DE69734426T2 - Filmkapazität und Halbleiterpackung oder Anordnung damit - Google Patents
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Description
- Die vorliegende Erfindung betrifft einen Schichtkondensator und ein Halbleiterbauelement und ein Gehäuse, das dieses trägt.
- Eine Maßnahme gegen Rauschen ist wichtig geworden, da ein Halbleiter-Chip mit hoher Geschwindigkeit arbeitet und hoch integriert ist. Insbesondere ist es erforderlich, einen Kondensator zwischen der Stromquelle und der Masse vorzusehen, um ein von einer elektrischen Stromzufuhrquelle hervorgerufenes Rauschen reduzieren zu können. Im allgemeinen befindet sich beim Stand der Technik der Kondensator außerhalb des Halbleiterbauelements und weit entfernt vom Halbleiter-Chip und daher reicht die Maßnahme gegen Rauschen nicht aus.
- Um dieses Problem zu lösen, kann ein Chip-Kondensator beispielsweise an einem vorderen Ende eines Anschlusses eines Anschlussrahmens angeordnet sein.
- Ist der Chip-Kondensator am vorderen Ende des Anschlussrahmens angeordnet, verkürzt sich der Abstand zum Halbleiter-Chip, so dass das Rauschen reduziert wird.
- Es ist allerdings mühsam, den Chip-Kondensator am vorderen Ende eines dünnen Anschlussrahmens zu anordnen, was daher zu einer Erhöhung der Herstellungskosten führt.
- In der DE-A-3724703 ist ein mehrschichtiger Keramikkondensator offenbart, der eine Vielzahl von Keramikschichten aufweist und bei dem sowohl auf einer unteren als auch einer oberen Schicht eine Metallelektrode aufgedruckt ist. Die inneren Keramikschichten weisen jeweils Öffnungen für eine Durchkontaktierung entweder zur oberen oder zur unteren Elektrodenschicht auf. Der Kondensator ist auf eine Leiterplatte unterhalb eines Halbleitergehäuses angeordnet. Das Gehäuse ist mit der Leiterplatte verbunden.
- In der EP-A-0397391 ist ein Halbleiter-Chipgehäuse offenbart, das Einrichtungen zum Anordnen eines Kondensators auf eine Oberfläche einer Abdeckung aufweist und den Kondensator mit einem Chip unter der Abdeckung elektrisch leitend verbindet.
- Somit soll die vorliegende Erfindung derartige Probleme des Standes der Technik lösen und es ist eine Aufgabe der Erfindung, ein Halbleiterbauelement zu schaffen, das einen Schichtkondensator umfasst, der leicht zu bedienen und anzuordnen ist und ein von einer elektrischen Stromzufuhrquelle hervorgerufenes Rauschen wirksam reduzieren kann.
- Erfindungsgemäß ist ein Halbleiterbauelement geschaffen worden, mit:
einem Halbleiter-Gehäuse; einem auf dem Gehäuse angeordneten Halbleiter-Chip; und einem Dünnschichtkondensator, der ein Substrat mit ersten und zweiten Flächen, eine plattierte Schicht, die auf der ersten Fläche des Substrats ausgebildet ist, um diese zu glätten, wobei die besagte plattierte Schicht entweder eine mit Nickel plattierte Schicht oder eine auf einer mit Chrom plattierten Schicht ausgebildete mit Nickel plattierte Schicht umfasst, eine erste Elektrodenschicht, die aus Palladium oder Platin besteht und direkt auf die plattierte Schicht durch Sputtern aufgebracht wird, eine auf der ersten Elektrodenschicht gebildete hoch dielektrische Schicht, eine auf der hoch dielektrischen Schicht gebildete zweite Elektrodenschicht und wenigstens einen externen Anschluss-punkt, der auf der zweiten Fläche des Substrats gegenüber der ersten Fläche, auf der die erste Elektrodenschicht gebildet ist, so ausgebildet ist, dass der besagte externe Anschlusspunkt mit der ersten Elektrodenschicht elektrisch leitend verbunden ist, umfasst, wobei der Halbleiter-Chip wenigstens eine Stromzufuhrkontaktfläche und eine Massekontaktfläche aufweist und der Dünnschichtkondensator auf dem Gehäuse so angeordnet ist, dass der externe Anschluss-punkt des Dünnschichtkondensators mit einer der Stromzufuhr- und Massekontaktflächen des Halbleiter-Chips elektrisch leitend verbunden ist. - Durch Bereitstellen der plattierten Schicht auf der Fläche des Substrats, um diese zu glätten, und Ausbilden der ersten Elektrodenschicht darauf ist es möglich, Poren in der ersten Elektrodenschicht zu beseitigen und deren Durchschlagsspannung zu erhöhen.
- Der externe Anschlusspunkt kann eine kugelförmige Ausbuchtung sein. Durch den Einsatz externer Anschlusspunkte wie z.B. kugelförmige Ausbuchtungen kann der Schichtkondensator leicht auf einer Stromzufuhrleitung und Masseleitung des Anschlussrahmens angeordnet werden, während er mit den Stromzufuhr- und Massekontaktflächen verbunden ist.
- Das Substrat kann aus wenigstens einem der Folgenden bestehen: einer Eisenlegierung, Kupfer bzw. Kupferlegierung, und die plattierte Schicht umfasst die mit Nickel plattierte Schicht nur als eine Nickelschicht. Andernfalls besteht das Substrat aus Polyimid und die plattierte Schicht umfasst die mit Nickel plattierte Schicht auf der mit Chrom plattierten Schicht.
- Das Halbleiterbauelement kann ferner einen zweiten externen Anschlusspunkt aufweisen, der auf der zweiten Fläche des Substrats gegenüber der ersten Fläche, auf der die erste Elektrodenschicht gebildet ist, so gebildet ist, dass der zweite externe Anschlusspunkt mit der zweiten Elektrodenschicht elektrisch leitend verbunden ist.
- Wenn der Halbleiter-Chip über eine Flip-Chip-Verbindung auf dem Gehäuse angeordnet ist, so dass der Schichtkondensator in einem Spalt zwischen dem Halbleiter-Chip und dem Gehäuse angeordnet ist, ist die Raumausnutzung erhöht.
- Die vorliegende Erfindung wird nachfolgend mit Bezug auf die bevorzugten Ausführungsformen, die in den beigefügten Zeichnungen dargestellt sind, näher erläutert; wobei:
-
1 eine seitliche Schnittansicht einer ersten Ausführungsform eines Schichtkondensators ist; -
2 eine erläuternde Darstellung eines Nachteils einer Sputter-Schicht ist; -
3 eine erläuternde Darstellung dafür ist, wenn eine Schicht auf einer Substratoberfläche plattiert ist; -
4 und5 jeweils einen Zustand darstellen, in dem ein Schichtkondensator an einem vorderen Ende eines Anschlussrahmens angeordnet ist; -
6 ,7 und8 jeweils seitliche Schnittansichten einer zweiten, dritten und vierten Ausführungsform des Schichtkondensators sind; -
9 und10 jeweils eine Draufsicht und eine Frontansicht auf den am Anschlussrahmen angeordneten Schichtkondensator sind; -
11 ,12 und13 jeweils erläuternde Darstellungen eines Zustands sind, bei dem der Schichtkondensator auf einem Gehäuseteil angeordnet ist; -
14 eine Draufsicht auf den auf den Halbleiter-Chip angeordneten Schichtkondensator ist; -
15 eine erläuternde Darstellung eines Zustands ist, bei dem der Schichtkondensator an einer frontseitigen Oberfläche des Halbleiter-Chips angeordnet und der Halbleiter-Chip über einen Flip verbunden ist; -
16 eine erläuternde Darstellung eines Zustands ist, bei dem der Schichtkondensator zwischen dem Halbleiter-Chip und dem Gehäuseteil angeordnet ist; und -
17 eine erläuternde Darstellung eines Zustands ist, bei dem der Schichtkondensator an einer rückseitigen Oberfläche des Halbleiter-Chips angeordnet ist. -
1 zeigt eine erste Ausführungsform eines Schichtkondensators10 . - Bezugsziffer
12 bezeichnet eine Polyimidschicht von ca. 10 μm Dicke, die als Substrat verwendet wird. Hier kann das Substrat außer der Polyimidschicht eine Epoxidschicht, eine Polyesterschicht oder eine andere Schicht sein. - Eine mit Chrom plattierte Schicht
14 mit mehreren μm Dicke ist auf der Polyimidschicht12 ausgebildet, und eine mit Nickel plattierte Schicht16 mit mehreren μm Dicke ist auf der mit Chrom plattierten Schicht14 ausgebildet. - Eine erste Elektrodenschicht
18 aus Palladium oder Platin von ca. 5000 Å Dicke ist durch ein Sputter-Verfahren auf der mit Nickel plattierten Schicht16 ausgebildet. - Eine hoch dielektrische Schicht
20 aus Strontiumtitanat oder Bariumtitanat von ca. 1 μm Dicke ist durch ein Sputter-Verfahren auf der ersten Elektrodenschicht18 ausgebildet. - Eine zweite Elektrodenschicht
22 aus Palladium oder Platin von ca. 5000 Å Dicke ist durch ein Sputter-Verfahren auf der hoch dielektrischen Schicht20 ausgebildet. Eine mit Kupfer plattierte Schicht24 von ca. 3 μm Dicke ist auf der zweiten Elektrodenschicht22 für die Verbindung mit Drähten ausgebildet. Die zweite Elektrodenschicht kann durch ein Epitaxialverfahren ausgebildet sein. - Eine Durchgangsöffnung
26 wird in einem geeigneten Bereich der Polyimidschicht12 durch einen Laserstrahl bereitgestellt, um die mit Chrom plattierte Schicht14 zu belichten, auf der eine kugelförmige Ausbuchtung28 gebildet ist, die eine Art externen Anschlusspunkt darstellt und den Schichtkondensator10 vervollständigt. Die kugelförmige Ausbuchtung28 wird gebildet, indem die Durchgangsöffnung mit Lot oder Nickel gefüllt und der ausgebauchte Bereich mit Gold plattiert wird. - Theoretisch könnte die erste Elektrodenschicht
18 durch direktes Sputtern auf die Polyimidschicht12 gebildet werden. - Weist jedoch die Oberfläche der Polyimidschicht eine kleine Unregelmäßigkeit auf, zum Beispiel eine unterschnittene Ausnehmung wie in
2 gezeigt, ist festgestellt worden, dass eine die Innenseite der Ausnehmung erreichende Schicht nicht durch das Sputtern gebildet wird und eine erforderte widerstandsfähige Spannung (oder Durchschlagsspannung) erzielt werden kann. - Um diesen Nachteil beseitigen zu können, wird erfindungsgemäß eine plattierte Schicht auf der Polyimidschicht
12 ausgebildet, wodurch es möglich ist, die erste E-lektrodenschicht10 , die keine Poren aufweist, auszubilden, indem das Sputter-Verfahren auf die plattierte Schicht14 ,16 ausgeführt wird (siehe3 ). - Es folgt ein Beispiel zur Herstellung des Schichtkondensators
10 :
Die mit Chrom plattierte Schicht14 , die mit Nickel plattierte Schicht16 , die erste Elektrodenschicht18 , die hoch dielektrische Schicht20 , die zweite Elektrodenschicht22 und die mit Kupfer plattierte Schicht werden nacheinander auf der Polyimidschicht12 wie vorstehend beschrieben in einer gewünschten Größe gebildet. Die Durchgangsöffnungen26 werden in einem vorbestimmten Muster in die Polyimidschicht12 gebohrt. Nachdem die kugelförmigen Ausbuchtungen28 in den jeweiligen Durchgangsöffnungen gebildet worden sind, wird die Polyimidschicht aufgeteilt, beispielsweise in ein Gittermuster, um gleichzeitig eine (nicht dargestellte) Anzahl von Schichtkondensatoren10 zu erhalten. - Ein im Folgenden beschriebener Schichtkondensator ist dem vorstehenden ähnlich.
- Da die kugelförmige Ausbuchtung
28 bei dem vorstehend genannten Schichtkondensator10 von der Polyimidschicht12 wegragt, kann der Schichtkondensator leicht an einem vorderen Ende eines dünnen Anschlusses eines Anschlussrahmens38 durch eine Selbstausrichtfunktion der kugelförmigen Ausbuchtung28 angeordnet werden, wenn diese am vorderen Ende des Anschlusses angeordnet und erhitzt wird, wie in den4 und5 dargestellt. - Um den Schichtkondensator
10 mit dem Anschluss sicher bonden zu können, kann eine Vielzahl von kugelförmigen Ausbuchtungen28 vorgesehen sein, wie in4 dargestellt. Während der Schichtkondensator10 auf den Anschlussrahmen38 angeordnet ist, der bei dieser Ausführungsform ein Beispiel für ein Gehäuse eines Halbleiterbauelements ist, kann er ohne weiteres auf ein Schaltungsmuster anderer (nicht dargestellter) Gehäuse wie z.B. einem Keramikgehäuse, einem Kunststoff-PGA oder BGA auf eine Weise angeordnet werden, die der vorstehend beschriebenen ähnelt. - Der Schichtkondensator
10 wird auf einer Stromzufuhrleitung oder einer Masseleitung des Anschlussrahmens38 angeordnet, während er damit über die kugelförmige Ausbuchtung28 leitend verbunden ist und ist über einen Draht mit einer Massekontaktfläche oder einer Stromzufuhrkontaktfläche eines auf dem Anschlussrahmen38 getragenen Halbleiter-Chips40 verbunden. Der Halbleiter-Chip40 ist mittels Harz abgedichtet, und somit ist ein Halbleiterbauelement einer mittels Harz abgedichteten Art vervollständigt. - Wird ein Keramikgehäuse, ein Kunstoff-PGA oder BGA-Gehäuse verwendet, kann das Gehäuse des Halbleiterbauelements mit einem (nicht dargestellten) Schichtkondensator selbstverständlich durch Anordnen des Schichtkondensators auf der Stromzufuhrleitung oder der Masseleitung auf die gleiche Weise wie vorstehend beschrieben erzielt werden. Ferner wird, nachdem ein Halbleiter-Chip auf einem derartigen Gehäuse eines Halbleiterbauelements angeordnet und wie erwünscht leitend verbunden worden ist, der Halbleiter-Chip mittels eines Harzes abgedichtet, um ein (nicht dargestelltes) Halbleiterbauelement zu vervollständigen.
-
6 zeigt eine zweite Ausführungsform eines Schichtkondensators10 , wobei gleiche Bezugsziffern für die Bezeichnung der gleichen Teile wie bei der vorhergehenden Ausführungsform verwendet werden und von einer Beschreibung derselben daher Abstand genommen wird. - Bei dieser Ausführungsform ist eine Schicht durch Sputtern oder Plattieren der Oberfläche der Polyimidschicht
12 und der Durchgangsöffnung26 in der Polyimidschicht12 ausgebildet. Die Schicht ist geätzt, so dass ein Schaltungsmuster27 gegeben ist, auf dem eine kugelförmige Ausbuchtung28 ausgebildet ist. - Es ergeben sich aus der vorstehend beschriebenen Ausführungsform der gleiche Vorgang und die gleiche Wirkung, und das Gehäuse des Halbleiterbauelements und das (nicht dargestellte) Halbleiterbauelement können wie vorstehend beschrieben erzielt werden.
- Da hier die kugelförmige Ausbuchtung
28 an einer geeigneten Stelle im Schaltungsmuster27 ausgebildet sein kann, erhöht sich ein Freiheitsgrad für die Bereitstellung der kugelförmigen Ausbuchtung28 . -
7 zeigt eine dritte Ausführungsform eines Schichtkondensators10 , wobei gleiche Bezugsziffern für die Bezeichnung der gleichen Teile wie bei der vorhergehenden Ausführungsform verwendet werden und von einer Beschreibung derselben daher Abstand genommen wird. - Bei dieser Ausführungsform werden als Substrat
29 Eisenlegierungen wie Legierung Nr. 42 (Eisen-/Nickellegierung), Kupfer oder Kupferlegierungen anstelle der Polyimidschicht29 verwendet. - Da die Ungleichmäßigkeit auch auf einer Oberfläche aus einem derartigen Metallsubstrat
29 besteht, ist eine mit Nickel plattierte Schicht16 darauf ausgebildet, und eine erste Elektrodenschicht18 wird darauf durch ein Sputter-Verfahren ausgebildet. - Eine Lötabdecklackschicht
30 ist auf der Unterfläche des Substrats29 ausgebildet, in der an einer geeigneten Stelle mittels Lithographie eine Durchgangsöffnung geschaffen worden ist. Eine kugelförmige Ausbuchtung28 ist in der Durchgangsöffnung ausgebildet, um einen externen Anschlusspunkt zu schaffen. - Es ergeben sich aus der vorstehend beschriebenen Ausführungsform der gleiche Vorgang und die gleiche Wirkung, und ein Gehäuse des Halbleiterbauelements und ein (nicht dargestelltes) Halbleiterbauelement können daraus ebenfalls gebildet werden.
-
8 zeigt eine vierte Ausführungsform eines Schichtkondensators10 , wobei gleiche Bezugsziffern für die Bezeichnung der gleichen Teile wie bei der vorhergehenden Ausführungsform verwendet werden und von einer Beschreibung derselben daher Abstand genommen wird. - Bei dieser Ausführungsform ist eine kugelförmige Ausbuchtung
32 an der Unterfläche der Polyimidschicht12 der ersten Ausführungsform für die leitende Verbindung mit einer zweiten Elektrodenschicht22 in gleicher Weise wie bei der ersten Ausführungsform vorgesehen. - Die kugelförmige Ausbuchtung
32 wird geschaffen, nachdem die mit Chrom plattierte Schicht14 und die mit Nickel plattierte Schicht16 auf der Polyimidschicht12 gebildet worden sind, indem eine Durchgangsöffnung34 durch die Polyimidschicht12 , die mit Chrom plattierte Schicht14 und die mit Nickel plattierte Schicht16 mittels eines Laserstrahls gebildet wird, und eine erste Elektrodenschicht18 wird auf der mit Nickel plattierten Schicht16 durch Sputtern ausgebildet, während die Durchgangsöffnung34 abgedeckt wird. Danach wird eine hoch dielektrische Schicht20 , die zur Innenwand der Durchgangsöffnung34 verläuft, mittels Sputtern geschaffen und dient als Isolierschicht. Da hier die Dicke der Polyimidschicht12 , der mit Chrom plattierten Schicht14 und der mit Nickel plattierten Schicht16 tatsächlich extrem dünn ist, wie vorstehend beschrieben, und die Tiefe der Durchgangsöffnung34 ebenfalls gering ist, wird die Schicht selbst an der Innenwand der Durchgangsöffnung34 durch dieses Sputtern gebildet. - Als nächstes wird eine zweite Elektrodenschicht
22 auf der hoch dielektrischen Schicht20 vorgesehen und eine mit Kupfer plattierte Schicht24 wird darauf ausgebildet. - Die kugelförmige Ausbuchtung
32 wird im Inneren der Durchgangsöffnung34 gebildet und ragt aus der Unterfläche der Polyimidschicht12 heraus. Die kugelförmige Ausbuchtung28 wird auf gleiche Weise wie vorstehend beschrieben gebildet. - Ein Schichtkondensator
10 gemäß dieser Ausführungsform wird ohne weiteres in ein Gehäuse eines Halbleiterbauelements wie in den9 und10 gezeigt eingefügt, indem er über die kugelförmigen Ausbuchtungen28 und32 an eine Stromzufuhrleitung38a und eine Masseleitung38b angeordnet wird. - Da ein Abstand zwischen benachbarten Anschlüssen zu einem vorderen Ende wie dargestellt gewöhnlich enger wird, ist es möglich, den Schichtkondensator an einer geeigneten Stelle anzuordnen, bei der ein Abstand zwischen den kugelförmigen Ausbuchtungen
28 und32 mit dem zwischen den Anschlüssen übereinstimmt, die dann erhitzt und an den Anschlussrahmen gebondet werden. Somit kann der Schichtkondensator ohne weiteres auf jeden der Anschlussrahmen angeordnet werden. - Auf diese Weise wird der Halbleiter-Chip mittels Harz abgedichtet, um ein Halbleitergehäuse zu vervollständigen.
- Die
11 und12 zeigen ein Gehäuse, das gebildet wird, indem ein Schichtkondensator10 auf einer Stromzufuhrleitung39a und einer Masseleitung39b eines Gehäuseteils39 aus Keramik oder Kunststoff angeordnet wird. Wird ein Chip40 auf diesem Gehäuse angeordnet und mit einem Schaltungsmuster über Drähte oder dergleichen leitend verbunden und mit einer Kappe41 abgedichtet, ist ein Halbleiterbauelement vollständig.13 zeigt ein Beispiel, bei dem der Schichtkondensator10 auf einer Stromzufuhrleitung43a und einer Masseleitung43b eines Teils43 eines PBGA-Gehäuses angeordnet ist, um ein Gehäuse für ein Halbleiterbauelement zu bilden. Wenn ein Halbleiter-Chip40 darauf angeordnet, wie erwünscht leitend verbunden und mittels eines Harzes44 abgedichtet wird, ist das Halbleiterbauelement vollständig. -
14 zeigt einen Halbleiter-Chip40 , der einen Schichtkondensator10 trägt. - Kontaktflächen
42 sind in einem vorbestimmten Muster auf dem Halbleiter-Chip40 angeordnet. Davon sind eine Stromzufuhrkontaktfläche42a und eine Massekontaktfläche42b so angeordnet, dass der Abstand zwischen ihnen der gleiche ist, wie derjenige zwischen den beiden kugelförmigen Ausbuchtungen28 und32 . - Somit ist es möglich, den Schichtkondensator
10 über die kugelförmigen Ausbuchtungen28 und32 an der Stromzufuhrkontaktfläche42a und der Massekontaktfläche42b anzuordnen und leitend damit zu verbinden. - Gemäß dieser Ausführungsform ist es möglich, da der Schichtkondensator
10 direkt auf dem Halbleiter-Chip40 angeordnet ist, ein von der Stromzufuhr herrührendes Rauschen effektiv zu mindern. Die Anordnung des Schichtkondensators10 auf dem Halbleiter-Chip40 ist ebenfalls erleichtert worden. - Es können unterschiedliche Halbleiterbauelemente erzielt werden, indem Halbleiter-Chips
40 , die diese Schichtkondensatoren10 tragen, zu gewünschten Gehäusen in abgedichteter Weise angeordnet werden. Selbstverständlich kann die vorliegende Erfindung nicht nur auf mittels Harz abgedichtete Halbleiterbauelemente angewendet werden, sondern auch auf jene, die ein Keramikgehäuse oder andere verwenden. -
15 zeigt einen Fall, bei dem ein Halbleiter-Chip40 mit einem Schichtkondensator10 wie vorstehend beschrieben mittels einer Flip-Chip-Verbindung mit einem Gehäu seteil43 verbunden ist. Gemäß dieser Ausführungsform wird ein Zwischenraum effektiv genutzt, da der Schichtkondensator10 in einem Spalt zwischen dem Halbleiter-Chip40 und dem Gehäuseteil43 untergebracht ist. -
16 zeigt ein ähnliches Halbleiterbauelement, wobei der Halbleiter-Chip40 über eine Flip-Chip-Verbindung mit dem Gehäuseteil43 verbunden ist. Bei dieser Ausführungsform ist der Schichtkondensator10 jedoch in einem Zwischenraum zwischen dem Halbleiter-Chip40 und dem Gehäuseteil43 angeordnet, während er sich über die Stromzufuhrleitung und die Masseleitung des Gehäuseteils43 erstreckt. Auch bei dieser Ausführungsform kann ein Zwischenraum effektiv genutzt werden. In diesem Fall kann der auf dem Gehäuseteil43 anzuordnende Schichtkondensator10 jeder der in der ersten bis dritten Ausführungsform gezeigten sein. Die zweite (nicht dargestellte) Elektrodenschicht ist mit einer Stromzufuhrkontaktfläche oder einer Massekontaktfläche, die im Halbleiter-Chip40 vorgesehen sind, verbunden. - Bei den vorstehenden Ausführungsformen, bei denen der Schichtkondensator
10 direkt auf dem Halbleiter-Chip40 angeordnet ist, wird der Schichtkondensator10 auf der frontseitigen Oberfläche des Halbleiter-Chips40 getragen. -
17 zeigt einen Halbleiter-Chip40 , der an einer rückseitigen Oberfläche einen Schichtkondensator10 trägt. In diesem Fall werden eine Stromzufuhrkontaktfläche und eine Massekontaktfläche auf die rückseitige Oberfläche des Halbleiter-Chips40 herausgeführt, und der Schichtkondensator10 ist so angeordnet, dass er sich über die Stromzufuhrkontaktfläche und die Massekontaktfläche erstreckt und leitend damit über externe Anschlusspunkte davon verbunden ist. Vorzugsweise wird ein aus der Stromzufuhrleitung herausgeführtes Schaltungsmuster45 mit einer Stromzufuhrleitung eines Gehäuseteils43 verbunden. Bei dieser Ausführungsform ist es ebenfalls möglich, das von der Stromzufuhr herrührende Rauschen zu reduzieren, da der Schichtkondensator10 direkt auf dem Halbleiter-Chip40 angeordnet ist. Da die rückseitige Oberfläche des Halbleiter-Chips40 effektiv genutzt ist, können die Schal tungsmuster auf der vorderen Fläche des Halbleiter-Chips40 in hoher Dichte vorgesehen sein. - Es könnte ein Halbleiter-Chip mit einem (nicht dargestellten) Schichtkondensator gebildet werden, indem irgend einer der mit Bezug auf die erste bis vierte Ausführungsform vorstehend beschriebenen Schichtkondensatoren auf einer Massekontaktfläche oder einer Stromzufuhrkontaktfläche angeordnet wird, die zur rückseitigen Oberfläche des Halbleiter-Chips
40 geführt werden. In diesem Fall wird eine zweite Elektrode des Schichtkondensators10 mit der Stromzufuhrleitung oder der Masseleitung des Gehäuseteils43 über Drähte leitend verbunden. Bei dieser Ausführungsform kann das von der Stromquelle herrührende Rauschen ebenfalls gemindert werden und die Schaltungsmuster können an der frontseitigen Oberfläche des Halbleiter-Chips40 in hoher Dichte vorgesehen sein. - Gemäß dem erfindungsgemäßen Schichtkondensator ist, da externe Anschlusspunkte für die leitende Verbindung mit einer ersten Elektrodenschicht auf einer Oberfläche eines Substrats ausgebildet sind, das dem gegenüber liegt, auf dem die erste Elektrodenschicht ausgebildet ist, dessen Anordnung auf einem Schaltungsmuster eines Gehäuses eines Halbleiterbauelements, wie z.B. ein vorderes Ende eines Anschlusses eines Anschlussrahmens, erleichtert worden. Es ist auch ein Halbleiterbauelement geschaffen worden, welches das von einer Stromquelle herrührende Rauschen mindert.
- Da ferner externe Anschlusspunkte an einer Oberfläche des Substrats gegenüber dem, auf dem die erste Elektrodenschicht ausgebildet ist, zur leitenden Verbindung jeweils mit der ersten Elektrodenschicht und einer zweiten Elektrodenschicht vorgesehen sind, kann der Schichtkondensator ohne weiteres auf einer Stromzufuhrleitung oder einer Masseleitung eines Gehäuses, wie z.B. ein Anschlussrahmen, ein Halbleiterbauelement oder eine Stromzufuhrkontaktfläche oder eine Massekontaktfläche eines Halbleiter-Chips angeordnet sein. Ebenso ist ein Halbleiterbauelement geschaffen worden, welches das von einer Stromquelle herrührende Rauschen mindert.
Claims (10)
- Halbleiterbauelement, mit: einem Halbleiter-Gehäuse (
43 ); einem auf dem Gehäuse (43 ) montierten Halbleiter-Chip (40 ); und einem Dünnschichtkondensator (10 ), der ein Substrat (12 ) mit ersten und zweiten Flächen, eine plattierte Schicht, die auf der ersten Fläche des Substrats (12 ) ausgebildet ist, um diese zu glätten, wobei die besagte plattierte Schicht entweder eine mit Nickel plattierte Schicht (16 ) oder eine auf einer mit Chrom plattierten Schicht (14 ) ausgebildete mit Nickel plattierte Schicht (16 ) umfasst, eine erste Elektrodenschicht (18 ), die aus Palladium oder Platin besteht und direkt auf die plattierte Schicht (16 ;14 ,16 ) durch Sputtern aufgebracht wird, eine auf der ersten Elektrodenschicht (18 ) gebildete hoch dielektrische Schicht (20 ), eine auf der hoch dielektrischen Schicht (20 ) gebildete zweite Elektrodenschicht (22 ) und wenigstens einen externen Anschlusspunkt (28 ), der auf der zweiten Fläche des Substrats (12 ) gegenüber der ersten Fläche, auf der die erste Elektrodenschicht (18 ) gebildet ist, so ausgebildet ist, dass der besagte externe Anschlusspunkt (28 ) mit der ersten Elektrodenschicht (18 ) elektrisch leitend verbunden ist, umfasst, wobei der Halbleiter-Chip (40 ) wenigstens eine Stromzufuhrkontaktfläche (42a ) und eine Massekontaktfläche (42b ) aufweist und der Dünnschichtkondensator (10 ) auf dem Gehäuse (43 ) so montiert ist, dass der externe Anschlusspunkt (28 ) des Dünnschichtkondensators (10 ) mit einer der Stromzufuhr- und Massekontaktflächen (42a ,42b ) des Halbleiter-Chips (40 ) elektrisch leitend verbunden ist. - Halbleiterbauelement nach Anspruch 1, wobei der externe Anschlusspunkt (
28 ) eine kugelförmige Ausbuchtung ist. - Halbleiterbauelement nach Anspruch 1 oder 2, wobei das Substrat (
12 ) aus wenigstens einem der Folgenden besteht: einer Eisenlegierung, Kupfer bzw. Kupferlegierung und die plattierte Schicht die mit Nickel plattierte Schicht (16 ) nur als Nickelschicht umfasst. - Halbleiterbauelement nach Anspruch 1 oder 2, wobei das Substrat (
12 ) aus Polyimid besteht und die plattierte Schicht die mit Nickel plattierte Schicht (16 ) auf der mit Chrom plattierten Schicht (14 ) umfasst. - Halbleiterbauelement nach einem der Ansprüche 1 bis 4, wobei der Dünnschichtkondensator (
10 ) ferner einen zweiten externen Anschlusspunkt (32 ) aufweist, der auf der zweiten Fläche des Substrats (12 ) so ausgebildet ist, dass der zweite externe Anschlusspunkt (32 ) mit der zweiten Elektrodenschicht (22 ) elektrisch leitend verbunden ist. - Halbleiterbauelement nach einem der Ansprüche 1 bis 5, wobei der Halbleiter-Chip (
40 ) über eine Flip-Chip-Verbindung auf dem Gehäuse (43 ) montiert ist und der Dünnschichtkondensator (10 ) so auf dem Gehäuse (43 ) montiert ist, dass der Dünnschichtkondensator (10 ) in einem Spalt zwischen dem Gehäuse (43 ) und dem Halbleiter-Chip (40 ) angeordnet ist. - Halbleiterbauelement nach einem der Ansprüche 1 bis 5, wobei der Halbleiter-Chip (
40 ) über eine Flip-Chip-Verbindung auf dem Gehäuse (43 ) montiert ist und der Dünnschichtkondensator (10 ) so auf dem Halbleiter-Chip (40 ) montiert ist, dass der Dünnschichtkondensator (10 ) in einem Spalt zwischen dem Gehäuse (43 ) und dem Halbleiter-Chip (40 ) angeordnet ist. - Halbleiterbauelement nach Anspruch 5, wobei der Halbleiter-Chip (
40 ) auf dem Gehäuse (43 ) und der Dünnschichtkondensator (10 ) auf dem Halbleiter-Chip (40 ) an einer Seite des Halbleiter-Chips (40 ), die dem Gehäuse (43 ) gegenüber liegt, montiert ist, wobei die Stromzufuhrkontaktfläche (42a ) und die Massekontaktfläche (42b ) auf der besagten Seite des Halbleiter-Chips (40 ) so ausgebildet sind, dass der Dünnschichtkondensator (10 ) die Stromzufuhr- und Massekontaktflächen (42a ,42b ) überdeckt und mit ihnen über deren ersten und zweiten externen Anschlusspunkt (28 ,32 ) elektrisch leitend verbunden ist. - Halbleiterbauelement nach Anspruch 5, wenn abhängig von Anspruch 2, wobei Kontaktflächen (
42 ) an vorab bestimmten Positionen am Halbleiter-Chip (40 ) angeordnet sind und der zweite externe Anschlusspunkt (32 ) eine kugelförmige Ausbuchtung ist, so dass die Stromzufuhrkontaktfläche (42a ) und die Massekontaktfläche (42b ) aus den Kontaktflächen (42 ) ausgewählt werden, wobei ein Abstand zwischen der ausgewählten Stromzufuhrkontaktfläche (42a ) und der Massekontaktfläche (42b ) dem Abstand zwischen dem kugelförmig ausgebuchteten externen Anschlusspunkt (28 ) und dem zweiten kugelförmig ausgebuchteten Anschlusspunkt (32 ) gleich ist. - Halbleiterbauelement nach Anspruch 5, wenn abhängig von Anspruch 2, wobei der zweite externe Anschlusspunkt (
32 ) eine kugelförmige Ausbuchtung ist, wobei der Schichtkondensator (10 ) über den kugelförmig ausgebuchteten externen Anschlusspunkt (28 ) und den zweiten kugelförmig ausgebuchteten Anschlusspunkt (32 ) mit einer Stromzufuhrleitung (38a ) und einer Masseleitung (38b ) eines Anschlussrahmens (38 ) jeweils elektrisch leitend verbunden ist, wobei der Anschlussrahmen (38 ) im Halbleiter-Gehäuse eingebaut und zur Vervollständigung des Halbleiterbauelements mittels Harz abgedichtet ist.
Applications Claiming Priority (2)
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---|---|---|---|
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Publications (2)
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---|---|
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DE69734426T Expired - Fee Related DE69734426T2 (de) | 1996-11-08 | 1997-11-05 | Filmkapazität und Halbleiterpackung oder Anordnung damit |
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Families Citing this family (12)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP4502564B2 (ja) * | 1999-12-24 | 2010-07-14 | 富士通株式会社 | フリップチップ実装された半導体ベアチップを有する半導体装置、及びフリップチップ実装された半導体ベアチップ用の薄膜構造コンデンサ付き基板部材 |
US6452250B1 (en) * | 2000-01-20 | 2002-09-17 | Advanced Micro Devices, Inc. | Stacked integrated circuit and capacitor structure containing via structures |
US7064412B2 (en) * | 2000-01-25 | 2006-06-20 | 3M Innovative Properties Company | Electronic package with integrated capacitor |
US20020127771A1 (en) * | 2001-03-12 | 2002-09-12 | Salman Akram | Multiple die package |
US6512301B1 (en) * | 2001-07-12 | 2003-01-28 | Intel Corporation | Making interconnections to a non-flat surface |
US6806568B2 (en) * | 2001-07-20 | 2004-10-19 | The Board Of Trustees Of The University Of Arkansas | Decoupling capacitor for integrated circuit package and electrical components using the decoupling capacitor and associated methods |
US7355420B2 (en) * | 2001-08-21 | 2008-04-08 | Cascade Microtech, Inc. | Membrane probing system |
JP4077261B2 (ja) * | 2002-07-18 | 2008-04-16 | 富士通株式会社 | 半導体装置 |
US7229875B2 (en) * | 2002-10-17 | 2007-06-12 | Samsung Electronics Co., Ltd. | Integrated circuit capacitor structure |
KR100480641B1 (ko) * | 2002-10-17 | 2005-03-31 | 삼성전자주식회사 | 고 커패시턴스를 지니는 금속-절연체-금속 커패시터, 이를구비하는 집적회로 칩 및 이의 제조 방법 |
JP4674606B2 (ja) * | 2005-10-18 | 2011-04-20 | 株式会社村田製作所 | 薄膜キャパシタ |
US10217810B2 (en) * | 2015-12-07 | 2019-02-26 | Microchip Technology Incorporated | Capacitor formed on heavily doped substrate |
Family Cites Families (10)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4494169A (en) * | 1983-11-14 | 1985-01-15 | Rogers Corporation | Decoupling capacitor and method of manufacture thereof |
US4667267A (en) * | 1985-01-22 | 1987-05-19 | Rogers Corporation | Decoupling capacitor for pin grid array package |
GB2176654B (en) * | 1985-06-11 | 1988-08-10 | Avx Corp | Method for optimising the decoupling of integrated circuit devices |
JPS631340A (ja) | 1986-06-20 | 1988-01-06 | Nippon Seiko Kk | 非接触支持モ−タ装置 |
JPH0828558B2 (ja) | 1988-03-30 | 1996-03-21 | 株式会社日立製作所 | セラミツク基板及びその製造方法 |
US5043533A (en) * | 1989-05-08 | 1991-08-27 | Honeywell Inc. | Chip package capacitor cover |
JP3033972B2 (ja) * | 1989-06-15 | 2000-04-17 | 日本特殊陶業株式会社 | アルミナ多層配線基板及びその製造方法 |
US5144526A (en) * | 1991-08-05 | 1992-09-01 | Hughes Aircraft Company | Low temperature co-fired ceramic structure containing buried capacitors |
US5767564A (en) * | 1993-10-19 | 1998-06-16 | Kyocera Corporation | Semiconductor device with a decoupling capacitor mounted thereon having a thermal expansion coefficient matched to the device |
US5590017A (en) * | 1995-04-03 | 1996-12-31 | Aluminum Company Of America | Alumina multilayer wiring substrate provided with high dielectric material layer |
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