DE69318894T2 - Gehäuse einer elektronischen Vorrichtung mit einem metallischen Insert und Verfahren zur Oberflächenaufrauhung des Inserts - Google Patents
Gehäuse einer elektronischen Vorrichtung mit einem metallischen Insert und Verfahren zur Oberflächenaufrauhung des InsertsInfo
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- DE69318894T2 DE69318894T2 DE69318894T DE69318894T DE69318894T2 DE 69318894 T2 DE69318894 T2 DE 69318894T2 DE 69318894 T DE69318894 T DE 69318894T DE 69318894 T DE69318894 T DE 69318894T DE 69318894 T2 DE69318894 T2 DE 69318894T2
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- 238000000034 method Methods 0.000 title claims description 59
- 238000007788 roughening Methods 0.000 title claims description 10
- 238000007747 plating Methods 0.000 claims description 42
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 claims description 33
- PXHVJJICTQNCMI-UHFFFAOYSA-N Nickel Chemical compound [Ni] PXHVJJICTQNCMI-UHFFFAOYSA-N 0.000 claims description 28
- 238000005469 granulation Methods 0.000 claims description 24
- 230000003179 granulation Effects 0.000 claims description 24
- 229910052751 metal Inorganic materials 0.000 claims description 24
- 239000002184 metal Substances 0.000 claims description 24
- 239000010949 copper Substances 0.000 claims description 23
- 229910052802 copper Inorganic materials 0.000 claims description 21
- 229910000990 Ni alloy Inorganic materials 0.000 claims description 20
- 229920005989 resin Polymers 0.000 claims description 19
- 239000011347 resin Substances 0.000 claims description 19
- 229910045601 alloy Inorganic materials 0.000 claims description 18
- 239000000956 alloy Substances 0.000 claims description 18
- 229910052759 nickel Inorganic materials 0.000 claims description 14
- 229910020938 Sn-Ni Inorganic materials 0.000 claims description 9
- 229910008937 Sn—Ni Inorganic materials 0.000 claims description 9
- 229910000881 Cu alloy Inorganic materials 0.000 claims description 6
- 229910001030 Iron–nickel alloy Inorganic materials 0.000 claims description 5
- 238000004381 surface treatment Methods 0.000 claims description 5
- 238000000465 moulding Methods 0.000 claims description 4
- 238000009713 electroplating Methods 0.000 description 9
- 239000010410 layer Substances 0.000 description 9
- 150000001875 compounds Chemical class 0.000 description 7
- 238000004519 manufacturing process Methods 0.000 description 6
- 230000004888 barrier function Effects 0.000 description 5
- 239000011342 resin composition Substances 0.000 description 5
- 238000000635 electron micrograph Methods 0.000 description 3
- TXUICONDJPYNPY-UHFFFAOYSA-N (1,10,13-trimethyl-3-oxo-4,5,6,7,8,9,11,12,14,15,16,17-dodecahydrocyclopenta[a]phenanthren-17-yl) heptanoate Chemical compound C1CC2CC(=O)C=C(C)C2(C)C2C1C1CCC(OC(=O)CCCCCC)C1(C)CC2 TXUICONDJPYNPY-UHFFFAOYSA-N 0.000 description 2
- 229910020630 Co Ni Inorganic materials 0.000 description 2
- 229910002440 Co–Ni Inorganic materials 0.000 description 2
- 229910003271 Ni-Fe Inorganic materials 0.000 description 2
- 229910021626 Tin(II) chloride Inorganic materials 0.000 description 2
- 238000003486 chemical etching Methods 0.000 description 2
- 239000004020 conductor Substances 0.000 description 2
- 238000001259 photo etching Methods 0.000 description 2
- NNFCIKHAZHQZJG-UHFFFAOYSA-N potassium cyanide Chemical compound [K+].N#[C-] NNFCIKHAZHQZJG-UHFFFAOYSA-N 0.000 description 2
- 238000003825 pressing Methods 0.000 description 2
- 235000011150 stannous chloride Nutrition 0.000 description 2
- 239000001119 stannous chloride Substances 0.000 description 2
- 229920003002 synthetic resin Polymers 0.000 description 2
- 239000000057 synthetic resin Substances 0.000 description 2
- 229910000851 Alloy steel Inorganic materials 0.000 description 1
- 241000519995 Stachys sylvatica Species 0.000 description 1
- 229910000831 Steel Inorganic materials 0.000 description 1
- LDDQLRUQCUTJBB-UHFFFAOYSA-O azanium;hydrofluoride Chemical compound [NH4+].F LDDQLRUQCUTJBB-UHFFFAOYSA-O 0.000 description 1
- 230000000052 comparative effect Effects 0.000 description 1
- DOBRDRYODQBAMW-UHFFFAOYSA-N copper(i) cyanide Chemical compound [Cu+].N#[C-] DOBRDRYODQBAMW-UHFFFAOYSA-N 0.000 description 1
- 238000005520 cutting process Methods 0.000 description 1
- 238000000151 deposition Methods 0.000 description 1
- 230000008021 deposition Effects 0.000 description 1
- 238000004070 electrodeposition Methods 0.000 description 1
- 239000003822 epoxy resin Substances 0.000 description 1
- 238000011156 evaluation Methods 0.000 description 1
- 230000008020 evaporation Effects 0.000 description 1
- 238000001704 evaporation Methods 0.000 description 1
- PCHJSUWPFVWCPO-UHFFFAOYSA-N gold Chemical compound [Au] PCHJSUWPFVWCPO-UHFFFAOYSA-N 0.000 description 1
- 229910052737 gold Inorganic materials 0.000 description 1
- 239000010931 gold Substances 0.000 description 1
- QMMRZOWCJAIUJA-UHFFFAOYSA-L nickel dichloride Chemical compound Cl[Ni]Cl QMMRZOWCJAIUJA-UHFFFAOYSA-L 0.000 description 1
- 239000002245 particle Substances 0.000 description 1
- 229920000647 polyepoxide Polymers 0.000 description 1
- 238000004080 punching Methods 0.000 description 1
- 230000003014 reinforcing effect Effects 0.000 description 1
- 229910052709 silver Inorganic materials 0.000 description 1
- 239000004332 silver Substances 0.000 description 1
- PUZPDOWCWNUUKD-UHFFFAOYSA-M sodium fluoride Chemical compound [F-].[Na+] PUZPDOWCWNUUKD-UHFFFAOYSA-M 0.000 description 1
- 239000010959 steel Substances 0.000 description 1
- 239000002344 surface layer Substances 0.000 description 1
- 230000003746 surface roughness Effects 0.000 description 1
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-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/495—Lead-frames or other flat leads
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/495—Lead-frames or other flat leads
- H01L23/49579—Lead-frames or other flat leads characterised by the materials of the lead frames or layers thereon
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
- H01L21/02—Manufacture or treatment of semiconductor devices or of parts thereof
- H01L21/04—Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
- H01L21/48—Manufacture or treatment of parts, e.g. containers, prior to assembly of the devices, using processes not provided for in a single one of the subgroups H01L21/06 - H01L21/326
- H01L21/4814—Conductive parts
- H01L21/4821—Flat leads, e.g. lead frames with or without insulating supports
-
- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L2924/00—Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
- H01L2924/0001—Technical content checked by a classifier
- H01L2924/0002—Not covered by any one of groups H01L24/00, H01L24/00 and H01L2224/00
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- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10T—TECHNICAL SUBJECTS COVERED BY FORMER US CLASSIFICATION
- Y10T428/00—Stock material or miscellaneous articles
- Y10T428/12—All metal or with adjacent metals
- Y10T428/12014—All metal or with adjacent metals having metal particles
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
- Y10T—TECHNICAL SUBJECTS COVERED BY FORMER US CLASSIFICATION
- Y10T428/00—Stock material or miscellaneous articles
- Y10T428/12—All metal or with adjacent metals
- Y10T428/12014—All metal or with adjacent metals having metal particles
- Y10T428/12028—Composite; i.e., plural, adjacent, spatially distinct metal components [e.g., layers, etc.]
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- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- General Physics & Mathematics (AREA)
- Condensed Matter Physics & Semiconductors (AREA)
- Computer Hardware Design (AREA)
- Microelectronics & Electronic Packaging (AREA)
- Physics & Mathematics (AREA)
- Manufacturing & Machinery (AREA)
- Lead Frames For Integrated Circuits (AREA)
- Structures Or Materials For Encapsulating Or Coating Semiconductor Devices Or Solid State Devices (AREA)
- Encapsulation Of And Coatings For Semiconductor Or Solid State Devices (AREA)
- Electroplating Methods And Accessories (AREA)
- Chemically Coating (AREA)
- Injection Moulding Of Plastics Or The Like (AREA)
Description
- Die vorliegende Erfindung betrifft eine Metalleinlage oder ein metallisches Insert, die bzw. das mindestens teilweise in eine geformte Harzmasse eingebettet ist, und die Erfindung betrifft ferner ein Verfahren der Oberflächenbehandlung zum Aufrauhen von Oberflächen von solchen Metalleinlagen bzw. metallischen Inserten.
- Beispielsweise ist allgemein bekannt, als Metalleinlage, die teilweise in einer geformten Harzmasse eingebettet ist, einen Leiterrahmen zur Herstellung von elektronischen Komponenten oder elektronischen Bauteilen zu verwenden. Im allgemeinen weist der Leiterrahmen eine zentrale Bühne zum Aufbringen eines elektrischen Elementes, wie zum Beispiel eines integrierten Schaltungs- (IC)- Chips auf, sowie einer Vielzahl von Leiterelementen, die rund um die zentrale Bühne angeordnet sind. Bei der Herstellung von elektronischen Bauteilen wird der IC-Chip sicher auf der zentralen Bühne des Leiterrahmens befestigt und dann elektrisch mit den inneren Enden der Leiterelemente nach einem allgemein bekannten Drahtverbindungsprozeß verbunden. Daraufhin wird die zentrale Bühne mit dem IC-Chip gemeinsam mit den inneren Enden der Leiterelemente mittels einer mehrteiligen Form (split mold) eingeschlossen, worauf ein geeignetes härtbares synthetisches Harz in die mehrteilige Form eingeführt wird. Somit wird der IC-Chip in der geformten Harzmasse in einer solchen Weise versiegelt, daß der Leiterrahmen teilweise hierin eingebettet ist.
- Der Leiterrahmen kann aus einer dünnen Cu-Platte, Cu-Legierungsplatte, Ni-Fe-Legierungsplatte oder dergleichen nach einem mechanischen Stanzprozeß oder einem Photoätzprozeß hergestellt werden, und er wird einer Oberflächenbehandlung unterworfen, um die Adhäsionseigenschaften bezüglich der geformten Harzmasse zu verbessern. Beispielsweise werden die Oberflächen des Leiterrahmens durch ein mechanisches Preßverfahren oder einen chemischen Ätzprozeß aufgerauht, so daß die Kontaktfläche zwischen dem Leiterrahmen und der Harzformmasse erhöht wird, so daß der Leiterrahmen verbesserte Adhäsionseigenschaften gegenüber der Harzformmasse aufweist. Wird der Leiterrahmen keiner Oberflächen-Aufrauhungsbehandlung unterworfen, so kann leicht Feuchtigkeit in die Grenzfläche zwischen dem Leiterrahmen und der Harzformmasse eintreten, so daß Risse in der geformten Harzmasse auftreten können aufgrund der Verdampfung der eingedrungenen Feuchtigkeit.
- Trotzdem wird, wenn der Leiterrahmen der Oberflächen-Aufrauhungsbehandlung durch den mechanischen Preßprozeß unterworfen wird, eine restliche Verformung in dem gepreßten Leiterrahmen erzeugt, die sich in dem Leiterrahmen unter dem thermischen Einfluß des Verformungsprozesses als Verwerfung zu erkennen gibt. Auch ist es bei dem chemischen Ätzprozeß der Oberflächen-Aufrauhungsbehandlung sehr schwierig und mühsam, den Grad der Rauhheit zu steuern, ohne die Festigkeit des Leiterrahmens zu vermindern.
- Es ist ferner vorgeschlagen worden, eine rauhe Oberflächenschicht durch Elektroabscheidung zu erzeugen. Ein Beispiel hierfür ist die JP-A-2 308 555. Ein weiteres Beispiel ist die JP-A-5 913 6957, in der die Abscheidung einer Nickelschicht beschrieben wird, um eine Schicht mit Teilchen mit einer Größe von ungefähr 1 um und einer Oberflächenrauhheit von 0,5 um zu erzeugen.
- Nach einem ersten Aspekt dieser Erfindung weist eine elektronische Baugruppe auf:
- eine Metalleinlage, die mindestens teilweise in eine geformte Harzmasse eingebettet ist;
- eine Schicht aus Kupferkernen auf der Oberfläche der Metalleinlage, wobei die Schicht eine mittlere Dicke von etwa 0,5 bis etwa 1,0 um aufweist,
- eine Schicht aus Nickel- oder Nickellegierungs-Granulierungen über der Kupferschicht, wobei die Nickel- oder Nickellegierungsschicht eine mittlere Dicke von etwa 0,5 bis etwa 1,5 um aufweist, wobei die Größe der Nickelgranulierungen höchstens 1,0 um beträgt.
- Gemäß einem zweiten Aspekt dieser Erfindung umfaßt ein Verfahren der Oberflächenbehandlung zum Aufrauhen einer Metalleinlage für eine mindestens teilweise Einbettung in eine geformte Harzmasse die Stufen:
- der Herstellung einer Schicht aus Kupferkernen über der Oberfläche einer Metalleinlage durch Steuerung eines elektrolytischen Kupfer-Plattierungsprozesses derart, daß die mittlere Dicke der Kupferschicht bei etwa 0,5 bis etwa 1,0 um liegt; und
- das Wachsenlassen der Nickel- oder Nickellegierungs-Granulierungen auf den Kupferkernen durch Steuerung eines elektrolytischen Nickel-Plattierungsprozesses derart, daß die mittlere Dicke der Plattierung bei etwa 0,5 bis etwa 1,5 um liegt, wobei die Nickel- oder Nickellegierungs-Granulierungen eine Größe von höchstens 1,0 um haben; und
- mindestens das teilweise Einbetten der Metalleinlage in eine Harzmasse einer elektronischen Baugruppe durch Verformen.
- Vorzugsweise wird der Metalleinlagen-Rohling aus Kupfer, einer Kupferlegierung oder einer Fe-Ni-Legierung erzeugt. Wenn die Granulierungen mit der Nickellegierung wachsen gelassen werden, besteht der zweite elektrolytische Plattierungsprozeß vorzugsweise aus einem Sn-Ni-Legierungs-Plattierungsprozeß, einem Co-Ni- Legierungs-Plattierungsprozeß oder einem Fe-CO-Ni-Legierungs- Plattierungsprozeß.
- Im folgenden werden nun besondere Ausführungsformen der vorliegenden Erfindung unter Bezugnahme auf die beigefügten Zeichnungen beschrieben, in denen darstellen:
- Figur 1 eine teilweise Draufsicht auf einen Leiterrahmen, der zur Herstellung einer elektronischen Baugruppe nach dem Dual-in-Line-Typ verwendet wird;
- Figur 2 eine elektronenmikroskopische Photographie, welche einen Leiterrahmen-Rohling darstellt, der nach einem elektrolytischen Kupfer-Plattierungsprozeß gemäß der vorliegenden Erfindung behandelt worden ist;
- Figur 3 eine elektronenmikroskopische Photographie, die den Leiterrahmen-Rohling zeigt, der weiter behandelt wurde im Rahmen eines elektrolytischen Nickellegierungs-Plattierungsprozesses gemäß der vorliegenden Erfindung;
- Figur 4 eine elektronenmikroskopische Photographie ähnlich der Photographie von Figur 3, welche den Leiterrahmen-Rohling zeigt, der weiter behandelt wurde nach einem anderen elektrolytischen Nickellegierungs-Plattierungsprozeß gemäß der vorliegenden Erfindung; und
- Figur 5 eine elektronenmikroskopische Photographie, die einen Leiterrahmen-Rohling zeigt, der direkt durch ein elektrolytisches Nickellegierungs-Plattierungsverfahren behandelt worden ist, in übereinstimmung mit den gleichen Bedingungen wie denen, die im Falle der Figur 3 angewandt wurden, ohne daß der Rohling einem elektrolytischen Kupfer-Plattierungsprozeß unterworfen wurde.
- Figur 1 zeigt einen Leiterrahmen als ein Beispiel einer Metalleinlage, die teilweise in einer Harzformmasse eingebettet ist. Dieser Leiterrahmen wird zur Herstellung einer elektronischen Baugruppe vom Dual-in-Line-Typ verwendet und kann hergestellt werden aus einer dünnen Cu-Platte, Cu-Legierungsplatte, Ni-Fe-Legierungsplatte oder dergleichen, durch einen mechanischen Stanzprozeß oder einen Photoätzprozeß. Der Leiterrahmen weist ein Paar von Seitenrahmenteilen 10 auf und eine Vielzahl von seitlichen Rahmenteilen 12, die sich integral zwischen den Seitenrahmenteilen 10 ausdehnen und einen Abstand voneinander aufweisen. Zu bemerken ist, daß in Figur 1 lediglich ein Satz von zwei einander benachbarten seitlichen Rahmenteilen dargestellt ist. Der Leiterrahmen weist ferner eine rechteckige zentrale Bühne auf, die in einem Mittelteil einer rechteckigen Fläche angeordnet ist, die definiert wird durch den Satz von seitlichen Rahmenteilen 12, wobei die zentrale Bühne 14 durch die Seitenrahmenteile 10 abgestützt wird und zwar über zwei Streifenelemente 16, die sich integriert zwischen den Seitenrahmenteilen und den gegenüberliegenden Seiten der zentralen Bühne 14 ausdehnen. Der Leiterrahmen weist ferner eine erste Gruppe von Leiterelementen 18 auf, die sich integriert von einem der seitlichen Rahmenteile 12 in Richtung der zentralen Bühne 14 erstrecken, sowie eine zweite Gruppe von Leiterelementen 20, die sich integriert von den anderen seitlichen Rahmenteilen 12 in Richtung der zentralen Bühne 14 ausdehnen, ein erstes Absperr-Streifenelement 22, das sich quer über die Leiterelemente 18 erstreckt und mit den Seitenrahmenteilen 10 an den Enden hiervon integriert ist, sowie ein zweites Absperr-Streifenelement 24, das sich quer über die Leiterelemente 20 erstreckt und mit den Seitenrahmenteilen 10 an den Enden hiervon integriert ist.
- Bei der Herstellung von Bauteilen vom Dual-in- Line-Typ wird ein elektrisches Element, wie zum Beispiel ein integrierter Schaltungs- (IC)-Chip sicher auf der zentralen Bühne 14 des Leiterrahmens befestigt, und zwar unter Verwendung einer Silber- oder Goldpaste, und dann elektrisch mit den inneren Enden der Leiterelemente 18, 20 nach einem allgemein bekannten Drahtverbindungsprozeß verbunden. Daraufhin wird die zentrale Bühne 14 mit dem IC- Chip zusammen mit den inneren Enden der Leiterelemente 18, 20 durch eine mehrteilige Form eingeschlossen und die Absperr-Streifenelemente 22 und 24 des Leiterrahmens wirken mit der mehrteiligen Form zusammen unter Ausbildung eines geschlossenen Form-Raumes. Dann wird ein geeignetes härtbares, synthetisches Harz, wie zum Beispiel ein Epoxyharz, in den Form-Raum eingeführt, so daß der IC-Chip in der geformten Harzmasse in solch einer Weise versiegelt wird, daß der Leiterrahmen hierin teilweise eingebettet ist. Nachdem das eingeführte Harz gehärtet worden ist, wird die mehrteilige Form von dem Leiterrahmen entfernt und die Absperr-Streifenelemente 22, 24 werden abgetrennt, um die Leiterelemente 18, 20 von den Absperr-Streifenverbindungen freizugeben. Daraufhin werden die Leiterelemente 18, 20 durch ein Preß-Schneidverfahren beschnitten, so daß die Leiterelemente 18, 20 von den seitlichen Rahmenteilen 12 abgelöst werden, und sie werden nach unten bezüglich der geformten Harzmasse gebogen. Als Folge hiervon wird eine Baugruppe (package) vom Dual-in-Line-Typ erhalten.
- Die vorliegende Erfindung ist gerichtet auf ein neues Verfahren der Oberflächenbehandlung zur Aufrauhung von Oberflächen der Metalleinlage oder des Leiterrahmens, wie oben angegeben, und in dieser Ausführungsform wird der Leiterrahmen nach der Oberflächen- Aufrauhungsbehandlungsmethode gemäß der vorliegenden Erfindung behandelt, vor der Befestigung des IC-Chips auf der zentralen Bühne des Leiterrahmens.
- Das Oberflächen-Aufrauhungsbehandlungsverfahren umfaßt zwei elektrolytische Plattierungsprozesse: einen ersten elektrolytischen Plattierungsprozeß für die Erzeugung einer ins Gewicht fallenden oder wesentlichen Menge von Kupferkernen auf den Oberflächen des Leiterrahmens; und einen zweiten elektrolytischen Plattierungsprozeß zum Wachsenlassen der Kupferkerne mit Nickel oder einer Nickellegierung, um dadurch eine ins Gewicht fallende oder wesentliche Menge von Granulierungen auf den Oberflächen des Leiterrahmens zu erzeugen. In diesem Falle ist die Größe der Kupferkerne von Unter-Mikrongrößenordnung und kann erhalten werden durch Steuerung des ersten elektrolytischen Plattierungsprozesses derart, daß eine mittlere Dicke der Plattierung von weniger als etwa 1,0 um (vorzugsweise 0,5 um) erhalten wird. Auch liegt die Größe der Granulierungen bei höchsten 1,0 um und kann erhalten werden durch Steuerung des zweiten elektrolytischen Plattierungsprozesses derart, daß eine mittlere Dicke der Plattierung von etwa 0,5 bis etwa 1,5 um erhalten wird.
- Die Granulierungen, die auf den Oberflächen des Leiterrahmens erzeugt werden, tragen zur Erhöhung der Kontaktfläche zwischen dem Leiterrahmen und der Harzformmasse bei, wodurch der Leiterrahmen bemerkenswert verbesserte Adhäsionseigenschaften bezüglich der geformten Harzmasse aufweist. Wird der zweite elektrolytische Plattierungsprozeß derart gesteuert, daß eine mittlere Dicke der Plattierung von weniger als 0,5 um herbeigeführt wird, so können die Granulierungen nicht ausreichend wachsen, weshalb eine Verbesserung in den Adhäsionseigenschaften des Leiterrahmens gegegenüber der Harzformmasse schlecht ist. Wird demgegenüber der zweite elektrolytische Plattierungsprozeß derart gesteuert, daß eine mittlere Dicke der Plattierung größer als 1,5 um ist, so wird die Anzahl der Granulierungen vermindert, so daß eine Kontaktfläche zwischen dem Leiterrahmen und der Harzformmasse kleiner wird, weshalb eine Verbesserung in den Adhäsionseigenschaften ebenfalls gering ist.
- Wenn die Kupferkerne als Nickellegierungs-Granulierungen gezüchtet oder wachsen gelassen werden, so umfaßt der zweite elektrolytische Plattierungsprozeß vorzugsweise einen Sn-Ni-Legierungs- Plattierungsprozeß. Trotzdem kann das Wachstum der Kupferkerne als Nickellegierungs-Granulierungen durch einen Co-Ni-Legierungs- Plattierungsprozeß durchgeführt werden oder einen Fe-co-Ni-Legierungs-Plattierungsprozeß.
- Ein Leiterrahmen wurde aus Kupfer hergestellt und der Rahmen wurde einem elektrolytischen Kupfer-Plattierungsprozeß unter den folgenden Bedingungen unterworfen:
- (1) Verwendet wurde eine Plattierungslösung aus einer Kupfercyanid- (CuCn)komponente von etwa 80 gil und freiem Kaliumcyanid (KCN) von etwa 40 g/l.
- (2) Die Plattierungstemperatur lag bei 40ºC.
- (3) Die Kathodenstromdichte lag bei 5 A/dm².
- Der elektrolytische Kupfer-Plattierungsprozeß wurde derart gesteuert, daß eine mittlere Plattierungsdicke von etwa 0,5 um erhalten werden konnte. Der erhaltene Leiterrahmen wurde mittels eines Elektronenmikroskops untersucht und mittels einer Instant Kamera photographiert. Diese Photographie wird als Figur 2 dargestellt. Wie sich aus der Photographie ergibt, wurde eine ins Gewicht fallende oder wesentliche Menge an Kupferkernen auf der Oberfläche des Leiterrahmens erzeugt, die als kleine weiße Flekken festzustellen sind. Wie sich aus der Skala auf der Photographie ergibt, liegt die Größe der Kupferkerne im Unter-Mikronbereich.
- Dann wurde der Leiterrahmen weiter einem Sn-Ni-Legierungs-Plattierungsprozeß unter den folgenden Bedingungen unterworfen:
- (1) Verwendet wurde eine Plattierungslösung aus einer Stannochlorid- (SnCl&sub2;)komponente von etwa 80 g/l, einer Nickelchlorid- (NiCl&sub2;)komponente von etwa 300 g/l, einer Natriumfluorid- (NaF)komponente von etwa 30 g/l sowie einer Ammoniumhydrogenfluorid- (NH&sub3;HF)komponente von etwa 35 g/l.
- (2) Die Plattierungstemperatur betrug 75ºC.
- (3) Die Kathodenstromdichte lag bei 2 A/dm².
- Dieser Sn-Ni-Legierungs-Plattierungsprozeß wurde derart gesteuert, daß eine mittlere Plattierungsdicke von etwa 0,5 um erhalten werden konnte. Der erhaltene Leiterrahmen wurde ebenfalls durch das Elektronenmikroskop betrachtet und er wurde mittels einer Instant-Kamera photographiert. Diese Photographie ist in Figur 3 dargestellt. Wie sich aus der Photographie ergibt, wurden die Kupferkerne als Granulierungen gezüchtet, die auf der Oberfläche des Leiterrahmens erzeugt wurden. Wie sich aus der Skala auf der Photographie ergibt, lag die Größe der Granulierungen bei weniger als 1,0 um. Beispiel II: Ähnlich wie im Falle des Beispieles I wurde ein Leiterrahmen aus Kupfer hergestellt und dieser wurde einem elektrolytischen Kupfer-Plattierungsprozeß unter den gleichen Bedingungen wie im Falle des Beispieles I unterworfen. Dann wurde der Leiterrahmen weiter einem Sn-Ni-Legierungs-Plattierungsprozeß unter den gleichen Bedingungen wie in Beispiel I angegeben unterworfen, mit der Ausnahme, daß der Sn-Ni-Legierungs-Plattierungsprozeß derart gesteuert wurde, daß eine mittlere Plattierungsdicke von etwa 1,0 um erhalten werden konnte. Der erhaltene Leiterrahmen wurde mittels eines Elektronenmikroskops untersucht und mittels einer Instant-Kamera photographiert. Diese Photographie ist in Figur 4 dargestellt. Wie sich aus der Photographie ergibt, wurden die Kupferkerne als Granulierungen gezüchtet, die auf der Oberfläche des Leiterrahmens erzeugt wurden. Wie sich aus der Skala der Photographie ergibt, lag die Größe der Granulierungen bei höchstens 1,0 um.
- Es wurde ein Leiterrahmen, hergestellt aus einer Fe-Ni-Legierung, hergestellt. Dieser Leiterrahmen wurde einem elektrolytischen Kupfer-Plattierungsprozeß unter den gleichen Bedingungen, wie in Beispiel I angegeben, unterworfen, worauf der Leiterrahmen einem Sn-Ni-Legierungs-Plattierungsprozeß unter den gleichen Bedingungen, wie in Beispiel 1 angegeben, unterworfen wurde. Ähnlich wie im Falle des Beispieles I wies der erhaltene Leiterrahmen eine beträchtliche Menge an Granulierungen auf, die auf der Oberfläche desselben erzeugt wurden, doch war die Größe der Granulierungen etwas geringer als die der Granulierungen gemäß Beispiel 1.
- Ein Leiterrahmen, erzeugt aus Kupfer, wurde direkt einem Sn-Ni- Legierungs-Plattierungsprozeß unter den gleichen Bedingungen, wie in Beispiel 1 angegeben, unterworfen. Der erhaltene Leiterrahmen wurde mittels eines Elektronenmikroskops untersucht und mit der Instant-Kamera photographiert. Diese Photographie ist in Figur 5 dargestellt. Wie sich aus der Photographie ergibt, wie der Leiterrahmen keine Granulierungen auf, die auf der Oberfläche desselben erzeugt wurden.
- Unter Verwendung der Bleirahmen, die gemäß Beispiel 1 erhalten wurden, wurden 100 Proben-Bauteile hergestellt. Die Proben-Bauteile wurden über einen Zeitraum von 168 Stunden einer Umgebung exponiert, die eine Temperatur von 85ºC hatte und einen Luftfeuchtigkeitsgehalt von 85 % (RH), worauf die Proben-Bauteile 10 Sekunden lang in einen Infrarot-Ofen mit einer Innentemperatur von 235ºC gebracht wurden. Als Folge hiervon konnten in keinem der Proben-Bauteile Risse festgestellt werden. Der gleiche Test wurde mit jedem der Bauteile der Beispiele II und III durchgeführt und in keinem der Proben-Bauteile konnten Risse festgestellt werden. Weiterhin wurde der gleiche Test im Falle der Bauteile des Vergleichsbeispiels durchgeführt, in welchem Falle Risse in 75 % der Proben-Bauteile auftraten.
- Obgleich in der vorstehenden Beschreibung als Metalleinlage ein Leiterrahmen zur Herstellung einer elektronischen Baugruppe verwendet wurde, ist festzustellen, daß die vorliegende Erfindung auf andere Typen von Metalleinlagen angewandt werden kann, wie beispielsweise verbindenden Stiften eines elektrischen Steckers, metallischer Kontakte eines elektrischen Schalters oder dergleichen, die teilweise in einer Formharzmasse eingebettet sind. Weiterhin kann die Metalleinlage ein Verstärkungselement sein, das vollständig in einer geformten Harzmasse eingebettet ist.
- Auch kann die Metalleinlage oder der Leiterrahmen, obgleich er aus Kupfer oder einer Fe-Ni-Legierung erzeugt wurde, aus einem anderen Metall bestehen, wie zum Beispiel einer Kupferlegierung, Stahl oder einer Stahllegierung.
Claims (5)
1. Elektronische Baugruppe mit:
einer Metalleinlage, die mindestens teilweise in einer
geformten Harzmasse eingebettet ist,
einer Schicht von Metallkernen auf der Oberfläche der
Metalleinlage, die eine mittlere Dicke von etwa 0,5 bis etwa 1,0 um
hat,
einer Schicht von Nickel- oder
Nickellegierungs-Granulierungen über der Kupferschicht, wobei die Nickel- oder
Nickellegierungsschicht eine mittlere Dicke von etwa 0,5 bis etwa 1,5 um
aufweist, wobei die Größe der Nickelgranulierungen höchstens
1,0 um beträgt.
2. Elektronische Baugruppe nach Anspruch 1, in der die
Metalleinlage aus Kupfer, einer Kupferlegierung oder einer
Fe-Ni-Legierung erzeugt worden ist.
3. Verfahren der Oberflächenbehandlung zum Aufrauhen einer
Metalleinlage für die mindestens teilweise Einbettung in eine
geformte Harzmasse mit den Stufen:
Erzeugung einer Schicht aus Kupferkernen auf der Oberfläche
einer Metalleinlage durch Steuerung eines elektrolytischen
Kupfer-Plattierungsprozesses derart, daß die mittlere Dicke
der Kupferschicht bei etwa 0,5 bis etwa 1,0 um liegt; und
Züchtung von Nickel- oder Nickellegierungs-Granulierungen auf
den Kupferkernen durch Steuerung eines elektrolytischen Nickel-
Plattierungsprozesses derart, daß die mittlere Dicke der
Plattierung bei etwa 0,5 bis 1,5 um liegt, wobei die Nickel- oder
Nickellegierungs-Granulierungen eine Größe von höchstens 1,0 um
haben; und
der mindestens teilweisen Einbettung der Metalleinlage in
eine Harzmasse einer elektronischen Baugruppe durch ein
Formverfahren.
4. Verfahren nach Anspruch 3, bei dem die Metalleinlage aus
Kupfer, einer Kupferlegierung oder einer Fe-Ni-Legierung erzeugt
wurde.
5. Verfahren nach Anspruch 3 oder 4, bei dem der elektrolytische
Nickellegierungs-Plattierungsprozeß einen Sn-Ni-Legierungs-
Plattierungsprozeß, einen CO-Ni-Legierungs-Plattierungsprozeß
oder einen Fe-CO-Ni-Legierungs-Plattierungsprozeß umfaßt.
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP20748092A JP3228789B2 (ja) | 1992-07-11 | 1992-07-11 | 樹脂用インサート部材の製造方法 |
Publications (2)
Publication Number | Publication Date |
---|---|
DE69318894D1 DE69318894D1 (de) | 1998-07-09 |
DE69318894T2 true DE69318894T2 (de) | 1998-09-24 |
Family
ID=16540451
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE69318894T Expired - Fee Related DE69318894T2 (de) | 1992-07-11 | 1993-07-09 | Gehäuse einer elektronischen Vorrichtung mit einem metallischen Insert und Verfahren zur Oberflächenaufrauhung des Inserts |
Country Status (6)
Country | Link |
---|---|
US (1) | US5585195A (de) |
EP (1) | EP0579464B1 (de) |
JP (1) | JP3228789B2 (de) |
KR (1) | KR940006254A (de) |
DE (1) | DE69318894T2 (de) |
SG (1) | SG46235A1 (de) |
Families Citing this family (28)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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KR102529295B1 (ko) | 2015-11-05 | 2023-05-08 | 후루카와 덴키 고교 가부시키가이샤 | 리드 프레임재 및 그 제조방법 |
DE102016117841A1 (de) | 2016-09-21 | 2018-03-22 | HYUNDAI Motor Company 231 | Packung mit aufgerauter verkapselter Oberfläche zur Förderung einer Haftung |
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JP7014695B2 (ja) | 2018-10-18 | 2022-02-01 | Jx金属株式会社 | 導電性材料、成型品及び電子部品 |
JP6805217B2 (ja) | 2018-10-18 | 2020-12-23 | Jx金属株式会社 | 導電性材料、成型品及び電子部品 |
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1992
- 1992-07-11 JP JP20748092A patent/JP3228789B2/ja not_active Expired - Fee Related
-
1993
- 1993-07-01 KR KR1019930012249A patent/KR940006254A/ko not_active Application Discontinuation
- 1993-07-09 EP EP93305413A patent/EP0579464B1/de not_active Expired - Lifetime
- 1993-07-09 DE DE69318894T patent/DE69318894T2/de not_active Expired - Fee Related
- 1993-07-09 SG SG1996001388A patent/SG46235A1/en unknown
- 1993-07-12 US US08/089,550 patent/US5585195A/en not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
DE69318894D1 (de) | 1998-07-09 |
JP3228789B2 (ja) | 2001-11-12 |
EP0579464B1 (de) | 1998-06-03 |
JPH0629439A (ja) | 1994-02-04 |
EP0579464A2 (de) | 1994-01-19 |
EP0579464A3 (de) | 1994-03-23 |
US5585195A (en) | 1996-12-17 |
SG46235A1 (en) | 1998-02-20 |
KR940006254A (ko) | 1994-03-23 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
8364 | No opposition during term of opposition | ||
8339 | Ceased/non-payment of the annual fee |