DE3235480C2 - Integrierter Halbleiterspeicher - Google Patents
Integrierter HalbleiterspeicherInfo
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- DE3235480C2 DE3235480C2 DE19823235480 DE3235480A DE3235480C2 DE 3235480 C2 DE3235480 C2 DE 3235480C2 DE 19823235480 DE19823235480 DE 19823235480 DE 3235480 A DE3235480 A DE 3235480A DE 3235480 C2 DE3235480 C2 DE 3235480C2
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Abstract
Ein integrierter Halbleiterspeicher besitzt mehrere Speicherzellen (11 bis 11n), bei denen als Lastelemente Polysiliciumwiderstände (R1, R2) verwendet werden. Die Speicherzellen (11 bis 11n) sind über einen MOS-Transistor (T11), dessen effektive Elektronenbeweglichkeit mit ansteigender Temperatur abnimmt, an eine Spannungsversorgung (Vcc) angeschlossen. Der den Speicherzellen (11 bis 11n) bei höheren Temperaturen zugeführte Strom wird durch den als Strombegrenzer wirkenden MOS-Transistor (T11) begrenzt.
Description
3 4
wobei Ea eine aktive Energie ist, die erfahrungsgemäß Vcc angeschlossen. Wenn bei dieser Ausführungsform
zwischen 0,3 und 0,5 (eV) liegt, ex eine Konstante, k die die Temperatur ansteigt, verringert sich die Beweglich-
Boltzmann-Konstaiite und T die absolute Temperatur keit μΜ wodurch ein ähnlicher Effekt erzielt wird wie
isL Ohne den MOS-Transistor 7*11 mit pos. Tempera- bei der obigen Ausführungsform.
turkoeffizienten als Strombegrenzer steigt die Strom- 5 Bei der Ausführungsform nach F i g. 4 wird ein MOS-
aufnahme mit der Verringerung des Widerstands, wenn Transistor 31 vom Anreicherungstyp oder vom Verar-
der Widerstandswert des Widerstands R 1 mit einem mungstyp als Strombegrenzer eingesetzt Das Gate des
Temperaturanstieg abnimmt. MOS-Transistors Γ31 ist an eine Taktsignalquelle oder
Wenn beispielsweise in einem MOS-RAM von 16 Ki- an eine andere Steuersignalquelle angeschlossen. Bei
lobits der Widerstandswert des Polysiliciumwiderstands 10 dieser Ausführungsform gelangt ein Signal an das Gate
R 1 (25°C) ein Gigaohm bei Normaltemperatur (25°C) des MOS-Transistors 31, so daß, wenn der MOS-RAM
beträgt, beträgt bei einer Versorgungsspannung im Lese- oder Schreibbetrieb arbeitet, der MOS-Transi-
Vcc = 5 V der Strom /1 (25° C) einer einzelnen Spei- stör Γ31 aus geschaltet wird, und daß er eingeschaltet
cherzeüe 5 χ 10~9 (A). Daher beträgt der durch die ins- wird, wenn sich der MOS-RAM im Stand-By-Betrieb
gesamt 16 384 Speicherzellen fließende Gesamtstrom 15 oder fm Bereitschaftszustand befindet Der Grund hier-
etwa 80 μΑ. Bei einer hohen Temperatur von beispiels- für liegt darin, daß in dem statischen MOS-RAM den
weise 8O0C ergibt sich mit Ea = 0,4(eV) Speicherzellen 11 bis Hn im Stand-by-Betrieb Energie
zugeführt werden muß, um die in dem Speicher enthal-
R 1 (8O0C) = Ri (25° C)Ze2-* = Ri (25° C)/10 tenen Daten zu halten, während beim Lesen oder
20 Schreiben keine Energie zum Halten der Daten benö-
und der in der Gesamtzahl der Speicherzellen ver- tigtwird.
brauchte Strom beträgt 800 μΑ. Bei einem 16-Kilobit- Bei der obigen Ausführungsform wird der Strombe-
MOS-RA M wird also bei hoher Temperatur etwa 1 Omal grenzer als Einzelelement verwendet. Es können jedoch
soviel Strom verbraucht wie bei Normaltemperatur. auch mehrere Strombegrenzer, d.h. mehrere MOS-
Der Stromverbrauch steigt mit der Anzahl von Bits in 25 Transistoren 7Ί1 verwendet werden, die gemäß F i g. 5
dem MOS-RAM an. Da bei dem erfindungsgemäßen parallelgeschaltet sind.
Halbleiterspeicher jedoch der als Strombegrenzer die-
nende MOS-Transistor 7"11 verwendet wird, wird der Hierzu 3 Blatt Zeichnungen
Stromverbrauch bezüglich der Umgebungstemperatur-
änderung unterhalb eines gegebenen Werts gehalten. 30
F i g. 2 zeigt eine Schaltung, die in jeder der Speicherzellen 11 bis 11/2 vorkommt. In dieser Schaltung ist der
resultierende Widerstand R und der resultierende
Strom /3. Der Strom /3 gleicht dem Strom /0, der über
resultierende Widerstand R und der resultierende
Strom /3. Der Strom /3 gleicht dem Strom /0, der über
den MOS-Transistor 7*11 durch die Spannungsversor- 35
gungsleitung L fließt Wie aus F i g. 2 ersichtlich, kann
der Strom /0 durch folgende Gleichung (2) angegeben
werden:
gungsleitung L fließt Wie aus F i g. 2 ersichtlich, kann
der Strom /0 durch folgende Gleichung (2) angegeben
werden:
/0 = KV2Th-μεί!νιτΗ (2) 40
f,.c„ = T-312 und K = (W/L) χ Cox χ
k = Konstante 45
Cox = Gate-Kapazität pro Flächeneinheit des Transistors TU
W = Kanalbreite des Transistors TIl
L = Kanallänge des Transistors 7*11
μ-cii = Effektive Elektronenbeweglichkeit 50
Viii— Schwellenspannung des Transistors 7*11.
Die Beweglichkeit ßeti führt zu einer bezüglich des
Temperaturkoeffizienten des Polysiliciums entgegengesetzten Temperaturkennlinie. Selbst wenn der Wider- 55
standswert des Polysiliciumwiderstands R abnimmt,
verringert sich die Beweglichkeit μ-eit, und der in den
MOS-Transistor 7*11 fließende Strom ist begrenzt.
Wenn also die Temperatur ansteigt, fließt kein zusätzlicher Strom in den MOS-RAM gemäß Fig. 1, so daß 60
Energie eingespart wird. Der Strom /0 kann dadurch
auf einen gegebenen Wert begrenzt werden, daß die
Schwellenspannung VTh oder die Kanalbreite und die
Kanallänge des MOS-Transistors geändert werden.
Temperaturkoeffizienten des Polysiliciums entgegengesetzten Temperaturkennlinie. Selbst wenn der Wider- 55
standswert des Polysiliciumwiderstands R abnimmt,
verringert sich die Beweglichkeit μ-eit, und der in den
MOS-Transistor 7*11 fließende Strom ist begrenzt.
Wenn also die Temperatur ansteigt, fließt kein zusätzlicher Strom in den MOS-RAM gemäß Fig. 1, so daß 60
Energie eingespart wird. Der Strom /0 kann dadurch
auf einen gegebenen Wert begrenzt werden, daß die
Schwellenspannung VTh oder die Kanalbreite und die
Kanallänge des MOS-Transistors geändert werden.
Bei der in F i g. 3 gezeigten Ausführungsform besteht 65
der Strombegrenzer aus einem MOS-Transistor vom
Anreicherungstyp, T21. In diesem Fall ist das Gate des
MOS-Transistors Γ21 an die Versorgungsspannung
der Strombegrenzer aus einem MOS-Transistor vom
Anreicherungstyp, T21. In diesem Fall ist das Gate des
MOS-Transistors Γ21 an die Versorgungsspannung
Claims (1)
1 . 2
Spannungsversorgungsleitung ist über einen als Strom-Patentansprüche:
begrenzer dienenden MOS-Transistor an die mehreren
Speicherzellen angeschlossen.
1. Integrierter Halbleiterspeicher, mit Gruppen Im folgenden werden Ausführungsbeispiele der Erfin-
von statischen Speicherzellen, die Polysiliciumwi- 5 dung anhand der Zeichnung näher erläutert Es zeigt
derstände als Lastelemente aufweisen, und mit F i g. 1 ein Schaltbild eines Teils eines integrierten
derstände als Lastelemente aufweisen, und mit F i g. 1 ein Schaltbild eines Teils eines integrierten
Strombegrenzereinrichtungen, die je aus einem EIe- Halbleiterspeichers gemäß einer Ausführungsform der
ment mit positivem Temperaturkoeffizienten gebil- Erfindung,
det sind und zum Begrenzen des von einer Span- F i g. 2 das Schaltbild eines Ausschnitts des in F i g. 1
nungsquelle gelieferten, durch die jeweilige Spei- 10 gezeigten Speichers,
cherzelle fließenden Stroms dienen, dadurchge- Fig. 3 ein Schaltbild einer anderen Ausführungsform
kennzeichnet, daß die Elemente mit positivem des erfindungsgemäßen integrierten Halbleiterspei-Temperaturkoeffizienten
mindestens aus einem chers, bei der als Strombegrenzer ein Transistor vom
MOS-Transistor (TU; 721; 731) bestehen, über Anreicherungstyp eingesetzt ist,
den jeweils eine Gruppe von Speicherzellen (11 bis 15 F i g. 4 ein Schaltbild einer weiteren Ausführungsform lindan die Spannungsquelle (Vcc)angeschlossen ist des erfindungsgemäßeri integrierten Halbleiterspei-2 Halbleiterspeicher nach Aiispruch 1, dadurch chers, bei dem ein Strombegrenzer-Transistor impulsgekennzeichnet, daß der MOS-Transistor (T 11) ein gesteuert wird, und
MOS-Transistor vom Verarmungstyp ist F i g. 5 ein Schaltbild einer weiteren Ausführungsform
den jeweils eine Gruppe von Speicherzellen (11 bis 15 F i g. 4 ein Schaltbild einer weiteren Ausführungsform lindan die Spannungsquelle (Vcc)angeschlossen ist des erfindungsgemäßeri integrierten Halbleiterspei-2 Halbleiterspeicher nach Aiispruch 1, dadurch chers, bei dem ein Strombegrenzer-Transistor impulsgekennzeichnet, daß der MOS-Transistor (T 11) ein gesteuert wird, und
MOS-Transistor vom Verarmungstyp ist F i g. 5 ein Schaltbild einer weiteren Ausführungsform
3. Halbleiterspeicher nach Anspruch 1, dadurch 20 des erfindungsgemäßen integrierten Halbleiterspeigekennzeichnet,
daß der MOS-Transistor (T21) ein chers, bei dem mehrere Strombegrenzer verwendet
MOS-Transistor vom Anreicherungstyp ist werden.
4. Halbleiterspeicher nach einem der Ansprüche 2 F i g. 1 zeigt eine Ausführungsform des erfindungsge-
und 3, dadurch gekennzeichnet, daß dem Gate des mäßen integrierten Halbleiterspeichers. Wie aus der
MOS-Transistors (T3i) ein Ein-AUS-Signal züge- 25 Zeichnung hervorgeht, sind mehrere Speicherzellen Il
führt wird. bis Hn an eine Spannungsversorgungsleitung L ange-
5. Halbleiterspeicher nach einem der vorherge- schlossen. Die Speicherzellen 11 bis Hn bestehen jehenden
Ansprüche, dadurch gekennzeichnet, daß weils aus einer Reihenschaltung eines Widerstands R 1
mehrere MOS-Transistoren ^TIl) parallel zwischen und eines Treiber-MOS-Transistors Tl sowie einer
die Speicherzellen (11 bis Unrund die Spannungs- 30 weiteren Reihenschaltung eines Widerstands R 2 und
quelle fVcq/geschaltet sind (F ig. 5). emes Treiber-MOS-Transistors T2. Die Reihenschaltungen
sind parallelgeschaltet, und der Verbindungs-
punkt der Widerstände R 1 und R 2 ist an die Spannungsversorgungsleitung
L angeschlossen. Ein Verbin-35 dungspunkt der Treiber-MOS-Transistoren 71 und 72
Die vorliegende Erfindung bezieht sich auf einen inte- ist an eine Versorgungsspannung Vss angeschlossen,
grierten Halbleiterspeicher der im Oberbegriff des An- Das Gate des MOS-Transistors Ti ist an einen Knoten
Spruchs 1 angegebenen Art. Ein solcher Halbleiterspei- P 2 zwischen dem Widerstand R 2 und dem MOS-Tra richer
ist aus der DE-OS 29 47 311 bekannt, sistor T2 angeschlossen. Das Gate des MOS-Transi-
Bei dem bekannten Halbleiterspeicher bestehen die 40 stors 72 ist an einen Knoten P1 zwischen dem Wider-Strombegrenzereinrichtungen
aus mehreren JFETs.de- stand R1 und dem MOS-Transistor Ti angeschlossen,
ren Anzahl der Anzahl der Speicherzellen entspricht. Der Knoten Pl ist über einen Übergabetransistor 73
Zwischen jeweils eine Speicherzelle und die Spannungs- an eine Datenleitung D angeschlossen. Der Knoten P2
quelle ist ein JFET geschaltet. Da für jede einzelne Spei- ist über einen anderen Übergabe-MOS-Transistor 74
cherzelle ein separater Strombegrenzer vorgesehen 45 an eine Datenleitung D angeschlossen. Die Gates der
sein muß, wird hierfür relativ viel Platz benötigt, was MOS-Transistoren 73 und 74 sind an eine Adreßlciinsbesondere
bei hoch integrierten Halbleiterspeichern tung AL angeschlossen.
(z. B. 16 K) besonders schwerwiegend ist. Der zusätzlich Die Widerstände R 1 und R 2 dienen als Lastelemen-
für die jeweiligen Strombegrenzer benötigte Bereich te, und sie bestehen aus Polysilicium.
entspricht bei jeder Speicherzelle mindestens der Ka- 50 Die Spannungsversorgungsleitung L ist über einen nalbreite des JFETs. MOS-Transistor vom Verarmungstyp, 711, an eine
entspricht bei jeder Speicherzelle mindestens der Ka- 50 Die Spannungsversorgungsleitung L ist über einen nalbreite des JFETs. MOS-Transistor vom Verarmungstyp, 711, an eine
Ferner weist die U-I-Kennlinie eines JFETs eine star- Versorgungsspannung Vcc angeschlossen. Der MOS-ke
Abhängigkeit von der Kanaldicke auf. Die Kennlinie Transistor vom Verarmungstyp dient als Strombegrenhängt
also davon ab, mit welcher Genauigkeit die Ka- zer.
naldicke gesteuert werden kann. Hierdurch wird der 55 In den Speicherzellen 11 bis Hn haben die Widerstän-Aufbau
eines mit JFETs als Strombegrenzerelementen de R 1 und R 2 im wesentlichen denselben Widerstandsausgestatteten
Halbleiterspeichers relativ aufwendig. wert, d. h. R1 « R 2. Daher ist der bei Einschalten des
Der Erfindung liegt demnach die Aufgabe zugrunde, MOS-Transistors 71 in den Widerstand R1 fließende
einen integrierten Halbleiterspeicher der eingangs ge- Strom /lim wesentlichen genau so groß wie der beim
nannten Art zu schaffen, der einen erhöhten Integra- 60 Einschalten des Transistors 72 in den Widerstand R 2
tionsgrad bei leicht herstellbaren Elementen mit positi- fließende Strom /2. Der in die Speicherzelle 11 fließenvem
Temperaturkoeffizienten aufweist. de Strom /1 läßt sich ausdrucken durch Vcc/Ri. Der
Diese Aufgabe wird durch die im kennzeichnenden Widerstand R 1 hat einen negativen Temperaturkoeffi-Teil
des Anspruchs 1 genannten Merkmale gelöst. zienten, d. h. der Widerstand nimmt mit zunehmender
Bei dem Halbleiterspeicher sind mehrere Speicher- 65 Temperatur ab, und somit ergibt sich der Strom/1 zu
zellen an eine Spannungsversorgungsleitung angeschlossen, und die Speicherzellen besitzen Polysilicium- Il=aVcce\p(--^—\ (I) Widerstandselemente, die als Lastelemente dienen. Die V kT J'
zellen an eine Spannungsversorgungsleitung angeschlossen, und die Speicherzellen besitzen Polysilicium- Il=aVcce\p(--^—\ (I) Widerstandselemente, die als Lastelemente dienen. Die V kT J'
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Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP56153366A JPS5856288A (ja) | 1981-09-28 | 1981-09-28 | 半導体集積回路 |
Publications (2)
Publication Number | Publication Date |
---|---|
DE3235480A1 DE3235480A1 (de) | 1983-04-14 |
DE3235480C2 true DE3235480C2 (de) | 1986-05-22 |
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ID=15560877
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
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Country | Link |
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DE (1) | DE3235480C2 (de) |
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---|---|---|---|---|
JPH0646650B2 (ja) * | 1983-09-12 | 1994-06-15 | 株式会社東芝 | 半導体メモリ装置 |
JPH01273291A (ja) * | 1988-04-25 | 1989-11-01 | Nec Corp | スタティックメモリ集積回路 |
DE69727581D1 (de) | 1997-11-28 | 2004-03-18 | St Microelectronics Srl | RAM-Speicherzelle mit niedriger Leistungsaufnahme |
FR2835945A1 (fr) * | 2002-02-11 | 2003-08-15 | St Microelectronics Sa | Extraction d'un code binaire a partir de parametres physiques d'un circuit integre |
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Publication number | Priority date | Publication date | Assignee | Title |
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JPS532549B2 (de) * | 1973-11-07 | 1978-01-28 | ||
DE2947311C2 (de) * | 1978-11-24 | 1982-04-01 | Hitachi, Ltd., Tokyo | Integrierte Halbleiterschaltung |
JPS57117182A (en) * | 1981-01-14 | 1982-07-21 | Hitachi Ltd | Semiconductor integrated circuit |
JPS57162181A (en) * | 1981-03-31 | 1982-10-05 | Fujitsu Ltd | Semiconductor memory device |
-
1981
- 1981-09-28 JP JP56153366A patent/JPS5856288A/ja active Pending
-
1982
- 1982-09-17 GB GB08226488A patent/GB2107541B/en not_active Expired
- 1982-09-24 DE DE19823235480 patent/DE3235480C2/de not_active Expired
Also Published As
Publication number | Publication date |
---|---|
JPS5856288A (ja) | 1983-04-02 |
GB2107541B (en) | 1985-02-20 |
GB2107541A (en) | 1983-04-27 |
DE3235480A1 (de) | 1983-04-14 |
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