CN105027219A - 延迟电路、使用延迟电路的电子电路以及超声波拍摄装置 - Google Patents

延迟电路、使用延迟电路的电子电路以及超声波拍摄装置 Download PDF

Info

Publication number
CN105027219A
CN105027219A CN201380074225.5A CN201380074225A CN105027219A CN 105027219 A CN105027219 A CN 105027219A CN 201380074225 A CN201380074225 A CN 201380074225A CN 105027219 A CN105027219 A CN 105027219A
Authority
CN
China
Prior art keywords
mentioned
signal
delay
output
circuit
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Granted
Application number
CN201380074225.5A
Other languages
English (en)
Other versions
CN105027219B (zh
Inventor
中川树生
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujifilm Healthcare Corp
Original Assignee
Hitachi Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Hitachi Ltd filed Critical Hitachi Ltd
Publication of CN105027219A publication Critical patent/CN105027219A/zh
Application granted granted Critical
Publication of CN105027219B publication Critical patent/CN105027219B/zh
Active legal-status Critical Current
Anticipated expiration legal-status Critical

Links

Classifications

    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03K—PULSE TECHNIQUE
    • H03K5/00—Manipulating of pulses not covered by one of the other main groups of this subclass
    • H03K5/13—Arrangements having a single output and transforming input signals into pulses delivered at desired time intervals
    • H03K5/133—Arrangements having a single output and transforming input signals into pulses delivered at desired time intervals using a chain of active delay devices
    • A—HUMAN NECESSITIES
    • A61—MEDICAL OR VETERINARY SCIENCE; HYGIENE
    • A61B—DIAGNOSIS; SURGERY; IDENTIFICATION
    • A61B8/00—Diagnosis using ultrasonic, sonic or infrasonic waves
    • A61B8/44—Constructional features of the ultrasonic, sonic or infrasonic diagnostic device
    • A61B8/4483—Constructional features of the ultrasonic, sonic or infrasonic diagnostic device characterised by features of the ultrasound transducer
    • A61B8/4494—Constructional features of the ultrasonic, sonic or infrasonic diagnostic device characterised by features of the ultrasound transducer characterised by the arrangement of the transducer elements
    • A—HUMAN NECESSITIES
    • A61—MEDICAL OR VETERINARY SCIENCE; HYGIENE
    • A61B—DIAGNOSIS; SURGERY; IDENTIFICATION
    • A61B8/00—Diagnosis using ultrasonic, sonic or infrasonic waves
    • A61B8/54—Control of the diagnostic device
    • G—PHYSICS
    • G01—MEASURING; TESTING
    • G01S—RADIO DIRECTION-FINDING; RADIO NAVIGATION; DETERMINING DISTANCE OR VELOCITY BY USE OF RADIO WAVES; LOCATING OR PRESENCE-DETECTING BY USE OF THE REFLECTION OR RERADIATION OF RADIO WAVES; ANALOGOUS ARRANGEMENTS USING OTHER WAVES
    • G01S15/00—Systems using the reflection or reradiation of acoustic waves, e.g. sonar systems
    • G01S15/88—Sonar systems specially adapted for specific applications
    • G01S15/89—Sonar systems specially adapted for specific applications for mapping or imaging
    • G01S15/8906—Short-range imaging systems; Acoustic microscope systems using pulse-echo techniques
    • G01S15/8909—Short-range imaging systems; Acoustic microscope systems using pulse-echo techniques using a static transducer configuration
    • G01S15/8915—Short-range imaging systems; Acoustic microscope systems using pulse-echo techniques using a static transducer configuration using a transducer array
    • G01S15/8927—Short-range imaging systems; Acoustic microscope systems using pulse-echo techniques using a static transducer configuration using a transducer array using simultaneously or sequentially two or more subarrays or subapertures
    • G—PHYSICS
    • G01—MEASURING; TESTING
    • G01S—RADIO DIRECTION-FINDING; RADIO NAVIGATION; DETERMINING DISTANCE OR VELOCITY BY USE OF RADIO WAVES; LOCATING OR PRESENCE-DETECTING BY USE OF THE REFLECTION OR RERADIATION OF RADIO WAVES; ANALOGOUS ARRANGEMENTS USING OTHER WAVES
    • G01S7/00—Details of systems according to groups G01S13/00, G01S15/00, G01S17/00
    • G01S7/52—Details of systems according to groups G01S13/00, G01S15/00, G01S17/00 of systems according to group G01S15/00
    • G01S7/52017—Details of systems according to groups G01S13/00, G01S15/00, G01S17/00 of systems according to group G01S15/00 particularly adapted to short-range imaging
    • G01S7/52023—Details of receivers
    • G01S7/52025—Details of receivers for pulse systems
    • G—PHYSICS
    • G01—MEASURING; TESTING
    • G01S—RADIO DIRECTION-FINDING; RADIO NAVIGATION; DETERMINING DISTANCE OR VELOCITY BY USE OF RADIO WAVES; LOCATING OR PRESENCE-DETECTING BY USE OF THE REFLECTION OR RERADIATION OF RADIO WAVES; ANALOGOUS ARRANGEMENTS USING OTHER WAVES
    • G01S7/00—Details of systems according to groups G01S13/00, G01S15/00, G01S17/00
    • G01S7/52—Details of systems according to groups G01S13/00, G01S15/00, G01S17/00 of systems according to group G01S15/00
    • G01S7/52017—Details of systems according to groups G01S13/00, G01S15/00, G01S17/00 of systems according to group G01S15/00 particularly adapted to short-range imaging
    • G01S7/52079—Constructional features
    • G01S7/5208—Constructional features with integration of processing functions inside probe or scanhead
    • G—PHYSICS
    • G10—MUSICAL INSTRUMENTS; ACOUSTICS
    • G10K—SOUND-PRODUCING DEVICES; METHODS OR DEVICES FOR PROTECTING AGAINST, OR FOR DAMPING, NOISE OR OTHER ACOUSTIC WAVES IN GENERAL; ACOUSTICS NOT OTHERWISE PROVIDED FOR
    • G10K11/00—Methods or devices for transmitting, conducting or directing sound in general; Methods or devices for protecting against, or for damping, noise or other acoustic waves in general
    • G10K11/18—Methods or devices for transmitting, conducting or directing sound
    • G10K11/26—Sound-focusing or directing, e.g. scanning
    • G10K11/34—Sound-focusing or directing, e.g. scanning using electrical steering of transducer arrays, e.g. beam steering
    • G10K11/341—Circuits therefor
    • G10K11/346—Circuits therefor using phase variation
    • G—PHYSICS
    • G11—INFORMATION STORAGE
    • G11C—STATIC STORES
    • G11C27/00—Electric analogue stores, e.g. for storing instantaneous values
    • G—PHYSICS
    • G11—INFORMATION STORAGE
    • G11C—STATIC STORES
    • G11C27/00—Electric analogue stores, e.g. for storing instantaneous values
    • G11C27/02—Sample-and-hold arrangements
    • G11C27/024—Sample-and-hold arrangements using a capacitive memory element
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03H—IMPEDANCE NETWORKS, e.g. RESONANT CIRCUITS; RESONATORS
    • H03H11/00—Networks using active elements
    • H03H11/02—Multiple-port networks
    • H03H11/26—Time-delay networks
    • H03H11/265—Time-delay networks with adjustable delay
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03H—IMPEDANCE NETWORKS, e.g. RESONANT CIRCUITS; RESONATORS
    • H03H19/00—Networks using time-varying elements, e.g. N-path filters
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03K—PULSE TECHNIQUE
    • H03K5/00—Manipulating of pulses not covered by one of the other main groups of this subclass
    • H03K2005/00013—Delay, i.e. output pulse is delayed after input pulse and pulse length of output pulse is dependent on pulse length of input pulse
    • H03K2005/00019—Variable delay

Landscapes

  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Radar, Positioning & Navigation (AREA)
  • Remote Sensing (AREA)
  • Health & Medical Sciences (AREA)
  • Life Sciences & Earth Sciences (AREA)
  • Acoustics & Sound (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • General Physics & Mathematics (AREA)
  • Pathology (AREA)
  • Surgery (AREA)
  • Nuclear Medicine, Radiotherapy & Molecular Imaging (AREA)
  • Veterinary Medicine (AREA)
  • Radiology & Medical Imaging (AREA)
  • Biomedical Technology (AREA)
  • Heart & Thoracic Surgery (AREA)
  • Medical Informatics (AREA)
  • Molecular Biology (AREA)
  • Biophysics (AREA)
  • Animal Behavior & Ethology (AREA)
  • General Health & Medical Sciences (AREA)
  • Public Health (AREA)
  • Nonlinear Science (AREA)
  • Multimedia (AREA)
  • Gynecology & Obstetrics (AREA)
  • Ultra Sonic Daignosis Equipment (AREA)
  • Pulse Circuits (AREA)

Abstract

提供一种延迟时间的精度高，最大延迟时间长，并且低消耗功率的延迟电路和超声波拍摄装置。构成为具备：输入线，其输入模拟输入信号；多个模拟信号存储元件；输出线；多个采样开关，其控制上述输入线和上述多个模拟信号存储元件之间的连接/非连接；多个输出开关，其控制上述多个模拟信号存储元件和上述输出线之间的连接/非连接；时钟生成部，其生成控制上述采样开关的采样开关控制信号、控制上述输出开关的输出开关控制信号，能够将上述采样开关控制信号的相位相对于上述输出开关控制信号的相位错开。

Description

延迟电路、使用延迟电路的电子电路以及超声波拍摄装置
技术领域
本发明涉及一种延迟电路、使用该延迟电路的电子电路以及超声波拍摄装置，特别涉及针对模拟信号生成微小的延迟的延迟电路、使用该延迟电路的电子电路以及安装了该电子电路的超声波拍摄装置。
背景技术
超声波拍摄装置与X射线诊断装置、MRI(磁共振成像)装置等其他医用图像诊断装置相比，装置规模小，另外能够只通过从体表对准超声波探头的简单的操作实时地显示例如心脏的脉动、胎儿的运动这样的检查对象的运动的情况，因此在现今的医疗中起到重要的作用。
具体地说，超声波拍摄装置通过向内置于超声波探头中的多个振动元件分别供给驱动信号来向被检测体内发送超声波。另外，超声波拍摄装置通过多个振动元件中的各个振动元件接收由于生物组织的声阻抗的差异而产生的超声波的反射波，根据超声波探头接收到的反射波生成超声波图像。
在此，在超声波拍摄装置中，为了提高超声波图像的画质，针对向多个振动元件供给的驱动信号、从多个振动元件中的各个振动单元得到的反射波信号进行延迟时间的控制。
具体地说，超声波拍摄装置根据被检测体内的预定的焦点与各振动元件之间的距离所对应的延迟时间，控制向各振动元件供给的驱动信号的定时，由此向被检测体的预定的焦点发送波束成形后的超声波。然后，超声波拍摄装置根据被检测体内的预定的焦点与各振动元件之间的距离所对应的延迟时间，对于在各振动元件中在时间上不同地接收到的来自预定的焦点的信号使各自的时间相一致来进行相加(整相相加)。由此，超声波拍摄装置生成位于焦点的一个接收信号。
这样，为了使来自预定的焦点的各个信号一致，需要模拟或数字的延迟电路。例如，在专利文献1中公开了以下的结构，即串联连接采样保持单元和多个电容存储电路，使采样频率恒定，在电容存储电路中进行每个采样周期的延迟，通过控制采样保持单元的保持时间，进行采样周期以下的短的延迟。另外，在专利文献2中公开了通过数字处理进行接收延迟时间控制的降低电路的规模和制造成本的超声波诊断装置。
现有技术文献
专利文献
专利文献1：日本特开昭62-123819号公报
专利文献2：日本特开2011-250946号公报
发明内容
发明要解决的问题
为了得到三维的立体图像而不是二维的断层图像，在二维阵列状地排列了振子(换能器)的二维探针中，使用数千到一万通道的振子。在这样的二维探针中，由于电缆的条数的制约等，将全部的振子与主体装置连接并不现实，需要在探针头内减少通道数量的处理。因此，需要将模拟信号延迟后进行相加的电子电路。
另外，在一维探针中，也可以通过将模拟信号延迟后相加来减少电缆条数、模拟/数字转换器的个数，能够降低成本、小型化。因此，需要将模拟信号延迟后相加的电子电路。
当在探针头内配备使模拟信号延迟的电路的情况下，需要使该电路成为低消耗功率。这是因为需要抑制因探针头内的发热造成的温度上升。另外，为了在各振子中精度良好地进行接收波束的对焦，要求使信号延迟的延迟时间的分辨率的高分辨率化。并且，要求最大延迟时间长。
现有的基于模拟采样的延迟电路有以下的方法，即并联连接多个电容，使该电容顺序地采样信号，在预定的延迟时间后顺序地从电容读出信号。但是，这样的电路的延迟分辨率由进行采样的时钟的频率决定，如果进行高分辨率化，则必须提高时钟的频率，因此存在消耗功率增大的问题。另外，最大延迟时间由时钟的频率和并联连接的电容的个数决定，因此高分辨率化和最大延迟时间处于权衡的关系，为了满足双方必须并联连接很多的电容。
如专利文献1所记载的那样，通过串联连接生成微小的延迟的电路和生成粗的延迟的电路，能够制作分辨率高、最大的延迟时间长的延迟电路。但是，如果多级地连接电路，则各个电路的消耗功率叠加，因此作为整体的消耗功率会变大。
另外，通过控制采样保持单元的保持时间生成微小的延迟，因此保持时间根据延迟时间而变化，模拟信号的特性产生恶化。这是由于电容中充电的电荷泄漏的量根据保持时间而变化。结果，保持的信号产生与保持时间相关的失真、偏移，电路的特性恶化。
另外，关于保持时间，为了后级的电路取得信号需要获取充分的时间，因此如果生成微小的延迟时间，则无法充分地获取保持时间，特性产生恶化。具体地说，例如保持时的过渡响应不收敛，产生振铃。该振铃在后级的电路进行采样时有可能成为误差原因。为了避免它，结果会提高电路的动作频率，存在消耗功率增大的问题。
并且，在超声波拍摄装置中，必须在使模拟信号延迟后将来自多个振子的信号相加，但在专利文献1中完全没有考虑到这时取得多个通道之间的同步。
根据以上说明，本发明的目的在于，提供一种高分辨率、最大延迟时间长、并且低消耗功率的延迟电路、使用该延迟电路的超声波拍摄装置。
根据本说明书的记载和附图,本发明的上述和其他目的和新的特征会变得明确。
解决问题的手段
为了解决上述问题，本发明采用权利要求所记载的结构。
本申请包含多个解决上述问题的手段，但如果列举其中一个例子，则是一种延迟电路，其具备：输入线，其输入模拟输入信号；多个模拟信号存储元件；输出线，其输出模拟输出信号；多个采样开关，其控制上述输入线和上述多个模拟信号存储元件之间的连接/非连接；多个输出开关，其控制上述多个模拟信号存储元件和上述输出线之间的连接/非连接；时钟生成部，其根据基准时钟生成分别控制上述多个采样开关的采样开关控制信号、分别控制上述多个输出开关的输出开关控制信号，控制上述多个采样开关，将上述模拟输入信号积蓄在上述多个模拟信号存储元件中，控制上述多个输出开关，向上述输出线输出积蓄在上述模拟信号存储元件中的信号，由此使信号延迟，该延迟电路的特征在于，能够使上述多个采样开关控制信号的相位相对于上述多个输出开关控制信号的相位错开。
发明效果
根据本发明，能够提供一种延迟时间的精度高、最大延迟时间长、并且低消耗功率的延迟电路和使用该延迟电路的超声波拍摄装置。
附图说明
图1是本发明的实施例1的延迟电路的结构图。
图2是说明本发明的实施例1的延迟电路的动作的定时图。
图3A是本发明的实施例1的时钟生成部的结构图。
图3B是时钟生成部的内部信号的定时图。
图4是在本发明的实施例2的超声波拍摄装置中使用的电子电路的结构图。
图5是本发明的实施例3的时钟生成部的结构图。
图6是本发明的实施例3的DLL电路的结构图。
图7是本发明的实施例3的使DLL电路动作的时序图。
图8是本发明的实施例4的模拟存储部的结构图。
图9A是本发明的实施例4的模拟存储部的采样时的等价电路。
图9B是本发明的实施例4的模拟存储部的保持时的等价电路。
图9C是本发明的实施例4的模拟存储部的复位时的等价电路。
图10是本发明的实施例5的超声波拍摄装置的结构图。
具体实施方式
根据附图说明用于实施本发明的方式。此外，在用于说明用于实施本发明的方式的全部图中，对具有相同的功能的要素赋予相同的名称、符号，省略其重复的说明。
实施例1
使用图1～图3说明本发明的实施例1的延迟电路。图1是本发明的实施例1的延迟电路的结构图。由电容101a、101b、101c、……、开关102a、102b、102c、……、开关103a、103b、103c、……、缓冲器104、时钟生成部105构成。
时钟生成部105具备相位延迟控制部106、时钟单位延迟控制部107。此外，下标的a、b、c、……表示是相同的构成要素，在不特别需要的情况下省略。
模拟输入信号Vin在通过缓冲器104被放大或进行阻抗变换后，从输入线经由开关102输入到电容101，积蓄与模拟信号Vin对应的电荷。积蓄在电容101中的电荷经由开关103作为输出信号Vout从输出线输出。通过开关102控制用信号对电容101进行充电的定时，通过开关103控制从电容101输出信号的定时。通过时钟生成部105生成控制这些开关的时钟。在本实施例的延迟生成电路中，并联连接多个电容，进行以下的动作，即采样模拟输入信号Vin顺序地存储在电容中，在预定的时间后顺序地输出存储的信号。
图2是说明本发明的实施例1的延迟生成电路的动作的定时图。通过时钟信号S108a控制开关102a。在此，表示在时钟信号S108为高电平的情况下开关102接通，但并不限于该极性。在开关102a接通时向电容101a积蓄与模拟输入信号对应的电荷。在电容101a中积蓄开关102a从接通变化为关断的定时的模拟输入信号的值(201a)。在电容101a中积蓄的电荷在开关103a接通的状态下输出为输出信号(202a)。通过时钟信号S109a控制开关103a的接通/关断的定时。即，通过时钟信号S108a被电容101a采样的信号在时钟信号S109a的接通的定时输出为输出信号。
其他的并联排列的电容101b、101c、……也同样地，分别在时钟信号S108b、S108c、……的定时积蓄与模拟输入信号Vin对应的电荷，在时钟信号S109b、S109c、……的接通的定时输出与所积蓄的电荷对应的信号。
这样，通过时钟信号S109输出通过时钟信号S108采样的信号，因此与模拟输入信号Vin相比，在输出信号Vout中输出以时钟信号S108和时钟信号S109的延迟时间而延迟后的信号。
通过时钟生成部105的相位延迟控制部106和时钟单位延迟控制部107控制时钟信号S108和时钟信号S109的延迟时间。在时钟单位延迟控制部中，以基准时钟的时钟周期Tclk为一个单位，控制其整数倍的延迟时间。即，生成基于时钟的延迟时间Tdc＝M×Tclk的延迟时间。在此，M是整数。
此外，在相位延迟控制部106中，生成不满时钟周期Tclk的微小的延迟时间Tdp。通过控制时钟信号的相位来生成微小延迟Tdp。因此，合计的延迟时间Td＝Tdp+Tdc＝Tdp+M×Tclk。该延迟时间的分辨率由能够控制相位延迟Tdp的分辨率决定。例如，如果生成并控制对时钟周期进行8分割所得的相位的时钟，则得到时钟周期的1/8、即Tclk/8的时间分辨率。另外，最大延迟时间由时钟周期和并联连接的电容的个数决定。因此，能够高精度地得到长的延迟时间。通过这样组合相位延迟和时钟单位延迟，能够兼顾延迟时间的高精度化和长的最大延迟时间。
作为提高延迟时间的分辨率的方法，也可以考虑缩短时钟周期Tclk。但是，如果缩短时钟周期Tclk，则对电容进行充放电的频率变高，消耗功率增大。另外，延迟时间的最大值由并联的电容的个数和时钟的周期决定。如果为了提高延迟时间的分辨率，而缩短时钟周期，同时确保最大延迟时间，则需要与之对应地并联连接许多电容。因此，面积也增大。
在如本实施例那样，通过控制时钟信号的相位来生成微小延迟Tdp的情况下，能够不提高时钟的频率而提高延迟时间的分辨率。因此，能够提供低消耗功率高精度的延迟电路。另外，最大延迟时间由电容的并联个数和时钟的周期决定，因此还能够抑制面积的增加。
图3A是时钟生成部105的结构的一个例子。时钟生成部由时钟单位延迟控制部107和相位延迟控制部106构成。时钟单位延迟控制部107由脉冲生成部301、延迟元件302a、302b、……、缓冲器303a、303b、……、选择器304构成。相位延迟控制部106由缓冲器305a、305b、……、缓冲器306a、306b、……、选择器307、延迟元件308a、308b、……、缓冲器309a、309b、……构成。
脉冲生成部301根据基准时钟，生成在多个周期输出一个周期量的高电平的脉冲信号。具体地说，例如在电容101的并联个数是N个的情况下，以基准时钟的周期的N倍的周期输出脉冲信号。由脉冲生成部301生成的脉冲信号通过串联排列的延迟元件302a、302b、……每次延迟一个时钟周期。将延迟后的信号经由缓冲器303a、303b、……作为时钟信号S109a、S109b、……用于开关013a、103b、……的控制。
另外，将时钟信号S109a、S109b、……输入选择器304，根据控制信号选择其中的一个时钟信号。根据通过该选择器304选择出的信号S310设定时钟单位的延迟。
把选择器304选择出的信号S310输入到串联连接的缓冲器305a、305b、……。图3B是时钟生成部105的内部信号的定时图。缓冲器305根据控制电压控制延迟时间，具有错开时钟的相位的作用。例如将缓冲器构成为串联连接了相对于输入信号输出反转后的输出信号的反相器的电路。把选择器304选择出的信号S310输入到缓冲器305，各缓冲器305a、305b、……输出每次将相位稍微错开的信号S311a、S311b、……。将每次相位稍微错开的信号S311经由缓冲器306a、306b、……输入到选择器307。
使通过缓冲器305将相位错开的量为基准时钟的一个周期以下，由此能够任意地设定微小的延迟时间。另外，该缓冲器305的一级的延迟时间成为通过本实施例的延迟电路能够设定的延迟时间的分辨率。
在选择器307中，选择相位稍微错开的信号S311中的任意一个。根据该选择器307选择出的信号生成时钟周期以下的延迟时间。通过串联连接的延迟元件308a、308b、……使选择器307的输出信号每次延迟时钟周期的量。将延迟后的信号经由缓冲器309a、309b、……作为时钟信号S108a、108b、……用于开关102a、102b、……的控制。
这样，针对根据基准时钟生成的时钟信号S109，通过选择器304选择时钟单位的延迟时间，另外通过选择器307选择错开了相位的信号。通过这样的电路结构，能够通过控制时钟的相位来生成高分辨率的延迟时间。
作为超声波拍摄装置，例如在使用2～8MHz的频带的超声波的情况下，需要以其2倍以上的频率进行采样。因此，作为基准时钟的频率，使用16MHz以上例如20MHz的时钟。在该情况下，如果生成具有对1个周期进行8分割后的相位的时钟信号，则能够提供具有6.25ns的分辨率的延迟电路。
根据本实施例这样的结构，能够在数字电路中安装生成延迟时间的电路的大部分。一般与模拟电路相比，数字电路不消耗恒定的电流，因此是低消耗功率。在将生成微小的延迟的模拟电路和生成大的延迟的模拟电路串联连接起来的情况下，能够实现高分辨率、最大延迟时间长的延迟电路，但在各模拟电路中消耗电力，因此只要串联连接的级数增加，消耗功率就增大。本实施例的延迟电路通过数字电路生成高精度、并且最大延迟时间长的延迟时间，因此不需要串联连接多级对电容进行充放电的模拟电路。因此，本实施例的延迟电路与串联连接多级的模拟电路的情况相比，能够实现低消耗功率化。
此外，在本实施例中，以基准时钟的周期作为一个单位进行了说明，但并不限于此，也可以将基准时钟的一半的周期Tclk/2作为一个单位。
在如本实施例那样控制时钟的相位来生成延迟时间的情况下，相对于基准时钟的相位，时钟信号S108的相位最大错开一个周期的量。因此，在设定时钟单位的延迟时，设想通过相位错开而使相位错开一个周期的量，设置无法进行设定的范围。即，进行控制，使得无论时钟信号S108的相位是怎样的值，时钟信号S108为开(ON)的定时和时钟信号S109为开(ON)的定时都不会重叠。由此，最大延迟时间缩短基准时钟的一个周期的量，因此考虑到该情况来设定并联连接电容的个数。
如果只是错开进行采样的时钟的相位，则还可以考虑以下的方法，即例如上升的定时为与基准时钟相同的相位，改变下降的定时，即改变占空比。但是，如果改变占空比，则在采样时时钟为开(ON)的时间根据延迟时间而变化，因此产生采样模拟信号时的增益的误差等。因此，理想的是几乎不改变时钟信号的高电平的期间地错开相位。
此外，在本实施例中，说明了使用电容作为存储模拟信号的元件，使用积蓄在该电容中的电荷来存储模拟信号的结构，但并不限于此。例如也可以使用MOS等的晶体管作为电流存储模拟信号。在作为电流存储模拟信号的情况下，与电容的情况相比，消耗功率变大，另一方面具有能够削减占用面积的优点。
实施例2
在超声波拍摄装置中使用多个在实施例1中说明的延迟电路。使用图4说明该情况的实施例。图4是在本发明的实施例2的超声波拍摄装置中使用的电子电路的结构图。由单元件电路401a、401b、……、时钟生成部406、加法电路407构成。单元件电路401由换能器402、发送部403、收发分离部404、接收模拟前端部(Analog Front End：AFE)405、模拟存储部110构成。
从发送部403输出的信号经过收发分离部404被交给换能器402。从换能器402输出超声波信号。另外，反射来的超声波信号由换能器402接收，经过收发分离部404输入到接收AFE部405。在接收AFE部405中，对接收到的信号进行放大、滤波等处理。将接收AFE部405的输出输入到模拟存储部110。模拟存储部110例如是图1所示的电路，根据来自时钟生成部406的时钟信号，采样模拟输入信号并将其积蓄在存储器中，在预定的延迟时间后将其输出。
根据时钟生成部406生成的时钟信号控制向各通道的模拟存储部110赋予的延迟时间。对模拟存储部110的输出用开关103进行控制的时钟信号使用在各通道之间取得同步，相位一致的时钟。因此，将各通道电路401a、401b、……的输出作为相位一致的信号输入到加法电路407，对信号进行相加。另一方面，关于模拟存储部110的采样用开关102，因为生成微小的延迟时间，因此有时成为在各通道之间相位错开的信号。这样，通过使控制模拟存储器的输出用开关的时钟的相位在各通道之间一致，输入到后级的加法电路407的信号成为在各通道中相位一致的信号。由此，即使在改变时钟的相位来生成高精度的延迟时间的情况下，也能够使输出信号的相位一致，能够消除控制相位对后级的电路动作的影响。
也可以构成为对各延迟电路的输出信号设置低通滤波器。例如，如果为能够去除时钟周期的噪声的滤波器，则能够降低时钟周期的噪声。另外，也可以对加法电路的输出设置同样的低通滤波器。
此外，在加法电路中，不需要对全部的通道的输出进行相加，可以分为多个块地分别进行相加。例如，在有192个通道的情况下，也可以构成为对每4个通道进行相加，得到48个相加后的输出。或者，也可以将8192个通道的二维阵列的信号以8×8阵列的64个通道进行相加，得到128个输出等。从探头用电缆与主体连接来发送该信号。
通过这样高精度地使多个通道的信号延迟并进行相加，相对于换能器的元件个数，能够削减输出的信号的个数。由此，能够削减电缆的条数、削减将模拟信号变换为数字信号的A/D变换器的个数，能够降低成本。另外，在二维的换能器阵列中，将全部通道的信号从探头与主体连接是不现实的，但通过如本实施例那样高精度地延迟相加，能够以现实的电缆的条数连接探头和主体。
实施例3
在本实施例中，说明时钟生成部的其他结构。图5是本发明的实施例3的时钟生成部的结构图。时钟生成部由多相时钟生成部506、输出时钟生成部507、采样时钟生成部508构成。输出时钟生成部507由脉冲生成部301、触发器(FF)501a、501b、……、缓冲器303a、303b、……构成。多相时钟生成部506由缓冲器502a、502b、……、缓冲器503a、503b、……、构成。采样时钟生成部508由选择器304、选择器504、触发器505a、505b、……、缓冲器309a、309b、……构成。多相时钟生成部506是以基准时钟为基准生成错开了相位的多相时钟的电路。输出时钟生成部507是生成控制模拟存储部的输出开关的时钟信号S109的电路。另外，采样时钟生成部508是生成控制模拟存储部的采样用开关的时钟信号S108的电路。
在脉冲生成部301中，生成在基准时钟的多个周期内1个周期为高电平的脉冲信号。在FF501中，与基准时钟信号同步地锁存脉冲信号，由此使其每次延迟一个时钟。将延迟后的信号经由缓冲器303作为时钟信号S109控制模拟存储部的输出用开关103。另外，将时钟信号S109输入到选择器304。
在多相时钟生成部506中，以基准时钟为基准，生成错开了相位的多相时钟。具体地说，将基准时钟输入到多级的缓冲器502，生成每次将相位错开了微小时间的信号。可以根据控制电压控制该缓冲器502的电源电压，调整因缓冲器产生的延迟时间。将生成的多相时钟输入到选择器504。
在选择器504中，选择并输出多相时钟中的一个相位的时钟(S509)。另外，在选择器304中，选择并输出时钟信号S109中的一个时钟信号(S510)。将通过选择器304选择出的信号S510输入到触发器505，根据选择器504选择出的相位错开的时钟S509使其每次延迟一个时钟。将延迟后的信号经由缓冲器309作为时钟信号S108控制模拟存储部的采样用开关102。
本实施例的时钟生成部能够在多个通道之间共享其一部分。具体地说，例如，输出时钟生成部507能够在各通道中使用同一时钟信号S109，因此能够在多个通道中共享。另外，多相时钟生成部506是根据基准时钟生成多相时钟的电路，是不依存于各通道的延迟时间的必要的功能，因此能够在多个通道之间共享。采样时钟生成部506通过选择器304和选择器504设定各通道的延迟时间。因此，成为不在通道之间共享而对每个通道具有采样时钟生成部的结构。这样，通过在多个通道之间共享电路，能够削减面积和消耗功率。
图6是本实施例的决定生成多相时钟时的控制电压的电路、Delay LockedLoop(延迟锁定环：DLL)电路的一个例子。由缓冲器601a、601b、……、相位比较器602、控制电压生成部603构成。通过串联连接的多级的缓冲器601使基准时钟延迟。关于缓冲器的性能以及级数，设计为大致延迟基准时钟的一个周期那样的值。通过相位比较器602比较缓冲器601的输出和原始的基准时钟的相位。根据比较的结果通过控制电压生成部603生成控制电压，控制缓冲器601的电源电压，调整因缓冲器产生的延迟时间。此外，也可以不控制电源电压，而控制偏置电流等。
这样，通过相位比较器比较基准时钟和延迟后的时钟的相位，控制因缓冲器产生的延迟时间，由此能够生成正确的多相时钟。将这样求出的控制电压用作多相时钟生成部506的控制电压。此外，该DLL电路内的缓冲器601也可以与多相时钟生成部506的缓冲器502通用。向DLL电路内的缓冲器601输入基准时钟，通过作为控制电压生成部的输出的控制信号来控制。另外，同样地也向多相时钟生成部506的缓冲器502输入基准时钟，通过控制电压进行控制。因此，这些缓冲器601和缓冲器502可以通用。作为具体的电路结构，将相位比较器602、控制电压生成部603与多相时钟生成部506的缓冲器502的输出串联连接，将控制电压生成部603的输出用作缓冲器502的控制电压。由此，能够使电路通用化，削减面积和消耗功率。
在图7中，表示使DLL电路动作的时序。首先，以来自外部的控制信号等作为触发而启动DLL电路(S701)。在使DLL动作后，锁定相位(S702)。在锁定相位后，保存这时的控制电压值(S703)。在保存控制电压值后，切断DLL电路自身的电源(S704)。使用保存的控制电压值生成多相时钟(S705)。在这样决定了控制电压后切断DLL电路的电源，由此能够抑制消耗功率。
关于启动DLL的定时，可以考虑启动了超声波拍摄装置的定时、改变拍摄的模式的定时、温度发生了变化的定时等。
实施例4
此前说明了作为模拟存储器而在接地的电容中积蓄模拟信号的电路结构，但并不限于此。可以考虑不是对于接地而是对于运算放大器的虚拟接地将电容进行充电的、不是单端而是差动化的、设置复位期间等的电路结构等。另外，通过不设为开环电路而是设为闭环电路，能够提高输出电压的精度。
在图8中表示本发明的实施例4的模拟存储部的电路结构。由运算放大器801、开关电容部810a、810b、……构成。开关电容部由电容802p、802n、开关803、803n、804p、804n、805、806p、806n、807p、807n、808p、808n构成。在此，下标的p、n表示是差动电路的正侧、负侧，在没有特别需要的情况下省略。
是并联排列多个开关电容部，进行采样和积蓄，在预定的延迟时间后进行输出的电路。通过差动信号Vinp、Vinn将输入信号输入。在图9A中表示本发明的实施例4的模拟存储器的采样时的等价电路。另外，在图9B中表示保持时的等价电路。
在采样时，开关803、804、805接通，开关806、807关断。因此，电容802连接在输入差动信号和作为共模电压(common voltage)的Vcm之间。在采样时，将与输入差动信号对应的电荷积蓄在电容802中。在保持时，开关803、804、805关断，开关806、807接通。由电容802和运算放大器801组成反馈电路，将与采样时积蓄在电容802中的电荷对应的信号作为差动信号Voutp、Voutn输出。
决定在采样时在电容802中积蓄的信号的定时是关断开关805的定时。因此，通过改变用于决定将开关805关断的定时的时钟的相位，能够生成微小的延迟时间。在保持时，在开关806和开关807接通的期间输出在电容802中积蓄的信号。在后级的电路中，在开关806、807从接通变化为关断的紧前进行采样。
另外，在复位时使用开关808。在图9C中表示复位时的等价电路。通过接通开关808，连接运算放大器的输入和输出，因此输出信号成为共模电压，能够进行复位。另外，如果保持这时的电压，则还能够取消运算放大器的输入失调电压(offset voltage)。
如本实施例那样，通过设为差动电路，能够高精度地采样模拟输入信号并使其延迟。特别通过设为差动电路，能够抑制失真。另外，通过构成使用了运算放大器的闭环电路来保持采样到的信号，能够得到高精度的信号。另外，通过对控制开关的时钟信号设置延迟时间，能够使模拟信号延迟。改变相位来控制时钟信号的延迟时间，由此能够得到高分辨率的延迟时间。
实施例5
使用图10说明本发明的实施例5的超声波拍摄装置。图10是本实施例的超声波拍摄装置的结构图。由探头1004、主体装置1005、电缆1006构成。探头具备子阵列1001a、1001b、……、以及时钟生成部406。子阵列由多个单元件电路401a、401b、……、加法电路407、缓冲器1002构成。主体装置具备多个ACD1003a、1003b、……。
在子阵列1001内从各通道401发送超声波，接收反射波。通过加法电路407将各通道的输出相加，经由缓冲器1002传送到主体装置1005。在各通道电路内使接收到的信号延迟。在时钟生成部406中根据来自主体装置1005的基准时钟和控制信号设定用于设定延迟时间的时钟。
在主体装置中，通过模拟/数字变换器(ADC)1003将来自探头的信号变换为数字信号。在ADC1003的采样中使用的时钟使用从主体装置1005向探头1004发送的基准时钟。与基准时钟同步地输出子阵列的各通道电路的延迟电路的输出，因此在ADC中也与该基准时钟同步地进行数字变换。此外，根据需要，也可以使用对基准时钟进行倍增或分频后的时钟。另外，也可以考虑在电缆中的延迟时间来错开进行模拟/数字变换的相位。
在探头内的延迟电路中，与基准时钟同步地输出信号。因此，在时钟的上升/下降的定时产生尖峰状的噪声。在主体装置侧的ADC中与基准时钟同步地进行采样，由此能够避免时钟端的噪声来进行数字化。对于通过ADC1003数字化后的信号，进行数字整相等信号处理，显示超声波图像。
通过如本实施例那样在探头内安装延迟电路和加法电路，能够削减电缆的配线的条数和ADC的个数，能够降低成本。
以上，根据实施方式具体说明了本发明人提出的发明，但本发明并不限于上述实施方式，在不脱离其主要内容的范围内当然能够进行各种变更。
附图标记说明
101a、101b、101c：电容；102a、102b、102c：开关；103a、103b、103c：开关；104：缓冲器；105：时钟生成部；106：相位延迟控制部；107：时钟单位延迟控制部；110：模拟存储部；301：脉冲生成部；302a、302b：延迟元件；303a、303b：缓冲器；304：选择器；305a、305b：缓冲器；306a、306b：缓冲器；307：选择器；308a、308b：延迟元件；309a、309b：缓冲器；401a、401b：单元件电路；406：时钟生成部；407：加法电路；402：换能器；403：发送部；404：收发分离部；405：接收模拟前端部；501a、501b：触发器(FF)；502a、502b：缓冲器；503a、503b：缓冲器；504：选择器；505a、505b：触发器；506：多相时钟生成部；507：输出时钟生成部；508：采样时钟生成部；601a、601b：缓冲器；602：相位比较器；603：控制电压生成部；801：运算放大器；801a、801b：开关电容部；802p、802n：电容；803p、803n、804p、803n、805、806p、806n、807p、807n、808p、808n：开关；1004：探头；1005：主体装置；1006：电缆；1001a、1001b：子阵列；1002：缓冲器；1003a、1003b：ADC。

Claims (15)

1.一种延迟电路，其具备：
输入线，其输入模拟输入信号；
多个模拟信号存储元件；
输出线，其输出模拟输出信号；
多个采样开关，其控制上述输入线和上述多个模拟信号存储元件的连接/非连接；
多个输出开关，其控制上述多个模拟信号存储元件和上述输出线的连接/非连接；
时钟生成部，其根据基准时钟生成分别控制上述多个采样开关的采样开关控制信号、分别控制上述多个输出开关的输出开关控制信号，
控制上述多个采样开关，将上述模拟输入信号积蓄在上述多个模拟信号存储元件中，控制上述多个输出开关，向上述输出线输出积蓄在上述模拟信号存储元件中的信号，由此使信号延迟，
上述延迟电路的特征在于，
能够将上述多个采样开关控制信号的相位相对于上述多个输出开关控制信号的相位错开。
2.根据权利要求1所述的延迟电路，其特征在于，
上述时钟生成部具备：时钟单位延迟控制部，其设定时钟周期单位的延迟；以及相位延迟控制部，其设定将时钟的相位错开后的相位延迟，
上述输出开关控制信号和上述采样开关控制信号的延迟时间是将上述基准时钟的相位错开后的相位延迟与上述基准时钟的周期的整数倍的时钟周期单位的延迟的总和。
3.根据权利要求1所述的延迟电路，其特征在于，
上述基准时钟的相位和上述输出开关控制信号的相位的关系是固定值。
4.根据权利要求1所述的延迟电路，其特征在于，
上述时钟生成部具备：串联连接的多个缓冲电路；以及
从上述多个缓冲电路的各个输出中选择一个信号的第一选择器，
通过上述缓冲电路相对于上述基准时钟的相位生成多个不同的相位的信号，
通过上述第一选择器选择上述多个不同的相位的信号中的一个相位的相位延迟信号，
根据上述相位延迟信号，生成上述采样开关控制信号。
5.根据权利要求4所述的延迟电路，其特征在于，
还具备串联连接的第一多个延迟元件，
使用上述相位延迟信号作为向上述第一多个延迟元件输入的时钟，
将上述第一多个延迟元件的输出信号用于上述多个采样开关控制信号。
6.根据权利要求4所述的延迟电路，其特征在于，
还具备：
相位比较器，其比较2个信号的相位；
控制电压生成部，其根据上述相位比较器的输出生成控制电压，
输入给上述多个缓冲电路的信号是上述基准时钟，
通过上述相位比较器将上述多个缓冲电路的最终级的输出信号和上述基准时钟的相位进行比较，
根据作为上述控制电压生成部的输出的上述控制电压，控制上述多个缓冲电路的延迟时间。
7.根据权利要求6所述的延迟电路，其特征在于，
还具备保持上述控制电压的控制电压保持部，
在使上述相位比较器和上述控制电压生成部动作后，在上述控制电压保持部中保持上述控制电压，
使上述相位比较器和上述控制电压生成部转移为低消耗功率的状态。
8.根据权利要求4所述的延迟电路，其特征在于，
还具备：
脉冲生成部，其对基准时钟进行分频来生成脉冲；
串联连接的第二多个延迟元件；
第二选择器，其选择上述第二多个延迟元件的输出中的一个输出，
通过上述第二多个延迟元件生成每次延迟预定的时钟周期的信号，
将通过上述第二选择器选择出的信号作为上述缓冲电路的输入。
9.根据权利要求4所述的延迟电路，其特征在于，
还具备：
脉冲生成部，其对基准时钟进行分频来生成脉冲；
串联连接的第二多个触发电路，其输入上述基准时钟和上述脉冲生成部的输出，生成每次延迟了预定的时钟周期的信号；
第二选择器，其选择上述第二多个触发电路的输出中的一个输出；
串联连接的第一多个触发电路，
将上述相位延迟信号和上述第二选择器的输出作为上述第一多个触发电路的输入，将上述第一多个触发电路的输出信号用于上述多个采样开关控制信号。
10.根据权利要求1所述的延迟电路，其特征在于，
上述模拟信号存储元件是电容。
11.一种电子电路，其具备：
多个输入线，其输入模拟输入信号；
模拟信号接收电路，其分别与上述多个输入线连接；
从各个上述模拟信号接收电路进行输出的多个输出线，
时钟生成部，
各个上述模拟信号接收电路具备：
多个模拟信号存储元件；
多个采样开关，其控制上述输入线和上述多个模拟信号存储元件的连接/非连接；
多个输出开关，其控制上述输出线和上述多个模拟信号存储元件的连接/非连接，
上述时钟生成部根据基准时钟生成分别控制各个上述模拟信号接收电路的上述多个采样开关的采样开关控制信号和分别控制各个上述模拟信号接收电路的上述多个输出开关的输出开关控制信号，
上述输出开关控制信号和上述采样开关控制信号的延迟时间是将上述基准时钟的相位错开后的相位延迟与上述基准时钟的周期的整数倍的时钟周期单位的延迟的总和，
上述输出开关控制信号的相位与上述基准时钟的相位的关系是固定值，
与上述基准时钟同步地输出各个上述模拟信号接收电路的输出信号。
12.根据权利要求11所述的电子电路，其特征在于，
还具备加法电路，其对上述多个输出线的信号进行相加，
通过上述加法电路使上述多个输出线的信号同步后进行相加。
13.根据权利要求12所述的电子电路，其特征在于，
还具备滤波器，其除去上述基准时钟的频率的信号，
将上述滤波器与上述多个输出线连接，
对上述模拟信号接收电路的输出信号进行滤波。
14.根据权利要求12所述的电子电路，其特征在于，
还具备模拟/数字变换器，其将模拟信号变换为数字信号，
将上述加法电路的输出输入到上述模拟/数字变换器，
根据上述基准时钟生成通过上述模拟/数字变换器将模拟信号变换为数字信号的定时。
15.一种超声波拍摄装置，其具备：
多个超声波换能器，其发送并接收超声波信号；
多个输入线，其输入上述多个超声波换能器各自的接收信号；
模拟信号接收电路，其分别与上述多个输入线连接；
从各个上述模拟信号接收电路进行输出的多个输出线；
加法电路，其将上述多个输出线的信号相加；以及
时钟生成部，
各个上述模拟信号接收电路具备：
多个模拟信号存储元件；
多个采样开关，其控制上述输入线和上述多个模拟信号存储元件的连接/非连接；
多个输出开关，其控制上述多个模拟信号存储元件和上述输出线的连接/非连接，
上述时钟生成部根据基准时钟生成分别控制各个上述模拟信号接收电路的上述多个采样开关的采样开关控制信号和分别控制各个上述模拟信号接收电路的上述多个输出开关的输出开关控制信号，
上述输出开关控制信号和上述采样开关控制信号的延迟时间是将上述基准时钟的相位错开后的相位延迟与上述基准时钟的周期的整数倍的时钟周期单位的延迟的总和，
上述输出开关控制信号的相位与上述基准时钟的相位的关系是固定值，
与上述基准时钟同步地输出各个上述模拟信号接收电路的输出信号，
通过上述加法电路使上述多个输出线的信号同步后进行相加。
CN201380074225.5A 2013-03-28 2013-03-28 延迟电路、使用延迟电路的电子电路以及超声波拍摄装置 Active CN105027219B (zh)

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
PCT/JP2013/059412 WO2014155635A1 (ja) 2013-03-28 2013-03-28 遅延回路、それを用いた電子回路および超音波撮像装置

Publications (2)

Publication Number Publication Date
CN105027219A true CN105027219A (zh) 2015-11-04
CN105027219B CN105027219B (zh) 2018-09-11

Family

ID=51622702

Family Applications (1)

Application Number Title Priority Date Filing Date
CN201380074225.5A Active CN105027219B (zh) 2013-03-28 2013-03-28 延迟电路、使用延迟电路的电子电路以及超声波拍摄装置

Country Status (5)

Country Link
US (1) US10389340B2 (zh)
EP (1) EP2980803B1 (zh)
JP (1) JP6043867B2 (zh)
CN (1) CN105027219B (zh)
WO (1) WO2014155635A1 (zh)

Cited By (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN105748103A (zh) * 2016-04-22 2016-07-13 深圳先进技术研究院 一种延迟激励超声成像方法、装置及延迟激励系统
CN108806744A (zh) * 2017-05-05 2018-11-13 中芯国际集成电路制造(上海)有限公司 一种延时产生电路及非易失性存储器读时序产生电路
CN109274260A (zh) * 2017-07-17 2019-01-25 南亚科技股份有限公司 电压系统及其操作方法
CN109391268A (zh) * 2017-08-03 2019-02-26 迈来芯科技有限公司 用于lidar系统的采样和保持电路
CN110731796A (zh) * 2018-07-19 2020-01-31 株式会社日立制作所 超声波诊断装置及超声波探头
CN111208867A (zh) * 2019-12-27 2020-05-29 芯创智（北京）微电子有限公司 一种基于ddr读数据整数时钟周期的同步电路及同步方法
CN112631114A (zh) * 2019-09-24 2021-04-09 精工爱普生株式会社 电路装置、物理量测量装置、电子设备和移动体

Families Citing this family (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN106061395B (zh) * 2014-02-26 2019-03-01 株式会社日立制作所 超声波探头以及使用该超声波探头的超声波摄像装置
KR20160030753A (ko) * 2014-09-11 2016-03-21 삼성전자주식회사 송신 빔포밍 장치, 수신 빔포밍 장치, 이들을 포함하는 초음파 프로브 및 빔포밍 방법
WO2016120744A1 (en) * 2015-01-29 2016-08-04 Koninklijke Philips N.V. Multiline receive beamformers and related systems and methods
WO2016151705A1 (ja) * 2015-03-20 2016-09-29 株式会社日立製作所 超音波信号受信回路、装置、および、超音波撮像装置
CN106253882B (zh) * 2016-10-12 2023-06-27 江阴元灵芯旷微电子技术有限公司 带模式切换功能的宽范围时间延迟电路
JP6878179B2 (ja) * 2017-07-06 2021-05-26 キヤノンメディカルシステムズ株式会社 超音波プローブ及び超音波診断装置
JP2019161324A (ja) * 2018-03-08 2019-09-19 日本電信電話株式会社 トラックアンドホールド回路
JP7224785B2 (ja) * 2018-06-06 2023-02-20 キヤノンメディカルシステムズ株式会社 超音波プローブ、超音波診断装置、及び決定方法
WO2021024343A1 (ja) * 2019-08-05 2021-02-11 日本電信電話株式会社 サンプリング回路
EP3806334B1 (en) * 2019-10-07 2023-08-30 IniVation AG Switched capacitor circuit
US11329640B1 (en) * 2021-02-18 2022-05-10 Keysight Technologies, Inc. Analog delay lines and analog readout systems

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6061279A (en) * 1998-03-11 2000-05-09 Yamaha Corporation Delay circuit for analog signals
CN1836375A (zh) * 2003-08-18 2006-09-20 罗姆股份有限公司 半导体集成电路器件

Family Cites Families (18)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS56129419A (en) * 1980-03-17 1981-10-09 Hitachi Ltd Delay circuit for analog signal
JPH0793553B2 (ja) * 1983-11-18 1995-10-09 株式会社日立製作所 スイッチド・キャパシタ・フィルタ
JPS62123819A (ja) 1985-11-25 1987-06-05 Hitachi Medical Corp 可変遅延回路
JPS62179437A (ja) * 1986-01-31 1987-08-06 富士通株式会社 超音波非線形パラメ−タ分布測定装置
US5123415A (en) 1990-07-19 1992-06-23 Advanced Technology Laboratories, Inc. Ultrasonic imaging by radial scan of trapezoidal sector
JPH084588B2 (ja) * 1991-07-02 1996-01-24 富士通株式会社 超音波受信装置
JP2965049B2 (ja) 1991-07-31 1999-10-18 株式会社アドバンテスト タイミング発生装置
JP3109263B2 (ja) * 1992-04-07 2000-11-13 松下電器産業株式会社 スイッチトキャパシタサンプルホールド遅延回路
JP2737703B2 (ja) * 1995-06-12 1998-04-08 富士通株式会社 超音波受信装置
JPH10173498A (ja) 1996-12-12 1998-06-26 Mitsubishi Electric Corp 可変遅延回路
JPWO2003043190A1 (ja) * 2001-11-13 2005-03-10 新潟精密株式会社 アナログ遅延回路
JP2004279155A (ja) 2003-03-14 2004-10-07 Advantest Corp サンプリングデジタイザを使ったジッタ試験装置、方法及びこのサンプリングデジタイザを備えた半導体試験装置
JP4044467B2 (ja) * 2003-03-19 2008-02-06 アロカ株式会社 超音波診断装置
US7750706B1 (en) * 2006-07-21 2010-07-06 Marvell International Ltd. Circuits, architectures, apparatuses, systems, and methods for low voltage clock delay generation
US8072253B2 (en) * 2006-09-13 2011-12-06 Nec Corporation Clock adjusting circuit and semiconductor integrated circuit device
JP2009065278A (ja) * 2007-09-04 2009-03-26 Toshiba Corp フィルタ回路、これを用いた受信機及びフィルタリング方法
JP4443616B2 (ja) * 2008-03-07 2010-03-31 株式会社半導体理工学研究センター 時間デジタル変換回路
JP5468468B2 (ja) 2010-06-01 2014-04-09 株式会社東芝 超音波診断装置

Patent Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6061279A (en) * 1998-03-11 2000-05-09 Yamaha Corporation Delay circuit for analog signals
CN1836375A (zh) * 2003-08-18 2006-09-20 罗姆股份有限公司 半导体集成电路器件

Cited By (13)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO2017181475A1 (zh) * 2016-04-22 2017-10-26 深圳先进技术研究院 一种延迟激励超声成像方法、装置及延迟激励系统
CN105748103B (zh) * 2016-04-22 2019-08-23 深圳先进技术研究院 一种延迟激励超声成像方法及装置
CN105748103A (zh) * 2016-04-22 2016-07-13 深圳先进技术研究院 一种延迟激励超声成像方法、装置及延迟激励系统
CN108806744B (zh) * 2017-05-05 2020-11-27 中芯国际集成电路制造(上海)有限公司 一种延时产生电路及非易失性存储器读时序产生电路
CN108806744A (zh) * 2017-05-05 2018-11-13 中芯国际集成电路制造(上海)有限公司 一种延时产生电路及非易失性存储器读时序产生电路
CN109274260A (zh) * 2017-07-17 2019-01-25 南亚科技股份有限公司 电压系统及其操作方法
CN109391268A (zh) * 2017-08-03 2019-02-26 迈来芯科技有限公司 用于lidar系统的采样和保持电路
CN109391268B (zh) * 2017-08-03 2024-02-20 迈来芯科技有限公司 用于lidar系统的采样和保持电路
CN110731796A (zh) * 2018-07-19 2020-01-31 株式会社日立制作所 超声波诊断装置及超声波探头
US11298107B2 (en) 2018-07-19 2022-04-12 Fujifilm Healthcare Corporation Ultrasonic diagnostic device and ultrasonic probe
CN112631114A (zh) * 2019-09-24 2021-04-09 精工爱普生株式会社 电路装置、物理量测量装置、电子设备和移动体
CN111208867B (zh) * 2019-12-27 2021-08-24 芯创智（北京）微电子有限公司 一种基于ddr读数据整数时钟周期的同步电路及同步方法
CN111208867A (zh) * 2019-12-27 2020-05-29 芯创智（北京）微电子有限公司 一种基于ddr读数据整数时钟周期的同步电路及同步方法

Also Published As

Publication number Publication date
JP6043867B2 (ja) 2016-12-14
WO2014155635A1 (ja) 2014-10-02
US20160013782A1 (en) 2016-01-14
CN105027219B (zh) 2018-09-11
EP2980803A4 (en) 2017-03-01
US10389340B2 (en) 2019-08-20
EP2980803A1 (en) 2016-02-03
EP2980803B1 (en) 2020-11-25
JPWO2014155635A1 (ja) 2017-02-16

Similar Documents

Publication Publication Date Title
CN105027219A (zh) 延迟电路、使用延迟电路的电子电路以及超声波拍摄装置
JP6205481B2 (ja) 超音波プローブおよびそれを用いた超音波撮像装置
TWI435711B (zh) 用於超音波系統之分束形成傳送器電路系統
CN102369669B (zh) 用于非重叠时钟产生的技术
JP2000269423A (ja) 半導体集積回路
TW201905490A (zh) 用於超音波應用的網格式數位微波束成形
US7817076B2 (en) Multiple mode digitization system for a non-destructive inspection instrument
JP5617688B2 (ja) 時間デジタル変換装置
CN102195648A (zh) 输出装置及测试装置
Um et al. A single-chip 32-channel analog beamformer with 4-ns delay resolution and 768-ns maximum delay range for ultrasound medical imaging with a linear array transducer
US20100169045A1 (en) Measurement apparatus for improving performance of standard cell library
US11298107B2 (en) Ultrasonic diagnostic device and ultrasonic probe
Stefanelli et al. An analog beam-forming circuit for ultrasound imaging using switched-current delay lines
US8736318B2 (en) Multiphase clock divider
Um et al. A single-chip time-interleaved 32-channel analog beamformer for ultrasound medical imaging
WO2006067852A1 (ja) 同期型記憶装置、およびその制御方法
CN115037286A (zh) 基于fpga芯片的延迟脉冲产生装置、方法及电子设备
JP6157483B2 (ja) Ａｄ変換器及び受信装置
CN103647528B (zh) 非交叠时钟产生电路
JP2009055597A (ja) タイミング発生回路
JP2018121807A (ja) 超音波振動子を用いた送受信方法、超音波探触子および超音波診断装置
RU2317638C1 (ru) Генератор программируемой задержки
JP3891913B2 (ja) 半導体集積回路およびそのテスト方法
JP2008099738A (ja) 超音波診断装置
CN114844488A (zh) 负压脉冲控制信号产生电路及方法

Legal Events

Date Code Title Description
C06 Publication
PB01 Publication
C10 Entry into substantive examination
SE01 Entry into force of request for substantive examination
GR01 Patent grant
GR01 Patent grant
TR01 Transfer of patent right

Effective date of registration: 20211118

Address after: Chiba County, Japan

Patentee after: Fujifilm medical health Co.,Ltd.

Address before: Tokyo, Japan

Patentee before: Hitachi, Ltd.

TR01 Transfer of patent right