CN104751811A - 显示装置及其驱动方法 - Google Patents

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Abstract

显示装置及其驱动方法。一种显示装置包括：源驱动器集成电路(IC)，其包括均衡器和时钟恢复电路，所述均衡器根据均衡(EQ)设定值将通过一对信号线接收的数据信号提升，所述时钟恢复电路恢复所述数据信号的时钟；时序控制器，其通过所述一对信号线连接到所述源驱动器IC并且将所述数据信号传输到所述源驱动器IC。所述源驱动器IC与在所述时钟恢复电路处于锁定状态时输出的内部时钟的时序一致地对所述数据信号进行取样。所述源驱动器IC还包括均衡器控制电路，所述均衡器控制电路用于当所述时钟恢复电路处于未锁定状态并且所述EQ设定值改变时将所述均衡器初始化。

Description

显示装置及其驱动方法
本申请要求2013年12月30日提交的韩国专利申请No.10-2013-0166670的权益，该专利申请的全部内容出于所有目的以引用方式并入本文，如同在本文中完全阐明。
技术领域
本发明的实施方式涉及显示装置及其驱动方法。
背景技术
有源矩阵型液晶显示器使用薄膜晶体管(TFT)作为开关元件显示运动画面。有源矩阵型液晶显示器可被制成比阴极射线管(CRT)更小且更紧凑，因此可应用于便携式信息器具、办公设备、计算机等的显示单元。另外，有源矩阵型液晶显示器可应用于电视，因此快速取代了阴极射线管。
液晶显示器包括：多个源驱动器集成电路(IC)，其用于向液晶显示面板的数据线供应数据电压；多个选通驱动器IC，其用于向液晶显示面板的选通线顺序地供应选通脉冲(或扫描脉冲)；时序控制器，其用于控制源驱动器IC和选通驱动器IC等。
时序控制器通过接口(例如，微型低压差分信号(LVDS)接口)向源驱动器IC供应数字视频数据、用于对数字视频数据进行取样的时钟、用于控制源驱动器IC的操作的控制信号等。源驱动器IC将从时序控制器接收的数字视频数据转换成模拟数据电压并且向数据线供应模拟数据电压。
当时序控制器通过微型LVDS接口以多点方式连接到源驱动器IC时，在时序控制器和源驱动器IC之间需要红色(R)数据传输线、绿色(G)数据传输线、蓝色(B)数据传输线、用于控制输出的操作时序和源驱动器IC的极性反相操作的控制线、时钟传输线等。在微型LVDS接口中，RGB数据(例如，RGB数字视频数据)和时钟被作为差分信号对传输。因此，当同时传输奇数数据和偶数数据时，在时序控制器和源驱动器IC之间需要用于传输RGB数据的至少14条线。当RGB数据是10位数据时，需要18条线。因此，许多线必须形成在安装在时序控制器和源驱动器IC之间的源印刷电路板(PCB)上。因此，难以减小源PCB的宽度。
在其全部内容特此以引用方式并入的美国专利No.8,330,699(2012年12月11日颁布)、美国专利No.7,898,518(2011年3月1日颁布)和美国专利No.7,948,465(2011年5月24日颁布)中公开了嵌入式面板接口(EPI)协议，该协议以点对点方式连接时序控制器和源驱动器IC，以将时序控制器和源驱动器IC之间的线的数量减至最少并且稳定信号传输。
EPI协议满足下面的接口规则(1)至(3)。
(1)时序控制器的发送端与源驱动器IC的接收端以点对点方式经由信号线对连接。
(2)在时序控制器和源驱动器IC之间没有连接单独的时钟线对。时序控制器将视频数据和控制数据连同时钟信号一起通过信号线对传输到源驱动器IC。
(3)用于时钟和数据恢复(CDR)功能的时钟恢复电路被嵌入源驱动器IC的每个中。时序控制器将时钟训练模式信号或前导信号传输到源驱动器IC，使得时钟恢复电路的输出相位和输出频率应该被锁定。当通过信号线对输入时钟训练模式信号和时钟信号时，嵌入各源驱动器IC中的时钟恢复电路产生内部时钟。
当内部时钟的相位和频率被锁定时，源驱动器IC向时序控制器反馈-输入指示输出稳定状态的高逻辑电平的锁定信号。锁定信号通过与时序控制器和最后一个源驱动器IC连接的锁定反馈信号线反馈-输入到时序控制器。
如上所述，在EPI协议中，时序控制器在将输入图像的视频数据和控制数据传输到源驱动器IC之前，将时钟训练模式信号传输到源驱动器IC。源驱动器IC的时钟恢复电路基于时钟训练模式信号在输出和恢复内部时钟的同时执行时钟训练操作。当内部时钟的相位和频率被稳定锁定时，在源驱动器IC和时序控制器之间形成被传输了输入图像的视频数据的数据链路。时序控制器响应于从最后一个源驱动器IC接收的锁定信号，开始将视频数据和控制数据传输到源驱动器IC。
EPI技术的应用已经扩展到各种模式。近来，已经尝试使用以多点方式将时序控制器与源驱动器IC连接以通过EPI传输数据的方法来减少时序控制器和源驱动器IC之间的线的数量。因为当时序控制器与源驱动器IC以点对点方式连接时待传输数据的量增大，所以EPI方式下的数据传输频率大于点对点方式下的数据传输频率。然而，EPI方式容易由于外部噪声、印刷电路板(PCB)的阻抗不匹配、时序控制器和源驱动器IC的信号线对的长度差异等而使传输到源驱动器IC的一对信号(P，N)的波形失真。
用于将输入信号提升(boost)的均衡器可嵌入源驱动器IC中。当源驱动器IC的输入信号被提升时，噪声被放大。因此，在放大后的信号中出现毛刺(glitch)波形。当毛刺波形被输入到源驱动器IC的时钟恢复电路时，时钟恢复电路的输出相位和输出频率没有被锁定。因此，时钟恢复电路转换成未锁定状态。然后，时序控制器响应于未锁定状态的锁定信号将时钟训练模式信号传输到源驱动器IC。然而，源驱动器IC的信号被根据均衡(EQ)设定值提升，再次产生毛刺波形。另外，重复时钟训练，在屏幕上没有再现输入图像。因此，在屏幕上显示异常噪声。结果，难以在时序控制器与源驱动器IC以多点方式连接的状态下应用EPI技术。
发明内容
本发明的实施方式提供了显示装置及其驱动方法，其能够防止由于源驱动器集成电路接收的信号被提升而导致源驱动器IC故障。
在一个方面，一种显示装置包括：源驱动器集成电路(IC)，其包括均衡器和时钟恢复电路，所述均衡器被构造成根据均衡(EQ)设定值将通过一对信号线接收的数据信号提升，所述时钟恢复电路被构造成恢复所述数据信号的时钟，所述源驱动器IC被构造成与当所述时钟恢复电路处于锁定状态时输出的内部时钟的时序一致地对所述数据信号进行取样；时序控制器，其通过所述一对信号线连接到所述源驱动器IC，所述时序控制器被构造成将所述数据信号传输到所述源驱动器IC。
所述源驱动器IC还包括均衡器控制电路，所述均衡器控制电路被构造成当所述时钟恢复电路处于未锁定状态并且所述EQ设定值改变时将所述均衡器初始化。
附图说明
附图被包括以提供对本发明的进一步理解，并入且构成本说明书的一部分，附图示出本发明的实施方式并且与描述一起用于说明本发明的原理。在附图中：
图1和图2示出根据本发明的示例性实施方式的显示装置；
图3是示出根据本发明的实施方式的用于时序控制器和源驱动器集成电路(IC)之间的信号传输的嵌入式面板接口(EPI)协议的示例的波形图；
图4示出根据本发明的实施方式的时钟训练模式信号、控制数据和像素数据的比特流的示例；
图5详细示出根据本发明的实施方式的源驱动器IC；
图6是示出根据本发明的实施方式的通过延迟锁相环(DLL)恢复的多相位的内部时钟示例的波形图；
图7是示出根据本发明的实施方式的其中因均衡器的提升而产生毛刺波形的示例的波形图；
图8示出根据本发明的实施方式的其中当频率变化时延迟锁相环保持未锁定状态的示例；
图9是示出根据本发明的实施方式的在频率变化之前和之后的数据取样时序的比较的波形图；
图10是示出根据本发明的实施方式的当延迟锁相环(DLL)处于未锁定状态时通过初始化均衡器将DLL快速转换成锁定状态的效果的波形图；
图11是示出根据本发明的示例性实施方式的用于驱动显示装置的方法的流程图；
图12是根据本发明的实施方式的均衡器控制电路的电路图。
具体实施方式
现在，将详细参照本发明的实施方式，这些实施方式的示例在附图中示出。在任何可能的地方，在整个附图中，将使用相同的参考标号表示相同或类似的部件。应该注意，如果确定已知技术会误导本发明的实施方式，则可省略对已知技术的详细描述。
根据本发明的示例性实施方式的显示装置可被实现为诸如液晶显示器(LCD)、场发射显示器(FED)、等离子体显示面板(PDP)和有机发光显示器的平板显示器。在下面的描述中，将使用液晶显示器作为平板显示器的示例来描述本发明的实施方式。可使用其它平板显示器。
如图1中所示，根据本发明的实施方式的液晶显示器包括液晶显示面板PNL、时序控制器TCON、一个或多个源驱动器集成电路(IC)SIC#1至SIC#4和选通驱动器IC GIC。
液晶层形成在液晶显示面板PNL的基板之间。液晶显示面板PNL包括基于数据线DL和选通线GL的交叉结构布置成矩阵形式的液晶单元。
包括数据线DL、选通线GL、薄膜晶体管(TFT)、存储电容器Cst等的像素阵列形成在液晶显示面板PNL的TFT阵列基板上。由通过TFT供应数据电压的像素电极和被供应公共电压的公共电极之间的电场，驱动各液晶单元。TFT的栅极连接到选通线GL，TFT的漏极连接到数据线DL。TFT的源极连接到液晶单元的像素电极。TFT响应于通过选通线GL供应的选通脉冲而导通并且将数据电压从数据线DL供应到液晶单元的像素电极。黑底、滤色器、公共电极等形成在液晶显示面板PNL的滤色器基板上。偏振板分别附接到液晶显示面板PNL的TFT阵列基板和滤色器基板。用于设置液晶的预倾斜角的取向层分别形成在液晶显示面板PNL的TFT阵列基板和滤色器基板上。分隔件可形成在液晶显示面板PNL的TFT阵列基板和滤色器基板之间，以保持液晶单元的单元间隙恒定。
液晶显示面板PNL可以诸如扭曲向列(TN)模式和垂直取向(VA)模式的垂直电场驱动方式实现或者以诸如面内切换(IPS)模式和边缘场切换(FFS)模式的水平电场驱动方式实现。根据本发明的实施方式的液晶显示器可被实现为包括透射型液晶显示器、透反射型液晶显示器和反射型液晶显示器的任何类型的液晶显示器。透射型液晶显示器和透反射型液晶显示器需要背光单元。背光单元可被实现为直下型背光单元或边光型背光单元。
信号线对101分别连接在时序控制器TCON和源驱动器IC SIC#1至SIC#4之间并且将EPIC数据的差分信号对传输到源驱动器IC SIC#1至SIC#4。锁定线102连接在时序控制器TCON和最后一个源驱动器IC SIC#4之间并且将锁定信号LOCK传输到时序控制器TCON。
时序控制器TCON通过诸如低压差分信号(LVDS)接口和最小化传输差分信号(TMDS)接口的接口，从外部主机系统(未示出)接收诸如垂直同步信号Vsync、水平同步信号Hsync、外部数据使能信号DE和主时钟CLK的外部时序信号。时序控制器TCON基于嵌入式面板接口(EPI)协议将时钟训练模式信号CT、控制数据CTR和像素数据RGB转换成低压的差分信号对并且通过信号线对101将它们传输到源驱动器IC SIC#1至SIC#4。时钟训练模式信号CT、控制数据CTR和像素数据RGB均包括EPI时钟。
当从接收到的EPI时钟恢复的内部时钟的相位和频率被锁定时，源驱动器ICSIC#1至SIC#4中的每个的时钟恢复电路产生指示锁定状态的高逻辑电平的锁定信号LOCK。另一方面，当从接收到的EPI时钟恢复的内部时钟的相位和频率未被锁定时，源驱动器IC SIC#1至SIC#4中的每个的时钟恢复电路产生指示未锁定状态的低逻辑电平的锁定信号LOCK。锁定信号LOCK被传输到下一个源驱动器IC。最后一个源驱动器IC SIC#4通过锁定线102将锁定信号LOCK传输到时序控制器TCON。电源电压VCC被输入到第一源驱动器IC SIC#1的锁定信号输入端。
当锁定信号LOCK处于低逻辑电平时，时序控制器TCON将时钟训练模式信号CT传输到源驱动器IC SIC#1至SIC#4。当锁定信号LOCK的电平转换成高逻辑电平时，时序控制器TCON开始将输入图像的像素数据RGB和控制数据CTR传输到源驱动器IC SIC#1至SIC#4。
EPI时钟被输入到源驱动器IC SIC#1至SIC#4中的每个的时钟恢复电路。时钟恢复电路使用延迟锁相环(DLL)产生{(视频数据的RGB位的数量)×2}个内部时钟。另外，DLL产生锁定信号LOCK。时钟恢复电路可使用锁相环(PLL)替代DLL。源驱动器IC SIC#1至SIC#4与内部时钟的时序一致地对输入图像的视频数据位进行取样，然后将取样的像素数据转换成并行数据。
源驱动器IC SIC#1至SIC#4以代码映射方法对通过信号线对101输入的控制数据CTR进行解码并且恢复源控制数据和选通控制数据。源驱动器IC SIC#1至SIC#4响应于恢复后的源控制数据将输入图像的视频数据转换成正模拟视频数据电压和负模拟视频数据电压并且将数据电压供应到液晶显示面板PNL的数据线DL。源驱动器IC SIC#1至SIC#4可将选通控制数据传输到选通驱动器IC GIC中的至少一个。
选通驱动器IC GIC响应于选通控制数据将与正模拟视频数据电压和负模拟视频数据电压同步的选通脉冲顺序地供应到液晶显示面板PNL的选通线GL，选通控制数据是直接从时序控制器TCON接收的或者是通过源驱动器IC SIC#1至SIC#4接收的。
如图2中所示，时序控制器TCON可以多点方式通过一对信号线101连接到N个源驱动器IC并且可同时将EPI数据的差分信号对传输到N个源驱动器IC，其中，N是等于或大于2的正整数。
图3是示出用于时序控制器TCON和源驱动器IC SIC#1至SIC#4之间的EPI数据传输的EPI协议的波形图。图4示出时钟训练模式信号、控制数据和像素数据的比特流。
如图3和图4中所示，时序控制器TCON在第一阶段Phase-I的时段期间将预定频率的时钟训练模式信号CT传输到源驱动器IC SIC#1至SIC#4。当通过锁定线102输入高逻辑电平H的锁定信号LOCK时，时序控制器TCON执行第二阶段Phase-II的信号的传输。在第二阶段Phase-II的时段期间，时序控制器TCON将控制数据CTR传输到源驱动器IC SIC#1至SIC#4。当锁定信号LOCK保持在高逻辑电平H时，时序控制器TCON执行第三阶段Phase-III的信号的传输。在第三阶段Phase-III的时段期间，时序控制器TCON将输入图像的像素数据(即，RGB数据)传输到源驱动器IC SIC#1至SIC#4。
在图3中，“Tlock”是从时钟训练模式信号CT开始被传输到源驱动器IC SIC#1至SIC#4之后直到源驱动器IC SIC#1至SIC#4的时钟恢复电路的输出相位和输出频率被锁定并且锁定信号LOCK反转成高逻辑电平H之前的时间。
当从最后一个源驱动器IC SIC#4输入低逻辑电平L的锁定信号LOCK时，时序控制器TCON执行第一阶段Phase-I的操作并且将时钟训练模式信号CT传输到源驱动器IC SIC#1至SIC#4，以继续源驱动器IC SIC#1至SIC#4的时钟训练。
在垂直消隐时段期间，时钟训练模式信号CT可被传输到源驱动器IC SIC#1至SIC#4。垂直消隐时段意指在第N帧时段和第(N+1)帧时段之间的、没有数据使能信号DE的时段，其中，N是正整数。在垂直消隐时段中，输入图像的像素数据没有被输入到时序控制器TCON。在水平消隐时段中，可传输控制数据CTR。水平消隐时段意指在传输第N线的像素数据的第N水平时段和传输第(N+1)线的像素数据的第(N+1)水平时段之间的、没有数据使能信号DE的时段。
图5示出源驱动器IC的内部电路构造。
如图5中所示，源驱动器IC SIC#1至SIC#4中的每个向k条数据线D1至Dk供应正模拟数据电压和负模拟数据电压，其中，k是正整数。
源驱动器IC SIC#1至SIC#4中的每个包括均衡器10、数据取样和解串器11、数模转换器(DAC)12、输出电路13等。
均衡器10可根据均衡(EQ)设定值放大源驱动器IC SIC的接收端Rx的输出。EQ设定值被编码到控制数据CTR并且被传输到源驱动器IC SIC。EQ设定值可以是2位EQ1和EQ2的以下数据。
EQ1和EQ2＝LL(或00)：均衡器关闭
EQ1和EQ2＝LH(或01)：低提升
EQ1和EQ2＝HL(或10)：中提升
EQ1和EQ2＝HH(或11)：高提升
当EQ1和EQ2是01、10和11时，均衡器10将接收到的信号提升，使得信号的低逻辑电平是更低值并且信号的高逻辑电平是更高值，从而放大信号。当EQ1和EQ2是00时，均衡器10不将接收到的信号提升而是将信号供应到数据取样和解串器11。EQ设定值被数据取样和解串器11恢复并且被输入到均衡器10。
数据取样和解串器11使用DLL恢复从时序控制器TCON接收的EPI时钟，产生内部时钟，按各内部时钟的时序对接收到的数据位进行取样。数据取样和解串器11锁存取样的数据位，然后同时输出数据位。因此，数据位被转换成并行数据。
数据取样和解串器11基于内部时钟对接收到的控制数据进行取样并且恢复源控制数据。当选通控制数据被编码到控制数据时，数据取样和解串器11恢复选通控制数据并且将恢复后的选通控制数据传输到选通驱动器IC GIC。源控制数据可包括源输出使能信号SOE、极性控制信号POL等。极性控制信号POL指示供应到数据线D1至Dk的正模拟数据电压和负模拟数据电压的极性。源输出使能信号SOE控制源驱动器IC SIC的数据输出时序和电荷共享时序。当使用除了液晶显示器之外的显示装置时，可省略极性控制信号POL。选通控制数据包括选通起始脉冲、选通输出使能信号等。
DAC 12将从数据取样和解串器11接收的视频数据转换成正伽玛补偿电压GH和负伽玛补偿电压GL并且产生正模拟数据电压和负模拟数据电压。DAC 12响应于极性控制信号POL反转数据电压的极性。
在源输出使能信号SOE的高逻辑时段期间，输出电路13通过电荷共享将正数据电压和负数据电压的平均电压或一半VDD电压HVDD供应到数据线D1至Dk。在电荷共享的时段期间，源驱动器IC SIC供应正数据电压的输出通道和源驱动器IC SIC供应负数据电压的输出通道被短路，因此正数据电压和负数据电压的平均电压被供应到数据线D1至Dk。在源输出使能信号SOE的低逻辑时段期间，输出电路13通过输出缓冲器将正模拟数据电压和负模拟数据电压供应到数据线D1至Dk。
各源驱动器IC的时钟恢复电路可被实现为DLL。如图6中所示，DLL在接收到的信号的EPI时钟的边缘时间产生参考时钟CLK0并且顺序地延迟参考时钟CLK0。因此，DLL恢复具有预定时间间隔的多相位的时钟CLK1至CLKM并且产生内部时钟。数据取样和解串器11以与内部时钟之中的与中心数据位同步的时钟一致地对数据位进行取样。
图7是示出其中因均衡器的提升而产生毛刺波形的示例的波形图。
如图7的(a)中所示，在发送到源驱动器IC的EPI数据的一对信号(p，n)彼此相遇的位置，确定数据位的低逻辑电平或高逻辑电平。信号对(p，n)可包括在电压变化的过渡处的峰值分量的噪声。如图7的(b)中所示，均衡器10将EPI数据的信号对(p，n)提升，使得信号对(p，n)的低逻辑电平和高逻辑电平分别具有更低值和更高值。因此，接收到的信号对中的峰值分量进一步增大。如图7的(c)中所示，放大后的峰值分量变成毛刺波形。
如图8中所示，当时序控制器TCON传输的EPI数据的传输频率改变时，均衡器10的输出频率改变。因为DLL在恢复时钟时需要延迟时间，所以因延迟时间，时钟的边缘时间不是根据均衡器10输出的EPI数据准确检测的。在图8中，“RST”是在各源驱动器IC的时钟恢复电路的输出被稳定锁定之后产生的源驱动器IC的内部信号。
当毛刺波形是因均衡器10的过度提升产生的时，DLL误认时钟训练模式信号CT的时钟边缘时间。因此，DLL没有恢复时钟并且将锁定信号LOCK的电平减小成低逻辑电平。时序控制器TCON响应于低逻辑电平的锁定信号LOCK将时钟训练模式信号CT传输到源驱动器IC。然而，接收到的信号对再次被均衡器10提升，DLL保持在未锁定状态。因为直到DLL的相位被再次锁定之前时序控制器TCON连续传输时钟训练模式信号CT，所以在屏幕上显示异常图像。因为EPI数据的频率高，所以图2中示出的多点方式的接口连接结构对于以上问题而言是较弱的。
图9的(a)示出在频率改变之前在正常状态下的DLL时钟的取样时序和与DLL时钟的上升沿同步的EPI数据。图9的(b)示出当EPI数据的频率改变时因DLL的延迟时间(例如，几微秒)造成的控制数据CTR的取样误差。当从时钟训练模式信号CT取样的信息被误认为EQ设定值“10”、“01”或“11”时，均衡器10因误认的EQ设定值而重复过度提升并且输出毛刺波形。当毛刺波形被输入到DLL时，因为DLL保持未锁定状态，所以时序控制器TCON将时钟训练模式信号CT连续传输到源驱动器IC SIC#1至SIC#4。
图10是示出当DLL处于未锁定状态时通过初始化均衡器将DLL快速转换成锁定状态的效果的波形图。
如图10中所示，根据本发明的实施方式的显示装置在DLL处于未锁定状态并且EQ设定值不是初始值时将EQ设定值变成初始值，从而将均衡器10初始化。当均衡器10被初始化成初始值“LL”(或“00”)时，均衡器10没有将接收到的信号对过度提升。因此，根据本发明的实施方式的显示装置可防止产生毛刺波形。结果，DLL快速检测没有毛刺波形的输入信号中的时钟边缘时间，锁定内部时钟的相位和频率。DLL可将锁定信号LOCK变成高逻辑电平。
图11是示出根据本发明的实施方式的用于驱动显示装置的方法的流程图。
如图11中所示，在步骤S1中，在第一阶段Phase-I的时段期间，时序控制器TCON将时钟训练模式信号CT传输到源驱动器IC SIC#1至SIC#4。在步骤S2中，当锁定状态(＝高逻辑电平)通过锁定线12被输入到DLL时，时序控制器TCON执行第二阶段Phase-II的信号的传输。在步骤S3中，在第二阶段Phase-II的时段期间，时序控制器TCON将控制数据CTR传输到源驱动器IC SIC#1至SIC#4。
在步骤S4至S6中，图12中的示出的均衡器控制电路感测EQ设定值并且当EQ设定值改变并且DLL处于未锁定状态时将EQ设定值初始化。
在步骤S7和S8中，当DLL处于锁定状态(＝高逻辑电平)时，时序控制器TCON继控制数据CTR之后将输入图像的像素数据RGB传输到源驱动器IC SIC#1至SIC#4。
图12是均衡器控制电路的电路图。
如图12中所示，在源驱动器IC SIC#1至SIC#4中的每个中，均衡器控制电路连接在均衡器10和数据取样和解串器11之间。当EQ设定值改变并且DLL处于未锁定状态时，均衡器控制电路将均衡器10初始化。
源驱动器IC SIC#1至SIC#4中的每个的均衡器控制电路包括第一锁存器21和第二锁存器25、第一比较器22和第二比较器23、与门24和EQ选择器26。
第一锁存器21存储在初始驱动阶段中取样的初始EQ设定值，在初始驱动阶段中，DLL稳定于锁定状态并且开始产生内部时钟。第一比较器22比较初始EQ设定值与当前EQ设定值，并且当当前EQ设定值不同于初始EQ设定值时产生高逻辑电平的输出。第二比较器23比较参考值ref与锁定信号LOCK，并且当锁定信号LOCK小于参考值ref时产生高逻辑电平的输出。
与门24对第一比较器22和第二比较器23的输出执行与运算并且输出与运算的结果。因此，与门24检测DLL未锁定并且EQ设定值改变的时间。
当与门24的输出是高逻辑电平时，第二锁存器25存储来自第一锁存器21的EQ设定值。当与门24的输出是高逻辑电平时，EQ选择器26将第二锁存器25的输出作为EQ设定值供应到均衡器10。另一方面，当与门24的输出是低逻辑电平时，EQ选择器26将当前EQ设定值供应到均衡器10。
DLL和PLL被用作源驱动器IC SIC#1至SIC#4中的每个的时钟恢复电路，用于将输入信号的相位与输出信号的相位同步。因此，当甚至使用PLL以及DLL作为时钟恢复电路的源驱动器IC误认EQ设定值时，本发明的实施方式也通过上述方法将EQ设定值初始化并且可防止源驱动器IC出现故障。
如上所述，本发明的实施方式在源驱动器IC的时钟恢复电路处于未锁定状态并且EQ设定值改变时将均衡器初始化，从而防止产生毛刺波形。结果，本发明的实施方式可防止由于源驱动器IC接收到的信号被提升而使源驱动器IC出现故障。
尽管已经参照实施方式的多个示例性实施方式描述了实施方式，但应该理解，本领域的技术人员可设想到将落入本公开的原理的范围内的众多其它修改形式和实施方式。更特别地，在本公开、附图和随附权利要求书的范围内，对主题组合布置的组件部件和/或布置可以进行各种变化和修改。除了组件部件和/或布置的变化和修改之外，本领域的技术人员还将清楚替代用途。

Claims (6)

1.一种显示装置，该显示装置包括：
源驱动器集成电路(IC)，其包括均衡器和时钟恢复电路，所述均衡器被构造成根据均衡(EQ)设定值将通过一对信号线接收的数据信号提升，所述时钟恢复电路被构造成恢复所述数据信号的时钟，源驱动器IC被构造成与当所述时钟恢复电路处于锁定状态时输出的内部时钟的时序一致地对所述数据信号进行取样；
时序控制器，其通过信号线对连接到所述源驱动器IC，所述时序控制器被构造成将所述数据信号传输到所述源驱动器IC，
其中，所述源驱动器IC还包括均衡器控制电路，所述均衡器控制电路被构造成当所述时钟恢复电路处于未锁定状态并且EQ设定值改变时将所述均衡器初始化。
2.根据权利要求1所述的显示装置，其中，所述时钟恢复电路包括延迟锁相环。
3.根据权利要求1所述的显示装置，其中，所述均衡器控制电路包括：
第一锁存器，其被构造成存储在所述源驱动器IC的初始驱动过程中取样的初始EQ设定值；
第一比较器，其被构造成比较所述初始EQ设定值与当前EQ设定值，并且检测所述当前EQ设定值何时不同于所述初始EQ设定值；
第二比较器，其被构造成检测所述时钟恢复电路的未锁定状态；
与门，其被构造成响应于所述第一比较器和所述第二比较器的输出，检测何时所述EQ设定值改变并且所述时钟恢复电路处于未锁定状态；
第二锁存器，其被构造成响应于所述与门的输出，当所述EQ设定值改变并且所述时钟恢复电路处于未锁定状态时存储所述初始EQ设定值；
EQ选择器，其被构造成响应于所述与门的输出，当所述EQ设定值改变并且所述时钟恢复电路处于未锁定状态时将所述初始EQ设定值供应到所述均衡器。
4.根据权利要求1所述的显示装置，其中，所述时序控制器通过信号线对连接到N个源驱动器IC，其中，N是大于或等于2的正整数。
5.一种驱动显示装置的方法，所述显示装置包括通过一对信号线将数据信号传输到源驱动器集成电路(IC)的时序控制器，所述方法包括：
在均衡器中，根据均衡(EQ)设定值将通过信号线对接收的所述数据信号提升；
当恢复所述数据信号的时钟的时钟恢复电路处于未锁定状态并且EQ设定值改变时，将所述均衡器初始化。
6.根据权利要求5所述的方法，其中，将所述均衡器初始化包括：
比较初始EQ设定值与当前EQ设定值并且检测所述当前EQ设定值何时不同于所述初始EQ设定值；
检测所述时钟恢复电路的未锁定状态；
检测何时所述EQ设定值改变并且所述时钟恢复电路处于未锁定状态；
当所述EQ设定值改变并且所述时钟恢复电路处于未锁定状态时将所述初始EQ设定值供应到所述均衡器。
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