CN103416110A - 印刷电路板及其制造方法 - Google Patents
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Abstract
本发明公开了一种印刷电路板及其制造方法。所述印刷电路板包括:芯部绝缘层、至少一个穿过所述芯部绝缘层形成的通孔线、埋入所述芯部绝缘层中的内部电路层、以及位于所述芯部绝缘层顶面或底面上的外部电路层。所述通孔线包括第一部、位于第一部之下的第二部以及位于第一部与第二部之间的第三部,并且该第三部包括与第一部和第二部不同的金属。所述内部电路层和所述通孔线同时形成,因此减少了工序步骤。由于提供了奇数个电路层,因此,所述印刷电路板具有轻薄结构。
Description
技术领域
印刷电路板是利用诸如铜等导电材料在绝缘衬底上印刷电路线图案而形成的。所述印刷电路板是指还未在其上安装电子部件的板子。也就是说,所述印刷电路板是指这样一种电路板,其中,在平板上限定了安装位置以安装各种类型的电子器件,并且在该平板上固定印刷了电路图案以使所述电子器件相互连接。
背景技术
所述印刷电路板(PCB)可以分成单层PCB和多层PCB,例如积层板。
积层板(即多层PCB)是一层接一层地制造出的,并对多层PCB的质量进行评估以提高多层PCB的产率。此外,使互联线精确连接以制造出高密度和小尺寸的PCB。根据积层工序,通过层中形成的通孔在层间形成互联线以使各层相互连接。取代机械钻孔,采用激光工艺来形成微尺寸的通孔。
图1是截面图,示出了根据现有技术的多层PCB。
参照图1,根据现有技术的多层PCB10包括芯部绝缘层1、形成在芯部绝缘层1的上和下的内部电路图案层3和4、将内部电路图案层3和4掩埋的上部和下部绝缘层5和6、以及分别形成在上部和下部绝缘层5和6上的外部电路图案层7和8。
在芯部绝缘层1以及上部和下部绝缘层5和6中形成导电通孔线2和导电通孔,从而使内部电路图案层3和4与外部电路图案层7和8电连接。
通过形成偶数个电路图案层(图1示出了四层),能够制造出具有上述现有技术结构的多层PCB10。在设置了绝缘层之后,通过钻孔或激光工艺使作为外层的两层相互电连接。然而,因为电路图案层的数量限为偶数个,所以衬底厚度会增加,使得多层PCB10不适用于便携式电子设备或者具有轻薄结构的衬底,例如半导体芯片。
发明内容
技术问题
本实施例提供了一种具有新结构的印刷电路板及其制造方法。
本实施例提供了一种包括奇数个电路层的印刷电路板及其制造方法。
技术方案
根据所述实施例的印刷电路板包括:芯部绝缘层、至少一个穿过芯部绝缘层形成的通孔线、埋入芯部绝缘层中的内部电路层、以及位于芯部绝缘层顶面或底面上的外部电路层,其中,所述通孔线包括第一部、位于第一部之下的第二部以及位于第一部与第二部之间的第三部,该第三部包括与第一部和第二部不同的金属。
根据该实施例的制造印刷电路板的方法包括以下步骤:制备具有层叠结构的金属衬底,该层叠结构包括第一金属层、第二金属层和第三金属层;通过刻蚀所述金属衬底的第一金属层形成通孔线的第一部;通过所述刻蚀金属衬底的第二金属层在所述通孔线的第一部之下形成连接部和内部电路层;通过刻蚀所述金属衬底的第三金属层在所述连接部之下形成所述通孔线的第二部;形成绝缘层以埋入所述通孔线;以及在所述绝缘层的顶面或底面形成外部电路层。
有益效果
根据该实施例,内部电路层和通孔线是同时形成的,使得工序步骤可以减少。此外,因为所述印刷电路板包括奇数个电路层,所以所述印刷电路板可以具有轻薄的结构。
此外,通孔线被埋入多层印刷电路板的绝缘层中,使得散热功能得到改善。因为没有采用电镀方法来形成所述通孔线,所以制造成本能够降低。
此外,利用包括不同类型金属层的金属衬底来形成通孔线,因此能够防止金属衬底在制造过程中弯曲。
附图说明
图1是截面图,示出了根据现有技术的印刷电路板;
图2是截面图,示出了根据第一实施例的印刷电路板;
图3-15是截面图,说明了图2所示的印刷电路板的制造过程;
图16是截面图,示出了根据第二实施例的印刷电路板;
图17是截面图,示出了根据第三实施例的印刷电路板;
图18-30是截面图,说明了图17所示的印刷电路板的制造过程;以及
图31是截面图,示出了根据第四实施例的印刷电路板。
具体实施方式
公开了一种印刷电路板及其制造方法。该印刷电路板包括芯部绝缘层、穿过芯部绝缘层形成的至少一个通孔线、埋入芯部绝缘层中的内部电路层、以及位于芯部绝缘层顶面或底面上的外部电路层。所述通孔线包括第一部、位于第一部之下的第二部以及位于第一部与第二部之间的第三部,并且该第三部包括与第一部和第二部的金属不同的金属。所述内部电路层和通孔线同时形成,使得工序步骤减少。因为提供奇数个电路层,所以该印刷电路板具有轻、薄的结构。
下文中,将参照附图具体描述各个实施例,使得本发明所属领域技术人员能够容易地实现各个实施例。然而,所述实施例可以具有各种修改而不受限制。
在以下描述中,当一个部分被称作包括某个部件时,除非文中明确指出,否则该部分不排除其他部件的存在,可能进一步包括另一部件。
为了方便或清楚,附图中所示的各层的厚度和尺寸可以被放大、省略或示意画出。此外,元件尺寸并不完全反映真实尺寸。在以下的描述中,类似的部件用类似的附图标记表示。
在实施例的说明中,可以理解,当某层(或膜)、某区域或某板被称作是位于另一层(或膜)、另一区域或另一板之上或之下时,其可以直接或间接地位于另一层(或膜)、区域或板之上,或者也可以存在一个或多个中间层。
根据实施例,通过刻蚀工序同时形成通孔线和内部电路层,使得能够在不使用电镀方法的情况下形成包括奇数个电路层的多层印刷电路板(PCB)。
下文中,将参照图2-15描述根据实施例的PCB。
图2是截面图,示出了根据第一实施例的PCB。
参照图2,根据本实施例的PCB100包括形成第一绝缘层120和第二绝缘层125的芯部绝缘层、形成在芯部绝缘层中的通孔线115、形成在芯部绝缘层中的内部电路层111以及分别形成在第一和第二绝缘层120和125上的第一和第二外部电路层131、135和145。
第一绝缘层120形成在第二绝缘层125上,并且在第一绝缘层120和第二绝缘层125之间可以存在附加的绝缘层(未示出)。
第一绝缘层120和第二绝缘层125可以包括热固性聚合物衬底、热塑性聚合物衬底、陶瓷衬底或者有机/无机复合衬底。第一绝缘层120和第二绝缘层125可以包括聚合物树脂,例如环氧绝缘树脂,或者聚酰亚胺树脂。此外,可以利用包含固体成分(例如玻璃纤维)的树脂来形成第一绝缘层120和第二绝缘层125。
可以利用相同材料来形成第一绝缘层120和第二绝缘层125。
第一绝缘层120和第二绝缘层125的厚度分别可以在30μm至80μm的范围内。
具有第一绝缘层120和第二绝缘层125的层叠结构的芯部绝缘层的厚度在60μm至160μm范围内,优选的是,在60μm至140μm范围内。通孔线115和内部电路层111形成在芯部绝缘层中。
通孔线115是穿过第一绝缘层120和第二绝缘层125形成的导电通孔线。通孔线115在第一绝缘层120与第二绝缘层125之间的边界处具有最大宽度d1。每个通孔线115的宽度随着其接近第一绝缘层120和第二绝缘层125的顶面而逐渐变窄。因此,每个通孔线115的与第一绝缘层120和第二绝缘层125顶面相交的部分具有最小宽度d2,使得通孔线115具有六边形截面形状。
通孔线115的宽度d1和d2在大约20μm至大约100μm的范围内。
通孔线115是导电通孔线并且可以利用含Cu合金形成。
通孔线115包括埋入第一绝缘层120中并且由含Cu合金形成的第一部115a、在第一部115a下方埋入第二绝缘层125中并且由与第一部115a相同的合金形成的第二部115b、以及介于第一部115a与第二部115b之间并且由不同于第一部115a和第二部115b的合金形成的第三部115c。
第三部115c形成在通孔线115的中心处,并且第三部115c的底面或者第二阻挡层115e的底面可以具有通孔线115的最大宽度d1。可以利用含Ni、Fe、Co、Mo或Cr的合金来形成第三部115c。第三部115c相对于第一部115a和第二部115b具有刻蚀选择性。
第一部115a和第二部115b的厚度在20μm至70μm的范围内,第三部115c的厚度在5μm至70μm的范围内。
内部电路层111形成在第二绝缘层125上。内部电路层111的电路图案的厚度在5μm至30μm的范围内,而宽度约为50μm或更小,优选为30μm,使得能够形成微图案。
内部电路层111具有矩形截面形状。
内部电路层111利用与通孔线115的第三部115c相同的材料形成。
包括与通孔线115相连的通孔垫135和145以及电路图案131的外部电路层131、135和145分别形成在第一绝缘层120和第二绝缘层125的顶面和底面上。
外部电路层131、135和145分为形成在芯部绝缘层上的第一外部电路层131和135以及形成在芯部绝缘层下方的第二外部电路层145。
外部电路层131、135和145可以形成线/间为30/30的微图案。为此,沉积厚度在6μm至30μm范围内的铜层,然后刻蚀该铜层以形成外部电路层131、135和145。
尽管已经描述了外部电路层131、135和145以单层形式形成在芯部绝缘层之上和之下,但本实施例不限于此。例如,在形成用于掩埋第一绝缘层120和第二绝缘层125上的外部电路层131、135和145的上部绝缘层之后,可以在该上部绝缘层上形成电路层,以形成多层PCB。
如上所述,因为内部电路层111掩埋在本实施例所述的PCB100的芯部绝缘层中,所以可以形成2n+1(n为正整数)个电路层。此外,在芯部绝缘层的基础上,绝缘层的数量与电路层的数量相同,使得PCB能够防止在一个方向上弯曲。
因此,可以在不增加绝缘层数量的情况下形成奇数个电路层。此外,因为包括导电材料的通孔线115形成在芯部绝缘层中,所以可以改善散热效率。
下文中,将参照图3-15描述制造图2的PCB的方法。
首先,如图3所示制备导电金属衬底110。
可以利用轧制箔或电解箔形式的含Cu合金来形成导电金属衬底110。根据产品规格,导电金属衬底110可以具有不同的厚度。导电金属衬底110具有第一金属层110a、第二金属层110b和第三金属层110c的层叠结构。
可以利用含Cu合金形成第一金属层110a和第三金属层110c,并且可以利用相对于第一金属层110a和第三金属层110c具有刻蚀选择性的金属形成位于第一金属层110a和第三金属层110c之间的第二金属层110b。
可以利用含Ni、Fe、Co、Mo或Cr的合金形成第二金属层110b。此外,第一金属层110a和第三金属层110c的厚度可以在20μm至70μm的范围内,第二金属层110b的厚度可以在5μm至70μm的范围内。
根据本实施例,金属衬底110的厚度优选在80μm至170μm范围内。可以通过诸如酸洗或冲洗等表面处理工艺来处理金属衬底110的表面。
然后,如图4所示,将光刻胶膜116附着于金属衬底110的顶面上。
光刻胶膜116形成刻蚀图案以刻蚀金属衬底110。光刻胶膜116的厚度可在15μm至30μm范围内变化,并且可以采用UV曝光型光刻胶膜以及LDI曝光型光刻胶膜。
此后,如图5所示,对光刻胶膜116进行曝光和显影工序,以形成光刻胶图案(未示出),并且利用该光刻胶图案作为掩模刻蚀金属衬底110,由此形成通孔线115的第一部115a。
然后,利用诸如氯化铜和氯化铁等湿刻溶液湿刻一部分金属衬底110,以形成通孔线115的第一部115a。由于第一金属层110a与第二金属层110b之间的刻蚀选择性,当形成第一部115a时仅刻蚀第一金属层110a。
如图5所示,在刻蚀了通孔线115的第一部115a之后,利用NaOH稀溶液使光刻胶图案剥离。
接着,如图6所示,在第一部115a以及第二金属层110b的露出的前表面上形成光刻胶膜117。
为了利用第二金属层110b形成内部电路层111,对形成在第二金属层110b上的一部分光刻胶膜117进行曝光和显影工序,以形成如图7所示的光刻胶图案118,并且利用光刻胶膜118作为掩模选择性刻蚀第二金属层110b,由此形成内部电路层111以及通孔线115的第三部115c。
由于第一金属层110a与第二金属层110b之间的刻蚀选择性,当形成通孔线的第三部115c时,第一部115a可以用作刻蚀掩模。
当第二金属层110b之下的第三金属层110c露出时,停止刻蚀工序并且形成内部电路层111。内部电路层111具有矩形截面形状。
此后,如图8所示,形成该第一绝缘层120,使得通孔线115的第一部115a和第三部115c以及内部电路层111能够埋入第一绝缘层120。
可以利用具有固体成分(诸如玻璃纤维)或者不具有固体成分的热固性树脂或热塑性树脂来形成第一绝缘层120。第一绝缘层120的厚度可以在大约30μm至大约80μm范围内。
然后,在第一绝缘层120上形成铜箔层130。
铜箔层130是用作第一外部电路层131和135的基体的金属层,并且其厚度在6μm至30μm范围内,使得能够形成30/30μm的线/间。优选的是,铜箔层130的厚度在6μm至20μm范围内,使得能够形成15/15μm或更小的线/间。
可以利用CCL(覆铜板)形成第一绝缘层120和铜箔层130。
然后,如图9所示,分别在铜箔层130上和金属衬底110下形成光刻胶膜136。
在金属衬底110下方形成的光刻胶膜136用作基体,以形成用于形成通孔线115的第二部115b以及内部电路层111的光刻胶图案。此外,在铜箔层130上形成的光刻胶膜136用作基体,以在金属衬底110下形成光刻胶图案,以及用作保护膜,以在金属衬底110的刻蚀工序中保护铜箔层130。
因此,可以用保护膜或者保护性有机层来取代形成在铜箔层130上的光刻胶膜136,并可以省略掉该光刻胶膜。
此后,如图10所示,对金属衬底110下形成的光刻胶膜136显影,以形成光刻胶图案,并且利用该光刻胶图案作为掩模刻蚀金属衬底110,由此在通孔线115的第一部115a下形成第二部115b。
按照这种方式,通过刻蚀工序将通孔线115的上部和下部分成第一到第三部115a、115b和115c,使得通孔线115具有六边形截面,其中通孔线115的中心具有最大宽度d1,并且宽度从通孔线115的中心向外部变窄。
当形成了通孔线115的第二部115b时,将光刻胶图案剥离。然后,如图11所示,沉积第二绝缘层125,使得通孔线115的第一部115a能够埋入第二绝缘层125中,并且在第二绝缘层125上沉积铜箔层140。
第二绝缘层125和铜箔层140的材料和厚度可以与第一绝缘层120和形成在第一绝缘层120上的铜箔层130相同。
然后,如图12所示,将光刻胶膜146分别附着于铜箔层130和140上。
光刻胶膜146可以具有在15μm至30μm范围内变化的厚度,并且可以采用UV曝光型光刻胶膜和LDI曝光型光刻胶膜。
然后,如图13所示,对光刻胶膜146进行曝光和显影工序,使得在铜箔层130和140上分别形成光刻胶图案148。此后,利用光刻胶图案148作为掩模刻蚀铜箔层130和140,由此形成如图14所示的垫135和145以及电路图案131。
垫135和145以及电路图案131可以构成形成在第一绝缘层120上的第一外部电路层131和135以及第二外部电路层145。第一外部电路层131和135包括与通孔线115的第一部115a相连的上部垫135以及包括与上部垫135的铜箔层130为同一铜箔层130的上部电路图案131。第二外部电路层145包括与通孔线115的第二部115b相连的下部垫145以及包括与下部垫145的铜箔层140为同一铜箔层140的下部电路图案(未示出)。
最终,如图15所示,将外部电路层131、135和145的电路图案131掩埋,并且形成覆盖层150以使垫135和145露出。
按照这种方式,与通过在绝缘层钻孔形成通孔以及通过掩埋通孔形成通孔线的现有技术不同,本实施例在刻蚀金属衬底110形成通孔线115之后形成掩埋通孔线115的绝缘层120和125,从而减少制造成本。此外,因为利用与通孔线115相同的金属衬底来形成内部电路层111,所以能够减少制造步骤。
尽管已经描述了通过刻蚀铜箔层形成外部电路层131、135和145,但是本实施例不限于此。例如,可以通过相对于光刻胶实施电镀工序来形成外部电路层131、135和145。
下文中,将参照图16描述根据第二实施例的PCB。
参照图16,根据第二实施例的PCB200包括形成第一绝缘层120和第二绝缘层125的芯部绝缘层、形成在芯部绝缘层中的通孔线115、形成在芯部绝缘层中的内部电路层112、以及分别形成在第一绝缘层120和第二绝缘层125上的第一和第二外部电路层131、135和145。
第一绝缘层120形成在第二绝缘层125上,并且在第一绝缘层120与第二绝缘层125之间可能存在其他绝缘层。
可以利用包括固体成分(诸如玻璃纤维)的树脂形成第一绝缘层120和第二绝缘层125。可以利用相同材料形成第一绝缘层120和第二绝缘层125。
第一绝缘层120和第二绝缘层125具有层叠结构以形成芯部绝缘层。该芯部绝缘层的厚度可以在大约60μm至大约140μm的范围内。通孔线115和内部电路层112形成在芯部绝缘层中。
通孔线115是穿过第一绝缘层120和第二绝缘层125形成的导电通孔线。通孔线115在第一绝缘层120与第二绝缘层125之间的边界处具有最大宽度d1。每个通孔线115的宽度随着其接近第一绝缘层120和第二绝缘层125的顶面而逐渐变窄。因此,通孔线115具有六边形截面形状。
通孔线115的宽度d1和d2在大约20μm至大约100μm的范围内。
通孔线115是导电通孔线并且可以利用含Cu合金形成。
通孔线115包括埋入第一绝缘层120中并且由含Cu合金形成的第一部115a、在第一部115a下方埋入第二绝缘层125中并且由与第一部115a相同的合金形成的第二部115b、以及介于第一部115a与第二部115b之间且由不同于第一部115a和第二部115b的合金形成的第三部115c。
第三部115c形成在通孔线115的中心处,并且第三部115c的底面可以具有通孔线115的最大宽度d1。第三部115c可以利用含Ni、Fe、Co、Mo或Cr的合金来形成,并且可以相对于第一部115a和第二部115b具有刻蚀选择性。
第一部115a和第二部115b的厚度在20μm至70μm的范围内,第三部115c的厚度在5μm至70μm的范围内。
内部电路层112具有矩形截面形状或者六边形截面形状。内部电路层112的宽度为大约60μm或更小,优选为50μm,使得能够形成微图案。
利用与通孔线115的第三部115c相同的材料形成内部电路层112。
包括与通孔线115相连的通孔线垫135和145以及电路图案131的外部电路层131、135和145分别形成在第一绝缘层120和第二绝缘层125的顶面和底面上。
外部电路层131、135和145形成在第一绝缘层120和第二绝缘层125的表面上,以及内部电路层112形成在第二绝缘层125上。
可以通过沉积铜箔层,然后刻蚀该铜箔层来形成外部电路层131、135和145。
在图16所示的PCB200中,内部电路层112的电路图案具有矩形截面形状,其相对于第一绝缘层120与第二绝缘层125之间的边界对称形成,类似于通孔线115。埋入第一绝缘层120中的区域包括与通孔线115的第三部115c相同的材料,并且埋入第二绝缘层125中的区域包括与通孔线115的第三部115c相同的材料。
可以利用图3-15中所示的制造方法来形成图16所示的内部电路层112。在图9和10所示的工序中,当形成通孔线115的第二部115b时,可以同时形成内部电路层112的要埋入第二绝缘层125中的区域。
如上所述,由于内部电路层112埋在本实施例所述的PCB200的芯部绝缘层中,所以可以形成2n+1(n为正整数)个电路层。此外,在芯部绝缘层的基础上,绝缘层的数量与电路层的数量相同,使得可以防止PCB在一个方向上弯曲。
因此,可以在不增加绝缘层数量的情况下形成奇数个电路层。此外,因为包括导电材料的通孔线115形成在芯部绝缘层中,所以能够改善散热效率。
此外,利用异质金属(hetero metal)形成金属衬底的中间层,使得能够防止金属衬底在制造过程中弯曲。
下文中,将参照图17-30描述根据第三实施例的PCB。
图17是截面图,示出了根据第三实施例的PCB。
参照图17,根据本实施例的PCB300包括形成第一绝缘层320和第二绝缘层325的芯部绝缘层、形成在该芯部绝缘层中的通孔线315、形成在该芯部绝缘层中的内部电路层311、以及分别形成在第一绝缘层320和第二绝缘层325上的第一和第二外部电路层331、335和345。
第一绝缘层320形成在第二绝缘层325上,并且在第一绝缘层320与第二绝缘层325之间可以存在其他绝缘层(未示出)。
第一绝缘层320和第二绝缘层325可以包括热固性聚合物衬底、热塑性聚合物衬底、陶瓷衬底或者有机/无机复合衬底。第一绝缘层320和第二绝缘层325可以包括聚合物树脂,例如环氧绝缘树脂,或者聚酰亚胺树脂。此外,可以利用包括固体成分(诸如玻璃纤维)的树脂形成第一绝缘层320和第二绝缘层325。
可以利用相同材料形成第一绝缘层320和第二绝缘层325。
第一绝缘层320和第二绝缘层325的厚度可以分别在大约30μm至大约80μm的范围内。
具有第一绝缘层320和第二绝缘层325的层叠结构的芯部绝缘层的厚度在大约60μm至大约160μm的范围内,优选的是在大约60μm至大约140μm的范围内。通孔线315和内部电路层311形成在芯部绝缘层中。
通孔线315是穿过第一绝缘层320和第二绝缘层325形成的导电通孔线。通孔线315在第一绝缘层320与第二绝缘层325之间的边界处具有最大宽度d1。每个通孔线315的宽度随着其接近第一绝缘层320和第二绝缘层325的顶面而逐渐变窄。因此,每个通孔线315的与第一绝缘层320和第二绝缘层325顶面相交的部分具有最小的宽度d2,使得通孔线315具有六边形截面形状。
通孔线315的宽度d1和d2在大约20μm至大约300μm的范围内。
通孔线315是导电通孔线并且可以利用含Cu合金形成。
通孔线315包括埋入第一绝缘层320中并且由含Cu合金形成的第一部315a、在第一部315a下方埋入第二绝缘层325中并且由与第一部315a相同的合金形成的第二部315b、以及介于第一部315a与第二部315b之间并且由不同于第一部315a和第二部315b的合金形成的第三部315c。
第三部315c形成在通孔线315的中心处,并且第三部315c的底面可以具有通孔线315的最大宽度d1。第三部315c可以利用含Ni、Fe、Co、Mo或Cr的合金来形成,并且相对于第一部315a和第二部315b具有刻蚀选择性。
第一部315a和第二部315b的厚度在20μm至70μm的范围内,第三部315c的厚度在5μm至70μm的范围内。
内部电路层311形成在第二绝缘层325上。内部电路层311的电路图案的厚度在6μm至30μm范围内,其宽度为大约50μm或更小,优选的是30μm,使得能够形成微图案。
内部电路层311具有矩形截面形状。
利用与通孔线315的第三部315c相同的材料形成内部电路层311。
与通孔线315相连的通孔线垫335和345以及用于形成电路图案331的图案凹槽321和326分别形成在第一绝缘层320和第二绝缘层325的顶面和底面上。
在填充图案凹槽321和326的同时能够形成外部电路层331、335和345。
外部电路层331、335和345分为第一外部电路层331和335以及第二外部电路层345,第一外部电路层331和335用于填充在第一绝缘层320(其为芯部绝缘层的上层)上形成的图案凹槽321和326,第二外部电路层345用于填充在第二绝缘层325(其为芯部绝缘层的下层)底面上形成的图案凹槽321和326。
外部电路层331、335和345可以制备为如图2所示的单层。此外,外部电路层331、335和345可以制备为包括下种层(lower seed layer)和上镀层(upper plating layer)的多层。通过化学镀、溅射等方法沿着图案凹槽321和326的侧面和底面浅浅地形成所述种层。
此外,可以利用含Cu、Ni、Pd或Cr的合金形成所述种层。
通过电镀工序在所述种层上形成镀层。利用含Cu、Ag、Au、Ni或Pd的合金形成该镀层,并且使其填充在图案凹槽321和326中。
形成在第一绝缘层320和第二绝缘层325中的图案凹槽321和326根据其制造方法可以具有矩形截面形状或者弯曲的截面形状。优选的是,图案凹槽321和326具有U形截面形状。
尽管描述了在芯部绝缘层上和下形成单层形式的外部电路层331、335和345,但是本实施例不限于此。例如,在第一绝缘层320和第二绝缘层325上分别形成了覆盖外部电路层331、335和345的上绝缘层之后,可以在该上绝缘层上形成电路层,以形成多层PCB。
如上所述,因为内部电路层311掩埋在本实施例所述的PCB300的芯部绝缘层中,所以可以形成2n+1(n为正整数)个电路层。此外,在芯部绝缘层的基础上,绝缘层的数量与电路层的数量相同,使得能够防止PCB在一个方向上弯曲。
因此,能够在不增加绝缘层数量的情况下形成奇数个电路层。此外,因为包括导电材料的通孔线315形成在芯部绝缘层中,所以能够改善散热效率。
此外,在绝缘层中形成凹槽之后可以通过镀工序形成外部电路层。在这种情况下,能够形成微图案。
下文中,将参照图18-30描述制造图17的PCB的方法。
首先,如图18所示,制备导电金属衬底310。
可以利用轧制箔或电解箔形式的含Cu合金来形成导电金属衬底310。根据产品规格,导电金属衬底310可以具有不同的厚度。导电金属衬底310具有第一金属层310a、第二金属层310b和第三金属层310c的层叠结构。
可以利用含Cu合金形成第一金属层310a和第三金属层310c。可以利用相对于第一金属层310a和第三金属层310c具有刻蚀选择性的金属形成位于第一金属层310a与第三金属层310c之间的第二金属层310b。
可以利用含Ni、Fe、Co、Mo或Cr的合金形成第二金属层310b。第一金属层310a和第二金属层310b的厚度可以在20μm至70μm的范围内,第二金属层310b的厚度可以在5μm至70μm的范围内。
根据本实施例,金属衬底310的厚度优选在80μm至170μm范围内。可以通过诸如酸洗或冲洗等表面处理工序来处理金属衬底310的表面。
然后,如图19所示,将光刻胶膜316附着于金属衬底310的顶面上。
光刻胶膜316形成刻蚀图案以刻蚀金属衬底310。光刻胶膜316的厚度可在15μm至30μm范围内变化,并且可以采用UV曝光型光刻胶膜以及LDI曝光型光刻胶膜。
此后,如图20所示,对光刻胶膜316进行曝光和显影工序,以形成光刻胶图案(未示出),并且利用该光刻胶图案作为掩模刻蚀金属衬底310,由此形成通孔线315的第一部315a。
然后,利用诸如氯化铜和氯化铁等湿刻溶液湿刻一部分金属衬底310,以形成通孔线315的第一部315a。由于第一金属层310a与第二金属层310b之间的刻蚀选择性,当形成第一部315a时仅刻蚀第一金属层310a。
在刻蚀了通孔线315的第一部315a以及内部电路层311之后,利用NaOH稀溶液使光刻胶图案剥离。
接着,如图21所示,在第一部315a以及第二金属层310b的露出的前表面上形成光刻胶膜317。
为了利用第二金属层310b形成内部电路层311,对形成在第二金属层310b上的一部分光刻胶膜317进行曝光和显影工序,以形成如图22所示的光刻胶图案318,并且利用光刻胶膜318作为掩模选择性刻蚀第二金属层310b,由此形成内部电路层311以及通孔线315的第三部。
由于第一金属层310a与第二金属层310b之间的刻蚀选择性,通孔线315的第一部315a可以用作第三部315c的刻蚀掩模。
当形成在第二金属层310b下的第三金属层310c露出时,停止刻蚀工序并且内部电路层311形成。内部电路层311具有矩形截面形状。
此后,如图23所示,形成第一绝缘层320,使得通孔线315的第一部315a和第三部315c以及内部电路层311可以埋入第一绝缘层320中。
可以利用具有固体成分(诸如玻璃纤维)或者不具有固体成分的热固性树脂或热塑性树脂来形成第一绝缘层320。第一绝缘层320的厚度可以在大约30μm至大约80μm范围内。
然后,如图24所示,分别在第一绝缘层320上和金属衬底310下形成光刻胶膜336。
形成在金属衬底310下的光刻胶膜336用作基体,以形成用于形成通孔线315的第二部315b和内部电路层311的光刻胶图案。此外,形成在第一绝缘层320上的光刻胶膜336用作在金属衬底310下形成光刻胶图案的基体以及在金属衬底310的刻蚀工序中保护上层的保护膜。
因此,可以省略掉形成在第一绝缘层320上的光刻胶膜336。
此后,如图25所示,对金属衬底310下形成的光刻胶膜336显影以形成光刻胶图案,并且利用该光刻胶图案作为掩模来刻蚀金属衬底310,从而在通孔线315的第一部315a下形成第二部315b。
按照这种方式,通过刻蚀工序将通孔线315的上部和下部分成第一部315a、第二部315b和第三部315c,使得通孔线315具有六边形截面形状,其中通孔线315的中心具有最大宽度d1,并且宽度从通孔线315的中心向外部变窄。
当形成了通孔线315的第二部315b时,使光刻胶图案剥离。然后,如图26所示,沉积第二绝缘层325,使得通孔线315的第二部315b能被埋入第二绝缘层325中。
然后,如图27所示,在第一绝缘层和第二绝缘层的表面上形成图案凹槽321和326。
图案凹槽321和326可以包括用于露出通孔线的通孔线垫凹槽和用于埋入电路图案的电路图案凹槽。
为了在第一绝缘层和第二绝缘层中形成图案凹槽321和326,可以使用需要使用图案掩模的准分子激光器或者无需使用图案掩模的UV-YAG激光器。
如果使用准分子激光器,则可以利用XeCl(308nm)、Krf(248nm)和ArF(193nm)之一。如果在第一绝缘层和第二绝缘层中形成图案凹槽321和326,则图案凹槽321和326根据电路的线/间以及振动深度具有V形截面形状或者矩形截面形状。
相反,如果使用UV-YAG激光器,则图案凹槽321和326具有弯曲的截面形状。优选的是,图案凹槽321和326具有U形截面形状。
此后,如图28所示,形成镀层330和340以填充图案凹槽321和326。
具体而言,通过化学镀工序在第一绝缘层320和第二绝缘层325的整个表面上形成种层。在利用Cu通过化学镀工序形成种层之前,可以实施预处理工序,例如清洗工序、软刻蚀工序、预催化工序、催化处理工序或者加速工序。
同时,可以实施溅射工序来取代化学镀工序。根据溅射工序,由等离子体产生的气体的离子颗粒(例如Ar+)与铜靶撞击,从而在绝缘层320和325上形成铜金属层。
此外,可以利用Ni-Pd合金或者Ni-Cr合金取代铜,通过化学镀工序或者溅射工序形成种层。
然后,在种层上实施电镀工序,以在第一绝缘层320和第二绝缘层325的整个区域上形成导电镀层330和340,使得图案凹槽321和326可以填充有镀层330和340。
可以利用含Cu、Ag、Au、Ni或Pd的合金来形成镀层330和340。优选的是,镀含铜合金。
为了形成镀层330和340,将衬底浸没在Cu镀槽中,并且利用直流整流器或者脉冲整流器来实施电镀工序。根据电镀工序,计算电镀面积,并且将电流施加到直流整流器或者脉冲整流器以萃取金属。
如上所述,通过化学镀工序或者电镀工序可以获得图28所示的镀层330和340。相反,可以通过相对于导电金属实施无电极电镀工序来填充图案凹槽321和326。
然后,如图29所示,完全去除镀层330和340以及种层,直到第一绝缘层320和第二绝缘层325的表面露出为止。
因此,仅在图案凹槽321和326中形成了外部电路层331、335和345。通过闪蚀(flash etching)工序可以去除镀层330和340。如果所要去除的镀层330和340的厚度过大,则可以在闪蚀工序之前实施半刻蚀工序。
最后,如图30所示,埋入外部电路层331、335和345的电路图案331,并且形成覆盖层350以露出垫335和345。
按照这种方式,与通过在绝缘层钻孔来形成通孔并且通过掩埋该通孔来形成通孔线的现有技术不同,本实施例通过刻蚀金属衬底310形成通孔线315之后形成掩埋通孔线315的绝缘层320和325,由此降低了制造成本。此外,因为利用与通孔线315相同的金属衬底来形成内部电路层311,所以能够减少制造步骤。
下文中,将参照图31描述根据第四实施例的PCB。
参照图31,根据第四实施例的PCB400包括形成第一绝缘层420和第二绝缘层425的芯部绝缘层、形成在该芯部绝缘层中的通孔线415、形成在该芯部绝缘层中的内部电路层412、以及分别形成在第一绝缘层420和第二绝缘层425上的第一和第二外部电路层431、435和445。
第一绝缘层420形成在第二绝缘层425上,并且在第一绝缘层420与第二绝缘层425之间可以存在其他绝缘层。
可以利用包括诸如玻璃纤维等固体成分的树脂形成第一绝缘层420和第二绝缘层425。可以利用相同材料形成第一绝缘层420和第二绝缘层425。
第一绝缘层420和第二绝缘层425具有层叠结构以形成芯部绝缘层。芯部绝缘层的厚度可以在大约60μm至大约140μm的范围内。在芯部绝缘层中形成通孔线415和内部电路层412。
通孔线415是穿过第一绝缘层420和第二绝缘层425形成的导电通孔线。通孔线415在第一绝缘层420与第二绝缘层425之间的边界处具有最大宽度。每个通孔线415的宽度随着其接近第一绝缘层420和第二绝缘层425的顶面而逐渐变窄。因此,通孔线415具有六边形截面形状。
通孔线415的宽度d1和d2在大约20μm至大约100μm的范围内。
通孔线415是导电通孔线并且可以利用含Cu合金形成。
通孔线415包括埋入第一绝缘层420中并且由含Cu合金形成的第一部415a、在第一部415a下方埋入第二绝缘层425中并且由与第一部415a相同的合金形成的第二部415b、以及介于第一部415a与第二部415b之间且由不同于第一部415a和第二部415b的合金形成的第三部415c。
第三部415c形成在通孔线415的中心处,并且第三部415c的底面可以具有通孔线415的最大宽度d1。第三部415c可以利用含Ni、Fe、Co、Mo或Cr的合金来形成,并且相对于第一部415a和第二部415b可以具有刻蚀选择性。
第一部415a和第二部415b的厚度在20μm至70μm的范围内,第三部415c的厚度在5μm至70μm的范围内。
内部电路层412具有矩形截面形状。内部电路层412的宽度为大约60μm或更小,优选为50μm或更小,使得能够形成微图案。
利用与通孔线415的第三部415c相同的材料形成内部电路层412。
在第一绝缘层420和第二绝缘层425的顶面和底面上分别形成与通孔线415相连的通孔线垫435和445以及用来形成电路图案431的图案凹槽421和426。
在填充图案凹槽421和426的同时可以形成外部电路层431、435和445。
外部电路层431、435和445可以分为第一外部电路层431和435以及第二外部电路层445,第一外部电路层431和435用于填充在第一绝缘层420(其为芯部绝缘层的上层)上形成的图案凹槽421和426,第二外部电路层445用于填充在第二绝缘层425(其为芯部绝缘层的下层)的底面上形成的图案凹槽421和426。
外部电路层431、435和445可以制备为如图2所示的单层。此外,外部电路层431、435和445可以制备为包括下种层和上镀层的多层。通过化学镀、溅射等方法沿着图案凹槽421和426的侧面和底面浅浅地形成种层。
此外,可以利用含Cu、Ni、Pd或Cr的合金形成该种层。
通过电镀工序在种层上形成镀层。利用含Cu、Ag、Au、Ni或Pd的合金形成该镀层,并且使其填充在图案凹槽421和426中。
形成在第一绝缘层420和第二绝缘层425中的图案凹槽421和426根据其制造方法可以具有矩形截面形状或者弯曲的截面形状。优选的是,图案凹槽421和426具有U形截面形状。
在图31所示的PCB400中,内部电路层412的电路图案具有多边形截面形状,其相对于第一绝缘层420与第二绝缘层425之间的边界对称形成,类似于通孔线415。优选的是,内部电路层412的电路图案具有矩形截面形状或者六边形截面形状。具体而言,内部电路层412的一部分被埋入第一绝缘层420中,并且内部电路层412的其他部分被埋入第二绝缘层425中。
通过图18-30所示的制造方法,可以形成图31所示的内部电路层412。
如上所述,因为内部电路层412被埋入本实施例所述的PCB400的芯部绝缘层中,所以可以形成2n+1(n为正整数)个电路层。此外,在芯部绝缘层的基础上,绝缘层的数量与电路层的数量相同,使得能够防止PCB在一个方向上弯曲。
因此,可以在不增加绝缘层数量的情况下形成奇数个电路层。此外,因为包括导电材料的通孔线415形成在芯部绝缘层中,所以能够改善散热效率。
此外,利用异质金属形成金属衬底的中间层,于是,能够防止金属衬底在制造过程中弯曲。
尽管参照多个示例性实施例描述了具体的实施方式,但是应当理解,本领域技术人员可以设计出许多其他的落入本发明原理的精神和范围内的修改和实施例。更特别的是,在本说明书、附图和所附权利要求书的范围内可以对组成部件和/或主题组合设置进行各种变化和修改。除了组成部件和/或设置的变化和修改之外,替换使用对于本领域技术人员也是显而易见的。
Claims (23)
1.一种印刷电路板,包括:
芯部绝缘层;
至少一个穿过所述芯部绝缘层形成的通孔线;
埋入所述芯部绝缘层中的内部电路层;以及
位于所述芯部绝缘层的顶面或底面上的外部电路层,
其中所述通孔线包括第一部、位于该第一部之下的第二部、以及位于该第一部与该第二部之间的第三部,并且所述第三部包括与所述第一部和所述第二部不同的金属。
2.根据权利要求1所述的印刷电路板,其中,所述芯部绝缘层包括:用于埋入所述通孔线的第一部和第三部的第一绝缘层;以及位于该第一绝缘层之下用于埋入所述通孔线的第二部的第二绝缘层。
3.根据权利要求2所述的印刷电路板,其中,所述内部电路层利用与所述通孔线的第三部相同的材料形成。
4.根据权利要求1所述的印刷电路板,其中,所述通孔线的第一部和第二部利用相同的材料形成。
5.根据权利要求1所述的印刷电路板,其中,所述内部电路层具有矩形截面形状。
6.根据权利要求2所述的印刷电路板,其中,所述内部电路层埋入所述第一绝缘层中。
7.根据权利要求1所述的印刷电路板,其中,所述印刷电路板包括含所述内部电路层和所述外部电路层并且数量为2n+1(n为正整数)的电路层。
8.根据权利要求1所述的印刷电路板,其中,所述通孔线具有六边形截面形状。
9.根据权利要求1所述的印刷电路板,其中,所述外部电路层填充在形成在所述芯部绝缘层的顶面或底面上的图案凹槽中。
10.根据权利要求9所述的印刷电路板,其中,所述图案凹槽具有U形截面形状。
11.一种制造印刷电路板的方法,所述方法包括:
制备具有层叠结构的金属衬底,所述层叠结构包括第一金属层、第二金属层和第三金属层;
通过刻蚀所述金属衬底的第一金属层形成通孔线的第一部;
通过刻蚀所述金属衬底的第二金属层在所述通孔线的第一部之下形成连接部和内部电路层;
通过刻蚀所述金属衬底的第三金属层在所述连接部之下形成所述通孔线的第二部;
形成绝缘层以掩埋所述通孔线;以及
在所述绝缘层的顶面或底面形成外部电路层。
12.根据权利要求11所述的方法,其中,形成所述绝缘层包括:
形成第一绝缘层以埋入所述通孔线的第一部、所述连接部以及所述内部电路层;以及
形成第二绝缘层以埋入所述通孔线的第二部。
13.根据权利要求11所述的方法,其中,制备所述金属衬底包括利用具有相互不同的刻蚀选择性的金属形成所述第一至第三金属层。
14.根据权利要求11所述的方法,其中,形成所述外部电路层包括:
在所述绝缘层上和下形成铜箔层;
在所述铜箔层上形成光刻胶图案;以及
利用所述光刻胶图案作为掩模刻蚀所述铜箔层,从而形成所述外部电路层。
15.根据权利要求11所述的方法,其中,所述通孔线的第二部与第三部之间的边界的宽度大于所述通孔线与所述绝缘层之间的边界的宽度。
16.根据权利要求11所述的方法,其中,制备所述金属衬底包括利用相同金属形成所述第一至第三金属层。
17.根据权利要求11所述的方法,其中,形成所述通孔线的第二部包括湿刻所述金属衬底的第三金属层以形成所述通孔线的第二部,并且同时形成所述内部电路层的下部。
18.根据权利要求11所述的方法,其中,所述内部电路层的宽度大约为50μm或更小。
19.根据权利要求11所述的方法,其中,利用含铜合金形成所述第一至第三金属层,并且利用含镍合金形成所述第二金属层。
20.根据权利要求11所述的方法,其中,形成所述外部电路层包括:
在所述绝缘层的顶面或底面形成图案凹槽;以及
通过镀导电材料填充所述图案凹槽来形成所述外部电路层。
21.根据权利要求20所述的方法,其中,形成所述外部电路层包括:
利用激光器在所述绝缘层的顶面或底面形成图案凹槽;
沿着所述图案凹槽的表面实施化学镀工序,从而形成种层;以及
在所述种层上电镀导电材料,从而用所述导电材料填充所述图案凹槽。
22.根据权利要求21所述的方法,其中,形成所述图案凹槽包括:
利用准分子激光器在所述绝缘层表面上形成所述图案凹槽。
23.根据权利要求21所述的方法,其中,形成所述图案凹槽包括:
利用UV-YAG激光器在所述绝缘层表面上形成所述图案凹槽。
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Families Citing this family (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR101397303B1 (ko) * | 2012-12-31 | 2014-05-23 | 삼성전기주식회사 | 인쇄회로기판 및 인쇄회로기판 제조 방법 |
KR102211741B1 (ko) * | 2014-07-21 | 2021-02-03 | 삼성전기주식회사 | 인쇄회로기판 및 인쇄회로기판의 제조 방법 |
US9744624B2 (en) * | 2015-06-17 | 2017-08-29 | Kinsus Interconnect Technology Corp. | Method for manufacturing circuit board |
US10103201B2 (en) | 2016-07-05 | 2018-10-16 | E Ink Holdings Inc. | Flexible display device |
TWI613942B (zh) * | 2016-07-05 | 2018-02-01 | 元太科技工業股份有限公司 | 電連接結構 |
US10607932B2 (en) | 2016-07-05 | 2020-03-31 | E Ink Holdings Inc. | Circuit structure |
JP6766960B2 (ja) * | 2017-05-26 | 2020-10-14 | 株式会社村田製作所 | 多層配線基板、電子機器、及び、多層配線基板の製造方法 |
KR20190012485A (ko) * | 2017-07-27 | 2019-02-11 | 삼성전기주식회사 | 인쇄회로기판 및 그 제조 방법 |
JP6962641B2 (ja) * | 2018-01-30 | 2021-11-05 | 株式会社伸光製作所 | 集合回路基板とその製造方法 |
Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2001177240A (ja) * | 1999-12-21 | 2001-06-29 | Toyo Kohan Co Ltd | 多層プリント配線板及びその製造方法 |
JP2004265930A (ja) * | 2003-02-13 | 2004-09-24 | Daiwa Kogyo:Kk | 多層配線基板及びその製造方法 |
JP2005064203A (ja) * | 2003-08-11 | 2005-03-10 | North:Kk | 多層配線基板の製造方法 |
TW201039704A (en) * | 2009-04-16 | 2010-11-01 | Samsung Electro Mech | Trench substrate and method of manufacturing the same |
Family Cites Families (37)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4303798A (en) * | 1979-04-27 | 1981-12-01 | Kollmorgen Technologies Corporation | Heat shock resistant printed circuit board assemblies |
JPH0736468B2 (ja) * | 1991-03-06 | 1995-04-19 | インターナショナル・ビジネス・マシーンズ・コーポレイション | 導電性転写部材 |
US5326643A (en) * | 1991-10-07 | 1994-07-05 | International Business Machines Corporation | Adhesive layer in multi-level packaging and organic material as a metal diffusion barrier |
TW250555B (zh) | 1992-09-30 | 1995-07-01 | Hudson Kk | |
EP0620702B1 (de) * | 1993-04-16 | 1999-01-20 | Dyconex Patente Ag | Kern für elektrische Verbindungssubstrate und elektrische Verbindungssubstrate mit Kern, sowie Verfahren zu deren Herstellung |
JPH09116273A (ja) * | 1995-08-11 | 1997-05-02 | Shinko Electric Ind Co Ltd | 多層回路基板及びその製造方法 |
US6631558B2 (en) * | 1996-06-05 | 2003-10-14 | Laservia Corporation | Blind via laser drilling system |
JPH11186698A (ja) | 1997-12-18 | 1999-07-09 | Matsushita Electric Ind Co Ltd | 回路基板の製造方法および回路基板 |
US6569543B2 (en) * | 2001-02-15 | 2003-05-27 | Olin Corporation | Copper foil with low profile bond enahncement |
US6931723B1 (en) * | 2000-09-19 | 2005-08-23 | International Business Machines Corporation | Organic dielectric electronic interconnect structures and method for making |
JP2002179772A (ja) * | 2000-12-08 | 2002-06-26 | Mitsui Mining & Smelting Co Ltd | プリント配線板の層間絶縁層構成用の樹脂化合物、その樹脂化合物を用いた絶縁層形成用樹脂シート及び樹脂付銅箔、並びにそれらを用いた銅張積層板 |
US6593534B2 (en) * | 2001-03-19 | 2003-07-15 | International Business Machines Corporation | Printed wiring board structure with z-axis interconnections |
US7543592B2 (en) * | 2001-12-04 | 2009-06-09 | Ekc Technology, Inc. | Compositions and processes for photoresist stripping and residue removal in wafer level packaging |
JP4045143B2 (ja) * | 2002-02-18 | 2008-02-13 | テセラ・インターコネクト・マテリアルズ,インコーポレイテッド | 配線膜間接続用部材の製造方法及び多層配線基板の製造方法 |
JP4179165B2 (ja) * | 2002-02-28 | 2008-11-12 | 日本ゼオン株式会社 | 部分めっき方法、部分めっき樹脂基材、及び多層回路基板の製造方法 |
US7548430B1 (en) * | 2002-05-01 | 2009-06-16 | Amkor Technology, Inc. | Buildup dielectric and metallization process and semiconductor package |
US6790725B2 (en) * | 2002-05-17 | 2004-09-14 | Micron Technology, Inc. | Double-sided capacitor structure for a semiconductor device and a method for forming the structure |
JP2004063575A (ja) | 2002-07-25 | 2004-02-26 | Fujikura Ltd | プリント基板 |
JP2004063701A (ja) | 2002-07-26 | 2004-02-26 | Yamaichi Electronics Co Ltd | フレキシブルプリント配線基板の製造方法 |
JP2005026645A (ja) * | 2002-10-15 | 2005-01-27 | Shinko Electric Ind Co Ltd | 回路基板及びその製造方法 |
KR100791667B1 (ko) * | 2003-05-21 | 2008-01-04 | 히다치 가세고교 가부시끼가이샤 | 프라이머, 수지 부착 도체박, 적층판 및 적층판의 제조방법 |
JP3949676B2 (ja) * | 2003-07-22 | 2007-07-25 | 三井金属鉱業株式会社 | 極薄接着剤層付銅箔及びその極薄接着剤層付銅箔の製造方法 |
DE102004005300A1 (de) * | 2004-01-29 | 2005-09-08 | Atotech Deutschland Gmbh | Verfahren zum Behandeln von Trägermaterial zur Herstellung von Schltungsträgern und Anwendung des Verfahrens |
JP2005223091A (ja) * | 2004-02-04 | 2005-08-18 | Sanyo Electric Co Ltd | エッチング方法およびそれを用いた回路装置の製造方法 |
JP2005353420A (ja) * | 2004-06-10 | 2005-12-22 | Sony Corp | 導電性材料、導電性材料担持シート、導電性材料の充填方法及び装置 |
TWI253714B (en) * | 2004-12-21 | 2006-04-21 | Phoenix Prec Technology Corp | Method for fabricating a multi-layer circuit board with fine pitch |
KR100797698B1 (ko) * | 2005-09-27 | 2008-01-23 | 삼성전기주식회사 | 고밀도 인쇄회로기판 제조방법 |
US7646097B2 (en) * | 2005-10-11 | 2010-01-12 | Taiwan Semiconductor Manufacturing Co., Ltd. | Bond pads and methods for fabricating the same |
JP2007208193A (ja) | 2006-02-06 | 2007-08-16 | Alps Electric Co Ltd | セラミック基板 |
US20070281464A1 (en) * | 2006-06-01 | 2007-12-06 | Shih-Ping Hsu | Multi-layer circuit board with fine pitches and fabricating method thereof |
KR100860367B1 (ko) * | 2006-08-21 | 2008-09-25 | 제일모직주식회사 | 금속실리사이드막 대비 실리콘 산화막에 대한 상대적인 식각 선택성이 향상된 식각용액 |
JP2008124370A (ja) | 2006-11-15 | 2008-05-29 | Hitachi Chem Co Ltd | 多層プリント配線板の製造方法 |
EP2114579B1 (en) * | 2007-01-02 | 2019-09-11 | Ormet Circuits, Inc. | Methods to produce high density, multilayer printed wiring boards from parallel-fabricated circuits and filled vias |
KR100990576B1 (ko) * | 2008-05-26 | 2010-10-29 | 삼성전기주식회사 | 미세 최외층 회로패턴을 갖는 인쇄회로기판 및 그 제조방법 |
JP4460013B2 (ja) * | 2008-08-22 | 2010-05-12 | 新光電気工業株式会社 | 配線基板の製造方法 |
KR100999529B1 (ko) * | 2008-09-04 | 2010-12-08 | 삼성전기주식회사 | 마이크로 스트립 라인을 구비한 인쇄회로기판, 스트립라인을 구비한 인쇄회로기판 및 그들의 제조 방법 |
JP5298347B2 (ja) * | 2009-05-18 | 2013-09-25 | 株式会社フジクラ | プリント配線基板及びその製造方法 |
-
2011
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Patent Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2001177240A (ja) * | 1999-12-21 | 2001-06-29 | Toyo Kohan Co Ltd | 多層プリント配線板及びその製造方法 |
JP2004265930A (ja) * | 2003-02-13 | 2004-09-24 | Daiwa Kogyo:Kk | 多層配線基板及びその製造方法 |
JP2005064203A (ja) * | 2003-08-11 | 2005-03-10 | North:Kk | 多層配線基板の製造方法 |
TW201039704A (en) * | 2009-04-16 | 2010-11-01 | Samsung Electro Mech | Trench substrate and method of manufacturing the same |
Also Published As
Publication number | Publication date |
---|---|
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TW201334646A (zh) | 印刷電路板及其製造方法 | |
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