WO2013136895A1 - 半導体装置 - Google Patents

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WO2013136895A1
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conductive
block
conductive pattern
semiconductor device
fixed
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瑶子 中村
典弘 梨子田
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富士電機株式会社
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Definitions

  • the present invention relates to a semiconductor device such as a power semiconductor module.
  • FIG. 11 is a cross-sectional view of a main part of a conventional semiconductor device having a structure similar to the structure described in Patent Document 1.
  • a power semiconductor module which is a conventional semiconductor device includes a DCB (Direct Copper Bonding) substrate 104 which is an insulating substrate with a conductive pattern composed of an insulating substrate 101 and copper circuit patterns 102a and 102b formed on the front and back of the insulating substrate 101. Is provided.
  • the power semiconductor module also includes a copper block 103a that is fixed to the copper circuit pattern 102a of the DCB substrate 104 by diffusion bonding or the like, and a copper block 103b that is fixed to the copper circuit pattern 102b of the DCB substrate 104 by diffusion bonding or the like.
  • this power semiconductor module includes a semiconductor chip 106 whose back surface is fixed to the copper block 103a with a bonding material 105 such as solder, and a conductive post 108 fixed to the upper surface electrode of the semiconductor chip 106 with a bonding material 107 such as solder, And a printed circuit board 109 having the conductive posts 108. Furthermore, the power semiconductor module includes a sealing resin 111 that seals the semiconductor chip 106, the DCB substrate 104, and the printed circuit board 109.
  • Reference numeral 110 denotes an external lead-out terminal.
  • Patent Document 2 it is described that when a power semiconductor chip is solder-bonded to a DCB substrate, a plurality of stress relaxation dimples are provided at the edge of the conductor pattern along the boundary portion with the ceramic substrate.
  • Patent Document 3 describes that irregularities are formed in a plan view on the outer peripheral edge of a metal layer for joining a circuit member and a support base in order to reduce thermal stress repeatedly applied to the heat dissipation base. Yes.
  • Patent Document 4 in a ceramic circuit board formed by bonding a metal plate such as a copper plate to a ceramic substrate by a direct bonding method, an active metal method, or the like, the inner side of the outer peripheral edge on the side opposite to the bonding surface of the copper plate In addition, for example, linearly discontinuous grooves are formed at predetermined intervals along the outer peripheral edge.
  • the copper circuit pattern in the vicinity of the insulating substrate 101 is caused by the difference in linear expansion coefficient between the insulating substrate 101 made of ceramic constituting the DCB substrate 104 and the copper circuit patterns 102a and 102b formed of copper.
  • stress is generated between the sealing resin 111 a and the sealing resin 111, and peeling occurs between the DCB substrate 104 and the sealing resin 111.
  • Patent Documents 1 to 4 the difference in linear expansion coefficient between the copper circuit pattern and the insulating substrate is reduced by reducing the average volume of copper in the copper circuit pattern around the copper block outward from the copper block. There is no description about relaxing the resin to avoid concentration of thermal stress and to prevent the resin from peeling off.
  • the object of the present invention is to solve the above-mentioned problems and maintain the adhesion of the sealing resin in a semiconductor device such as a resin-encapsulated power semiconductor module, thereby improving the reliability and life of the module. To provide an apparatus.
  • the present invention provides an insulating substrate with a conductive pattern (for example, a DCB substrate) and a conductive block fixed on the conductive pattern (for example, a circuit pattern) of the insulating substrate with a conductive pattern.
  • a conductive pattern for example, a DCB substrate
  • a conductive block fixed on the conductive pattern for example, a circuit pattern
  • the semiconductor device is provided with a configuration in which the volume of the average conductive film per unit area of the conductive pattern around the portion where the conductive block is fixed is arranged so as to decrease outward from the conductive block.
  • a perforation hole is arranged so that the number per unit area increases outward from the conductive block, It is preferable to reduce the volume of the conductive film of the conductive pattern.
  • the conductive pattern around the portion where the conductive block is fixed is provided with a perforated hole having a cross-sectional area that increases outward from the conductive block, so that the conductive pattern is electrically conductive. It is good to reduce the volume of the membrane.
  • an annular perforated groove whose number per unit length increases outward from the conductive block is arranged, The volume of the conductive film of the conductive pattern may be reduced.
  • annular perforated groove having a width increasing outwardly from the conductive block is disposed in the conductive pattern around the portion where the conductive block is fixed, so that the conductive pattern is electrically conductive. It is good to reduce the volume of the membrane.
  • the bottom of the perforated hole or the annular perforated groove may be closed with the conductive film.
  • the volume of the conductive film of the conductive pattern is reduced by gradually reducing the thickness of the conductive pattern around the portion where the conductive block is fixed outward from the conductive block. It is good to let them.
  • the cross-sectional shape of the conductive pattern whose thickness is gradually reduced is a slope shape or a step shape.
  • the conductive pattern is bonded to the front surface side of the insulating substrate with a conductive pattern, and the conductive block and the semiconductor chip are fixed in order on the conductive pattern, And another conductive pattern is joined to the back side of the insulating substrate with the conductive pattern, and another conductive block is fixed on the other conductive pattern, and one main surface of the other conductive block is the resin. It is good to be exposed from.
  • the conductive pattern and the other conductive pattern may be a metal film, and the conductive block and the other conductive block may be a metal block.
  • the average volume per unit area of the conductive pattern around the portion where the conductive block is fixed is decreased outward from the conductive block.
  • FIG. 10A is a plan view of relevant parts of a DCB substrate of a semiconductor device according to a fourth embodiment of the present invention
  • FIG. 10A is a plan view of relevant parts of a DCB substrate of a semiconductor device according to a fourth embodiment of the present invention
  • FIG. 10A is principal part sectional drawing of a DCB board
  • FIG. 1 is a cross-sectional view of a principal part of a semiconductor device according to a first embodiment of the present invention.
  • FIG. 2 is a plan view of an essential part of the DCB substrate of FIG.
  • a semiconductor power module as a semiconductor device includes a DCB (Direct Copper Bonding) which is an insulating substrate with a conductive pattern composed of an insulating substrate 1 and copper circuit patterns 2a and 2b formed on the front and back of the insulating substrate 1.
  • a substrate 4 is provided.
  • the semiconductor power module also includes a copper block 3a that is fixed to the copper circuit pattern 2a of the DCB substrate 4 by diffusion bonding or the like, and a copper block 3b that is fixed to the copper circuit pattern 2b of the DCB substrate 4 by diffusion bonding or the like.
  • the semiconductor power module includes a semiconductor chip 6 whose back surface is fixed to the copper block 3a with a bonding material 5 such as solder, a conductive post 8 fixed to the upper surface electrode of the semiconductor chip 6 with a bonding material 7 such as solder, And a printed circuit board 9 having the conductive posts 8. Furthermore, in this semiconductor power module, the external lead-out terminals 10 are fixed to the copper block 3a and the printed board 9 with a bonding material (not shown). Furthermore, the semiconductor power module includes a sealing resin 11 that seals the semiconductor chip 6, the DCB substrate 4, and the printed board 9. From the sealing resin 11, the end part of the external lead-out terminal 10 and one main surface of the copper block 3b are exposed.
  • the copper circuit pattern 2 a has a circular cross-sectional shape when seen in a plan view, and a plurality of small drill holes 12 a opened to the position of the surface of the insulating substrate 1 are arranged. These drill holes 12a are arranged so that the number per unit area increases as the distance from the end of the copper block 3a increases, thereby reducing the volume of the copper film per unit area of the copper circuit pattern 2a. It is decreasing towards the outside.
  • the average area density So is decreased outward from the copper block.
  • the resin 11 is filled in the hole 12a formed in the copper circuit pattern 2a and cured.
  • the resin 11 is cured, in addition to adhesion by chemical bonding between the resin 11 and a member (for example, the copper circuit pattern 2a), the resin 11 is physically peeled by being cured after the hole 11a is filled with the resin 11. It becomes difficult (anchor effect).
  • the area (or volume) of the copper circuit pattern portion is reduced in the portion where the apparent perforated holes 12 a are large, and the volume of the copper film of the copper circuit pattern occupied in the ceramic forming the insulating substrate 1. Becomes smaller. Therefore, the linear expansion coefficient of the copper circuit pattern is close to that of the insulating substrate. Further, the area (or volume) of the copper circuit pattern 2a is large in the portion where the perforated holes 12a are small, the copper volume of the copper circuit pattern occupying the ceramic is large, and the linear expansion coefficient of the copper circuit pattern is close to copper.
  • the copper area (or volume) in the vicinity of the ceramic (the copper circuit pattern 2a away from the copper block 3a) is reduced, and the copper area (or volume) in the vicinity of the copper block 3a is increased.
  • the difference in the linear expansion coefficient between the copper circuit pattern 2a and the ceramic that is the insulating substrate 1 becomes gradual, and the stress concentration between the copper circuit pattern near the insulating substrate and the sealing resin by the heat around the semiconductor chip serving as the heat source is reduced.
  • separation of the resin 11 is prevented in combination with the anchor effect of the drilled hole 12a. Further, insulation failure due to ceramic cracking is suppressed, and high reliability can be realized.
  • perforated holes may be similarly formed in the copper circuit pattern 2b on the back side where the semiconductor chip 6 is not mounted.
  • the semiconductor device is used so that one main surface of the copper block 3b is in contact with the cooler, and the periphery of the copper block 3b is lower in temperature than the periphery of the copper block 3a to which the semiconductor chip 6 is fixed.
  • the area occupied by the pattern 2b on the insulating substrate 1 is large, the difference in the linear expansion coefficient between the copper circuit patterns 2a and 2b and the insulating substrate 1 can be reduced as a whole by forming the pattern 2b on both the copper circuit patterns 2a and 2b, and further reliability. Can be improved.
  • FIG. 4 is a plan view of the main part of the semiconductor device according to the second embodiment of the present invention. This figure is a plan view of the main part of the DCB substrate 4 constituting the semiconductor device. This plan view is a plan view corresponding to FIG.
  • the difference from FIG. 2 is that the number of holes 12b (area of the cross section) is changed by making the number per unit area substantially the same.
  • the effect similar to Example 1 is acquired by making the drilling hole 12b small in the copper block 3a vicinity, and enlarging the drilling hole 12b of the distant place.
  • FIG. 6 is a plan view of the main part of the semiconductor device according to the third embodiment of the present invention. This figure is a plan view of the main part of the DCB substrate 4 constituting the semiconductor device. This plan view is a plan view corresponding to FIG.
  • the difference from FIG. 2 is that the formed drilling hole 12a is changed to an annular drilling groove 12d.
  • the area of copper near the ceramic away from the copper block can be reduced.
  • the effect similar to Example 1 is acquired by making small and enlarging the copper area of the copper block vicinity. As shown in FIG. 7, the same effect can be obtained even if the width of each of the drilling grooves 12e is increased outward.
  • annular drilling grooves 12d and 12e may have the shape interrupted on the way irrespective of the cyclic
  • FIGS. 9A and 9B are a plan view (a) and a cross-sectional view (b) of the main part of the DCB substrate of the semiconductor device according to the fourth embodiment of the present invention. The difference from FIG. 2 is that the thickness of the copper circuit pattern 2a is changed instead of forming the drilled hole.
  • a similar effect can be obtained by the slope-like copper circuit pattern 14 whose thickness is gradually decreased at a constant rate toward the outside. Further, the same effect can be obtained even if the stepped copper circuit pattern 15 is thinned in a step shape instead of a slope shape as shown in FIG. Although not shown in the figure, when the drilling holes or the annular drilling grooves are uniformly arranged in this structure, an anchor effect is generated, so that the adhesion of the resin 11 is further improved.

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Abstract

　封止樹脂の密着性を保持し、モジュールの信頼性等を向上させることができる樹脂封止型の半導体装置を提供する。　導電パターン付絶縁基板１と、導電パターン付絶縁基板１の導電パターン２ａ，２ｂ上に固着された導電ブロック３ａ，３ｂと、導電ブロック上に固着された半導体チップ６と、半導体チップ上に固着された導電ポスト８を備えるプリント基板９と、これらを封止する樹脂１１とを備えている半導体装置である。導電ブロックが固着した箇所の周囲の導電パターンの単位面積あたりの平均の導電膜の体積を、導電ブロックから外に向って減少するようにした。

Description

半導体装置
　この発明は、パワー半導体モジュールなどの半導体装置に関する。
　図１１は、特許文献１に記載の構造と類似の構造をした従来の半導体装置の要部断面図である。従来の半導体装置であるパワー半導体モジュールは、絶縁基板１０１とこの絶縁基板１０１の表裏に形成される銅回路パターン１０２ａ，１０２ｂで構成される導電パターン付絶縁基板であるＤＣＢ（Ｄｉｒｅｃｔ　Ｃｏｐｐｅｒ　Ｂｏｎｄｉｎｇ）基板１０４を備える。また、このパワー半導体モジュールは、ＤＣＢ基板１０４の銅回路パターン１０２ａに拡散接合等で固着する銅ブロック１０３ａと、ＤＣＢ基板１０４の銅回路パターン１０２ｂに拡散接合等で固着する銅ブロック１０３ｂを備える。さらに、このパワー半導体モジュールは、銅ブロック１０３ａ上に半田などの接合材１０５で裏面が固着する半導体チップ１０６と、半導体チップ１０６の上面電極に半田などの接合材１０７で固着する導電ポスト１０８と、この導電ポスト１０８を有するプリント基板１０９とを備える。さらにまた、このパワー半導体モジュールは、前記の半導体チップ１０６およびＤＣＢ基板１０４およびプリント基板１０９を封止する封止樹脂１１１を備える。符号１１０は、外部導出端子を示す。
　また、特許文献２では、ＤＣＢ基板にパワー半導体チップを半田接合するときに、セラミック基板との境界部分に沿う導体パターンの縁部に複数の応力緩和用のディンブルを設けることが記載されている。
　さらに、特許文献３では、放熱基体に繰り返し与えられる熱応力を低減するために、回路部材と支持基体を接合するための金属層の外周縁部に平面視で凹凸を形成することが記載されている。
　さらにまた、特許文献４では、セラミックス基板に銅板等の金属板を、直接接合法や活性金属法等で接合して構成したセラミックス回路基板において、銅板の接合面と反対面側の外周縁部内側に、例えば外周縁部に沿って所定の間隔で直線状に不連続な溝を形成している。こうすることで、冷熱サイクルが付加された場合等においても、セラミックス基板のクラック発生や強度低下を有効に防止することができることが記載されている。
特開２００９－６４８５２号公報 特開２００９－９４１３５号公報 特開２００９－８８１７６号公報 特開平８－２７４４２３号公報
　樹脂封止型半導体においては、内蔵される部材との樹脂密着性が信頼性に大きく影響を与える。図１１の構造においては、ＤＣＢ基板１０４を構成するセラミックからなる絶縁基板１０１と、銅で形成される銅回路パターン１０２ａ，１０２ｂとの線膨張率差が原因となり、絶縁基板１０１近傍の銅回路パターン１０２ａ，１０２ｂと封止樹脂１１１の間で応力が発生し、ＤＣＢ基板１０４と封止樹脂１１１との間に剥離が生じるという課題があった。
　半導体チップ１０６が搭載されるＤＣＢ基板１０４と封止樹脂１１１との間に剥離が進行した場合、半導体チップ１０６と銅ブロック１０３ａとの接合部にも応力が集中し、接合部劣化が発生して、故障の原因となる。
　特に、銅回路パターン１０２ａと封止樹脂１１１との間に生じた剥離が絶縁基板１０１にまで進展すると、絶縁不良が発生する。また、封止樹脂１１１が絶縁基板１０１とのみ密着し、銅回路パターン１０２ａから剥離している状態でも、銅回路パターン１０２ａ近傍の絶縁基板１０１に応力が集中するため、絶縁基板１０１にクラックが発生し、同様に絶縁不良となる。
　さらに、近年適用が進むＳｉＣ（炭化珪素）デバイス等のＷＢＧ（ワイドバンドギャップ）素子を搭載したパワー半導体モジュールでは、動作温度範囲が従来のＳｉ（シリコン）デバイスを搭載したパワー半導体モジュールと比べ高くなっており、Ｓｉデバイスを搭載したパワー半導体モジュール以上（Ｔｊｍａｘ≧１７５℃）の高温駆動となる。そのような場合、さらに熱応力が増大するため、前記のような封止樹脂１１１の剥離が起こりやすくなることが想定され、信頼性の低下が懸念される。
　前記の特許文献１～特許文献４では、銅ブロックの周囲の銅回路パターンの銅の平均の体積を銅ブロックから外に向って小さくすることで、銅回路パターンと絶縁基板との線膨張率差を緩やかにして、熱応力集中を回避し、樹脂の剥離を生じにくくすることについては記載されていない。
　この発明の目的は、前記の課題を解決して、樹脂封止型パワー半導体モジュールなどの半導体装置において、封止樹脂の密着性を保持し、モジュールの信頼性および寿命を向上させることができる半導体装置を提供することにある。
　前記の目的を達成するために、本発明は、導電パターン付絶縁基板（例えば、ＤＣＢ基板など）と、該導電パターン付絶縁基板の導電パターン（例えば、回路パターンなど）上に固着された導電ブロック（例えば、銅ブロックなど）と、該導電ブロック上に固着された半導体チップと、該半導体チップ上に固着された導電ポストを備えるプリント基板と、これらを封止する樹脂（封止樹脂）とを備えている半導体装置において、前記導電ブロックが固着した箇所の周囲の前記導電パターンの単位面積あたりの平均の導電膜の体積を、該導電ブロックから外に向って減少するように配置した構成とする。
　また、本発明によれば、前記導電ブロックが固着した箇所の周囲の前記導電パターンに、該導電ブロックから外に向って単位面積あたりの個数が増加するように穿設穴を配置して、前記導電パターンの導電膜の体積を減少させるとよい。
　また、本発明によれば、前記導電ブロックが固着した箇所の周囲の前記導電パターンに、該導電ブロックから外に向って断面の面積が大きくなる穿設穴を配置して、前記導電パターンの導電膜の体積を減少させるとよい。
　また、本発明によれば、前記導電ブロックが固着した箇所の周囲の前記導電パターンに、該導電ブロックから外に向って単位長さあたりの本数が増加する環状の穿設溝を配置して、前記導電パターンの導電膜の体積を減少させるとよい。
　また、本発明によれば、前記導電ブロックが固着した箇所の周囲の前記導電パターンに、該導電ブロックから外に向って幅が増加する環状の穿設溝を配置して、前記導電パターンの導電膜の体積を減少させるとよい。
　また、本発明によれば、前記穿設穴もしくは前記環状の穿設溝の底部を、前記導電膜により塞いでもよい。
　また、本発明によれば、前記導電ブロックが固着した箇所の周囲の前記導電パターンの厚さを該導電ブロックから外に向って徐々に薄くすることで、前記導電パターンの導電膜の体積を減少させるとよい。
　また、本発明によれば、前記導電ブロックが固着した箇所の周囲の前記導電パターンに、穿設穴もしくは環状の穿設溝を設けるとよい。
　また、本発明によれば、厚さが徐々に薄くなる前記導電パターンの断面形状が、スロープ状もしくは階段状であるとよい。
　また、本発明によれば、前記導電パターン付絶縁基板の表（おもて）面側に前記導電パターンが接合され、該導電パターン上に前記導電ブロックおよび前記半導体チップが順に固着されており、かつ、前記導電パターン付絶縁基板の裏面側に他の導電パターンが接合され、該他の導電パターン上に他の導電ブロックが固着されており、前記他の導電ブロックの一の主面が前記樹脂から露出しているとよい。
　また、本発明によれば、前記導電パターンおよび他の導電パターンが金属膜であり、前記導電ブロックおよび他の導電ブロックが金属ブロックであるとよい。
　本発明によれば、導電ブロックが固着した導電パターン付絶縁基板の導電パターンにおいて、導電ブロックが固着した箇所の周囲の導電パターンの単位面積あたりの平均の体積を導電ブロックから外に向って減少させるように配置したことで、導電パターン付絶縁基板と封止樹脂の密着性を向上させ、半導体装置の信頼性および寿命を向上させることができる。
本発明の第１実施例における半導体装置の要部断面図である。 図１のＤＣＢ基板の要部平面図である。 穿設穴を増やした場合のＤＣＢ基板の要部平面図である。 本発明の第２実施例における半導体装置のＤＣＢ基板の要部平面図である。 穿設穴の平面形状が矩形の場合のＤＣＢ基板の要部平面図である。 本発明の第３実施例における半導体装置のＤＣＢ基板の要部平面図である。 環状の穿設溝の幅を外に向って広くした場合のＤＣＢ基板の要部平面図である。 穿設穴１２ｈもしくは環状の穿設溝１２ｊを貫通させずに薄い銅層を底部に残した構造とした場合のＤＣＢ基板の要部断面図である。 本発明の第４実施例における半導体装置のＤＣＢ基板の要部平面図（ａ）および（ｂ）要部断面図である。 図９のスロープ状銅回路パターン１４を階段状銅回路パターン１５とした場合のＤＣＢ基板の要部断面図である。 特許文献１に記載の構造と類似の構造をした従来の半導体装置の要部断面図である。
　本発明を実施するための形態のポイントは、銅ブロックの周囲の銅回路パターンの銅の単位面積あたりの平均の体積を外に向って小さくすることで、銅回路パターンと絶縁基板との線膨張率差を緩やかにして、熱応力集中を回避し、樹脂の剥離を生じにくくすることである。平均の体積を減少させる方法としては、穿設穴の配置密度や、環状の穿設溝の占める面積、厚さなどを変える方法がある。また、穿設穴や環状の穿設溝を形成することでアンカー効果が出てきて、さらに樹脂の剥離が生じにくくなる。実施の形態を以下の実施例で説明する。
＜実施例１＞
　図１は、本発明の第１実施例における半導体装置の要部断面図である。
　図２は、図１のＤＣＢ基板の要部平面図である。
　図１において、半導体装置である半導体パワーモジュールは、絶縁基板１とこの絶縁基板１の表裏に形成される銅回路パターン２ａ，２ｂで構成される導電パターン付絶縁基板であるＤＣＢ（Ｄｉｒｅｃｔ　Ｃｏｐｐｅｒ　Ｂｏｎｄｉｎｇ）基板４を備える。また、この半導体パワーモジュールは、ＤＣＢ基板４の銅回路パターン２ａに拡散接合等で固着する銅ブロック３ａと、ＤＣＢ基板４の銅回路パターン２ｂに拡散接合等で固着する銅ブロック３ｂを備える。さらに、この半導体パワーモジュールは、銅ブロック３ａ上に半田などの接合材５で裏面が固着する半導体チップ６と、半導体チップ６の上面電極に半田などの接合材７で固着する導電ポスト８と、この導電ポスト８を有するプリント基板９とを備える。さらにまた、この半導体パワーモジュールにおいて、銅ブロック３ａとプリント基板９にはそれぞれ、外部導出端子１０が、図示しない接合材により固着されている。さらにまた、この半導体パワーモジュールは、前記の半導体チップ６およびＤＣＢ基板４およびプリント基板９を封止する封止樹脂１１を備える。封止樹脂１１からは、外部導出端子１０の端部と銅ブロック３ｂの一の主面が露出している。
　図２に示すように、銅回路パターン２ａには、平面視したときの断面形状が円形であり、絶縁基板１の表面の位置まで開口した小さな穿設穴１２ａが複数配置されている。これらの穿設穴１２ａは、銅ブロック３ａの端部から外に向かって離れるにつれて、単位面積あたりの個数を増やすように配置することで、銅回路パターン２ａの単位面積あたりの銅膜の体積を外に向かって減少させている。
　このように、銅回路パターン２ａに形成される穿設穴１２ａの数を銅ブロック３ａから外に向かって離れるにつれて増加させることで、銅膜の平均の体積密度は外に向って減少する。平均の体積密度とは、銅ブロックを一周する穿設穴１２ａの中央線２０の長さをＬ、所定の幅（例えば、穿設穴の直径の１倍超の幅）をＷ、環状の帯の面積Ｓ１、穿設穴１２ａの面積をＳ２、環状の面積Ｓ１に存在する穿設穴１２ａの数をｎ、環状の面積Ｓ１に存在する穿設穴１２ａの総面積をＳ３、銅の平均の面積密度Ｓｏとしたとき、Ｓ１＝Ｌ×Ｗ、Ｓ３＝Ｓ２×ｎであり、Ｓｏ＝（Ｓ１－Ｓ３）／Ｓ１となる。この平均の面積密度Ｓｏを銅ブロックから外に向って小さくする。このＳｏに銅回路パターン１２ａの厚さｔを掛けたもの（Ｓｏ×ｔ）が平均の体積密度Ｖｏとなり、この平均の体積密度Ｖｏを銅ブロック３ａから外に向って離れるにつれて小さくする。
　樹脂封止することにより、銅回路パターン２ａに形成される穿設穴１２ａに樹脂１１が充填され硬化する。樹脂１１が硬化することで、樹脂１１と部材（例えば、銅回路パターン２ａ）の化学的結合による接着に加え、穿設穴１２ａに樹脂１１が充填された後に硬化することで、物理的に剥がれにくくなる（アンカー効果）。
　さらに、ＤＣＢ基板４全体では、見かけ上の穿設穴１２ａが多い部分は銅回路パターン部分の面積（または体積）が小さくなり、絶縁基板１を形成するセラミックに占める銅回路パターンの銅膜の体積が小さくなる。そのため、銅回路パターンの線膨張率は絶縁基板に近くなる。また、穿設穴１２ａが少ない部分は銅回路パターン２ａの面積（または体積）が大きく、セラミックに占める銅回路パターンの銅の体積が大きくなり、銅回路パターンの線膨張率は銅に近くなる。
　そのため、セラミック付近（銅ブロック３ａから外の方へ離れた箇所の銅回路パターン２ａ）の銅の面積（または体積）を小さくし、銅ブロック３ａ付近の銅の面積（または体積）を大きくすることで、銅回路パターン２ａと絶縁基板１であるセラミックの線膨張率差が緩やかとなり、熱源となる半導体チップ周辺での、熱による絶縁基板近傍の銅回路パターンと封止樹脂の間の応力集中を回避できる。その結果、穿設穴１２ａのアンカー効果と相まって樹脂１１の剥離が防止される。また、セラミックの割れによる絶縁不良が抑制されて、高い信頼性を実現することができる。
　尚、図１には図示していないが、半導体チップ６が搭載されない裏面側の銅回路パターン２ｂにも、同様に穿設穴を形成してもよい。半導体装置は銅ブロック３ｂの一の主面が冷却器に接触するように使用され、銅ブロック３ｂの周辺は、半導体チップ６が固着した銅ブロック３ａの周辺に比べれば低温となるが、銅回路パターン２ｂの絶縁基板１に占める面積が大きい場合には、銅回路パターン２ａ，２ｂ両方に形成することにより銅回路パターン２ａ，２ｂと絶縁基板１の線膨張率差を全体として小さくでき、さらに信頼性を向上できる。
　また、図３に示すように、穿設穴１２ａの個数を増やすことでアンカー効果が増進され、一層樹脂１１の剥離が防止される。
＜実施例２＞
　図４は、本発明の第２実施例における半導体装置の要部平面図である。この図は半導体装置を構成するＤＣＢ基板４の要部平面図である。この平面図は図２に相当する平面図である。
　図２との違いは、単位面積あたりの個数をほぼ同じにして穿設穴１２ｂのそれぞれの大きさ（断面の面積）を変えた点である。銅ブロック３ａ近傍で穿設穴１２ｂを小さくし、離れた箇所の穿設穴１２ｂを大きくすることで、実施例１と同様の効果が得られる。
　尚、実施例１、実施例２ともに穿設穴１２ａ，１２ｂの形状は円形であるが、これに限られるものではなく、図５に示すような矩形の穿設穴１２ｃ等にしても構わない。また、矩形と円形の組み合わせでも構わない。
＜実施例３＞
　図６は、本発明の第３実施例における半導体装置の要部平面図である。この図は半導体装置を構成するＤＣＢ基板４の要部平面図である。この平面図は図２に相当する平面図である。
　図２との違いは、形成する穿設穴１２ａを環状の穿設溝１２ｄに変えた点である。環状の穿設溝１２ｄの、銅ブロック３ａから外に向かう方向における単位長さあたりの本数を外に向かって密にする（大きくする）ことで、銅ブロックから離れたセラミック付近の銅の面積を小さくし、銅ブロック付近の銅の面積を大きくすることで、実施例１と同様の効果が得られる。図７に示すように、穿設溝１２ｅのそれぞれの幅を外に向って広くしても同様の効果が得られる。また、図示しないが、環状の穿設溝１２ｄ，１２ｅは、環状によらず途中で途切れた形状等でもよく、部分的に穿設溝が形成されている箇所があっても構わない。
　前記実施例１～実施例３において、図８の断面図に示すように、穿設穴１２ｈもしくは環状の穿設溝１２ｊを絶縁基板１の表面の位置まで貫通させないで薄い銅層を底部１３に残した構造としても同様の効果が得られる。また、残す銅層の厚さを銅ブロック３ａから外に向って徐々に薄くしても同様の効果が得られる。
＜実施例４＞
　図９は、本発明の第４実施例における半導体装置のＤＣＢ基板の要部平面図（ａ）および要部断面図（ｂ）である。図２との違いは、穿設穴を形成するのではなく、銅回路パターン２ａの厚さを変えた点である。厚さを外に向って一定の割合で徐々に薄くしたスロープ状銅回路パターン１４により、同様の効果が得られる。また、図１０のようにスロープ状でなく階段状に薄くした階段状銅回路パターン１５にしても同様の効果が得られる。また、図示しないが、この構造に穿設穴もしくは環状の穿設溝を均一に配置すると、アンカー効果が発生するため、樹脂１１の密着性はさらに向上する。
　　　１　　絶縁基板
　　　２ａ，２ｂ　銅回路パターン
　　　３ａ，３ｂ　銅ブロック
　　　４　　ＤＣＢ基板
　　　５，７　接合材
　　　６　　半導体チップ
　　　８　　導電ポスト
　　　９　　プリント基板
　　１０　　外部導出端子
　　１１　　封止樹脂
　　１２ａ，ｂ，ｃ　穿設穴
　　１２ｄ，１２ｅ　環状の穿設溝
　　１２ｈ　底面がある穿設穴
　　１２ｊ　底面がある環状の穿設溝
　　１３　　底部
　　１４　　スロープ状銅回路パターン
　　１５　　階段状銅回路パターン 

Claims (11)

  1. 　導電パターン付絶縁基板と、該導電パターン付絶縁基板の導電パターン上に固着された導電ブロックと、該導電ブロック上に固着された半導体チップと、該半導体チップ上に固着された導電ポストを備えるプリント基板と、これらを封止する樹脂とを備えている半導体装置において、
    　前記導電ブロックが固着した箇所の周囲の前記導電パターンの単位面積あたりの平均の導電膜の体積を、該導電ブロックから外に向って減少するようにしたことを特徴とする半導体装置。
  2. 　前記導電ブロックが固着した箇所の周囲の前記導電パターンに、該導電ブロックから外に向って単位面積あたりの個数が増加するように穿設穴を配置して、前記導電パターンの導電膜の体積を減少させたことを特徴とする請求項１に記載の半導体装置。
  3. 　前記導電ブロックが固着した箇所の周囲の前記導電パターンに、該導電ブロックから外に向って断面の面積が大きくなる穿設穴を配置して、前記導電パターンの導電膜の体積を減少させたことを特徴とする請求項１に記載の半導体装置。
  4. 　前記導電ブロックが固着した箇所の周囲の前記導電パターンに、該導電ブロックから外に向って単位長さあたりの本数が増加する環状の穿設溝を配置して、前記導電パターンの導電膜の体積を減少させたことを特徴とする請求項１に記載の半導体装置。
  5. 　前記導電ブロックが固着した箇所の周囲の前記導電パターンに、該導電ブロックから外に向って幅が増加する環状の穿設溝を配置して、前記導電パターンの導電膜の体積を減少させたことを特徴とする請求項１に記載の半導体装置。
  6. 　前記穿設穴もしくは前記環状の穿設溝の底部が、前記導電膜により塞がれていることを特徴とする請求項２に記載の半導体装置。
  7. 　前記導電ブロックが固着した箇所の周囲の前記導電パターンの厚さを該導電ブロックから外に向って徐々に薄くすることで、前記導電パターンの導電膜の体積を減少させたことを特徴とする請求項１に記載の半導体装置。
  8. 　前記導電ブロックが固着した箇所の周囲の前記導電パターンに、穿設穴もしくは環状の穿設溝を設けたことを特徴とする請求項７に記載の半導体装置。
  9. 　厚さが徐々に薄くなる前記導電パターンの断面形状が、スロープ状もしくは階段状であることを特徴とする請求項７に記載の半導体装置。
  10. 　前記導電パターン付絶縁基板の表面側に前記導電パターンが接合され、該導電パターン上に前記導電ブロックおよび前記半導体チップが順に固着されており、かつ、前記導電パターン付絶縁基板の裏面側に他の導電パターンが接合され、該他の導電パターン上に他の導電ブロックが固着されており、
    　前記他の導電ブロックの一の主面が前記樹脂から露出していることを特徴とする請求項１に記載の半導体装置。
  11. 　前記導電パターンおよび他の導電パターンが金属膜であり、前記導電ブロックおよび他の導電ブロックが金属ブロックであることを特徴とする請求項１０に記載の半導体装置。
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