KR970060421A - 반도체 장치 및 그 제조방법 - Google Patents

반도체 장치 및 그 제조방법 Download PDF

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Abstract

[과제]
반도체 메모리부와, 바이폴라 트랜지스터를 포함하는 주변회로부를 구비한 반도체 장치에 있어서, 설계요건에 따라서 특성이 다른 복수의 바이폴라 트랜지스터를, 제조공정의 증가를 억제하여 효과적으로 제조한다.
[해결수단]
반도체 메모리부와, 주변회로부의 바이폴라 트랜지스터의 제조에 있어서, 반도체 메모리부의 층간 절연막에 대하는 구멍부 형성의 복수의 단계 대응하여, 주변부에서 바이폴라 트랜지스터 형성용의 복수의 구멍부를 설치하여, 이 구멍부의 영역에 특성이 다른 바이폴라 트랜지스터를 형성한다.

Description

반도체 장치 및 그 제조방법
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제14도는 본 발명의 실시의 형태2에 의한 반도체 장치의 제조방법을 도시한 도면.

Claims (4)

  1. 반도체 메모리를 포함하는 반도체 기억회로부와 이 반도체 기억회로부의 주변의 배치된 주변회로부를 가지는 반도체 장치의 제조에 있어서, 상기 반도체 기억회로부에서 레지스트 패턴을 통해 절연막에 선택적으로 구멍부를 설치하는 하나의 공정과 동시에, 상기 주변회로부에서 레지스트 패턴을 통해 절연막에 선택적으로 복수의 구멍부를 설치하고, 상기 주변회로부 및/또는 상기 반도체 기억회로부의 복수의 구멍부의 영역에 서로 특성이 다른 바이폴라 트랜지스터를 형성하는 것을 특징으로 하는 반도체 장치의 제조방법.
  2. 반도체 메모리를 포함하는 반도체 기억회로부와 이 반도체 기억회로부의 주변의 배치된 주변회로부를 가지는 반도체 장치의 제조에 있어서, 상기 주변회로부에서 레지스트 패턴을 통해 절연막에 선택적으로 동시에 복수의 구멍부를 설치하여, 이 복수의 구멍부의 영역에 서로 특성이 다른 바이폴라 트랜지스터를 형성하는 것을 특징으로 하는 반도체 장치의 제조방법.
  3. 반도체 메모리를 포함하는 반도체 기억회로부와 이 반도체 기억회로부의 주변에 배치된 주변회로부를 가지는 반도체 장치의 제조에 있어서, 상기 반도체 기억회로부에서, 다른 제조단계에 각각에 대응하여, 상기 주변회로부에서 레지스트 패턴을 통해 절연막에 선택적으로 구멍부를 설치하고, 상기 주변회로부 및/또는 반도체 기억회로부의 이들의 구멍부의 영역에 서로 특성이 다른 바이폴라 트랜지스터를 형성하는 것을 특징으로 하는 반도체 장치의 제조방법.
  4. 반도체 메모리를 포함하는 반도체 기억회로부와 이 반도체 기억회로부의 주변에 배치된 주변회로부를 가지는 반도체 장치의 제조에 있어서, 상기 주변회로부에서, 다른 제조단계로 레지스트 패턴을 통해서 절연막에 선택적으로 다른 구멍부를 설치하며, 이들 다른 구멍부의 영역에 서로 특성이 다른 바이폴라 트랜지스터를 형성하는 것을 특징으로 하는 반도체 장치의 제조방법.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019960039959A 1996-01-16 1996-09-14 반도체 장치 및 그 제조방법 KR100256169B1 (ko)

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
IN141922B (ko) * 1974-08-19 1977-05-07 Rca Corp
JPS5138983A (ko) * 1974-09-30 1976-03-31 Hitachi Ltd
CA1056070A (en) * 1975-02-25 1979-06-05 General Electric Company Method of making an ic structure having both power and signal components
US4535531A (en) * 1982-03-22 1985-08-20 International Business Machines Corporation Method and resulting structure for selective multiple base width transistor structures
JPS60117765A (ja) * 1983-11-30 1985-06-25 Fujitsu Ltd 半導体装置の製造方法
JPS63140567A (ja) * 1986-12-01 1988-06-13 Mitsubishi Electric Corp 半導体記憶装置

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