KR970051334A - 불휘발성 반도체 메모리장치의 고전압 레벨 최적화 회로 및 그 방법 - Google Patents
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Abstract
1. 청구 범위에 기재된 발명이 속한 기술분야
불휘발성 반도체 메모리 장치의 고전압 레벨 최적화 회로 및 그 방법.
2. 발명이 해결하려고 하는 기술적 과제
메모리 쎌의 소거나 프로그램 동작 모우드에서 필요한 고전압 레벨을 최적화하여 소거 또는 프로그램동작에 걸리는 시간을 최적화할 수 있는 불휘발성 반도체 메모리장치를 제공함에 있다.
3. 발명의 해결방법의 요지
동일 메모리 쎌에 대한 소거 및 소거검증동작 또는 프로그램 검증동작이 연속적으로 이루어지는 이이피롬은 상기 소거 또는 프로그램동작이 반복될 때마다 소거전압 또는 프로그램 전압을 시작레벨부터 점차 높여 공급하기 위하 승압레벨 제어신호를 출력하는 푸르횟수 계수회로와, 상기 승압레벨 제어신호에 응답하여 출력고전압이 점차 높아지는 고전압 발생회로와, 커팅가능한 다수의 퓨즈소자들을 가지며 동작 테스트 모우드시 인가되는 어드레스에 응답하여 상기 시작레벨을 변화시키기 위한 다수의 트리밍용 신호들을 상기 루프횟수 계수회로에 제공하며 상기퓨즈소자들중 테스트의 결가로써 선택된 퓨즈의 커팅에 의해 실제의 동작모우드시딥하여 상기 루프횟수 계수회로에 제공하는 셋팅수단을 가진다.
4. 발명의 중요한 용도
콤퓨터등에 사용되는 영구 메모리.
※ 선택도 : 제1도
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 실시예에 따른 고전압 레벨 최적화 회로의 블럭도,
제2도는 본 발명의 실시예에 따른 최적화 테스트의 동작제어 흐름도,
제3도는 본 발명에 실시예에 따른 메모리의 프로그램 동작에 대한 플로우챠트.
Claims (7)
- 다수의 플로팅게이트형의 메모리쎌들과, 선택된 복수개의 메모리쎌들을 프로그램하기 위한 프로그램수단과, 상기 선택된 복수개의 메모리쎌들이 성공적으로 프로그램되었는지를 판단하기 위한 프로그램검증수단을 가지는 불휘발성 반도체메모리에 있어서, 상기 프로그램동작이 반복될 때마다 프로그램 전압을 시작레벨부터 점차높여 공급하기 위한 승압레벨 제어신호를 출력하는 루프횟수 계수회로와, 상기 승압레벨 제어신호에 응답하여 출력고전압이 점차 높아지는 고전압 발생회로와, 커팅가능한 다수의 퓨즈소자들을 가지며 동작 테스트 모우드시 인가되는 어드레스에 응답하여 상기 시작레벨을 변화시키기 위한 다수의 트리밍용 신호들을 상기 루프횟수 계수회로에 제공하며 상기 퓨즈소자들중 테스트의 결과로써 선택된 퓨즈의 커팅에 의해 실제의 동작모우드시 설정된 모우드의 동작시간에 적합한 시작레벨을 고정적으로 셋팅하기 위한 셋팅용 신호를 상기 어드레스에 응답하여 상기 루프횟수 계수회로에 제공하는 셋팅수단을 가짐을 특징으로 하는 불휘발성 반도체 메모리 장치.
- 동일 메모리 쎌에 대한 소거 및 소거검증동작 또는 프로그램 및 프로그램 검증동작이 연속적으로 이루어지는 이이피롬에 있어서, 상기 소거 또는 프로그램동작이 반복될 때마다 소거전압 또는 프로그램 전압을 시작레벨부터 점차높여 공급하기 위한 승압레벨 제어신호를 출력하는 루프횟수 계수회로와, 상기 승압레벨 제어신호에 응답하여 출력고전압이 점차 높아지는 고전압 발생회로와, 커팅가능한 다수의 퓨즈소자들을 가지며 동작 테스트 모우드시 인가되는 어드레스에 응답하여 상기 시작레벨을 변화시키기 위한 다수의 트리밍용 신호들을 상기 루프횟수 계수회로에 제공하며 상기 퓨즈소가들중 테스트의 결과로써 선택된 퓨즈의 커팅에 의해 실제의 동작모우드시 설정된 모우드의 동작시간에 적합한 시작레벨을 고정적으로 셋팅하기 위한 셋팅용 신호를 상기 어드레스에 응답하여 상기 루프횟수 계수회로에 제공하는 셋팅수단을 가짐을 특징으로 하는 메모리.
- 제2항에 있어서, 상기 이이피롬은 다수의 프로팅 게이트형의 메모리쎌들과, 선택된 복수개의 메모리 쎌들을 프로그램하기 위한 프로그램수단과, 상기 선택된 복수개의 메모리 쎌들이 성공적으로 프로그램되었는가를 판단하기 위한 프로그램 검증수단을 가지는 불휘발성 반도체 메모리 장치임을 특징으로 하는 반도체 메모리.
- 제2항에 있어서, 상기 고전압 발생회로는 프로그램시 고전압인 프로그램 전압을 발생하기위한 차아지펌프와, 선택된 메모리쎌들이 성공적으로 프로그램되지 아니하였을 때마다 상기 프로그램 전압이 소정 전압의 변위 내에서 순차 증가하도록 상기 프로그램 전압의 레벨을 검출하기 위한 레벨검출기와, 상기 검출된 레벨과 기준전압과를 비교하고 비교신호를 발생하기 위한 차동증폭기 구조의 비교부와, 상기 비교부로부터 비교신호 에 응답하여 상기 차아지 펌프를 활성화하기 위한 고전압 제어부로 이루어짐을 특징으로 하는 반도체 메모리.
- 제2항에 있어서, 상기 루프횟수 계수회로는 2진 카운터로 이루어진 4단의 트리밍 카운터 및 상기 카운터에 연결된 트리밍 디코더로 구성됨을 특징으로 하는 반도체 메모리.
- 제2항에 있어서, 상기 셋팅 수단은 퓨즈 및 어드레스를 수신하는 인버터를 가지는 제1블럭과, 내부신호 ø1chpgm룰 발생하는 제21블럭과, 카운팅 신호들 TRDpgm0-2을 생성하는 제3블럭으로 구성됨을 특징으로 하는 반도체 메모리.
- 프로그램전압이 발생되는 프로그램 동작과 프로그램 검증동작이 연속적으로 행해지는 불휘발성 반도체 메모리의 프로그램전압 발생방법에 있어서 프로그램 전압은 소정 전압의 범위내에서 순차적으로 증가한 후 일정레벨을 유지하되, 실제의 동작모우드시 설정된 모우드의 동작시간에 적합한 시작레벨이 고정적으로 셋팅되어 있게 한 것을 특징으로 하는 프로그램 전압 발생방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임
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---|---|
KR970051334A true KR970051334A (ko) | 1997-07-29 |
KR0185611B1 KR0185611B1 (ko) | 1999-04-15 |
Family
ID=19439029
Family Applications (1)
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Country Status (4)
Country | Link |
---|---|
US (1) | US5801989A (ko) |
JP (1) | JP3648003B2 (ko) |
KR (1) | KR0185611B1 (ko) |
TW (1) | TW391008B (ko) |
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