KR970024542A - 스펙트럼 확산통신을 위한 매치필터회로 - Google Patents

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KR970024542A
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코쿠료오 쥬
쪼오메이 슈우
마코토 야마모토
수나오 타카토리
마모루 사와하시
후미유키 아다찌
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수나오 타카토리
카부시키가이샤 요잔
오오보시 코오지
엔.티.티 이도오쯔우신모오 카부시키가이샤
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    • H03H17/00—Networks using digital techniques
    • H03H17/02—Frequency selective networks
    • H03H17/0248—Filters characterised by a particular frequency response or filtering method
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    • H04B—TRANSMISSION
    • H04B1/00—Details of transmission systems, not covered by a single one of groups H04B3/00 - H04B13/00; Details of transmission systems not characterised by the medium used for transmission
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Abstract

롱코오팅에 대하여, 소규모회로에서 대응할 수 있는 매치필터회로를 제공하는 것을 목적으로 한다.
승산을 위한 샘플, 홀드회로를 롱코오트의 일부의 개수만큼 설치하고, 이 개수에 동일한 PN부호를 유지할 수 있는 제1승수 레지스터로부터 병렬로 샘플홀드회로에 승산입력을 행하고, 이 PN부호에 계속하여 사용하는 PN부호가 있을 때에는, 그 PN부호를, 제1승산레지스터와 동일용량의 제2승수 레지스터에 격납하여, 소정의 타이밍으로 제2승수 레지스터의 PN부호를 제1승수 레지스터에 병렬전송하는 것이 다. 그리고, 제2승수 레지스터로의 PN부호입력은 시리알하게 행하여진다.

Description

스펙트럼 확산통신을 위한 매치필터회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
도 1은, 본 발명에 관한 매치필터회로의 일실시예를 표시하는 블록도,
도 2는, 동 실시예의 개개의 매치필터회로의 연산부분을 표시하는 블록도,
도 3은, 도 2에 있어서의 샘플홀드회로를 표시하는 회로도이다.

Claims (11)

  1. 입력전압에 접속된 스위치와, 이 스위치의 출력에 접속된 제1캐퍼시턴스와, 이 제1캐퍼시턴스의 출력에 접속된 기수단의 MOS인버터로 이루어진 제1반전증폭부와, 이 제1반전증폭부의 출력을 입력에 접속하는 제1귀환캐퍼시턴스와, 전기 제1반전증폭부의 출력 또는 기준전압을 택일적으로 출력하는 제1멀티플렉서 및 제2멀티플렉서를 구비한 샘플·홀드회로와, 각 샘플·홀드회로의 제1멀티플렉서의 출력이 접속된 복수의 제2캐퍼시턴스와, 이들 제2캐퍼시턴스의 출력이 통합되면서 접속된 기수단의 MOS인버터로 이루어지는 제2반전증폭부와, 이 제2반전증폭부의 출력을 입 력에 접속하는 제2귀환캐퍼시턴스를 보유하는 제1가산부와, 각 샘플·홀드회로의 제2멀티플렉서의 출력 및 제1가산부의 출력이 접속된 복수의 제3캐퍼시턴스와, 이들 제3캐퍼시턴스의 출력이 통합되면서 접속된 기수단의 MOS인버터로 이루어지는 제3반전증폭부와, 이 제3반전증폭부의 출력을 입력에 접속하는 제3귀환캐퍼시턴스를 보유하는 제2가산부와, 전기 제1가산부의 출력으로부터 제2가산부의 출력을 감하는 감산부와, 전기 샘플·홀드회로중 어느 것인가 1개에 있어서의 전기 스위치를 폐성함과 아울러, 다른 스위치를 개방하고, 또한 소정의 조합으로 각 샘플·홀드회로의 제1, 제2멀티플렉서를 변환하는 콘트로올회로를 구비한 스펙트럼 확산통신을 구비한 매치필터회로에 있어서, 전기 샘플·홀드회로의 개수에 동일한 PN부호를 유지하면서 그 PN부호를 병렬로 전기콘트로올회로에 입력하고, 또한 1회의 연산마다에 유지된 PN부호를 순환적으로 시프트하는 제1승수 레지스터와, 이 제1승수 레지스터의 각 데이터에리어에 병렬로 접속된 데이터에리어를 보유하고, 또한, PN부호를 시리얼입력할 수 있는 제2승수 레지스터를 구비하고, 제2승수 레지스터의 PN부호는 적시 제1승수 레지스터의 대응데이터에 리어에 전송되는 것을 특징으로 하는 매치필터회로.
  2. 제1항에 있어서, 제2승수 레지스터로부터 제1승수 레지스터로의 PN부호전송은, 매치필터의 1주기의 연산의 종료직후에 실행되는 것을 특징으로 하는 매치필터회로.
  3. 제2항에 있어서, 제2승수 레지스터로부터 제1승수 레지스터로의 전송신호를, 매치필터의 1주기의 종료직후에는 항상 생성해 두고, 전송을 행하지 않을 때는 이 전송신호를 마스크하고, 전송을 행할 때에만 이 마스크를 제거하는 것을 특징으로 하는 매치필터회로.
  4. 제1항에 있어서, 제2승수 레지스터의 PN부호의 시리얼 입력은 매치필터의 샘플링클록크에 동기하여 행하여지는 것을 특징으로 하는 매치필터회로.
  5. 제1항에 있어서, 샘플·홀드회로를 복수의 그룹으로 그룹분할하고, 각 그룹에 대하여, 제1멀티플렉서의 출력이 접속된 제4가산부를 설치하고, 제2멀티플렉서가 접속된 제5가산부를 설치하고, 전구릅의 제4가산부의 출력을 제2가산부에 입력하고, 전구릅의 제5가산부의 출력을 제1가산부에 입력하고 있으며, 제4가산부는 각샘플·홀드 회로에 제1멀티플렉서의 출력이 접속된 복수의 제4캐퍼시턴스와, 이들 제4캐퍼시턴스의 출력이 통합되면서 접속된 기수단의 MOS인버터로 이루어지는 제4반전증폭부와, 이 제4반전증폭부의 출력을 입력에 접속하는 제4귀환 캐퍼시턴스를 보유하고, 제5가산부는, 각 샘플·홀드회로의 제2멀티플렉서의 출력 및 제1가산부의 출력이 접속된 복수의 제5캐퍼시턴스와, 이들 제5캐퍼시턴스의 출력이 통합되면서 접속되는 기수단의 MOS인버터로 이루어지는 제5반전 증폭부와, 이 제5반전 증폭부의 출력을 접속하는 제5귀환 캐퍼시턴스가 매치필터회로에 설치된 것을 특징으로 하는 매치필터회로.
  6. 제1항에 있어서, 기수단의 MOS인버터로 이루어지는 제6반전 증폭부의 출력 을 입력에 접속하는 제6귀환 캐퍼시턴스를 구비한 기준전압 생성회로에 의하여 기준전압이 생성되어 있는 것을 특징으로 하는 매치필터회로.
  7. 제4항 또는 제6항에 있어서, 반전증폭부는 출력과 그랜드와의 사이에는 접지캐퍼시턴스가 접속되고, 최종단의 MOS인버터로부터 전단에서 MOS인버터의 출력을 1쌍의 평형레지스턴스에 의하여 전원 및 그랜드에 접속하고 있는 것을 특징으로 하는 매치필터회로.
  8. 제6항에 있어서, 기준전압은 MOS인버터의 전원전압의 1/2로 되도록 MOS인버터의 한계치가 설정되어 있는 것을 특징으로 하는 매치필터회로.
  9. 제1항에 있어서, 각 샘플·홀드회로에 대한 콘트로올회로의 설정은, 모든 샘플 ·홀드회로를 순환하도록 변환되는 것을 특징으로 하는 매치필터회로.
  10. 제1항에 있어서, 제1멀티플렉서는 제1반전 증폭부의 출력 또는 기준전압을 택일적으로 출력하고, 제2멀티플렉서는 제1멀티플렉서와는 반대의 선택으로 제1반전 증폭부출력 또는 기준전압을 출력하도록 되어 있는 매치필터회로.
  11. 제4항에 있어서, 제1멀티플렉서 및 제2멀티플렉서는, 모두 한쪽이 제1반전증폭부출력을 출력하고, 혹은 양자가 기준전압을 출력하도록 되어 있는 매치 필터회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019960046580A 1995-10-20 1996-10-17 스펙트럼 확산통신을 위한 매치필터회로 KR970024542A (ko)

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