KR960026812A - 반도체소자의 캐패시터 제조방법 - Google Patents

반도체소자의 캐패시터 제조방법 Download PDF

Info

Publication number
KR960026812A
KR960026812A KR1019940035139A KR19940035139A KR960026812A KR 960026812 A KR960026812 A KR 960026812A KR 1019940035139 A KR1019940035139 A KR 1019940035139A KR 19940035139 A KR19940035139 A KR 19940035139A KR 960026812 A KR960026812 A KR 960026812A
Authority
KR
South Korea
Prior art keywords
conductive layer
forming
layer
film
semiconductor device
Prior art date
Application number
KR1019940035139A
Other languages
English (en)
Other versions
KR0166030B1 (ko
Inventor
유의규
Original Assignee
김주용
현대전자산업 주식회사
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 김주용, 현대전자산업 주식회사 filed Critical 김주용
Priority to KR1019940035139A priority Critical patent/KR0166030B1/ko
Publication of KR960026812A publication Critical patent/KR960026812A/ko
Application granted granted Critical
Publication of KR0166030B1 publication Critical patent/KR0166030B1/ko

Links

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L28/00Passive two-terminal components without a potential-jump or surface barrier for integrated circuits; Details thereof; Multistep manufacturing processes therefor
    • H01L28/40Capacitors
    • H01L28/60Electrodes
    • H01L28/82Electrodes with an enlarged surface, e.g. formed by texturisation
    • H01L28/90Electrodes with an enlarged surface, e.g. formed by texturisation having vertical extensions
    • H01L28/91Electrodes with an enlarged surface, e.g. formed by texturisation having vertical extensions made by depositing layers, e.g. by depositing alternating conductive and insulating layers
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L28/00Passive two-terminal components without a potential-jump or surface barrier for integrated circuits; Details thereof; Multistep manufacturing processes therefor
    • H01L28/40Capacitors
    • H01L28/60Electrodes
    • H01L28/75Electrodes comprising two or more layers, e.g. comprising a barrier layer and a metal layer

Landscapes

  • Engineering & Computer Science (AREA)
  • Power Engineering (AREA)
  • Computer Hardware Design (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Semiconductor Integrated Circuits (AREA)

Abstract

본 발명은 반도체소자의 캐패시터 제조방법에 관한 것으로, 하부절연층이 형성된 반도체기판 상부에 제1도전층과 감광막패턴을 순차적으로 형성하고 상기 감광막패턴 측벽에 절연막 스페이서를 형성한 다음, 이를 이용하여 콘택홀을 형성하고 상기 감광막패턴을 제거한 다음, 전체표면상부에 제2도전층을 형성하고 상기 제2도전층의 상측 일부만 돌출되도록 회생막을 형성한 다음, 노출된 만큼의 제2도전층을 식각하고, 상기 절연막 스페이서 및 회생막 제거공정과 저장전극마스크를 이용한 식각공정을 실시하여 표면적이 증가된 저장전극을 형성함으로써 후공정에서반도체소자의 고집적화에 충분한 정전용량을 확보할 수 있어 반도체소자의 고집적화를 가능하게 하고 이에 따른 반도체소자의 신뢰성을 향상시키는 기술이다.

Description

반도체소자의 캐패시터 제조방법
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2A도 내지 제2D도는 본 발명의 실시예에 따른 반도체소자의 캐패시터 제조공정을 도시한 단면도.

Claims (10)

  1. 반도체기판 상부에 하부절연층을 형성하는 공정과, 상기 하부절연층 상부에 제1도전층을 형성하는 공정과, 상기 제1도전층 상부에 제1감광막패턴을 형성하는 공정과, 상기 제1감광막패턴 측벽에 절연막 스페이서를 형성하는 공정과, 상기 절연막 스페이서를 이용한 식각공정으로 콘택홀을 형성하는 공정과, 상기 제1감광막패턴을 제거하는 공정과, 상기 반도체기판의 예정된 부분에 접속되는 제2도전층을 일정두께 형성하는 공정과, 상기 제2도전층 상측 일부분만이 노출되도록 회생막을 형성하는 공정과, 상기 노출된 제2도전층만을 식각하는 공정과, 상기 절연막 스페이서와 회생막을 제거함으로써 표면적이 증가된 저장전극을 형성하는 공정을 포함하는 반도체소자의 캐패시터 제조방법.
  2. 제 1항에 있어서, 상기 절연막 스페이서는 산화막으로 형성되는 것을 특징으로 하는 반도체소자의 캐패시터 제조방법.
  3. 제 1항에 있어서, 상기 제1,2도전층은 다결정실리콘막으로 사용되는 것을 특징으로 하는 반도체소자의 캐패시터 제조방법.
  4. 제 1항에 있어서, 상기 콘택홀의 크기는 상기 절연막 스페이서의 두께로 조절되는 것을 특징으로 하는 반도체소자의 캐패시터 제조방법.
  5. 제 1항에 있어서, 상기 희생막은 전체표면상부에 두껍게 형성하여 최상부에 형성된 제2도전층을 도포하고 상기 제2도전층 상측 일부만이 노출되도록 전면식각을 실시하여 형성된 것을 특징으로 하는 반도체소자의 캐패시터 제조방법.
  6. 제1항 또는 제5항에 있어서, 상기 희생막은 절연막으로 형성되는 것을 특징으로 하는 반도체소자의 캐패시터 제조방법.
  7. 제6항에 있어서, 상기 절연막은 SOG, CVD 산화막 또는 폴리이미드로 형성되는 것을 특징으로 하는 반도체소자의 캐패시터 제조방법.
  8. 제5항에 있어서, 상기 전면식각은 상기 절연막 스페이서 및 회생막과의 식각선택비 차이를 이용하여 실시하는 것을 특징으로 하는 반도체소자의 캐패시터 제조방법
  9. 제1항에 있어서, 상기 제2감광막패턴은 저장전극마스크를 이용하여 형성하는 것을 특징으로 하는 반도체소자의 캐패시터 제조방법.
  10. 제1항에 있어서, 상기 절연막과 회생막은 상기 제1도전층 및 제2도전층과의 식각선택비 차이를 이용하여 제거되는 것을 특징으로 하는 반도체소자의 캐패시터 제조방법.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019940035139A 1994-12-19 1994-12-19 반도체 소자의 캐패시터 제조방법 KR0166030B1 (ko)

Priority Applications (1)

Application Number Priority Date Filing Date Title
KR1019940035139A KR0166030B1 (ko) 1994-12-19 1994-12-19 반도체 소자의 캐패시터 제조방법

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
KR1019940035139A KR0166030B1 (ko) 1994-12-19 1994-12-19 반도체 소자의 캐패시터 제조방법

Publications (2)

Publication Number Publication Date
KR960026812A true KR960026812A (ko) 1996-07-22
KR0166030B1 KR0166030B1 (ko) 1998-12-15

Family

ID=19402265

Family Applications (1)

Application Number Title Priority Date Filing Date
KR1019940035139A KR0166030B1 (ko) 1994-12-19 1994-12-19 반도체 소자의 캐패시터 제조방법

Country Status (1)

Country Link
KR (1) KR0166030B1 (ko)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100297411B1 (ko) * 1997-12-24 2001-10-24 류정열 작업자보호를위한안전기능을구비한패턴접착기

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100297411B1 (ko) * 1997-12-24 2001-10-24 류정열 작업자보호를위한안전기능을구비한패턴접착기

Also Published As

Publication number Publication date
KR0166030B1 (ko) 1998-12-15

Similar Documents

Publication Publication Date Title
KR960008417A (ko) 반도체소자의 캐패시터 제조방법
KR960006030A (ko) 반도체소자의 캐패시터 제조방법
KR960026812A (ko) 반도체소자의 캐패시터 제조방법
KR960026870A (ko) 반도체소자의 캐패시터 제조방법
KR960026819A (ko) 반도체소자의 저장전극 제조방법
KR960026835A (ko) 반도체소자의 캐패시터 제조방법
KR960026813A (ko) 반도체소자의 캐패시터 제조방법
KR960026818A (ko) 반도체소자의 캐패시터 제조방법
KR960026856A (ko) 반도체소자의 캐패시터 제조방법
KR960026793A (ko) 반도체소자의 캐패시터 제조방법
KR960026800A (ko) 반도체소자의 저장전극 제조방법
KR970054122A (ko) 반도체소자의 저장전극 형성방법
KR970052320A (ko) 반도체 소자의 전하저장전극 형성방법
KR960026815A (ko) 반도체소자의 캐패시터 제조방법
KR970024133A (ko) 반도체 소자의 저장전극 형성방법
KR960026864A (ko) 반도체소자의 캐패시터 제조방법
KR970018496A (ko) 반도체 소자의 저장전극 형성방법
KR960026647A (ko) 반도체소자의 캐패시터 제조방법
KR960026790A (ko) 반도체소자의 캐패시터 제조방법
KR960006001A (ko) 반도체소자의 캐패시터 제조방법
KR960026791A (ko) 반도체소자의 캐패시터 제조방법
KR980005476A (ko) 반도체 소자의 저장전극 형성방법
KR960026855A (ko) 반도체소자의 캐패시터 제조방법
KR960026852A (ko) 반도체소자의 캐패시터 제조방법
KR960026849A (ko) 반도체소자의 캐패시터 제조방법

Legal Events

Date Code Title Description
A201 Request for examination
E902 Notification of reason for refusal
E701 Decision to grant or registration of patent right
GRNT Written decision to grant
FPAY Annual fee payment

Payment date: 20050822

Year of fee payment: 8

LAPS Lapse due to unpaid annual fee