KR960015208A - 기억 제어 시스템 및 그 제어 방법 - Google Patents
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Abstract
표시 메모리(10)에 있어서, 표시 데이타 기억 영역 지정 레지스터(11)는 표시 데이타 기억 영역을 지정하고, 마스크 비트폭 지정 레지스터(12)는 기입 마스크 비트폭을 지정한다. 이들 데이타에 따라서, 마스크 제어 신호 발생기(13)는 외부 어드레스 데이타에 대응하는 마스크 제어 신호를 기입 제어 유니트(14)에 공급한다. 상기 기입 제어 유니트(14)는 표시 메모리(10)에 외부 기입 데이타의 유효 비트만을 기입한다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따른 제1실시예의 기억 제어 시스템을 도시하는 블록선도,
제2도는 본 발명의 제2실시예에 따른 데이타 기억 시스템의 블록선도,
제3도는 종래의 기술과 본 발명에 따른 표시 메모리의 맵도.
Claims (7)
- 메모리 소자가 배열된 메모리와, 상기 메모리를 소정의 비트폭 단위로 액세스하는 메모리 액세스 유니트를 가진 기억 제어 시스템에 있어서, 상기 메모리내에 기억 내용의 재기입을 필요로 하지 않는 영역을 저장하도록 데이타를 유지하는 수단과, 메모리 어드레스와 상기 데이타를 비교하는 수단과, 상기 비교 수단의 비교 결과로서 비교 어드레스에 의해 지정된 비트폭내에 기억 내장의 변경을 요구하지 않는 영역이 포함되는 경우, 기억된 내용의 재기입을 요구하지 않는 영역에 대응하는 메모리 소자에 데이타 기입을 금지하는 수단을 포함하는 것을 특징으로 하는 기억 제어 시스템.
- 제1항에 있어서, 상기 기억 내용의 재기입을 요구하지 않는 상기 영역의 최종 어드레스와 상기 영역의 폭을 나타내는 데이타는 상기 영역을 저장하는 데이타로서 사용되는 것을 특징으로 하는 기억 제어 시스템.
- 제1항에 있어서, 상기 기억 내용의 변경을 필요로 하지 않는 영역을 지정하는 데이타로서, 상기 메모리의 행 방향에 관한 제1데이타와 상기 메모리의 열방향에 관한 제2데이타가 사용되는 것을 특징으로 하는 기억 제어 시스템.
- 다수의 비트 경계에 의해 분할된 메모리와, 인접한 비트 경계간의 비트수를 단위로서 상기 메모리를 액세스하는 수단과, 상기 메모리의 특정 영역에 대하여 데이타의 변경을 금지시키는 금지 수단을 포함하며, 상기 금지 수단은 상기 특정 영역의 적어도 1변을 규정하는 제1데이타와 상기 특정 영역의 폭을 규정하는 제2데이타를 기초하여 기입 금지 어드레스를 지정하는 것을 특징으로 하는 기억 제어 시스템.
- 다수의 비트 경계에 의해 분할된 메모리에 대하여 데이타의 판독 및 기입을 제어하는 기억 제어 방법에 있어서, 기입 금지 영역을 지정하는 제1단계와, 상기 금지 영역내에 어떤 비트 경계가 존재하는지의 여부를 판정하는 제2단계와, 상기 판정의 결과로서, 상기 비트 경계가 존재하지 않는 경우 상기 메모리내의 모든 데이타의 기입을 허가하고, 상기 비트 경계가 존재하는 경우에 상기 금지 영역에 대응하는 비트폭을 상기 비트 경계에 기초하여 계산함으로써 기입 금지 영역내의 데이타의 변경을 금지시키는 제3단계를 포함하는 것을 특징으로 하는 기억 제어 방법.
- 외부적으로 공급되는 어드레스에 응답하여 데이타가 기입되고 판독되는 기입 허가 영역 및 기입 금지 영역을 가진 표시 메모리와, 표시 비트폭 지정 데이타에 응답하여 표시 메모리내에 기억된 표시 데이타의 X방향 표시 비트폭을 지정하는 표시 데이타 기억 영역 지정 레지스터와, 마스크될 데이타, 즉, 마스크 비트폭 지정 데이타에 응답하여 표시 데이타 기억 영역 지정 레지스터에 의해 지정된 표시 비트폭중에 재기입되지 않는 데이타의 마스크 비트폭을 지정하기 위한 마스크 비트폭 지정 레지스터와, 상기 표시 메모리내의 기입 금지 영역의 반대 종단을 결정하여, 4개의 상이한 상태의 번지, 즉, 모든 비트가 기입 허가 영역에 있는 번지, 소정의 상위 비트가 기입 허가 영역에 있고 소정의 하위 비트가 기입 금지 영역에 있는 번지, 모든 비트가 기입 금지 영역에 있는 번지, 및 소정의 상위 비트가 기입 금지 영역에 있고 소정의 하위 비트가 기입 허가 영역에 있는 번지를 정의하고, 공급된 번지 데이타에 대응하는 상기 4개의 데이타 마스크 상태중 어느 한쪽의 번지를 결정하고, 상기 번지에 대응하는 비트 단위에 대하여 기입 허가 신호 및 기입 금지 신호를 발생하는 기입 판정/지시 신호 발생기와, 상기 표시 메모리의 기입 데이타의 유효 비트만을 상기 기입 판정/지시 신호 발생기로부터 공급된 비트 단위에 대하여 기입 허가 신호 및 기입 금지 신호에 따라서 기입하는 기입 제어 유니트를 포함하며, 상기 표시 데이타 기억 영역 지정 레지스터 및 마스크 비트폭 지정 레지스터는 X방향 비트폭을 표시 메모리의 맵상에 지정하는 것을 특징으로 하는 기억 제어 시스템.
- 외부적으로 공급되는 어드레스에 응답하여 데이타가 기입되고 판독되는 기입 허가 영역 및 기입 금지 영역을 가진 표시 메모리와, 표시 비트폭 지정 데이타에 응답하여 표시 메모리내에 기억된 표시 데이타의 X 및 Y방향 표시 비트폭을 지정하는 2개의 표시 데이타 기억 영역 지정 레지스터와, 마스크될 데이타, 폭, 마스크 비트폭 지정 데이타에 응답하여 표시 데이타 기억 영역 지정 레지스터에 의해 지정된 표시 비트폭 중에 재기입되지 않는 데이타의 마스크 비트폭을 지정하기 위한 마스크 비트폭 지정 레지스터와, 상기 표시 메모리내의 기입 금지 영역의 반대 종단을 결정하여, 4개의 상이한 상태의 번지, 즉, 모든 비트가 기입 허가 영역에 있는 번지, 소정의 상위 비트가 기입 허가 영역에 있고 소정의 하위 비트가 기입 금지 영역에 있는 번지, 또는 비트가 기입 금지 영역에 있는 번지, 및 소정의 상위 비트가 기입 금지 영역에 있고 소정의 하위 비트가 기입 허가 영역에 있는 번지를 정의하고, 공급된 번지 데이타에 대응하는 상기 4개의 데이타 마스크 상태중 어느 한쪽의 번지를 결정하고, 상기 번지에 대응하는 비트 단위에 대하여 기입 허가 신호 및 기입 금지 신호를 발생하는 기입 판정/지시 신호 발생기와, 상기 표시 메모리의 기입 데이타의 유효 비트만을 상기 기입 판정/지시 신호 발생기로부터 공급된 비트 단위에 대하여 기입 허가 신호 및 기입 금지 신호에 따라서 기입하는 기입 제어 유니트를 포함하며, 상기 표시 데이타 기억 영역 지정 레지스터 및 마스크 비트폭지정 레지스터는 X 및 Y방향 비트폭을 표시 메모리의 맵상에 지정하는 것을 특징으로 하는 기억 제어 시스템.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP6253852A JP2729151B2 (ja) | 1994-10-19 | 1994-10-19 | 記憶制御装置 |
JP94-253852 | 1994-10-19 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR960015208A true KR960015208A (ko) | 1996-05-22 |
KR100225726B1 KR100225726B1 (ko) | 1999-10-15 |
Family
ID=17257037
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019950036814A KR100225726B1 (ko) | 1994-10-19 | 1995-10-19 | 기억 제어 시스템 및 그 제어 방법(Storage control system) |
Country Status (6)
Country | Link |
---|---|
US (1) | US5777632A (ko) |
EP (1) | EP0708429B1 (ko) |
JP (1) | JP2729151B2 (ko) |
KR (1) | KR100225726B1 (ko) |
CN (1) | CN1084895C (ko) |
DE (1) | DE69533499D1 (ko) |
Families Citing this family (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
USRE38997E1 (en) * | 1995-02-03 | 2006-02-28 | Kabushiki Kaisha Toshiba | Information storage and information processing system utilizing state-designating member provided on supporting card surface which produces write-permitting or write-inhibiting signal |
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JP6396373B2 (ja) * | 2016-07-26 | 2018-09-26 | ファナック株式会社 | フィルタ回路、フィルタ回路を備えた通信回路及びフィルタ回路を備えた数値制御装置 |
Family Cites Families (17)
Publication number | Priority date | Publication date | Assignee | Title |
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JPS60147785A (ja) * | 1984-01-12 | 1985-08-03 | 株式会社アスキ− | 論理領域間デ−タ移動制御装置 |
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-
1994
- 1994-10-19 JP JP6253852A patent/JP2729151B2/ja not_active Expired - Lifetime
-
1995
- 1995-10-17 EP EP95116374A patent/EP0708429B1/en not_active Expired - Lifetime
- 1995-10-17 DE DE69533499T patent/DE69533499D1/de not_active Expired - Fee Related
- 1995-10-19 US US08/545,405 patent/US5777632A/en not_active Expired - Lifetime
- 1995-10-19 CN CN95119937A patent/CN1084895C/zh not_active Expired - Fee Related
- 1995-10-19 KR KR1019950036814A patent/KR100225726B1/ko not_active IP Right Cessation
Also Published As
Publication number | Publication date |
---|---|
US5777632A (en) | 1998-07-07 |
CN1151048A (zh) | 1997-06-04 |
EP0708429B1 (en) | 2004-09-15 |
KR100225726B1 (ko) | 1999-10-15 |
EP0708429A1 (en) | 1996-04-24 |
DE69533499D1 (de) | 2004-10-21 |
CN1084895C (zh) | 2002-05-15 |
JPH08115256A (ja) | 1996-05-07 |
JP2729151B2 (ja) | 1998-03-18 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A201 | Request for examination | ||
E902 | Notification of reason for refusal | ||
E701 | Decision to grant or registration of patent right | ||
GRNT | Written decision to grant | ||
FPAY | Annual fee payment |
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