KR930018377A - 캐시메모리 시스템 - Google Patents
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Abstract
본 발명은, 캐시메모리의 태그(TAG) 지정 히트신호의 독출을 고속화 할 수 있도록 하기 위한 것이다.
본 발명은, 캐시메모리의 태그(TAG)의 메모리내에 유지되는 전원전압 보다도 작은 제1진폭으로 독출되는 제1데이터와, 상기 캐시메모리의 외부로부터 입력되는 데이터의 비교를 각각 수행하는 비교수단과; 이들 비교수단에서의 데이터 비교결과에 대해 OR 논리를 취하여 전원전압 보다 작은 제2진폭의 논리출력을 얻는 히트(Hit) 검출회로를 구비하여 구성된 것을 특징으로 한다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 1실시예에 따른 구성도, 제2도는 동 실시예에 따른 구체예를 나타낸 회로도.
Claims (4)
- 캐시메모리의 태그(TAG)의 메모리(1)내에 유지되는 전원전압 보다도 작은 제1진폭으로 독출되는 제1태그와, 상기 캐시메모리의 외부로부터 입력되는 데이터의 비교를 각각 수행하는 비교기(31)와; 이 비교기(31)로 부터 출력되는 제2진폭의 출력신호를 레벨 시프트시키는 에미터파로워(31'); 이 에미터파로워(31')의 출력이 베이스에 입력되면서 콜렉터가 제1전원에 접속된 제1바이폴라 트랜지스터(32,33)를 각 비트에 구비하고, 상기 제1바이폴라 트랜지스터(32,33)의 에미터 단자가 접속되는 에미터 도트라인 및; 콜렉터가 부하(39)를 통해 제1전원에 접속됨과 더불어 베이스에 기준전압이 입력되면서 에미터가 상기 에미터 도트라인에 접속된 제2바이폴라 트랜지스터(34)의 콜렉터로부터 히트신호를 얻는 히트검출회로(14b)를 구비하여 구성된 것을 특징으로 하는 캐시메모리 시스템.
- 제1항에 있어서, 상기 태그의 메모리(1)내에 유지되는 제1진폭으로 독출되는 제2데이터를 제3진폭신호로 변환시키는 독출회로(15)와, 이 독출회로(15)의 출력과 상기 히트검출회로(14b)의 출력의 논리를취하는 히트논리회로(4)를 구비하여 구성된 것을 특징으로 하는 캐시메모리 시스템.
- 제2항에 있어서, 적어도 상기 히트검출회로(14b)와 히트논리신호(4)가 ECL(에미터 커플드로직) 게이트인 것을 특징으로 하는 캐시메모리 시스템.
- 제2항에 있어서, 상기 히트검출회로(14b)와 히트논리회로(4)가 MOS 트랜지스터로 구성된 것을 특징으로 하는 캐시메모리 시스템.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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