KR910019217A - 근접 배치 접점을 갖는 bicmos 디바이스 및 그 제조 방법 - Google Patents
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제 1 도는 본 발명의 하나의 실시예에 따른 BICMOS구조의 단면도.
Claims (18)
- 기판상에 트랜지스터 디바이스를 형성하는 방법에 있어서, 상기 기판에 적어도 제 1 활성영역을 형성하는 단계와, 상기 기판의 표면에 제 1 도전형 제 1 폴리실리콘층을 형성하는 단계와, 제 1 폴리실리콘 영역은 상면과 제1 및 제2측벽 표면을 갖는데, 상기 제 1 폴리실리콘층의 패턴을 형성하기 위해 상기 제 1 폴리실리콘층의 선택된 부분을 제거하고, 상기 활성영역 위에 구역내에 제 1 폴리실리콘층의 적어도 제 2 영역을 도핑하는 단계와, 상기 제 1 및 제 2 측벽 표면상에 제 1 및 제 2 산화물 스페이서를 형성하는 단계와, 상기 제 1 및 제 2 스페이서에 의해 상기 제 1 폴리실리콘 영역으로부터 이격되고, 상면을 갖는 제 2 폴리실리콘층을 형성하는 단계를 포함하는 것을 특징으로 하는 방법.
- 제 1 항에 있어서, 상기 제 1 폴리실리콘 영역의 상기 상면의 적어도 일부와 상기 제 2 폴리실리콘층의 상면의 적어도 일부상에 고융점 금속을 포함하는 코팅을 형성하는 단계와, 상기 제 1 폴리실리콘 영역의 상면의 적어도 일부와, 상기 제 1 및 제2 스페이서까지 확장되는 상기 제2 실리사이드의 층을 발생시키기 위해 상기 금속을 인접 폴리실리콘과 반응시키는 단계를 추가로 포함하는 것을 특징으로 하는 방법.
- 제 1 항에 있어서, 상기 제 1 폴리실리콘 영역의 아래를 제 2 도전형 도팬트(dopant)로 도핑하고, 상기 제 1 폴리실리콘 영역에 인접한 상기 기판의 한 구역을 바이폴라 트랜지스터의 베이스부로 형성시키기 위해서 상기 기판을 어닐링(annealing)하는 단계를 추가로 포함하는 것을 특징으로 하는 방법.
- 제 1 항에 있어서, 상기 제 1 폴리실리콘 영역을 전계 효과 트랜지스터의 게이트를 형성시키기 위해서 상기 제 1 폴리실리콘 영역을 도핑하는 단계를 추가로 포함하는 것을 특징으로 하는 방법.
- 제 1 항에 있어서, 전계 효과 트랜지스터의 소스 및 드레인 영역을 형성하기 위하여 상기 제 1 폴리실리콘 영역에 인접한 영역의 상기 기판을 도핑하는 단계를 추가로 포함하는 것을 특징으로 하는 방법.
- 제 1 항에 있어서, 상기 제 1 폴리실리콘 영역을 형성하는 단계를 폴리실리콘을 형성하는 단계와 상기 폴리실리콘층의 선택된 부분에 도핑 재료를 주입하는 단계와, 상기 폴리실리콘층을 어닐링하는 단계를 포함하는 것을 특징으로 하는 방법.
- 제 1 항에 있어서, 상기 제 1 및 제 2 산화물 스페이서를 형성하는 단계는 스페이서 산화물을 상기 기판의 전체 표면과 상기 제 1 폴리실리콘 영역위에 데포지트 시키는(depositiong)단계와, 상기 산화물의 선택된 부분을 제거하고 상기 제 1 폴리실리콘 영역의 상기 제 1 및 제 2 측벽 부근에 산화물 층을 남기도록 상기 산화물을 에칭(etching)하는 단계를 포함하는 것을 특징으로 하는 방법.
- 제 1 항에 있어서, 상기 제 2 폴리실리콘을 형성하는 단계는 폴리실리콘층을 상기 기판의 거의 전체 표면과 상기 제 1 폴리실리콘 영역 위에 대포지트시키는 단계와, 평탄화층을 데포지트 시키는 단계와, 상기 제 1 및 제 2 스페이서까지 확장되는 상기 제 2 폴리실리콘층을 제공하기 위하여 상기 데포지트 폴리실리콘층의 상면을 에칭하는 단계를 포함하는 것을 특징으로 하는 방법.
- 제 1 항에 있어서, 상기 제 2 폴리실리콘의 선택된 부분에 도핑재료를 주입하는 단계와 상기 주입 폴리실리콘을 어닐링하는 단계를 추가로 포함하는 것을 특징으로 하는 방법.
- 제 1 항에 있어서, 상기 코팅 단계전에 원하는 패턴을 제공하기 위해 상기 제 2 폴리실리콘층의 선택된 부분을 제거하기 위하여 상기 제 2 폴리실리콘층을 마스킹(masking)하고 에칭하는 단계를 추가로 포함하는 것을 특징으로 하는 방법.
- 제 2 항에 있어서, 상기 교융점 금속의 반응되지 않은 부분을 제거하는 단계를 추가로 포함하는 것을 특징으로 하는 방법.
- 제 1 항에 있어서, 상기 제 1 폴리실리콘 영역의 적어도 몇 부분에 질화물(nitride)의 층을 형성하는 단계를 추가로 포함하는 것을 특징으로 하는 방법.
- 제 1 항에 있어서, 상기 기판은 에피텍셜층(epitaxial)을 포함하는 것을 특징으로 하는 방법.
- 트랜지스터를 형성하는 방법에 있어서, 실리콘 기판을 제공하는 단계와, 상기 기판내에 적어도 제1 매몰 도핑층을 형성하는 단계와, 상기 기판의 표면상에 제 1 폴리실리콘층을 형성하는 단계와, 제 1 폴리실리콘 영역은 상면과 제 1 및 제 2 측벽 표면을 갖는데, 상기 제 1 매몰층 위의 구역내의 상기 기판상에 제 1 폴리실리콘 영역을 제공하도록 상기 제 1 폴리실리콘층의 패턴을 형성하기 위해 상기 제 1 폴리실리콘층의 선택된 부분을 제거하는 단계와, 상기 제 1 폴리실리콘 영역을 도핑하는 단계와, 상기 기판을 어닐링하는 단계와, 스페이서 산화물을 상기 기판의 거의 전체 표면과 상기 제 1 폴리실리콘 영역 위에 데포지트 시키는 단계와, 상기 산화물의 선택된 부분을 제거하고 상기 제1 폴리실리콘 영역의 상기 제 1 및 제 2 측벽 부근에 산화물 층을 남기도록 상기 산화물을 드라이-에칭하는 단계와, 제 2 폴리실리콘층을 상기 기판의 거의 전체 표면과 상기 제 1 폴리실리콘영역 위에 바이폴라시키는 단계와, 평탄화층을 데포지트시키는 단계와, 상기 데포지트 폴리실리콘과 상기 평탄화층의 상면을 드라이-에칭하는 단계와, 상기 제 2 폴리실리콘층은 상기 제 1 및 제 2 스페이서에 의해서만 상기 제 1 폴리실리콘 영역으로 부터 분리되는데, 상기 제 1 및 제 2 스페이서까지 확정되는 상기 제 2 폴리실리콘층을 제공하기 위하여 상기 데포지트 폴리실리콘층의 상면을 습식-에칭하는 단계와, 원하는 패턴을 제공하기 위해 상기 제 2 폴리실리콘층의 선택된 부분을 제거하도록 상기 제2 폴리실리콘층을 마스킹하고 에칭하는 단계와, 상기 제 2 폴리실리콘층을 마스킹하고 에칭하는 단계와, 상기 제1 폴리실리콘 영역의 상면과 상기 폴리실리콘층의 상면의 적어도 일부분에 고융점 금속을 포함하는 코팅을 형성하는 단계와, 상기 제 1 폴리실리콘 영역위 상부의 적어도 일부분과 상기 제 2 폴리실리콘층의 적어도 일부분을 덮고 상기 제 1 및 제 2 스페이서까지 확장되는 실라사이드의 층을 형성하기 위해 상기 금속을 인접 폴리실리콘과 반응시키는 단계와, 상기 고융점 금속의 반응되지 않은 부분을 제거하는 단계를 포함하는 것을 특징으로 하는 방법.
- 실리콘 기판과, 상기 실리콘 기판내에 형성된 도핑 메몰층과, 상면과 제 1 및 제 2 측벽을 가지며, 상기 메몰층의 적어도 일부위에 놓이는 상기 기판의 표면상에 형성된 제1도핑 폴리실리콘 영역과, 상기 제 1도핑 폴리실리콘 영역 바로 아래의 상기 기판내에 위치된 도핑 게이트 영역과, 상기 제 1 폴리실리콘 영역의 상기 제1 및 제2 측벽에 인접하여 형성된 제1 및 제2 측벽 스페이서와, 상기 기판의 표면상에 형성되고, 상면을 가지며, 상기 제1 및 제 2 스페이서까지 확장되는 제 2 폴리실리콘층과, 상기 제 1 폴리실리콘 영역의 상면의 적어도 일부와 상기 제 2 폴리실리콘층의 상면의 적어도 일부에 형성되고, 상기 제 2 폴리실리콘층상에 놓이며, 상기 제 1 및 제 2 스페이서까지 확장되는 금속 실리사이드를 포함하는 것을 특징으로 하는 바이폴라 트랜지스터.
- 제 15항에 있어서, 상기 기판은 에피택셜층을 포함하는 것을 특징으로 하는 바이폴라 트랜지스터.
- 제 15항에 있어서, 상기 제 1 폴리실리콘 영역을 전계 효과 트랜지스터의 게이트를 형성시키기 위해 상기 기판의 일부분과 상기 제 1 폴리실리콘 영역이 도핑되는 것을 특징으로 하는 바이폴라 트랜지스터.
- 제 15항에 있어서, 상기 제 1 폴리실리콘 영역 부근의 상기 기판의 일부가 바이폴라 트랜지스터의 베이스부로 형성되도록 상기 기판의 선택된 부분이 도핑되는 것을 특징으로 하는 바이폴라 트랜지스터.※ 참고사항 : 최초출원내용에 의하여 공개하는 것임.
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