KR910013264A - 반도체 메모리 어레이의 워드라인 구조 - Google Patents
반도체 메모리 어레이의 워드라인 구조 Download PDFInfo
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Abstract
내용 없음.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제4도는 본 발명에 따른 금속과 폴리실리콘층의 배치도.
Claims (7)
- 다수의 워드라인들을 구비하는 반도체 메모리 어레이에 있어서, 상기 각 워드라인이 어드레스신호가 전송되고 평행하게 배열된 제1라인(또는 제1층)과, 상기 제1라인(또는 제1층)의 상부에 접촉하고 최소한 4개 이상씩 한조를 구성하여 각조에서 서로 인접하지 않도록 꼬여있는 제2라인(또는 제2층)과, 상기 제1라인(또는 제1층)과 상기 제2라인(또는 제2층)을 접속시키는 제3층으로 구성됨을 특징으로 하는 반도체 메모리 어레이.
- 제1항에 있어서, 상기 제1라인(또는 제1층)이 반도체 메모리용 트랜지스터의 게이트 물질임을 특징으로 하는 반도체 메모리 어레이.
- 제1항에 있어서, 상기 제2라인(또는 제2층)이 상기 제1라인(또는 제1층) 보다 저저항성의 물질로 이루어져 있음을 특징으로 하는 반도체 메모리 어레이.
- 제1항에 있어서, 상기 제2라인(또는 제2층)이 꼬인후에도 최초에 접속된 제1라인(또는 제1층)과 접속됨을 특징으로 하는 반도체 메모리 어레이.
- 제1항에서 상기 제3라인(또는 제3층)이 저저항성 물질로 구성되어 있음을 특징으로 하는 반도체 메모리 어레이.
- 소정의 신호를 전송하는 다수의 신호선로들과, 상기 신호선로들을 선택하는 금속성단자들을 구비한 반도체 메모리 장치에 있어서, 상기 금속성 단자들이 상기 해당하는 신호선로들과는 서로 이격되어 접속되어 있음을 특징으로 하는 반도체 메모리 장치.
- 제6항에서 상기 금속성단자들 및 해당 신호선로들이 각각 저저항성의 물질에 의해 연결됨을 특징으로 하는 반도체 메모리 어레이.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019890020105A KR930001739B1 (ko) | 1989-12-29 | 1989-12-29 | 반도체메모리 어레이의 워드라인구조 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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KR1019890020105A KR930001739B1 (ko) | 1989-12-29 | 1989-12-29 | 반도체메모리 어레이의 워드라인구조 |
Publications (2)
Publication Number | Publication Date |
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KR910013264A true KR910013264A (ko) | 1991-08-08 |
KR930001739B1 KR930001739B1 (ko) | 1993-03-12 |
Family
ID=19294146
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019890020105A KR930001739B1 (ko) | 1989-12-29 | 1989-12-29 | 반도체메모리 어레이의 워드라인구조 |
Country Status (1)
Country | Link |
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KR (1) | KR930001739B1 (ko) |
-
1989
- 1989-12-29 KR KR1019890020105A patent/KR930001739B1/ko not_active IP Right Cessation
Also Published As
Publication number | Publication date |
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KR930001739B1 (ko) | 1993-03-12 |
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