KR890007286A - 제어신호 출력회로 - Google Patents

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KR890007286A
KR890007286A KR1019880014144A KR880014144A KR890007286A KR 890007286 A KR890007286 A KR 890007286A KR 1019880014144 A KR1019880014144 A KR 1019880014144A KR 880014144 A KR880014144 A KR 880014144A KR 890007286 A KR890007286 A KR 890007286A
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KR
South Korea
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control signal
signal
circuit
output circuit
signal output
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KR1019880014144A
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Inventor
미츠오 이소베
신이치 나카우치다
Original Assignee
아오이 죠이치
가부시키가이샤 도시바
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    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03K—PULSE TECHNIQUE
    • H03K19/00—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits
    • H03K19/0008—Arrangements for reducing power consumption
    • H03K19/0013—Arrangements for reducing power consumption in field effect transistor circuits

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Abstract

내용 없음

Description

제어신호 출력회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 반도체 기억장치의 블록도.
제4도는 본 발명의 1실시예에 따른 회로도.
제5도는 본 발명의 다른 실시예에 따른 회로도이다.

Claims (6)

  1. 전원전압에 응답해서 제1 및 제2입력신호 중 한쪽을 반전시켜 반전된 신호를 출력하는 인버터수단과, 상기 반전된 신호와 다른쪽의 제1, 제2입력신호에 응답해서 제어신호를 출력하는 논리회로수단 및, 다른쪽의 제1, 제2입력신호에 응답해서 전원전압으로부터 상기 인버터수단을 분리시키는 스위칭수단으로 구성되어, 상기제1 , 제2입력신호 및 전원전압에 응답하여 제어신호를 출력하는 제어신호 출력회로.
  2. 제1항에 있어서, 상기 인버터수단이 CMOS인버터회로(20,30)로 구성된 것을 특징으로 하는 제어신호 출력회로.
  3. 제1항에 있어서, 제1입력신호는 부논리신호이고 제2입력신호는 정논리신호(CE2)이며, 스위칭수단이 PMOS트랜지스터(23)로 구성된 것을 특징으로 하는 제어신호 출력회로.
  4. 제1항에 있어서, 제1입력신호는 정논리신호(CE2)이고, 제2입력신호는 부논리신호이며, 스위칭수단이 NMOS트랜지스터(33)로 구성된 것을 특징으로 하는 제어신호 출력회로.
  5. 제3항에 있어서, 논리회로수단이 노아회로(26)로 구성된 것을 특징으로 하는 제어신호 출력회로.
  6. 제4항에 있어서, 논리회로수단이 낸드회로(36) 및 인버터회로(37)로 구성된 것을 특징으로 하는 제어신호 출력회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019880014144A 1987-10-30 1988-10-29 제어신호 출력회로 KR890007286A (ko)

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JP62275471A JPH063679B2 (ja) 1987-10-30 1987-10-30 半導体装置の制御回路
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