KR840005231A - 히스토리 메모리 제어방식 - Google Patents
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 종래의 히스토리 메모리장치의 개념도.
제2도는 본 발명의 한가지 실시예에 의한 마이크로프로그램 처리장치의 구조도.
제3도는 마이크로 프로그램 처리장치를 포함한 데이타처리장치의 전체구성도.
제4도는 제2도에 예시한 제어축적기(CS)의 구조도.
제5도는 동결/해제 명령코우드를 마이크로 동작어에 설정하는 흐름도의 예.
제6도 a, b는 각각 장해의 원인으로 되는 사상이 발생한 시점의 하드웨어의 상태가 히스토리메모리중에 들어 있지 않은 경우와 히스토리를 동결한 시점을 변한 경우에 관한 설명도이다.
Claims (7)
- 장치내의 상태정보를 연속적으로 수집하여 기억하는 히스토리메모리와, 이 히스토리 메모리에|대해 그 내용 갱신을 금지하는 동결제어 및 이 동결을 해제하는 해제제어를 실행하는 동결제어 회로와,이 동결 제어회로에 대해 미리 설정된 하드웨어 조건에 따라 동결제어 또는 해제제어를 지시하는 수단 및마이크로 프로그램 처리 시스템을 이용하여 구성한 데이타 처리 시스템에 있어서 동결 또는 해제의 제어를 지시하는 히스토리 제어 정보를 유지하기 위한 제어필드를 마이크로 명렬내에 저장시키고 마이크로 명렬의 실행을 위한 제어 필드를 해독하여 히스토리 제어 정보가 존재할때 동결 제어 회로에 동결 또는 해제를 명령하기 위한 신호를 발생하는 수단을 구성함으로써 미리 설정된 하드웨어 조건이 발생되고 히스토리 제어 정보를 가진 마이크로 명렬이 실행될때 히스토리 메모리를 제어함을 특징으로 하는 데이타 처리시스템의 히스토리메모리제어방식.
- 청구범위 제1항에 있어서, 마이크로명령 사이의 제어필드 위에서 해독하여 동결명령 신호를 발생하는 디코우드와 해당되는 마이크로 명령을 나타내는
- 유효신호와 동결명령신호를 AND 처리하기 위한 1차 게이트회로와,
- 유효신호와 해제명령 신호를 AND 처리하기 위한 2차 게이트회로와,
- 하드웨어 조건에 있는 동결제어 신호와 상기 1차 게이트회로의 출력을 OR 처리하기 위한 3차 게이트회로, 하드웨어조건에 있는 해제제어신호와 상기 2차 게이트회로의 출력을 OR 처리하기 위한 4차 게이트회로, 3차 게이트회로의 출력을 세트입력으로써 받고, 4차게이트회로의 출력을 리세트입력으로써 받아들이는 플립플롭과, 쓰기가능신호를 플립플롭의 출력과 더불어 히스토리메모리에 제어하는 5차게이트회로로 구성함을 특징으로 하는 히스토리메모리 제어방식.
- 청구범위 제1항 또는 제2항에 있어서, 마이크로프로그램처리 장치가 파이프라인을 구성하여 복수단계에서 제어메모리로부터 독출한 마이크로 명령을 실행하고, 제어필드의 히스토리 제어정보를 하나의 미리 설정된 단계에 의해 해독함을 특징으로 하는 히스토리메모리 제어방식.
- ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Applications Claiming Priority (3)
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