KR20080033590A - 박막 트랜지스터 기판의 제조 방법 - Google Patents

박막 트랜지스터 기판의 제조 방법 Download PDF

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Abstract

박막 트랜지스터 기판의 제조 방법이 개시되어 있다. 활성층 상에 제1 금속층, 제2 금속층 및 제3 금속층이 연속으로 적층된 데이터용 금속막을 형성한다. 이후, 데이터용 금속막 상에 채널 형성 영역이 다른 영역에 비하여 상대적으로 얇은 두께를 갖는 제1 포토레지스트 패턴을 형성한다. 이후, 제1 포토레지스트 패턴을 이용하여 제3 금속층을 건식 식각한다. 이후, 제1 포토레지스트 패턴을 이용하여 제2 금속층 및 제1 금속층을 동시에 건식 식각한다. 이후, 제1 포토레지스트 패턴을 이용하여 활성층을 건식 식각한다. 이후, 제1 포토레지스트 패턴을 식각하여 채널 형성 영역이 제거된 제2 포토레지스트 패턴을 형성한다. 이후, 제2 포토레지스트 패턴을 이용하여 데이터용 금속막의 채널 형성 영역을 건식 식각하여 데이터 라인과 연결된 소오스 전극 및 상기 소오스 전극과 이격된 드레인 전극을 형성한다. 이와 같이, 데이터 라인을 형성하기 위한 1차 식각 공정과 채널을 형성하기 위한 2차 식각 공정을 모두 건식 식각 공정으로 진행함으로써, 습식 식각에 따른 문제점을 해결하고, 제조 공정을 단순화시킬 수 있다.

Description

박막 트랜지스터 기판의 제조 방법{METHOD OF MANUFACTURING THIN FILM TRANSISTOR SUBSTRATE}
도 1은 본 발명의 실시예에 따라 제조된 박막 트랜지스터 기판을 나타낸 평면도이다.
도 2 내지 도 11은 도 1에 도시된 박막 트랜지스터 기판의 제조 과정을 나타낸 공정도들이다.
도 12 내지 도 15는 다른 실시예에 따른 데이터용 금속막의 식각 과정을 나타낸 공정도들이다.
<도면의 주요부분에 대한 부호의 설명>
110 : 기판 122 : 게이트 라인
124 : 게이트 전극 130 : 게이트 절연층
140 : 활성층 142 : 채널층
144 : 오믹 콘택층 150 : 데이터용 금속막
151 : 제1 금속층 152 : 제2 금속층
153 : 제3 금속층 155 : 데이터 라인
157 : 소오스 전극 158 : 드레인 전극
160 : 제1 포토레지스트 패턴 162 : 제2 포토레지스트 패턴
170 : 보호막 180 : 화소 전극
본 발명은 박막 트랜지스터 기판의 제조 방법에 관한 것으로, 보다 상세하게는 제조 공정을 단순화시킬 수 있는 박막 트랜지스터 기판의 제조 방법에 관한 것이다.
일반적으로, 액정표시장치는 박막 트랜지스터 및 화소 전극이 형성된 박막 트랜지스터 기판과 컬러필터 및 공통 전극이 형성된 컬러필터 기판이 액정을 사이에 두고 결합된 구조를 갖는다.
박막 트랜지스터 기판을 형성하는 공정은 마스크를 이용한 사진 식각 공정을 통해 이루어지는데, 최근에는 공정 단순화를 위하여 4매의 마스크만을 사용하는 4매 마스크 공정이 개발된 바 있다.
통상적으로, 4매 마스크 공정에서는 데이터용 금속층을 식각함에 있어, 데이터 라인을 형성하기 위한 1차 식각 단계와 채널 형성 영역을 식각하기 위한 2차 식각 단계를 진행하게 된다.
기존 4매 마스크 공정에서는 상기 1차 식각 단계 및 2차 식각 단계를 모두 습식 식각 공정을 적용함에 따라, 채널 폭의 증가 및 공정 산포를 줄이기 위하여 배선 폭을 넓게 디자인해야 하는 문제가 발생된다.
최근에는 상기 1차 식각 단계는 습식 식각 공정을 사용하고, 2차 식각 단계 는 건식 식각 공정을 사용하는 제조 공정이 개발된 바 있으나, 습식 식각 공정과 건식 식각 공정을 모두 사용함으로 인해 제조 공정이 복잡해지고, 제조 시간이 증가되는 문제가 발생된다.
따라서, 본 발명은 이러한 종래의 문제점을 해결하기 위한 것으로, 본 발명은 건식 식각 공정만을 이용하여 제조 공정을 단순화시킬 수 있는 박막 트랜지스터 기판의 제조 방법을 제공한다.
본 발명의 일 특징에 따른 박막 트랜지스터 기판의 제조 방법에 따르면, 게이트 라인 및 상기 게이트 라인과 연결된 게이트 전극을 포함하는 게이트 배선이 형성된 기판 상에 게이트 절연막 및 활성층을 순차적으로 형성한다. 이후, 상기 활성층 상에 제1 금속층, 제2 금속층 및 제3 금속층이 연속으로 적층된 데이터용 금속막을 형성한다. 이후, 상기 데이터용 금속막 상에 채널 형성 영역이 다른 영역에 비하여 상대적으로 얇은 두께를 갖는 제1 포토레지스트 패턴을 형성한다. 이후, 상기 제1 포토레지스트 패턴을 이용하여 상기 제3 금속층을 건식 식각한다. 이후, 상기 제1 포토레지스트 패턴을 이용하여 상기 제2 금속층 및 상기 제1 금속층을 동시에 건식 식각하여 데이터 라인을 형성한다. 이후, 상기 제1 포토레지스트 패턴을 이용하여 상기 활성층을 건식 식각한다. 이후, 상기 제1 포토레지스트 패턴을 식각하여 상기 채널 형성 영역이 제거된 제2 포토레지스트 패턴을 형성한다. 이후, 상기 제2 포토레지스트 패턴을 이용하여 상기 데이터용 금속막의 상기 채널 형성 영역을 건식 식각하여 상기 데이터 라인과 연결된 소오스 전극 및 상기 소오스 전극과 이격된 드레인 전극을 형성한다.
상기 제1 금속층은 몰리브덴을 포함하고, 상기 제2 금속층은 알루미늄을 포함하며, 상기 제3 금속층은 몰리브덴을 포함한다.
상기 제1 포토레지스트 패턴을 이용하여 상기 제2 금속층과 상기 제1 금속층을 동시에 건식 식각하는 공정은 삼염화붕소(BCl3) 가스와 염소(Cl2) 가스를 이용하여 진행된다. 이때, 상기 삼염화붕소(BCl3) 가스와 상기 염소(Cl2) 가스의 조성비는 약 1 : 1 ~ 1 : 5 정도로 구성된다.
상기 제2 포토레지스트 패턴을 이용하여 상기 데이터용 금속막의 상기 채널 형성 영역을 건식 식각하는 공정은 상기 제2 포토레지스트 패턴을 이용하여 상기 제3 금속층을 건식 식각하는 공정과 상기 제2 포토레지스트 패턴을 이용하여 상기 제2 금속층 및 상기 제1 금속층을 동시에 건식 식각하는 공정으로 진행될 수 있다.
상기 소오스 전극 및 드레인 전극을 형성한 이후에, 상기 제2 포토레지스트 패턴을 이용하여 상기 채널 형성 영역의 오믹 콘택층을 제거하여 박막 트랜지스터를 형성한다.
이후, 상기 박막 트랜지스터가 형성된 기판 상에 보호막을 형성하고, 상기 보호막 상에 상기 드레인 전극과 전기적으로 연결되는 화소 전극을 형성한다.
본 발명의 다른 특징에 따른 박막 트랜지시트 기판의 제조 방법에 따르면, 게이트 라인 및 상기 게이트 라인과 연결된 게이트 전극을 포함하는 게이트 배선이 형성된 기판 상에 게이트 절연막 및 활성층을 순차적으로 형성한다. 이후, 상기 활성층 상에 제1 금속층, 제2 금속층 및 제3 금속층이 연속으로 적층된 데이터용 금속막을 형성한다. 이후, 상기 데이터용 금속막 상에 채널 형성 영역이 다른 영역에 비하여 상대적으로 얇은 두께를 갖는 포토레지스트 패턴을 형성한다. 이후, 상기 포토레지스트 패턴을 이용하여 상기 제3 금속층을 건식 식각한다. 이후, 상기 포토레지스트 패턴을 이용하여 상기 제2 금속층을 건식 식각한다. 이후, 상기 포토레지스트 패턴을 이용하여 상기 제1 금속층 및 상기 활성층을 동시에 건식 식각하여 데이터 라인을 형성한다. 이후, 상기 포토레지스트 패턴을 이용하여 상기 데이터용 금속막의 상기 채널 형성 영역을 건식 식각하여 상기 데이터 라인과 연결된 소오스 전극 및 상기 소오스 전극과 이격된 드레인 전극을 형성한다.
상기 제1 금속층은 몰리브덴을 포함하고, 상기 제2 금속층은 알루미늄을 포함하며, 상기 제3 금속층은 몰리브덴을 포함한다.
상기 포토레지스트 패턴을 이용하여 상기 제1 금속층과 상기 활성층을 동시에 건식 식각하는 공정은 육불화황(SF6) 가스와 염소(Cl2) 가스를 이용하여 진행된다. 이때, 상기 육불화황(SF6) 가스와 상기 염소(Cl2) 가스의 조성비는 약 1 : 5 ~ 1 : 7 정도로 구성된다.
이러한 박막 트랜지스터 기판의 제조 방법에 의하면, 데이터 라인을 형성하기 위한 1차 식각 공정과 채널을 형성하기 위한 2차 식각 공정을 모두 건식 식각 공정으로 진행함으로써, 습식 식각에 따른 문제점을 해결하고, 제조 공정을 단순화시킬 수 있다.
이하, 첨부한 도면들을 참조하여, 본 발명에 따른 박막 트랜지스터 기판의 제조 방법을 보다 상세하게 설명하고자 한다.
도 1은 본 발명의 실시예에 따라 제조된 박막 트랜지스터 기판을 나타낸 평면도이며, 도 2 내지 도 11은 도 1에 도시된 박막 트랜지스터 기판의 제조 과정을 나타낸 공정도들이다. 여기서, 도 2 내지 도 11은 도 1의 Ⅰ-Ⅰ'선을 따라 절단한 경우의 단면도들이다.
도 1 및 도 2를 참조하면, 기판(110) 상에 게이트용 금속막을 형성한 후, 제1 노광 마스크를 이용한 사진 식각 공정을 통해 상기 게이트용 금속막을 패터닝하여 게이트 라인(122) 및 게이트 라인(122)과 연결된 게이트 전극(124)을 포함하는 게이트 배선(120)을 형성한다. 상기 게이트용 금속막은 예를 들어, 스퍼터링 방법을 통해 기판(110) 상에 형성될 수 있다.
기판(110)은 투명성 절연 기판, 예를 들어, 유리 기판으로 형성된다.
게이트 배선(120)은 예를 들어, 알루미늄(Al), 몰리브덴(Mo), 크롬(Cr), 탄탈륨(Ta), 티타늄(Ti), 텅스텐(W), 구리(Cu), 은(Ag) 등의 단일 금속 또는 이들의 합금으로 형성될 수 있다. 또한, 게이트 배선(120)은 물리적 성질이 다른 2개 이상의 금속층으로 형성될 수 있다. 예를 들어, 게이트 배선(120)은 저저항 배선을 위하여, 알루미늄(Al)과 몰리브덴(Mo)이 적층된 Al/Mo 이층막 구조로 형성될 수 있다.
게이트 라인(122)은 예를 들어, 가로 방향으로 연장되어 각 화소(P)의 상측 및 하측을 정의한다. 게이트 전극(124)은 게이트 라인(122)과 연결되며, 박막 각 화소(P)에 형성되는 스위칭 소자인 박막 트랜지스터(TFT)의 게이트 단자를 구성한다.
다음 도 3을 참조하면, 게이트 배선(120)이 형성된 기판(110) 상에 게이트 절연막(130) 및 활성층(140)을 순차적으로 형성한다. 게이트 절연막(130) 및 활성층(140)은 예를 들어, 플라즈마 화학 기상 증착(Plasma Enhanced Chemical Vapor Deposition, PECVD) 방법을 통해 형성될 수 있다.
게이트 절연막(130)은 게이트 배선(120)을 보호하고 절연시키기 위한 절연막으로서, 예를 들어, 질화 실리콘(SiNx) 또는 산화 실리콘(SiOx)으로 형성되며, CVD 공정을 통해 약 4500Å의 두께로 형성된다.
활성층(140)은 채널층(142) 및 오믹 콘택층(144)을 포함한다. 예를 들어, 채널층(142)은 비정질 실리콘(amorphous Silicon : 이하, a-Si)으로 형성되며, 오믹 콘택층(144)은 n형 불순물이 고농도로 도핑된 비정질 실리콘(이하, n+a-Si)으로 형성될 수 있다.
이어서, 활성층(140) 상에 제1 금속층(151), 제2 금속층(152) 및 제3 금속층(153)을 연속으로 적층하여 데이터용 금속막(150)을 형성한다. 예를 들어, 제1 금속층(151)은 몰리브덴(Mo), 제2 금속층(152)은 알루미늄(Al), 제3 금속층(153)은 몰리브덴(Mo)으로 형성될 수 있다. 따라서, 데이터용 금속막(150)은 저저항 배선의 형성을 위하여 Mo/Al/Mo 3층막 구조로 형성된다. 데이터용 금속막(150)은 예를 들어, 스퍼터링 방법을 통해 활성층(140) 상에 형성될 수 있다.
다음 도 4를 참조하면, 데이터용 금속막(150) 상에 포토레지스트를 형성한 후, 슬릿(slit) 마스크 또는 하프톤(half tone) 마스크 등의 제2 노광 마스크를 이용한 사진 식각 공정을 통해 상기 포토레지스트를 패터닝하여 제1 포토레지스트 패턴(160)을 형성한다. 상기 포토레지스트는 예를 들어, 노광된 영역이 현상액에 의해 제거되는 포지티브형 포토레지스트로 형성된다.
제1 포토레지스트 패턴(160)은 채널 형성 영역이 다른 영역에 비하여 얇은 두께를 갖도록 형성된다. 예를 들어, 제1 포토레지스트 패턴(160)의 채널 형성 영역은 약 5000Å ~ 8000Å의 두께로 형성된다.
다음 도 5를 참조하면, 제1 포토레지스트 패턴(160)을 식각 마스크로 이용하여 데이터용 금속막(150) 중에 가장 상부에 형성된 제3 금속층(153)을 건식 식각한다.
몰리브덴(Mo)으로 형성된 제3 금속층(153)의 건식 식각을 위하여, 식각 가스로는 육불화황(SF6) 가스와 염소(Cl2) 가스가 주로 사용될 수 있다. 예를 들어, 육불화황(SF6) 가스와 염소(Cl2) 가스는 약 1 : 0.5 ~ 약 1 : 1.5 정도의 조성비로 혼합되어 사용된다.
다음 도 1 및 도 6을 참조하면, 제1 포토레지스트 패턴(160)을 식각 마스크로 이용하여 제2 금속층(152) 및 제1 금속층(151)을 동시에 건식 식각한다.
알루미늄(Al)으로 형성된 제2 금속층(152)과 몰리브덴(Mo)으로 형성된 제1 금속층(151)을 동시에 건식 식각하기 위하여, 식각 가스로는 삼염화붕소(BCl3) 가스와 염소(Cl2) 가스가 주로 사용될 수 있다. 예를 들어, 삼염화붕소(BCl3) 가스와 염소(Cl2) 가스는 약 1 : 1 ~ 약 1 : 5 정도의 조성비로 혼합되어 사용된다. 알루미늄(Al)으로 형성된 제2 금속층(152)만을 식각하는 경우에 비하여 삼염화붕소(BCl3)의 조성비율을 높임으로서, 제2 금속층(152)과 제1 금속층(151)을 동시에 건식 식각하는 것이 가능해진다.
한편, 제3 금속층(153), 제2 금속층(152) 및 제1 금속층(151)을 각각 건식 식각할 경우, 채널 형성 영역에 위치하는 포토레지스트의 잔량 부족으로 인해 건식 식각 도중에 활성층(140)의 채널 영역이 뚫리게 되는 현상이 발생될 수 있다. 따라서, 제2 금속층(152)과 제1 금속층(151)을 동시에 건식 식각함으로써, 공정을 단순화시키고, 공정 마진을 증가시켜 채널 뚫림 현상을 어느 정도 제거할 수 있다.
제1 포토레지스트 패턴(160)을 이용한 건식 식각 공정을 통해 제3 금속층(153), 제2 금속층(152) 및 제1 금속층(151)의 식각이 완료되면, 데이터 라인(155)과 소오스/드레인용 금속패턴(156)만이 남게 된다. 데이터 라인(155)은 예를 들어, 게이트 라인(122)과 교차하는 세로 방향으로 연장되어 각 화소(P)의 좌측 및 우측을 정의한다.
다음 도 7을 참조하면, 제1 포토레지스트 패턴(160)을 식각 마스크로 이용하여 활성층(140)을 건식 식각한다.
이와 같이, 동일한 제1 포토레지스트 패턴(160)을 이용하여 데이터용 금속막(150) 및 활성층(140)을 식각함으로 인해, 남게 되는 활성층(140)의 외부 윤곽은 데이터 라인(150) 및 소오스/드레인용 금속패턴(156)의 외부 윤곽과 실질적으로 일치하게 형성된다.
다음 도 8을 참조하면, 산소 플라즈마를 이용한 애싱(ashing) 공정을 통해 제1 포토레지스트 패턴(160)을 일정 두께만큼 식각하여 채널 형성 영역이 제거된 제2 포토레지스트 패턴(162)을 형성한다. 이에 따라, 채널 형성 영역에 대응되는 소오스/드레인용 금속패턴(156)이 외부로 노출된다.
다음 도 1 및 도 9를 참조하면, 제2 포토레지스트 패턴(162)을 식각 마스크로 이용하여 소오스/드레인용 금속패턴(156)의 채널 형성 영역을 건식 식각한다.
제2 포토레지스트 패턴(162)을 이용한 건식 식각 공정은 앞서 설명한 제1 포토레지스트 패턴(160)을 이용한 건식 식각 공정과 마찬가지로, 제3 금속층(153)을 1차로 건식 식각하고, 제2 금속층(152) 및 제1 금속층(151)을 동시에 2차로 건식 식각하는 공정으로 진행될 수 있다. 이와 달리, 제2 포토레지스트 패턴(162)을 이용한 건식 식각 공정은 제3 금속층(153), 제2 금속층(152) 및 제1 금속층(151)을 각각 건식 식각하는 공정으로 진행될 수 있다.
제2 포토레지스트 패턴(162)을 이용한 건식 식각 공정을 통해 소오스/드레인용 금속패턴(156)의 채널 형성 영역의 식각이 완료되면, 소오스 전극(157) 및 드레인 전극(158)이 형성된다. 소오스 전극(157)은 데이터 라인(155)과 연결되어 박막 트랜지스터(TFT)의 소오스 단자를 구성한다. 드레인 전극(158)은 소오스 전극(157)과 이격되어 박막 트랜지스터(TFT)의 드레인 단자를 구성한다.
이후, 제2 포토레지스트 패턴(162)을 식각 마스크로 이용하여 채널 형성 영역의 오믹 콘택층(144)을 식각한다. 이에 따라, 소오스 전극(157)과 드레인 전극(158) 사이에는 채널층(142)이 노출되어 박막 트랜지스터(TFT)의 채널(159)이 형성된다.
이와 같이, 제1, 제2 및 제3 금속층(151, 152, 153)으로 형성된 데이터용 금속막(150)의 모든 식각 공정을 건식 식각 공정으로 진행함으로써, 습식 식각으로 인한 배선폭 증가 등의 문제점을 개선하고, 제조 공정을 보다 단순화시킬 수 있게 된다.
이후, 데이터 라인(155), 소오스 전극(157) 및 드레인 전극(158) 상에 존재하는 제2 포토레지스트 패턴(162)을 제거한다. 예를 들어, 제2 포토레지스트 패턴(162)은 스트립 용액을 이용한 스트립 공정을 통해 제거된다. 이로써, 박막 트랜지스터(TFT)의 제조가 완료된다.
다음 도 1 및 도 10을 참조하면, 박막 트랜지스터(TFT)가 형성된 기판(110) 상에 보호막(170)을 형성한다. 보호막(170)은 박막 트랜지스터(TFT) 및 데이터 라인(155)을 보호하고 절연시키기 위한 절연막으로서, 예를 들어, 질화 실리콘(SiNx) 또는 산화 실리콘(SiOx)으로 형성되며, CVD 공정을 통해 약 500Å ~ 2000Å의 두께로 형성된다.
이후, 제3 노광 마스크를 이용한 사진 식각 공정을 통해 보호막(170)을 패터닝하여 드레인 전극(158)의 일부를 노출시키는 콘택 홀(172)을 형성한다.
다음 도 1 및 도 11을 참조하면, 보호막(170) 상에 투명성 도전막을 형성한 후, 제4 노광 마스크를 이용한 사진 식각 공정을 통해 상기 투명성 도전막을 패터닝하여 각 화소(P) 내에 화소 전극(180)을 형성한다.
화소 전극(180)은 보호막(170)에 형성된 콘택 홀(172)을 통해 드레인 전극(158)과 전기적으로 연결된다. 화소 전극(180)은 예를 들어, 인듐 징크 옥사이 드(Indium Zinc Oxide : IZO) 또는 인듐 틴 옥사이드(Indium Tin Oxide : ITO)로 형성된다.
한편, 도시되지는 않았으나, 화소 전극(180)을 형성하기 전에 보호막(170) 상에 평탄화를 위한 유기 절연막을 더 형성할 수 있다.
도 12 내지 도 15는 다른 실시예에 따른 데이터용 금속막의 식각 과정을 나타낸 공정도들이다. 제1 포토레지스트 패턴을 형성하는 과정까지는 도 2 내지 도 4에 도시된 것과 동일하므로, 이와 관련된 상세한 설명은 생략하기로 한다.
도 12를 참조하면, 채널 형성 영역이 다른 영역에 비하여 상대적으로 얇은 두께를 갖는 포토레지스트 패턴(160)을 식각 마스크로 이용하여 제3 금속층(153)을 건식 식각한다.
몰리브덴(Mo)으로 형성된 제3 금속층(153)의 건식 식각을 위하여, 식각 가스로는 불소(F) 계열의 가스와 염소(Cl2) 가스가 사용된다. 예를 들어, 불소(F) 계열의 가스로는 육불화황(SF6) 가스가 사용될 수 있다. 이때, 육불화황(SF6) 가스와 염소(Cl2) 가스는 약 1 : 0.5 ~ 약 1 : 1.5 정도의 조성비로 혼합되어 사용된다.
다음 도 13을 참조하면, 포토레지스트 패턴(160)을 식각 마스크로 이용하여 제2 금속층(152)을 건식 식각한다.
알루미늄(Al)으로 형성된 제2 금속층(152)의 건식 식각을 위하여, 식각 가스로는 삼염화붕소(BCl3) 가스와 염소(Cl2) 가스가 사용된다. 예를 들어, 삼염화붕소(BCl3) 가스와 염소(Cl2) 가스는 제2 금속층(152)만을 식각하기 위하여 약 1 : 8 ~ 약 1 : 12 정도의 조성비로 혼합되어 사용된다.
다음 도 14를 참조하면, 포토레지스트 패턴(160)을 식각 마스크로 이용하여 제1 금속층(151)과 활성층(140)을 동시에 건식 식각한다.
몰리브덴(Mo)으로 형성된 제1 금속층(151)과 a-Si 및 n+a-Si으로 형성된 활성층(140)을 동시에 건식 식각하기 위하여, 식각 가스로는 불소(F) 계열의 가스와 염소(Cl2) 가스가 사용된다. 예를 들어, 불소(F) 계열의 가스로는 육불화황(SF6) 가스가 사용될 수 있다. 이때, 육불화황(SF6) 가스와 염소(Cl2) 가스는 약 1 : 5 ~ 약 1 : 7 정도의 조성비로 혼합되어 사용된다. 이와 같이, 몰리브덴(Mo)으로 형성된 제1 금속층(151)만을 식각하는 경우에 비하여 염소(Cl2) 가스의 조성비율을 높임으로서, 제1 금속층(151)과 활성층(140)을 동시에 건식 식각하는 것이 가능해진다.
이와 같이, 제1 금속층(151)과 활성층(140)을 동시에 건식 식각함으로써, 공정을 단순화시키고, 공정 마진을 증가시켜 채널 뚫림 현상을 완전히 제거할 수 있다.
한편, 제1 금속층(151)과 활성층(140)을 동시에 건식 식각하는 도중에, 포토레지스트 패턴(160)의 채널 형성 영역이 오픈되어 제3 금속층(153)이 동시에 식각된다.
경우에 따라서는 채널 형성 영역에 포토레지스트가 잔존할 수 있으므로, 채널 형성 영역에 잔존하는 포토레지스트를 완전히 제거하기 위하여, 애싱(ashing) 공정을 더 진행할 수 있다.
다음 도 15를 참조하면, 포토레지스트 패턴(160)을 식각 마스크로 이용하여 채널 형성 영역의 제2 금속층(152) 및 제1 금속층(151)을 건식 식각한다.
채널 형성 영역의 제2 금속층(152) 및 제1 금속층(151)을 건식 식각하는 공정은, 이미 도 9에서 설명한 바와 같이, 한번의 건식 식각으로 제2 금속층(152) 및 제1 금속층(151)을 동시에 건식 식각하거나, 제2 금속층(152) 및 제1 금속층(151)을 각각 건식 식각하는 공정으로 진행될 수 있다.
이후, 채널 형성 영역의 오믹 콘택층(144)을 식각하면, 소오스 전극(157)과 드레인 전극(158) 사이의 채널층(142)이 노출되어 박막 트랜지스터(TFT)의 채널이 형성된다.
이후의 제조 공정은 도 10 및 도 11에 도시된 것과 동일하므로, 이와 관련된 상세한 설명은 생략하기로 한다.
이와 같은 박막 트랜지스터 기판의 제조 방법에 따르면, 저저항 배선을 위해 Mo/Al/Mo 3층막 구조로 형성된 데이터용 금속막의 모든 식각 공정을 건식 식각 공정으로 진행함으로써, 습식 식각으로 인해 발생했던 배선 폭 증가 등의 문제점을 개선하고, 제조 공정을 단순화시킬 수 있다.
또한, 알루미늄과 하부 몰리브덴을 동시에 건식 식각하거나, 하부 몰리브덴과 활성층을 동시에 건식 식각함으로써, 제조 공정을 보다 단순화시키고, 공정 마진을 증가시켜 채널 뚫림 현상을 방지할 수 있다.
앞서 설명한 본 발명의 상세한 설명에서는 본 발명의 바람직한 실시예들을 참조하여 설명하였지만, 해당 기술분야의 숙련된 당업자 또는 해당 기술분야에 통상의 지식을 갖는 자라면 후술될 특허청구범위에 기재된 본 발명의 사상 및 기술 영역으로부터 벗어나지 않는 범위 내에서 본 발명을 다양하게 수정 및 변경시킬 수 있음을 이해할 수 있을 것이다.

Claims (15)

  1. 게이트 라인 및 상기 게이트 라인과 연결된 게이트 전극을 포함하는 게이트 배선이 형성된 기판 상에 게이트 절연막 및 활성층을 순차적으로 형성하는 단계;
    상기 활성층 상에 제1 금속층, 제2 금속층 및 제3 금속층이 연속으로 적층된 데이터용 금속막을 형성하는 단계;
    상기 데이터용 금속막 상에 채널 형성 영역이 다른 영역에 비하여 상대적으로 얇은 두께를 갖는 제1 포토레지스트 패턴을 형성하는 단계;
    상기 제1 포토레지스트 패턴을 이용하여 상기 제3 금속층을 건식 식각하는 단계;
    상기 제1 포토레지스트 패턴을 이용하여 상기 제2 금속층 및 상기 제1 금속층을 동시에 건식 식각하여 데이터 라인을 형성하는 단계;
    상기 제1 포토레지스트 패턴을 이용하여 상기 활성층을 건식 식각하는 단계;
    상기 제1 포토레지스트 패턴을 식각하여 상기 채널 형성 영역이 제거된 제2 포토레지스트 패턴을 형성하는 단계;
    상기 제2 포토레지스트 패턴을 이용하여 상기 데이터용 금속막의 상기 채널 형성 영역을 건식 식각하여 상기 데이터 라인과 연결된 소오스 전극 및 상기 소오스 전극과 이격된 드레인 전극을 형성하는 단계를 포함하는 박막 트랜지스터 기판의 제조 방법.
  2. 제1항에 있어서, 상기 제1 금속층은 몰리브덴을 포함하고, 상기 제2 금속층은 알루미늄을 포함하며, 상기 제3 금속층은 몰리브덴을 포함하는 것을 특징으로 하는 박막 트랜지스터 기판의 제조 방법.
  3. 제2항에 있어서, 상기 제1 포토레지스트 패턴을 이용하여 상기 제2 금속층 및 상기 제1 금속층을 동시에 건식 식각하는 단계는 삼염화붕소(BCl3) 가스와 염소(Cl2) 가스를 이용하여 진행하는 것을 특징으로 하는 박막 트랜지스터 기판의 제조 방법.
  4. 제3항에 있어서, 상기 삼염화붕소(BCl3) 가스와 상기 염소(Cl2) 가스의 조성비는 1:1 ~ 1:5인 것을 특징으로 하는 박막 트랜지스터 기판의 제조 방법.
  5. 제1항에 있어서, 상기 제2 포토레지스트 패턴을 이용하여 상기 데이터용 금속막의 상기 채널 형성 영역을 건식 식각하는 단계는,
    상기 제2 포토레지스트 패턴을 이용하여 상기 제3 금속층을 건식 식각하는 단계; 및
    상기 제2 포토레지스트 패턴을 이용하여 상기 제2 금속층 및 상기 제1 금속층을 동시에 건식 식각하는 단계를 포함하는 것을 특징으로 하는 박막 트랜지스터 기판의 제조 방법.
  6. 제1항에 있어서, 상기 활성층은 비정질 실리콘으로 이루어진 채널층 및 이온이 도핑된 비정질 실리콘으로 이루어진 오믹 콘택층을 포함하며,
    상기 소오스 전극 및 드레인 전극을 형성하는 단계 이후에, 상기 제2 포토레지스트 패턴을 이용하여 상기 채널 형성 영역의 상기 오믹 콘택층을 제거하여 박막 트랜지스터를 형성하는 단계를 더 포함하는 것을 특징으로 하는 박막 트랜지스터 기판의 제조 방법.
  7. 제6항에 있어서,
    상기 박막 트랜지스터가 형성된 기판 상에 보호막을 형성하는 단계; 및
    상기 보호막 상에 상기 드레인 전극과 전기적으로 연결되는 화소 전극을 형성하는 단계를 더 포함하는 것을 특징으로 하는 박막 트랜지스터 기판의 제조 방법.
  8. 게이트 라인 및 상기 게이트 라인과 연결된 게이트 전극을 포함하는 게이트 배선이 형성된 기판 상에 게이트 절연막 및 활성층을 순차적으로 형성하는 단계;
    상기 활성층 상에 제1 금속층, 제2 금속층 및 제3 금속층이 연속으로 적층된 데이터용 금속막을 형성하는 단계;
    상기 데이터용 금속막 상에 채널 형성 영역이 다른 영역에 비하여 상대적으로 얇은 두께를 갖는 포토레지스트 패턴을 형성하는 단계;
    상기 포토레지스트 패턴을 이용하여 상기 제3 금속층을 건식 식각하는 단계;
    상기 포토레지스트 패턴을 이용하여 상기 제2 금속층을 건식 식각하는 단계;
    상기 포토레지스트 패턴을 이용하여 상기 제1 금속층 및 상기 활성층을 동시에 건식 식각하여 데이터 라인을 형성하는 단계;
    상기 포토레지스트 패턴을 이용하여 상기 데이터용 금속막의 상기 채널 형성 영역을 건식 식각하여 상기 데이터 라인과 연결된 소오스 전극 및 상기 소오스 전극과 이격된 드레인 전극을 형성하는 단계를 포함하는 박막 트랜지스터 기판의 제조 방법.
  9. 제8항에 있어서, 상기 제1 금속층은 몰리브덴을 포함하고, 상기 제2 금속층은 알루미늄을 포함하며, 상기 제3 금속층은 몰리브덴을 포함하는 것을 특징으로 하는 박막 트랜지스터 기판의 제조 방법.
  10. 제9항에 있어서, 상기 포토레지스트 패턴을 이용하여 상기 제1 금속층 및 상기 활성층을 동시에 건식 식각하는 단계는 불소(F) 계열 가스와 염소(Cl2) 가스를 이용하여 진행하는 것을 특징으로 하는 박막 트랜지스터 기판의 제조 방법.
  11. 제10항에 있어서, 상기 불소(F) 계열 가스는 육불화황(SF6) 가스를 포함하는 것을 특징으로 하는 박막 트랜지스터 기판의 제조 방법.
  12. 제11항에 있어서, 상기 육불화황(SF6) 가스와 상기 염소(Cl2) 가스의 조성비 는 1:5 ~ 1:7인 것을 특징으로 하는 박막 트랜지스터 기판의 제조 방법.
  13. 제8항에 있어서, 상기 포토레지스트 패턴을 이용하여 상기 제1 금속층 및 상기 활성층을 동시에 건식 식각하는 과정에서 상기 채널 형성 영역의 상기 제3 금속층이 동시에 식각되는 것을 특징으로 하는 박막 트랜지스터 기판의 제조 방법.
  14. 제8항에 있어서, 상기 활성층은 비정질 실리콘으로 이루어진 채널층 및 이온이 도핑된 비정질 실리콘으로 이루어진 오믹콘택층을 포함하며,
    상기 소오스 전극 및 드레인 전극을 형성하는 단계 이후에, 상기 제2 포토레지스트 패턴을 이용하여 상기 채널 형성 영역의 상기 오믹콘택층을 제거하여 박막 트랜지스터를 형성하는 단계를 더 포함하는 것을 특징으로 하는 박막 트랜지스터 기판의 제조 방법.
  15. 제14항에 있어서,
    상기 박막 트랜지스터가 형성된 기판 상에 보호막을 형성하는 단계; 및
    상기 보호막 상에 상기 드레인 전극과 전기적으로 연결되는 화소 전극을 형성하는 단계를 더 포함하는 것을 특징으로 하는 박막 트랜지스터 기판의 제조 방법.
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