KR100755654B1 - Esr 특성 제어가능한 적층세라믹 커패시터 - Google Patents
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Abstract
Description
외부전극/ 저항층 | 저항층 조성 | 입자형상 (구형:침상) | 저항층 비저항 (Ωcm) | 정전용량 (uF) | tand (%) | ESR (mΩ) | |
1 | Cu | 3.3 | 0.03 | 4 | |||
2 | Cu/Ni-Cu | Ni 16wt% | 구형 100 | 0.3×10-4 | 3.2 | 0.03 | 30 |
3 | Cu/Ni-Cu | Ni 30wt% | 구형 100 | 1.1×10-3 | 3.2 | 0.03 | 52 |
Claims (10)
- 유전체층과 그 유전체층 사이에 교대로 배열된 다수의 내부전극들을 포함하는 세라믹 적층체;상기 세라믹 적층체의 양단부에 형성된 외부전극; 및상기 외부전극 상에 형성된, 상기 외부전극을 이루는 전도성 금속 원소를 포함하는 합금층으로 조성된 저항층;을 포함하는 ESR 제어가능한 적층세라믹 커패시터.
- 제 1항에 있어서, 상기 외부전극은 Cu, Ni, Pd, Ag중 선택된 1종의 금속으로 조성된 것임을 특징으로 하는 ESR 제어가능한 적층세라믹 커패시터.
- 제 1항에 있어서, 상기 외부전극이 Cu로 이루어진 경우, 상기 저항층은 Cu-Ni, Cu-Ag, Cu-P중 선택된 1종의 합금층으로 조성된 것임을 특징으로 하는 ESR 제어가능한 적층세라믹 커패시터.
- 제 1항에 있어서, 상기 저항층은 그 두께가 1~100㎛임을 특징으로 하는 ESR 제어가능한 적층세라믹 커패시터.
- 제 1항에 있어서, 나아가 상기 저항층상에 Ni 도금층과 Sn 도금층이 순차적 으로 형성되어 있음을 특징으로 하는 ESR 제어가능한 적층세라믹 커패시터.
- 유전체층과 그 유전체층 사이에 교대로 배열된 다수의 제1 및 제2 내부전극들을 포함하는 세라믹 적층체;상기 제1 내부전극들 중 적어도 하나와 전기적으로 연결되도록 상기 적층체의 일측 단부에 형성된 제1 외부전극;상기 제2 내부전극들 중 적어도 하나와 전기적으로 연결되도록 상기 적층체의 타측 단부에 형성된 제2 외부전극; 및상기 제1 및 제2 외부전극 상에 형성된 도금층;을 포함하고,상기 제1 및 제2 외부전극과 상기 도금층 사이에는 상기 외부전극을 이루는 전도성 금속보다 비저항이 높은 저항층이 형성되어 있으며, 상기 저항층은 상기 전도성 금속을 포함하는 합금층으로 조성되어 있는 ESR 제어가능한 적층세라믹 커패시터.
- 제 6항에 있어서, 상기 제1 및 제2 외부전극은 Cu, Ni, Pd, Ag중 선택된 1종의 금속으로 조성된 것임을 특징으로 하는 ESR 제어가능한 적층세라믹 커패시터.
- 제 6항에 있어서, 상기 제1 및 제2 외부전극이 Cu로 이루어진 경우, 상기 저항층은 Cu-Ni, Cu-Ag, Cu-P중 선택된 1종의 합금층으로 조성된 것임을 특징으로 하는 ESR 제어가능한 적층세라믹 커패시터.
- 제 6항에 있어서, 상기 저항층은 그 두께가 1~100㎛임을 특징으로 하는 ESR 제어가능한 적층세라믹 커패시터.
- 제 6항에 있어서, 상기 도금층은 Ni 도금층이며, 그리고 상기 Ni 도금층상에 Sn 도금층이 추가로 형성되는 것을 특징으로 하는 ESR 제어가능한 적층세라믹 커패시터.
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