KR100619111B1 - 에칭 방법 및 이를 실행시키기 위한 프로그램이 기억된 컴퓨터기억매체 - Google Patents
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Abstract
Description
Claims (19)
- 미리 패터닝된 마스크층의 측벽에 플라즈마 반응 생성물을 퇴적시켜 상기 마스크층의 패턴폭을 넓히는 제1 공정과,패턴폭이 넓혀진 상기 마스크층을 마스크로 해서 피에칭층을 에칭하는 제2 공정을 갖는 것을 특징으로 하는에칭 방법.
- 제1항에 있어서,상기 제2 공정에 있어서 상기 마스크층의 측벽을 에칭하여 상기 마스크층의 패턴폭을 좁히면서 상기 피에칭층을 에칭하는 것을 특징으로 하는에칭 방법.
- 제1항에 있어서,상기 마스크층은 각 패턴이 접근해서 밀하게 배치된 제1 영역과, 각 패턴이 이간되어 소하게 배치된 제2 영역을 갖고, 미리 패터닝된 상기 마스크층의 패턴폭은 상기 제1 영역에 속하는 마스크층과 상기 제2 영역에 속하는 마스크층 사이에서 다르고,상기 제1 공정에 있어서 상기 제1 영역에 속하는 마스크층의 패턴폭과 상기 제2 영역에 속하는 마스크층의 패턴폭이 일치하도록, 상기 각 영역에 속하는 마스 크층의 패턴폭을 넓히는 것을 특징으로 하는에칭 방법.
- 제1항에 있어서,상기 제1 공정에 있어서 처리 가스로서 CF계 가스, CHF계 가스, 또는 CH계 가스중의 적어도 어느 하나를 이용하는 것을 특징으로 하는에칭 방법.
- 제4항에 있어서,상기 처리 가스는 CHF3인 것을 특징으로 하는에칭 방법.
- 미리 패터닝된 마스크층의 측벽을 에칭하여 상기 마스크층의 패턴폭을 좁히는 제1 공정과,패턴폭이 좁혀진 상기 마스크층을 마스크로 해서 해당 마스크층의 측벽을 에칭하여 상기 마스크층의 패턴폭을 더욱 좁히면서 피에칭층을 에칭하는 제2 공정을 갖는 것을 특징으로 하는에칭 방법.
- 제6항에 있어서,상기 마스크층은 각 패턴이 접근해서 밀하게 배치된 제1 영역과, 각 패턴이 이간되어 소하게 배치된 제2 영역을 갖고, 미리 패터닝된 상기 마스크층의 패턴폭은 상기 제1 영역에 속하는 마스크층과 상기 제2 영역에 속하는 마스크층 사이에서 다르고,상기 제1 공정에 있어서 상기 제1 영역에 속하는 마스크층의 패턴폭과 상기 제2 영역에 속하는 마스크층의 패턴폭이 일치하도록, 상기 각 영역에 속하는 마스크층의 패턴폭을 좁히는 것을 특징으로 하는에칭 방법.
- 제6항에 있어서,상기 제1 공정에 있어서 처리 가스로서 O2가스를 이용하는 것을 특징으로 하는에칭 방법.
- 제6항에 있어서,상기 제1 공정에 있어서 상기 마스크층 및 상기 피에칭층을 구비하는 피처리체가 탑재되는 전극에 대해 전력을 인가하지 않는 것을 특징으로 하는에칭 방법.
- 제1항에 있어서,상기 마스크층은 포토 레지스트재로 이루어지는 것을 특징으로 하는에칭 방법.
- 제10항에 있어서,상기 포토 레지스트재는 ArF광에 감광하는 것을 특징으로 하는에칭 방법.
- 제1항에 있어서,상기 피에칭층은 반사방지막으로 이루어지는 것을 특징으로 하는에칭 방법.
- 제12항에 있어서,상기 반사방지막은 유기계 재료로 이루어지는 것을 특징으로 하는에칭 방법.
- 제1항에 있어서,상기 제2 공정에 있어서 처리 가스로서 CF4 가스와 O2 가스의 양쪽의 가스를 이용하는 것을 특징으로 하는에칭 방법.
- 제1항에 있어서,상기 제2 공정에 있어서 처리 가스로서 CF4 가스를 이용하는 것을 특징으로 하는에칭 방법.
- 제1항에 있어서,상기 마스크층에는 콘택트 홀의 패턴이 형성되어 있는 것을 특징으로 하는에칭 방법.
- 제1항에 있어서,상기 제1 공정에 있어서 상기 마스크층의 패턴폭을 감시하여 해당 패턴폭이 목표치수에 도달했을 때에 해당 제1 공정을 종료하는 것을 특징으로 하는에칭 방법.
- 제1항의 에칭방법을 실행시키기 위한 프로그램이 기억된컴퓨터 판독가능 기억매체.
- 제6항의 에칭방법을 실행시키기 위한 프로그램이 기억된컴퓨터 판독가능 기억매체.
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Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR101061621B1 (ko) * | 2008-02-12 | 2011-09-01 | 도쿄엘렉트론가부시키가이샤 | 플라즈마 에칭 방법 및 컴퓨터 기억 매체 |
Families Citing this family (31)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US7723238B2 (en) * | 2004-06-16 | 2010-05-25 | Tokyo Electron Limited | Method for preventing striation at a sidewall of an opening of a resist during an etching process |
US7271107B2 (en) * | 2005-02-03 | 2007-09-18 | Lam Research Corporation | Reduction of feature critical dimensions using multiple masks |
US7539969B2 (en) * | 2005-05-10 | 2009-05-26 | Lam Research Corporation | Computer readable mask shrink control processor |
US7465525B2 (en) * | 2005-05-10 | 2008-12-16 | Lam Research Corporation | Reticle alignment and overlay for multiple reticle process |
US20060292876A1 (en) * | 2005-06-21 | 2006-12-28 | Tokyo Electron Limited | Plasma etching method and apparatus, control program and computer-readable storage medium |
US7271108B2 (en) * | 2005-06-28 | 2007-09-18 | Lam Research Corporation | Multiple mask process with etch mask stack |
US7273815B2 (en) * | 2005-08-18 | 2007-09-25 | Lam Research Corporation | Etch features with reduced line edge roughness |
US20070211402A1 (en) * | 2006-03-08 | 2007-09-13 | Tokyo Electron Limited | Substrate processing apparatus, substrate attracting method, and storage medium |
JP2007294905A (ja) * | 2006-03-30 | 2007-11-08 | Hitachi High-Technologies Corp | 半導体製造方法およびエッチングシステム |
JP4861893B2 (ja) * | 2006-07-28 | 2012-01-25 | 東京エレクトロン株式会社 | 基板の処理方法、プログラム、コンピュータ記憶媒体及び基板の処理システム |
US7491343B2 (en) * | 2006-09-14 | 2009-02-17 | Lam Research Corporation | Line end shortening reduction during etch |
JP2008078582A (ja) * | 2006-09-25 | 2008-04-03 | Hitachi High-Technologies Corp | プラズマエッチング方法 |
JP4912907B2 (ja) * | 2007-02-06 | 2012-04-11 | 東京エレクトロン株式会社 | プラズマエッチング方法及びプラズマエッチング装置 |
JP5065787B2 (ja) * | 2007-07-27 | 2012-11-07 | 東京エレクトロン株式会社 | プラズマエッチング方法、プラズマエッチング装置、および記憶媒体 |
US7838426B2 (en) * | 2007-08-20 | 2010-11-23 | Lam Research Corporation | Mask trimming |
US7998872B2 (en) * | 2008-02-06 | 2011-08-16 | Tokyo Electron Limited | Method for etching a silicon-containing ARC layer to reduce roughness and CD |
JP5027753B2 (ja) * | 2008-07-30 | 2012-09-19 | 東京エレクトロン株式会社 | 基板処理制御方法及び記憶媒体 |
JP4638550B2 (ja) | 2008-09-29 | 2011-02-23 | 東京エレクトロン株式会社 | マスクパターンの形成方法、微細パターンの形成方法及び成膜装置 |
US9601349B2 (en) * | 2009-02-17 | 2017-03-21 | Macronix International Co., Ltd. | Etching method |
JP5260356B2 (ja) | 2009-03-05 | 2013-08-14 | 東京エレクトロン株式会社 | 基板処理方法 |
CN102117737B (zh) * | 2009-12-30 | 2015-01-07 | 中国科学院微电子研究所 | 减小半导体器件中ler的方法及半导体器件 |
JP5634313B2 (ja) * | 2011-03-29 | 2014-12-03 | 富士フイルム株式会社 | レジストパターン形成方法およびそれを用いたパターン化基板の製造方法 |
JP2013222852A (ja) | 2012-04-17 | 2013-10-28 | Tokyo Electron Ltd | 有機膜をエッチングする方法及びプラズマエッチング装置 |
JP6355374B2 (ja) * | 2013-03-22 | 2018-07-11 | 株式会社半導体エネルギー研究所 | 半導体装置の作製方法 |
JP6289996B2 (ja) * | 2014-05-14 | 2018-03-07 | 東京エレクトロン株式会社 | 被エッチング層をエッチングする方法 |
JP6817168B2 (ja) * | 2017-08-25 | 2021-01-20 | 東京エレクトロン株式会社 | 被処理体を処理する方法 |
JP6913569B2 (ja) | 2017-08-25 | 2021-08-04 | 東京エレクトロン株式会社 | 被処理体を処理する方法 |
US11227767B2 (en) | 2018-05-03 | 2022-01-18 | Tokyo Electron Limited | Critical dimension trimming method designed to minimize line width roughness and line edge roughness |
JP7066565B2 (ja) * | 2018-07-27 | 2022-05-13 | 東京エレクトロン株式会社 | プラズマ処理方法およびプラズマ処理装置 |
JP7278456B2 (ja) * | 2018-07-27 | 2023-05-19 | 東京エレクトロン株式会社 | プラズマ処理装置 |
JP7195113B2 (ja) * | 2018-11-07 | 2022-12-23 | 東京エレクトロン株式会社 | 処理方法及び基板処理装置 |
Family Cites Families (16)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE68923247T2 (de) * | 1988-11-04 | 1995-10-26 | Fujitsu Ltd | Verfahren zum Erzeugen eines Fotolackmusters. |
JP3445886B2 (ja) * | 1995-10-27 | 2003-09-08 | 松下電器産業株式会社 | 半導体装置の製造方法及び半導体装置の製造装置 |
JP3316407B2 (ja) * | 1997-02-26 | 2002-08-19 | シャープ株式会社 | 半導体装置の製造方法 |
US6635185B2 (en) * | 1997-12-31 | 2003-10-21 | Alliedsignal Inc. | Method of etching and cleaning using fluorinated carbonyl compounds |
JP2000077386A (ja) * | 1998-08-27 | 2000-03-14 | Seiko Epson Corp | パターン形成方法 |
US6362111B1 (en) * | 1998-12-09 | 2002-03-26 | Texas Instruments Incorporated | Tunable gate linewidth reduction process |
JP2000183027A (ja) * | 1998-12-11 | 2000-06-30 | Mitsubishi Electric Corp | 半導体装置の製造方法 |
TW525260B (en) * | 1999-08-02 | 2003-03-21 | Taiwan Semiconductor Mfg | Shallow trench isolation pull-back process |
US6461969B1 (en) * | 1999-11-22 | 2002-10-08 | Chartered Semiconductor Manufacturing Ltd. | Multiple-step plasma etching process for silicon nitride |
US6569774B1 (en) * | 2000-08-31 | 2003-05-27 | Micron Technology, Inc. | Method to eliminate striations and surface roughness caused by dry etch |
JP2002343780A (ja) * | 2001-05-01 | 2002-11-29 | Applied Materials Inc | ガス導入装置、成膜装置、及び成膜方法 |
CN1277293C (zh) * | 2001-07-10 | 2006-09-27 | 东京毅力科创株式会社 | 干蚀刻方法 |
JP2003077900A (ja) * | 2001-09-06 | 2003-03-14 | Hitachi Ltd | 半導体装置の製造方法 |
US20040097077A1 (en) * | 2002-11-15 | 2004-05-20 | Applied Materials, Inc. | Method and apparatus for etching a deep trench |
US20040224524A1 (en) * | 2003-05-09 | 2004-11-11 | Applied Materials, Inc. | Maintaining the dimensions of features being etched on a lithographic mask |
US6955961B1 (en) * | 2004-05-27 | 2005-10-18 | Macronix International Co., Ltd. | Method for defining a minimum pitch in an integrated circuit beyond photolithographic resolution |
-
2004
- 2004-06-25 JP JP2004188013A patent/JP4727171B2/ja not_active Expired - Fee Related
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Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR101061621B1 (ko) * | 2008-02-12 | 2011-09-01 | 도쿄엘렉트론가부시키가이샤 | 플라즈마 에칭 방법 및 컴퓨터 기억 매체 |
Also Published As
Publication number | Publication date |
---|---|
CN1300637C (zh) | 2007-02-14 |
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