KR100505645B1 - 동작주파수 정보 또는 카스 레이턴시 정보에 따라출력신호의 슬루율을 조절 할 수 있는 출력 드라이버 - Google Patents
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Abstract
Description
Claims (6)
- 반도체 메모리장치의 출력 드라이버에 있어서,출력단;상기 출력단에 연결되고 상기 출력단을 풀업시키는 풀업 드라이버;상기 출력단에 연결되고 상기 출력단을 풀다운시키는 풀다운 드라이버; 및상기 반도체 메모리장치의 외부에서 인가되며 상기 반도체 메모리장치의 동작주파수 정보를 포함하는 카스 레이턴시(CAS latency) 정보를 저장하는 모드 레지스터 셋트를 구비하고,상기 풀업 드라이버 및 상기 풀다운 드라이버의 구동능력이 상기 모드 레지스터에 저장된 상기 카스 레이턴시 정보에 응답하여 가변되는 것을 특징으로 하는 출력 드라이버.
- 제1항에 있어서, 상기 풀업 드라이버는,상기 출력단에 공통 연결되고 각각의 제어신호에 응답하여 선택적으로 인에이블되는 복수개의 풀업 트랜지스터들을 구비하고,상기 각각의 제어신호는 상기 모드 레지스터에 저장된 상기 카스 레이턴시 정보에 의해 발생되는 것을 특징으로 하는 출력 드라이버.
- 제1항에 있어서, 상기 풀다운 드라이버는,상기 출력단에 공통 연결되고 각각의 제어신호에 응답하여 선택적으로 인에이블되는 복수개의 풀다운 트랜지스터들을 구비하고,상기 각각의 제어신호는 상기 모드 레지스터에 저장된 상기 카스 레이턴시 정보에 의해 발생되는 것을 특징으로 하는 출력 드라이버.
- 반도체 메모리장치의 출력 드라이버에 있어서,출력단;상기 출력단에 연결되고 상기 출력단을 풀업시키는 풀업 드라이버;상기 출력단에 연결되고 상기 출력단을 풀다운시키는 풀다운 드라이버; 및상기 반도체 메모리장치의 외부에서 인가되는 동작클럭의 주파수를 검출하여 저장하는 주파수 검출기를 구비하고,상기 풀업 드라이버 및 상기 풀다운 드라이버의 구동능력이 상기 주파수 검출기에 저장된 상기 동작클럭의 주파수 정보에 응답하여 가변되는 것을 특징으로 하는 출력 드라이버.
- 제4항에 있어서, 상기 풀업 드라이버는,상기 출력단에 공통 연결되고 각각의 제어신호에 응답하여 선택적으로 인에이블되는 복수개의 풀업 트랜지스터들을 구비하고,상기 각각의 제어신호는 상기 주파수 검출기에 저장된 상기 동작클럭의 주파수 정보에 의해 발생되는 것을 특징으로 하는 출력 드라이버.
- 제4항에 있어서, 상기 풀다운 드라이버는,상기 출력단에 공통 연결되고 각각의 제어신호에 응답하여 선택적으로 인에이블되는 복수개의 풀다운 트랜지스터들을 구비하고,상기 각각의 제어신호는 상기 주파수 검출기에 저장된 상기 동작클럭의 주파수 정보에 의해 발생되는 것을 특징으로 하는 출력 드라이버.
Priority Applications (5)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR10-2002-0063475A KR100505645B1 (ko) | 2002-10-17 | 2002-10-17 | 동작주파수 정보 또는 카스 레이턴시 정보에 따라출력신호의 슬루율을 조절 할 수 있는 출력 드라이버 |
US10/631,412 US7035148B2 (en) | 2002-10-17 | 2003-07-30 | Output driver capable of controlling slew rate of output signal according to operating frequency information or CAS latency information |
TW092123298A TWI223265B (en) | 2002-10-17 | 2003-08-25 | Output driver capable of controlling slew rate of output signal according to operating frequency information or CAS latency information |
JP2003343642A JP2004139718A (ja) | 2002-10-17 | 2003-10-01 | 出力ドライバおよび出力駆動方法 |
US11/339,120 US7133318B2 (en) | 2002-10-17 | 2006-01-23 | Output driver capable of controlling slew rate of output signal according to operating frequency information or CAS latency information |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR10-2002-0063475A KR100505645B1 (ko) | 2002-10-17 | 2002-10-17 | 동작주파수 정보 또는 카스 레이턴시 정보에 따라출력신호의 슬루율을 조절 할 수 있는 출력 드라이버 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR20040034845A KR20040034845A (ko) | 2004-04-29 |
KR100505645B1 true KR100505645B1 (ko) | 2005-08-03 |
Family
ID=36574012
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR10-2002-0063475A KR100505645B1 (ko) | 2002-10-17 | 2002-10-17 | 동작주파수 정보 또는 카스 레이턴시 정보에 따라출력신호의 슬루율을 조절 할 수 있는 출력 드라이버 |
Country Status (4)
Country | Link |
---|---|
US (2) | US7035148B2 (ko) |
JP (1) | JP2004139718A (ko) |
KR (1) | KR100505645B1 (ko) |
TW (1) | TWI223265B (ko) |
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-
2002
- 2002-10-17 KR KR10-2002-0063475A patent/KR100505645B1/ko active IP Right Grant
-
2003
- 2003-07-30 US US10/631,412 patent/US7035148B2/en not_active Expired - Lifetime
- 2003-08-25 TW TW092123298A patent/TWI223265B/zh not_active IP Right Cessation
- 2003-10-01 JP JP2003343642A patent/JP2004139718A/ja active Pending
-
2006
- 2006-01-23 US US11/339,120 patent/US7133318B2/en not_active Expired - Fee Related
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---|---|
US7035148B2 (en) | 2006-04-25 |
KR20040034845A (ko) | 2004-04-29 |
US20040076039A1 (en) | 2004-04-22 |
JP2004139718A (ja) | 2004-05-13 |
US20060120180A1 (en) | 2006-06-08 |
US7133318B2 (en) | 2006-11-07 |
TWI223265B (en) | 2004-11-01 |
TW200406922A (en) | 2004-05-01 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A201 | Request for examination | ||
E902 | Notification of reason for refusal | ||
E701 | Decision to grant or registration of patent right | ||
GRNT | Written decision to grant | ||
FPAY | Annual fee payment |
Payment date: 20130701 Year of fee payment: 9 |
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FPAY | Annual fee payment |
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|
FPAY | Annual fee payment |
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|
FPAY | Annual fee payment |
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FPAY | Annual fee payment |
Payment date: 20170630 Year of fee payment: 13 |
|
FPAY | Annual fee payment |
Payment date: 20180629 Year of fee payment: 14 |