JPWO2012029874A1 - 信号処理回路、インバータ回路、バッファ回路、ドライバ回路、レベルシフタ、表示装置 - Google Patents
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Abstract
Description
本ドライバ回路でが、各段のフリップフロップは、ブートストラップ容量を含み、第1制御信号端子に接続される第1信号生成部と、第1電源に接続される第2信号生成部と、ブートストラップ容量をチャージする第1入力部と、上記ブートストラップ容量をディスチャージするディスチャージ部と、第2信号生成部に接続された第2入力部と、第2制御信号端子に接続され、上記ディスチャージ部および第2信号生成部を制御するリセット部とを含み、第1初期化信号が上記第1信号生成部を制御し、第2初期化信号が第1入力部を制御し、第3初期化信号がディスチャージ部および第2信号生成部を制御するものとして、
上記信号処理回路の入力端子に第1初期化信号を入力することで、上記信号処理回路の出力端子から第2初期化信号を得る構成とすることもできる。
INITB 第2初期化信号
INITKEEP 第3初期化信号
VDD 高電位側電源
VSS 低電位側電源
Tr21〜Tr24 第1〜第4トランジスタ
Claims (19)
- 第1および第2入力端子と、出力端子と、上記ブートストラップ容量を含み、第2入力端子および出力端子に接続される第1出力部と、上記第1入力端子並びに第1電源および出力端子に接続される第2出力部と、上記第1入力端子に接続され、上記ブートストラップ容量の電荷を制御する電荷制御部と、一端が出力端子に接続されるとともに他端が第2電源に接続される抵抗とを備える信号処理回路。
- 上記電荷制御部と第1出力部とが、両者間を電気的に接続あるいは遮断する中継部を介して接続され、上記電荷制御部には、第2電源に接続する抵抗が設けられている請求項1記載の信号処理回路。
- 上記第1出力部に、制御電極および一方の導通電極がブートストラップ容量を介して接続され、かつ他方の導通電極が第2入力端子に接続されるとともに、上記一方の導通電極が出力端子に接続される第1トランジスタを含み、
上記第2出力部に、一方の導通電極が第1電源に接続されるとともに、他方の導通電極が出力端子に接続され、かつ制御電極が第1入力端子に接続される第2トランジスタを含み、
上記電荷制御部に、一方の導通電極が第1電源に接続されるとともに、他方の導通電極がチャージ部に接続され、かつ制御電極が第1入力端子に接続される第3トランジスタを含む請求項1記載の信号処理回路。 - 上記中継部に、一方の導通電極が第1トランジスタの制御電極に接続されるとともに、他方の導通電極が電荷制御部に接続され、かつ制御電極が第2電源に接続される第4トランジスタを含む請求項2記載の信号処理回路。
- 上記入力端子には、アクティブ時に第2電源に対応する電位となる信号が入力される請求項1記載の信号処理回路。
- 第2入力端子には、第2電源からの信号が入力される請求項1記載の信号処理回路。
- 第2入力端子には、クロック信号が入力される請求項1記載の信号処理回路。
- 上記抵抗が、各トランジスタのチャネルを構成する材料で形成されている請求項2記載の信号処理回路。
- 反転出力端子と、上記ブートストラップ容量とは別のブートストラップ容量を含み、第2電源および反転出力端子に接続される第3出力部と、第1電源および反転出力端子に接続される第4出力部とを備え、
上記別のブートストラップ容量は上記第1入力端子からチャージされ、
上記第4出力部は上記電荷制御部あるいは出力端子に接続される請求項1記載の信号処理回路。 - 反転出力端子と、上記ブートストラップ容量とは別のブートストラップ容量を含み、第2電源および反転出力端子に接続される第3出力部と、第1電源および反転出力端子に接続される第4出力部と、上記電荷制御部とは別の電荷制御部とを備え、
上記別のブートストラップ容量は上記別の電荷制御部からチャージされ、
上記第4出力部は上記電荷制御部あるいは出力端子に接続される請求項1記載の信号処理回路。 - 請求項1〜10のいずれか1項に記載の信号処理回路を備えたインバータ回路。
- 請求項1〜10のいずれか1項に記載の信号処理回路を備えたバッファ回路。
- 請求項1〜10のいずれか1項に記載の信号処理回路を備えたレベルシフタ。
- 請求項1〜10のいずれか1項に記載の信号処理回路を備えたフリップフロップ。
- 請求項1〜10のいずれか1項に記載の信号処理回路を備えたドライバ回路。
- 各段にフリップフロップを含むシフトレジスタを備え、上記信号処理回路から出力された信号が各段のフリップフロップに入力される請求項15記載のドライバ回路。
- 上記信号処理回路から出力された信号は、シフトレジスタの初期化時にアクティブとなる請求項16記載のドライバ回路。
- 各段のフリップフロップは、ブートストラップ容量を含み、第1制御信号端子に接続される第1信号生成部と、第1電源に接続される第2信号生成部と、ブートストラップ容量をチャージする第1入力部と、上記ブートストラップ容量をディスチャージするディスチャージ部と、第2信号生成部に接続された第2入力部と、第2制御信号端子に接続され、上記ディスチャージ部および第2信号生成部を制御するリセット部とを含み、
第1初期化信号が上記第1信号生成部を制御し、第2初期化信号が第1入力部を制御し、第3初期化信号がディスチャージ部および第2信号生成部を制御するものとして、
上記信号処理回路の入力端子に第1初期化信号を入力することで、上記信号処理回路の出力端子から第2初期化信号を得る請求項16記載のドライバ回路。 - 請求項1〜10のいずれか1項に記載の信号処理回路を備えた表示装置。
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