JP6874997B2 - 転送回路、シフトレジスタ、ゲートドライバ、表示パネル、およびフレキシブル基板 - Google Patents
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Description
本発明の実施の形態について説明する前に、従来例に係るレジスタ回路の動作、および、本発明者によって見出された誤動作の可能性について説明する。
以下、本発明の実施の形態について、図面を参照しながら説明する。
21 ライトスキャナ
22 行電源スキャナ
23 水平セレクタ
31、32 走査信号線
33 データ信号線
50、51 ゲートドライバ
100〜106 転送回路
110、111 入力回路
120〜123 リセット回路
130 出力回路
140〜143 出力安定化回路
150、151、152、160、161、162 反転回路
700、701 シフトレジスタ
800 バッファ回路
900 出力信号線
Claims (15)
- 入力回路、リセット回路、出力回路、出力安定化回路から構成され、クロック信号に同期して、入力端にて入力信号を取得して保持し、保持された入力信号を出力信号として出力端から出力する転送回路において、
入力端が前記転送回路の前記入力端に接続され、前記入力信号の極性を反転した反転信号を出力端から出力する第1の反転回路、および、入力端が前記転送回路の前記出力端に接続され、前記出力信号の極性を反転した反転信号を出力端から出力する第2の反転回路の少なくとも一方を含み、
前記リセット回路は、制御信号端が前記第1の反転回路の前記出力端に接続され、前記入力信号を保持する第1の容量の一端と第1の電源との間の信号経路の導通および非導通を切り替える第1のトランジスタを含み、前記第1の容量の一端と前記第1の電源との間の信号経路を導通させることで、前記第1の容量の一端に印加される電圧をリセットし、
前記出力安定化回路は、前記転送回路の前記出力信号を第2の電源の電源電位とすることで、前記出力信号を安定化させ、
前記第2の反転回路は、
一端が前記第2の反転回路の入力端に接続された第2の容量と、
第1の主信号端が第3の電源に接続され、第2の主信号端が前記第2の容量の他端に接続された第3のトランジスタと、
第1の主信号端が前記第2の反転回路の出力端に接続され、第2の主信号端が第4の電源に接続された第4のトランジスタと、
第1の主信号端が前記第2の反転回路の前記出力端に接続され、第2の主信号端が第5の電源に接続された第5のトランジスタと、から形成される、
転送回路。 - 前記リセット回路は前記第1の反転回路を含み、前記第1の反転回路の前記入力端は前記転送回路の前記入力端に接続されている、
請求項1に記載の転送回路。 - 前記出力安定化回路は前記第2の反転回路を含み、前記第2の反転回路の前記入力端は前記転送回路の前記出力端に接続され、
前記出力安定化回路は、制御信号端が前記第2の反転回路の前記出力端に接続され、第1の主信号端が前記第2の電源に接続され、第2の主信号端が前記転送回路の前記出力端に接続されている第2のトランジスタをさらに含む、
請求項1に記載の転送回路。 - 前記第1の反転回路は、前記リセット回路に含まれ、
前記第2の反転回路は、前記出力安定化回路に含まれ、
前記第1のトランジスタの制御信号端は、前記第1の反転回路の前記出力端に接続され、
前記出力安定化回路は、制御信号端が前記第2の反転回路の前記出力端に接続され、第1の主信号端が前記第2の電源に接続され、第2の主信号端が前記転送回路の前記出力端に接続されている第2のトランジスタをさらに含む、
請求項1に記載の転送回路。 - 入力回路、リセット回路、出力回路、出力安定化回路から構成され、クロック信号に同期して、入力端にて入力信号を取得して保持し、保持された入力信号を出力信号として出力端から出力する転送回路において、
入力端が前記転送回路の前記入力端に接続され、前記入力信号の極性を反転した反転信号を出力端から出力する第1の反転回路、および、入力端が前記転送回路の前記出力端に接続され、前記出力信号の極性を反転した反転信号を出力端から出力する第2の反転回路の少なくとも一方を含み、
前記リセット回路は、制御信号端が前記第1の反転回路の前記出力端に接続され、前記入力信号を保持する第1の容量の一端と第1の電源との間の信号経路の導通および非導通を切り替える第1のトランジスタを含み、前記第1の容量の一端と前記第1の電源との間の信号経路を導通させることで、前記第1の容量の一端に印加される電圧をリセットし、
前記出力安定化回路は、前記転送回路の前記出力信号を第2の電源の電源電位とすることで、前記出力信号を安定化させ、
前記第1の反転回路は、前記リセット回路に含まれ、
前記第2の反転回路は、前記出力安定化回路に含まれ、
前記第1のトランジスタの制御信号端は、前記第1の反転回路の前記出力端に接続され、
前記出力安定化回路は、制御信号端が前記第2の反転回路の前記出力端に接続され、第1の主信号端が前記第2の電源に接続され、第2の主信号端が前記転送回路の前記出力端に接続されている第2のトランジスタをさらに含む、
転送回路。 - 前記第1の反転回路には、前記転送回路と同一のパルスが入力されている、
請求項1〜5のいずれか1項に記載の転送回路。 - 前記出力回路は、第1の主信号端がパルス電源に接続され、第2の主信号端が前記転送回路の出力端に接続され、制御信号端が前記第1の容量の前記一端に接続された第6のトランジスタと、前記第1の容量とから構成されており、
前記入力回路は、第1の主信号端が前記転送回路の入力端に接続され、第2の主信号端が前記第6のトランジスタの制御信号端に接続されている第7のトランジスタを含み、
前記リセット回路は、前記第1の容量の前記一端と前記第1の電源との間の信号経路に前記第1のトランジスタと直列に接続された第8のトランジスタをさらに含む、
請求項5に記載の転送回路。 - 前記第7のトランジスタの制御信号端と前記第8のトランジスタの制御信号端とに同一の制御信号が入力されている、
請求項7に記載の転送回路。 - 入力回路、リセット回路、出力回路、出力安定化回路から構成され、クロック信号に同期して、入力端にて入力信号を取得して保持し、保持された入力信号を出力信号として出力端から出力する転送回路において、
入力端が前記転送回路の前記入力端に接続され、前記入力信号の極性を反転した反転信号を出力端から出力する第1の反転回路、および、入力端が前記転送回路の前記出力端に接続され、前記出力信号の極性を反転した反転信号を出力端から出力する第2の反転回路の少なくとも一方を含み、
前記リセット回路は、制御信号端が前記第1の反転回路の前記出力端に接続され、前記入力信号を保持する第1の容量の一端と第1の電源との間の信号経路の導通および非導通を切り替える第1のトランジスタを含み、前記第1の容量の一端と前記第1の電源との間の信号経路を導通させることで、前記第1の容量の一端に印加される電圧をリセットし、
前記出力安定化回路は、前記転送回路の前記出力信号を第2の電源の電源電位とすることで、前記出力信号を安定化させ、
前記出力安定化回路は前記第2の反転回路を含み、前記第2の反転回路の前記入力端は前記転送回路の前記出力端に接続され、
前記出力安定化回路は、制御信号端が前記第2の反転回路の前記出力端に接続され、第1の主信号端が前記第2の電源に接続され、第2の主信号端が前記転送回路の前記出力端に接続されている第2のトランジスタをさらに含み、
前記出力回路は、第1の主信号端がパルス電源に接続され、第2の主信号端が前記転送回路の出力端に接続され、制御信号端が前記第1の容量の前記一端に接続された第6のトランジスタと、前記第1の容量とから構成されており、
前記入力回路は、第1の主信号端が前記転送回路の入力端に接続され、第2の主信号端が前記第6のトランジスタの制御信号端に接続されている第7のトランジスタを含み、
前記リセット回路は、前記第1の容量の前記一端と前記第1の電源との間の信号経路に前記第1のトランジスタと直列に接続された第8のトランジスタをさらに含む、
転送回路。 - 前記第7のトランジスタの制御信号端に入力される制御信号と前記第8のトランジスタのゲートに入力される制御信号とは同時にHighレベルになることがない、
請求項9に記載の転送回路。 - 前記転送回路を構成する各トランジスタは、酸化物半導体トランジスタである、
請求項7又は9に記載の転送回路。 - 請求項1から11のいずれか1項に記載の転送回路を各段に有するシフトレジスタ。
- 請求項12に記載のシフトレジスタと、
前記シフトレジスタの各段の出力信号を処理するバッファ回路と、
を備えるゲートドライバ。 - 請求項13に記載のゲートドライバを搭載した表示パネル。
- 請求項13に記載のゲートドライバを搭載したフレキシブル基板。
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