JPWO2011040437A1 - Esd保護デバイスおよびその製造方法 - Google Patents

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Abstract

繰り返して静電気を印加しても特性の劣化を生じない、安定した特性を備えたESD保護デバイスおよびその製造方法を提供する。セラミック基材1の内部に、対向するように形成された一方側対向電極2aと他方側対向電極2bとを備えてなる対向電極2と、一方側対向電極と他方側対向電極のそれぞれと接し、一方側対向電極から他方側対向電極にわたるように配設された放電補助電極3とを具備し、放電補助電極は、金属粒子と、半導体粒子と、ガラス質とを含み、かつ、金属粒子間、半導体粒子間、および金属粒子と半導体粒子の間が、ガラス質を介して結合しているとともに、金属粒子の平均粒子径Xが1.0μm以上であり、放電補助電極の厚みYと、金属粒子の平均粒子径Xとの関係が、0.5≦Y/X≦3の要件を満たす構成とする。

Description

本発明は半導体装置などを静電気破壊から保護するESD保護デバイスおよびその製造方法に関する。
近年、民生機器を使用するにあたって、入出力インターフェースであるケーブルの抜差し回数が増える傾向にあり、入出力コネクタ部に静電気が印加されやすい状況にある。また、信号周波数の高周波化に伴って、設計ルールの微細化でパスが作り込みにくくなり、LSI自体が静電気に対して脆弱になっている。
そのため、静電気放電(ESD)(Electron−Statics Discharge)から、LSIなどの半導体装置を保護するESD保護デバイスが広く用いられるに至っている。
このようなESD保護デバイスとして、第1の電極と第2の電極の間に接続され、かつ、非導体粉末(炭化ケイ素粉末)と、金属導体粉末(Cu粉末)と、粘着剤(ガラス)とを含む過電圧保護素子の材料を用いて焼成処理して生成された多孔構造部とを備えた過電圧保護素子が提案されている。
しかし、この過電圧保護素子の場合、粘着材(ガラス)の添加が不可欠であるため、以下の問題が生じる可能性がある。
(1)ガラスの分散不良により、製品の特性にばらつきが大きくなる傾向があり、信頼性の高い製品を提供することが困難である。
(2)ガラスの分散不良により、繰り返しESDが印加されるとショート耐性が劣化する傾向がある。
特開2008−85284号公報
本発明は、上記実情に鑑みてなされたものであり、安定した特性を備え、繰り返して静電気を印加しても特性の劣化を生じないESD保護デバイスおよびその製造方法を提供することを目的とする。
上記課題を解決するために、本発明のESD保護デバイスは、
セラミック基材の内部に、先端部が間隔をおいて対向するように形成された一方側対向電極と他方側対向電極とを備えてなる対向電極と、
前記対向電極を構成する前記一方側対向電極と前記他方側対向電極のそれぞれと接し、前記一方側対向電極から前記他方側対向電極にわたるように配設された放電補助電極と
を具備し、
前記放電補助電極は、金属粒子と、半導体粒子と、ガラス質とを含み、かつ、
前記金属粒子間、前記半導体粒子間、および前記金属粒子と前記半導体粒子の間が、前記ガラス質を介して結合しているとともに、
前記金属粒子の平均粒子径Xが1.0μm以上であり、前記放電補助電極の厚みYと、前記金属粒子の平均粒子径Xとの関係が、0.5≦Y/X≦3の要件を満たすこと
を特徴としている。
前記金属粒子はCu粒子であることが好ましく、また、前記半導体粒子は炭化ケイ素粒子であることが好ましい。
また、前記ガラス質は、前記金属粒子と前記半導体粒子との反応により生じるものであることが望ましい。
また、前記対向電極を構成する前記一方側対向電極と前記他方側対向電極の先端部が互いに対向する放電ギャップ部および前記放電補助電極の前記放電ギャップ部に位置する領域が、前記セラミック基材内部に設けられた空洞部に臨んでいることが望ましい。
また、本発明のESD保護デバイスの製造方法は、
第1のセラミックグリーンシートの一方主面上に、平均粒子径が1.0μm以上の金属粒子と、半導体粒子と、有機ビヒクルとを含むとともに、前記金属粒子と前記半導体粒子の少なくとも一方が、表面にガラスの網目形成成分を有し、かつ、前記金属粒子と前記半導体粒子とを合わせたものが占める割合が7体積%〜25体積%である放電補助電極ペ−ストを印刷することにより、未焼成の放電補助電極を形成する工程と、
前記第1のセラミックグリーンシートの一方主面上に、対向電極ペーストを印刷することにより、それぞれが、前記放電補助電極の一部を覆うとともに、互いに間隔をおいて配設された一方側対向電極と他方側対向電極とを備える未焼成の対向電極を形成する工程と、
前記第1のセラミックグリーンシートの一方主面上に、第2のセラミックグリーンシートを積層して未焼成の積層体を形成する工程と、
前記積層体を焼成し、前記放電補助電極の前記金属粒子の表面と前記半導体粒子の表面とを反応させることにより、ガラス質を生成させる工程と
を備えている。
また、前記放電補助電極に含まれる金属粒子がアルミナコートCu粒子であり、前記半導体粒子が炭化ケイ素粒子であることを特徴としている。
本発明のESD保護デバイスは、互いに対向する一方側対向電極と他方側対向電極とを備えた対向電極と、一方側対向電極と他方側対向電極の一部と接し、一方側対向電極から他方側対向電極にわたるように配設された放電補助電極とを具備しており、放電補助電極は、少なくとも、金属粒子および半導体粒子およびガラス質を含み、かつ、金属粒子間、半導体粒子間、金属粒子と半導体粒子の間が、ガラス質を介して結合しているとともに、金属粒子の平均粒子径Xが1.0μm以上、放電補助電極の厚みYと、金属粒子の平均粒子径Xとの関係が、0.5≦Y/X≦3の要件を満たしているので、安定した特性を備え、繰り返して静電気を印加しても特性の劣化を生じないESD保護デバイスを提供することが可能になる。
なお、本発明において、金属粒子間、半導体粒子間、および金属粒子と半導体粒子間が、ガラス質を介して結合しているとは、
(a)各粒子間に充満するガラス質により各粒子が結びつけられている場合、
(b)各粒子の全体がガラス質により覆われ、かつ、該ガラス質により各粒子が結合している場合、
(c)ガラス質が各粒子の全体を覆ったり、各粒子間に充満したりしておらず、例えば、各粒子の表面に点在するガラス質により各粒子が結合している場合、
などを含む広い概念である。
本発明のESD保護デバイスにおいては、金属粒子はCu粒子であることが好ましいが、これは、金属粒子としてCu粒子を用いることにより、放電開始電圧やピーク電圧を低くすることが可能なESD保護デバイスを構成することができることによる。
また、半導体粒子としては炭化ケイ素粒子を用いることが好ましいが、これは、半導体粒子として炭化ケイ素粒子を用いることにより、クランプ電圧を低くすることが可能になることによる。
また、本発明のESD保護デバイスにおいて、ガラス質が、金属粒子と半導体粒子との反応により生成するものの場合、原料に別途ガラス成分を添加することを必要とせずに、ガラス質が均一に分散された放電補助電極を効率よくしかも確実に形成することができる。
また、対向電極を構成する一方側対向電極と他方側対向電極の先端部が互いに対向する放電ギャップ部および放電補助電極の放電ギャップ部に位置する領域が、セラミック基材内部に設けられた空洞部に臨むようにした場合、ESD印加時に空洞部でも放電現象が起きるため、空洞部がない場合よりも放電能力を向上させることが可能になり、有意義である。
また、本発明のESD保護デバイスの製造方法は、第1のセラミックグリーンシートの一方主面上に、平均粒子径が1.0μm以上の金属粒子と、半導体粒子と、有機ビヒクルとを含むとともに、金属粒子と半導体粒子の少なくとも一方が表面にガラスの網目形成成分を有し、かつ、前記金属粒子と前記半導体粒子とを合わせたものが占める割合が7体積%〜25体積%である放電補助電極ペ−ストを印刷することにより未焼成の放電補助電極を形成する工程と、放電補助電極の一部を覆うとともに、互いに間隔をおいて、対向電極ペーストを印刷することにより、間隔をおいて配設された一方側対向電極と他方側対向電極とを備える未焼成の対向電極を形成する工程と、第1のセラミックグリーンシートの一方主面上に第2のセラミックグリーンシートを積層して未焼成の積層体を形成する工程と、積層体を焼成し、放電補助電極の金属粒子の表面と半導体粒子の表面とを反応させることによりガラス質を生成させる工程とを備えているので、本発明の構成を備えたESD保護デバイスを効率よく、しかも確実に製造することが可能になる。
なお、上記積層体を焼成する工程の前に、未焼成の積層体の表面に、対向電極と接続するように外部電極ペーストを印刷し、その後に焼成することにより外部電極を備えたESD保護デバイスを得るようにすることも可能であり、また、上記積層体の焼成後に、積層体の表面に外部電極ペーストを印刷し、焼き付けることにより外部電極を形成することも可能である。
なお、本発明のESD保護デバイスの製造方法において、金属粒子と半導体粒子の少なくとも一方が表面に有しているガラスの網目形成成分とは、その成分単独でもガラスになるものであり、例えば、SiO2、B23、Al23、P25、ZrO2、V25、TiO2、ZnO、GeO2、As25、Sb25、PbO、BeO等が挙げられる。
また、放電補助電極に含まれる金属粒子としてアルミナコートCu粒子を用い、半導体粒子用の原料として炭化ケイ素粒子を用いた場合、アルミナ(Al23)や、炭化ケイ素の表面に通常存在することになる微量の酸化ケイ素などがガラスの網目形成成分として機能し、放電補助電極を構成する金属粒子間、半導体粒子間、あるいは金属粒子と半導体粒子の間が、ガラス質を介して結合した、安定した特性を備え、繰り返して静電気を印加しても特性の劣化を生じないESD保護デバイスを効率よく製造することが可能になる。
本発明の実施例にかかるESD保護デバイスの構成を模式的に示す正面断面図である。 本発明の実施例にかかるESD保護デバイスの要部を拡大して示す要部拡大正面断面図である。 本発明の実施例にかかるESD保護デバイスの内部構成を示す平面図である。
以下、本発明の実施例を示して、本発明の特徴とするところをさらに詳しく説明する。
[実施例にかかるESD保護デバイスの構成]
図1は、本発明の一実施例にかかるESD保護デバイスの構造を模式的に示す断面図であり、図2は、その要部を拡大して示す要部拡大正面断面図、図3は本発明の一実施例にかかるESD保護デバイスの平面断面図である。
このESD保護デバイスは、図1〜3に示すように、セラミック基材1と、セラミック基材1内の同一平面に形成された、先端部が互いに対向する一方側対向電極2aと他方側対向電極2bからなる対向電極(引出電極)2と、一方側対向電極2aと他方側対向電極2bの一部と接し、一方側対向電極2aから他方側対向電極2bにわたるように形成された放電補助電極3と、セラミック基材1の両端部に、対向電極2を構成する一方側対向電極2aおよび他方側対向電極2bと導通するように配設された、外部との電気的な接続のための外部電極5a,5bを備えている。
放電補助電極3は、金属粒子、半導体粒子およびガラス質を含んでおり、金属粒子間、半導体粒子間、および金属粒子と半導体粒子の間が、ガラス質を介して結合している。なお、このガラス質は、金属粒子と半導体粒子との反応により生じた反応生成物である。
また、金属粒子としてはCu粒子が用いられており、半導体粒子としては炭化ケイ素粒子が用いられている。
そして、本発明のESD保護デバイスにおいては、放電補助電極3の厚みYと、金属粒子の平均粒子径Xとの関係が、0.5≦Y/X≦3の要件(すなわち本発明の要件)を満たすように構成されている。
また、対向電極2を構成する一方側対向電極2aと他方側対向電極2bの互いに対向する放電ギャップ部10、放電補助電極3の放電ギャップ部10に位置する領域は、セラミック基材1の内部に設けられた空洞部12に臨むように配設されている。すなわち、このESD保護デバイスにおいては、放電ギャップ部10や一方側対向電極2aと他方側対向電極2bを接続する放電補助電極3などの、ESD保護デバイスとしての機能を果たすべき機能部が、セラミック基材の内部の空洞部12に臨むように配設されている。
さらに、このESD保護デバイスにおいては、一方側対向電極2aと他方側対向電極2bの対向部分(放電ギャップ部10)、対向電極2と放電補助電極3との接続部、および放電補助電極3の放電ギャップ部10に位置する領域、空洞部12などを覆うように、シール層11が配設されている。このシール層11は、アルミナなどのセラミック粒子からなる、ポーラスな層で、セラミック基材1に含まれているガラス成分や焼成工程でセラミック基材1において生成するガラス成分を吸収保持(トラップ)して、ガラス成分が空洞部12やその内部の放電ギャップ部10などに流れ込むことを防止する機能を果たす。そして、その結果、放電補助電極3にガラス成分が流れ込んで、焼結が進みすぎ、放電補助電極3の導電性が高くなりすぎてショート不良を引き起こすことを防止したり、空洞部へのガラス成分の流れ込みを阻止して、空洞部を確保し、空洞部でも放電現象が起きるようにして高い放電能力を確保することが可能になる。
また、この実施例のESD保護デバイスにおいては、セラミック基材1として、平面形状が方形で、長さ1.0mm、幅0.5mm、厚み0.3mmのBa、Al、Siの酸化物を主成分とするガラスセラミック基板が用いられている。
ただし、セラミック基材1の構成材料に制約はなく、場合によってはアルミナ基板やシリコン基板など他の種類のものを用いることも可能である。なお、セラミック基材1としては比誘電率が50以下、好ましくは10以下のものを用いることが望ましい。
以下に、上述のような構造を有するESD保護デバイスの製造方法について説明する。
[ESD保護デバイスの製造]
(1)セラミックグリーンシートの作製
セラミック基材1の材料となるセラミック材料として、Ba、Al、Siを主たる成分とする材料を用意する。
そして、各材料を所定の組成になるよう調合し、800〜1000℃で仮焼する。得られた仮焼粉末をジルコニアボールミルで12時間粉砕し、セラミック粉末を得る。
このセラミック粉末に、トルエン・エキネンなどの有機溶媒を加え混合した後、さらにバインダー、可塑剤を加え、混合することによりスラリーを作製する。
このスラリーをドクターブレード法により成形し、厚さ50μmのセラミックグリーンシートを作製した。
(2)対向電極ペーストの作製
また、一対の対向電極2a,2bを形成するための対向電極ペーストとして、平均粒径約2μmのCu粉80重量%と、エチルセルロースなどからなるバインダー樹脂を調合し、溶剤を添加して3本ロールにより撹拌、混合することにより対向電極ペーストを作製した。なお、上記のCu粉の平均粒径とは、マイクロトラックによる粒度分布測定から求めた中心粒径(D50)をいう。
(3)放電補助電極ペーストの作製
さらに、放電補助電極3を形成するための放電補助電極ペーストとして、金属粒子(金属導体粉末)と、半導体粒子(半導体粉末)を所定の割合で配合し、ビヒクルを添加して3本ロールにより撹拌、混合することにより放電補助電極ペーストを作製した。
なお、放電補助電極ペーストは、ビヒクルの体積分率が75〜95vol%、金属粒子、半導体粒子の体積分率が残りの5〜25vol%となるようにした。
なお、評価に用いた金属粒子(金属導体粉末)種を表1に示す。
表1中のAl23コート量(重量%),およびZrO2コート量(重量%)は、コートCu粒子全体に占めるコート種の重量割合であり、残部は金属粒子(金属導体粉末)である。
さらに、評価に用いた半導体粒子(半導体粉末)種を表2に示す。また、表2には、比較評価に用いた絶縁体粒子(絶縁体粉末)種を併せて示す。
さらに、ビヒクルの組成、すなわち、バインダーの種類、溶剤種、分散剤種、およびそれらの配合割合を表3に示す。
また、金属粒子、および半導体粒子、絶縁体粒子、ビヒクルを使用して作製した放電補助電極ペーストの組成(vol%)を表4および5に示す。
Figure 2011040437
Figure 2011040437
Figure 2011040437
Figure 2011040437
Figure 2011040437
(4)シール層を形成するために用いられるシール層ペーストの作製
上述のシール層を形成するためのペーストとして、アルミナと有機ビヒクルを含むシール層ペーストを用意した。
(5)空洞部形成用の樹脂ペーストの作製
上述の空洞部12を形成するためのペーストとして、樹脂、有機溶剤、有機バインダーなど、焼成工程で分解、燃焼して消失する樹脂ペーストを作製した。
(6)各ペーストの印刷
上述の放電補助電極ペースト、対向電極ペースト、シール層ペースト、および空洞部形成用の樹脂ペーストを、第1のセラミックグリーンシ−ト上に印刷する。
具体的には、まず、第1のセラミックグリーンシートにシール層ペーストを塗布する。
それから、シール層ペースト上に放電補助電極ペーストを所定のパターンとなるように、スクリーン印刷法により印刷し、乾燥させることにより、未焼成の放電補助電極を形成する。本発明では、ここで、得られるESD保護デバイスにおいて、放電補助電極を構成する金属粒子の平均粒子径Xが1.0μm以上であり、前記放電補助電極の厚みYと、前記金属粒子の平均粒子径Xとの関係が、0.5≦Y/X≦3の要件を満たすようにする。
さらに、対向電極ペーストを塗布して、対向電極を構成する未焼成の一方側対向電極,他方側対向電極を形成する。これにより、一方側対向電極2aと他方側対向電極2bの互いに対向する先端部どうし間には、放電ギャップ10が形成される。
なお、この実施例では、焼成後の段階で、対向電極2を構成する一方側対向電極2a,他方側対向電極2bの幅W(図3)が100μm、放電ギャップ10の寸法G(図3)が30μmとなるようにした。
それから、対向電極2および放電補助電極3の上から、空洞部12を形成すべき領域に、空洞部形成用の樹脂ペーストを塗布する。
さらに、その上から空洞部形成用の樹脂ペーストを覆うように、シール層ペーストを塗布して未焼成のシール層を形成する。
(7)積層、圧着
上述のようにして、シール層ペースト、放電補助電極ペースト、対向電極ペースト、樹脂ペースト、シール層ペーストの順で各ペーストを塗布した第1のセラミックグリーンシート上に、ペーストの塗布されていない第2のセラミックグリーンシートを積層し、圧着する。ここでは焼成後に厚みが0.3mmとなる積層体が形成されるようにした。
(8)カット、外部電極ペーストの塗布
積層体をマイクロカッタでカットして、各チップに分割する。ここでは、焼成後に、長さ1.0mm、幅0.5mmになるようにカットした。その後、端面に外部電極ペーストを塗布して未焼成の外部電極を形成した。
(9)焼成
次いで、外部電極ペーストを塗布したチップをN2雰囲気中で焼成する。
なお、ESDに対する応答電圧を下げるため、空洞部12にAr,Ne等の希ガスを導入する場合には、セラミック材料の収縮、焼結が行われる温度領域における焼成工程をAr,Neなどの希ガス雰囲気中で実施すればよい。酸化しない電極材料を用いる場合には、大気雰囲気で焼成することも可能である。
(10)めっき
上記(9)の焼成工程で形成された外部電極上に電解めっきによりNiおよびSnめっきの順でめっきを施す。これにより、Niめっき膜およびSnめっき膜を備え、はんだ付け性などの特性に優れた外部電極が形成される。
これにより、図1〜3に示すような構造を有するESD保護デバイスが得られる。
[特性の評価]
次に、上述のようにして作製したESD保護デバイスについて、以下の方法で各特性を調べた。
(1)ショート耐性
ショート耐性は、接触放電にて8kV印加を50回、4kV印加を10回、2kV印加を10回、1kV印加を10回、0.5kV印加を10回、0.2kV印加を10回行った後のIRを調べることにより評価した。
IRが106Ω未満のものについてはESD印加によるショート耐性が不良(×印)であると判定し、106Ω以上のものについてはショート耐性が良好(○印)と判定した。
(2)ESD放電応答性
繰り返しESDに対する応答性であるESD放電応答性(ESD繰返し耐性)の評価を行うにあたっては、まず、それぞれ100個の試料について、IECの規格、IEC61000−4−2に規定されている静電気放電イミュニティ試験を行い、その平均値を求めた。それから、各試料について、上記(1)の場合と同様に、接触放電にて8kV印加を50回、4kV印加を10回、2kV印加を10回、1kV印加を10回、0.5kV印加を10回、0.2kV印加を10回行った後、静電気放電イミュニティ試験を行い、ESD放電応答性(ESD繰返し耐性)を調べた。
繰り返して静電気を印加した後の静電気放電イミュニティ試験において、保護回路側で検出されたピーク電圧が900Vを超えるものについてはESD放電応答性が不良(×印)である判定し、ピーク電圧が900V以下のものについてはESD放電応答性が良好(○印)であると判定した。
なお、焼成後の積層体10個について、対向電極のW=1/2の地点で積層方向にカットし、放電補助電極を露出させ、その断面を研磨した。次に、断面に露出させた放電補助電極を金属顕微鏡を用いて観察し、観察された個々の金属粒子の円相当径を画像処理ソフトを用いて測長し、その平均値を放電補助電極を構成する金属粒子の平均粒子径Xと定義した。また、同様にして個々の放電補助電極の厚みを画像処理ソフトにて測長し、その平均値を放電補助電極の厚みYと定義した。そして、この平均粒子径Xと放電補助電極の厚みYの値から、両者の関係Y/Xを求めた。
(3)総合判定
上記のショート耐性とESD放電応答性の2つの特性評価結果の両方が良好であるものを総合判定良好(○印)と評価し、どちらか一方または両方が不良であるものを総合判定不良(×印)と評価した。
表6および7に、放電補助電極ペーストの条件、平均粒子径Xと放電補助電極の厚みYの関係、特性評価結果などを示す。
表6および7において、試料番号に*を付したものは、本発明の要件を備えていない試料である。
Figure 2011040437
Figure 2011040437
表6および7より、放電補助電極に含まれる金属粒子の平均粒子径Xが1.0μm未満で、本発明の要件を備えていない試料番号1〜10のESD保護デバイスでは、ショート耐性およびESD放電応答性が繰り返しESD印加により、劣化することが確認された。
また、放電補助電極の厚みYと金属の平均粒子径Xとの関係が、0.5>Y/Xと、本発明の要件を満たさない試料番号11、16、21、25、29、33、34および38のESD保護デバイスでは、ショート耐性が劣化することが確認された。
一方、放電補助電極に含まれる金属粒子の平均粒子径Xが、1.0μm以上であり、かつ放電補助電極の厚みYと金属の平均粒子径Xとの関係が、0.5≦Y/X≦3と本発明の要件を備えた試料番号12〜15、17〜20、22〜24、26〜28、30〜32、35〜37、および39〜49のESD保護デバイスの場合、ショート耐性が良好であり、かつESD放電応答性が良好であった。
また、半導体粒子SiCの替わりに、絶縁体粒子Al23を使用した試料番号50〜52のESD保護デバイスでは、ショート耐性が劣化することが確認された。
これは、放電補助電極中のCu密度が局所的に高くなったことが原因と考えられる。すなわち、放電補助電極中に局所的に存在する微粒のAl23によって過剰な液相成分が形成され、局所的にCu粒子が過焼結状態になったことによるものと推察される。
上記実施例の結果から、放電補助電極を構成する金属粒子の平均粒子径Xが1.0μm以上で、放電補助電極の厚みYと金属粒子の平均粒子径Xとの関係が0.5≦Y/X≦3の要件を満たす場合には、
(a)繰り返しESD印加によるショート耐性が良好であること、
(b)ガラスを添加しなくても、焼成工程で放電補助電極を構成する金属粒子の表面と半導体粒子の表面とが反応してガラス質が生成し、金属粒子間、半導体粒子間、および金属粒子と半導体粒子の間がこのガラス質により結合した放電補助電極が形成されるため、繰り返して静電気を印加した場合にもショート耐性が良好に保たれること
が確認された。
上記実施例では、シール層および空洞部を備えたESD保護デバイスを例にとって説明したが、本発明は、シール層および空洞部のいずれか一方を備えていない構成や、シール層および空洞部のいずれをも備えていない構成とすることも可能である。
なお、本発明は上記実施例に限定されるものではなく、対向電極の構成材料、その具体的な形状、放電補助電極の具体的な形状、放電補助電極を構成する金属粒子、半導体粒子の種類、金属粒子間、半導体粒子間、および金属粒子と半導体粒子の間を結合させる機能を果たすガラス質の種類、シール層や空洞部の形成方法などに関し、発明の範囲内において、種々の応用、変形を加えることが可能である。
上述のように、本発明によれば、安定した特性を備え、繰り返して静電気を印加しても特性の劣化を生じないESD保護デバイスを提供することが可能になる。したがって、本発明は半導体装置などをはじめとする種々の機器、装置の保護のために用いられるESD保護デバイスの分野に広く適用することが可能である。
1 セラミック基材
2 対向電極
2a 対向電極を構成する一方側対向電極
2b 対向電極を構成する他方側対向電極
3 放電補助電極
5a,5b 外部電極
11 シール層
12 空洞部
10 放電ギャップ部
W 対向電極の幅
G 放電ギャップ部の寸法

Claims (7)

  1. セラミック基材の内部に、先端部が間隔をおいて対向するように形成された一方側対向電極と他方側対向電極とを備えてなる対向電極と、
    前記対向電極を構成する前記一方側対向電極と前記他方側対向電極のそれぞれと接し、前記一方側対向電極から前記他方側対向電極にわたるように配設された放電補助電極と
    を具備し、
    前記放電補助電極は、金属粒子と、半導体粒子と、ガラス質とを含み、かつ、
    前記金属粒子間、前記半導体粒子間、および前記金属粒子と前記半導体粒子の間が、前記ガラス質を介して結合しているとともに、
    前記金属粒子の平均粒子径Xが1.0μm以上であり、前記放電補助電極の厚みYと、前記金属粒子の平均粒子径Xとの関係が、0.5≦Y/X≦3の要件を満たすこと
    を特徴とするESD保護デバイス。
  2. 前記金属粒子がCu粒子であることを特徴とする請求項1記載のESD保護デバイス。
  3. 前記半導体粒子が炭化ケイ素粒子であることを特徴とする請求項1または2記載のESD保護デバイス。
  4. 前記ガラス質は、前記金属粒子と前記半導体粒子との反応により生じるものであることを特徴とする請求項1〜3のいずれかに記載のESD保護デバイス。
  5. 前記対向電極を構成する前記一方側対向電極と前記他方側対向電極の先端部が互いに対向する放電ギャップ部および前記放電補助電極の前記放電ギャップ部に位置する領域が、前記セラミック基材内部に設けられた空洞部に臨んでいることを特徴とする請求項1〜4のいずれかに記載のESD保護デバイス。
  6. 第1のセラミックグリーンシートの一方主面上に、平均粒子径が1.0μm以上の金属粒子と、半導体粒子と、有機ビヒクルとを含むとともに、前記金属粒子と前記半導体粒子の少なくとも一方が表面にガラスの網目形成成分を有し、かつ、前記金属粒子と前記半導体粒子とを合わせたものが占める割合が7体積%〜25体積%である放電補助電極ペ−ストを印刷することにより、未焼成の放電補助電極を形成する工程と、
    前記第1のセラミックグリーンシートの一方主面上に、対向電極ペーストを印刷することにより、それぞれが、前記放電補助電極の一部を覆うとともに、互いに間隔をおいて配設された一方側対向電極と他方側対向電極とを備える未焼成の対向電極を形成する工程と、
    前記第1のセラミックグリーンシートの一方主面上に、第2のセラミックグリーンシートを積層して未焼成の積層体を形成する工程と、
    前記積層体を焼成し、前記放電補助電極の前記金属粒子の表面と前記半導体粒子の表面とを反応させることにより、ガラス質を生成させる工程と
    を備えることを特徴とするESD保護デバイスの製造方法。
  7. 前記放電補助電極に含まれる金属粒子がアルミナコートCu粒子であり、前記半導体粒子が炭化ケイ素粒子であることを特徴とする、請求項6記載のESD保護デバイスの製造方法。
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Families Citing this family (25)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR101679099B1 (ko) * 2009-03-26 2016-11-23 쇼킹 테크놀로지스 인코포레이티드 전압 스위칭형 유전 물질을 갖는 소자
GB2497252A (en) 2010-09-29 2013-06-05 Murata Manufacturing Co ESD protection device and method of manufacturing thereof
US8885324B2 (en) 2011-07-08 2014-11-11 Kemet Electronics Corporation Overvoltage protection component
US9142353B2 (en) 2011-07-08 2015-09-22 Kemet Electronics Corporation Discharge capacitor
KR101555047B1 (ko) * 2011-07-15 2015-09-23 가부시키가이샤 무라타 세이사쿠쇼 Esd 보호 디바이스 및 그 제조방법
WO2013038893A1 (ja) * 2011-09-14 2013-03-21 株式会社村田製作所 Esd保護デバイスおよびその製造方法
WO2013038892A1 (ja) * 2011-09-14 2013-03-21 株式会社村田製作所 Esd保護デバイスおよびその製造方法
DE102012101606A1 (de) 2011-10-28 2013-05-02 Epcos Ag ESD-Schutzbauelement und Bauelement mit einem ESD-Schutzbauelement und einer LED
CN204088879U (zh) * 2012-01-30 2015-01-07 株式会社村田制作所 Esd保护装置
TWI517227B (zh) * 2012-02-24 2016-01-11 Amazing Microelectronic Corp Planetary Discharge Microchannel Structure and Its Making Method
JP5811268B2 (ja) 2012-02-29 2015-11-11 株式会社村田製作所 Esd保護デバイスおよびその製造方法
JP5585744B2 (ja) * 2012-02-29 2014-09-10 株式会社村田製作所 Esd保護デバイスおよびその製造方法
US9849376B2 (en) * 2012-05-02 2017-12-26 Microsoft Technology Licensing, Llc Wireless controller
JP5221794B1 (ja) * 2012-08-09 2013-06-26 立山科学工業株式会社 静電気保護素子とその製造方法
WO2015002045A1 (ja) * 2013-07-03 2015-01-08 株式会社村田製作所 サージ保護デバイス、その製造方法、および、それを含む電子部品
DE102013012842A1 (de) 2013-08-02 2015-02-05 Epcos Ag Verfahren zur Herstellung einer Vielzahl von Ableitern im Verbund, Ableiter und Ableiterverbund
JP2015138932A (ja) * 2014-01-24 2015-07-30 Tdk株式会社 静電気保護部品
CN106463912B (zh) * 2014-05-09 2018-07-06 株式会社村田制作所 静电放电保护设备
DE102015116278A1 (de) * 2015-09-25 2017-03-30 Epcos Ag Überspannungsschutzbauelement und Verfahren zur Herstellung eines Überspannungsschutzbauelements
KR102218896B1 (ko) 2015-11-16 2021-02-24 삼성전기주식회사 정전기 방전 보호용 조성물 및 이 조성물을 이용한 정전기 방전 보호 소자
US9953749B2 (en) * 2016-08-30 2018-04-24 Samsung Electro-Mechanics Co., Ltd. Resistor element and resistor element assembly
CN108366480A (zh) * 2018-01-05 2018-08-03 东莞久尹电子有限公司 静电保护元件及其制造方法
US10741313B1 (en) * 2019-02-06 2020-08-11 Eaton Intelligent Power Limited Bus bar assembly with integrated surge arrestor
CN114765085A (zh) * 2021-01-11 2022-07-19 国巨电子(中国)有限公司 点火器电阻及其制造方法
JP2022185854A (ja) * 2021-06-03 2022-12-15 Tdk株式会社 過渡電圧保護デバイス

Family Cites Families (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE19741658A1 (de) * 1997-09-16 1999-03-18 Siemens Ag Gasgefüllte Entladungsstrecke
JP4140173B2 (ja) * 2000-05-31 2008-08-27 三菱マテリアル株式会社 チップ型サージアブソーバおよびその製造方法
JP2005276666A (ja) * 2004-03-25 2005-10-06 Mitsubishi Materials Corp サージアブソーバ
TW200625743A (en) * 2004-07-15 2006-07-16 Mitsubishi Materials Corp Surge absorber
TW200816232A (en) * 2006-09-28 2008-04-01 Inpaq Technology Co Ltd Material of an over voltage protection device, over voltage protection device and manufacturing method thereof
CN101536275B (zh) * 2006-10-31 2012-05-30 松下电器产业株式会社 防静电部件及其制造方法
JP4247581B2 (ja) * 2007-05-28 2009-04-02 株式会社村田製作所 Esd保護デバイス
US8128365B2 (en) * 2007-07-09 2012-03-06 Siemens Energy, Inc. Turbine airfoil cooling system with rotor impingement cooling
JP2009152348A (ja) 2007-12-20 2009-07-09 Panasonic Corp 静電気対策部品
WO2009098944A1 (ja) * 2008-02-05 2009-08-13 Murata Manufacturing Co., Ltd. Esd保護デバイス

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