JPS63215224A - デイジタル−アナログ変換器 - Google Patents
デイジタル−アナログ変換器Info
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- JPS63215224A JPS63215224A JP62047734A JP4773487A JPS63215224A JP S63215224 A JPS63215224 A JP S63215224A JP 62047734 A JP62047734 A JP 62047734A JP 4773487 A JP4773487 A JP 4773487A JP S63215224 A JPS63215224 A JP S63215224A
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- 238000006243 chemical reaction Methods 0.000 claims abstract description 10
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- 238000004519 manufacturing process Methods 0.000 description 1
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
- H03M1/66—Digital/analogue converters
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- H—ELECTRICITY
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- H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
- H03M1/00—Analogue/digital conversion; Digital/analogue conversion
- H03M1/06—Continuously compensating for, or preventing, undesired influence of physical parameters
- H03M1/0602—Continuously compensating for, or preventing, undesired influence of physical parameters of deviations from the desired transfer characteristic
- H03M1/0604—Continuously compensating for, or preventing, undesired influence of physical parameters of deviations from the desired transfer characteristic at one point, i.e. by adjusting a single reference value, e.g. bias or gain error
-
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- H03M1/66—Digital/analogue converters
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- H03M1/742—Simultaneous conversion using current sources as quantisation value generators
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- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Analogue/Digital Conversion (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
[発明の目的]
(産業上の利用分野)
この発明はディジタル信号をアナログ信号に変換するデ
ィジタル−アナログ変換器に関し、特にビデオ用信号処
理装置のように高速信号処理が必要な機器に使用される
ディジタル−アナログ変換器に関する。
ィジタル−アナログ変換器に関し、特にビデオ用信号処
理装置のように高速信号処理が必要な機器に使用される
ディジタル−アナログ変換器に関する。
(従来の技術)
従来、高速D/A (ディジタル−アナログ)変換器と
しては、文献(口紅エレクトロニクス、1986.2,
24、No、389、第168頁乃至第170頁)に記
載されているような電流セグメント型のD/A変換器が
知られている。
しては、文献(口紅エレクトロニクス、1986.2,
24、No、389、第168頁乃至第170頁)に記
載されているような電流セグメント型のD/A変換器が
知られている。
第4図にそのD/A変換器を示す。このD/A変換器は
、慢数の電流源Aと、この各電流源にそれぞれ接続され
るスイッチSとから構成され、例えばnビットのディジ
タル信号をアナログ信号に変換する場合には、電流AA
とスイッチSの数はそれぞれ2rL−1個となる。これ
は、nビットのディジタル信号のデコード出力の数が2
rLであり、ディジタル信号の各ビットが全て0”の場
合は全ての電流源Aを遮断する方式のためである。
、慢数の電流源Aと、この各電流源にそれぞれ接続され
るスイッチSとから構成され、例えばnビットのディジ
タル信号をアナログ信号に変換する場合には、電流AA
とスイッチSの数はそれぞれ2rL−1個となる。これ
は、nビットのディジタル信号のデコード出力の数が2
rLであり、ディジタル信号の各ビットが全て0”の場
合は全ての電流源Aを遮断する方式のためである。
211−1個の各スイッチSは、ディジタル信号のデコ
ード結果に対応してそれぞれオン・オフ制御されるもの
であり、そのデコードした値の数だけスイッチSがオン
となる。したがって、出力電流1 outの値は、ディ
ジタル信号の内容が1増加する毎に1個の電流源によっ
て供給される電流値1oだけ増加される。
ード結果に対応してそれぞれオン・オフ制御されるもの
であり、そのデコードした値の数だけスイッチSがオン
となる。したがって、出力電流1 outの値は、ディ
ジタル信号の内容が1増加する毎に1個の電流源によっ
て供給される電流値1oだけ増加される。
また、破線の枠内に示すように抵抗Rを接続すれば、デ
ィジタル信号に対応した電圧出力VouLを得ることが
できる。
ィジタル信号に対応した電圧出力VouLを得ることが
できる。
しかしながら、このような構成のD/A変換器にあって
は、電流出力I ouLまたは電圧出力V outの値
が、デバイス構造すなわち電流源Aの電流値1 o s
または電流源Aの電流値■0と抵抗R1の値とによって
決定されてしまうため、製造後にアナログ信号のフルス
ケール値を変更することは困難となる。このため、D/
A変換−器の用途は限定されたものとなる。
は、電流出力I ouLまたは電圧出力V outの値
が、デバイス構造すなわち電流源Aの電流値1 o s
または電流源Aの電流値■0と抵抗R1の値とによって
決定されてしまうため、製造後にアナログ信号のフルス
ケール値を変更することは困難となる。このため、D/
A変換−器の用途は限定されたものとなる。
また、電流源Aの電流値1oは、温度変動や電源電圧v
ccの変動に伴って変化するため、アナログ出力が不安
定になり、高精度のD/A変換を行なうことは困難であ
る。
ccの変動に伴って変化するため、アナログ出力が不安
定になり、高精度のD/A変換を行なうことは困難であ
る。
(発明が解決しようとする問題点)
この発明は上記のよう・な点に鑑みなされたもので、従
来のD/A変換器では一旦そのD/A変換器を製造する
とそのアナログ出力のフルスケール値を変更することが
できず、その用途が限定されてしまう点、またD/A変
換の精度が温度変動や電源電圧変動等に影響され、安定
したアナログ出力を得ることができなかった点を改善し
、温度変動や電源電圧変動に強く、しかもアナログ出力
のフルスケール値を任意の値に容易に設定することが可
能なり/A変換器を提供することを目的とする。
来のD/A変換器では一旦そのD/A変換器を製造する
とそのアナログ出力のフルスケール値を変更することが
できず、その用途が限定されてしまう点、またD/A変
換の精度が温度変動や電源電圧変動等に影響され、安定
したアナログ出力を得ることができなかった点を改善し
、温度変動や電源電圧変動に強く、しかもアナログ出力
のフルスケール値を任意の値に容易に設定することが可
能なり/A変換器を提供することを目的とする。
[発明の構成]
(問題点を解決するための手段)
この発明によるディジタル−アナログ変換器にあっては
、電源電位供給端子と出力端子間に設けられた複数の電
流通路にそれぞれ直列接続されているスイッチと第1の
電流値制御手段を備え、前記スイッチがディジタル信号
のデコード結果に基づいてオン・オフ制御されることに
より前記ディジタル値に対応するアナログ値を得るディ
ジタル−アナログ変換回路と、前記電源電位供給端子に
一端が接続され、前記第1の電流値制御手段と同一構成
の第2の電流値制御手段と、この第2の電流値制御手段
に応じた電圧を発生する電圧発生手段と、この電圧発生
手段によって発生された電圧と基準電圧とを比較し、そ
の比較結果に基づいて前記第1および第2の電流値制御
手段をそれぞれ制御する比較手段とを具備したものであ
る。
、電源電位供給端子と出力端子間に設けられた複数の電
流通路にそれぞれ直列接続されているスイッチと第1の
電流値制御手段を備え、前記スイッチがディジタル信号
のデコード結果に基づいてオン・オフ制御されることに
より前記ディジタル値に対応するアナログ値を得るディ
ジタル−アナログ変換回路と、前記電源電位供給端子に
一端が接続され、前記第1の電流値制御手段と同一構成
の第2の電流値制御手段と、この第2の電流値制御手段
に応じた電圧を発生する電圧発生手段と、この電圧発生
手段によって発生された電圧と基準電圧とを比較し、そ
の比較結果に基づいて前記第1および第2の電流値制御
手段をそれぞれ制御する比較手段とを具備したものであ
る。
(作用)
このような構成のディジタル−アナログ変換器にあって
は、前記第2の電流値制御手段の電流値は、前記電圧発
生手段で発生される電圧が基や電圧と等しくなるように
前記比較手段によって制御されるため安定した値となる
。この第2の電流値制御手段と前記第1の電流値制御手
段は同一構成であるので、この第1の電流値制御手段の
電流値も前記基準電圧に対応した値となる。したがって
、温度変動や電源電圧の変動によらず安定した値のアナ
ログ出力を得ることが可能となる。また、前記基準電圧
の値を変化させれば、これに伴って第1の電流値制御手
段の電流値も変化するので、アナログ出力のフルスケー
ル値を任意の値に容易に設定することができる。
は、前記第2の電流値制御手段の電流値は、前記電圧発
生手段で発生される電圧が基や電圧と等しくなるように
前記比較手段によって制御されるため安定した値となる
。この第2の電流値制御手段と前記第1の電流値制御手
段は同一構成であるので、この第1の電流値制御手段の
電流値も前記基準電圧に対応した値となる。したがって
、温度変動や電源電圧の変動によらず安定した値のアナ
ログ出力を得ることが可能となる。また、前記基準電圧
の値を変化させれば、これに伴って第1の電流値制御手
段の電流値も変化するので、アナログ出力のフルスケー
ル値を任意の値に容易に設定することができる。
(実施例)
以下、図面を参照してこの発明の詳細な説明する。
第1図にこの発明の一実施例に係わるD/A変換器を示
す。このD/A変換器は、ディジタル信号がnビットの
場合、第4図のD/A変換器と同様に、ディジタル信号
のデコード出力によってオン・オフ制御される2rL−
1個のスイッチSと、これらのスイッチSにそれぞれ接
続される2n−1個の電流源Aとによって構成される電
流セグメント型のD/A変換器であるが、このD/A変
換器にはさらに、電流源Aの電流値1oを制御する制御
回路11が設けられている。
す。このD/A変換器は、ディジタル信号がnビットの
場合、第4図のD/A変換器と同様に、ディジタル信号
のデコード出力によってオン・オフ制御される2rL−
1個のスイッチSと、これらのスイッチSにそれぞれ接
続される2n−1個の電流源Aとによって構成される電
流セグメント型のD/A変換器であるが、このD/A変
換器にはさらに、電流源Aの電流値1oを制御する制御
回路11が設けられている。
2n−1個の電流源Aに一端が共通接続されている抵抗
R1は、電流出力を電圧出力V outに変換するため
のものである。
R1は、電流出力を電圧出力V outに変換するため
のものである。
制御回路11は、電流源Aoと、抵抗Roと、電圧比較
器Coとによって構成される。電流源A。
器Coとによって構成される。電流源A。
は前記電流源Aと同一構成のものである。電流源Aoと
抵抗Roは、電源Vcc端子と接地端子との間に直列接
続されており、その接続点の電位V。
抵抗Roは、電源Vcc端子と接地端子との間に直列接
続されており、その接続点の電位V。
は比較器COの一方の人力に供給される。この比較器C
oの他方の人力には基準電圧V rat’が供給されて
おり、VoとV rerとの差電圧に対応した電圧値が
比較器COから電流源Ao、Aに電流制御信号としてそ
れぞれ供給される。
oの他方の人力には基準電圧V rat’が供給されて
おり、VoとV rerとの差電圧に対応した電圧値が
比較器COから電流源Ao、Aに電流制御信号としてそ
れぞれ供給される。
電流源A、Aoとしては、例えばP型MO5+−ランジ
スタを用いることができる。このようにP型MOSトラ
ンジスタを電流源として使用する場合には、従来ではP
型MOSトランジスタのゲートをそのドレインに接続す
るが、この場−合にはP型MO3FETのゲートには比
較器Coの出力が供給される。
スタを用いることができる。このようにP型MOSトラ
ンジスタを電流源として使用する場合には、従来ではP
型MOSトランジスタのゲートをそのドレインに接続す
るが、この場−合にはP型MO3FETのゲートには比
較器Coの出力が供給される。
P型MOSトランジスタを電流源A、Aoとして使用す
る場合、V rerは比較器Coの反転入力に供給し、
Voはその非反転入力に供給する。このようにすれば、
Vrcr−Voとなるような電流値1oを得ることがで
きる−0この電流値1oは、Vo=Io−Roであるこ
とより、l□ −Vrcr/Roとなる。
る場合、V rerは比較器Coの反転入力に供給し、
Voはその非反転入力に供給する。このようにすれば、
Vrcr−Voとなるような電流値1oを得ることがで
きる−0この電流値1oは、Vo=Io−Roであるこ
とより、l□ −Vrcr/Roとなる。
ディジタル信号のデコード出力により例えばに個(0≦
に≦21L)のスイッチがオンになった時、出力電圧V
outは、Vout =k * Io−R1であるが
、前述の関係より、VouL −に−R1・Vrel’
/Roとなる。
に≦21L)のスイッチがオンになった時、出力電圧V
outは、Vout =k * Io−R1であるが
、前述の関係より、VouL −に−R1・Vrel’
/Roとなる。
このように、このD/A変換器にあっては、出力電圧V
outをIoに関係なく、基準電圧V rc「と、抵
抗Ro、R1によって決めることができる。
outをIoに関係なく、基準電圧V rc「と、抵
抗Ro、R1によって決めることができる。
したがって、温度変動やffi源電圧VCCの変動に影
響されず、精度の良い安定したD/A変換を行なうこと
が可能となる。また、アナログ出力のフルスケール値も
、基準電圧V ro(’を変化させることによって任意
の値に容易に設定可能となる。
響されず、精度の良い安定したD/A変換を行なうこと
が可能となる。また、アナログ出力のフルスケール値も
、基準電圧V ro(’を変化させることによって任意
の値に容易に設定可能となる。
第2図にこの発明の第2の実施例に係わるD/A変換器
を示す。これは、nビットのディジタル信号をに位aビ
ットと下位bビットに分けてそれぞれD/A変換を行な
う構成のものである。
を示す。これは、nビットのディジタル信号をに位aビ
ットと下位bビットに分けてそれぞれD/A変換を行な
う構成のものである。
上位aビット用のD/A変換部12には、上位aビット
のデコード結果によってそれぞれオン・オ)制御される
2 1個のスイッチSと、これらのスイッチSにそれ
ぞれ接続されている2a−1個の電流源Aの他に、これ
らの電流源Aの電流値IIの値を制御する上位ビット用
の制御回路11aが設けられている。
のデコード結果によってそれぞれオン・オ)制御される
2 1個のスイッチSと、これらのスイッチSにそれ
ぞれ接続されている2a−1個の電流源Aの他に、これ
らの電流源Aの電流値IIの値を制御する上位ビット用
の制御回路11aが設けられている。
同様に、下位bビット用のD/A変換部13にも、下位
bビットのデコード結果によってそれぞれオン・オフ制
御される2 1個のスイッチSと、これらのスイ・ン
チSにそれぞれ接続されている2b−1個の電流MAの
他に、これらの電流源Aの電流値Ifの値を制御する下
位ビット用の制御回路11bが設けられている。
bビットのデコード結果によってそれぞれオン・オフ制
御される2 1個のスイッチSと、これらのスイ・ン
チSにそれぞれ接続されている2b−1個の電流MAの
他に、これらの電流源Aの電流値Ifの値を制御する下
位ビット用の制御回路11bが設けられている。
制御回路11aは、電流源Aoと、抵抗Roと、電圧比
較器Coによって構成される。同様に、制御回路11b
は、電流源Aolと、抵抗値が25・Roとなるように
重みづけされた抵抗Rolと、TI圧比較器Colによ
って構成される。電流源AoおよびAolはそれぞれ前
記電流源Aと同一構成のものである。
較器Coによって構成される。同様に、制御回路11b
は、電流源Aolと、抵抗値が25・Roとなるように
重みづけされた抵抗Rolと、TI圧比較器Colによ
って構成される。電流源AoおよびAolはそれぞれ前
記電流源Aと同一構成のものである。
このような構成のD/A変換器にあっても、電流源Aの
電流値10%11が基準電圧V refに対応した値に
制御されるので、第1図と同様に精度の良い安定したD
/A変換を行なうことができると共に、基準電圧V r
of’を変化させることによってアナログ出力のフルス
ケール値を容易に設定することができる。
電流値10%11が基準電圧V refに対応した値に
制御されるので、第1図と同様に精度の良い安定したD
/A変換を行なうことができると共に、基準電圧V r
of’を変化させることによってアナログ出力のフルス
ケール値を容易に設定することができる。
第3図はこの発明の第3の実施例を示すもので、nビッ
トのディジタル信号を上位aビットと下位bビットとに
分けてD/A変換部12と13とによってそれぞれD/
A変換を実行するのは第2図のD/A変換器と同様であ
るが、抵抗ROIの値を重みづけする代わりに2b個の
電流源Aolを一112列に用いたものである。
トのディジタル信号を上位aビットと下位bビットとに
分けてD/A変換部12と13とによってそれぞれD/
A変換を実行するのは第2図のD/A変換器と同様であ
るが、抵抗ROIの値を重みづけする代わりに2b個の
電流源Aolを一112列に用いたものである。
すなわち、下位側の制御回路11bには、電流源Aと同
一構成の2b個の電流+11X A Olと、抵抗値が
制御回路11aの抵抗Roと同一の抵抗Rotと、比較
QiColが設けられる。2b個の電流源Aolは、電
源電圧Vcc端子と抵抗Rotとの間に並列接続され、
比較器Cotの出力によってそれぞれ電流制御される。
一構成の2b個の電流+11X A Olと、抵抗値が
制御回路11aの抵抗Roと同一の抵抗Rotと、比較
QiColが設けられる。2b個の電流源Aolは、電
源電圧Vcc端子と抵抗Rotとの間に並列接続され、
比較器Cotの出力によってそれぞれ電流制御される。
このような構成にしても、下位ビット側の電流源Aに流
れる電流値■lを所定の値に設定できる。
れる電流値■lを所定の値に設定できる。
尚、電流源A、 Ao s AOIとしては、P型MO
Sトランジスタだけでなく、N型MOSトランジスタや
バイポーラトランジスタを利用することもできる。また
、その電流値を制御できる構成であれば、igi数の素
子で電流源を構成してもよい。
Sトランジスタだけでなく、N型MOSトランジスタや
バイポーラトランジスタを利用することもできる。また
、その電流値を制御できる構成であれば、igi数の素
子で電流源を構成してもよい。
また、出力抵抗R1を用いずアナログ信号を電流出力に
しても同様の効果が得られることはもちろんである。
しても同様の効果が得られることはもちろんである。
[発明の効果]
以上のようにこの発明によれば、温度−変動や電源電圧
の変動に影響されず、精度の良い安定したD/A変換を
行なうことが可能となる。また、アナログ出力のフルス
ケール値も、基準電圧値を変化させることによって容易
に設定可能となる
の変動に影響されず、精度の良い安定したD/A変換を
行なうことが可能となる。また、アナログ出力のフルス
ケール値も、基準電圧値を変化させることによって容易
に設定可能となる
第1図はこの発明の一実施例に係わるディジタル−アナ
ログ変換器を示−す回路図、第2図および第3図はそれ
ぞれこの発明の他の実施例に係わるディジタル−アナロ
グ変換器を示す回路図、第4図は従来のディジタル−ア
ナログ変換器を示す図である。 A・・・電流源、S・・・スイッチ、Ro、R1・・・
抵抗、Co・・・比較器、11・・・制御回路。
ログ変換器を示−す回路図、第2図および第3図はそれ
ぞれこの発明の他の実施例に係わるディジタル−アナロ
グ変換器を示す回路図、第4図は従来のディジタル−ア
ナログ変換器を示す図である。 A・・・電流源、S・・・スイッチ、Ro、R1・・・
抵抗、Co・・・比較器、11・・・制御回路。
Claims (2)
- (1)電源電位供給端子と出力端子間に設けられた複数
の電流通路にそれぞれ直列接続されているスイッチと第
1の電流値制御手段を備え、前記スイッチがディジタル
信号のデコード結果に基づいてオン・オフ制御されるこ
とにより前記ディジタル値に対応するアナログ値を得る
ディジタル−アナログ変換回路と、 前記電源電位供給端子に一端が接続され、前記第1の電
流値制御手段と同一構成の第2の電流値制御手段と、 この第2の電流値制御手段に応じた電圧を発生する電圧
発生手段と、 この電圧発生手段によって発生された電圧と基準電圧と
を比較し、その比較結果に基づいて前記第1および第2
の、電流値制御手段をそれぞれ制御する比較手段とを具
備することを特徴とするディジタル−アナログ変換器。 - (2)前記第1および第2の電流値制御手段は、それぞ
れゲートに前記比較手段からの出力が供給されるMOS
トランジスタである特許請求の範囲第1項記載のディジ
タル−アナログ変換器。
Priority Applications (5)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62047734A JPH0810832B2 (ja) | 1987-03-04 | 1987-03-04 | デイジタル―アナログ変換器 |
US07/162,264 US4827260A (en) | 1987-03-04 | 1988-02-29 | Digital-to-analog converter |
EP88103205A EP0281116B1 (en) | 1987-03-04 | 1988-03-02 | Digital-to-analog converter |
DE3850982T DE3850982T2 (de) | 1987-03-04 | 1988-03-02 | Digital-Analogwandler. |
KR1019880002229A KR900008821B1 (ko) | 1987-03-04 | 1988-03-04 | 디지탈/아날로그변환기 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62047734A JPH0810832B2 (ja) | 1987-03-04 | 1987-03-04 | デイジタル―アナログ変換器 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS63215224A true JPS63215224A (ja) | 1988-09-07 |
JPH0810832B2 JPH0810832B2 (ja) | 1996-01-31 |
Family
ID=12783568
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP62047734A Expired - Fee Related JPH0810832B2 (ja) | 1987-03-04 | 1987-03-04 | デイジタル―アナログ変換器 |
Country Status (5)
Country | Link |
---|---|
US (1) | US4827260A (ja) |
EP (1) | EP0281116B1 (ja) |
JP (1) | JPH0810832B2 (ja) |
KR (1) | KR900008821B1 (ja) |
DE (1) | DE3850982T2 (ja) |
Cited By (5)
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---|---|---|---|---|
WO2001041310A1 (fr) * | 1999-11-30 | 2001-06-07 | Yamaha Corporation | Convertisseur numerique-analogique |
JP2002190739A (ja) * | 2000-12-22 | 2002-07-05 | Kawasaki Microelectronics Kk | 半導体装置 |
KR100495500B1 (ko) * | 2000-12-14 | 2005-06-17 | 매그나칩 반도체 유한회사 | 디지털/아날로그 변환기 |
JP2007037148A (ja) * | 2005-07-27 | 2007-02-08 | Agilent Technol Inc | 複数のdacの加算を用いたデジタル/アナログ変換方法およびシステム |
JP2009188532A (ja) * | 2008-02-04 | 2009-08-20 | Sanyo Electric Co Ltd | 出力値調整回路及び電流値調整回路 |
Families Citing this family (37)
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JPH01277027A (ja) * | 1988-04-28 | 1989-11-07 | Toshiba Corp | デジタル・アナログ変換回路 |
JP2597712B2 (ja) * | 1989-05-22 | 1997-04-09 | 株式会社東芝 | ディジタル・アナログ変換器 |
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