JPS6085680A - 画像処理方法 - Google Patents
画像処理方法Info
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- JPS6085680A JPS6085680A JP58193876A JP19387683A JPS6085680A JP S6085680 A JPS6085680 A JP S6085680A JP 58193876 A JP58193876 A JP 58193876A JP 19387683 A JP19387683 A JP 19387683A JP S6085680 A JPS6085680 A JP S6085680A
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- 238000000034 method Methods 0.000 description 22
- 239000011159 matrix material Substances 0.000 description 18
- 238000010586 diagram Methods 0.000 description 9
- 238000011946 reduction process Methods 0.000 description 3
- 238000005070 sampling Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 1
- 239000000463 material Substances 0.000 description 1
Classifications
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N1/00—Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
- H04N1/387—Composing, repositioning or otherwise geometrically modifying originals
- H04N1/393—Enlarging or reducing
- H04N1/3935—Enlarging or reducing with modification of image resolution, i.e. determining the values of picture elements at new relative positions
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06T—IMAGE DATA PROCESSING OR GENERATION, IN GENERAL
- G06T3/00—Geometric image transformations in the plane of the image
- G06T3/40—Scaling of whole images or parts thereof, e.g. expanding or contracting
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N1/00—Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
- H04N1/40—Picture signal circuits
- H04N1/40075—Descreening, i.e. converting a halftone signal into a corresponding continuous-tone signal; Rescreening, i.e. combined descreening and halftoning
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- Multimedia (AREA)
- Signal Processing (AREA)
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Theoretical Computer Science (AREA)
- Editing Of Facsimile Originals (AREA)
- Image Processing (AREA)
- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔技術分野〕
本発明は画像処理装置に関し、特に画像の拡大・縮小処
理を行なう装置に関するものである。
理を行なう装置に関するものである。
従来から画像の拡大・縮小処理に関しては種々の方法が
提案されている。例えば第１図に示す４Ｘ４マトリクス
の各ビットデータを縦（Ｙ）方向及び横（３）方向共に
２倍に拡大してやることで第２図の如き拡大画像が得ら
れるものである。また縮小の際には１例えば第１図に示
す４×４マドＩＪツクスの内所定位置のビット（（Ｘ、
Ｙ）−（Ａ、０）。
提案されている。例えば第１図に示す４Ｘ４マトリクス
の各ビットデータを縦（Ｙ）方向及び横（３）方向共に
２倍に拡大してやることで第２図の如き拡大画像が得ら
れるものである。また縮小の際には１例えば第１図に示
す４×４マドＩＪツクスの内所定位置のビット（（Ｘ、
Ｙ）−（Ａ、０）。
（Ｃ，Ｏ）、（Ａ、２）、（Ｃ，２）４）をサンプリン
グすることで第６図の如き縮小画像が得られるものであ
る。
グすることで第６図の如き縮小画像が得られるものであ
る。
ところが上述した拡大・縮小方法を通常の画像（例工ば
パターンジェネレータから発生した文字、画像）に適用
した場合は特に問題ないが、ディザ処理された画像に適
用した場合は再生画像の画質が低下する恐れがおった。
パターンジェネレータから発生した文字、画像）に適用
した場合は特に問題ないが、ディザ処理された画像に適
用した場合は再生画像の画質が低下する恐れがおった。
例えば所定０此の画像を第４図に示すディザマトリクス
Ａ（数値は閾値を示す。）によってディザ処理した後、
前述した如き拡大方法により縦・横方向共に２倍に拡大
すると、拡大画像は第５図に示すディザマトリクスによ
ってディザ処理したものと同様になってしまい、本来の
ディザマトリクスＡによる再現性が失なわれてしまう。
Ａ（数値は閾値を示す。）によってディザ処理した後、
前述した如き拡大方法により縦・横方向共に２倍に拡大
すると、拡大画像は第５図に示すディザマトリクスによ
ってディザ処理したものと同様になってしまい、本来の
ディザマトリクスＡによる再現性が失なわれてしまう。
またディザ処理された画像はディザマトリクスによる周
期性を治すため、縮小する際のサンプリングするビット
の位置によって再生画像に大きな変化が生じてしま５可
能性があった。
期性を治すため、縮小する際のサンプリングするビット
の位置によって再生画像に大きな変化が生じてしま５可
能性があった。
本発明は上記の点に鑑みなされたもので優れた拡大・縮
小画像を得ることができる画像処理装置を提供すること
にある。
小画像を得ることができる画像処理装置を提供すること
にある。
以下図面を参照して本発明の一実施例について詳細に説
明する。
明する。
第６図は本発明による拡大画像を説明するための図であ
る。例えば第４図に示すディザマトリクスＡにより処理
した画像を本発明により縦横方向に２倍に拡大した場合
、第４図ディザマトリクスの各閾値を各ビットの番号と
したとき、各ビットデータは第６図に示す如き配置とな
る。
る。例えば第４図に示すディザマトリクスＡにより処理
した画像を本発明により縦横方向に２倍に拡大した場合
、第４図ディザマトリクスの各閾値を各ビットの番号と
したとき、各ビットデータは第６図に示す如き配置とな
る。
次に第７図（ａ） 、 （ｂ）を用いて本発明による縮
小画像を説明するε第７図（ａ）は第４図に示すディザ
マトリクスＡにより処理した画像をマトリクス単位で表
わしたものであり、Ａ１〜Ａ、１６のマトリクスで表わ
されている。つまり、ここではマトリクスＡ１〜ＡＩ６
の各々がデイザマ） ＩＪクスＡにより処理された画像
を示すものである。
小画像を説明するε第７図（ａ）は第４図に示すディザ
マトリクスＡにより処理した画像をマトリクス単位で表
わしたものであり、Ａ１〜Ａ、１６のマトリクスで表わ
されている。つまり、ここではマトリクスＡ１〜ＡＩ６
の各々がデイザマ） ＩＪクスＡにより処理された画像
を示すものである。
第７図（ｂ）は第７図（ａ）の画像を縮小した状態を示
す図である。図から明らかな様に本例ではマトリクス単
位（ＡＩ 、Ａ３ 、Ａ９ 、Ａ１１ ）で縮小が行な
われているものである。この様に本発明によればディザ
処理により得られたパターンを破壊することな（画像の
処理を行なっているので、ディザマトリクスによる再現
性を失なうことなく優れた拡大・縮小画像が得られるも
のである。
す図である。図から明らかな様に本例ではマトリクス単
位（ＡＩ 、Ａ３ 、Ａ９ 、Ａ１１ ）で縮小が行な
われているものである。この様に本発明によればディザ
処理により得られたパターンを破壊することな（画像の
処理を行なっているので、ディザマトリクスによる再現
性を失なうことなく優れた拡大・縮小画像が得られるも
のである。
第８図は本実施例における制御回路を示す図である。こ
の制御回路は、例えば第１０図に示す様な記憶装置１内
の記憶領域内の５ＡＤＤ番地からはじまる矩形領域２の
ディザ処理データを拡大してＤＡＤＤｉ地からはじまる
矩形領域６へ転送するものである。尚、本例では矩形領
域２よりのデータを（２Ｘ２ ）倍に拡大する０図中４
は矩形領域２よりの読出しデータを格納するＳレジスタ
、５はＳレジスタ４の値（ここではビット幅を８ビツト
と規定する。）を上位４ビツトと下位４ビツトとに分割
し、選択出力するセレクタ、２５はセレクタ５からの４
ビツト出力を８ビツトに生成して出力する拡大部、２０
は例えばメモリ１あるいは拡大部２５からの画像データ
あるいはアドレスデータを転送するためのデータバス、
６は矩形領域２の１行毎の読み出し開始′アドレスを示
すＳアドレスレジスタ、２２はＳアドレスレジスタ乙の
値を基にメモリ１の矩形領域２のメモリアクセス番地を
示すＳアドレスカウンタ、７は加減算器、１１は矩形領
域６の横レングスＸを示すＸレジスタ、１２￥ｉ横レン
グスＸ分のデータ転送終了を検知するＸカウンタ、１６
は縦しングスＹ分のデータ転送終了つまり全てのデータ
転送終了を検知するＸカウンタ、８はメモリ′１１の１
行分のレングスを示すＰレジスタ、１０は矩形領域乙の
行毎の書き込み開始アドレスを示すＤアドレスレジスタ
、２６は矩形領域乙のメモリアクセス番地を示−３−Ｄ
アドレスカウンタ、９は加算器、２４はアドレスバス、
１４は上述した各レジスタ、カウンタ等の制御を行なう
制御装置である。
の制御回路は、例えば第１０図に示す様な記憶装置１内
の記憶領域内の５ＡＤＤ番地からはじまる矩形領域２の
ディザ処理データを拡大してＤＡＤＤｉ地からはじまる
矩形領域６へ転送するものである。尚、本例では矩形領
域２よりのデータを（２Ｘ２ ）倍に拡大する０図中４
は矩形領域２よりの読出しデータを格納するＳレジスタ
、５はＳレジスタ４の値（ここではビット幅を８ビツト
と規定する。）を上位４ビツトと下位４ビツトとに分割
し、選択出力するセレクタ、２５はセレクタ５からの４
ビツト出力を８ビツトに生成して出力する拡大部、２０
は例えばメモリ１あるいは拡大部２５からの画像データ
あるいはアドレスデータを転送するためのデータバス、
６は矩形領域２の１行毎の読み出し開始′アドレスを示
すＳアドレスレジスタ、２２はＳアドレスレジスタ乙の
値を基にメモリ１の矩形領域２のメモリアクセス番地を
示すＳアドレスカウンタ、７は加減算器、１１は矩形領
域６の横レングスＸを示すＸレジスタ、１２￥ｉ横レン
グスＸ分のデータ転送終了を検知するＸカウンタ、１６
は縦しングスＹ分のデータ転送終了つまり全てのデータ
転送終了を検知するＸカウンタ、８はメモリ′１１の１
行分のレングスを示すＰレジスタ、１０は矩形領域乙の
行毎の書き込み開始アドレスを示すＤアドレスレジスタ
、２６は矩形領域乙のメモリアクセス番地を示−３−Ｄ
アドレスカウンタ、９は加算器、２４はアドレスバス、
１４は上述した各レジスタ、カウンタ等の制御を行なう
制御装置である。
以上の構成で第１０図に示すメモリ空間１内のディザ処
理された画像データ（矩形領域２のデータ）を拡大して
矩形領域６に転送するものである０次に拡大処理の、シ
）ミ細を第１１図の７０−チャートを参照して説明する
。尚、本例の処理単位は４×４ （ビット）のマトリク
ス、転送単位はノくイト （８ビツト）とする。
理された画像データ（矩形領域２のデータ）を拡大して
矩形領域６に転送するものである０次に拡大処理の、シ
）ミ細を第１１図の７０−チャートを参照して説明する
。尚、本例の処理単位は４×４ （ビット）のマトリク
ス、転送単位はノくイト （８ビツト）とする。
まず初期設定としてステップ１００において各レジスタ
カウンタに所定の設定値をセットし、フラグＦ Ｌ Ｇ
を６０”にセットする。つまりＳアドレスレジスタ６に
は矩形領域２のスタート番地であるＳ Ａ Ｄ Ｄ ”
を、Ｄアドレスレジスタ１０しこけ矩形領域乙のスター
ト番地であるＤ Ａ Ｄ Ｄ ”を、Ｘレジスタ１１に
は矩形領域乙の横レングス″′Ｘ”を、Ｘカウンタ１６
には矩形％＋ｊ域６の縦レングス”Ｙ”を、Ｐレジスタ
にはメモリ１の記憶領域の横レングス相当数を設定する
。続いてステップ１０１においてＳアドレスレジスタ６
及びＤアドレスレジスタ１０の内容をそれぞれ、Ｓアド
レスカウンタ２２、Ｄアドレスカウンタ２５へ転送する
。またステップ１０２においてＸレジスタ１１の内容を
Ｘカウンタ１２へ転送する。次にステップ１０３にてセ
レクタ５への制御信号ＵＰ／ＬＯＷ１６をＵＰ側にする
。これによりセレクタ５はＳレジスタ４から入力された
８ビツトの内上位４ビットを選択する。そしてステップ
１０４でＳアドレスカウンタηが示す缶地の内容をデー
タバス２０を介してＳレジスタ４にセットする。＋ｌ１
Ｉｌ：いてステップ１０５においてＳレジスタ４に格納
された８ビツトのデータの内上位４ビットがセレクタ５
により出力され、拡大部２５において８ビツトデータ
（Ｓ−１）Ａ’ｌ’Ａ ）として出力される。このＢビ
ットデータは前記上位４ビツトデータが２回繰り返し出
力されたものである。次にこの拡大された８ビツトデー
タはステップ１０６でＤアドレスカウンタ２６が示すメ
モリの番地へ書き込まれる。
カウンタに所定の設定値をセットし、フラグＦ Ｌ Ｇ
を６０”にセットする。つまりＳアドレスレジスタ６に
は矩形領域２のスタート番地であるＳ Ａ Ｄ Ｄ ”
を、Ｄアドレスレジスタ１０しこけ矩形領域乙のスター
ト番地であるＤ Ａ Ｄ Ｄ ”を、Ｘレジスタ１１に
は矩形領域乙の横レングス″′Ｘ”を、Ｘカウンタ１６
には矩形％＋ｊ域６の縦レングス”Ｙ”を、Ｐレジスタ
にはメモリ１の記憶領域の横レングス相当数を設定する
。続いてステップ１０１においてＳアドレスレジスタ６
及びＤアドレスレジスタ１０の内容をそれぞれ、Ｓアド
レスカウンタ２２、Ｄアドレスカウンタ２５へ転送する
。またステップ１０２においてＸレジスタ１１の内容を
Ｘカウンタ１２へ転送する。次にステップ１０３にてセ
レクタ５への制御信号ＵＰ／ＬＯＷ１６をＵＰ側にする
。これによりセレクタ５はＳレジスタ４から入力された
８ビツトの内上位４ビットを選択する。そしてステップ
１０４でＳアドレスカウンタηが示す缶地の内容をデー
タバス２０を介してＳレジスタ４にセットする。＋ｌ１
Ｉｌ：いてステップ１０５においてＳレジスタ４に格納
された８ビツトのデータの内上位４ビットがセレクタ５
により出力され、拡大部２５において８ビツトデータ
（Ｓ−１）Ａ’ｌ’Ａ ）として出力される。このＢビ
ットデータは前記上位４ビツトデータが２回繰り返し出
力されたものである。次にこの拡大された８ビツトデー
タはステップ１０６でＤアドレスカウンタ２６が示すメ
モリの番地へ書き込まれる。
ステップ１０７では矩形６１１域６０１行分（横レング
スＮＸ”分）のデータ転送が終了しＸカウンタ１２が０
”になったか台かを、Ｉｌｌべろ。Ｘカウンタ１２カ″
Ｏ”であれば後述するステップ１１８に進み、′０”で
なければステップ１０Ｂに進みＸカウンタ１２の値を転
送終了ビット（この場合１バイト）分だけカウントダウ
ンする。次にステップ１０９においてＤアドレスカウン
タ２６をカウントアツプし、転送先のアドレスを１バイ
ト分進める。
スＮＸ”分）のデータ転送が終了しＸカウンタ１２が０
”になったか台かを、Ｉｌｌべろ。Ｘカウンタ１２カ″
Ｏ”であれば後述するステップ１１８に進み、′０”で
なければステップ１０Ｂに進みＸカウンタ１２の値を転
送終了ビット（この場合１バイト）分だけカウントダウ
ンする。次にステップ１０９においてＤアドレスカウン
タ２６をカウントアツプし、転送先のアドレスを１バイ
ト分進める。
そしてステップ１１０においてセレクタ５への制御信号
ＵＰ／ＬＯＷ１６をＬＯＷ側にする。これによりセレク
タ５はＳレジスタ４に格納された８ビツトのデータの内
上位４ビット黄択する。そしてステップ１１１でこの下
位４ビツトのデータはステップ１０５と同様拡大部２５
において８ビツトデータに拡大され、ステップ１１２で
Ｄアドレスカウンタ２６が示すメモリ１の番地へ古込ま
れる。ステップ１１３ではステップ１０７と同様に１行
分のデータ転送が終了したか否かを判断する。Ｘカウン
タ１２が′Ｄ゛であればステップ１１Ｂに進み、そうで
なければステップ１１４に進む。ステップ１１４では、
Ｓレジスタに格納された８ビツトのデータが全て処理さ
れたのでＳアドレスカウンタ２２をカウントアツプし、
転送元のアドレスを１バイト分進める。
ＵＰ／ＬＯＷ１６をＬＯＷ側にする。これによりセレク
タ５はＳレジスタ４に格納された８ビツトのデータの内
上位４ビット黄択する。そしてステップ１１１でこの下
位４ビツトのデータはステップ１０５と同様拡大部２５
において８ビツトデータに拡大され、ステップ１１２で
Ｄアドレスカウンタ２６が示すメモリ１の番地へ古込ま
れる。ステップ１１３ではステップ１０７と同様に１行
分のデータ転送が終了したか否かを判断する。Ｘカウン
タ１２が′Ｄ゛であればステップ１１Ｂに進み、そうで
なければステップ１１４に進む。ステップ１１４では、
Ｓレジスタに格納された８ビツトのデータが全て処理さ
れたのでＳアドレスカウンタ２２をカウントアツプし、
転送元のアドレスを１バイト分進める。
ステップ１１５ではＤアドレスカウンタ２６をカウント
アツプし、ステップ１１６でＸカウンタ１２のカウント
ダウンを行う。ステップ１０７あるいは１１６において
Ｘカウンター２の値が０”と判定されると、横レングス
″Ｘ”分のデータの転送が終了したと見なされステップ
１１Ｂへ進む。ステップ１１ＢではＹカウンター乙の値
が”０゛′であるか否かを判定する。Ｙカウンター６が
０”の場合には全での ”データ転送が終了したことに
なり、データ転送拡大処理を終了する。データ転送が終
了していない場合はステップ１１９へ進み、Ｄアドレス
レジスタ１０の値とＰレジスタの値を加算器９で加算し
、（１）びＤアドレスレジスター０にセットする。これ
によりＤアドレスレジスター０には矩形領域ろの次の行
の先回′Ｉアドレスがセットされる。そしてステップ１
２０でＹカウンター３の値を１ビツト分だけカウントダ
ウンする。次にステップ１２１で縦方向（糸（ソレンズ
方向）に４行分（４ビット分）の処理が終了したか否か
の判断を行い、終了していなけれはステップ１２６へ移
行し、Ｓアドレスレジスタ６の値とＰレジスタ８の値を
加減算器７で加算して再びＳアドレスレジスタ６にセッ
トした後、ステップ１０１へ戻る。ステップ１２１で４
行分の処理が終了した場合は、ステップ１２２へ移行し
７ラグｌ”、Ｌ［が０″にセットされているか缶かを判
断する。＋１０１＋にセットされていない場合はステッ
プ１２５で°゛０”にセットされる。”Ｏ゛′にセット
されている場合はステップ１２５へ移行し、Ｓアドレス
レジスタ６のイ［ほからＰレジスタ８の値を加減算器７
で減算して再びＳアドレスレジスタ乙にセットする。ス
テップ１２３ではこの動作が６回繰り返される。この動
作を６回繰り返すことにより転送元のアドレスは６行前
の先（］ξＩアドレスとなる。次にステップ１２４で７
ラグＦＬＧを′１”にセットする。
アツプし、ステップ１１６でＸカウンタ１２のカウント
ダウンを行う。ステップ１０７あるいは１１６において
Ｘカウンター２の値が０”と判定されると、横レングス
″Ｘ”分のデータの転送が終了したと見なされステップ
１１Ｂへ進む。ステップ１１ＢではＹカウンター乙の値
が”０゛′であるか否かを判定する。Ｙカウンター６が
０”の場合には全での ”データ転送が終了したことに
なり、データ転送拡大処理を終了する。データ転送が終
了していない場合はステップ１１９へ進み、Ｄアドレス
レジスタ１０の値とＰレジスタの値を加算器９で加算し
、（１）びＤアドレスレジスター０にセットする。これ
によりＤアドレスレジスター０には矩形領域ろの次の行
の先回′Ｉアドレスがセットされる。そしてステップ１
２０でＹカウンター３の値を１ビツト分だけカウントダ
ウンする。次にステップ１２１で縦方向（糸（ソレンズ
方向）に４行分（４ビット分）の処理が終了したか否か
の判断を行い、終了していなけれはステップ１２６へ移
行し、Ｓアドレスレジスタ６の値とＰレジスタ８の値を
加減算器７で加算して再びＳアドレスレジスタ６にセッ
トした後、ステップ１０１へ戻る。ステップ１２１で４
行分の処理が終了した場合は、ステップ１２２へ移行し
７ラグｌ”、Ｌ［が０″にセットされているか缶かを判
断する。＋１０１＋にセットされていない場合はステッ
プ１２５で°゛０”にセットされる。”Ｏ゛′にセット
されている場合はステップ１２５へ移行し、Ｓアドレス
レジスタ６のイ［ほからＰレジスタ８の値を加減算器７
で減算して再びＳアドレスレジスタ乙にセットする。ス
テップ１２３ではこの動作が６回繰り返される。この動
作を６回繰り返すことにより転送元のアドレスは６行前
の先（］ξＩアドレスとなる。次にステップ１２４で７
ラグＦＬＧを′１”にセットする。
上述した操作を行うことにより矩形領域２のデータは４
１］ごとに２回づつ拡大処理のため用いられることにな
る。従って本例では４×４ビツトのマトリクス単位でＩ
ＩＩＪＩ像が拡大される。
１］ごとに２回づつ拡大処理のため用いられることにな
る。従って本例では４×４ビツトのマトリクス単位でＩ
ＩＩＪＩ像が拡大される。
次に本実施例における縮小処理について説明する。尚、
ｔ１？１小処理のためのｉｊｉ！Ｉ御回路は第８図制御
回トの拡大部２５を第９図に示す縮小部２６に置き換え
ることにより容易に冥現でさる。従ってここでは第１０
図に示す回路についてのｄＩｊ説明し、他の部分の説明
はる１１１ｉする。縮小部２６においてＳ Ｌ（レジス
タ２１はセレクタ５から出力される上位４ビツトのデー
タを格納するためのものである９以下縮小処理の詳細を
第１２図のフローチャートを参１ｉｊＪシて説明する。
ｔ１？１小処理のためのｉｊｉ！Ｉ御回路は第８図制御
回トの拡大部２５を第９図に示す縮小部２６に置き換え
ることにより容易に冥現でさる。従ってここでは第１０
図に示す回路についてのｄＩｊ説明し、他の部分の説明
はる１１１ｉする。縮小部２６においてＳ Ｌ（レジス
タ２１はセレクタ５から出力される上位４ビツトのデー
タを格納するためのものである９以下縮小処理の詳細を
第１２図のフローチャートを参１ｉｊＪシて説明する。
尚、拡大処理と同様、本例の縮小処理ｍ位は４×４ （
ビット）のマトリクス、転送単位はバイト毎とする。ま
た本例では矩形領域２のデータな（１／２ ｘ １／２
）倍に縮小する。
ビット）のマトリクス、転送単位はバイト毎とする。ま
た本例では矩形領域２のデータな（１／２ ｘ １／２
）倍に縮小する。
定の設定値をセットする。すなわちＳアドレスレジスタ
６には矩形領域２のスタート番地である“８ＡＤＤ”を
、ＤアドレスレジスタＩＯＫは番地“ＤＡＤＤ″′を、
Ｘレジスタ１１には矩形領域６の横レングス“Ｘ″′を
、Ｘカウンタ１６には矩形領域６の縦レングス“Ｙ″を
、Ｐレジスタにはメモリ１の記憶領域の横レングス相当
数を設定する。次にステップ２０１においてセレクタ５
への制御信号ＵＰ／ＬＯＷ１．！ＳをＵＰ側にする。こ
れは縮小時においては、８ビツトの転送データの内上位
４ビットノテータのみを使うためである。ステップ２０
２ 、２０３ではＳアドレスレジスタ６及びＤアドレス
レジスタ１０の内容をそれぞれＳアドレスカウンタ２２
゜Ｄアドレスカウンタ２６へ転送する。そしてＸレジス
タ１１の内容をＸカウンタ１２へ転送する。
６には矩形領域２のスタート番地である“８ＡＤＤ”を
、ＤアドレスレジスタＩＯＫは番地“ＤＡＤＤ″′を、
Ｘレジスタ１１には矩形領域６の横レングス“Ｘ″′を
、Ｘカウンタ１６には矩形領域６の縦レングス“Ｙ″を
、Ｐレジスタにはメモリ１の記憶領域の横レングス相当
数を設定する。次にステップ２０１においてセレクタ５
への制御信号ＵＰ／ＬＯＷ１．！ＳをＵＰ側にする。こ
れは縮小時においては、８ビツトの転送データの内上位
４ビットノテータのみを使うためである。ステップ２０
２ 、２０３ではＳアドレスレジスタ６及びＤアドレス
レジスタ１０の内容をそれぞれＳアドレスカウンタ２２
゜Ｄアドレスカウンタ２６へ転送する。そしてＸレジス
タ１１の内容をＸカウンタ１２へ転送する。
次にステップ２０４でＳアドレスカウンタ２２が示す番
地の内容をＳレジスタ４にセットする。ステップ２０５
ではＳレジスタ４にセットされた８ビツトのデータの内
上位４ビットがセレクタ５により選択され、ＳＲレジス
タ２１に格納される。次にステップ２０６においてはＳ
アドレスカウンタ２２をカウントアツプし、ステップ２
０７で次の１バイトの転送データを８レジスタ４にセッ
トする。ステップ２０８では縮小部２６においてＳＲレ
ジスタ２１に格納されて〜・る４ビツトのデータと、セ
レクタ５により選択されたＳレジスタ４の上位４ビツト
データとにより８ビツトの縮小データ（Ｓ−ＤＡＴＡ
）が形成される。そしてその８ビツトのデータはステッ
プ２０９において、Ｄアドレスカウンタ２６が示すメモ
リの番地へ書き込まれる。ステップ２１０では矩形領域
３の１行分（横レングス“Ｙ″分）のデータ転送が終了
し、Ｘカウンタ１２が０″′になったか否かを判定する
。
地の内容をＳレジスタ４にセットする。ステップ２０５
ではＳレジスタ４にセットされた８ビツトのデータの内
上位４ビットがセレクタ５により選択され、ＳＲレジス
タ２１に格納される。次にステップ２０６においてはＳ
アドレスカウンタ２２をカウントアツプし、ステップ２
０７で次の１バイトの転送データを８レジスタ４にセッ
トする。ステップ２０８では縮小部２６においてＳＲレ
ジスタ２１に格納されて〜・る４ビツトのデータと、セ
レクタ５により選択されたＳレジスタ４の上位４ビツト
データとにより８ビツトの縮小データ（Ｓ−ＤＡＴＡ
）が形成される。そしてその８ビツトのデータはステッ
プ２０９において、Ｄアドレスカウンタ２６が示すメモ
リの番地へ書き込まれる。ステップ２１０では矩形領域
３の１行分（横レングス“Ｙ″分）のデータ転送が終了
し、Ｘカウンタ１２が０″′になったか否かを判定する
。
Ｘカウンタ１２が“０″であればステップ２１６へ進み
ｕ Ｑ ＆ｌでなければステップ２１１へ進む。ステ
ップ２１１においてはＸカウンタ１２０カウントダウン
が行われる。そしてステップ２１２においてＳアドレス
カウンタ２２をカウントアツプし、転送元のアドレスを
１バイト分進める。またＤアドレスカウンタ２６もカウ
ントアツプし、ステップ２０４へ移行する。ステップ２
１３においてはＸカウンタ１３の値が“０″であるか否
かを判定する。０′の場合は全てのデータ転送が終了し
たことになり、データ転送縮小処理を終了する。データ
転送が終了していない場合はステップ２１４へ進み、Ｄ
アドレスレジスタ１０の値とＰレジスタの値を加算器９
で加算し、再びＤアドレスレジスタ１ｏにセットする。
ｕ Ｑ ＆ｌでなければステップ２１１へ進む。ステ
ップ２１１においてはＸカウンタ１２０カウントダウン
が行われる。そしてステップ２１２においてＳアドレス
カウンタ２２をカウントアツプし、転送元のアドレスを
１バイト分進める。またＤアドレスカウンタ２６もカウ
ントアツプし、ステップ２０４へ移行する。ステップ２
１３においてはＸカウンタ１３の値が“０″であるか否
かを判定する。０′の場合は全てのデータ転送が終了し
たことになり、データ転送縮小処理を終了する。データ
転送が終了していない場合はステップ２１４へ進み、Ｄ
アドレスレジスタ１０の値とＰレジスタの値を加算器９
で加算し、再びＤアドレスレジスタ１ｏにセットする。
次にステップ２１５でＸカウンタ１３の値を１ビツト分
だけカウントダウンする。
だけカウントダウンする。
ステップ２１６では縦方向に４行分の処理が終了したか
否かの判断を行い、終了していなければステップ２１８
へ移行し、Ｓアドレスレジスタ６の値とＰレジスタ８の
値を加減算器７で加算して、再びＳアドレスレジスタ乙
にセットした後ステップ２０２へ戻る。ステップ２１６
で４行分の処理が終了した場合はステップ２１７へ移行
し、Ｓアドレスレジスタ乙の値とＰレジスタ８の値を加
減算器７で加算し、再びＳアドレスレジスタ６にセット
する。
否かの判断を行い、終了していなければステップ２１８
へ移行し、Ｓアドレスレジスタ６の値とＰレジスタ８の
値を加減算器７で加算して、再びＳアドレスレジスタ乙
にセットした後ステップ２０２へ戻る。ステップ２１６
で４行分の処理が終了した場合はステップ２１７へ移行
し、Ｓアドレスレジスタ乙の値とＰレジスタ８の値を加
減算器７で加算し、再びＳアドレスレジスタ６にセット
する。
ステップ２１７ではこの動作が５回繰り返される。
この動作を５回縁９返丁ことにより、転送元のアドレス
は５行先の先頭アドレスとなる。つまり矩形領域２にお
いて、４行分（４ビット分）のデータ転送が終了すると
、次の４行は無視され、５行目から再びデータ転送が行
われる。上述した操作により矩形領域２のデータは４×
４ビツトのマトリクス単位で縮小される。
は５行先の先頭アドレスとなる。つまり矩形領域２にお
いて、４行分（４ビット分）のデータ転送が終了すると
、次の４行は無視され、５行目から再びデータ転送が行
われる。上述した操作により矩形領域２のデータは４×
４ビツトのマトリクス単位で縮小される。
尚、上述した如き構成をとることにより、ディザ処理さ
れた画像の拡大、縮小処理と同時に他の記憶領域へのデ
ータ転送も行うことができる。つまり、データの転送時
間と同等な時間にてデータの加工を行いながら転送する
事が可能となり、データ転送した後データ処理を行うも
のに比べて非常に効率の良いデータ転送を行うことがで
きるものである。
れた画像の拡大、縮小処理と同時に他の記憶領域へのデ
ータ転送も行うことができる。つまり、データの転送時
間と同等な時間にてデータの加工を行いながら転送する
事が可能となり、データ転送した後データ処理を行うも
のに比べて非常に効率の良いデータ転送を行うことがで
きるものである。
また、本例では４×４のディザマトリクスによりディザ
処理された画像の拡大、縮小について説明したが、他の
サイズのデイザマ） ＩＪクスにより処理された画像に
ついても同様に拡大、縮小を行うことができる。また倍
率も任意に設定！、きることは熱論である。
処理された画像の拡大、縮小について説明したが、他の
サイズのデイザマ） ＩＪクスにより処理された画像に
ついても同様に拡大、縮小を行うことができる。また倍
率も任意に設定！、きることは熱論である。
また拡大、縮小のための制御回路は上述した実施例に限
らず、他の構成の回路等によって行っても良い。
らず、他の構成の回路等によって行っても良い。
また本例ではディザ処理された画像の拡大、縮小処理を
行ったが、濃度パターン法等により処理された画像に対
しても本発明は適用できるものである。
行ったが、濃度パターン法等により処理された画像に対
しても本発明は適用できるものである。
以上説明した様に本発明によれば、ディザ処理による再
現性を失うことなく画像の拡大、縮小を行うことができ
るので優れた再生画像を得ることができる。
現性を失うことなく画像の拡大、縮小を行うことができ
るので優れた再生画像を得ることができる。
第１図は原画像を示す図、第２図は第１図の画像を拡大
した場合の図、第３図は第１図の画像を縮小した場合の
図、第４図は４×４のディザマトリクスを示す図、第５
図は従来の拡大方法でディザ処理画像を拡大した場合に
生ずるみかけ上のディザマトリクスを示す図、第６図は
本発明による拡大画像を説明するための図、第７図（ａ
） 、 （ｂ）は本発明による縮小画像を説明するため
の図、第８図は本実施例における制御回路図、第９図は
縮小部を示す図、第１０図は記憶装置１を示す図、第１
１図は本実施例における拡大処理のための制御フローチ
ャート）第１２図は本実施例における縮小処理のための
制御フローチャートである。 ここで４はＳレジスタ、５はセレクタ、６はＳアドレス
レジスタ、７は加減算器、８はＰレジスタ、１０はＤア
ドレスレジスタ、１１はＸレジスタ、１２はＸカウンタ
、１６はＹカウンタ、１４は制御装置、２２はＳアドレ
スカウンタ、２６はＤアドレスカウンタである。
した場合の図、第３図は第１図の画像を縮小した場合の
図、第４図は４×４のディザマトリクスを示す図、第５
図は従来の拡大方法でディザ処理画像を拡大した場合に
生ずるみかけ上のディザマトリクスを示す図、第６図は
本発明による拡大画像を説明するための図、第７図（ａ
） 、 （ｂ）は本発明による縮小画像を説明するため
の図、第８図は本実施例における制御回路図、第９図は
縮小部を示す図、第１０図は記憶装置１を示す図、第１
１図は本実施例における拡大処理のための制御フローチ
ャート）第１２図は本実施例における縮小処理のための
制御フローチャートである。 ここで４はＳレジスタ、５はセレクタ、６はＳアドレス
レジスタ、７は加減算器、８はＰレジスタ、１０はＤア
ドレスレジスタ、１１はＸレジスタ、１２はＸカウンタ
、１６はＹカウンタ、１４は制御装置、２２はＳアドレ
スカウンタ、２６はＤアドレスカウンタである。
Claims (1)
- 画像の拡大・縮小処理を行なう画像処理装置において、
所定領域単位で前記画像の拡大・縮小処理を行なうこと
を特徴とする画像処理装置。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58193876A JPS6085680A (ja) | 1983-10-17 | 1983-10-17 | 画像処理方法 |
| US06/660,924 US4734786A (en) | 1983-10-17 | 1984-10-15 | Image processing apparatus |
| DE19843437895 DE3437895A1 (de) | 1983-10-17 | 1984-10-16 | Bildverarbeitungseinrichtung |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58193876A JPS6085680A (ja) | 1983-10-17 | 1983-10-17 | 画像処理方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6085680A true JPS6085680A (ja) | 1985-05-15 |
| JPH053783B2 JPH053783B2 (ja) | 1993-01-18 |
Family
ID=16315213
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58193876A Granted JPS6085680A (ja) | 1983-10-17 | 1983-10-17 | 画像処理方法 |
Country Status (3)
| Country | Link |
|---|---|
| US (1) | US4734786A (ja) |
| JP (1) | JPS6085680A (ja) |
| DE (1) | DE3437895A1 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6378278A (ja) * | 1986-09-20 | 1988-04-08 | Canon Inc | 画像処理装置 |
Families Citing this family (20)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE3141450A1 (de) * | 1980-10-17 | 1982-06-03 | Canon K.K., Tokyo | "bildverarbeitungssystem" |
| JP2635308B2 (ja) * | 1985-10-18 | 1997-07-30 | キヤノン株式会社 | 画像処理装置 |
| DE3545157A1 (de) * | 1985-12-20 | 1987-06-25 | Philips Patentverwaltung | Verfahren und schaltungsanordnung zur aufloesungsumwandlung von binaeren pseudo-halbtonbildern |
| DE3789461D1 (de) * | 1986-01-22 | 1994-05-05 | Konishiroku Photo Ind | Bildverarbeitungssystem mit Fähigkeit zum Vergrössungs- und Reduzier-Betrieb. |
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| US10361802B1 (en) | 1999-02-01 | 2019-07-23 | Blanding Hovenweep, Llc | Adaptive pattern recognition based control system and method |
| US8352400B2 (en) | 1991-12-23 | 2013-01-08 | Hoffberg Steven M | Adaptive pattern recognition based controller apparatus and method and human-factored interface therefore |
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| US8364136B2 (en) | 1999-02-01 | 2013-01-29 | Steven M Hoffberg | Mobile system, a method of operating mobile system and a non-transitory computer readable medium for a programmable control of a mobile system |
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| JPS5825767A (ja) * | 1981-08-07 | 1983-02-16 | Oki Electric Ind Co Ltd | 画像処理装置 |
| JPS5859666A (ja) * | 1981-10-06 | 1983-04-08 | Oki Electric Ind Co Ltd | 画像処理装置 |
Family Cites Families (2)
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| US4394693A (en) * | 1979-03-23 | 1983-07-19 | International Business Machines Corporation | System and method for generating enlarged or reduced images |
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-
1983
- 1983-10-17 JP JP58193876A patent/JPS6085680A/ja active Granted
-
1984
- 1984-10-15 US US06/660,924 patent/US4734786A/en not_active Expired - Lifetime
- 1984-10-16 DE DE19843437895 patent/DE3437895A1/de active Granted
Patent Citations (4)
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Also Published As
| Publication number | Publication date |
|---|---|
| US4734786A (en) | 1988-03-29 |
| DE3437895C2 (ja) | 1991-12-05 |
| DE3437895A1 (de) | 1985-04-25 |
| JPH053783B2 (ja) | 1993-01-18 |
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