JPS5983254A - ウオツチドツグタイマ - Google Patents
ウオツチドツグタイマInfo
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- JPS5983254A JPS5983254A JP57192558A JP19255882A JPS5983254A JP S5983254 A JPS5983254 A JP S5983254A JP 57192558 A JP57192558 A JP 57192558A JP 19255882 A JP19255882 A JP 19255882A JP S5983254 A JPS5983254 A JP S5983254A
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- 230000002159 abnormal effect Effects 0.000 claims description 2
- 230000005856 abnormality Effects 0.000 abstract description 15
- 238000001514 detection method Methods 0.000 abstract description 10
- 238000010586 diagram Methods 0.000 description 4
- 238000000034 method Methods 0.000 description 3
- 238000012544 monitoring process Methods 0.000 description 3
- 230000002123 temporal effect Effects 0.000 description 2
- 239000003990 capacitor Substances 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 239000003292 glue Substances 0.000 description 1
- 230000007257 malfunction Effects 0.000 description 1
- 238000012806 monitoring device Methods 0.000 description 1
Classifications
-
- G—PHYSICS
- G06—COMPUTING; CALCULATING OR COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F11/00—Error detection; Error correction; Monitoring
- G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
- G06F11/0703—Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation
- G06F11/0751—Error or fault detection not based on redundancy
- G06F11/0754—Error or fault detection not based on redundancy by exceeding limits
- G06F11/0757—Error or fault detection not based on redundancy by exceeding limits by exceeding a time limit, i.e. time-out, e.g. watchdogs
-
- G—PHYSICS
- G01—MEASURING; TESTING
- G01R—MEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
- G01R29/00—Arrangements for measuring or indicating electric quantities not covered by groups G01R19/00 - G01R27/00
- G01R29/02—Measuring characteristics of individual pulses, e.g. deviation from pulse flatness, rise time or duration
- G01R29/027—Indicating that a pulse characteristic is either above or below a predetermined value or within or beyond a predetermined range of values
- G01R29/0273—Indicating that a pulse characteristic is either above or below a predetermined value or within or beyond a predetermined range of values the pulse characteristic being duration, i.e. width (indicating that frequency of pulses is above or below a certain limit)
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- Theoretical Computer Science (AREA)
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- General Engineering & Computer Science (AREA)
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(技術分野)
本発明は、マイクロコンピュータの動作を正確に監視で
きるウォッチドッグタイマに関するものである。
きるウォッチドッグタイマに関するものである。
(背景技術)
ウォッチドッグタイマは高い信頼性を要求されるシステ
ムの監視装置として有用である。特にマイクロコンビー
ータシステムの応用分野の拡大に伴なって、ウォッチド
ッグタイマの必要性が高まっている。従来のウォッチド
ッグタイマを第1図(a)に示す。これは拘トリガ可能
な単安定マルチバイブレータ(リトリガブルモノステー
ブルマルチバ、イブレータ・・・・・・以下MMVとす
る)を使った例である。
ムの監視装置として有用である。特にマイクロコンビー
ータシステムの応用分野の拡大に伴なって、ウォッチド
ッグタイマの必要性が高まっている。従来のウォッチド
ッグタイマを第1図(a)に示す。これは拘トリガ可能
な単安定マルチバイブレータ(リトリガブルモノステー
ブルマルチバ、イブレータ・・・・・・以下MMVとす
る)を使った例である。
トリガ入力としては、デジタルシステムの内部で定期的
に発生するパルス(例えばシステムクロックパルス)を
入力する。出力パルス幅は、入力パルスの間隔の約1.
5倍になるように外付けの抵抗■tトコンデンサCで設
定してお((第1図(l〕)のT2)。
に発生するパルス(例えばシステムクロックパルス)を
入力する。出力パルス幅は、入力パルスの間隔の約1.
5倍になるように外付けの抵抗■tトコンデンサCで設
定してお((第1図(l〕)のT2)。
従って、このMMVはシステムの動作が正常な場合は入
力パルスによって常にトリ力されており、出力はJTレ
ベルを保持している。第1図(1))の点線のように入
力パルスが1発でも抜けると、へ・I MVの出力は設
定された時間′P2後Lレベルとなる。これによって、
システムの動作か異常になったことを検出できる。
力パルスによって常にトリ力されており、出力はJTレ
ベルを保持している。第1図(1))の点線のように入
力パルスが1発でも抜けると、へ・I MVの出力は設
定された時間′P2後Lレベルとなる。これによって、
システムの動作か異常になったことを検出できる。
しかし、このような方法ではシステムの動作異常かMM
VO入カパルスに反映される場合は検出できろが、反映
されない場合は検出不rtJ能である。
VO入カパルスに反映される場合は検出できろが、反映
されない場合は検出不rtJ能である。
マイクロコンビ・、−タシステムに於ては、内蔵のプロ
グラムタイマを用いてこのようなウォッチドッグタイマ
が実現できる。第2図(alにその例を示す。プログラ
ムタイマ1は、レジスタ2、コンパレータ:つ、カウン
タ4、スクート・ストップコントロール回路4′から構
成されている。φは命令実行サイクル毎に出るパルスで
ある。動作を説明すると、プログラムの特定の個所にタ
イマの値(])ATA)をレジスタ2にプリセットする
命令を入れておく。この命令が実行されると、レジスタ
2への州込み信号W1.によってDATAかレジスタ2
に一占込まれると同時にカウンタ4をリセットする。
グラムタイマを用いてこのようなウォッチドッグタイマ
が実現できる。第2図(alにその例を示す。プログラ
ムタイマ1は、レジスタ2、コンパレータ:つ、カウン
タ4、スクート・ストップコントロール回路4′から構
成されている。φは命令実行サイクル毎に出るパルスで
ある。動作を説明すると、プログラムの特定の個所にタ
イマの値(])ATA)をレジスタ2にプリセットする
命令を入れておく。この命令が実行されると、レジスタ
2への州込み信号W1.によってDATAかレジスタ2
に一占込まれると同時にカウンタ4をリセットする。
次にスターl−命令を実行すると、φがカウンタに人力
されカウンタはOかも歩進し、その内容かレジスタ2内
のデータと一致するとコンパレータ3の出力に一致伯号
Mを出力する。ここで、一致する直Ail K丙びタイ
マのプリセット命令を置けば、一致信号Mを出力するこ
となく再び次のDATAかレジスタに入り、カウンタは
Oかもカウントを再開する。このような方法で、プログ
ラムの中に適当な間隔をお℃・てタイマのノリセント命
令をお(ことによってウォッチドッグタイマが実現され
る。
されカウンタはOかも歩進し、その内容かレジスタ2内
のデータと一致するとコンパレータ3の出力に一致伯号
Mを出力する。ここで、一致する直Ail K丙びタイ
マのプリセット命令を置けば、一致信号Mを出力するこ
となく再び次のDATAかレジスタに入り、カウンタは
Oかもカウントを再開する。このような方法で、プログ
ラムの中に適当な間隔をお℃・てタイマのノリセント命
令をお(ことによってウォッチドッグタイマが実現され
る。
第2図(1))のタイミング図で再度説明すると5.5
’、 5“の各々はプリセット命令の実行される時間的
位置を示1−16は5の次に実行されるべきプリセット
命令の時間的位置を示す。もし6が□(i’jらかの異
常によって実行されないとき、あるいは8のように遅(
実行されるような場合は5でプリセット(〜だ値に基づ
(一致信号M(7)が出力され、プログラムの実行に伺
もかの異常があったことが判断できる。
’、 5“の各々はプリセット命令の実行される時間的
位置を示1−16は5の次に実行されるべきプリセット
命令の時間的位置を示す。もし6が□(i’jらかの異
常によって実行されないとき、あるいは8のように遅(
実行されるような場合は5でプリセット(〜だ値に基づ
(一致信号M(7)が出力され、プログラムの実行に伺
もかの異常があったことが判断できる。
この出力は警報ブザーをトリガするか、異常処J用ルー
チンを開始するための割込みを発生する力・、システム
にリセットをかけるなどの目的に使用される。
チンを開始するための割込みを発生する力・、システム
にリセットをかけるなどの目的に使用される。
第2図のような方法に於ても次のような問題カー残され
ている。
ている。
(1) タイマにプリセットした時間より早めに次の
プリセント命令か実行されろような異常か発生したとき
は、検出できない。
プリセント命令か実行されろような異常か発生したとき
は、検出できない。
(2)一致信号か出な(なるような故障かあっても検出
できない。
できない。
従って、従来の方法によるウォッチドッグタイマにおい
ては起り得る全ての故障に対し、検出できる割合が非常
に低いものであった。別の表現をすれば、従来のウォッ
チドッグタイマはシステムの動作を正確に監視している
とは言えないものてあった。
ては起り得る全ての故障に対し、検出できる割合が非常
に低いものであった。別の表現をすれば、従来のウォッ
チドッグタイマはシステムの動作を正確に監視している
とは言えないものてあった。
(発明の諌題ン
本発明は従来の技術の上記欠点を改善するも久で、その
特徴は、書込み信号(Wr )によりデータな書込むレ
ジスタと、クロックパルス(φ)により歩進するカウン
タと、該カウンタの内容と前記レジスタの内容とが一致
したとき一致出力信号を発生するプログラムタイマと;
該−散出力信号をノくルス(φ)の1周期分保持する第
1のフリップフロップ(1”+ )と;−散出力信号を
パルス(φ)に同期して保持する第2の7リツプフロツ
プ(F2)と;第2のフリップフロップの出力をパルス
(φ)に同期して保持する第3のフリップフロップ(F
3)と;第1のフリップフロップ(F+ )の反私出力
と書込み信号(WT )との論理積を提供するアンド回
路(G、)と;第3のノリツブフロップ(F3)の出力
と前記アンド回路(G2)との綿埋和を提供するオア回
路(G2)とを有し、該オア回路(G2)の出力にコン
パータの異常動作(NG)信号を発生するごときウォッ
チドッグタイマにある。
特徴は、書込み信号(Wr )によりデータな書込むレ
ジスタと、クロックパルス(φ)により歩進するカウン
タと、該カウンタの内容と前記レジスタの内容とが一致
したとき一致出力信号を発生するプログラムタイマと;
該−散出力信号をノくルス(φ)の1周期分保持する第
1のフリップフロップ(1”+ )と;−散出力信号を
パルス(φ)に同期して保持する第2の7リツプフロツ
プ(F2)と;第2のフリップフロップの出力をパルス
(φ)に同期して保持する第3のフリップフロップ(F
3)と;第1のフリップフロップ(F+ )の反私出力
と書込み信号(WT )との論理積を提供するアンド回
路(G、)と;第3のノリツブフロップ(F3)の出力
と前記アンド回路(G2)との綿埋和を提供するオア回
路(G2)とを有し、該オア回路(G2)の出力にコン
パータの異常動作(NG)信号を発生するごときウォッ
チドッグタイマにある。
(発明の構成および作用)
第3図は本発明の実施例であって1(鎖線内))
は従来のプログラムタイマ、F1〜F3はD形ンリソプ
フロノブ、G1はアンドゲート、G2.G3はオアゲ−
トである。以下、詳細に説明する。
は従来のプログラムタイマ、F1〜F3はD形ンリソプ
フロノブ、G1はアンドゲート、G2.G3はオアゲ−
トである。以下、詳細に説明する。
図に示すようにレジスタ、コンパレータ、カウンタ、ス
タートストップ回路などからなる点線部1のプログラム
タイマ1の一致信号出力(第3図(2j)の場合コンパ
レータの出力M)をフリラグフロップ1゛1どF2のデ
ータ入力端子1)、 、 J)、、に与え、前記F1の
反転出力端子Q1はアントゲ−)G、の一方の入力端子
へ、1・2の出力端子Q2はF、のデータ入力端子1)
3へ接続すると共にオアゲートG3の一方の入力端子へ
接続する。1.込パルスW□はプログラムタイマ1のレ
ジスタに入力すると共にオアゲー)Ci3の一方の入力
、■・′2のリセット端子几2、およびアントゲ−トG
、の他の入力端子へ人力するよう接続する。
タートストップ回路などからなる点線部1のプログラム
タイマ1の一致信号出力(第3図(2j)の場合コンパ
レータの出力M)をフリラグフロップ1゛1どF2のデ
ータ入力端子1)、 、 J)、、に与え、前記F1の
反転出力端子Q1はアントゲ−)G、の一方の入力端子
へ、1・2の出力端子Q2はF、のデータ入力端子1)
3へ接続すると共にオアゲートG3の一方の入力端子へ
接続する。1.込パルスW□はプログラムタイマ1のレ
ジスタに入力すると共にオアゲー)Ci3の一方の入力
、■・′2のリセット端子几2、およびアントゲ−トG
、の他の入力端子へ人力するよう接続する。
初期リセット信号R]号SはF、のセット人力S、、I
パ、のりセット人力1モ3へ接続する。1・3の出力Q
3とアンドゲートq1の出力はオアゲート()2の入力
へそれぞれ接続し、このゲートG2の出力を異常検出出
力NOとする。なお1”1 r F21 F3のクロッ
ク入力端子へはプログラムタイマ1のスタートストップ
回路を経てクロックパルスを入力するよう接続する。
パ、のりセット人力1モ3へ接続する。1・3の出力Q
3とアンドゲートq1の出力はオアゲート()2の入力
へそれぞれ接続し、このゲートG2の出力を異常検出出
力NOとする。なお1”1 r F21 F3のクロッ
ク入力端子へはプログラムタイマ1のスタートストップ
回路を経てクロックパルスを入力するよう接続する。
いま、プリセント命令で次にプリセットするまでの時間
に対応するパルス数(第3図(1つ)の場合P1〜P4
の4パルス)をレジスタに書込むと、カウンタとC2が
Oとなる(書込み信号WTが1j゛2のリセット](,
2に入るため)。このとき]”l + F 3はシステ
ムのリセット信号によってすでにQ+ = 1 、C3
= oとなっている。スタート命令を実行すると入力パ
ルスφかカウンタとフリラグフロップに入力され、Ql
が0となり、カウンタはOから歩進する。
に対応するパルス数(第3図(1つ)の場合P1〜P4
の4パルス)をレジスタに書込むと、カウンタとC2が
Oとなる(書込み信号WTが1j゛2のリセット](,
2に入るため)。このとき]”l + F 3はシステ
ムのリセット信号によってすでにQ+ = 1 、C3
= oとなっている。スタート命令を実行すると入力パ
ルスφかカウンタとフリラグフロップに入力され、Ql
が0となり、カウンタはOから歩進する。
ここで、もしプリセットした時間より早く次のプリセン
ト命令が実行されると(9)、ゲートG、が開きG2を
通して異常検出信号(10)が出力されろ。またプリセ
ノl−した時間より遅(次のプリセット命令但 が実行され(11)ても、G1(J2を通して異常検出
力信号(12)が出力される。プリセントした時間内(
13)に次のプリセット命令(15)が実行された場合
には、異常検出信号は出力されない。またこのときの書
込み信号WT(+ 51によってC2がすセットされる
のでC3はLのままである。
ト命令が実行されると(9)、ゲートG、が開きG2を
通して異常検出信号(10)が出力されろ。またプリセ
ノl−した時間より遅(次のプリセット命令但 が実行され(11)ても、G1(J2を通して異常検出
力信号(12)が出力される。プリセントした時間内(
13)に次のプリセット命令(15)が実行された場合
には、異常検出信号は出力されない。またこのときの書
込み信号WT(+ 51によってC2がすセットされる
のでC3はLのままである。
もしブリセソl−した時間内(13つに次のプリセット
命令か実行されなし・場合(16)は、C31/J=I
Iとなって02を通して異常検出信号(17)か出力さ
れろ。
命令か実行されなし・場合(16)は、C31/J=I
Iとなって02を通して異常検出信号(17)か出力さ
れろ。
このように、設定した時間内で次の設定値をプリセント
したときのみ正常とすることによって、プリセット信号
がプリセット値より早(でも遅くても、また、一致信号
が出ないような故障でも検出することができる。
したときのみ正常とすることによって、プリセット信号
がプリセット値より早(でも遅くても、また、一致信号
が出ないような故障でも検出することができる。
第4図は、このようなウォッチドッグタイマを使用する
場合の動作フローチャートの例である。
場合の動作フローチャートの例である。
Bは実際の処理プログラムのブロックであり、この処理
が正常に終了するまでの時間をへの命令でプリセントす
る。最初だけはスタート命令によって、ウォッチドッグ
タイマを起動する。注目すφ処理ブロックI3.に対し
てはA1、B2は対してはA2.133に対してはA3
なる命令で各々の埴をセントすることにより、正確に監
視することが可能になる。
が正常に終了するまでの時間をへの命令でプリセントす
る。最初だけはスタート命令によって、ウォッチドッグ
タイマを起動する。注目すφ処理ブロックI3.に対し
てはA1、B2は対してはA2.133に対してはA3
なる命令で各々の埴をセントすることにより、正確に監
視することが可能になる。
Cはウォッチドッグタイマのストップ命令であり、待ち
(D、)や分岐(1)2)のため次のプリセット値が決
定できない場合、一時的に監視を中止するためのもので
ある。
(D、)や分岐(1)2)のため次のプリセット値が決
定できない場合、一時的に監視を中止するためのもので
ある。
分岐後、A4. A、などで再び監視を再開することか
できる。C2,C3のストップ命令はプログラムの終了
による監視の中止を行うためのものである。
できる。C2,C3のストップ命令はプログラムの終了
による監視の中止を行うためのものである。
(発明の効果)
以上説明したように、あるプログラムの処理に必要な時
間をウォッチドッグタイマにプリセットしておき、その
時間になったとき、次の処理に要する時間をプリセット
するという手順をくり返すことによってグリセットの時
間が正常より早(でも遅くても異常検出でき、また一致
信号が出ないか、あるいは出たままとなるような故障で
も異常として検出できるので、起り得る全ての故障に対
して検出できる割合いが非常に高いという特徴か得られ
る。つまり、システムの監視を正確に信頼性高く行うこ
とができる。
間をウォッチドッグタイマにプリセットしておき、その
時間になったとき、次の処理に要する時間をプリセット
するという手順をくり返すことによってグリセットの時
間が正常より早(でも遅くても異常検出でき、また一致
信号が出ないか、あるいは出たままとなるような故障で
も異常として検出できるので、起り得る全ての故障に対
して検出できる割合いが非常に高いという特徴か得られ
る。つまり、システムの監視を正確に信頼性高く行うこ
とができる。
不発明の実施例では、入力クロックとして昔令実行サイ
クルパルスを用いたが、これを分周して2ないし3命令
実行ザイクル毎にカウンタを歩進することにより、プリ
セント時間内に次のプリセット命令の実行の許される時
間範囲を広くすることも可能である。また、Dフリップ
フロップの代りに他のフリップフロップ、或はゲート回
路の組合せなどで構成することも可能である。
クルパルスを用いたが、これを分周して2ないし3命令
実行ザイクル毎にカウンタを歩進することにより、プリ
セント時間内に次のプリセット命令の実行の許される時
間範囲を広くすることも可能である。また、Dフリップ
フロップの代りに他のフリップフロップ、或はゲート回
路の組合せなどで構成することも可能である。
第1図(al及び(]〕)は従来のウオッチドックタイ
マ回路とその動作シーケンス図、第2図(al及び(b
)は従来の別のウオッチドックタイマ回路とその動作シ
ーケンス図、第3図(a)及び(1))は本発明による
ウォ、・チドソグタイマ回路とその動作シーケンス図、
第4図は本発明によるウオッチドックタイマ回路を用い
るコンピュータの動作フローである。 1;プログラムタイマ FIr F2+ F3 :フリップフロップG1 、
G2 ;ゲート回路 特許出願人 沖電気工業株式会社 %訂出願代理人 弁理士 山 本 恵 − 箔1図(b) 第2図(0) 第2図(b) 第3図(CI) 第3図(b) 3
マ回路とその動作シーケンス図、第2図(al及び(b
)は従来の別のウオッチドックタイマ回路とその動作シ
ーケンス図、第3図(a)及び(1))は本発明による
ウォ、・チドソグタイマ回路とその動作シーケンス図、
第4図は本発明によるウオッチドックタイマ回路を用い
るコンピュータの動作フローである。 1;プログラムタイマ FIr F2+ F3 :フリップフロップG1 、
G2 ;ゲート回路 特許出願人 沖電気工業株式会社 %訂出願代理人 弁理士 山 本 恵 − 箔1図(b) 第2図(0) 第2図(b) 第3図(CI) 第3図(b) 3
Claims (1)
- 書込み信号(WT )によりデータを書込むレジスタと
、クロックパルス(φ)により歩進するカウンタと、該
カウンタの内容と前記レジスタの内容とが一致したとき
一致出力信号を発生するプログラムタイマと;該−散出
力信号をパルス(φ)の1周期分保持する第1のフリソ
プフロッ(Fl)と;−散出力信号ヲパルス(φ)に同
期して保持する第2のフリップフロップ(F2)と;第
2の7リツプフロツプの出力をパルス(φ)に同期して
保持する第3のフリップフロッグ(F3)と;第1のフ
リップフロッグ(Fl)の反転出力と書込み信号(WT
)との論理積を提供するアンド回路(G1)と;第3
のフリップフロップ(F3)の出力と前記アンド回路(
G2)との論理和を提供するオア回路(G2)とを有し
、該オア回路(G2)の出力にコンビーータの異常動作
(NG)信号を発生することを特徴とするウォッチドッ
グタイマ。
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57192558A JPS5983254A (ja) | 1982-11-04 | 1982-11-04 | ウオツチドツグタイマ |
US06/547,932 US4566111A (en) | 1982-11-04 | 1983-11-02 | Watchdog timer |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP57192558A JPS5983254A (ja) | 1982-11-04 | 1982-11-04 | ウオツチドツグタイマ |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS5983254A true JPS5983254A (ja) | 1984-05-14 |
JPH0341853B2 JPH0341853B2 (ja) | 1991-06-25 |
Family
ID=16293268
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP57192558A Granted JPS5983254A (ja) | 1982-11-04 | 1982-11-04 | ウオツチドツグタイマ |
Country Status (2)
Country | Link |
---|---|
US (1) | US4566111A (ja) |
JP (1) | JPS5983254A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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US4766601A (en) * | 1985-12-23 | 1988-08-23 | Tektronix, Inc. | Constant carrier watchdog |
JPS62203420A (ja) * | 1986-03-03 | 1987-09-08 | Fanuc Ltd | カウンタ回路 |
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