JPS586121A - 半導体基板 - Google Patents
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は半導体基板に係り、轡に単結晶半導体基板上に
絶縁膜が慾開けして形成され、皺窓mシよび絶縁膜上に
単結晶半導体膜が形成されて成る半導体基1[KIlす
る。
絶縁膜が慾開けして形成され、皺窓mシよび絶縁膜上に
単結晶半導体膜が形成されて成る半導体基1[KIlす
る。
単結晶半導体基板表面に絶縁膜が爆開けして形成され、
該窓舒および絶縁膜上に単結晶半導体膜がW4成された
半導体基1[K調しては%最近 ムP)LPhys、
Lett、 5B (5)、 I March 19
81 K報告された技術がある。
該窓舒および絶縁膜上に単結晶半導体膜がW4成された
半導体基1[K調しては%最近 ムP)LPhys、
Lett、 5B (5)、 I March 19
81 K報告された技術がある。
しかし、前P技術に入る単結晶半導体基板上の窓−叶さ
れた絶優膜上と廖部上に形成された単結晶半導体lIは
、窓mK於て単結晶半導体膜O段差を小さくするために
、絶縁1FO1lF犀を小さくせねばならず、上記単結
晶半導体膜上に4導体装菅を構成する場合に、単結晶半
導体基板と牟導体装置との間に寄生する電気容量が小さ
くできず、前記電気容量を小さくするために絶縁IFの
厚さを厚くすると、WJ部の単結晶半導体lll0段差
が大会(なり、単結晶半導体#に半導体鋏曾を構威すゐ
場合に、前記段差v上と交差する電極配線が段差部で段
切れ断線を起こす岬の欠点がある。
れた絶優膜上と廖部上に形成された単結晶半導体lIは
、窓mK於て単結晶半導体膜O段差を小さくするために
、絶縁1FO1lF犀を小さくせねばならず、上記単結
晶半導体膜上に4導体装菅を構成する場合に、単結晶半
導体基板と牟導体装置との間に寄生する電気容量が小さ
くできず、前記電気容量を小さくするために絶縁IFの
厚さを厚くすると、WJ部の単結晶半導体lll0段差
が大会(なり、単結晶半導体#に半導体鋏曾を構威すゐ
場合に、前記段差v上と交差する電極配線が段差部で段
切れ断線を起こす岬の欠点がある。
本発明は上記欠点をなくシ、単結晶半導体基板との寄生
容量の小さい高速の半導体善営を単結晶半導体9KW4
成する事シよび電極配線の段差部での段切れ断線のない
高僧Il変り半導体11fIm作用半導体基板を提供す
るど\とを目的とする。
容量の小さい高速の半導体善営を単結晶半導体9KW4
成する事シよび電極配線の段差部での段切れ断線のない
高僧Il変り半導体11fIm作用半導体基板を提供す
るど\とを目的とする。
上記目的を達成するための本発Tl140基本的構威は
、単結晶半導体基1[表面にけ絶**が−一けして形成
されて成り、該Wl舒および絶縁を上にけ単結晶半導体
膜が形成された半導体基板に於て、上鮎絶縁膜の窓部に
’S成された単結晶半導体膜の表面が周辺絶縁膜上の単
結晶半導体膜表面とほぼ平i1に形成されて成る事を特
徴とすゐ。
、単結晶半導体基1[表面にけ絶**が−一けして形成
されて成り、該Wl舒および絶縁を上にけ単結晶半導体
膜が形成された半導体基板に於て、上鮎絶縁膜の窓部に
’S成された単結晶半導体膜の表面が周辺絶縁膜上の単
結晶半導体膜表面とほぼ平i1に形成されて成る事を特
徴とすゐ。
以下、本発明を実施例により詳述すゐ。
第1111は本発明の半導体基板を製作する場合の11
作法に関する一例を半導体基板の断面図を工春順に示し
たものである。雛1図では、すづ単結晶半導体基板(B
1岬)10表面KOVD法岬により形成されたα5zク
ロン厚の810.膜2と、その上KOVD法岬により形
威された81,11. @ 3を部分的にフォトエツチ
ング法により螢に窓部となる部分に残して形成し、上記
EIiO,[12tIPよび811)J、膜5會マスク
として下地単結晶半導体基板を1ζクロンS度KOH溶
液による異方性エツチングによりエツチングし溝II4
を形成する0次で前記s10.膜2シよびlli、)i
、膜3をマスクとして、熱駿化により 810.#の絶
縁WI5を基板10褒面では埋平坦になる様に形成し、
810.膜2′1及び’is M41F 3を除去すゐ
、前記の基板の衰11KO’VD法岬により多結晶状オ
たはアモルファス状Oシリコ/f16fα5ミクロン厚
で形成し、そのlIwから基板1を1200’cs廖K
pp熱しながら熱曽オたは光線を照射して前記シリコン
I16を融解し、冷却過1で再結晶化して単結晶半導体
II7を形威するととKよ抄、平坦な単結晶半導体11
7が形威される。
作法に関する一例を半導体基板の断面図を工春順に示し
たものである。雛1図では、すづ単結晶半導体基板(B
1岬)10表面KOVD法岬により形成されたα5zク
ロン厚の810.膜2と、その上KOVD法岬により形
威された81,11. @ 3を部分的にフォトエツチ
ング法により螢に窓部となる部分に残して形成し、上記
EIiO,[12tIPよび811)J、膜5會マスク
として下地単結晶半導体基板を1ζクロンS度KOH溶
液による異方性エツチングによりエツチングし溝II4
を形成する0次で前記s10.膜2シよびlli、)i
、膜3をマスクとして、熱駿化により 810.#の絶
縁WI5を基板10褒面では埋平坦になる様に形成し、
810.膜2′1及び’is M41F 3を除去すゐ
、前記の基板の衰11KO’VD法岬により多結晶状オ
たはアモルファス状Oシリコ/f16fα5ミクロン厚
で形成し、そのlIwから基板1を1200’cs廖K
pp熱しながら熱曽オたは光線を照射して前記シリコン
I16を融解し、冷却過1で再結晶化して単結晶半導体
II7を形威するととKよ抄、平坦な単結晶半導体11
7が形威される。
第2図は本発明の半導体基板、を製作する場合の製作法
を示す他の実施例を半導体基板の断面図を工8FIK示
したものである。館2図では、壇ず単結晶半導体基板(
81等)11の**に*h酸化岬により1zクロン厚の
絶縁II (sto、等)12を形成しホト・エツチン
グによ勢絶縁膜の窓開けを行なう次で窓部にエピタキシ
ャル法によ勤蒙1の単結晶半導体1113を壌込み形成
し、その表面を絶縁膜12の表面とほぼ平坦になるよう
Kする。前記の基板の表面KOVD法岬により多結晶状
オたはアモルファス状のシリコン1114vr(15(
クロン厚で形成し、その表面から基板11を1200℃
糧度に加熱しながら熱線壇たは光線を照射して前記シリ
コン1114を融解し、冷却過穆で再結晶化して単結晶
半導体l115を形威すゐことKよ抄、平坦な単結晶体
膜15が形成されゐ。
を示す他の実施例を半導体基板の断面図を工8FIK示
したものである。館2図では、壇ず単結晶半導体基板(
81等)11の**に*h酸化岬により1zクロン厚の
絶縁II (sto、等)12を形成しホト・エツチン
グによ勢絶縁膜の窓開けを行なう次で窓部にエピタキシ
ャル法によ勤蒙1の単結晶半導体1113を壌込み形成
し、その表面を絶縁膜12の表面とほぼ平坦になるよう
Kする。前記の基板の表面KOVD法岬により多結晶状
オたはアモルファス状のシリコン1114vr(15(
クロン厚で形成し、その表面から基板11を1200℃
糧度に加熱しながら熱線壇たは光線を照射して前記シリ
コン1114を融解し、冷却過穆で再結晶化して単結晶
半導体l115を形威すゐことKよ抄、平坦な単結晶体
膜15が形成されゐ。
こOsK単結晶半導体基板衰面に絶**うt窓開けして
形成され、該慾郁および絶縁膜上に単結晶半導体膜が平
坦Kl!l成された半導体基板を用−・て上配単結晶半
導体腓に半導体装置を形成する場合に、絶縁膜の厚さが
厚くfきるので半導体装置と単結晶半導体基板との寄生
容量が減少し一層の高速性能が得られると共に、単結晶
半導体膜に形成された半導体装置の電極配線層が窓部の
段差部で段切れ断線することもなく、高歩留りで且つ高
僧I11度の半導体装置が提供できる効果がある。
形成され、該慾郁および絶縁膜上に単結晶半導体膜が平
坦Kl!l成された半導体基板を用−・て上配単結晶半
導体腓に半導体装置を形成する場合に、絶縁膜の厚さが
厚くfきるので半導体装置と単結晶半導体基板との寄生
容量が減少し一層の高速性能が得られると共に、単結晶
半導体膜に形成された半導体装置の電極配線層が窓部の
段差部で段切れ断線することもなく、高歩留りで且つ高
僧I11度の半導体装置が提供できる効果がある。
第1 II (a) −(s)は本発明を達成する為の
1つの製造1寝をIIIIIIIIlで示したものtあ
る。 第2 !l (&)〜(11)は本発明を達成する為の
他の製造1穆を断面図で示した4のである・ 1.11・・半導体基板 5.12・・絶縁膜 2・・拳・・・slo、11 3・・・・・・81.N4# 4・・・・・・溝部 13・・・・・・・・エピタキシャル半導体埋込り層6
.14・・多結晶tたはアモルファス半導体l17.1
5・・単結晶半導体膜 以 上 出願人 株式会社 諏訪精工會 代理人 弁理士 最上 務
1つの製造1寝をIIIIIIIIlで示したものtあ
る。 第2 !l (&)〜(11)は本発明を達成する為の
他の製造1穆を断面図で示した4のである・ 1.11・・半導体基板 5.12・・絶縁膜 2・・拳・・・slo、11 3・・・・・・81.N4# 4・・・・・・溝部 13・・・・・・・・エピタキシャル半導体埋込り層6
.14・・多結晶tたはアモルファス半導体l17.1
5・・単結晶半導体膜 以 上 出願人 株式会社 諏訪精工會 代理人 弁理士 最上 務
Claims (1)
- 単結晶半導体基板表面には絶縁膜が窓開けして形成され
て成り、該窓部シよび絶縁膜上KF1単結晶半導体膜が
形成された半導体基板に於て、1紀絶縁膜の嗜部に形成
された単結晶半導体膜の表面が周辺絶縁膜上の単結晶半
導体膜表面とほぼ平坦K11威されて成る事を4111
とする半導体基板。
Priority Applications (6)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP56104298A JPS586121A (ja) | 1981-07-02 | 1981-07-02 | 半導体基板 |
NLAANVRAGE8202526,A NL188550C (nl) | 1981-07-02 | 1982-06-22 | Werkwijze voor het vervaardigen van een halfgeleidersubstraat. |
GB08218306A GB2104723B (en) | 1981-07-02 | 1982-06-24 | Semiconductor substrate and method of manufacturing the same |
DE19823224604 DE3224604A1 (de) | 1981-07-02 | 1982-07-01 | Halbleitersubstrat und verfahren zur herstellung einer monokristallinen schicht |
US06/723,708 US4576851A (en) | 1981-07-02 | 1985-04-16 | Semiconductor substrate |
US07/171,370 USRE33096E (en) | 1981-07-02 | 1988-03-17 | Semiconductor substrate |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP56104298A JPS586121A (ja) | 1981-07-02 | 1981-07-02 | 半導体基板 |
Related Child Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP323786A Division JPS62122120A (ja) | 1986-01-10 | 1986-01-10 | 半導体基板の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS586121A true JPS586121A (ja) | 1983-01-13 |
Family
ID=14377013
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP56104298A Pending JPS586121A (ja) | 1981-07-02 | 1981-07-02 | 半導体基板 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS586121A (ja) |
Cited By (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5853821A (ja) * | 1981-09-25 | 1983-03-30 | Toshiba Corp | 積層半導体装置の製造方法 |
JPS5893220A (ja) * | 1981-11-30 | 1983-06-02 | Toshiba Corp | 半導体単結晶膜の製造方法 |
JPS59208820A (ja) * | 1983-05-13 | 1984-11-27 | Seiko Epson Corp | 半導体装置の製造方法 |
JPS60152018A (ja) * | 1984-01-20 | 1985-08-10 | Agency Of Ind Science & Technol | 半導体薄膜結晶層の製造方法 |
JPS60201665A (ja) * | 1984-03-26 | 1985-10-12 | Nippon Denso Co Ltd | 圧力・電気変換装置の製造方法 |
JPS61245518A (ja) * | 1985-04-23 | 1986-10-31 | Agency Of Ind Science & Technol | Soiシ−ド構造形成方法 |
JPS627115A (ja) * | 1985-07-03 | 1987-01-14 | Agency Of Ind Science & Technol | 単結晶薄膜形成法 |
JPS62118513A (ja) * | 1985-11-19 | 1987-05-29 | Sony Corp | 半導体層の固相成長方法 |
JPH01215011A (ja) * | 1988-02-24 | 1989-08-29 | Agency Of Ind Science & Technol | 半導体再結晶化処理用基板及びその製造方法 |
Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5667923A (en) * | 1979-11-07 | 1981-06-08 | Toshiba Corp | Preparation method of semiconductor system |
-
1981
- 1981-07-02 JP JP56104298A patent/JPS586121A/ja active Pending
Patent Citations (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5667923A (en) * | 1979-11-07 | 1981-06-08 | Toshiba Corp | Preparation method of semiconductor system |
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Publication number | Priority date | Publication date | Assignee | Title |
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JPS5853821A (ja) * | 1981-09-25 | 1983-03-30 | Toshiba Corp | 積層半導体装置の製造方法 |
JPS5893220A (ja) * | 1981-11-30 | 1983-06-02 | Toshiba Corp | 半導体単結晶膜の製造方法 |
JPS59208820A (ja) * | 1983-05-13 | 1984-11-27 | Seiko Epson Corp | 半導体装置の製造方法 |
JPS60152018A (ja) * | 1984-01-20 | 1985-08-10 | Agency Of Ind Science & Technol | 半導体薄膜結晶層の製造方法 |
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JPS61245518A (ja) * | 1985-04-23 | 1986-10-31 | Agency Of Ind Science & Technol | Soiシ−ド構造形成方法 |
JPS627115A (ja) * | 1985-07-03 | 1987-01-14 | Agency Of Ind Science & Technol | 単結晶薄膜形成法 |
JPS62118513A (ja) * | 1985-11-19 | 1987-05-29 | Sony Corp | 半導体層の固相成長方法 |
JPH01215011A (ja) * | 1988-02-24 | 1989-08-29 | Agency Of Ind Science & Technol | 半導体再結晶化処理用基板及びその製造方法 |
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