JPS58143571A - 薄膜半導体装置 - Google Patents

薄膜半導体装置

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Publication number
JPS58143571A
JPS58143571A JP2698182A JP2698182A JPS58143571A JP S58143571 A JPS58143571 A JP S58143571A JP 2698182 A JP2698182 A JP 2698182A JP 2698182 A JP2698182 A JP 2698182A JP S58143571 A JPS58143571 A JP S58143571A
Authority
JP
Japan
Prior art keywords
film
glass
silicon oxide
oxide film
semiconductor device
Prior art date
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Pending
Application number
JP2698182A
Other languages
English (en)
Inventor
Seiichi Iwamatsu
誠一 岩松
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Seiko Epson Corp
Suwa Seikosha KK
Original Assignee
Seiko Epson Corp
Suwa Seikosha KK
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Filing date
Publication date
Application filed by Seiko Epson Corp, Suwa Seikosha KK filed Critical Seiko Epson Corp
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Publication of JPS58143571A publication Critical patent/JPS58143571A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L29/00Semiconductor devices adapted for rectifying, amplifying, oscillating or switching, or capacitors or resistors with at least one potential-jump barrier or surface barrier, e.g. PN junction depletion layer or carrier concentration layer; Details of semiconductor bodies or of electrodes thereof  ; Multistep manufacturing processes therefor
    • H01L29/66Types of semiconductor device ; Multistep manufacturing processes therefor
    • H01L29/68Types of semiconductor device ; Multistep manufacturing processes therefor controllable by only the electric current supplied, or only the electric potential applied, to an electrode which does not carry the current to be rectified, amplified or switched
    • H01L29/76Unipolar devices, e.g. field effect transistors
    • H01L29/772Field effect transistors
    • H01L29/78Field effect transistors with field effect produced by an insulated gate

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  • Engineering & Computer Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Power Engineering (AREA)
  • Physics & Mathematics (AREA)
  • Ceramic Engineering (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Formation Of Insulating Films (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は薄膜半導体装置の基板構造に関する。
従来、薄膜半導体装置は、絶縁基板上に形成する構造が
とられていた。
しかし、上記従来技術では、絶縁基板、とりわけガラス
基板中に含まれるNOが薄膜半導体装置の半導体と誘電
体層との境界面に析出し、薄膜半導体装置の電気的特性
を変動させるという欠点がありた。
本発明は、かかる従来技術の欠点をなくし、ガラス絶縁
基板からのNa析出のない、電気的特性の安定な薄膜半
導体装置を提供することを目的とする。
上記目的を達成するための本発明の基本的な構成は、半
導体装置においてガラス基板上にはリン・ガラス膜と該
リン・ガラス膜上に酸化硅素膜を形成するか、ガラス基
板上に酸化硅素膜を形成し、前記酸化硅素膜上には薄膜
半導体装置が形成されて・成る事を特徴とする。
以下、実施例により本発明の詳細な説明する。
第1図は本発明による薄膜半導体装置の断面図である。
ソーダ・ガラスからなる絶縁基板1上にはリン・ガラス
膜2および酸化硅素膜5が什学蒸理法により形成される
。基板ガラス1がリン・ガラス系である場合にはこのリ
ン・ガラス膜は不要である。酸化硼素膜3上にはP型ア
モルファス81勝が形成され、イオン打込み等によりI
IIアモルファスS1膜からなるソース領域8とドレイ
ン領域6および、ゲート酸化膜7が形成され、ムを電極
が蒸着法により形成されて、ゲート電極7−ソース11
極8、ドレイン電極10となり薄膜MOSトランジスタ
が絶縁基板上に形成される。
この様にして形成された薄膜半導体装置に於ては、リン
・ガラス膜2がWa補層膜効果ある事および、酸化硅素
膜5が下地からのN1拡散をゆるやかにする事等の作用
により、半導体膜と絶縁膜の界面(3と4および7と4
の界面)へy−が析出することを防止し、電気的特性の
安定な薄膜半導体装置を絶縁基板上に形成できる効果が
ある。
【図面の簡単な説明】
11P11図は本発明による薄膜半導体装置の断面図で
ある。 2・・・・・・リン・ガラス膜 3・・・・・・酸化硅素膜    4・・・・・・P@
jS1膜5.6・・・・・・y型s1膜 7・・・・・・ゲート酸化膜   9・・・・・・ゲー
ト電極8.10・・・・・・引出し電極 以  上 出願人  株式会社諏訪精工舎 代理人  弁理士 最上  −、・

Claims (1)

    【特許請求の範囲】
  1. (1)  ソーダ・ガラス、ボロンリナイト・ガラス、
    アルミノーンリケイト・ガラス等のガラス基板上にはリ
    ン・ガラス膜が形成され、該リン・ガラス膜上には酸化
    硅素膜が形成され、該酸化硅素膜りには薄膜半導体装置
    が形成されて成る事を特徴とする薄膜半導体装置。 (21ガラス基板上には酸化硅素膜が形成され、該酸化
    硅素膜上には薄膜半導体装置が形成されて成る事を特徴
    とする特許請求範囲第1項記載の薄膜半導体装置。
JP2698182A 1982-02-22 1982-02-22 薄膜半導体装置 Pending JPS58143571A (ja)

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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS59108357A (ja) * 1982-12-14 1984-06-22 Seiko Epson Corp 薄膜半導体装置
JPS6057672A (ja) * 1983-09-08 1985-04-03 Seiko Epson Corp 半導体装置
JPS60170972A (ja) * 1984-02-15 1985-09-04 Sony Corp 薄膜半導体装置

Cited By (4)

* Cited by examiner, † Cited by third party
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