JPH1195261A - 液晶表示装置およびその作製方法 - Google Patents

液晶表示装置およびその作製方法

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JPH1195261A
JPH1195261A JP9273445A JP27344597A JPH1195261A JP H1195261 A JPH1195261 A JP H1195261A JP 9273445 A JP9273445 A JP 9273445A JP 27344597 A JP27344597 A JP 27344597A JP H1195261 A JPH1195261 A JP H1195261A
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Abstract

(57)【要約】 【課題】 トップ容量型TFTの蓄積容量における単位
面積当たりの容量を高めることを課題とする。 【解決手段】 画素とブラックマトリクスとで構成され
る蓄積容量の間に窒化珪素膜、酸化珪素膜、窒化酸化珪
素膜等の無機層を挟むことにより、単位面積当たりの容
量を高めることができた。

Description

【発明の詳細な説明】 【0001】 【発明の属する技術分野】本明細書で開示する発明は、
薄膜トランジスタを用いたアクティブマトリクス型の液
晶表示装置に関する。 【0002】 【従来の技術】薄膜トランジスタ(以下TFTと略)を
用いたアクティブマトリクス型の液晶表示装置は、今日
20型以上という大画面化、また、SXGA(super ex
tendedgraphics array )という高精細化が実現されて
いる。 【0003】また、アクティブマトリクス型の液晶表示
装置は、ノートパソコンやPDA(personal digital a
ssistant)等の携帯型の情報機器にも応用され、消費電
力を少なくする努力が為されている。。 【0004】その一つとして、開口率を高めることによ
って消費電力を抑えることが可能である。理想的には、
10型程度の液晶表示装置では、80%以上の開口率
を、また4型程度の液晶表示装置では60%以上の開口
率を目指している。 【0005】開口率を低下させる要因の一つとして、画
素部における蓄積容量がある。特にプロジェクタ・ライ
トバルブ向けの3型以下の小型パネルのような高精細パ
ネルでは、画素面積が小さいため蓄積容量の占有面積に
よる開口率の低下が顕著に見られる。 【0006】蓄積容量の構造を分類すると、 1)ゲイト絶縁膜を利用したもの 2)層間絶縁膜を利用したもの 3)パッシベーション絶縁膜を利用したもの 4)上記1) 〜3)を組み合わせたもの に分けられ、上記1)の構成が単位面積当たりの容量が
大きいため広く利用されている。 【0007】また、蓄積容量の接続として、 a)専用容量配線を用いた共通電極型 b)隣接走査線を利用した兼用型 の2種類があり、実際問題として、b)の接続方法は走
査方向を変えると、画素TFTの電極側に瞬間的に発生
する高電圧による画質の低下という問題が発生する。 【0008】 【発明の背景】専用容量配線を用いた共通電極型の一例
として、遮光のためのブラックマトリクスをTFT上に
配置し、更に共通電極として利用することにより、画素
電極とブラックマトリクスとで蓄積容量を形成する方式
(トップ容量型)は、既に本発明者によって出願されて
いる(特願平08−58500号)。 【0009】また、このブラックマトリクスは、その下
に配線されるソース配線、ゲイト配線等のバスラインに
対するシールドとしての機能を有している。図8A、B
にトップ容量型を採用した液晶表示装置の画素部の断面
構造を示す。 【0010】図8Aに示されるように、基板801上に
ダブルゲイトからなるTFTが構成されている。そし
て、チャネル領域802a、802bとソース領域80
3、ドレイン領域804および不純物領域805とから
なる半導体層を有したTFTは、その上にゲイト絶縁膜
810を介してゲイト電極820a、820bが配設さ
れている。 【0011】そして、無機材料からなる第1の層間絶縁
膜811がTFTを覆って形成されている。そして、コ
ンタクトホールを介してTFTのソース領域803とソ
ース電極821とがコンタクトしている。また、TFT
のドレイン領域804とドレイン電極822とがコンタ
クトしている。 【0012】無機材料からなる第1の層間絶縁膜811
とソース電極とを覆って有機樹脂からなる第2の層間絶
縁膜812が形成されている。この有機樹脂812は、
TFTの配線等による凹凸を解消するために設けられ、
その表面は概略平坦となっている。 【0013】こうして形成された有機樹脂膜812の上
に導電性を有するブラックマトリクス824を配置し、
その上に有機材料からなる第3の層間絶縁膜813が設
けられている。そして、第3の層間絶縁膜813と第2
の層間絶縁膜812に開口したコンタクトホールを介し
て、ドレイン電極822と画素電極829とがコンタク
トし、TFTのドレイン領域804と画素電極829と
が電気的に連絡している。 【0014】図8Aの構成で、Yで示される領域が、ブ
ラックマトリクス824と画素電極829とを電極とす
る蓄積容量である。このブラックマトリクスは金属から
なり、例えばTi、CrまたはTiN等が用いられる。 【0015】また、図8Bはブラックマトリクスを形成
する前に第2の層間絶縁膜である有機樹脂812にコン
タクトホールを形成し、ブラックマトリクスを形成する
際にドレイン電極822とコンタクトする第2のドレイ
ン電極825を形成した例である。 【0016】そして、有機材料からなる第3の層間絶縁
膜813を設け、コンタクトホールを介して、画素電極
829を第2の電極825とコンタクトさせ、TFTの
ドレイン領域804と電気的に連絡した構成となってい
る。 【0017】図8Bの構成においても領域Yが、ブラッ
クマトリクス824と画素電極829とによる蓄積容量
となっている。 【0018】 【発明が解決しようとする課題】 【0019】上述のように、トップ容量型の液晶表示装
置における蓄積容量(領域Y)は、ブラックマトリク
ス、画素電極および有機樹脂からなる第3の層間絶縁膜
とから構成される。 【0020】このように上下の層を有機樹脂に挟まれた
導電層は、周囲の有機樹脂中のパーティクル等による影
響を受けやすい。特に、導電層は電極として用いること
が多く、パーティクルによって電気的な短絡(ショー
ト)を起こしやすい。 【0021】本発明者が研究した結果、使用前にフィル
タを通すことにより0.5μm以上の大きさのパーティ
クルを除去することは可能であったが、0.5μm以下
の大きさのパーティクルを完全に除去することは困難で
あった。 【0022】蓄積容量を構成する第3の層間絶縁膜とし
て用いられる有機材料中にも0.5μm以下の大きさの
パーティクルが残存する。そのため、画素電極とブラッ
クマトリクスとがショートすることにより、容量として
の機能が損なわれていた。また、ショートすることによ
り、点欠陥や線欠陥等の表示不良が発生していた。 【0023】本発明者の経験によると、0.5μm以下
のパーティクルによる表示不良の発生確率は、10万分
の1〜100万分の1程度と思われる。例えば、VGA
(video graphics array)パネルはおよそ30万の画素
を有しているが、0.5μm以下のパーティクルによる
点欠陥が多いときには数個発生する。 【0024】ところで、この蓄積容量の容量は、以下の
式で表せる。 C=εS/d (C:容量、ε:電極間の誘電率、S:電極面積、d:
電極間距離) 【0025】従って、この蓄積容量の単位面積当たりの
容量を増加させる手段として、 d)電極面積を大きくする。 e)画素電極とブラックマトリクスとの距離を縮める。 f)電極間の誘電率を大きくする。 ことが考えられる。 【0026】しかしながら、dの手段は現在様々な工夫
がなされているが、基本的に開口率の低下を招き、特に
小型のパネルにおいては実現が困難である。 【0027】また、上記eの方法は、容易に実現可能で
あるが、蓄積容量の単位面積当たりの容量を増やすため
に、第3の層間絶縁膜を薄くすると、第3の層間絶縁膜
が有機樹脂から構成されるためパーティクルによる表示
不良の発生確率が増加することは確実である。 【0028】fの方法を実現するためには、誘電率の大
きい物質(例えば窒化珪素膜)を電極間に用いる必要が
ある。しかしながら、従来からブラックマトリクスをT
FT上の上に形成する際に、電極および配線等によって
生じる凹凸からの影響を排除するため、第2の層間絶縁
膜として有機樹脂を用い平坦化している。 【0029】窒化珪素膜をブラックマトリクスの上に設
ける際に、表面に露呈した第2の層間絶縁膜である有機
樹脂から水やメタン等のガスが発生し、現状の成膜方法
では良質な窒化珪素膜を得ることが難しいことが判明し
た。 【0030】また、有機樹脂に直接設けられた窒化珪素
膜は応力によってピーリングしやすく、液晶表示素子の
信頼性を損ねる結果となった。 【0031】更に、図9に示すように、窒化珪素膜91
8を設けることにより、画素電極がドレイン領域904
と電気的に連絡するために、第3の層間絶縁膜913を
テーパ状にエッチングし、続いて窒化珪素膜918をエ
ッチングする。その後第2の層間絶縁膜912もエッチ
ングするが、この工程で、図9に示すように窒化珪素膜
918の下まで回り込んでエッチングしてしまう。 【0032】これは、第2の層間絶縁膜912と第3の
層間絶縁膜913のエッチング速度は速く、無機層91
8のエッチング速度は遅いため、このような構成とな
る。その結果図9中Zで示す段差部分において画素電極
のコンタクト不良が生じ易くなるという問題も発生す
る。 【0033】尚、コンタクトホールは多少はテーパ状に
形成されるが、他の図面では簡略のためコンタクトホー
ルは矩形で示す。 【0034】本明細書で開示する発明は、有機樹脂のパ
ーティクルによるショートを解消することを課題とす
る。 【0035】また、トップ容量型を蓄積容量に採用した
液晶表示装置の単位面積当たりの容量を高めることを課
題とする。 【0036】また、有機樹脂層の上に良質な膜を形成す
ることを課題とする。 【0037】 【課題を解決するための手段】本明細書で開示する発明
の構成の一つは、有機樹脂に上下が挟まれた導電層を有
する液晶表示装置において、前記導電層の上には無機層
が設けられ、前記導電層の下の有機樹脂は表面が平坦化
され、前記導電層と前記無機層は概略同一形状を有して
いることを特徴とする。 【0038】また、本明細書で開示する他の発明の構成
は、表面が平坦な有機樹脂の上に形成された、ブラック
マトリクスと画素電極とから構成される蓄積容量を有す
る液晶表示装置において、前記ブラックマトリクスと画
素電極との間に複数の絶縁膜が配設され、前記複数の絶
縁膜の前記ブラックマトリクスに接する層は、無機層か
らなることを特徴とする。 【0039】また、本明細書で開示する他の発明の構成
は、表面が平坦な有機樹脂からなる層間絶縁膜の上に形
成された、ブラックマトリクスと画素電極とから構成さ
れる蓄積容量を有する液晶表示装置において、前記ブラ
ックマトリクスと画素電極との間に複数の絶縁膜が配設
され、前記複数の絶縁膜の前記ブラックマトリクスに接
する層は、無機層からなり、前記無機層は前記ブラック
マトリクスと概略同一形状にパターニングされているこ
とを特徴とする。 【0040】また、本発明の構成の他の一つとして、絶
縁表面を有する基板の上に薄膜トランジスタを形成する
第1の工程と、前記薄膜トランジスタの上に有機樹脂か
らなる層を形成する第2の工程と、前記有機樹脂からな
る層の上に導電層を形成する第3の工程と、前記導電層
の上に少なくとも1層の無機層を形成する第4の工程
と、平坦化された有機樹脂層を設ける第5の工程とを有
し、前記第4の工程と前記第5の工程の間に少なくとも
1回のパターニング工程を有することを特徴とする。 【0041】また、本発明の構成の他の一つとして、絶
縁表面を有する基板の上に薄膜トランジスタを形成する
工程と、前記薄膜トランジスタを覆って第1の層間絶縁
膜を形成する工程と、前記第1の層間絶縁膜の上に表面
が平坦な有機材料からなる第2の層間絶縁膜を形成する
工程と、前記第2の層間絶縁膜の上にブラックマトリク
スを形成する工程と、前記ブラックマトリクスの上に無
機層を形成する工程と、前記ブラックマトリクスと前記
無機層とを概略同一形状にパターニングする工程と、該
工程の後に、有機樹脂からなる第3の層間絶縁膜を形成
する工程と、前記薄膜トランジスタのドレイン領域と電
気的に連絡している画素電極を形成する工程とを有し、
前記画素電極と前記パターニングされたブラックマトリ
クスとが蓄積容量を形成していることを特徴とする。 【0042】また、本発明の構成の他の一つとして、絶
縁表面を有する基板の上に薄膜トランジスタを形成する
工程と、前記薄膜トランジスタを覆って第1の層間絶縁
膜を形成する工程と、前記第1の層間絶縁膜の上に表面
が平坦な有機材料からなる第2の層間絶縁膜を形成する
工程と、前記第2の層間絶縁膜の上にブラックマトリク
スを形成する工程と、前記ブラックマトリクスをパター
ニングする工程と、前記パターニングされたブラックマ
トリクスを陽極酸化する工程と、該工程の後に、有機樹
脂からなる第3の層間絶縁膜を形成する工程と、前記薄
膜トランジスタのドレイン領域と電気的に連絡している
画素電極を形成する工程とを有し、前記画素電極と前記
パターニングされたブラックマトリクスとが蓄積容量を
形成していることを特徴とする。 【0043】また、前記無機層は酸化珪素、窒化珪素ま
たは窒化酸化珪素からなることを特徴とする。 【0044】また、前記複数の絶縁膜の最も表面に近い
層は平坦化された有機樹脂層であることを特徴とする。 【0045】このように、誘電率の大きい無機層をブラ
ックマトリクスの上に設けることにより、単位面積当た
りの容量を高めることが可能となる。 【0046】また、トップ容量型のブラックマトリクス
は、有機樹脂に挟まれた導電層という構成である。無機
層を形成することにより、ブラックマトリクスが有機樹
脂のパーティクルに対して保護されショートすることが
抑制することができた。 【0047】 【発明の実施の形態】本発明の構成で、無機層として
は、誘電率が重要となり、非晶質窒化珪素膜、非晶質酸
化珪素膜、窒化酸化珪素膜(SiOx y )、DLC
(diamond like carbon )膜、Al23 、Ta2
5 、TiO2 およびこれらの積層膜等を用いることがで
きる。特に誘電率が大きく、選択的にエッチングが可能
な窒化珪素膜を用いることが好ましい。 【0048】これらの材料の誘電率の代表的な値を以下
に示す。また、比較としてポリイミドおよびアクリルの
誘電率も示す。 非晶質窒化珪素膜 ε=7 非晶質酸化珪素膜 ε=4 窒化酸化珪素膜 ε=4.5〜5 DLC膜 ε=8〜12 Al23 ε=8 Ta25 ε=20〜27 TiO2 ε=30〜40 ポリイミド ε=2.8〜3.4 アクリル ε=3.2 【0049】無機層を設ける際に、その膜厚が重要にな
る。膜厚を薄くして電極間の距離を短くすることが好ま
しいが、蓄積容量の絶縁破壊電圧は少なくとも20V以
上としたい。 【0050】また、膜厚が10〜30nmと薄くなる
と、均一な膜厚を得ることが難しくピンホールの発生な
どを引き起こす。 【0051】また、無機層の膜厚が厚くなると、ブラッ
クマトリクスと無機層による段差が大きくなり、第3の
層間絶縁膜によって平坦化が困難になる。そのため、第
3の層間絶縁膜の膜厚も厚くすることになり、蓄積容量
の減少を招く。そのため、無機層の膜厚は、ブラックマ
トリクスと無機層の合計の膜厚が700nm以下、好ま
しくは500nm以下とする。 【0052】そのため、窒化珪素膜を単層で用いるので
あれば、少なくとも50nm以上の膜厚を必要とする。
ブラックマトリクスを200nm設けた場合の窒化珪素
膜は50〜300nmとする。好ましくは、50〜20
0nm、更に好ましくは50〜100nmの膜厚で用い
る。 【0053】多層構造からなる無機層を用いるならば、
ブラックマトリクス上に誘電率の大きいDLC膜を形成
し、その上に窒化珪素膜、酸化珪素膜又は窒化酸化珪素
膜からなる上層を設けた構成を利用することが可能であ
る。 【0054】このような構成を採ることにより、塩素系
のエッチャントによるエッチングにより上層を選択的に
エッチングした後に、酸素系のエッチャントによるエッ
チングによりDLC膜をエッチングする。このエッチン
グにより同時に、レジストのアッシングも行うことがで
き、他の多層構造に比べてより少ない工程でパターニン
グされた無機層を得ることができた。 【0055】また、酸化珪素膜は、誘電率ではポリイミ
ドとさほど変わらないが、酸化珪素膜は絶縁性が高く漏
洩電流が少ない。そのため、ショート等に対する高い信
頼性が得ることができ、蓄積容量の絶縁膜として用いる
ことは有効である。特に、無機層を多層構造とする際
に、酸化珪素膜をその一つとして用いることは有効であ
る。 【0056】また、ブラックマトリクスにAl或いはT
aを用いた場合、陽極酸化を行うことにより、Al2
3 やTa25 を表面に形成すると、誘電率の大きい無
機層が、ブラックマトリクスとの応力により発生するピ
ーリングを少なくでき、自己整合的に形成できるため有
効である。 【0057】更に、無機層をブラックマトリクスに接し
て配置するため、第3の層間絶縁膜である有機材料中
に、0.5μm以下の大きさのパーティクルが残存する
ことにより発生する表示不良を減少させることができ
た。 【0058】また、本願発明の作製方法としては、ブラ
ックマトリクスをパターニングする前に無機層を成膜す
ることを基本とする。つまり、無機層の形成後で第3の
層間絶縁膜を形成する前に少なくとも1回のパターニン
グ工程を有する。 【0059】ただし、前述のように陽極酸化膜を無機層
として用いる場合はその限りではなく、パターニング後
に陽極酸化膜を形成しても良い。 【0060】その結果、有機樹脂からなる第2の層間絶
縁膜からのガスの放出を防ぐことが実現できた。 【0061】また、ブラックマトリクスと無機層を概略
同一形状にパターニングすることにより、応力を緩和す
ることができピーリングを抑制することができた。 【0062】以上の構成は、ブラックマトリクスと画素
電極とからなる蓄積容量を例に説明したが、本発明の構
成は、有機樹脂に挟まれた導電層に対して、パーティク
ルに対する問題を解消するために用いることが可能であ
る。 【0063】有機樹脂に挟まれた導電層の例としては、
第1の層間絶縁膜に有機樹脂を用いた場合のソース配線
やドレイン電極が考えられる。 【0064】尚、本明細書中では、同一のマスクにより
パターニングされた複数の膜に対して、概略同一形状を
有していると認める。また、後述するように、無機層を
ひさし状に形成した場合のブラックマトリクスと無機層
とは概略同一形状を有していると認める。 【0065】本明細書でいう電極とは、TFTのソース
領域或いはドレイン領域と電気的に連絡を取るための部
分の導電体を指す。また、ゲイトとしてTFT中で機能
する部分の導電体を指す。 【0066】本明細書中でいう塩素系のエッチャントと
は、塩素若しくは塩素を一部に含む気体を指し、例え
ば、Cl2 、BCl3 、SiCl4 、HCl、CCl4
等の単一気体若しくは混合気体、さらにこれらの単一気
体若しくは混合気体を塩素を含まない気体(例えばH
2 、O2 、N2 等)で希釈したものを指す。 【0067】更に、本明細書中でいうフッ素系のエッチ
ャントとは、フッ素若しくはフッ素を一部に含む気体を
指し、例えば、F2 、BF3 、SiF4 、HF、CF4
等の単一気体若しくは混合気体、さらにこれらの単一気
体若しくは混合気体を塩素を含まない気体(例えばH
2 、O2 、N2 等)で希釈したものを指す。 【0068】また、本明細書中でいう酸素系のエッチャ
ントとは、酸素を含む気体を指し、例えば、O2 、O3
等およびO2 、O3 等を酸素を含まない気体(例えばN
2 、He等)で希釈したものを指す。 【0069】 【実施例】 [実施例1]図1に本明細書で開示する発明を利用した
アクティブマトリクス型の液晶表示装置の一画素の概略
上面図を示す。図中の107で示されるのがTFTの半
導体層であり、126がゲイト配線である。また、12
7で示されるのがソース配線であり、121がソース電
極である。図中で、各配線上には太線で示すブラックマ
トリクス124が形成されている。そして、図中点線で
示す画素電極129が、ドレイン電極122でTFTと
電気的に連絡している。 【0070】図中で太線と点線とで囲まれた右上がりの
斜線部Yが、ブラックマトリクスと画素電極との重畳し
た領域となり、蓄積容量を形成している。 【0071】図2Aに図1のX−X’部のTFT基板の
概略断面図を示す。また、図4A〜Cにその作製工程図
を示す。 【0072】まず、図4Aに示すように基板101に図
示しない下地絶縁膜を形成する。基板として、ガラス基
板、石英基板又は半導体基板を用いることができる。本
実施例においてはガラス基板を用いる。また、基板に被
処理面を十分に洗浄した石英基板を用いるならば下地絶
縁膜は特に設けなくともよい。 【0073】また、下地絶縁膜は、酸化珪素膜、窒化珪
素膜、窒化酸化珪素膜等を100〜300nmの膜厚で
利用することができる。本実施例では、プラズマCVD
(Chemical Vapor Deposition )法によって、TEOS
を原料に用いた酸化珪素膜を200nmの膜厚に形成す
る。 【0074】次に、下地酸化珪素膜上に半導体層を形成
する。本実施例では、半導体層として、真性の非晶質珪
素膜をプラズマCVD法によって20〜100nm、本
実施例では50nmの膜厚に形成する。珪素膜は、プラ
ズマCVD法の他にLPCVD(low Pressure CVD)法
を用いてもよい。 【0075】本実施例では真性の非晶質珪素膜を作製し
たが、閾値制御のためにボロンを添加したP型の珪素膜
やリンを添加したN型の珪素膜を用いてもよい。また、
多結晶珪素膜や微結晶珪素膜を用いてもよい。更に、珪
素膜以外に、化合物半導体、例えばGaAs、SiX
1-X (0<X<1)、GaP、InP、InSb、C
dS又はPbSe等をMOCVD(Metal Organic CVD
)法で作製し、半導体層として用いることもできる。 【0076】そして、非晶質珪素膜にパターニングを施
したマスク酸化珪素膜を設け、Niを添加する。このN
iは、結晶化工程において、非晶質珪素膜の結晶化をよ
り低温で行う触媒として機能する。その詳細な機構は特
開平08−78329号に開示されている。 【0077】このようにして、選択的に珪素膜に添加さ
れたNi元素は、加熱アニールによって、結晶が添加部
分から基板に平行な方向に横成長をする。本実施例で
は、560℃で17時間結晶化を行う。 【0078】その後、マスク酸化珪素膜を除去し、新た
にパターニングを施した酸化珪素膜を形成し、露出した
部分の結晶性珪素膜にリンを添加する。このリンは、結
晶化に用いたNi元素を結晶性珪素膜からゲッタリング
する効果を有している。リンによるゲッタリングの詳細
は特願平07−216608号に記載されている。 【0079】リンを1×1017cm-3〜2×1020cm-3
本実施例では5×1019cm-3の濃度に添加した。その
後、基板を550〜650℃、本実施例では600℃に
加熱することによりゲッタリングを行う。 【0080】こうして形成された結晶性珪素膜をパター
ニングし、珪素膜の上にゲイト絶縁膜を形成する。ゲイ
ト絶縁膜は、酸化珪素膜、窒化珪素膜、窒化酸化珪素膜
又はこれらの積層膜を100〜300nmの膜厚で用い
ることができるが、本実施例では、SiH4 とN2 Oと
を用いたプラズマCVD法によって窒化酸化珪素膜を1
20nmの膜厚としてゲイト絶縁膜とした。 【0081】その後、ゲイト配線となる金属をスパッタ
リングによって成膜し、パターニングを施すことによ
り、一部がゲイト電極120a、120bであるゲイト
配線126を400nmの膜厚に形成する。本実施例で
は、ゲイト配線としてアルミニウム合金を用いたが、ゲ
イト配線用の材料にクロム、タンタル、モリブデンとタ
ンタルの合金、TaとAlの積層又はクロムとアルミニ
ウムの積層等を用いてもよい。 【0082】次に、ゲイト配線に陽極酸化を行い、陽極
酸化膜を形成する。この陽極酸化膜は外側に形成された
多孔質の陽極酸化膜と、内側に形成された緻密な陽極酸
化膜との2種類を形成する。この2種類の陽極酸化膜に
よって、低不純物領域およびオフセット領域を形成す
る。詳細は特開平07−135318号に記載されてい
る。 【0083】続いて、ゲイト配線および陽極酸化膜の下
の部分を除くゲイト絶縁膜をエッチングする。その後、
外側に形成された多孔質の陽極酸化膜を除去する。この
状態で、ゲイト配線をマスクとして自己整合的に不純物
をドーピングする。本実施例では、不純物としてリンを
ドーピングし、N型のTFTを作製した。P型のTFT
を形成したいときはリンの変わりにボロンをドーピング
すれば良い。 【0084】その後、リンがドーピングされたソース領
域、ドレイン領域、不純物添加領域を活性化するために
エキシマーレーザを照射する。このレーザー光として、
XeCl、ArF、KrF、KrCl等を用いることが
できるが、本実施例ではKrFを用いた発振波長248
nmのエキシマーレーザを用いて、線状スキャン方式で
活性化を行った。 【0085】このN型TFTは、ゲイト電極120a、
120bの下に形成されたチャネル領域102a、10
2bを有し、ゲイト絶縁膜110a、110bによって
ドーズ量が少なくなった低不純物領域106がソース1
03とチャネル102aの間、不純物添加領域105と
チャネル102a、102bの間およびドレイン104
とチャネル102bの間に設けられており、緻密な陽極
酸化膜115a、115bの下にはオフセット領域が形
成されている。 【0086】こうして完成したN型TFTを覆って、第
1の層間絶縁膜111を形成する。この第1の層間絶縁
には無機材料、例えば酸化珪素膜、窒化珪素膜、窒化酸
化珪素膜、リン珪酸ガラス(PSG)又はこれらの積層
膜を用いることができるが、本実施例では、酸化珪素膜
を900nm形成して、第1の層間絶縁膜として用い
る。 【0087】このようにして、図4Aに示す構成を得
る。そして、第1の層間絶縁膜にコンタクトホールを開
口する。そして、ソース配線となる金属を成膜する。こ
の金属として、アルミニウム、クロム、タンタル、モリ
ブデンとタンタルの合金、タンタルとアルミニウムの積
層、チタンとアルミニウムの積層又はクロムとアルミニ
ウムの積層等を用いることができる。本実施例では、チ
タン/アルミニウム/チタンの積層膜を用いて、それぞ
れ1500/3000/100nmの膜厚にスパッタ法
で形成した。 【0088】その後、ソース配線127にパターニング
する。そして,コンタクトホールを介して、ソース配線
の一部であるソース電極121とソース領域103とが
コンタクトを形成する。また、同時にドレイン領域10
4に形成されたコンタクトホールを介して、ドレイン電
極122が形成される。更に、図示はしていないが、こ
のソース配線の形成において、ブラックマトリクスを接
地電位にするための引き出し電極も形成する。 【0089】その後、第2の層間絶縁膜112としてポ
リイミドを設ける。成膜方法は、スピナーを用いたスピ
ンコーティング法を利用することにより、容易に表面が
平坦な被膜を得ることができる。スピナーにはフィルタ
ーを設けており、0.5μm以上の大きさのパーティク
ルを除去することができる。また、第2の層間絶縁膜に
はポリイミドの他にアクリル或いは他の有機樹脂を使用
することが可能である。また、第2の層間絶縁膜として
無機材料からなる絶縁膜と有機樹脂からなる絶縁膜との
積層構造も可能である。第2の層間絶縁膜は500nm
〜3.0μm、本実施例では1.0μmの膜厚に成膜す
る。 【0090】続いて、ポリイミドを300℃で1時間加
熱することにより焼成する。こうして形成された平坦な
ポリイミド膜112の上に、ブラックマトリクス123
としてTiをRFスパッタ法で、150℃に加熱しつつ
200nmの膜厚に成膜する。このブラックマトリクス
123は、蓄積容量の一方の電極となり、0Vの電位に
保つため、後の工程でソース配線と同時に形成した引き
出し電極と電気的に連絡する。 【0091】ブラックマトリクスとしては、チタン、ア
ルミニウム、タンタル、クロム、窒化チタン等を適宜用
いることができる。その膜厚も100〜400nmの範
囲で選択できる。 【0092】ブラックマトリクスにアルミニウム、タン
タル、クロム、窒化チタンを設けるには、スパッタリン
グによって成膜することができる、特にRFスパッタ法
を用いることが簡易である。また、蒸着法を用いて成膜
することも可能である。 【0093】ブラックマトリクスを形成した後に、無機
層118をブラックマトリクスの上に設ける。本実施例
では、誘電率の大きい窒化珪素膜を単層、プラズマCV
D法を用いて形成する。本実施例での諸条件は、反応ガ
スとしてSiH4 、NH3 およびN2 を5sccm/38sc
cm/87sccmで用い、反応温度250℃で、100nm
の膜厚に成膜する。 【0094】無機層118としては、窒化珪素膜の他に
酸化珪素膜、窒化酸化珪素膜、DLC膜、Al23
Ta25 、TiO2 、TaNおよびこれらの積層膜等
を用いることができる。 【0095】無機層118として酸化珪素膜を用いる場
合は、本実施例のプラズマCVD法において反応ガスを
SiH4 又はTEOSと酸素又はオゾンとを用いれば良
い。窒化酸化珪素膜を用いる場合は、反応ガスをSiH
4 とN2 Oまたは/およびN2 とすればよい。DLC膜
を用いる場合は、水素雰囲気中で炭素ターゲットをスパ
ッタする方法や、イオンビーム堆積法、ECR(electr
on cyclotron resonance)CVD法を用いて炭化水素化
物またはそれに加えて水素を反応ガスとして成膜すれば
よい。本実施例の無機層として、Al23 、Ta2
5 、TiO2 またはTaNを利用する場合は、スパッタ
法を用いて成膜すれば良い。 【0096】無機層に結晶性の被膜を用いると、結晶粒
界によってピンホールや亀裂が生じ、表示不良やムラの
原因になる可能性が高いため、蓄積容量に用いる無機層
は均一な膜質の非晶質被膜が好ましい。そのため、無機
層の成膜の際に、反応圧力を高くするまたは/および温
度を低くするなどにより無機層を非晶質とすることが好
ましい。 【0097】こうして、図4Bに示す構成を得る。その
後、無機膜118の上にレジストを設け、パターニング
を施すことによりブラックマトリクスのパターン130
を形成する。 【0098】そして、無機層である窒化珪素膜をRIE
(reactive ion etching)等による異方性のドライエッ
チングによってエッチングする。エッチャントとしては
フッ素系、本実施例ではCF4 /O2 を40sccm/60
sccmで用いた。 【0099】無機膜が窒化珪素膜、酸化珪素膜、窒化酸
化珪素膜、Ta25 またはTaNの場合、エッチャン
トとしてフッ素系のエッチャントを用いれば良い。ま
た、DLC膜の場合であれば、エッチャントに酸素系を
用いれば良い。また、化学的に安定な物質、例えばAl
23 やTiO2 等には、HeイオンやArイオン等を
用いた物理的なエッチング(例えばイオンミリング)を
利用することが可能である。 【0100】その後、同一のマスクでブラックマトリク
スであるチタン膜をエッチングする。エッチャントとし
て塩素系のエッチャント、本実施例では、Cl2 /BC
3/SiCl4 を40sccm/10sccm/180sccmで
用いた。 【0101】また、Cr、Al、TiNをブラックマト
リクスに用いた場合は、同様に塩素系のエッチャントを
用いてエッチングすればよい。また、Taを用いた場合
は、フッ素系のエッチャントを用いてエッチングすれば
良い。 【0102】無機層を物理的なエッチングでパターンす
る場合に、同時にブラックマトリクスまでエッチングす
ることは有効である。また、無機層に用いた材料が、塩
素系のエッチャントでエッチングできる場合は、同時に
ブラックマトリクスもエッチングすることができ工程を
簡略化することができ効果的である。 【0103】また、ブラックマトリクスをエッチングす
る際に塩素系のエッチャントを用いると、下地の有機樹
脂からなる第2の層間絶縁膜112への影響を少なくす
ることが可能である。 【0104】このように、無機層118を形成した後で
あって、且つ第3の層間絶縁膜113を形成する前に、
少なくとも1回(本実施例では無機層とブラックマトリ
クスとで2回)のパターニング工程を有している。 【0105】こうして、図2Cに示すようにパターニン
グされたブラックマトリクス124を得る。この後、パ
ターン130をウェットエッチングで剥離する。そし
て、第3の層間絶縁膜113を形成する。本実施例で
は、再びポリイミドを0.3〜0.7μm、本実施例で
は、0.5μmの膜厚にフィルター付きのスピナーを用
いて塗布する。 【0106】第3の層間絶縁膜113としては、表面に
画素電極を形成するため平坦な膜が必要であり、ポリイ
ミド、アクリル等の有機樹脂を用いることが可能であ
る。また、第3の層間絶縁膜113を第2の層間絶縁膜
112と同一材料を用いると、応力を抑制することがで
き、優れた密着性を得ることができる。更に、コンタク
トホールの開口に際して、エッチングレートが等しいの
でエッチング残りを減らすことができ、コンタクト不良
を抑制することが可能であった。 【0107】こうして形成された第3の層間絶縁膜の上
にレジストを用いてパターンを形成し、コンタクトホー
ルをパターニングする。本実施例では、CF4 /O2
Heを5sccm/95sccm/40sccmで用いてドライエッ
チングによって形成する。 【0108】コンタクトホールの開口は、ウェットエッ
チングによっても形成することができるが、ドライエッ
チングで行う方がマージンを少なくでき、余分なスペー
スを減らすことができより好ましかった。また、このコ
ンタクトホールを形成する際に、同時に引き出し線とブ
ラックマトリクスとを電気的に連絡させるためのコンタ
クトホールを形成する。 【0109】そして、レジストを除去して、画素電極と
なる導電膜を形成し、ドレイン電極122を介して、T
FTのドレイン領域104と電気的に連絡をさせた。こ
の導電膜には本実施例では、ITO(Indium Tin Oxid
e)を用いた。同時に、この導電膜によって、ブラック
マトリクスと引き出し線とを電気的に連絡させた。 【0110】そして、導電膜をパターニングすることに
よって画素電極129を形成する。こうして、図2Aに
示すように本発明を利用した液晶表示装置のTFT基板
を完成させる。 【0111】こうして形成されたTFT基板を用いた液
晶表示装置は、画素電極129とブラックマトリクス1
24との間に無機層118として窒化珪素膜が形成され
ている。このため、画素部の蓄積容量を増やすことがで
き、高いコントラストを得ることが可能となった。ま
た、単位面積当たりの容量を大きくすることが実現でき
たため、ブラックマトリクスと、画素電極とによって形
成される蓄積容量の面積を少なくすることができ、その
結果、画素面積を広くすることができた。 【0112】本実施例では、画素電極としてITOを用
いた透過型の液晶表示装置を作製したが、画素電極にA
lやTi等の反射電極を用いて反射型の液晶表示装置を
作製することも可能である。AlやTi等の反射電極
は、スパッタ法を用いて形成すればよい。 【0113】本実施例では、ブラックマトリクス124
と無機層118とを自己整合的に形成したため同一形状
となっているが、図3Bに示すように、ブラックマトリ
クス124をパターニング工程で過剰にエッチングする
ことにより、無機層118をひさし型とした構成をとる
と、ブラックマトリクスの端部においても有機樹脂のパ
ーティクルによるショートから保護することができ好ま
しかった。 【0114】図3Bの中で、129が画素電極、113
が第3の層間絶縁膜であり、領域Yが蓄積容量部となっ
ている。 【0115】また、本実施例では、ブラックマトリクス
と無機層とを自己整合的に形成したため同一形状となっ
ているが、ブラックマトリクスと無機層のマスクを変え
ることにより、異なるパターンとすることも、本発明の
有機樹脂の上に良質の無機層を設けるという効果を損ね
るものではない。 【0116】尚、ブラックマトリクスと無機層のマスク
を変えても、無機層のひさし型の部分を除いて、無機層
の下にはブラックマトリクスが必ずあり、無機層の形成
後であり、第3の層間絶縁膜の形成前に少なくとも1回
のパターニング工程を有している。 【0117】[実施例2]本実施例は、図2Bにその構
造を示すように、ドレイン領域と、画素電極との電気的
な連絡をとるためのドレイン電極の一つに、第2のドレ
イン電極225をブラックマトリクスを利用した例であ
る。その作製工程を図5A〜Cに示す。 【0118】まず、基板201として、表面を良く洗浄
した石英基板を用いる。そして、基板201の上に非晶
質の珪素膜を80nmの膜厚にLPCVD法を用いて成
膜する。 【0119】そして、実施例1と同様にしてNiを添加
して結晶化を行う。その後、HClを1〜10vol%
含む酸素雰囲気中で850〜1100℃に加熱すること
により、熱酸化膜を形成する。本実施例では、HClが
3vol%、950℃、30分の条件で熱酸化膜を形成
する。こうすることにより、Ni元素が塩素によって熱
酸化膜中にゲッタリングされる。 【0120】そして、この熱酸化膜を除去する。その
後、少なくともTFTのチャネルとなる領域にボロンを
添加する。このボロンは、TFTの閾値制御のために添
加する。本実施例では、6×1013cm-3のドーズ量添
加する。 【0121】こうして形成された結晶性の珪素膜にパタ
ーニングを施す。そして、結晶性珪素膜の上にゲイト絶
縁膜として、SiH4 とN2 Oを用いたプラズマCVD
法によって、窒化酸化珪素膜を成膜する。本実施例で
は、100nmの膜厚に成膜する。そして、再びHCl
を1〜10vol%含む酸素雰囲気中で850〜110
0℃に加熱することにより、熱酸化膜を形成する。この
熱酸化膜は結晶性の珪素膜と窒化酸化珪素膜との間に形
成されることによって、ゲイト絶縁膜の耐圧を大きく向
上できる。 【0122】そして、ゲイト配線となる金属膜をスパッ
タ法により成膜する。本実施例ではAlを用いて、40
0nmの膜厚に成膜する。そして、実施例1と同様に、
ゲイト配線にパターニングし、2種類の陽極酸化膜を形
成する。その後、ゲイト絶縁膜をゲイト配線および陽極
酸化膜をマスクとしてエッチングすることにより、窒化
酸化珪素膜よりなるゲイト絶縁膜210”a、210”
bと熱酸化膜よりなるゲイト絶縁膜210’a、21
0’bが形成される。 【0123】そして、実施例1と同様に多孔質の陽極酸
化膜を除去し、リンを添加することにより、N型のTF
Tを形成する。このN型のTFTは、ゲイト電極220
a、220bの下に形成されたチャネル領域202a、
202bと、ゲイト絶縁膜によってドーズ量が少なくな
った低不純物領域206が、ソース203とチャネル2
02aの間、不純物添加領域205とチャネル202
a、202bの間およびドレイン204とチャネル20
2bの間に設けられており、緻密な陽極酸化膜215
a、215bの下にはオフセット領域が形成されてい
る。 【0124】このN型TFTの上に第1の層間絶縁膜を
形成する。本実施例では、第1の層間絶縁膜として酸化
珪素膜211’とリン珪酸ガラス膜211”との積層膜
を用いる。酸化珪素膜は、TEOSとO2 を用いたプラ
ズマCVD法により100nmの膜厚に形成する。そし
てその上にリン珪酸ガラス膜をTEOSとPH3 とO2
を用いたプラズマCVD法により、800nmの膜厚に
形成する。 【0125】そして、コンタクトホールを開口して、ソ
ース配線となる金属を形成する。本実施例では、実施例
1と同様のTi/Al/Tiを用いた。そして、パター
ニングを施すことにより、ソース配線とソース領域20
3とがコンタクトしているソース電極221が形成され
る。同時に、ドレイン領域204と電気的に連絡してい
る第1のドレイン電極222とが形成される。 【0126】この工程において、実施例1と同様に画素
部の外にはブラックマトリクスを接地電位とするための
引き出し電極がTi/Al/Tiにより形成される。 【0127】次に、第2の層間絶縁膜212として、ア
クリルを0.6〜2.0μm、本実施例では1.2μm
設ける。アクリルは、スピナーを用いたスピンコーティ
ング法により、平坦な表面を有する第2の層間絶縁膜を
得る。そして、250℃で1時間加熱することによりア
クリルを焼成する。 【0128】この第2の層間絶縁膜に、ドレイン領域と
電気的に連絡をとるためのコンタクトホールを形成す
る。この工程は、フッ素系のエッチャントを用いたドラ
イエッチングにより行う。同時に、ブラックマトリクス
と引き出し電極とが電気的に連絡をとるためのコンタク
トホールを開口する。 【0129】そして、ブラックマトリクスとしてTaを
100〜300nm、本実施例では150nmの膜厚に
形成する。次に、ブラックマトリクスの上にレジストを
設けパターニングすることによりパターン230を形成
する。 【0130】パターン230をマスクとして、フッ素系
のエッチャントを用いてブラックマトリクスに異方性の
ドライエッチングを施す。この工程で、図示していない
がフッ素系のエッチャントにより第2の層間絶縁膜21
2もわずかにエッチングされ膜厚が薄くなる。 【0131】こうして、図5Bに示すように、ブラック
マトリクスのパターン224と、第2のドレイン電極2
25が形成される。また、ブラックマトリクスと引き出
し電極とが電気的に連絡する。 【0132】次に、レジストのパターン230を除去
し、ブラックマトリクス224を陽極としてリン酸アン
モニウム水溶液を電界溶液に用いた陽極酸化を行い陽極
酸化膜Ta25 218を70〜300nm、本実施例
では150nmの膜厚に形成する。また、電界溶液とし
て、マロン酸等の有機酸、酒石酸アンモニウム、リン酸
アンモニウムまたは硼酸アンモニウムの水溶液等を用い
ることができる。 【0133】本実施例では、パターニング後に陽極酸化
を施すため、ブラックマトリクス224と第2のドレイ
ン電極225とが電気的に連絡していない。そのため、
陽極酸化によってブラックマトリクスの外部にさらされ
た表面には陽極酸化膜が形成されるが、第2のドレイン
電極225には陽極酸化膜が形成されない。その結果、
画素電極と第2のドレイン電極225とのコンタクトホ
ールの形成を容易にすることができる。 【0134】本実施例では、ブラックマトリクスをパタ
ーニングしてから陽極酸化を行ったが、パターニング前
に陽極酸化を行い全面に陽極酸化膜を形成してもよい。
特に、無機層として陽極酸化膜と他の無機層との積層構
造とするときには、パターニング前に陽極酸化を行い全
面に陽極酸化膜を形成後、他の無機層、例えば酸化珪素
膜を形成する必要がある。 【0135】こうして図5Cに示す状態を得る。次に、
第3の層間絶縁膜213として再びアクリルを形成す
る。アクリルはスピナーを用いて、0.2〜0.7μ
m、本実施例では0.3μmの膜厚に形成後250℃で
焼成してアクリルを成膜する。 【0136】続いて、第2のドレイン電極225へのコ
ンタクトホールを開口するために、アクリルをドライエ
ッチングする。エッチングは、フッ素系のエッチャント
を用いて行う。注意すべき点は、第2のドレイン電極で
あるTaもフッ素系のエッチャントによりエッチングさ
れるため、選択比を取れるようにエッチャントを工夫す
る必要がある。本実施例ではCF4 /O2 /Heを5sc
cm/95sccm/40sccmで用いる。 【0137】次に、画素電極となる導電膜としてITO
を成膜し、パターニングを施す。こうして図2Bに示す
ように、ドレイン領域204と第1のドレイン電極22
2および第2のドレイン電極225を介して電気的に接
続した画素電極229を形成することができた。 【0138】また、図2B中の領域Yで示されるのが、
画素電極229とブラックマトリクス224とで形成さ
れる蓄積容量である。本実施例では、第2および第3の
層間絶縁膜としてアクリルを用いるため、ポリイミドと
比較して平坦性の優れた層間絶縁膜を得ることができ
る。 【0139】また、本実施例では、陽極酸化膜を無機層
218として用いたため、誘電率の大きい無機層を残留
応力によるピーリング等を起こさずに形成することがで
きた。更に、パターニング後に陽極酸化を行ったためブ
ラックマトリクスの外部表面の全面に陽極酸化膜を形成
することができ、パーティクル等により発生する表示不
良を更に低減させることができた。 【0140】なお、本実施例のように、第2のドレイン
電極225を設けることは、第2の層間絶縁膜と第3の
層間絶縁膜とのエッチング速度の違いを考慮する必要が
なく有効である。 【0141】本実施例では、画素電極としてITOを用
いた透過型の液晶表示装置を作製したが、画素電極にA
lやTi等の反射電極を用いて反射型の液晶表示装置を
作製することも可能である。AlやTi等の反射電極
は、スパッタ法を用いて形成すればよい。 【0142】[実施例3]本実施例は、図3Aにその構
成を示すように逆スタガー型のTFTを用いた例であ
る。また、本実施例では、無機層を積層構造とした例で
ある。図6A〜Cにその作製工程を示す。 【0143】まず、図6Aに示すように、基板301上
にゲイト電極320a、320bを形成する。本実施例
では、基板として、下地酸化珪素膜を100nm設けた
ガラス基板を用いた。また、ゲイト配線としてはスパッ
タ法で成膜したTaをパターニングすることにより形成
した。 【0144】続いて、ゲイト配線を陽極として、リン酸
アンモニウム水溶液を電界溶液とした陽極酸化によって
陽極酸化膜315a、315bを形成する。この陽極酸
化膜Ta25 は、50〜300nm、本実施例では1
00nm成膜し、ゲイト絶縁膜の一つとして機能する。 【0145】そして、窒化珪素膜をゲイト絶縁膜310
として、150nmの膜厚に成膜する。その後、半導体
層として非晶質珪素膜をプラズマCVD法を用いて50
nmの膜厚に成膜する。 【0146】その後、エキシマーレーザを照射すること
により非晶質珪素膜を結晶化する。本実施例では、Xe
Clを用いた波長308nmのレーザを用いて、室温中
で30Hz、200〜400mJ/cm2 、本実施例で
は300mJ/cm2 の条件で線状に照射し、走査する
ことにより結晶化を行う。 【0147】次に、結晶化した珪素膜をパターニング
し、島状の結晶性珪素膜を形成する。 【0148】こうして形成された島状の結晶性珪素膜の
上にレジストを形成し、ガラス基板側から露光すること
により、ゲイト配線をマスクとするパターンを得ること
ができる。続いて、このパターンをマスクとして不純物
を添加する。 【0149】本実施例では、不純物としてリンを5×1
14cm-3のドーズ量で添加した。そして、再びエキシマ
ーレーザを照射することによりソース、ドレインを活性
化する。本実施例では、波長が248nmのKrFレー
ザを用いて250mJ/cm 2 の条件で照射する。 【0150】こうして、ソース領域303、ドレイン領
域304および不純物添加領域305と、ゲイト電極3
20a、320bの上に形成されたチャネル領域302
a、302bとを有したN型のTFTを得る。 【0151】次に、第1の層間絶縁膜311として酸化
珪素膜をプラズマCVD法で400〜1200nm、本
実施例では600nmの膜厚に形成することにより、図
6Aに示す状態を得る。 【0152】そして、実施例1と同様に、第1の層間絶
縁膜にコンタクトホールを形成し、ソース配線を形成す
る。こうして、ソース電極321とドレイン電極322
が形成される。同時に、ブラックマトリクスの引き出し
電極も形成する。 【0153】続いて、第2の層間絶縁膜として酸化珪素
膜とポリイミドの積層膜を形成する。酸化珪素膜31
2’はプラズマCVD法によりTEOSとO2 から20
0nm形成される。また、ポリイミド312”はスピナ
ーを用いたスピンコーティング法により0.8μm形成
される。 【0154】こうして形成された表面が平坦な第2の層
間絶縁膜の上にブラックマトリクス323を設ける。本
実施例ではブラックマトリクス323としてCrをスパ
ッタ法を用いて200nm形成する。 【0155】更に、図6Bに示すようにブラックマトリ
クスの上に無機層を2層設ける。本実施例では、第1の
無機層318としてDLC膜を第2の無機層319とし
て酸化珪素膜を設ける。 【0156】DLC膜318は、炭化水素をイオン源と
したイオンビーム堆積法を用いて50nmの膜厚に形成
する。その後、酸化珪素膜319をSiH4 とO2 を用
いたプラズマCVD法により100nmの膜厚に形成す
る。 【0157】そして、レジストを塗布し、パターニング
することによりパターンを形成する。続いて、パターン
をマスクとしてフッ素系のエッチャントを用いてドライ
エッチングすることにより酸化珪素膜319をエッチン
グする。そして、エッチャントを酸素系のエッチャント
として、DLC膜318のエッチングとパターンのアッ
シングを同時に行う。 【0158】次に、無機層をマスクとして塩素系のエッ
チャントを用いたドライエッチングにより、ブラックマ
トリクス323をパターニングする。こうして、図6C
に示すようにパターニングされたブラックマトリクス3
24を得る。 【0159】このように、無機層318、319を形成
した後であって、且つ第3の層間絶縁膜313を形成す
る前に、少なくとも1回(本実施例では無機層を2層と
ブラックマトリクスとで3回)のパターニング工程を有
している。 【0160】続いて、第3の層間絶縁膜313として、
アクリルを0.3μmの膜厚に形成する。アクリルは、
スピナーを用いたスピンコーティング法で形成する。 【0161】そして、第2の層間絶縁膜312’、31
2”と第3の層間絶縁膜313に、ドレイン電極322
へのコンタクトホールを開口する。このエッチングは、
フッ素系のエッチャントを用いたドライエッチングによ
り行う。そして、画素電極329としてITOを形成し
図3Aに示す状態を得る。 【0162】こうして、形成された液晶表示装置のTF
T基板は、領域Yで示す蓄積容量を有している。この蓄
積容量には、無機層としてDLC膜と酸化珪素膜の積層
構造となっており、単位面積当たりの容量を増やすこと
ができ、且つ漏洩電流も少なくすることができた。 【0163】また、DLC膜をエッチングする際にパタ
ーンをアッシングすることができたため、多層としたこ
とによる工程数の増加を減らすことができた。 【0164】本実施例では、画素電極としてITOを用
いた透過型の液晶表示装置を作製したが、画素電極にA
lやTi等の反射電極を用いて反射型の液晶表示装置を
作製することも可能である。AlやTi等の反射電極
は、スパッタ法を用いて形成すればよい。 【0165】本実施例では、ブラックマトリクス324
と無機層318、319とを自己整合的に形成したため
同一形状となっているが、ブラックマトリクスをパター
ニング工程で過剰にエッチングすることにより、少なく
とも無機層の一つをひさし型とした構成をとると、ブラ
ックマトリクスの端部においても有機樹脂のパーティク
ルによるショートから保護することができ好ましかっ
た。 【0166】本実施例では、ソース配線と同時に形成し
たドレイン電極だけを設けた構成であるが、実施例2で
概略説明したように、ブラックマトリクスを用いた第2
のドレイン電極を設けた構成としてもよい。 【0167】なお、本実施例のように、第2の層間絶縁
膜312’、312”が積層である場合や第2の層間絶
縁膜と第3の層間絶縁膜とが異なる場合に第2のドレイ
ン電極を設けることは、エッチング速度の違いを考慮す
る必要がなく有効である。 【0168】[実施例4]本実施例は、画素部に本発明
の構成を利用した液晶表示装置の利用例を示す。図7A
〜Fにその利用例の概略図を示す。 【0169】図7AはPDAの情報表示部に本発明を利
用した液晶表示装置を利用した例である。本体2001
は、表示装置2005、集積化回路2006およびカメ
ラ部を有している。ここで、表示装置2005のブラッ
クマトリクスと画素電極との間には無機層が挟まれてい
る。具体的には、実施例1乃至3のTFT基板を利用し
ている。 【0170】図中の2002は、画像を入力するための
カメラ部であり、操作スイッチ2004で操作する。受
像部2003は、CCD素子やCMOS固体撮像素子で
構成されている。 【0171】図7BはHMD(Head Mounted Display)
の表示部に本発明を利用した液晶表示装置を利用した例
である。本体2101は、表示装置2102およびバン
ド部2103から構成されている。ここで、表示装置2
102に本発明の構成を利用している。具体的には、実
施例1乃至3のTFT基板を利用している。 【0172】図7Cはカーナビゲーションシステムの表
示部に本発明を利用した液晶表示装置を利用した例であ
る。本体2201は、表示装置2202、操作スイッチ
2203およびアンテナ2204から構成されている。
ここで、表示装置2202に本発明の構成を利用してい
る。具体的には、実施例1乃至3のTFT基板を利用し
ている。 【0173】図7DはPHSの情報表示部に本発明を利
用した液晶表示装置を利用した例である。本体2301
は、音声出力部2302、音声入力部2303、表示装
置2304、操作スイッチ2305およびアンテナ23
06から構成されてから構成されている。ここで、表示
装置2304に本発明の構成を利用している。具体的に
は、実施例1乃至3のTFT基板を利用している。 【0174】図7Eはビデオカメラの表示部に本発明を
利用した液晶表示装置を利用した例である。本体240
1は、表示装置2402、音声入力部2403、操作ス
イッチ2404、バッテリー2405、受像部2406
および集積化回路2407から構成されている。ここ
で、表示装置2402に本発明の構成を利用している。
具体的には、実施例1乃至3のTFT基板を利用してい
る。 【0175】図7Fはプロジェクタに本発明を利用した
液晶表示装置を利用した例である。本体2501は、光
源2502、表示装置2503、光学系2504および
スクリーン2505から構成されてから構成されてい
る。ここで、表示装置2503に本発明の構成を利用し
ている。具体的には、実施例1乃至3のTFT基板を利
用している。 【0176】 【発明の効果】このように、ブラックマトリクスと画素
電極との間に無機層を設けることにより、従来よりも単
位面積当たりの容量が大きい蓄積容量を設けることがで
き、従来の無機層を設けない液晶表示装置に比べて、本
発明を用いて作製した液晶表示装置は、コントラスト比
が20〜30%向上した。 【0177】また、単位面積当たりの容量が大きくなっ
たため、蓄積容量に用いる面積を小さくすることがで
き、その結果、開口率を大きくすることが実現できた。
また、本発明を用いることにより、従来と同じパネルサ
イズで、より高精細化を実現することが可能となる。 【0178】さらに、無機層を設けることによって、従
来、第3の層間絶縁膜である有機樹脂のパーティクルに
よる表示不良を従来の1/10に減らすことができた。
SXGAのパネルは約130万画素を有しているが、
0.5μm以下のパーティクルによる表示不良を数個以
内に抑えることができた。また、無機層を設けたことに
より、パーティクルの影響が緩和され、第3の層間絶縁
膜の膜厚を薄くすることが可能となり、更に、蓄積容量
を大きくすることができる。 【0179】また、ブラックマトリクスに限らず、有機
樹脂に挟まれた導電層に対して、無機層を設けることに
より、パーティクルによるショートを防止することがで
きる。 【0180】ブラックマトリクスと無機層を自己整合的
に形成したことにより、無機層の応力を緩和することが
でき、ピーリングを減らすことができる。
【図面の簡単な説明】 【図1】 本発明の構成の上面図 【図2】 本発明の構成の断面図 【図3】 本発明の構成の断面図 【図4】 本発明の構成の作製工程図 【図5】 本発明の構成の作製工程図 【図6】 本発明の構成の作製工程図 【図7】 本発明の構成を有する表示装置の利用例 【図8】 従来の構成の断面図 【図9】 コンタクトホール形状図 【符号の説明】 101 基板 102 チャネル領域 103 ソース領域 104 ドレイン領域 105 不純物添加領域 106 低不純物領域 107 半導体層 110 ゲイト絶縁膜 111 第1の層間絶縁膜 112 第2の層間絶縁膜 113 第3の層間絶縁膜 115 陽極酸化膜 118 無機層 120 ゲイト電極 121 ソース電極 122 ドレイン電極 123 ブラックマトリクス 124 パターニングしたブラックマトリクス 126 ゲイト配線 127 ソース配線 129 画素電極 130 レジスト 201 基板 202 チャネル領域 203 ソース領域 204 ドレイン領域 205 不純物添加領域 206 低不純物領域 210 ゲイト絶縁膜 211 第1の層間絶縁膜 212 第2の層間絶縁膜 213 第3の層間絶縁膜 215 陽極酸化膜 218 無機層 220 ゲイト電極 221 ソース電極 222 第1のドレイン電極 224 パターニングしたブラックマトリクス 225 第2のドレイン電極 229 画素電極 230 レジスト 301 基板 302 チャネル領域 303 ソース領域 304 ドレイン領域 305 不純物添加領域 310 ゲイト絶縁膜 311 第1の層間絶縁膜 312 第2の層間絶縁膜 313 第3の層間絶縁膜 315 陽極酸化膜 318 無機層 319 無機層 320 ゲイト電極 321 ソース電極 322 ドレイン電極 323 ブラックマトリクス 324 パターニングしたブラックマトリクス 329 画素電極 801 基板 802 チャネル領域 803 ソース領域 804 ドレイン領域 805 不純物添加領域 810 ゲイト絶縁膜 811 第1の層間絶縁膜 812 第2の層間絶縁膜 813 第3の層間絶縁膜 820 ゲイト電極 821 ソース電極 822 第1のドレイン電極 824 パターニングしたブラックマトリクス 825 第2のドレイン電極 829 画素電極 904 ドレイン領域 912 第2の層間絶縁膜 913 第3の層間絶縁膜 918 窒化珪素膜

Claims (1)

  1. 【特許請求の範囲】 【請求項1】有機樹脂に上下が挟まれた導電層を有する
    液晶表示装置において、 前記導電層の上には無機層が設けられ、 前記導電層の下の有機樹脂は表面が平坦化され、 前記導電層と前記無機層は概略同一形状を有しているこ
    とを特徴とする液晶表示装置。 【請求項2】表面が平坦な有機樹脂の上に形成された、
    ブラックマトリクスと画素電極とから構成される蓄積容
    量を有する液晶表示装置において、 前記ブラックマトリクスと画素電極との間に複数の絶縁
    膜が配設され、 前記複数の絶縁膜の前記ブラックマトリクスに接する層
    は、無機層からなることを特徴とする液晶表示装置。 【請求項3】表面が平坦な有機樹脂からなる層間絶縁膜
    の上に形成された、ブラックマトリクスと画素電極とか
    ら構成される蓄積容量を有する液晶表示装置において、 前記ブラックマトリクスと画素電極との間に複数の絶縁
    膜が配設され、 前記複数の絶縁膜の前記ブラックマトリクスに接する層
    は、無機層からなり、 前記無機層は前記ブラックマトリクスと概略同一形状に
    パターニングされていることを特徴とする液晶表示装
    置。 【請求項4】請求項1乃至3において、前記無機層は酸
    化珪素、窒化珪素または窒化酸化珪素からなることを特
    徴とする液晶表示装置。 【請求項5】請求項1乃至3において、前記複数の絶縁
    膜の最も表面に近い層は平坦化された有機樹脂層である
    ことを特徴とする液晶表示装置。 【請求項6】請求項1乃至3において、前記有機樹脂は
    ポリイミドまたはアクリルからなることを特徴とする液
    晶表示装置。 【請求項8】絶縁表面を有する基板の上に薄膜トランジ
    スタを形成する第1の工程と、 前記薄膜トランジスタの上に有機樹脂からなる層を形成
    する第2の工程と、 前記有機樹脂からなる層の上に導電層を形成する第3の
    工程と、 前記導電層の上に少なくとも1層の無機層を形成する第
    4の工程と、 平坦化された有機樹脂層を設ける第5の工程とを有し、 前記第4の工程と前記第5の工程の間に少なくとも1回
    のパターニング工程を有することを特徴とする液晶表示
    装置の作製方法。 【請求項9】絶縁表面を有する基板の上に薄膜トランジ
    スタを形成する工程と、 前記薄膜トランジスタを覆って第1の層間絶縁膜を形成
    する工程と、 前記第1の層間絶縁膜の上に表面が平坦な有機材料から
    なる第2の層間絶縁膜を形成する工程と、 前記第2の層間絶縁膜の上にブラックマトリクスを形成
    する工程と、 前記ブラックマトリクスの上に無機層を形成する工程
    と、 前記ブラックマトリクスと前記無機層とを概略同一形状
    にパターニングする工程と、 該工程の後に、有機樹脂からなる第3の層間絶縁膜を形
    成する工程と、 前記薄膜トランジスタのドレイン領域と電気的に連絡し
    ている画素電極を形成する工程とを有し、 前記画素電極と前記パターニングされたブラックマトリ
    クスとが蓄積容量を形成していることを特徴とする液晶
    表示装置の作製方法。 【請求項10】絶縁表面を有する基板の上に薄膜トラン
    ジスタを形成する工程と、 前記薄膜トランジスタを覆って第1の層間絶縁膜を形成
    する工程と、 前記第1の層間絶縁膜の上に表面が平坦な有機材料から
    なる第2の層間絶縁膜を形成する工程と、 前記第2の層間絶縁膜の上にブラックマトリクスを形成
    する工程と、 前記ブラックマトリクスをパターニングする工程と、 前記パターニングされたブラックマトリクスを陽極酸化
    する工程と、 該工程の後に、有機樹脂からなる第3の層間絶縁膜を形
    成する工程と、 前記薄膜トランジスタのドレイン領域と電気的に連絡し
    ている画素電極を形成する工程とを有し、 前記画素電極と前記パターニングされたブラックマトリ
    クスとが蓄積容量を形成していることを特徴とする液晶
    表示装置の作製方法。 【請求項11】請求項8または9において、前記無機層
    は酸化珪素、窒化珪素または窒化酸化珪素からなること
    を特徴とする液晶表示装置の作製方法。
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Cited By (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP1052701A2 (en) * 1999-05-14 2000-11-15 Semiconductor Energy Laboratory Co., Ltd. Capacitor, semiconductor device, and manufacturing method thereof
JP2001092426A (ja) * 1999-07-21 2001-04-06 Semiconductor Energy Lab Co Ltd 表示装置
JP2009151328A (ja) * 1999-10-15 2009-07-09 Lg Display Co Ltd 液晶表示装置とその製造方法
JP2011002855A (ja) * 2010-09-22 2011-01-06 Semiconductor Energy Lab Co Ltd 液晶表示装置
JP2011119743A (ja) * 1999-06-02 2011-06-16 Semiconductor Energy Lab Co Ltd 半導体装置
US7995015B2 (en) 1999-07-21 2011-08-09 Semiconductor Energy Laboratory Co., Ltd. Display device
US8305507B2 (en) 2005-02-25 2012-11-06 Samsung Display Co., Ltd. Thin film transistor array panel having improved storage capacitance and manufacturing method thereof
JP2014032415A (ja) * 1999-08-31 2014-02-20 Semiconductor Energy Lab Co Ltd 半導体装置
JP2014225044A (ja) * 1999-07-06 2014-12-04 株式会社半導体エネルギー研究所 表示装置及び電子機器
JP2016208043A (ja) * 1999-05-14 2016-12-08 株式会社半導体エネルギー研究所 液晶表示装置
JP2017135404A (ja) * 2010-05-21 2017-08-03 株式会社半導体エネルギー研究所 半導体装置

Families Citing this family (43)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3126661B2 (ja) * 1996-06-25 2001-01-22 株式会社半導体エネルギー研究所 液晶表示装置
US6088070A (en) 1997-01-17 2000-07-11 Semiconductor Energy Laboratory Co., Ltd. Active matrix liquid crystal with capacitor between light blocking film and pixel connecting electrode
JP3856889B2 (ja) * 1997-02-06 2006-12-13 株式会社半導体エネルギー研究所 反射型表示装置および電子デバイス
JP3784491B2 (ja) * 1997-03-28 2006-06-14 株式会社半導体エネルギー研究所 アクティブマトリクス型の表示装置
US6486933B1 (en) * 1998-03-12 2002-11-26 Samsung Electronics Co., Ltd. Liquid crystal display with preventing vertical cross-talk having overlapping data lines
JPH11307782A (ja) * 1998-04-24 1999-11-05 Semiconductor Energy Lab Co Ltd 半導体装置およびその作製方法
KR100312753B1 (ko) * 1998-10-13 2002-04-06 윤종용 광시야각액정표시장치
US6277679B1 (en) 1998-11-25 2001-08-21 Semiconductor Energy Laboratory Co., Ltd. Method of manufacturing thin film transistor
JP3378820B2 (ja) * 1999-01-20 2003-02-17 三洋電機株式会社 垂直配向型液晶表示装置
US6576924B1 (en) * 1999-02-12 2003-06-10 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device having at least a pixel unit and a driver circuit unit over a same substrate
EP1031873A3 (en) 1999-02-23 2005-02-23 Sel Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and fabrication method thereof
US7821065B2 (en) * 1999-03-02 2010-10-26 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device comprising a thin film transistor comprising a semiconductor thin film and method of manufacturing the same
US6531993B1 (en) 1999-03-05 2003-03-11 Semiconductor Energy Laboratory Co., Ltd. Active matrix type display device
US6690434B1 (en) 1999-03-15 2004-02-10 Semiconductor Energy Laboratory Co., Ltd. Active matrix liquid crystal display device
JP3826618B2 (ja) * 1999-05-18 2006-09-27 ソニー株式会社 液晶表示装置
JP2001175198A (ja) 1999-12-14 2001-06-29 Semiconductor Energy Lab Co Ltd 半導体装置およびその作製方法
US6825488B2 (en) 2000-01-26 2004-11-30 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and manufacturing method thereof
US6646692B2 (en) * 2000-01-26 2003-11-11 Semiconductor Energy Laboratory Co., Ltd. Liquid-crystal display device and method of fabricating the same
US7023021B2 (en) 2000-02-22 2006-04-04 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and method of manufacturing the same
TW521303B (en) 2000-02-28 2003-02-21 Semiconductor Energy Lab Electronic device
US6789910B2 (en) 2000-04-12 2004-09-14 Semiconductor Energy Laboratory, Co., Ltd. Illumination apparatus
US7525165B2 (en) * 2000-04-17 2009-04-28 Semiconductor Energy Laboratory Co., Ltd. Light emitting device and manufacturing method thereof
US6580475B2 (en) 2000-04-27 2003-06-17 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and method of fabricating the same
US7804552B2 (en) * 2000-05-12 2010-09-28 Semiconductor Energy Laboratory Co., Ltd. Electro-optical device with light shielding portion comprising laminated colored layers, electrical equipment having the same, portable telephone having the same
US6509616B2 (en) 2000-09-29 2003-01-21 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and its manufacturing method
TW525216B (en) * 2000-12-11 2003-03-21 Semiconductor Energy Lab Semiconductor device, and manufacturing method thereof
SG111923A1 (en) * 2000-12-21 2005-06-29 Semiconductor Energy Lab Light emitting device and method of manufacturing the same
JP2002311448A (ja) * 2001-02-06 2002-10-23 Advanced Display Inc 液晶表示装置及びその製造方法
JP4306142B2 (ja) * 2001-04-24 2009-07-29 株式会社日立製作所 画像表示装置及びその製造方法
KR100443831B1 (ko) 2001-12-20 2004-08-09 엘지.필립스 엘시디 주식회사 액정표시소자의 제조 방법
JP4338948B2 (ja) * 2002-08-01 2009-10-07 株式会社半導体エネルギー研究所 カーボンナノチューブ半導体素子の作製方法
US20050186690A1 (en) * 2004-02-25 2005-08-25 Megic Corporation Method for improving semiconductor wafer test accuracy
JP4934599B2 (ja) * 2007-01-29 2012-05-16 キヤノン株式会社 アクティブマトリクス表示装置
US8456586B2 (en) * 2009-06-11 2013-06-04 Apple Inc. Portable computer display structures
US8408780B2 (en) * 2009-11-03 2013-04-02 Apple Inc. Portable computer housing with integral display
US8743309B2 (en) 2009-11-10 2014-06-03 Apple Inc. Methods for fabricating display structures
US8583187B2 (en) * 2010-10-06 2013-11-12 Apple Inc. Shielding structures for wireless electronic devices with displays
US8467177B2 (en) 2010-10-29 2013-06-18 Apple Inc. Displays with polarizer windows and opaque masking layers for electronic devices
US9143668B2 (en) 2010-10-29 2015-09-22 Apple Inc. Camera lens structures and display structures for electronic devices
KR102019191B1 (ko) * 2013-02-28 2019-09-09 엘지디스플레이 주식회사 유기전계발광표시장치 및 그 제조방법
CN111937490B (zh) * 2018-04-20 2023-07-18 堺显示器制品株式会社 有机el装置及其制造方法
US11637919B2 (en) 2019-12-03 2023-04-25 Apple Inc. Handheld electronic device
US11503143B2 (en) 2019-12-03 2022-11-15 Apple Inc. Handheld electronic device

Family Cites Families (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2538086B2 (ja) * 1990-01-11 1996-09-25 松下電器産業株式会社 液晶表示デバイスおよびその製造方法
US5056895A (en) * 1990-05-21 1991-10-15 Greyhawk Systems, Inc. Active matrix liquid crystal liquid crystal light valve including a dielectric mirror upon a leveling layer and having fringing fields
JP2770763B2 (ja) * 1995-01-31 1998-07-02 日本電気株式会社 アクティブマトリクス液晶表示装置
JP3349332B2 (ja) * 1995-04-28 2002-11-25 インターナショナル・ビジネス・マシーンズ・コーポレーション 反射式空間光変調素子配列及びその形成方法
US5815226A (en) * 1996-02-29 1998-09-29 Semiconductor Energy Laboratory Co., Ltd. Electro-optical device and method of fabricating same

Cited By (27)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP1052701A3 (en) * 1999-05-14 2005-01-12 Semiconductor Energy Laboratory Co., Ltd. Capacitor, semiconductor device, and manufacturing method thereof
JP2016208043A (ja) * 1999-05-14 2016-12-08 株式会社半導体エネルギー研究所 液晶表示装置
EP1052701A2 (en) * 1999-05-14 2000-11-15 Semiconductor Energy Laboratory Co., Ltd. Capacitor, semiconductor device, and manufacturing method thereof
JP2013211573A (ja) * 1999-06-02 2013-10-10 Semiconductor Energy Lab Co Ltd 半導体装置
JP2011119743A (ja) * 1999-06-02 2011-06-16 Semiconductor Energy Lab Co Ltd 半導体装置
JP2014081643A (ja) * 1999-06-02 2014-05-08 Semiconductor Energy Lab Co Ltd 半導体装置
JP2019133180A (ja) * 1999-07-06 2019-08-08 株式会社半導体エネルギー研究所 液晶表示装置
US9395584B2 (en) 1999-07-06 2016-07-19 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and method of fabricating the same
US9069215B2 (en) 1999-07-06 2015-06-30 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and method of fabricating the same
US9052551B2 (en) 1999-07-06 2015-06-09 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device and method of fabricating the same
JP2014225044A (ja) * 1999-07-06 2014-12-04 株式会社半導体エネルギー研究所 表示装置及び電子機器
US7995015B2 (en) 1999-07-21 2011-08-09 Semiconductor Energy Laboratory Co., Ltd. Display device
US8018412B2 (en) 1999-07-21 2011-09-13 Semiconductor Energy Laboratory Co., Ltd. Display device
US8362994B2 (en) 1999-07-21 2013-01-29 Semiconductor Energy Laboratory Co., Ltd. Display device
JP2001092426A (ja) * 1999-07-21 2001-04-06 Semiconductor Energy Lab Co Ltd 表示装置
US8004483B2 (en) 1999-07-21 2011-08-23 Semiconductor Energy Laboratory Co., Ltd. Display device
US8933455B2 (en) 1999-08-31 2015-01-13 Semiconductor Energy Laboratory Co., Ltd. Display device comprising pixel
JP2015008336A (ja) * 1999-08-31 2015-01-15 株式会社半導体エネルギー研究所 半導体装置
JP2014032415A (ja) * 1999-08-31 2014-02-20 Semiconductor Energy Lab Co Ltd 半導体装置
JP2015129968A (ja) * 1999-08-31 2015-07-16 株式会社半導体エネルギー研究所 半導体装置
US9250490B2 (en) 1999-08-31 2016-02-02 Semiconductor Energy Laboratory Co., Ltd. Liquid crystal display device including light shielding film
JP2016153917A (ja) * 1999-08-31 2016-08-25 株式会社半導体エネルギー研究所 半導体装置
US9466622B2 (en) 1999-08-31 2016-10-11 Semiconductor Energy Laboratory Co., Ltd. Display device comprising a thin film transistor and a storage capacitor
JP2009151328A (ja) * 1999-10-15 2009-07-09 Lg Display Co Ltd 液晶表示装置とその製造方法
US8305507B2 (en) 2005-02-25 2012-11-06 Samsung Display Co., Ltd. Thin film transistor array panel having improved storage capacitance and manufacturing method thereof
JP2017135404A (ja) * 2010-05-21 2017-08-03 株式会社半導体エネルギー研究所 半導体装置
JP2011002855A (ja) * 2010-09-22 2011-01-06 Semiconductor Energy Lab Co Ltd 液晶表示装置

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