JPH1145072A - 表示装置およびその駆動方法 - Google Patents
表示装置およびその駆動方法Info
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- JPH1145072A JPH1145072A JP9199040A JP19904097A JPH1145072A JP H1145072 A JPH1145072 A JP H1145072A JP 9199040 A JP9199040 A JP 9199040A JP 19904097 A JP19904097 A JP 19904097A JP H1145072 A JPH1145072 A JP H1145072A
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Abstract
(57)【要約】
【課題】 本発明は、複数の基本色を組み合わせて１つ
の色を表示する画素を配列し、マトリクス駆動をする表
示装置において駆動回路系での消費電力を低減するとと
もに、画質の低下を招かない液晶表示装置とその駆動方
法の提供にある。 【解決手段】 本発明は、多数の走査線Ｇと多数の信号
線Ｓとによって多数の画素１２がマトリクス駆動される
とともに、前記各信号線方向に沿って複数の基本色の組
み合わせが繰り返し配列され、前記走査線の数が前記信
号線に沿って並ぶ全画素の数とされ、前記信号線に沿っ
て配列された基本色の順番が前記信号線に沿って繰り返
し同じ順番とされ、前記走査線に沿って同じ基本色が配
列されてなるとともに、ソースドライバＳｄから各一走
査線当たりの各信号線に送るべき信号を順次ソースドラ
イバに送る信号入力手段Ｎを有することを特徴とする。
の色を表示する画素を配列し、マトリクス駆動をする表
示装置において駆動回路系での消費電力を低減するとと
もに、画質の低下を招かない液晶表示装置とその駆動方
法の提供にある。 【解決手段】 本発明は、多数の走査線Ｇと多数の信号
線Ｓとによって多数の画素１２がマトリクス駆動される
とともに、前記各信号線方向に沿って複数の基本色の組
み合わせが繰り返し配列され、前記走査線の数が前記信
号線に沿って並ぶ全画素の数とされ、前記信号線に沿っ
て配列された基本色の順番が前記信号線に沿って繰り返
し同じ順番とされ、前記走査線に沿って同じ基本色が配
列されてなるとともに、ソースドライバＳｄから各一走
査線当たりの各信号線に送るべき信号を順次ソースドラ
イバに送る信号入力手段Ｎを有することを特徴とする。
Description
【０００１】
【発明の属する技術分野】本発明は複数の基本色、例え
ば、Ｒ（赤色）、Ｇ（緑色）、Ｂ（青色）を組み合わせ
て１つの色を表示するマトリクス駆動の表示装置および
その駆動方法に関する。
ば、Ｒ（赤色）、Ｇ（緑色）、Ｂ（青色）を組み合わせ
て１つの色を表示するマトリクス駆動の表示装置および
その駆動方法に関する。
【０００２】
【従来の技術】従来、液晶などの表示素子を利用してこ
れに光源とカラーフィルタを組み合わせ、カラー表示を
可能とした液晶表示装置が知られている。ここでカラー
フィルタとして、Ｒ、Ｇ、Ｂの３つの基本色をそれぞれ
画素として組み合わせて用いることで１つの色表示を行
う絵素を構成し、この絵素を表示領域に多数配列し、更
に、液晶を駆動するために信号線と走査線をマトリクス
状に配線して信号線と走査線に区画された領域に画素電
極を配置し、画素電極に対するスイッチングの切り換え
を薄膜トランジスタにより行って各画素に対応する液晶
に電界を印加し、液晶の透過率を変化させて表示、非表
示を切り換える薄膜トランジスタ駆動方式の液晶表示装
置を例にとって以下に説明する。
れに光源とカラーフィルタを組み合わせ、カラー表示を
可能とした液晶表示装置が知られている。ここでカラー
フィルタとして、Ｒ、Ｇ、Ｂの３つの基本色をそれぞれ
画素として組み合わせて用いることで１つの色表示を行
う絵素を構成し、この絵素を表示領域に多数配列し、更
に、液晶を駆動するために信号線と走査線をマトリクス
状に配線して信号線と走査線に区画された領域に画素電
極を配置し、画素電極に対するスイッチングの切り換え
を薄膜トランジスタにより行って各画素に対応する液晶
に電界を印加し、液晶の透過率を変化させて表示、非表
示を切り換える薄膜トランジスタ駆動方式の液晶表示装
置を例にとって以下に説明する。
【０００３】この種の液晶表示装置が適用されるコンピ
ュータ用の表示装置において、６４０（横）×４８０
（縦）絵素の表示を行うＶＧＡにあっては、表示の単位
となる絵素（Ｒ、Ｇ、Ｂ各１画素一組で１絵素を構成）
の数が、６４０×４８０＝３０７２００絵素であり、信
号線に沿ってＲＧＢに３分割されているために、走査
線、信号線の数は、走査線数４８０本、信号線数６４０
×３＝１９２０本である。従って総画素数は、６４０×
３×４８０＝９２１６００画素とされている。
ュータ用の表示装置において、６４０（横）×４８０
（縦）絵素の表示を行うＶＧＡにあっては、表示の単位
となる絵素（Ｒ、Ｇ、Ｂ各１画素一組で１絵素を構成）
の数が、６４０×４８０＝３０７２００絵素であり、信
号線に沿ってＲＧＢに３分割されているために、走査
線、信号線の数は、走査線数４８０本、信号線数６４０
×３＝１９２０本である。従って総画素数は、６４０×
３×４８０＝９２１６００画素とされている。
【０００４】図１７は、この種のカラー液晶表示装置の
画面に駆動用ＬＳＩを取り付けたカラー液晶駆動ユニッ
トを示すものである。この図において１は、２枚の対向
配置された透明基板間に液晶が封入され、一方の透明基
板に共通電極とカラーフィルタが備えられ、他方の透明
基板に縦方向に信号線が横方向に走査線がそれぞれ多数
本マトリックス状に配線され、信号線と走査線に囲まれ
て区画された領域に画素電極と薄膜トランジスタとが設
けられた液晶表示装置であり、この例では液晶表示装置
１の左側部側に走査線駆動用の複数のゲートドライバＧ
ｄが、上辺側と下辺側にそれぞれ信号線駆動用の複数の
ソースドライバＳｄが取り付けられている。
画面に駆動用ＬＳＩを取り付けたカラー液晶駆動ユニッ
トを示すものである。この図において１は、２枚の対向
配置された透明基板間に液晶が封入され、一方の透明基
板に共通電極とカラーフィルタが備えられ、他方の透明
基板に縦方向に信号線が横方向に走査線がそれぞれ多数
本マトリックス状に配線され、信号線と走査線に囲まれ
て区画された領域に画素電極と薄膜トランジスタとが設
けられた液晶表示装置であり、この例では液晶表示装置
１の左側部側に走査線駆動用の複数のゲートドライバＧ
ｄが、上辺側と下辺側にそれぞれ信号線駆動用の複数の
ソースドライバＳｄが取り付けられている。
【０００５】図１８にこの例の液晶表示装置１の回路構
成の部分拡大図を示すが、この例の回路において縦列の
信号線Ｓ1、Ｓ2、Ｓ3、Ｓ4と、横列の走査線Ｇ1、Ｇ2が
交差状態で多数マトリクス状に形成され、信号線と走査
線による区画された領域にそれぞれ画素電極５と薄膜ト
ランジスタ６が設けられ、画素電極５を形成した１つの
領域が１つの画素とされ、この画素が３つ集合して１つ
の絵素とされている。従って図１８に示す回路において
は、図１８の鎖線で囲まれたような絵素７が構成されて
いるので、前記ＶＧＡの表示装置にあっては、この絵素
７が１画面上に３０７２００個形成されていることにな
る。
成の部分拡大図を示すが、この例の回路において縦列の
信号線Ｓ1、Ｓ2、Ｓ3、Ｓ4と、横列の走査線Ｇ1、Ｇ2が
交差状態で多数マトリクス状に形成され、信号線と走査
線による区画された領域にそれぞれ画素電極５と薄膜ト
ランジスタ６が設けられ、画素電極５を形成した１つの
領域が１つの画素とされ、この画素が３つ集合して１つ
の絵素とされている。従って図１８に示す回路において
は、図１８の鎖線で囲まれたような絵素７が構成されて
いるので、前記ＶＧＡの表示装置にあっては、この絵素
７が１画面上に３０７２００個形成されていることにな
る。
【０００６】
【発明が解決しようとする課題】このような画素数の液
晶表示装置１に対して設けられるソースドライバＳｄと
ゲートドライバＧｄは、通常、２４０本程度の出力ピン
を有する１個のＬＳＩから構成されるので、液晶表示装
置１の透明基板に実装されるのは、ポリイミドテープに
ＬＳＩが装着されたものを用いるＴＣＰ（テープキャリ
アパッケージ）の形態であるか、ＬＳＩを直接実装する
ＣＯＧ（チップオングラス）の形態とされるのが通常で
ある。従って、前記液晶表示装置１に用いられる信号線
１９２０本と走査線４８０本に対応するためには、図１
７に示すように２４０ピンのソースドライバＳｄを８個
（２４０×８＝１９２０）、２４０ピンのゲートドライ
バＧｄを２個（２４０×２＝４８０）用いる必要があっ
た。なお、実際の液晶表示装置にあっては、これらの他
にもドライバに信号等を供給するための回路が別途必要
であるがここでの説明では省略してある。
晶表示装置１に対して設けられるソースドライバＳｄと
ゲートドライバＧｄは、通常、２４０本程度の出力ピン
を有する１個のＬＳＩから構成されるので、液晶表示装
置１の透明基板に実装されるのは、ポリイミドテープに
ＬＳＩが装着されたものを用いるＴＣＰ（テープキャリ
アパッケージ）の形態であるか、ＬＳＩを直接実装する
ＣＯＧ（チップオングラス）の形態とされるのが通常で
ある。従って、前記液晶表示装置１に用いられる信号線
１９２０本と走査線４８０本に対応するためには、図１
７に示すように２４０ピンのソースドライバＳｄを８個
（２４０×８＝１９２０）、２４０ピンのゲートドライ
バＧｄを２個（２４０×２＝４８０）用いる必要があっ
た。なお、実際の液晶表示装置にあっては、これらの他
にもドライバに信号等を供給するための回路が別途必要
であるがここでの説明では省略してある。
【０００７】ここで前記ドライバの消費電力は、以下に
記載する如くソースドライバＳｄの方がゲートドライバ
Ｇｄより大きいとされている。 ドライバ消費電力（約８４０ｍＷ） ゲートドライバ 低い（約 ２０ｍＷ×２＝ ４０ｍ
Ｗ：５％を占める。） ソースドライバ 高い（約１００ｍＷ×８＝８００ｍ
Ｗ：９５％を占める。） また、ソースドライバの方がゲートドライバよりも一般
に単価において倍程度高価であることも知られている。
記載する如くソースドライバＳｄの方がゲートドライバ
Ｇｄより大きいとされている。 ドライバ消費電力（約８４０ｍＷ） ゲートドライバ 低い（約 ２０ｍＷ×２＝ ４０ｍ
Ｗ：５％を占める。） ソースドライバ 高い（約１００ｍＷ×８＝８００ｍ
Ｗ：９５％を占める。） また、ソースドライバの方がゲートドライバよりも一般
に単価において倍程度高価であることも知られている。
【０００８】なお、上記のソースドライバの消費電力
は、現状においてカラー表示で６ｂｉｔ（階調数６４）
の代表的なものであり、８ｂｉｔの場合は、価格、消費
電力共により大きな値となり、ゲートドライバとソース
ドライバの価格差と消費電力差は更に広がる方向にな
る。以上の背景から、更なる大画面化、高階調化が進め
られている液晶表示装置の低コスト化、低消費電力化を
図るためには、これらの高価格なドライバの必要数を少
なくすることが望まれている。また、低消費電力を図っ
たことに引き換え、フリッカ等の画質の劣化が生じてし
まうと大画面であるが故にこの劣化が際立って目立って
しまう。従って、低消費電力化を図るとともに、画質の
品質を維持する必要があるとともに、これらの優れた特
性を満足させた上で液晶表示装置を効率良く駆動するこ
とが望まれる。
は、現状においてカラー表示で６ｂｉｔ（階調数６４）
の代表的なものであり、８ｂｉｔの場合は、価格、消費
電力共により大きな値となり、ゲートドライバとソース
ドライバの価格差と消費電力差は更に広がる方向にな
る。以上の背景から、更なる大画面化、高階調化が進め
られている液晶表示装置の低コスト化、低消費電力化を
図るためには、これらの高価格なドライバの必要数を少
なくすることが望まれている。また、低消費電力を図っ
たことに引き換え、フリッカ等の画質の劣化が生じてし
まうと大画面であるが故にこの劣化が際立って目立って
しまう。従って、低消費電力化を図るとともに、画質の
品質を維持する必要があるとともに、これらの優れた特
性を満足させた上で液晶表示装置を効率良く駆動するこ
とが望まれる。
【０００９】本発明は前記事情に鑑みてなされたもので
あり、本発明の目的は、複数の基本色を組み合わせて１
つの色を表示する絵素を配列し、マトリクス駆動をする
表示装置において駆動回路系での消費電力を低減すると
ともに、画質の低下を招かない液晶表示装置とその駆動
方法を提供することにある。
あり、本発明の目的は、複数の基本色を組み合わせて１
つの色を表示する絵素を配列し、マトリクス駆動をする
表示装置において駆動回路系での消費電力を低減すると
ともに、画質の低下を招かない液晶表示装置とその駆動
方法を提供することにある。
【００１０】
【課題を解決するための手段】本発明は前記課題を解決
するために、多数の走査線と多数の信号線とによって多
数の画素がマトリクス駆動されるとともに、前記各信号
線方向に沿って複数の基本色の組み合わせが繰り返し配
列され、前記走査線の数が前記信号線に沿って並ぶ全画
素の数とされ、前記信号線に沿って配列された基本色の
順番が前記信号線に沿って繰り返し同じ順番とされ、前
記走査線に沿って同じ基本色が配列されてなるととも
に、ソースドライバから各一走査線当たりの各信号線に
送られる信号を順次ソースドライバに送る信号入力手段
を有することを特徴とする。
するために、多数の走査線と多数の信号線とによって多
数の画素がマトリクス駆動されるとともに、前記各信号
線方向に沿って複数の基本色の組み合わせが繰り返し配
列され、前記走査線の数が前記信号線に沿って並ぶ全画
素の数とされ、前記信号線に沿って配列された基本色の
順番が前記信号線に沿って繰り返し同じ順番とされ、前
記走査線に沿って同じ基本色が配列されてなるととも
に、ソースドライバから各一走査線当たりの各信号線に
送られる信号を順次ソースドライバに送る信号入力手段
を有することを特徴とする。
【００１１】ソースドライバから各一走査線当たりの各
信号線に送られるべき信号を順次ソースドライバに送る
信号入力手段を備えるならば、マトリクス配置された各
画素に対して好ましい信号入力形態をとることができ
る。一走査線当たりの色のデータの順番で駆動信号のデ
ータ入力を行うことは、従来用いられている駆動信号の
データ入力フォーマットの一部を変更して駆動信号の一
部を入れ替えるのみで実現できるので、回路変更も最低
限で良く、容易に実現できる特徴を有する。更に、前記
の構造において、走査線の数が前記信号線に沿って並ぶ
全画素数に対する前記基本色数倍の数にされ、前記信号
線に沿って配列された基本色の順番が前記信号線に沿っ
て繰り返し同じ順番とされた構造を採用するならば、従
来構造の表示装置と比べて画質的な劣化を生じることな
く消費電力が大きく高価なソースドライバを大幅に削減
できる。更に、この構造の場合、ソースドライバよりも
消費電力が小さく安価なゲートドライバの必要数は増加
するものの、ゲートドライバの増加によるコスト増加分
よりもソースドライバの削減による消費電力およびコス
ト減の方を大きくできるので、全体として従来構造より
も低消費電力および低コストにすることができる。
信号線に送られるべき信号を順次ソースドライバに送る
信号入力手段を備えるならば、マトリクス配置された各
画素に対して好ましい信号入力形態をとることができ
る。一走査線当たりの色のデータの順番で駆動信号のデ
ータ入力を行うことは、従来用いられている駆動信号の
データ入力フォーマットの一部を変更して駆動信号の一
部を入れ替えるのみで実現できるので、回路変更も最低
限で良く、容易に実現できる特徴を有する。更に、前記
の構造において、走査線の数が前記信号線に沿って並ぶ
全画素数に対する前記基本色数倍の数にされ、前記信号
線に沿って配列された基本色の順番が前記信号線に沿っ
て繰り返し同じ順番とされた構造を採用するならば、従
来構造の表示装置と比べて画質的な劣化を生じることな
く消費電力が大きく高価なソースドライバを大幅に削減
できる。更に、この構造の場合、ソースドライバよりも
消費電力が小さく安価なゲートドライバの必要数は増加
するものの、ゲートドライバの増加によるコスト増加分
よりもソースドライバの削減による消費電力およびコス
ト減の方を大きくできるので、全体として従来構造より
も低消費電力および低コストにすることができる。
【００１２】次に、本発明の駆動方法の１つは、先に記
載の基本構成の表示装置を駆動するにあたり１つのフレ
ームの間に全走査線を順次走査することを特徴とする。
これにより、従来装置と全く同じ表示性能を維持しつつ
大幅に低コスト化、低消費電力化を図ることができる。
また、１つのフレームを複数のフィールドに分割し、所
定のフィールドごとに飛び越し走査することができる。
前記所定のフィールド数は基本色の数に応じた数が好ま
しい。例えば、３色の基本色の場合は３つのフィールド
数となる。これにより、動画対応などの面で多少の遅れ
を生じても更に低消費電力化を図ることができる。
載の基本構成の表示装置を駆動するにあたり１つのフレ
ームの間に全走査線を順次走査することを特徴とする。
これにより、従来装置と全く同じ表示性能を維持しつつ
大幅に低コスト化、低消費電力化を図ることができる。
また、１つのフレームを複数のフィールドに分割し、所
定のフィールドごとに飛び越し走査することができる。
前記所定のフィールド数は基本色の数に応じた数が好ま
しい。例えば、３色の基本色の場合は３つのフィールド
数となる。これにより、動画対応などの面で多少の遅れ
を生じても更に低消費電力化を図ることができる。
【００１３】また、先に記載の基本構成を有し、更に１
つのフレームの間に全走査線を順次駆動する駆動方法
と、１つのフレームを複数のフィールドに分割し、所定
のフィールドごとに飛び越し走査する駆動方法とを切換
手段により選択自在にした構成であっても良い。これに
より、動画対応時などのように高画質要求時とそれ以外
の場合において使い分けができるようになり、高画質か
つ低消費電力対応と、更なる低消費電力対応の切換使用
ができる。
つのフレームの間に全走査線を順次駆動する駆動方法
と、１つのフレームを複数のフィールドに分割し、所定
のフィールドごとに飛び越し走査する駆動方法とを切換
手段により選択自在にした構成であっても良い。これに
より、動画対応時などのように高画質要求時とそれ以外
の場合において使い分けができるようになり、高画質か
つ低消費電力対応と、更なる低消費電力対応の切換使用
ができる。
【００１４】
【発明の実施の形態】以下、図面を参照して本発明の実
施の形態について説明する。図１は本発明を薄膜トラン
ジスタ駆動方式の液晶表示装置に適用した一形態を示す
もので、この形態において２枚の透明基板間に液晶が封
入されて液晶表示装置１０が構成され、この液晶表示装
置１０の透明基板の上縁部にソースドライバＳｄが３個
（Ｓｄ1〜Ｓｄ3）、液晶表示装置１０の透明基板の左側
部と右側部にそれぞれ３個、合計６個のゲートドライバ
Ｇｄ（Ｇｄ1〜Ｇｄ6）が設けられている。次に、前記液
晶表示装置１０を構成する２枚の透明基板のうち、一方
の基板には共通電極とカラーフィルタが設けられ、他方
の透明基板には薄膜トランジスタ回路が構成されてい
る。その回路構成のうちの１絵素に相当する部分を図２
に拡大して示す。この形態における１つの絵素１２は、
２本の縦列の信号線Ｓ1、Ｓ2と４本の横列の走査線
Ｇ1、Ｇ2、Ｇ3、Ｇ4によって区画された領域で構成され
ている。そして、信号線Ｓ1、Ｓ2、と走査線Ｇ1、Ｇ2と
により囲まれた領域に１つの画素電極１１が設けられて
この領域が１つの画素とされ、信号線Ｓ1、Ｓ2、と走査
線Ｇ2、Ｇ3とにより囲まれた領域に１つの画素電極１１
が設けられてこの領域が１つの画素とされ、信号線
Ｓ1、Ｓ2、と走査線Ｇ3、Ｇ4とにより囲まれた領域に１
つの画素電極１１が設けられてこの領域が１つの画素と
され、これら３つの画素によって１つの絵素１２が構成
されるとともに、各画素電極１１の側部側にそれぞれス
イッチ素子としての薄膜トランジスタＴが構成されてい
る。
施の形態について説明する。図１は本発明を薄膜トラン
ジスタ駆動方式の液晶表示装置に適用した一形態を示す
もので、この形態において２枚の透明基板間に液晶が封
入されて液晶表示装置１０が構成され、この液晶表示装
置１０の透明基板の上縁部にソースドライバＳｄが３個
（Ｓｄ1〜Ｓｄ3）、液晶表示装置１０の透明基板の左側
部と右側部にそれぞれ３個、合計６個のゲートドライバ
Ｇｄ（Ｇｄ1〜Ｇｄ6）が設けられている。次に、前記液
晶表示装置１０を構成する２枚の透明基板のうち、一方
の基板には共通電極とカラーフィルタが設けられ、他方
の透明基板には薄膜トランジスタ回路が構成されてい
る。その回路構成のうちの１絵素に相当する部分を図２
に拡大して示す。この形態における１つの絵素１２は、
２本の縦列の信号線Ｓ1、Ｓ2と４本の横列の走査線
Ｇ1、Ｇ2、Ｇ3、Ｇ4によって区画された領域で構成され
ている。そして、信号線Ｓ1、Ｓ2、と走査線Ｇ1、Ｇ2と
により囲まれた領域に１つの画素電極１１が設けられて
この領域が１つの画素とされ、信号線Ｓ1、Ｓ2、と走査
線Ｇ2、Ｇ3とにより囲まれた領域に１つの画素電極１１
が設けられてこの領域が１つの画素とされ、信号線
Ｓ1、Ｓ2、と走査線Ｇ3、Ｇ4とにより囲まれた領域に１
つの画素電極１１が設けられてこの領域が１つの画素と
され、これら３つの画素によって１つの絵素１２が構成
されるとともに、各画素電極１１の側部側にそれぞれス
イッチ素子としての薄膜トランジスタＴが構成されてい
る。
【００１５】また、前記画素電極１１が構成された透明
基板に対向する他の基板にはカラーフィルタが設けられ
るが、この形態においては図２に示す１つの絵素のう
ち、上段の画素電極１１に対向する位置に図３に示すよ
うにＲのカラーフィルタが、中段の画素電極１１に対向
する位置に図３に示すようにＧのカラーフィルタが、下
段の画素電極１１に対向する位置に図３に示すようにＢ
のカラーフィルタがそれぞれ配置される。また、他の複
数の絵素も含めたカラーフィルタのＲＧＢの配置関係を
図３に示すが、この形態においては、各信号線Ｓの長さ
方向（図３の上下方向）に沿ってＲＧＢ、ＲＧＢの色の
順序でカラーフィルタが配列され、走査線Ｇ1の方向に
はＲ、走査線Ｇ2の方向にはＧ、信号線Ｇ3の方向には
Ｂ、走査線Ｇ4の方向にはＲ、走査線Ｇ5の方向にはＧ、
走査線Ｇ6の方向にはＢの順にそれぞれカラーフィルタ
が配置され、以下、その他のカラーフィルタも同様な順
序で配置されている。
基板に対向する他の基板にはカラーフィルタが設けられ
るが、この形態においては図２に示す１つの絵素のう
ち、上段の画素電極１１に対向する位置に図３に示すよ
うにＲのカラーフィルタが、中段の画素電極１１に対向
する位置に図３に示すようにＧのカラーフィルタが、下
段の画素電極１１に対向する位置に図３に示すようにＢ
のカラーフィルタがそれぞれ配置される。また、他の複
数の絵素も含めたカラーフィルタのＲＧＢの配置関係を
図３に示すが、この形態においては、各信号線Ｓの長さ
方向（図３の上下方向）に沿ってＲＧＢ、ＲＧＢの色の
順序でカラーフィルタが配列され、走査線Ｇ1の方向に
はＲ、走査線Ｇ2の方向にはＧ、信号線Ｇ3の方向には
Ｂ、走査線Ｇ4の方向にはＲ、走査線Ｇ5の方向にはＧ、
走査線Ｇ6の方向にはＢの順にそれぞれカラーフィルタ
が配置され、以下、その他のカラーフィルタも同様な順
序で配置されている。
【００１６】また、この形態においては、ＶＧＡ表示を
行うために、信号線Ｓは６４０本設けられているが、走
査線Ｇが４８０×３＝１４４０本設けられている。従っ
てこの形態においては、絵素数は６４０×４８０＝３０
７２００であって図１７に示す従来構造と同等の絵素数
であるが、信号線本数が従来構造の１／３に減少してい
る。ただし、走査線数は図１７に示す従来構造の３倍
（基本色数倍）となる。この構造により、従来と同等の
２４０ピンの駆動用ＬＳＩを用いるとすると、ソースド
ライバＳｄは３個で２４０×３＝７２０本まで対応可能
となり、ＶＧＡで６４０本とすると８０本の余裕が生ま
れるので図１に示すように３個のソースドライバＳｄ1
〜Ｓｄ3が設けられ、実際には２個のソースドライバＳ
ｄの端子全部と３個目のソースドライバＳｄ3の１６０
本程度の端子が信号線Ｓに接続されている。また、ゲー
トドライバＧｄにおいては、走査線必要本数が１４４０
本であるために２４０ピンのＬＳＩを用いるとすると、
６個必要になるので、図１に示すように６個のゲートド
ライバＧｄ1〜Ｇｄ6が設けられている。なお、透明基板
の左上側のゲートドライバＧｄ1と右上側のゲートドラ
イバＧｄ4に対する走査線Ｇの接続形態について説明す
ると、透明基板の左上側のゲートドライバＧｄ1に対し
て走査線Ｇが１本おきに接続され、右上側のゲートドラ
イバＧｄ4に対して残りの１本おきの走査線Ｇが接続さ
れている。従って、左右に対向するゲートドライバＧｄ
1とゲートドライバＧｄ4にＧ1〜Ｇ480の合計４８０本の
ゲート線Ｇがそれぞれ１本おきに接続されている。
行うために、信号線Ｓは６４０本設けられているが、走
査線Ｇが４８０×３＝１４４０本設けられている。従っ
てこの形態においては、絵素数は６４０×４８０＝３０
７２００であって図１７に示す従来構造と同等の絵素数
であるが、信号線本数が従来構造の１／３に減少してい
る。ただし、走査線数は図１７に示す従来構造の３倍
（基本色数倍）となる。この構造により、従来と同等の
２４０ピンの駆動用ＬＳＩを用いるとすると、ソースド
ライバＳｄは３個で２４０×３＝７２０本まで対応可能
となり、ＶＧＡで６４０本とすると８０本の余裕が生ま
れるので図１に示すように３個のソースドライバＳｄ1
〜Ｓｄ3が設けられ、実際には２個のソースドライバＳ
ｄの端子全部と３個目のソースドライバＳｄ3の１６０
本程度の端子が信号線Ｓに接続されている。また、ゲー
トドライバＧｄにおいては、走査線必要本数が１４４０
本であるために２４０ピンのＬＳＩを用いるとすると、
６個必要になるので、図１に示すように６個のゲートド
ライバＧｄ1〜Ｇｄ6が設けられている。なお、透明基板
の左上側のゲートドライバＧｄ1と右上側のゲートドラ
イバＧｄ4に対する走査線Ｇの接続形態について説明す
ると、透明基板の左上側のゲートドライバＧｄ1に対し
て走査線Ｇが１本おきに接続され、右上側のゲートドラ
イバＧｄ4に対して残りの１本おきの走査線Ｇが接続さ
れている。従って、左右に対向するゲートドライバＧｄ
1とゲートドライバＧｄ4にＧ1〜Ｇ480の合計４８０本の
ゲート線Ｇがそれぞれ１本おきに接続されている。
【００１７】ここで、ソースドライバＳｄはゲートドラ
イバＧｄよりも倍程度高価であるがために、高価なソー
スドライバＳｄを従来の８個から３個に減少させること
で大幅なコストダウンをなし得る。また、ゲートドライ
バＧｄはソースドライバＳｄの単価において半額程度で
あるので、図１７に示す従来構造で２個必要なものがこ
の形態において６個必要になったとして必要コストが向
上しても、そのための必要コスト増加分は、ソースドラ
イバＳｄの低減によるコスト安の分よりも少なくなる。
従って結果的に表示画素数を全く変えることなく高価な
ソースドライバの削減による低コスト化を実現できたこ
とになる。また、消費電力に関して見ると、消費電力約
２０ｍＷのゲートドライバが６個で１２０ｍＷ、消費電
力約１００ｍＷのソースドライバ３個で３００ｍＷとす
ると、合計で約４２０ｍＷとなり、従来構造の約８４０
ｍＷに対して約半分に抑えることができる。
イバＧｄよりも倍程度高価であるがために、高価なソー
スドライバＳｄを従来の８個から３個に減少させること
で大幅なコストダウンをなし得る。また、ゲートドライ
バＧｄはソースドライバＳｄの単価において半額程度で
あるので、図１７に示す従来構造で２個必要なものがこ
の形態において６個必要になったとして必要コストが向
上しても、そのための必要コスト増加分は、ソースドラ
イバＳｄの低減によるコスト安の分よりも少なくなる。
従って結果的に表示画素数を全く変えることなく高価な
ソースドライバの削減による低コスト化を実現できたこ
とになる。また、消費電力に関して見ると、消費電力約
２０ｍＷのゲートドライバが６個で１２０ｍＷ、消費電
力約１００ｍＷのソースドライバ３個で３００ｍＷとす
ると、合計で約４２０ｍＷとなり、従来構造の約８４０
ｍＷに対して約半分に抑えることができる。
【００１８】ところで、最近ではポリシリコンを用いて
薄膜トランジスタ回路を透明基板上に形成する際に同時
に薄膜トランジスタ駆動回路も形成して液晶用透明基板
に駆動回路を一部内蔵化する構造も見られるが、液晶表
示用の画素電極のオンオフ制御を行うための１ｂｉｔの
ゲートドライバＧｄに比べて６〜８ｂｉｔ程度の多階調
の信号を高速で処理しなくてはならないソースドライバ
Ｓｄの方が消費電力が大きく、ソースドライバＳｄのト
ランジスタ数も多いために、歩留まりも悪い問題があ
る。従って駆動回路を内蔵化した液晶表示装置であって
も、信号線数を減少させ、ソースドライバＳｄを削減す
ることは、低消費電力化と歩留まりの向上化に大きく寄
与する。
薄膜トランジスタ回路を透明基板上に形成する際に同時
に薄膜トランジスタ駆動回路も形成して液晶用透明基板
に駆動回路を一部内蔵化する構造も見られるが、液晶表
示用の画素電極のオンオフ制御を行うための１ｂｉｔの
ゲートドライバＧｄに比べて６〜８ｂｉｔ程度の多階調
の信号を高速で処理しなくてはならないソースドライバ
Ｓｄの方が消費電力が大きく、ソースドライバＳｄのト
ランジスタ数も多いために、歩留まりも悪い問題があ
る。従って駆動回路を内蔵化した液晶表示装置であって
も、信号線数を減少させ、ソースドライバＳｄを削減す
ることは、低消費電力化と歩留まりの向上化に大きく寄
与する。
【００１９】また、この形態においては図３に示すよう
にカラーフィルタのＲＧＢ配置を行ったが、カラーフィ
ルタのＲＧＢ配置はこの形態のように限るものではな
い。
にカラーフィルタのＲＧＢ配置を行ったが、カラーフィ
ルタのＲＧＢ配置はこの形態のように限るものではな
い。
【００２０】次に、図１〜図３を基に先に示した形態の
液晶表示装置を駆動する場合について説明する。前記の
形態の液晶表示装置の駆動方法を説明するにあたり、図
１７と図１８に示す従来の液晶表示装置の駆動方法と対
比させて以下に説明する。図１７と図１８に示す従来の
液晶表示装置においてＶＧＡで６４０×４８０絵素の表
示を行う場合、フレーム周波数は６０Ｈｚ（１秒間に６
０回画面を書き換える）とされるので、１画面を書き換
えるために、約１６ｍｓｅｃの時間を要する。即ち、こ
の１６ｍｓｅｃの間に、４８０本の走査線をスキャンす
ることになる。従って、ゲートドライバＧｄが１本１本
の走査線をスキャンしてゆく周波数は、６０Ｈｚ×４８
０本で、約３０ｋＨｚ（１本あたり約３０μｓｅｃ）と
なる。一方、信号線側について、ソースドライバＳｄに
は、信号線６４０×３＝１９２０本分の信号が時系列に
送られ、それを一時ため込んで１９２０本分を一斉に吐
き出すように構成されている。従って、時系列に送られ
てくる信号を１絵素分（３画素分）ずつ読み取るための
ドットクロックは、３０ｋＨｚ×６４０本分と帰線期間
を含めて約２５ＭＨｚとなる。
液晶表示装置を駆動する場合について説明する。前記の
形態の液晶表示装置の駆動方法を説明するにあたり、図
１７と図１８に示す従来の液晶表示装置の駆動方法と対
比させて以下に説明する。図１７と図１８に示す従来の
液晶表示装置においてＶＧＡで６４０×４８０絵素の表
示を行う場合、フレーム周波数は６０Ｈｚ（１秒間に６
０回画面を書き換える）とされるので、１画面を書き換
えるために、約１６ｍｓｅｃの時間を要する。即ち、こ
の１６ｍｓｅｃの間に、４８０本の走査線をスキャンす
ることになる。従って、ゲートドライバＧｄが１本１本
の走査線をスキャンしてゆく周波数は、６０Ｈｚ×４８
０本で、約３０ｋＨｚ（１本あたり約３０μｓｅｃ）と
なる。一方、信号線側について、ソースドライバＳｄに
は、信号線６４０×３＝１９２０本分の信号が時系列に
送られ、それを一時ため込んで１９２０本分を一斉に吐
き出すように構成されている。従って、時系列に送られ
てくる信号を１絵素分（３画素分）ずつ読み取るための
ドットクロックは、３０ｋＨｚ×６４０本分と帰線期間
を含めて約２５ＭＨｚとなる。
【００２１】これに対して、図１と図２に示す構造の液
晶表示装置を用いてフレーム周波数を先の場合と同様に
６０Ｈｚとすると、走査線Ｇの本数を図１７と図１８に
示す従来構造に比べてＲ、Ｇ、Ｂ用に３倍としているの
で、走査速度を３倍として駆動する。具体的には、走査
線Ｇを４８０×３＝１４４０本、信号線Ｓを６４０本と
しているので、ゲートドライバＧｄが走査線Ｇをスキャ
ンする場合の周波数は、６０Ｈｚ×４８０×３本＝約９
０ｋＨｚとなる。ここで通常使用されているゲートドラ
イバでは、約１００ｋＨｚまで動作可能であり、この点
からみれば、従来構造と同じゲートドライバを用いるこ
とができる。一方、図１と図２に示す構造では、信号線
Ｓを図１７と図１８に示す従来構造の１／３の６４０本
にできるために、ソースドライバＳｄのドットクロック
は９０ｋＨｚ×６４０／３本分と帰線期間を含めて約２
５ＭＨｚ（１絵素が３画素に相当するため）となり従来
構造の場合と変わらない。従って図１と図２に示す構造
であると、図１７と図１８に示す従来構造と同じゲート
ドライバＧｄおよびソースドライバＳｄをそのまま用い
ることができる。
晶表示装置を用いてフレーム周波数を先の場合と同様に
６０Ｈｚとすると、走査線Ｇの本数を図１７と図１８に
示す従来構造に比べてＲ、Ｇ、Ｂ用に３倍としているの
で、走査速度を３倍として駆動する。具体的には、走査
線Ｇを４８０×３＝１４４０本、信号線Ｓを６４０本と
しているので、ゲートドライバＧｄが走査線Ｇをスキャ
ンする場合の周波数は、６０Ｈｚ×４８０×３本＝約９
０ｋＨｚとなる。ここで通常使用されているゲートドラ
イバでは、約１００ｋＨｚまで動作可能であり、この点
からみれば、従来構造と同じゲートドライバを用いるこ
とができる。一方、図１と図２に示す構造では、信号線
Ｓを図１７と図１８に示す従来構造の１／３の６４０本
にできるために、ソースドライバＳｄのドットクロック
は９０ｋＨｚ×６４０／３本分と帰線期間を含めて約２
５ＭＨｚ（１絵素が３画素に相当するため）となり従来
構造の場合と変わらない。従って図１と図２に示す構造
であると、図１７と図１８に示す従来構造と同じゲート
ドライバＧｄおよびソースドライバＳｄをそのまま用い
ることができる。
【００２２】以上のような液晶駆動方式におけるデータ
入力フォーマットついて更に詳細に説明すると、図１７
と図１８に示されるような従来の液晶表示装置にあって
は、ソースドライバＳｄに対する入力信号は、図６に示
すように３つの入力ラインから、第１ラインｌ1にはＲ
データ（Ｒ１、Ｒ２、Ｒ３・・・Ｒ６４０）が送られ、第
２ラインｌ2にはＧデータ（Ｇ１、Ｇ２、Ｇ３・・・Ｇ６４
０）が送られ、第３ラインにはＢデータ（Ｂ１、Ｂ２、
Ｂ３・・・Ｂ６４０）が送られ、ソースドライバＳｄに送
られた信号は１水平走査期間分ずつ蓄積されてからソー
スドライバＳｄにてシリアル―パラレル変換された形
で、図６あるいは図１９に示す信号線Ｓ1、Ｓ2、Ｓ3、
Ｓ4、Ｓ5、・・・Ｓnに対して、図６に示すようにＲ1、
Ｇ1、Ｂ1、Ｒ2、Ｇ2、Ｂ2、・・・Ｒn、Ｇn、Ｂnのように
出力される。
入力フォーマットついて更に詳細に説明すると、図１７
と図１８に示されるような従来の液晶表示装置にあって
は、ソースドライバＳｄに対する入力信号は、図６に示
すように３つの入力ラインから、第１ラインｌ1にはＲ
データ（Ｒ１、Ｒ２、Ｒ３・・・Ｒ６４０）が送られ、第
２ラインｌ2にはＧデータ（Ｇ１、Ｇ２、Ｇ３・・・Ｇ６４
０）が送られ、第３ラインにはＢデータ（Ｂ１、Ｂ２、
Ｂ３・・・Ｂ６４０）が送られ、ソースドライバＳｄに送
られた信号は１水平走査期間分ずつ蓄積されてからソー
スドライバＳｄにてシリアル―パラレル変換された形
で、図６あるいは図１９に示す信号線Ｓ1、Ｓ2、Ｓ3、
Ｓ4、Ｓ5、・・・Ｓnに対して、図６に示すようにＲ1、
Ｇ1、Ｂ1、Ｒ2、Ｇ2、Ｂ2、・・・Ｒn、Ｇn、Ｂnのように
出力される。
【００２３】前記のソースドライバＳｄに対する入力信
号の状態を簡略化して記載すると、図１１に示すように
なり、図１１に示す信号入力形態と図１９に示す液晶表
示装置のＲ、Ｇ、Ｂの画素配列が一致することから、図
１９に示す構造の液晶表示装置に対して適正な駆動信号
を入力できたことになる
号の状態を簡略化して記載すると、図１１に示すように
なり、図１１に示す信号入力形態と図１９に示す液晶表
示装置のＲ、Ｇ、Ｂの画素配列が一致することから、図
１９に示す構造の液晶表示装置に対して適正な駆動信号
を入力できたことになる
【００２４】ここで、図６に示すような従来のデータ入
力フォーマットをそのまま図１と図２に示す液晶表示装
置に適用しようとすると、ソースドライバＳｄが前述と
同じシリアル―パラレル変換を行おうとするので、その
ままでは適正に駆動できないために、図６に示すような
場合と同様の駆動入力を図１と図２に示す液晶表示装置
に適用するためには、別途メモリ等の論理回路を設けて
駆動信号の調整を行わなくてはならない。そこで、従来
と同じソースドライバＳｄをそのまま流用して他に回路
の付加を行わなくとも駆動可能なように、本発明ではデ
ータ入力フォーマットの変更を行う。即ち、図５に示す
ように、ソースドライバＳｄに対する３つの入力ライン
のうち、第１入力ラインＬ1から、Ｒ１、Ｒ４、Ｒ７、・
・・Ｒ６３４、Ｒ６３７、Ｒ６４０、Ｇ１、Ｇ４、Ｇ７、
・・・Ｇ６３４、Ｇ６３７、Ｇ６４０、Ｂ１、Ｂ４、Ｂ
７、・・・Ｂ６３４、Ｂ６３７、Ｂ６４０の順でＲ、Ｇ、
Ｂの信号データを入力し、第２入力ラインＬ2から、Ｒ
２、Ｒ５、Ｒ８、・・・Ｒ６３２、Ｒ６３５、Ｒ６３８、
Ｇ２、Ｇ５、Ｇ８、・・・Ｇ６３２、Ｇ６３５、Ｇ６３
８、Ｂ２、Ｂ５、Ｂ８、・・・Ｂ６３２、Ｂ６３５、Ｂ６
３８の順でＲ、Ｇ、Ｂの信号データを入力し、第３入力
ラインＬ3から、Ｒ３、Ｒ６、Ｒ９、・・・Ｒ６３３、Ｒ６
３６、Ｒ６３９、Ｇ３、Ｇ６、Ｇ９、・・・Ｇ６３３、Ｇ
６３６、Ｇ６３９、Ｂ３、Ｂ６、Ｂ９、・・・Ｂ６３３、
Ｂ６３６、Ｂ６３９の順でＲ、Ｇ、Ｂの信号データを入
力するようなデータ入力フォーマットを採用する。
力フォーマットをそのまま図１と図２に示す液晶表示装
置に適用しようとすると、ソースドライバＳｄが前述と
同じシリアル―パラレル変換を行おうとするので、その
ままでは適正に駆動できないために、図６に示すような
場合と同様の駆動入力を図１と図２に示す液晶表示装置
に適用するためには、別途メモリ等の論理回路を設けて
駆動信号の調整を行わなくてはならない。そこで、従来
と同じソースドライバＳｄをそのまま流用して他に回路
の付加を行わなくとも駆動可能なように、本発明ではデ
ータ入力フォーマットの変更を行う。即ち、図５に示す
ように、ソースドライバＳｄに対する３つの入力ライン
のうち、第１入力ラインＬ1から、Ｒ１、Ｒ４、Ｒ７、・
・・Ｒ６３４、Ｒ６３７、Ｒ６４０、Ｇ１、Ｇ４、Ｇ７、
・・・Ｇ６３４、Ｇ６３７、Ｇ６４０、Ｂ１、Ｂ４、Ｂ
７、・・・Ｂ６３４、Ｂ６３７、Ｂ６４０の順でＲ、Ｇ、
Ｂの信号データを入力し、第２入力ラインＬ2から、Ｒ
２、Ｒ５、Ｒ８、・・・Ｒ６３２、Ｒ６３５、Ｒ６３８、
Ｇ２、Ｇ５、Ｇ８、・・・Ｇ６３２、Ｇ６３５、Ｇ６３
８、Ｂ２、Ｂ５、Ｂ８、・・・Ｂ６３２、Ｂ６３５、Ｂ６
３８の順でＲ、Ｇ、Ｂの信号データを入力し、第３入力
ラインＬ3から、Ｒ３、Ｒ６、Ｒ９、・・・Ｒ６３３、Ｒ６
３６、Ｒ６３９、Ｇ３、Ｇ６、Ｇ９、・・・Ｇ６３３、Ｇ
６３６、Ｇ６３９、Ｂ３、Ｂ６、Ｂ９、・・・Ｂ６３３、
Ｂ６３６、Ｂ６３９の順でＲ、Ｇ、Ｂの信号データを入
力するようなデータ入力フォーマットを採用する。
【００２５】また、１水平走査時間（１Ｈ）の間に３つ
の入力ラインＬ1、Ｌ2、Ｌ3から入力される信号をまと
めて図７に併記した。また、図４に示すようにｎ回目の
走査の場合にＲの線、Ｇの線、Ｂの線の順序で走査し、
次のｎ＋１回目の走査の場合にＲの線、Ｇの線、Ｂの線
の順序で走査し、続くｎ＋２回目の走査の場合にＲの
線、Ｇの線、Ｂの線の順序で走査するという走査を繰り
返し行うことで、先の信号線Ｓ11、Ｓ2、Ｓ3、Ｓ4、
Ｓ5、・・・Ｓnに対する信号入力とともに表示ができたこ
とになる。以上のようなデータ入力フォーマットを採用
することで、ソースドライバＳｄが先の場合と同等のシ
リアル―パラレル変換を行うと、ソースドライバＳｄか
ら図５に示すように、信号線Ｓ11、Ｓ2、Ｓ3、Ｓ4、
Ｓ5、・・・に対し、Ｒ１、Ｒ２、Ｒ３、Ｒ４、Ｒ５・・・の
ように図１と図２に示す構造の液晶表示装置のドット配
置に合致するような適正な信号を入力できたことにな
る。
の入力ラインＬ1、Ｌ2、Ｌ3から入力される信号をまと
めて図７に併記した。また、図４に示すようにｎ回目の
走査の場合にＲの線、Ｇの線、Ｂの線の順序で走査し、
次のｎ＋１回目の走査の場合にＲの線、Ｇの線、Ｂの線
の順序で走査し、続くｎ＋２回目の走査の場合にＲの
線、Ｇの線、Ｂの線の順序で走査するという走査を繰り
返し行うことで、先の信号線Ｓ11、Ｓ2、Ｓ3、Ｓ4、
Ｓ5、・・・Ｓnに対する信号入力とともに表示ができたこ
とになる。以上のようなデータ入力フォーマットを採用
することで、ソースドライバＳｄが先の場合と同等のシ
リアル―パラレル変換を行うと、ソースドライバＳｄか
ら図５に示すように、信号線Ｓ11、Ｓ2、Ｓ3、Ｓ4、
Ｓ5、・・・に対し、Ｒ１、Ｒ２、Ｒ３、Ｒ４、Ｒ５・・・の
ように図１と図２に示す構造の液晶表示装置のドット配
置に合致するような適正な信号を入力できたことにな
る。
【００２６】なお、本発明で用いるソースドライバＳｄ
の内部ブロック構造の一例と信号の流れを図８に示して
おく。この形態で用いるソースドライバＳｄの内部ブロ
ック構造は図８に示す構成とされていて、シフトレジス
タ１５に対してデータの取り込みを指示するスタート信
号が入力されると、サンプリングレジスタ１６に対して
３つの入力ラインＬ1、Ｌ2、Ｌ3から映像信号データが
取り込まれる。次に、ラッチ１７に入力されるラッチ信
号は１水平走査ライン分の映像信号データが全部入った
ところでラッチ１７に取り込みを指示するための信号
で、このラッチ信号によりサンプリングレジスタ１６に
入力されていた映像信号データが一斉にラッチ１７に送
られる。ラッチ１７に入った信号はＤ／Ａコンバータ１
８と出力バッファ１９を介して信号線Ｓ11、Ｓ2、Ｓ3、
Ｓ4、Ｓ5、・・・、Ｓnに送られるようになっている。
の内部ブロック構造の一例と信号の流れを図８に示して
おく。この形態で用いるソースドライバＳｄの内部ブロ
ック構造は図８に示す構成とされていて、シフトレジス
タ１５に対してデータの取り込みを指示するスタート信
号が入力されると、サンプリングレジスタ１６に対して
３つの入力ラインＬ1、Ｌ2、Ｌ3から映像信号データが
取り込まれる。次に、ラッチ１７に入力されるラッチ信
号は１水平走査ライン分の映像信号データが全部入った
ところでラッチ１７に取り込みを指示するための信号
で、このラッチ信号によりサンプリングレジスタ１６に
入力されていた映像信号データが一斉にラッチ１７に送
られる。ラッチ１７に入った信号はＤ／Ａコンバータ１
８と出力バッファ１９を介して信号線Ｓ11、Ｓ2、Ｓ3、
Ｓ4、Ｓ5、・・・、Ｓnに送られるようになっている。
【００２７】以上のように本発明では従来と異なる特殊
なデータ入力フォーマットを採用するので、液晶表示装
置に接続されるパソコン等の映像信号発生装置との間に
従来のような図６を基にした従来標準のデータ入力フォ
ーマットを図５を基に説明したデータ入力フォーマット
に変換する回路を設ける必要がある。そのような回路を
液晶表示装置に接続した一例の構造を図９に示す。図９
に示す構造においては、液晶表示装置１０にデマルチプ
レクサ２０を介してゲートドライバＧｄが接続され、デ
マルチプレクサ２０とゲートドライバＧｄに接続された
レベルシフタ２１に制御変換回路２２が接続され、制御
変換回路２２にソースドライバＳｄも接続されて構成さ
れている。
なデータ入力フォーマットを採用するので、液晶表示装
置に接続されるパソコン等の映像信号発生装置との間に
従来のような図６を基にした従来標準のデータ入力フォ
ーマットを図５を基に説明したデータ入力フォーマット
に変換する回路を設ける必要がある。そのような回路を
液晶表示装置に接続した一例の構造を図９に示す。図９
に示す構造においては、液晶表示装置１０にデマルチプ
レクサ２０を介してゲートドライバＧｄが接続され、デ
マルチプレクサ２０とゲートドライバＧｄに接続された
レベルシフタ２１に制御変換回路２２が接続され、制御
変換回路２２にソースドライバＳｄも接続されて構成さ
れている。
【００２８】本発明においては従来と異なる前述の特殊
なデータ入力フォーマットを採用するので、液晶表示装
置１０に接続されるパソコン等の映像信号発生装置２３
との間に従来のような図６を基にした標準のデータ入力
フォーマットを図５を基に説明したデータ入力フォーマ
ットに変換する信号入力手段Ｎを設ける必要があるの
で、この例では制御変換回路２２にこのような信号入力
手段Ｎを内蔵しておくこととする。この信号入力手段Ｎ
は具体的には映像信号を記憶しておくグラフィックメモ
リから映像信号を読み出す際の順序を変える変換回路で
良い。これにより、映像信号発生装置２３から制御変換
回路２２に入力されるデータ信号入力フォーマットは従
来と同じ方式であっても、この制御変換回路２２の信号
入力回路Ｎにおいて図５を基に説明したデータ入力フォ
ーマットに変換することで、映像信号発生装置２３とデ
マルチプレクサ２０とゲートドライバＧｄとレベルシフ
タ２１とソースドライバＳｄ等の駆動回路系を従来のも
のから一切変更することなく本発明の表示装置を駆動す
ることができるようになる。なお、このデータ変換を行
う信号入力手段Ｎを制御変換回路２２に内蔵しなくとも
良いのは勿論であり、パソコン等の映像信号発生装置２
３側に設けても、映像信号発生装置２３と制御変換回路
２２との間に設けても良い。
なデータ入力フォーマットを採用するので、液晶表示装
置１０に接続されるパソコン等の映像信号発生装置２３
との間に従来のような図６を基にした標準のデータ入力
フォーマットを図５を基に説明したデータ入力フォーマ
ットに変換する信号入力手段Ｎを設ける必要があるの
で、この例では制御変換回路２２にこのような信号入力
手段Ｎを内蔵しておくこととする。この信号入力手段Ｎ
は具体的には映像信号を記憶しておくグラフィックメモ
リから映像信号を読み出す際の順序を変える変換回路で
良い。これにより、映像信号発生装置２３から制御変換
回路２２に入力されるデータ信号入力フォーマットは従
来と同じ方式であっても、この制御変換回路２２の信号
入力回路Ｎにおいて図５を基に説明したデータ入力フォ
ーマットに変換することで、映像信号発生装置２３とデ
マルチプレクサ２０とゲートドライバＧｄとレベルシフ
タ２１とソースドライバＳｄ等の駆動回路系を従来のも
のから一切変更することなく本発明の表示装置を駆動す
ることができるようになる。なお、このデータ変換を行
う信号入力手段Ｎを制御変換回路２２に内蔵しなくとも
良いのは勿論であり、パソコン等の映像信号発生装置２
３側に設けても、映像信号発生装置２３と制御変換回路
２２との間に設けても良い。
【００２９】即ち、図５と図７に示すようなデータ入力
フォーマットにすることにより３倍の速度で走査できる
ことが可能となり、また、この場合のデータの入力順序
はグラフィックメモリの読出順序を変更することで容易
に対応できる。更に、データ入力レートについて、通常
の６４０×４８０のＶＧＡ表示においては８００絵素分
のデータ（これらのうち、有効データは６４０）入力が
なされている。図７に示すようなデータ入力フォーマッ
トであっても、ＲＴ、ＧＴ、ＢＴの期間は、それぞれ２
１４画素分であり、合わせて６４２画素（２１４×３）
であり、従来のブランキング期間を２画素分減らすこと
で容易に対応できることから、データの入力レート（入
力速度）を従来と全く同じにしても何ら問題は生じな
い。
フォーマットにすることにより３倍の速度で走査できる
ことが可能となり、また、この場合のデータの入力順序
はグラフィックメモリの読出順序を変更することで容易
に対応できる。更に、データ入力レートについて、通常
の６４０×４８０のＶＧＡ表示においては８００絵素分
のデータ（これらのうち、有効データは６４０）入力が
なされている。図７に示すようなデータ入力フォーマッ
トであっても、ＲＴ、ＧＴ、ＢＴの期間は、それぞれ２
１４画素分であり、合わせて６４２画素（２１４×３）
であり、従来のブランキング期間を２画素分減らすこと
で容易に対応できることから、データの入力レート（入
力速度）を従来と全く同じにしても何ら問題は生じな
い。
【００３０】更に、理解の容易化のために、本発明の液
晶表示装置１０におけるソースドライバＳｄに対するデ
ータ入力フォーマットの入力状態とソースドライバＳｄ
から液晶表示装置に対するデータ出力フォーマットの出
力状態を図１０に簡略的に示す。図１０に示す本発明に
係る信号と、図１１、１９、２０に示す従来構造とその
信号を比較することで、従来の液晶表示装置１の各絵素
を構成する画素の形状と各画素に対する駆動信号の状
態、並びに、本発明装置の液晶表示装置１０の各絵素を
構成する画素の形状と各画素に対する駆動信号の状態を
比較してその差異を容易に把握することができる。
晶表示装置１０におけるソースドライバＳｄに対するデ
ータ入力フォーマットの入力状態とソースドライバＳｄ
から液晶表示装置に対するデータ出力フォーマットの出
力状態を図１０に簡略的に示す。図１０に示す本発明に
係る信号と、図１１、１９、２０に示す従来構造とその
信号を比較することで、従来の液晶表示装置１の各絵素
を構成する画素の形状と各画素に対する駆動信号の状
態、並びに、本発明装置の液晶表示装置１０の各絵素を
構成する画素の形状と各画素に対する駆動信号の状態を
比較してその差異を容易に把握することができる。
【００３１】次に、図１と図２に示す構造であると、以
下の効果を奏することができる。 図１と図２に示す構造は、図１７と図１８に示す従来
構造の液晶表示装置と比べて画質的な劣化を全く生じな
い。即ち、１画面を空間的に見ると、絵素数は図１に示
す構造も図１７に示す構造も３０７２００であり、解像
度の変化は生じない。また、時間的に見ても、図１に示
す構造も図１７に示す構造もフレーム周波数は６０Ｈｚ
で同じなので、動画表示の面でも全く問題ない。 図１と図２に示す構造では、図１７と図１８に示す従
来構造の液晶表示装置と比べて同じゲートドライバと同
じソースドライバを使用することができ、しかも、安価
なゲートドライバを２個から６個に増やす必要があるも
のの、ゲートドライバの２倍程度高価なソースドライバ
を８個から３個に減少させることができるので、全体と
して低コスト化できる。
下の効果を奏することができる。 図１と図２に示す構造は、図１７と図１８に示す従来
構造の液晶表示装置と比べて画質的な劣化を全く生じな
い。即ち、１画面を空間的に見ると、絵素数は図１に示
す構造も図１７に示す構造も３０７２００であり、解像
度の変化は生じない。また、時間的に見ても、図１に示
す構造も図１７に示す構造もフレーム周波数は６０Ｈｚ
で同じなので、動画表示の面でも全く問題ない。 図１と図２に示す構造では、図１７と図１８に示す従
来構造の液晶表示装置と比べて同じゲートドライバと同
じソースドライバを使用することができ、しかも、安価
なゲートドライバを２個から６個に増やす必要があるも
のの、ゲートドライバの２倍程度高価なソースドライバ
を８個から３個に減少させることができるので、全体と
して低コスト化できる。
【００３２】消費電力を低減できる。ドライバ消費電
力については、ゲートドライバの約２０ｍＷの消費電力
のものを６個必要とするので１２０ｍＷであるが、ゲー
トドライバ１個あたりの消費電力は走査線をスキャンす
る場合の周波数が３倍になったために、３倍となり、合
計で３６０ｍＷとなり、ソースドライバの約１００ｍＷ
のものを３個必要とするので３００ｍＷとすると、全部
で合計６６０ｍＷ必要になるが、従来構造では約８４０
ｍＷ必要であったので、約４／５程度に削減できる。
力については、ゲートドライバの約２０ｍＷの消費電力
のものを６個必要とするので１２０ｍＷであるが、ゲー
トドライバ１個あたりの消費電力は走査線をスキャンす
る場合の周波数が３倍になったために、３倍となり、合
計で３６０ｍＷとなり、ソースドライバの約１００ｍＷ
のものを３個必要とするので３００ｍＷとすると、全部
で合計６６０ｍＷ必要になるが、従来構造では約８４０
ｍＷ必要であったので、約４／５程度に削減できる。
【００３３】次に、図１と図２に示す構造を採用した場
合の駆動方法の他の形態について図１２を基に以下に説
明する。先の駆動方法の実施形態は、全ての画素を１フ
ィールド内で駆動する方法であったが、本発明において
は飛び越し走査を行うこともできる。即ち、図１２に示
すように１つの走査線に対応するｎ番目の走査線のう
ち、１つの色のみを走査駆動することにより、ソースド
ライバＳｄにデータを入力する期間を１／３にすること
が可能となる。この場合に１フィールドにおいて全画素
がリフレッシュされないが、静止画のような動きの無い
表示形態の場合には、表示品質の劣化を伴わずに先の形
態の場合よりも更に消費電力を削減することができるよ
うになる。
合の駆動方法の他の形態について図１２を基に以下に説
明する。先の駆動方法の実施形態は、全ての画素を１フ
ィールド内で駆動する方法であったが、本発明において
は飛び越し走査を行うこともできる。即ち、図１２に示
すように１つの走査線に対応するｎ番目の走査線のう
ち、１つの色のみを走査駆動することにより、ソースド
ライバＳｄにデータを入力する期間を１／３にすること
が可能となる。この場合に１フィールドにおいて全画素
がリフレッシュされないが、静止画のような動きの無い
表示形態の場合には、表示品質の劣化を伴わずに先の形
態の場合よりも更に消費電力を削減することができるよ
うになる。
【００３４】具体的には、ゲートドライバが走査線をス
キャンする周波数は、図１７と図１８に示す従来構造の
駆動の場合と同じ約３０ｋＨｚとなり、本発明の先に記
載した第１の実施形態の駆動方法の場合の１／３とする
ことができる。また、それに伴って、ドットクロックも
ＶＧＡ表示の場合に３０ｋＨｚ×６４０本となり、図１
７と図１８に示す従来構造の駆動と同じ約３０ｋＨｚ、
即ち、本発明に係る先の形態の場合の１／３となる。
キャンする周波数は、図１７と図１８に示す従来構造の
駆動の場合と同じ約３０ｋＨｚとなり、本発明の先に記
載した第１の実施形態の駆動方法の場合の１／３とする
ことができる。また、それに伴って、ドットクロックも
ＶＧＡ表示の場合に３０ｋＨｚ×６４０本となり、図１
７と図１８に示す従来構造の駆動と同じ約３０ｋＨｚ、
即ち、本発明に係る先の形態の場合の１／３となる。
【００３５】以上のような飛び越し走査の駆動方法を採
用した場合、以下に説明する効果を得ることができる。 図１７と図１８に示す従来構造で用いたものと同等の
ゲートドライバとソースドライバを用いることができ、
しかも、安価なゲートドライバを２個から６個に増やす
必要があるものの、高価なソースドライバを８個から３
個に減少させることができるので、低コストにすること
ができる。
用した場合、以下に説明する効果を得ることができる。 図１７と図１８に示す従来構造で用いたものと同等の
ゲートドライバとソースドライバを用いることができ、
しかも、安価なゲートドライバを２個から６個に増やす
必要があるものの、高価なソースドライバを８個から３
個に減少させることができるので、低コストにすること
ができる。
【００３６】また、消費電力に関して見ると、消費電
力約２０ｍＷのゲートドライバが６個で１２０ｍＷ、消
費電力約１００ｍＷのソースドライバ３個で３００ｍＷ
とすると、合計で約４２０ｍＷとなり、従来構造の約８
４０ｍＷに対して約半分に抑えることができる。 回路の設計変更部を少なくして実現できる（先の第１
形態の場合よりも従来構造を流用できる）。特に、１つ
のフレームを基本色数のフィールド（この形態の場合は
Ｒ、Ｇ、Ｂの３フィールド）ごとに分け、フィールド周
波数を６０Ｈｚとし、間を２本飛ばして走査することに
より、ゲートドライバの走査線をスキャンする周波数を
従来と全く同じ６４０×４８０本で約３０ｋＨｚとする
ことができ、ゲートドライバの周辺回路を従来構造と同
じようにすることができる。
力約２０ｍＷのゲートドライバが６個で１２０ｍＷ、消
費電力約１００ｍＷのソースドライバ３個で３００ｍＷ
とすると、合計で約４２０ｍＷとなり、従来構造の約８
４０ｍＷに対して約半分に抑えることができる。 回路の設計変更部を少なくして実現できる（先の第１
形態の場合よりも従来構造を流用できる）。特に、１つ
のフレームを基本色数のフィールド（この形態の場合は
Ｒ、Ｇ、Ｂの３フィールド）ごとに分け、フィールド周
波数を６０Ｈｚとし、間を２本飛ばして走査することに
より、ゲートドライバの走査線をスキャンする周波数を
従来と全く同じ６４０×４８０本で約３０ｋＨｚとする
ことができ、ゲートドライバの周辺回路を従来構造と同
じようにすることができる。
【００３７】なお、飛び越し走査する場合に色の偏りを
生じないようにｎ番目の走査線のうちでＲを選択したな
らば、次のｎ＋１番目の走査線のうちではＧを選択し、
更に次のｎ＋２番目の走査線のうちではＢを選択するこ
とを繰り返し行うことが好ましい。また、走査線の選択
順序はこの形態の如く、Ｒ、Ｇ、Ｂの順番に限らず、
Ｒ、Ｂ、Ｇの順、Ｇ、Ｒ、Ｂの順等のいずれでも良い。
生じないようにｎ番目の走査線のうちでＲを選択したな
らば、次のｎ＋１番目の走査線のうちではＧを選択し、
更に次のｎ＋２番目の走査線のうちではＢを選択するこ
とを繰り返し行うことが好ましい。また、走査線の選択
順序はこの形態の如く、Ｒ、Ｇ、Ｂの順番に限らず、
Ｒ、Ｂ、Ｇの順、Ｇ、Ｒ、Ｂの順等のいずれでも良い。
【００３８】図１３にこのような飛び越し走査の場合の
入力データとソースドライバ用出力データの比較を示
す。入力データにおいては、先の形態と同様にｎ番目、
ｎ＋１番目、ｎ＋２番目、ｎ＋３番目・・・の順に全ての
データが送られてくるが、ソースドライバＳｄに対する
ドライバの出力は、ｎ番目のＲとＧとＢの入力データに
対応する期間だけＢを出力し、ｎ＋１番目のＲとＧとＢ
の入力データに対応する期間だけＲを出力し、ｎ＋２番
目のＲとＧとＢの入力データに対応する期間だけＧを出
力し、ｎ＋３番目のＲとＧとＢの入力データに対応する
期間だけＢを出力することを順次繰り返し行うことにな
る。
入力データとソースドライバ用出力データの比較を示
す。入力データにおいては、先の形態と同様にｎ番目、
ｎ＋１番目、ｎ＋２番目、ｎ＋３番目・・・の順に全ての
データが送られてくるが、ソースドライバＳｄに対する
ドライバの出力は、ｎ番目のＲとＧとＢの入力データに
対応する期間だけＢを出力し、ｎ＋１番目のＲとＧとＢ
の入力データに対応する期間だけＲを出力し、ｎ＋２番
目のＲとＧとＢの入力データに対応する期間だけＧを出
力し、ｎ＋３番目のＲとＧとＢの入力データに対応する
期間だけＢを出力することを順次繰り返し行うことにな
る。
【００３９】なお、図１３に示した入力データとソース
ドライバの出力データのタイミング関係と同じようなタ
イミング関係を従来装置に対して行った場合（図１７〜
図１９に示す液晶表示装置を用いて従来の駆動を行った
場合）のデータタイミング関係を図１４（Ａ）に示し、
図１３に示した入力データとソースドライバの出力デー
タのタイミング関係と同じようなタイミング関係を先の
実施形態の装置に対して行った場合（図１〜図３に示す
本発明の液晶表示装置を用いて本発明の駆動を行った場
合）のデータタイミング関係を図１４（Ｂ）に示す。図
１３に示す出力データに基づく駆動であるならば、図１
４（Ａ）に示す従来の駆動と同じようなドライバ出力タ
イミングで出力できるので、駆動回路に従来のものを使
用できることが明かである。
ドライバの出力データのタイミング関係と同じようなタ
イミング関係を従来装置に対して行った場合（図１７〜
図１９に示す液晶表示装置を用いて従来の駆動を行った
場合）のデータタイミング関係を図１４（Ａ）に示し、
図１３に示した入力データとソースドライバの出力デー
タのタイミング関係と同じようなタイミング関係を先の
実施形態の装置に対して行った場合（図１〜図３に示す
本発明の液晶表示装置を用いて本発明の駆動を行った場
合）のデータタイミング関係を図１４（Ｂ）に示す。図
１３に示す出力データに基づく駆動であるならば、図１
４（Ａ）に示す従来の駆動と同じようなドライバ出力タ
イミングで出力できるので、駆動回路に従来のものを使
用できることが明かである。
【００４０】ところで、前記の各形態においては、薄膜
トランジスタを用いた液晶表示装置（ＴＦＴ-ＬＣＤ）
の場合を基に説明したが、複数の基本色（例えば、Ｒ、
Ｇ、Ｂ）を組み合わせて１つの色を表示する絵素を配列
し、マトリクス駆動する表示装置においては、同様の効
果を期待できるので、単純マトリクス液晶表示装置、Ｆ
ＥＤ（フィールドエミッションディスプレイ）、強誘電
液晶表示装置、プラズマディスプレイ、ＥＬディスプレ
イ等に広く本発明を適用できるのは勿論である。 ま
た、１つの絵素を基本色に分割する場合、２色分割ある
いは４色分割等も可能であるので、それらの分割の場合
は走査線数を従来の２倍あるいは４倍として対応し、カ
ラーフィルタの配置も２色あるいは４色を前述のような
横ストライプ配置とすれば良い。
トランジスタを用いた液晶表示装置（ＴＦＴ-ＬＣＤ）
の場合を基に説明したが、複数の基本色（例えば、Ｒ、
Ｇ、Ｂ）を組み合わせて１つの色を表示する絵素を配列
し、マトリクス駆動する表示装置においては、同様の効
果を期待できるので、単純マトリクス液晶表示装置、Ｆ
ＥＤ（フィールドエミッションディスプレイ）、強誘電
液晶表示装置、プラズマディスプレイ、ＥＬディスプレ
イ等に広く本発明を適用できるのは勿論である。 ま
た、１つの絵素を基本色に分割する場合、２色分割ある
いは４色分割等も可能であるので、それらの分割の場合
は走査線数を従来の２倍あるいは４倍として対応し、カ
ラーフィルタの配置も２色あるいは４色を前述のような
横ストライプ配置とすれば良い。
【００４１】図１５と図１６は本発明を単純マトリクス
式の液晶表示装置に適用した例を示すもので、２枚の透
明基板間に液晶が封入され、一方の透明基板の液晶側に
カラーフィルタが設けられ、更に、この一方の透明基板
に透明導電層製の走査線Ｇ1、Ｇ2・・・が、他方の基板の
液晶側に透明導電層からなる信号線Ｓ1、Ｓ2・・・が交差
するように対向配置されて液晶表示装置１００が構成さ
れている。なお、図１６は図１５に示す液晶表示装置１
００の１つの絵素７０のみを拡大して示すもので、この
形態においてもカラーフィルタは、Ｒ、Ｇ、Ｂに３分割
され、Ｒ、Ｇ、Ｂで３分割された各領域毎に走査線Ｇが
設けられている。また、透明基板の上縁部にはセグメン
トドライバＳｇ1、Ｓｇ2、Ｓｇ3が設けられ、各ドライ
バの端子がそれぞれ信号線Ｓに接続されるとともに、透
明基板の左右両縁部にはそれぞれ３個、合計６個のコモ
ンドライバＣｄ（Ｃｄ1〜Ｃｄ6）が設けられ、各ドライ
バの端子がそれぞれ走査線Ｇに接続されている。なお、
この例においても先の例の場合と同様に、多数配列され
たゲート線Ｇ…のうち、１本おきのゲート線Ｇ…が左側
のコモンドライバＣｄに、残りの１本おきのゲート線Ｇ
…が右側のコモンドライバに接続されている。この例に
おいては信号線Ｓと３つの走査線Ｇとが挟んで区画する
領域に絵素が構成され、その絵素が３つの画素に分割さ
れて構成されることで目的を達成している。このように
単純マトリクス式の液晶表示装置にあっては、対向して
交差する信号線Ｓと走査線Ｇの交差部分の間に存在する
液晶に電界が印加されて液晶が駆動されるのでこの信号
線Ｓと走査線Ｇが交差する部分が１つの画素を構成す
る。
式の液晶表示装置に適用した例を示すもので、２枚の透
明基板間に液晶が封入され、一方の透明基板の液晶側に
カラーフィルタが設けられ、更に、この一方の透明基板
に透明導電層製の走査線Ｇ1、Ｇ2・・・が、他方の基板の
液晶側に透明導電層からなる信号線Ｓ1、Ｓ2・・・が交差
するように対向配置されて液晶表示装置１００が構成さ
れている。なお、図１６は図１５に示す液晶表示装置１
００の１つの絵素７０のみを拡大して示すもので、この
形態においてもカラーフィルタは、Ｒ、Ｇ、Ｂに３分割
され、Ｒ、Ｇ、Ｂで３分割された各領域毎に走査線Ｇが
設けられている。また、透明基板の上縁部にはセグメン
トドライバＳｇ1、Ｓｇ2、Ｓｇ3が設けられ、各ドライ
バの端子がそれぞれ信号線Ｓに接続されるとともに、透
明基板の左右両縁部にはそれぞれ３個、合計６個のコモ
ンドライバＣｄ（Ｃｄ1〜Ｃｄ6）が設けられ、各ドライ
バの端子がそれぞれ走査線Ｇに接続されている。なお、
この例においても先の例の場合と同様に、多数配列され
たゲート線Ｇ…のうち、１本おきのゲート線Ｇ…が左側
のコモンドライバＣｄに、残りの１本おきのゲート線Ｇ
…が右側のコモンドライバに接続されている。この例に
おいては信号線Ｓと３つの走査線Ｇとが挟んで区画する
領域に絵素が構成され、その絵素が３つの画素に分割さ
れて構成されることで目的を達成している。このように
単純マトリクス式の液晶表示装置にあっては、対向して
交差する信号線Ｓと走査線Ｇの交差部分の間に存在する
液晶に電界が印加されて液晶が駆動されるのでこの信号
線Ｓと走査線Ｇが交差する部分が１つの画素を構成す
る。
【００４２】なお、前述の各形態の説明においては、６
４０×４８０絵素のＶＧＡの場合について説明したが、
この他にも画面の表示形態は種々のものがあり、走査線
数４８０本のＮＴＳＣ方式のテレビ画面、走査線数５７
０本のＰＡＬ方式のテレビ画面、走査線数１１２５本の
ＨＤＴＶ方式、走査線数６００本のＳＶＧＡ、走査線数
７６８本のＸＧＡ、走査線数１０２４本のＥＷＳ等の種
々の規格に合わせて本発明構造を適用できるのは勿論で
ある。
４０×４８０絵素のＶＧＡの場合について説明したが、
この他にも画面の表示形態は種々のものがあり、走査線
数４８０本のＮＴＳＣ方式のテレビ画面、走査線数５７
０本のＰＡＬ方式のテレビ画面、走査線数１１２５本の
ＨＤＴＶ方式、走査線数６００本のＳＶＧＡ、走査線数
７６８本のＸＧＡ、走査線数１０２４本のＥＷＳ等の種
々の規格に合わせて本発明構造を適用できるのは勿論で
ある。
【００４３】また、前記図３〜図５を基に説明した第１
の実施形態の駆動方法と図１２と図１３を基に説明した
飛び越し走査の駆動方法を切り替えて使用する構造とす
ることもできる。例えば、液晶表示装置がノートパソコ
ン用に用いられた場合は、ノートパソコンの表示装置回
りに切替用のスイッチを設けておき、このスイッチによ
り図３〜図５を基に説明した駆動方法をなす駆動回路と
図１２と図１３を基に説明した駆動方法をなす駆動回路
を切り替えて表示装置の表示状態を使用目的に合わせて
変更できるように構成しても良い。次に、本発明の信号
入力手段Ｎを設けるのは、図１〜図３に基本構成を示す
３倍走査線型の液晶表示装置に限るものではなく、走査
線数と信号線数が一般の本数のものであっても良い。そ
の場合においても信号入力手段により各一走査線当たり
の各信号線に送る信号を順次ソースドライバに送るよう
な構成とすることで対応することができる。
の実施形態の駆動方法と図１２と図１３を基に説明した
飛び越し走査の駆動方法を切り替えて使用する構造とす
ることもできる。例えば、液晶表示装置がノートパソコ
ン用に用いられた場合は、ノートパソコンの表示装置回
りに切替用のスイッチを設けておき、このスイッチによ
り図３〜図５を基に説明した駆動方法をなす駆動回路と
図１２と図１３を基に説明した駆動方法をなす駆動回路
を切り替えて表示装置の表示状態を使用目的に合わせて
変更できるように構成しても良い。次に、本発明の信号
入力手段Ｎを設けるのは、図１〜図３に基本構成を示す
３倍走査線型の液晶表示装置に限るものではなく、走査
線数と信号線数が一般の本数のものであっても良い。そ
の場合においても信号入力手段により各一走査線当たり
の各信号線に送る信号を順次ソースドライバに送るよう
な構成とすることで対応することができる。
【００４４】
【発明の効果】以上説明したように本発明によれば、信
号入力手段により各一走査線当たりの各信号線に送る信
号を順次ソースドライバに送ることができるので、１水
平走査期間の間に駆動される色のデータの順番で駆動信
号のデータ入力を行うことができるとともに、マトリク
ス配置された各画素に対して好ましい信号入力形態をと
ることができる。また、従来装置で用いられている駆動
信号のデータ入力フォーマットの一部を変更して駆動信
号の一部を入れ替えるのみで実現できるので、回路変更
も最低限で良く、容易に実現できる特徴を有する。更
に、前記の構造において、走査線の数が前記信号線に沿
って並ぶ全画素の数にされ、前記信号線に沿って配列さ
れた基本色の順番が前記信号線に沿って繰り返し同じ順
番とされた構造を採用するならば、従来構造の表示装置
と比べて画質的な劣化を全く生じることなく、従来構造
の液晶表示装置と同じゲートドライバとソースドライバ
を使用して表示することができ、しかも、消費電力の大
きなソースドライバを大幅に削減することができる。更
に、ソースドライバよりも消費電力の小さいゲートドラ
イバの必要数は増加するものの、ゲートドライバの増加
による消費電力増加分よりもソースドライバの削減によ
る消費電力減の方を大きくできるので、全体として従来
構造よりも低消費電力にすることができる。
号入力手段により各一走査線当たりの各信号線に送る信
号を順次ソースドライバに送ることができるので、１水
平走査期間の間に駆動される色のデータの順番で駆動信
号のデータ入力を行うことができるとともに、マトリク
ス配置された各画素に対して好ましい信号入力形態をと
ることができる。また、従来装置で用いられている駆動
信号のデータ入力フォーマットの一部を変更して駆動信
号の一部を入れ替えるのみで実現できるので、回路変更
も最低限で良く、容易に実現できる特徴を有する。更
に、前記の構造において、走査線の数が前記信号線に沿
って並ぶ全画素の数にされ、前記信号線に沿って配列さ
れた基本色の順番が前記信号線に沿って繰り返し同じ順
番とされた構造を採用するならば、従来構造の表示装置
と比べて画質的な劣化を全く生じることなく、従来構造
の液晶表示装置と同じゲートドライバとソースドライバ
を使用して表示することができ、しかも、消費電力の大
きなソースドライバを大幅に削減することができる。更
に、ソースドライバよりも消費電力の小さいゲートドラ
イバの必要数は増加するものの、ゲートドライバの増加
による消費電力増加分よりもソースドライバの削減によ
る消費電力減の方を大きくできるので、全体として従来
構造よりも低消費電力にすることができる。
【００４５】ここで例えば、１つの絵素を３つの基本色
で構成する場合は、走査線本数を従来の３倍、ゲートド
ライバ数を従来の３倍とする必要があるが、信号線本数
を従来の１／３、ソースドライバ数を従来の１／３とす
ることができる。次に、ドライバの消費電力について
は、消費電力の大きなソースドライバを大幅に削減でき
るので、ゲートドライバの増加分を差し引いても全体と
して消費電力を抑制することができる。
で構成する場合は、走査線本数を従来の３倍、ゲートド
ライバ数を従来の３倍とする必要があるが、信号線本数
を従来の１／３、ソースドライバ数を従来の１／３とす
ることができる。次に、ドライバの消費電力について
は、消費電力の大きなソースドライバを大幅に削減でき
るので、ゲートドライバの増加分を差し引いても全体と
して消費電力を抑制することができる。
【００４６】一方、先に記載の構成において１つのフレ
ームを複数のフィールドに分割し、フィールド毎に走査
することで、従来構造の駆動の場合と同様に表示装置を
駆動することができる。また、先に記載の構成において
１つのフレームを複数のフィールドに分割し、所定のフ
ィールド毎に飛び越し走査することにより、走査線数の
増加に拘わらず走査する周波数を従来構造の駆動の場合
と同程度にできるので、ソースドライバ１個あたりの消
費電力を更に低減できて省電力化することができる。次
に、表示装置においてこれらの駆動方法をなす駆動回路
を切り替えできる構造とすることで種々の表示形態に合
わせた駆動方式を選択できる表示装置を提供できる。
ームを複数のフィールドに分割し、フィールド毎に走査
することで、従来構造の駆動の場合と同様に表示装置を
駆動することができる。また、先に記載の構成において
１つのフレームを複数のフィールドに分割し、所定のフ
ィールド毎に飛び越し走査することにより、走査線数の
増加に拘わらず走査する周波数を従来構造の駆動の場合
と同程度にできるので、ソースドライバ１個あたりの消
費電力を更に低減できて省電力化することができる。次
に、表示装置においてこれらの駆動方法をなす駆動回路
を切り替えできる構造とすることで種々の表示形態に合
わせた駆動方式を選択できる表示装置を提供できる。
【図１】 本発明に係る表示装置の第１の形態を示す平
面図。
面図。
【図２】 図１に示す表示装置の画素と薄膜トランジス
タ構造の関係を示す拡大図。
タ構造の関係を示す拡大図。
【図３】 図１に示す構造においてカラーフィルタのＲ
ＧＢ配置状態とソースドライバおよびゲートドライの接
続状態の一例を示す図。
ＧＢ配置状態とソースドライバおよびゲートドライの接
続状態の一例を示す図。
【図４】 図１に示す構造において各画素を走査する場
合の走査順序を説明するための説明図。
合の走査順序を説明するための説明図。
【図５】 図１に示す表示装置を駆動する場合のソース
ドライバに対する入力信号と出力データの関係を示す
図。
ドライバに対する入力信号と出力データの関係を示す
図。
【図６】 図１７と図１８に示す従来の表示装置を駆動
する場合のソースドライバに対する入力信号と出力デー
タの関係を示す図。
する場合のソースドライバに対する入力信号と出力デー
タの関係を示す図。
【図７】 図１に示す表示装置を駆動する場合に１水平
走査時間（１Ｈ）の間にソースドライバに入力される信
号をまとめて示す図。
走査時間（１Ｈ）の間にソースドライバに入力される信
号をまとめて示す図。
【図８】 図１に示す表示装置で用いるソースドライバ
の内部ブロック構造の一例と信号の流れを示す図。
の内部ブロック構造の一例と信号の流れを示す図。
【図９】 図１に示す表示装置が組み込まれる液晶表示
装置の一例を示すブロック構成図。
装置の一例を示すブロック構成図。
【図１０】 図１に示す表示装置を駆動する場合のソー
スドライバに対する入力信号と出力データの関係および
液晶表示装置の画素の配列状態を示す図。
スドライバに対する入力信号と出力データの関係および
液晶表示装置の画素の配列状態を示す図。
【図１１】 図１７に示す従来の表示装置を駆動する場
合のソースドライバに対する入力信号と出力データの関
係および液晶表示装置の画素の配列状態を示す図。
合のソースドライバに対する入力信号と出力データの関
係および液晶表示装置の画素の配列状態を示す図。
【図１２】 本発明に係る液晶表示装置の第１の形態の
構造を駆動する方法の第２の例を示す説明図。
構造を駆動する方法の第２の例を示す説明図。
【図１３】 図１２に示す構造におけるソースドライバ
に対する入力信号と出力データの関係を示す図。
に対する入力信号と出力データの関係を示す図。
【図１４】 ソースドライバに対する入力信号と出力デ
ータの関係を示すもので、図１４（Ａ）は図１７に示す
従来装置の入力信号と出力データの関係を示す図、図１
４（Ｂ）は図１に示す第１実施形態の入力信号と出力デ
ータの関係を示す図。
ータの関係を示すもので、図１４（Ａ）は図１７に示す
従来装置の入力信号と出力データの関係を示す図、図１
４（Ｂ）は図１に示す第１実施形態の入力信号と出力デ
ータの関係を示す図。
【図１５】 本発明を単純マトリクス駆動の液晶表示装
置に適用した一形態を示す図。
置に適用した一形態を示す図。
【図１６】 図１５に示す液晶表示装置の１つの画素の
拡大図。
拡大図。
【図１７】 従来の液晶表示装置の一例の平面図。
【図１８】 図１７に示す従来の液晶表示装置の１つの
画素の拡大図。
画素の拡大図。
【図１９】 図１７に示す従来の液晶表示装置のカラー
フィルタのＲＧＢ配置状態とソースドライバおよびゲー
トドライの接続状態の一例を示す図。
フィルタのＲＧＢ配置状態とソースドライバおよびゲー
トドライの接続状態の一例を示す図。
【図２０】 図１７に示す従来の表示装置を駆動する場
合に１水平走査時間（１Ｈ）の間にソースドライバに入
力される信号をまとめて示す図。
合に１水平走査時間（１Ｈ）の間にソースドライバに入
力される信号をまとめて示す図。
Ｓｄ・・・ソースドライバ、Ｇｄ・・・ゲートドライバ、Ｇ・・
・走査線、Ｎ・・・信号入力手段、Ｓ・・・信号線、Ｔ・・・薄膜
トランジスタ、１０、１００・・・液晶表示装置、１１・・・
画素電極、１２・・・絵素。
・走査線、Ｎ・・・信号入力手段、Ｓ・・・信号線、Ｔ・・・薄膜
トランジスタ、１０、１００・・・液晶表示装置、１１・・・
画素電極、１２・・・絵素。
Claims (4)
- 【請求項１】 多数の走査線と多数の信号線とによって
多数の画素がマトリクス駆動されるとともに、前記各信
号線方向に沿って複数の基本色の組み合わせが繰り返し
配列され、前記走査線の数が前記信号線に沿って並ぶ全
画素の数とされ、前記信号線に沿って配列された基本色
の順番が前記信号線に沿って繰り返し同じ順番とされ、
前記走査線に沿って同じ基本色が配列されてなるととも
に、ソースドライバから各一走査線当たりの各信号線に
送るべき信号を順次ソースドライバに送る信号入力手段
を有することを特徴とする表示装置。 - 【請求項２】 請求項１記載の表示装置を駆動するにあ
たり、１つのフレームの間に全走査線を順次走査するこ
とを特徴とする表示装置の駆動方法。 - 【請求項３】 請求項１記載の表示装置を駆動するにあ
たり、１つのフレームを複数のフィールドに分割し、所
定のフィールドごとに飛び越し走査することを特徴とす
る表示装置の駆動方法。 - 【請求項４】 請求項１記載の構成を有するとともに、
請求項２記載の駆動方法と請求項３記載の駆動方法とを
切換手段により選択自在にしたことを特徴とする表示装
置。
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| US09/120,107 US20010050688A1 (en) | 1997-07-24 | 1998-07-21 | Display device and its driving method |
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