JPH10163213A - 半導体装置の製造方法及び半導体装置の実装方法 - Google Patents

半導体装置の製造方法及び半導体装置の実装方法

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JPH10163213A
JPH10163213A JP8321974A JP32197496A JPH10163213A JP H10163213 A JPH10163213 A JP H10163213A JP 8321974 A JP8321974 A JP 8321974A JP 32197496 A JP32197496 A JP 32197496A JP H10163213 A JPH10163213 A JP H10163213A
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solder
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一明 柄澤
康弘 ▲高▼木
Yasuhiro Takagi
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Abstract

(57)【要約】 【課題】本発明は突起電極を有した半導体装置の製造方
法及び実装方法に係り、突起電極内におけるボイドの発
生を抑制すると共に、良好な実装を行なうことを課題と
する。 【解決手段】半導体素子にはんだバンプ１を形成する突
起電極形成工程において、半導体素子２にはんだバンプ
１となるはんだ部材を配設する配設工程と、はんだバン
プ１を減圧雰囲気中で加熱し溶融する減圧加熱工程と、
この減圧加熱工程が終了した後にはんだバンプ１を前記
減圧加熱工程おける減圧雰囲気よりも加圧した加圧雰囲
気中で加熱する加圧加熱工程と、この加圧加熱工程の終
了後、前記加圧雰囲気を略維持しつつはんだバンプ１を
冷却して凝固させる加圧冷却工程とを実施する。

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は半導体装置の製造方
法及び半導体装置の実装方法に係り、特にはんだバンプ
等の突起電極を有した半導体装置の製造方法及び半導体
装置の実装方法に関する。
【０００２】コンピュータを高速動作させるには、信号
の伝播速度の遅延を減少させる必要がある。信号の伝播
経路は、半導体素子内部と半導体素子外部とがある。現
在、半導体素子内部の信号の高速化が進んでいるため、
半導体素子外部の接合部や実装基板の配線部での遅延を
減少させなくてはならない。
【０００３】フリップチップ接合は、信号の遅延が少な
い接合方法である。フリップチップ接合では、はんだバ
ンプ（または、金バンプや誘電性樹脂）を用いて、半導
体素子と実装基板とを直接接合する。従って、接合部の
配線長を短くすることができ、その結果、総配線長も短
くすることができる。配線部での信号の遅延は配線長に
比例するため、遅延を短縮することができる。
【０００４】
【従来の技術】フリップチップ接合では、半導体素子か
実装基板の少なくともいずれか一方の電極上に、はんだ
バンプを形成する必要がある。はんだバンプを形成する
手段として、はんだペーストの印刷、はんだボール、蒸
着、転写、めっきなどがある。
【０００５】多数の微細なはんだバンプを形成する方法
としては、蒸着、転写、めっきなどの方法が優れてい
る。たとえば、半導体素子の電極上にはんだ材料をめっ
きしてはんだバンプを形成し、これらのはんだバンプと
実装基板の電極とを位置合わせし、加熱してはんだを溶
融しはんだ接合を行う。
【０００６】フリップチップ接合の問題点の一つは、は
んだ中にボイドが存在すると、はんだ接合部の強度が低
下したり、半導体素子と実装基板の実装工程でボイドが
膨張し、はんだ接合部を破断させたりする危険性がある
点にある。ボイドの原因としては、電極とはんだとの界
面にはんだぬれ不良部があると、そこにガスがトラップ
されることが考えられる。
【０００７】従来より、はんだ中のボイドに対する対策
として幾つかの方法が提案されており、以下にその例を
挙げて説明する。特開昭６１−７５５３１号公報には、
接合面に傾斜を付けてガスを追い出しながら順次はんだ
付けを行う方法が開示されている。しかし、この方法
は、微細なはんだバンプに適用することは困難である。
【０００８】また、特開昭６３−９０１６０号公報、特
開平３−８２１４６号公報、及び特開平６−２７５７３
３には、ボイド中のガスが外に逃げる通路（穴）を設け
る方法が開示されている。また、特開昭６３−１３０２
５８号公報及び特開平６−２８５６２２号公報には、は
んだの酸化膜を破りボイドの発生を防止する方法が開示
されている。しかるに、これらの方法は微細なはんだバ
ンプに適用することは困難である。
【０００９】また、特開平３−２０８３４６号公報に
は、はんだのボイド中に針を刺してガスを抜く方法が開
示されている。しかるにこの方法では、１チップあたり
数千端子のあるような微細なバンプに対し針を刺してガ
スを抜くことは実際上は困難である。
【００１０】また、特開平４−３６０５５７号公報に開
示された方法では、気密封止のはんだ付けに関する方法
であるため、はんだバンプには適用できない。また、特
開平５−２２６３８６号公報では揺動しながらはんだ付
けを行う方法が開示されているが、微細ピッチのはんだ
付けには不向きである。また、特開平７−２２７４４号
公報に開示された方法は、はんだに圧力を加えてガスを
順次押し出すものであるが、微細なバンプに圧力を加え
ることは困難である。
【００１１】そこで、例えば特開昭６３−２２６０３１
号公報、特開昭６３−３０４６５５号公報、特開平２−
７９４５３０号公報、特開平１−２７８９５９号公報、
特開平３−９１２５４号公報、及び特開平６−６９３８
７号公報に開示されているように、接着材料を接合面を
囲むように配置し、低圧下で接着材料に流動性を持た
せ、高圧にすることで接着材料を内部に流入させ、これ
を固化させてボイドのない接着をする方法が提案されて
いる。
【００１２】
【発明が解決しようとする課題】しかるに、上記した各
公報に開示された方法をはんだバンプに適用すると、先
ず電極を囲むようにはんだ材料を形成することとなる
が、径が数十μｍの微細な電極を囲むようにはんだ材料
を形成するのは実際上困難である。また、ピッチが数十
〜数百μｍの場合には、隣合わせる電極とショートする
危険性が高いという問題点がある。
【００１３】上記したように、はんだバンプのボイドを
低減する方法としては有効な公知手段がなく、従って実
際の半導体装置の製造工程においては、比較的簡単に実
施すできる真空中や不活性ガス中ではんだバンプをアニ
ールすることによりはんだバンプ中のガス抜きを行なっ
ている。しかるに、この方法ではボイドの活性を低減し
ていたが不十分である。
【００１４】また、フリップチップ接合の別の問題点
は、はんだバンプ表面に酸化膜が存在すると、半導体素
子と実装基板の実装工程で、はんだ付け不良が発生する
ことである。従って、実装工程前にはんだバンプ表面の
酸化膜を除去しなくてはならないが、はんだバンプの酸
化膜の除去を上記した真空中や不活性雰囲気中で実施す
るのは困難である。
【００１５】また、フリップチップ接合の別の問題点
は、はんだと電極との拡散が進むと、はんだが配線を劣
化させたり、はんだと電極との反応によって生成した固
くて脆い金属間化合物の部分で破断が起こり、電気的に
接続されなくなったりする危険性があることである。従
って、はんだと配線の間には、はんだの拡散を防止する
金属層を形成しなくてはならない。
【００１６】本発明は上記の点に鑑みてなされたもので
あり、ボイドの発生を抑制した半導体装置の製造方法を
提供することを目的とする。また、本発明の他の目的
は、半導体装置の実装基板に対する良好な実装処理を可
能とした半導体装置の実装方法を提供することにある。
【００１７】
【課題を解決するための手段】上記の課題は、下記の手
段を講じることにより解決することができる。請求項１
記載の発明では、半導体素子に突起電極を形成する突起
電極形成工程を含む半導体装置の製造方法において、前
記突起電極形成工程は、前記半導体素子に前記突起電極
となる部材を配設する配設工程と、前記突起電極を減圧
雰囲気中で加熱し溶融する減圧加熱工程と、前記減圧加
熱工程の終了後、前記突起電極を前記減圧加熱工程にお
ける減圧雰囲気よりも加圧した加圧雰囲気中で加熱する
加圧加熱工程と、前記加圧加熱工程の終了後、前記加圧
雰囲気を略維持しつつ前記突起電極を冷却して凝固させ
る加圧冷却工程とを有することを特徴とするものであ
る。
【００１８】また、請求項２記載の発明では、前記請求
項１記載の半導体装置の製造方法において、前記突起電
極としてはんだバンプを用いたことを特徴とするもので
ある。また、請求項３記載の発明では、前記請求項１ま
たは２記載の半導体装置の製造方法において、前記配設
工程は、前記突起電極となる部材を該部材と接合性の低
い材料により形成された基板上に形成する形成工程と、
前記基板上に形成された前記突起電極となる部材と、前
記半導体素子とを位置合わせすると共に加熱し、前記突
起電極となる部材を前記基板から前記半導体素子に転写
する転写工程とを有することを特徴とするものである。
【００１９】また、請求項４記載の発明では、前記請求
項１乃至３のいずれか１項に記載された半導体装置の製
造方法において、前記突起電極形成工程の実施中に、或
いは前記突起電極形成工程の実施後に、前記突起電極の
表面に形成された酸化膜の除去を行なう酸化膜除去工程
を行なうことを特徴とするものである。
【００２０】また、請求項５記載の発明では、前記請求
項１乃至３のいずれか１項に記載された半導体装置の製
造方法により製造された半導体装置を電極が形成された
実装基板に実装する半導体装置の実装方法であって、前
記半導体装置の製造方法において実施される前記突起電
極形成工程と、前記電極の表面に表面層を形成する表面
層形成工程を連続しためっきプロセスで実施することを
特徴とするものである。
【００２１】また、請求項６記載の発明では、前記請求
項４または５に記載の半導体装置の実装方法において、
前記電極の表面層がニッケル（Ｎｉ）または白金（Ｐ
ｔ）であることを特徴とするものである。
【００２２】上記した各手段は、次のように作用する。
請求項１及び請求項２記載の発明によれば、突起電極形
成工程において、先ず減圧加熱工程を実施することによ
り突起電極（はんだバンプ）を減圧雰囲気中で加熱溶融
し、続いて実施される加圧加熱工程において突起電極を
減圧加熱工程における減圧雰囲気よりも加圧した加圧雰
囲気中で加熱する。更に、続いて実施される加圧冷却工
程において加圧加熱工程の加圧雰囲気を略維持しつつ突
起電極を冷却して突起電極を凝固させる。
【００２３】これによって、突起電極（はんだバンプ）
中にボイドが存在していても、ボイドの体積は（減圧雰
囲気時の圧力）／（加圧雰囲気時の圧力）に収縮するた
め、実質的にボイドを消滅させることができる。これに
よって、例え突起電極中にボイドが発生していたとして
も、加圧冷却工程後には実質的に突起電極の内部にボイ
ドが残らない。
【００２４】また、請求項３記載の発明によれば、半導
体素子に突起電極となる部材を配設する配設工程におい
て、先ず形成工程を実施することにより突起電極となる
部材をこの部材と接合性の低い材料により形成された基
板上に形成する。続いて、転写工程を実施することによ
り、基板上に形成された突起電極となる部材と半導体素
子とを位置合わせし、この状態で加熱することにより突
起電極となる部材を基板から半導体素子に転写する。
【００２５】このように、基板に予め突起電極となる部
材を形成し、かつ該基板と半導体素子とを位置決めした
上で、突起電極となる部材を基板から半導体素子に転写
することにより、突起電極を半導体素子に高い位置精度
をもって配設することができる。
【００２６】また、請求項４記載の発明によれば、突起
電極形成工程の実施中、或いはその実施後に突起電極の
表面に形成された酸化膜の除去を行なう酸化膜除去工程
を行なうことにより、半導体素子を実装基板に接合する
際、酸化膜に起因した接合不良の発生を防止することが
できる。
【００２７】また、請求項５記載の発明によれば、半導
体装置の製造方法において実施される前記突起電極形成
工程と、電極の表面に表面層を形成する表面層形成工程
を連続しためっきプロセスで実施することにより、電極
表面に酸化が発生することを抑制でき、よって後に実施
される接合工程（加熱プロセスを含む）において電極と
突起電極との間のぬれ性を良好な状態とすることがで
き、これによってもボイドの発生を抑制することができ
る。
【００２８】また、請求項６記載の発明によれば、電極
の表面層としてニッケル（Ｎｉ）または白金（Ｐｔ）を
用いたことにより、突起電極材料と電極材料との拡散を
防止することができ、よって電極及びこれに接続された
配線の劣化の防止や、断線の原因となる金属間化合物の
生成の抑制を図ることができる。
【００２９】
【発明の実施の形態】続いて本発明の実施の形態につい
て図面と共に説明する。図１乃至図５は、本発明の一実
施例である半導体装置の製造方法を示している。尚、本
発明の要部は半導体装置の製造工程の内、突起電極を形
成する工程（突起電極形成工程）にあり、他の工程は従
来と変わるところがないため、以下の説明では突起電極
形成工程についてのみ説明するものとする。また、本実
施例では、突起電極としてはんだバンプを用いた例につ
いて説明する。
【００３０】突起電極形成工程は、大略すると実施する
工程順に配設工程，減圧加熱工程，加圧加熱工程，加圧
冷却工程等を有している。先ず、配設工程について図４
を用いて説明する。この配設工程は、半導体素子２に突
起電極となる部材（はんだ）を配設するものである。
【００３１】配設工程では、まず図４（Ａ）に示すよう
に、基板５を用意する。この基板５は、はんだバンプ１
の形成位置に対応した位置に半球状に窪んだ形状のディ
ンプル５ａが形成されている。また、基板５の材質は、
はんだバンプ１を構成するはんだとぬれ性が低い材質、
即ちはんだとの接合性が低い材質に選定されている。
【００３２】この基板５には、図４（Ｂ）に示されるよ
うに、はんだペースト６が塗布される。このはんだペー
スト６は、スキージ７を用いて基板５に形成されている
ディンプル５ａ内に充填される。図４（Ｃ）は、全ての
ディンプル５ａにはんだペースト６が充填された状態を
示している（以上の処理が、前記した形成工程とな
る）。尚、はんだペースト６は、有機材料よりなるペー
スト基材にはんだ粒子が混入された構成となっている。
【００３３】上記のようにはんだペースト６が基板５に
形成されたディンプル５ａ内に充填されると、続いて図
４（Ｄ）に示されるように、別工程である半導体素子製
造工程を経ることにより製造された半導体素子２が基板
５の上部に位置決めされる。この位置決めが行なわれた
状態において、半導体素子２に形成されている電極パッ
ド３は基板５に形成されているディンプル５ａと対向す
るよう位置決めされる構成となっている。尚、半導体素
子２はハンドリング装置等を用いて上記位置に搬送され
位置決めされる。
【００３４】続いて、半導体素子２はディンプル５ａと
対向した状態を維持しつつ下動され、そして図４（Ｅ）
に示されるように半導体素子２は基板５と当接した状態
となる。この状態で、電極パッド３は基板５のディンプ
ル５ａに充填されたはんだペースト６内に埋設された状
態となる。
【００３５】続いて、これをはんだの融点以上の温度に
加熱処理する。これにより、はんだペースト６のペース
ト基材は蒸発し、またはんだ粒子は溶融し表面張力の作
用によりボール状となり電極パッド３に接合され、よっ
てはんだバンプ１が形成される。即ち、基板５に配設さ
れていたはんだ（はんだペースト６）は、基板５から半
導体素子２に転写される（以上の処理が、前記した転写
工程となる）。図５は転写工程が終了し、はんだバンプ
１が半導体素子２に形成された半導体装置２０を示して
いる。
【００３６】上記のように、配設工程では基板５に予め
はんだペースト６（突起電極となる部材）を形成し、か
つこの基板５と半導体素子２とを位置決めした上で、は
んだペースト６を基板５から半導体素子２に転写するこ
とによりはんだバンプ１を配設するため、はんだバンプ
１を半導体素子２に高い位置精度をもって配設すること
ができ、信頼性の高い半導体装置２０を製造することが
できる。
【００３７】ところで、上記のように形成されたはんだ
バンプ１では、はんだバンプ１の内部にボイドが形成さ
れてしまうことは前述した通りである。そこで、本実施
例では減圧加熱工程，加圧加熱工程，加圧冷却工程を順
次実施することにより、実質的にはんだバンプ１内のボ
イドを除去することを特徴としている。以下、減圧加熱
工程，加圧加熱工程，及び加圧冷却工程の各工程につい
て説明する。
【００３８】図７は、突起電極形成工程を構成する減圧
加熱工程，加圧加熱工程，及び加圧冷却工程の各工程に
おいて使用するアニール装置１０を示している。アニー
ル装置１０は、半導体素子２が内設されるチャンバー１
１，半導体素子２を加熱処理するヒータ１２，半導体素
子２が載置される支持台１３，ヒータ１２に電力供給す
る電源１４等により構成されている。また、チャンバー
１１により外界と画成させた内部領域には真空ポンプ等
の真空系及び窒素ガス供給装置（共に図示せず）が接続
されている。
【００３９】減圧加熱工程では、先ずはんだバンプ１
（ボイドが形成されている）が配設された半導体素子２
をアニール装置１０に装着する。続いて、真空系を駆動
することにより、チャンバー１１の圧力を常圧（Ｐ２）
より低い圧（Ｐ１）となるよう真空引きを行なう。ま
た、これと同時に電源１４からヒータ１２に電力供給を
行い、半導体素子２に形成されているはんだバンプ１に
対しハンダの溶融温度以上に加熱処理を行なう。
【００４０】この状態におけるはんだバンプ１の断面を
図１に示す。同図に示されるように、減圧加熱工程実施
後のはんだバンプ１は、その内部に大きなボイド４が形
成されている。尚、はんだバンプ１に対しはんだの溶融
温度以上に加熱処理することによりはんだバンプ１は溶
融状態となるが、表面張力により球形状を維持してい
る。
【００４１】上記の減圧加熱工程が終了すると、続いて
加圧加熱工程を実施する。この加圧加熱工程では、はん
だバンプ１を減圧加熱工程における減圧雰囲気（圧力Ｐ
１）よりも加圧して常圧Ｐ２とし、この加圧雰囲気中で
加熱処理を行なう。この加圧加熱工程における加熱温度
は、減圧加熱工程における加熱温度と略等しく設定され
ている（即ち、はんだの溶融温度以上の温度に設定され
ている）。
【００４２】この状態におけるはんだバンプ１の断面を
図２に示す。同図に示されるように、加圧加熱工程実施
後のはんだバンプ１は、減圧加熱工程時に比べて雰囲気
圧力が増大するため、ボイド４はその体積が小さくな
る。具体的には、減圧加熱工程実施後におけるボイド４
の体積をＶ１，雰囲気圧力をＰ１とし、加圧加熱工程実
施後におけるボイド４の体積をＶ２，雰囲気圧力をＰ２
とすると、加圧加熱工程実施後におけるボイド４の体積
をＶ２は、Ｖ２＝（Ｐ１／Ｐ２）×Ｖ１で求めることが
できる。また、Ｐ１＜Ｐ１であるため、加圧加熱工程実
施後におけるボイド体積Ｖ２は、減圧加熱工程実施後に
おけるボイド体積Ｖ１に対して小さくなる。
【００４３】上記の加圧加熱工程が終了すると、続いて
加圧冷却工程が実施される。加圧冷却工程では、加圧加
熱工程における加圧雰囲気を略維持しつつ、はんだバン
プ１を冷却して凝固させる。これにより、前記した減圧
加熱工程及び加圧加熱工程において溶融状態てあったは
んだバンプ１は固化した状態となる。
【００４４】この状態におけるはんだバンプ１の断面を
図３に示す。同図に示されるように、加圧冷却工程実施
後のはんだバンプ１は、加圧加熱工程の実施時と同様に
雰囲気圧力が高い状態（減圧加熱工程に比べて高い状
態）が維持されているため、ボイド４も体積が小さい状
態を維持している。
【００４５】このように、配設工程により形成されたは
んだバンプ１にボイド４が形成されていても、減圧加熱
工程を実施することによりはんだバンプ１を減圧雰囲気
中で加熱溶融し、続いて実施される加圧加熱工程におい
てはんだバンプ１を減圧加熱工程における減圧雰囲気よ
りも加圧した加圧雰囲気中で加熱し、更に加圧冷却工程
において加圧加熱工程の加圧雰囲気を略維持しつつはん
だバンプ１を凝固させることにより、ボイド４の体積を
実質的に消滅させることができる。即ち、はんだバンプ
１内のボイド４を実装時に影響を与えることがない大き
さに収縮させることができる。よって、半導体装置２０
の実装時における信頼性を向上させることができる。
【００４６】続いて、本発明者が実施した具体的な突起
電極形成工程の実施例について説明する。
【００４７】
【実施例１】先ず、１００μｍ径、２００μｍピッチで
電極が形成されたモデルウェハ（半導体素子２）を作製
すると共に、この電極にはんだ付け用の電極としてＮｉ
を２μｍめっきして電極パッド３を形成した。その後、
はんだ残量としてＰｂ−５ｗｔ％Ｓｎを５０μｍめっき
することによりはんだバンプ１を形成すると共に、これ
をアニールした（前記した配設工程に相当する）。
【００４８】ここまでの処理が終了した時点で、はんだ
バンプ１内のボイド４を透過Ｘ線装置を用いて観察した
ところ、アニールを行ったにもかかわらず、大なる体積
を有したボイド４が生成されていた。そこで、ボイド４
が形成されたはんだバンプ１を０．０２ｔｏｒｒの減圧
下で３８０℃に５ｍｉｎ加熱し（前記した減圧加熱工程
に相当する）、はんだバンプ１を溶融した（Ｐｂ−５ｗ
ｔ％の融点は３１４℃）。次に、チャンバー１１内にＮ
2 を流して、雰囲気温度は減圧加熱工程における温度と
略等しくなるよう制御しつつ、雰囲気圧力を常圧まで加
圧した（前記した加圧加熱工程に相当する）。尚、この
処理を行なうことにより、雰囲気温度は一旦３５０℃ま
で下がったが、すぐに３８０℃に回復した。その後、常
圧下で５ｍｉｎ保持して冷却し、はんだバンプ１を凝固
させた（前記した加圧冷却工程に相当する）。
【００４９】上記した処理が終了した時点で、もう一度
はんだバンプ１中のボイドを透過Ｘ線装置を用いて観察
したところ、生成されていたボイド４が消滅（収縮）し
ていた。この結果から、はんだバンプ１を低圧の雰囲気
中で溶融し、その後に溶融したまま高圧の雰囲気にして
から、はんだバンプ１凝固することにより、実質的にボ
イド４を消滅させることができることを確認した。
【００５０】次に、本発明者が実施した突起電極形成工
程の他の実施例（実施例２）について説明する。周知の
ように、はんだバンプ１は加熱処理等を行なうことによ
り、図８に示されるように、その表面に酸化膜９が形成
されることが知られている。この実施例２では、前記し
た実施例１に対しはんだバンプ１に形成される酸化膜９
を除去する処理を加えたことを特徴とするものである。
【００５１】
【実施例２】本実施例においても、１００μｍ径、２０
０μｍピッチで電極が形成されたモデルウェハ（半導体
素子２）を作製すると共に、この電極にはんだ付け用の
電極としてＮｉを２μｍめっきして電極パッド３を形成
した。その後、はんだ残量としてＰｂ−５ｗｔ％Ｓｎを
５０μｍめっきすることによりはんだバンプ１を形成す
ると共に、これをアニールした（配設工程）。
【００５２】ここで、はんだバンプ１中のボイドを透過
Ｘ線装置を用いて観察したところ、実施例１と同様にア
ニールを行ったにもかかわらず、はんだバンプ１の内部
には大なる体積を有するボイドが生成されていた。そこ
で、これを、０．０２ｔｏｒｒの減圧下で３８０℃に５
ｍｉｎ加熱し、はんだバンプを溶融する（減圧加熱工
程）と共に、続いてＮ2 ガスを流して常圧に加圧した
（加圧加熱工程）。この時、温度は一旦３５０℃まで下
がったが、すぐに３８０℃に回復した。常圧下で５ｍｉ
ｎ保持して冷却した。
【００５３】続いて、Ｎ2 雰囲気中（常圧）で３８０℃
に５ｍｉｎ加熱し、そしてフラックスを塗布して３５０
℃に加熱し酸化膜を除去した。この状態のはんだバンプ
中のボイドを透過Ｘ線装置を用いて観察したところ、ボ
イドの発生率は１８．６パーセントであった。
【００５４】次に、真空中（０．０２ｔｏｒｒ）で３８
０℃に５ｍｉｎ加熱した。そして、フラックスを塗布し
て３５０℃に加熱し酸化膜を除去した。この状態のはん
だバンプ１中のボイドを透過Ｘ線装置を用いて観察した
ところ、ボイド４の発生率は１７．６パーセントであっ
た。
【００５５】更に、次に真空中（０．０２ｔｏｒｒ）で
３８０℃に５ｍｉｎ加熱し、はんだが溶融した状態のま
までＮ2 を流して、常圧で３８０℃に５ｍｉｎ加熱し
た。そして、フラックスを塗布して３５０℃に加熱して
酸化膜を除去した。この状態のはんだバンプ１中のボイ
ドを透過Ｘ線装置を用いて観察したところ、ボイド４の
発生率は４．４パーセントと激減した。
【００５６】このように、本実施例においても、ボイド
４の発生を抑制することができることが証明された。特
に、実施例２のようにはんだバンプ１の表面に形成され
る酸化膜９の除去を行なうことにより、実施例１と同様
にボイド４の発生を抑制できると共に酸化膜９が除去さ
れるため、半導体素子２と実装基板との接合処理を良好
な状態で行なうことができ接合不良の発生を抑制するこ
とができる。
【００５７】続いて、上記した突起電極形成工程により
形成されたはんだバンプ１を有する半導体装置２０を実
装基板１５に実装する実装方法について説明する。図６
は半導体装置２０を実装基板１５に実装する状態を示し
ている。実装基板１５はセラミック或いは樹脂製の回路
基板であり、その実装側面には電極２１及び配線パター
ン（図示せず）が形成されている。この電極２１及び配
線パターンは、例えば銅（Ｃｕ）等により形成されてお
り、特に電極２１の表面には表面層が形成されている。
【００５８】そして、半導体装置２０と実装基板１５を
はんだバンプ１と電極２１とが対向するよう位置決め
し、半導体装置２０と実装基板１５とを近接させること
によりはんだバンプ１と電極２１とを当接し、次にこの
状態で加熱処理を行なうことによりはんだバンプ１と電
極２１とを接合する（接合工程）。
【００５９】本実施例では、この表面層をニッケル（Ｎ
ｉ）または白金（Ｐｔ）により形成したことを特徴とし
ている。このように電極２１の表面層としてニッケル
（Ｎｉ）または白金（Ｐｔ）を用いることにより、はん
だバンプ１と電極材料との拡散を防止することができ
る。これについて、図９を用いて説明する。
【００６０】図９は、はんだ材料としてＳｎ−３７ｗｔ
％Ｐｂ（図９（Ａ）），Ｉｎ−３０ｗｔ％Ｐｂ（図９
（Ｂ）），Ｉｎ−４８ｗｔ％Ｓｎ（図９（Ｃ））を用
い、この各材料により形成されたはんだバンプ１が接続
される電極２１としてニッケル（Ｎｉ），白金（Ｐ
ｔ），パラジウム（Ｐｄ）を用いた場合のはんだ温度と
はんだ中への電極材料の溶け込み時間を測定した結果を
示している。
【００６１】尚、各図に示す実験結果は、電極２１の表
面にはんだとのぬれ性を向上させる面から金（Ａｕ）膜
が１０００Åの膜厚で形成されたものに対するものであ
る。また、図中上向きの矢印（↑）は３０分経過しても
拡散が発生していないことを示している。
【００６２】各図より、各はんだ材料を用いた場合にお
いて、特に表面層の材質としてニッケル（Ｎｉ）または
白金（Ｐｔ）を用いた場合に拡散の発生が抑制されいる
ことが判る。よって、電極２１の表面に形成される表面
層の材質としてニッケル（Ｎｉ）または白金（Ｐｔ）を
用いることにより、はんだバンプ１を構成するはんだが
電極２１に拡散することを抑制でき、これにより電極２
１及びこれに接続された配線の劣化を有効に防止するこ
とができ、かつ断線の原因となる金属間化合物の生成の
抑制を図ることができる。
【００６３】ところで、上記のように電極２１の表面に
表面層を形成することにより、配線の劣化及び断線等を
抑制することができるが、これに伴い電極２１の表面に
表面層を形成する工程（表面層形成工程）が必要とな
る。この表面層形成工程は、電極２１の表面にニッケル
（Ｎｉ）または白金（Ｐｔ）をめっき処理することによ
り形成される。
【００６４】本実施例では、前記した半導体装置の製造
方法において実施される突起電極形成工程と、この電極
２１の表面に表面層を形成する表面層形成工程を連続し
ためっきプロセスで実施する方法を採用している。即
ち、本実施例に係る実装方法は、その一部において半導
体装置の製造方法とオーバーラップした構成となってい
る。
【００６５】このように、突起電極形成工程と表面層形
成工程を連続しためっきプロセスで実施することによ
り、電極２１の表面に酸化が発生することを抑制でき、
よって後に実施される接合工程（加熱プロセスを含む）
において電極２１とはんだバンプ１との間のぬれ性を良
好な状態とすることができ、これによってもボイド４の
発生を抑制することができる。
【００６６】尚、本発明の適用は、上記した材料や各実
施例で説明した具体的手段に限定されるものではなく、
本発明の趣旨に基づく方法に適用できることは勿論であ
る。また、上記した実施例でははんだバンプを形成する
方法として、いわゆるディンプルプレート法を用いた例
を説明した。しかるに、はんだバンプの形成方法は、デ
ィンプルプレート法以外にもメッキ法，蒸着転写法等の
他の形成方法によっても形成することができる。本発明
は、これらのディンプルプレート法以外の形成方法によ
り形成されたはんだバンプに対しても適用できるもので
あり、この場合であっても上記した実施例と同様の効果
を実現できるものである。
【００６７】
【発明の効果】上述したように、本発明によれば下記の
各種の効果を実現することができる。請求項１及び請求
項２記載の発明によれば、突起電極（はんだバンプ）中
にボイドが存在していても、ボイドの体積は収縮するた
め、実質的にボイドを消滅させることができ、実質的に
ボイドが存在しない状態にすることができる。
【００６８】また、請求項３記載の発明によれば、基板
に予め突起電極となる部材を形成し、かつこの基板と半
導体素子とを位置決めした上で、突起電極となる部材を
基板から半導体素子に転写することにより、突起電極を
半導体素子に高い位置精度をもって配設することができ
る。
【００６９】また、請求項４記載の発明によれば、半導
体素子と回路基板とを接合工する際に酸化膜に起因した
接合不良の発生を防止することができる。また、請求項
５記載の発明によれば、電極表面に酸化が発生すること
を抑制でき、よって後に実施される接合工程（加熱プロ
セスを含む）において電極と突起電極との間のぬれ性を
良好な状態とすることができ、これによってもボイドの
発生を抑制することができる。
【００７０】また、請求項６記載の発明によれば、突起
電極材料と電極材料との拡散を防止することができ、よ
って電極及びこれに接続された配線の劣化の防止や断線
の原因となる金属間化合物の生成の抑制を図ることがで
きる。
【図面の簡単な説明】
【図１】本発明の一実施例である半導体装置の製造方法
を示しており、減圧加熱工程を説明するための図であ
る。
【図２】本発明の一実施例である半導体装置の製造方法
を示しており、加圧加熱工程を説明するための図であ
る。
【図３】本発明の一実施例である半導体装置の製造方法
を示しており、加圧冷却工程を説明するための図であ
る。
【図４】本発明の一実施例である半導体装置の製造方法
を示しており、配設工程を説明するための図である。
【図５】配設工程が終了した状態の半導体装置を示す図
である。
【図６】本発明の一実施例である半導体装置の実装方法
を説明するための図である。
【図７】本発明の一実施例である半導体装置の製造方法
において用いるアニール装置の概略構成図である。
【図８】保護膜が形成されたはんでバンプを示す断面図
である。
【図９】各種電極材料に対するはんだ温度とはんだ中へ
の溶け込み時間との関係を示す図である。
【符号の説明】
１ はんだバンプ ２ 半導体素子 ３ 電極 ４ ボイド ５ 酸化膜 １０ アニール装置 １１ チャンバー １２ ヒータ １４ 電源

Claims (6)

    【特許請求の範囲】
  1. 【請求項１】 半導体素子に突起電極を形成する突起電
    極形成工程を含む半導体装置の製造方法において、 前記突起電極形成工程は、 前記半導体素子に前記突起電極となる部材を配設する配
    設工程と、 前記突起電極を減圧雰囲気中で加熱し溶融する減圧加熱
    工程と、 前記減圧加熱工程の終了後、前記突起電極を前記減圧加
    熱工程における減圧雰囲気よりも加圧した加圧雰囲気中
    で加熱する加圧加熱工程と、 前記加圧加熱工程の終了後、前記加圧雰囲気を略維持し
    つつ前記突起電極を冷却して凝固させる加圧冷却工程と
    を有することを特徴とする半導体装置の製造方法。
  2. 【請求項２】 請求項１記載の半導体装置の製造方法に
    おいて、 前記突起電極としてはんだバンプを用いたことを特徴と
    する半導体装置の製造方法。
  3. 【請求項３】 請求項１または２記載の半導体装置の製
    造方法において、 前記配設工程は、 前記突起電極となる部材を該部材と接合性の低い材料に
    より形成された基板上に形成する形成工程と、 前記基板上に形成された前記突起電極となる部材と、前
    記半導体素子とを位置合わせすると共に加熱し、前記突
    起電極となる部材を前記基板から前記半導体素子に転写
    する転写工程とを有することを特徴とする半導体装置の
    製造方法。
  4. 【請求項４】 請求項１乃至３のいずれか１項に記載さ
    れた半導体装置の製造方法において、 前記突起電極形成工程の実施中に、或いは前記突起電極
    形成工程の実施後に、前記突起電極の表面に形成された
    酸化膜の除去を行なう酸化膜除去工程を行なうことを特
    徴とする半導体装置の製造方法。
  5. 【請求項５】 請求項１乃至４のいずれか１項に記載さ
    れた半導体装置の製造方法により製造された半導体装置
    を電極が形成された実装基板に実装する半導体装置の実
    装方法であって、 前記半導体装置の製造方法において実施される前記突起
    電極形成工程と、前記電極の表面に表面層を形成する表
    面層形成工程を連続しためっきプロセスで実施すること
    を特徴とする半導体装置の実装方法。
  6. 【請求項６】 請求項４または５に記載の半導体装置の
    実装方法において、 前記電極の表面層がニッケル（Ｎｉ）または白金（Ｐ
    ｔ）であることを特徴とする半導体装置の実装方法。
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