JPH10163174A - 薄膜のパターニング方法 - Google Patents

薄膜のパターニング方法

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JPH10163174A
JPH10163174A JP31839696A JP31839696A JPH10163174A JP H10163174 A JPH10163174 A JP H10163174A JP 31839696 A JP31839696 A JP 31839696A JP 31839696 A JP31839696 A JP 31839696A JP H10163174 A JPH10163174 A JP H10163174A
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博彦 錦
Yoshiharu Kataoka
義晴 片岡
Yoshikazu Sakihana
由和 咲花
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Abstract

(57)【要約】 【課題】 少なくとも二つの異なる材料または膜厚から
なる被エッチング膜を、1回のパターニング工程でエッ
チングできるパターニング方法を提供する。 【解決手段】 絶縁性基板1上にゲート配線2を形成
し、ゲート配線2上にゲート絶縁膜3、ドープを行って
いないアモルファスシリコンからなるi層4及びリン等
を高濃度でドープしたシリコンからなるn+層5を順次
積層する。次に、レジスト6を塗布してパターニングす
る際に、所望する部位にレジストの薄い部分6aを設
け、レジスト6をアッシングしながらドライエッチング
を行うことにより、レジスト6が存在していない部位の
+層5及びi層4をエッチングするとともに、レジス
トの薄い部分6aの下層のn+層5をエッチングする。
エッチング後のレジスト6bは、一部がアッシングされ
ているため薄くなっている。そして、レジスト6を剥離
してTFTのチャネル部7を形成する。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、半導体、導体及び
絶縁体等の薄膜のパターニング方法に関するもので、特
に、液晶表示装置を構成する各種薄膜のパターニング方
法に関するものである。
【0002】
【従来の技術】液晶表示装置としては、互いに交差する
複数本のゲート配線と複数本のデータ配線とともに、ア
モルファスシリコンにより構成した薄膜トランジスタ
(TFT)またはMIM素子を基板上に形成した、所謂
アクティブマトリクス基板を用いたものが知られてい
る。
【0003】一方、薄膜のパターニング方法は、図5
(a)に示すように、絶縁性基板51上に被エッチング
膜52を成膜し、被エッチング膜52上にレジスト53
を塗布する。
【0004】そして、クロムまたは酸化クロム等の遮光
膜が成膜された遮光部54と、遮光膜が成膜されていな
い透光部55とが、所望するパターンに応じて形成され
ているフォトマスク56を介して、レジスト53に光5
7を照射して露光し、図5(b)に示すように、感光し
たレジスト53aとする。
【0005】次に、図5(c)に示すように、感光した
レジスト53aを現像することによって除去し、所望す
るパターンのレジスト53を得る。さらに、図5(d)
に示すように、ウェットエッチングまたはドライエッチ
ングすることにより、被エッチング膜52をパターニン
グし、図5(e)に示すように、レジスト53を剥離す
る。
【0006】このような工程を目的とする被エッチング
膜52の数だけ繰り返し、目的とする膜を重ね合せるこ
とが必要である。
【0007】図6に示すような、アクティブマトリクス
基板にエッチングストッパーを用いない逆スタガ型のT
FTを形成する場合には、以下のような製造工程が用い
られる。
【0008】まず、図7(a)に示すように、絶縁性基
板51上にゲート配線58を形成し、ゲート配線58上
にゲート絶縁膜59、ドープを行っていないアモルファ
スシリコンからなるi層60及びリン等を高濃度でドー
プしたシリコンからなるn+層61を順次積層する。
【0009】そして、図7(b)に示すように、レジス
ト53を塗布してパターニングし、図7(c)に示すよ
うに、i層60及びn+層61をエッチングして、図7
(d)に示すように、レジスト53を剥離する。
【0010】次に、図7(e)に示すように、レジスト
53を塗布して図7(b)に示すパターンとは異なるパ
ターンにパターニングし、図7(f)に示すように、T
FTのチャネル部62のn+層61のみをエッチングし
て、図7(g)に示すように、レジスト53を剥離する
ことでチャネル部62を形成し、データ配線63及び画
素電極64を形成してTFTを得る。
【0011】このように、エッチングストッパーを用い
ない逆スタガ型のTFTを形成する場合には、少なくと
も2回の薄膜のパターニング工程を行わなければならな
い。
【0012】
【発明が解決しようとする課題】前述したように、少な
くとも二つの異なる材料または膜厚からなる被エッチン
グ膜をエッチングする場合、各被エッチング膜の数のパ
ターニング工程を行わなければならず、工程が長くなっ
たり、各パターニング工程毎でフォトマスクの位置ずれ
が生じたりするという問題点がある。
【0013】本発明は、以上のような従来の問題点に鑑
みなされたものであって、少なくとも二つの異なる材料
または膜厚からなる被エッチング膜を、1回のパターニ
ング工程でエッチングできるパターニング方法を提供す
ることを目的としている。
【0014】
【課題を解決するための手段】前述した目的を達成する
ために、本発明の請求項1記載の薄膜のパターニング方
法は、被エッチング膜上にレジストを塗布する工程と、
前記レジストを所望のパターンのフォトマスクを用いて
感光させる工程と、前記レジストを所望のパターンに現
像する工程と、前記被エッチング膜をドライエッチング
する工程とを有する薄膜のパターニング方法において、
前記レジストを少なくとも二つの異なる膜厚に現像し、
前記レジストをアッシングしながら前記被エッチング膜
をドライエッチングすることを特徴としている。
【0015】請求項2記載の薄膜のパターニング方法
は、請求項1記載の薄膜のパターニング方法において、
少なくとも二つの異なるパターンを有するフォトマスク
を用いて前記レジストを連続して感光させ、前記レジス
トを少なくとも二つの異なる膜厚に現像することを特徴
としている。
【0016】請求項3記載の薄膜のパターニング方法
は、請求項1記載の薄膜のパターニング方法において、
少なくとも二つの異なる透過率を有する部分が形成され
たフォトマスクを用いて前記レジストを感光させ、前記
レジストを少なくとも二つの異なる膜厚に現像すること
を特徴としている。
【0017】請求項4記載の薄膜のパターニング方法
は、請求項2または請求項3記載の薄膜のパターニング
方法において、前記レジストは、少なくとも二つの異な
る感度を有するレジストが積層されたものであることを
特徴としている。
【0018】本発明の薄膜のパターニング方法によれ
ば、レジストを少なくとも二つの異なる膜厚に現像し、
レジストをアッシングしながら被エッチング膜をドライ
エッチングすることにより、レジストの下層の被エッチ
ング膜は、レジストがアッシングされた後にエッチング
が行われるため、レジストの膜厚で被エッチング膜のエ
ッチング量を制御して、少なくとも二つの異なる材料ま
たは膜厚からなる被エッチング膜を1回のエッチングで
パターニングすることができる。
【0019】このことは、少なくとも二つの異なるパタ
ーンを有するフォトマスクを用いてレジストを連続して
感光させ、レジストを少なくとも二つの異なる膜厚に現
像することにより、容易に実現することができる。
【0020】また、少なくとも二つの異なる透過率を有
する部分が形成されたフォトマスクを用いてレジストを
感光させ、レジストを少なくとも二つの異なる膜厚に現
像することによっても、容易に実現することができる。
【0021】さらに、レジストは、少なくとも二つの異
なる感度を有するレジストが積層されたものであること
により、レジストを少なくとも二つの異なる膜厚に制御
することが簡便になるとともに、レジストの膜厚を正確
に制御することができる。
【0022】
【発明の実施の形態】図1乃至図4を用いて、本発明の
実施の形態について説明する。図1は本発明の概念を説
明する工程図、図2は本発明に係わる第1のパターニン
グ方法を説明する工程図、図3は本発明に係わる第2の
パターニング方法を説明する工程図、図4は本発明に係
わる第3のパターニング方法を説明する工程図である。
【0023】図1を用いて本発明について説明する。図
1(a)に示すように、ガラス等からなる絶縁性基板1
上にTa等からなるゲート配線2を形成し、ゲート配線
2上にシリコン酸化膜等からなるゲート絶縁膜3、ドー
プを行っていないアモルファスシリコンからなるi層4
及びリン等を高濃度でドープしたシリコンからなるn+
層5を順次積層する。
【0024】次に、図1(b)に示すように、レジスト
6を塗布してパターニングする際に、所望する部位にレ
ジストの薄い部分6aを設け、図1(c)に示すよう
に、レジスト6をアッシングしながらドライエッチング
を行うことにより、レジスト6が存在していない部位の
+層5及びi層4をエッチングするとともに、レジス
トの薄い部分6aの下層のn+層5をエッチングする。
エッチング後のレジスト6bは、一部がアッシングされ
ているため薄くなっている。そして、図1(d)に示す
ように、レジスト6を剥離してTFTのチャネル部7を
形成する。
【0025】このように、レジスト6をアッシングしな
がらドライエッチングを行うことにより、レジスト6が
存在していない部位のn+層5及びi層4は通常のよう
にエッチングされる。そして、レジストの薄い部分6a
の下層のn+層5は、レジストの薄い部分6aが完全に
エッチングされてからn+層5のエッチングが行われる
ため、n+層5の下層のi層4までエッチングされるこ
とがないように制御することができる。そして、通常の
膜厚のレジスト6部分は一部がアッシングされて薄くな
り、エッチング後のレジスト6bのようになるが、レジ
スト6が完全になくなるわけではないので、その下層の
+層5及びi層4はエッチングされることがないよう
に制御することができる。
【0026】レジスト6のアッシングとn+層5及びi
層4のエッチングとを同時に行うためには、プロセスガ
スとしてHCl+SF6+O2の混合ガスを用いればよ
い。
【0027】レジストの薄い部分6aの厚さは、実際の
プロセスにおけるレジスト6のアッシングレート並びに
+層5及びi層4の膜厚及びエッチングレートから決
定すればよい。
【0028】具体的には、レジスト6が存在していない
部位のn+層5及びi層4がエッチングされると同時
に、レジストの薄い部分6aがアッシングされてその下
層のn+層5がエッチングされる必要があり、n+層5に
ついては、レジスト6が存在していない部位とレジスト
の薄い部分6aとで同様にエッチングされることから、
i層4のエッチング時間とレジストの薄い部分6aのア
ッシング時間とを同じにすればよいのである。
【0029】例えば、レジスト6のアッシングレート、
+層5のエッチングレート及びi層4のエッチングレ
ートの比が5:2:1で、n+層5の膜厚が50nm及
びi層4の膜厚が100nmであり、10%のオーバー
エッチングを行うとする場合、レジストの薄い部分6a
の膜厚は550nmとすればよく、通常の厚さのレジス
ト6の膜厚は700nm以上あればよい。特に、レジス
トの薄い部分6aの膜厚は正確に制御する必要がある。
【0030】ここで、図2乃至図4を用いて、少なくと
も二つの異なる膜厚のレジスト6を形成するためのパタ
ーニング方法について説明する。
【0031】(第1のパターニング方法)図2(a)に
示すように、絶縁性基板1上に被エッチング膜8を成膜
し、被エッチング膜8上にレジスト6を塗布する。そし
て、クロムまたは酸化クロム等の遮光膜が成膜された遮
光部9と、遮光膜が成膜されていない透光部10とが、
所望するパターンに応じて形成されている第1のフォト
マスク11aを介して、レジスト6に第1の光12aを
照射して露光し、図2(b)に示すように、感光したレ
ジスト6cとする。
【0032】次に、図2(c)に示すように、遮光部9
と透光部10とが所望するパターンに応じて形成されて
いる第2のフォトマスク11bを介して、レジスト6に
第2の光12bを照射して露光し、図2(d)に示すよ
うに、厚さの異なる感光したレジスト6cを形成する。
【0033】そして、図2(e)に示すように、感光し
たレジスト6cを現像することによって除去し、レジス
トの薄い部分6aを有する所望するパターンのレジスト
6を得る。
【0034】さらに、図2(f)に示すように、レジス
ト6をアッシングしながらドライエッチングを行うこと
により、レジストが存在していない部位の被エッチング
膜8をエッチングするとともに、レジストの薄い部分6
aの下層の被エッチング膜8の一部をエッチングする。
エッチング後のレジスト6bは、一部がアッシングされ
ているため薄くなっている。
【0035】そして、図2(g)に示すように、レジス
ト6を剥離し、膜厚の薄い被エッチング膜8aを有する
所望するパターンの被エッチング膜8を形成して、パタ
ーニングを終了する。
【0036】このように、少なくとも二つの異なる膜厚
のレジスト6を形成するためには、少なくとも二つの異
なるパターンのフォトマスク11を用いて、連続して露
光を行うようにすればよい。
【0037】図2の場合、第1の光12aは、レジスト
の薄い部分6aの膜厚を制御し、レジストの薄い部分6
aが所望する膜厚となるような光量で照射すればよく、
第2の光12bは、現像で除去する部位のレジスト6を
完全に感光したレジスト6cにできるような光量で照射
すればよい。
【0038】(第2のパターニング方法)図3(a)に
示すように、絶縁性基板1上に被エッチング膜8を成膜
し、被エッチング膜8上にレジスト6を塗布する。そし
て、遮光部9と、透光部10と、第1の透過率を有する
第1の半透過部13aと、第2の透過率を有する第2の
半透過部13bとが、所望するパターンに応じて形成さ
れているフォトマスク11を介して、レジスト6に光1
2を照射して露光する。
【0039】このとき、第1の半透過部13aを透過し
た光12は第1の透過率の光12cとなり、第2の半透
過部13bを透過した光12は第2の透過率の光12d
となるため、図3(b)に示すように、厚さの異なる感
光したレジスト6cを形成することができる。
【0040】そして、図3(c)に示すように、感光し
たレジスト6cを現像することによって除去し、レジス
トの薄い部分6a及びレジストのさらに薄い部分6dを
有する所望するパターンのレジスト6を得る。
【0041】さらに、図3(d)に示すように、レジス
ト6をアッシングしながらドライエッチングを行うこと
により、レジストが存在していない部位の被エッチング
膜8、レジストの薄い部分6aの下層の被エッチング膜
8の一部及びレジストのさらに薄い部分6dの下層の被
エッチング膜8の一部をエッチングする。エッチング後
のレジスト6bは、一部がアッシングされているため薄
くなっている。
【0042】そして、図3(e)に示すように、レジス
ト6を剥離し、膜厚の薄い被エッチング膜8a及び膜厚
のさらに薄い被エッチング膜8bを有する所望するパタ
ーンの被エッチング膜8を形成して、パターニングを終
了する。
【0043】このように、少なくとも二つの異なる膜厚
のレジスト6を形成するためには、少なくとも二つの異
なる透過率を有する部分が形成されたフォトマスク11
を用いて、1回の露光を行うようにすればよい。
【0044】図3の場合、第1の半透過部13aは、レ
ジストの薄い部分6aの膜厚を制御し、レジストの薄い
部分6aが所望する膜厚となるように第1の半透過部1
3aの透過率を設定すればよく、第2の半透過部13b
は、レジストのさらに薄い部分6dの膜厚を制御し、レ
ジストのさらに薄い部分6dが所望する膜厚となるよう
に第2の半透過部13bの透過率を設定すればよい。光
12は、現像で除去する部位のレジスト6を完全に感光
したレジスト6cにできるような光量で照射すればよ
い。
【0045】(第3のパターニング方法)図4(a)に
示すように、絶縁性基板1上に被エッチング膜8を成膜
し、被エッチング膜8上に感度の異なる第1のレジスト
6e、第2のレジスト6f及び第3のレジスト6gを塗
布して積層する。
【0046】そして、遮光部9と、透光部10と、第1
の透過率を有する第1の半透過部13aと、第2の透過
率を有する第2の半透過部13bとが、所望するパター
ンに応じて形成されているフォトマスク11を介して、
第1のレジスト6e、第2のレジスト6f及び第3のレ
ジスト6gに光12を照射して露光する。
【0047】このとき、第1の半透過部13aを透過し
た光12は第1の透過率の光12cとなり、第2の半透
過部13bを透過した光12は第2の透過率の光12d
となるため、図4(b)に示すように、厚さの異なる感
光したレジスト6cを形成することができる。
【0048】そして、図4(c)に示すように、感光し
たレジスト6cを現像することによって除去し、所望す
るパターンの第1のレジスト6e、第2のレジスト6f
及び第3のレジスト6gを得る。
【0049】さらに、図4(d)に示すように、第1の
レジスト6e、第2のレジスト6f及び第3のレジスト
6gをアッシングしながらドライエッチングを行うこと
により、レジスト6が存在していない部位の被エッチン
グ膜8、第1のレジスト6eと第2のレジスト6fとが
積層された部分の下層の被エッチング膜8の一部及び第
1のレジスト6eのみの部分の下層の被エッチング膜8
の一部をエッチングする。エッチング後には、第2のレ
ジスト6f及び第3のレジスト6gは全てアッシングさ
れているため、第1のレジスト6eと第2のレジスト6
fと第3のレジスト6gとが積層されていた部分の第1
のレジスト6eのみが残っている。
【0050】そして、図4(e)に示すように、第1の
レジスト6eを剥離し、膜厚の薄い被エッチング膜8a
及び膜厚のさらに薄い被エッチング膜8bを有する所望
するパターンの被エッチング膜8を形成して、パターニ
ングを終了する。
【0051】このように、少なくとも二つの異なる膜厚
のレジスト6を形成するためには、少なくとも二つの異
なる感度を有するレジスト6を積層し、少なくとも二つ
の異なる透過率を有する部分が形成されたフォトマスク
11を用いて、1回の露光を行うようにすればよい。
【0052】図4の場合、第1のレジスト6eとして感
度の最も低いものを用い、第3のレジスト6gとして感
度の最も高いものを用いれば、第1の透過率の光12c
は、第3のレジスト6gのみを感光したレジスト6cと
し、第2の透過率の光12dは、第3のレジスト6g及
び第2のレジスト6fを感光したレジスト6cとし、光
12は、第3のレジスト6g、第2のレジスト6f及び
第1のレジスト6eを感光したレジスト6cとして、異
なる膜厚のレジスト6を形成することができる。
【0053】例えば、レジスト6の膜厚を400nm、
1000nm及び1500nmの3種類に異ならせたい
場合、第1のレジスト6eを400nm、第2のレジス
ト6fを600nm及び第3のレジスト6gを500n
mの厚さで積層すればよい。
【0054】また、少なくとも二つの異なる膜厚のレジ
スト6を形成するためには、少なくとも二つの異なる感
度を有するレジスト6を積層し、第1のパターニング方
法で説明したように、少なくとも二つの異なるパターン
のフォトマスク11を用いて、連続して露光を行うよう
にしてもよい。
【0055】
【発明の効果】以上の説明のように、本発明の薄膜のパ
ターニング方法によれば、レジストを少なくとも二つの
異なる膜厚に現像し、レジストをアッシングしながら被
エッチング膜をドライエッチングすることにより、少な
くとも二つの異なる材料または膜厚からなる被エッチン
グ膜を1回のエッチングでパターニングすることができ
るため、パターニングに係わる工数を大幅に削減できる
とともに、パターニング工程毎のフォトマスクの位置ず
れを生じることがなくなる。
【0056】このことは、少なくとも二つの異なるパタ
ーンを有するフォトマスクを用いてレジストを連続して
感光させ、レジストを少なくとも二つの異なる膜厚に現
像することにより、容易に実現することができる。
【0057】また、少なくとも二つの異なる透過率を有
する部分が形成されたフォトマスクを用いてレジストを
感光させ、レジストを少なくとも二つの異なる膜厚に現
像することによっても、容易に実現することができる。
【0058】さらに、レジストは、少なくとも二つの異
なる感度を有するレジストが積層されたものであること
により、レジストを少なくとも二つの異なる膜厚に制御
することが簡便になるとともに、レジストの膜厚を正確
に制御することができる。
【図面の簡単な説明】
【図1】(a)〜(d)は本発明の概念を説明する工程
図である。
【図2】(a)〜(g)は本発明に係わる第1のパター
ニング方法を説明する工程図である。
【図3】(a)〜(e)は本発明に係わる第2のパター
ニング方法を説明する工程図である。
【図4】(a)〜(e)は本発明に係わる第3のパター
ニング方法を説明する工程図である。
【図5】(a)〜(e)は従来の薄膜のパターニング方
法を示す工程図である。
【図6】エッチングストッパーを用いない逆スタガ型の
TFTを示す断面図である。
【図7】(a)〜(g)は従来の薄膜のアクティブマト
リクス基板のパターニング方法を示す工程図である。
【符号の説明】
1 絶縁性基板 2 ゲート配線 3 ゲート絶縁膜 4 i層 5 n+層 6 レジスト 6a レジストの薄い部分 6b エッチング後のレジスト 6c 感光したレジスト 6d レジストのさらに薄い部分 6e 第1のレジスト 6f 第2のレジスト 6g 第3のレジスト 7 チャネル部 8 被エッチング膜 8a 膜厚の薄い被エッチング膜 8b 膜厚のさらに薄い被エッチング膜 9 遮光部 10 透光部 11 フォトマスク 11a 第1のフォトマスク 11b 第2のフォトマスク 12 光 12a 第1の光 12b 第2の光 12c 第1の透過率の光 12d 第2の透過率の光 13a 第1の半透過部 13b 第2の半透過部 51 絶縁性基板 52 被エッチング膜 53 レジスト 53a 感光したレジスト 54 遮光部 55 透光部 56 フォトマスク 57 光 58 ゲート配線 59 ゲート絶縁膜 60 i層 61 n+層 62 チャネル部 63 データ配線 64 画素電極

Claims (4)

    【特許請求の範囲】
  1. 【請求項1】 被エッチング膜上にレジストを塗布する
    工程と、前記レジストを所望のパターンのフォトマスク
    を用いて感光させる工程と、前記レジストを所望のパタ
    ーンに現像する工程と、前記被エッチング膜をドライエ
    ッチングする工程とを有する薄膜のパターニング方法に
    おいて、前記レジストを少なくとも二つの異なる膜厚に
    現像し、前記レジストをアッシングしながら前記被エッ
    チング膜をドライエッチングすることを特徴とする薄膜
    のパターニング方法。
  2. 【請求項2】 少なくとも二つの異なるパターンを有す
    るフォトマスクを用いて前記レジストを連続して感光さ
    せ、前記レジストを少なくとも二つの異なる膜厚に現像
    することを特徴とする請求項1記載の薄膜のパターニン
    グ方法。
  3. 【請求項3】 少なくとも二つの異なる透過率を有する
    部分が形成されたフォトマスクを用いて前記レジストを
    感光させ、前記レジストを少なくとも二つの異なる膜厚
    に現像することを特徴とする請求項1記載の薄膜のパタ
    ーニング方法。
  4. 【請求項4】 前記レジストは、少なくとも二つの異な
    る感度を有するレジストが積層されたものであることを
    特徴とする請求項2または請求項3記載の薄膜のパター
    ニング方法。
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Cited By (35)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2000164584A (ja) * 1998-11-26 2000-06-16 Samsung Electronics Co Ltd 薄膜の写真エッチング方法及びこれを用いた液晶表示装置用薄膜トランジスタ基板の製造方法
JP2000180898A (ja) * 1998-12-12 2000-06-30 Samsung Electronics Co Ltd 液晶表示装置用薄膜トランジスタ基板及びその製造方法
JP2000206571A (ja) * 1998-12-31 2000-07-28 Samsung Electronics Co Ltd 液晶表示装置用薄膜トランジスタ基板及びその製造方法
JP2001005038A (ja) * 1999-04-26 2001-01-12 Samsung Electronics Co Ltd 表示装置用薄膜トランジスタ基板及びその製造方法
JP2001044439A (ja) * 1999-07-28 2001-02-16 Nec Corp トランジスタ及びその製造方法
JP2001066639A (ja) * 1999-06-03 2001-03-16 Samsung Electronics Co Ltd 液晶表示装置用薄膜トランジスタ基板及びその製造方法
JP2001296557A (ja) * 2000-02-10 2001-10-26 Samsung Electronics Co Ltd 液晶表示装置用薄膜トランジスタ基板及びその製造方法
JP2001358343A (ja) * 2000-04-19 2001-12-26 Samsung Electronics Co Ltd 配線の接触構造及びその形成方法並びにこれを含む薄膜トランジスター基板及びその製造方法
JP2002026333A (ja) * 2000-07-11 2002-01-25 Nec Corp アクティブマトリクス基板の製造方法
WO2002013277A1 (fr) * 2000-08-09 2002-02-14 Advanced Display Inc. Procede permettant de produire un reseau de transistors a couche mince
JP2002055364A (ja) * 2000-05-31 2002-02-20 Hynix Semiconductor Inc 薄膜トランジスタ液晶表示装置製造用フォトマスク
WO2002037574A1 (en) * 2000-11-06 2002-05-10 Advanced Display Inc. Method of patterning thin film and tft array substrate using it and production method therefor
JP2003297850A (ja) * 2002-04-02 2003-10-17 Advanced Display Inc 薄膜トランジスタアレイ及びその製造方法並びにこれを用いた液晶表示装置
JP2004104134A (ja) * 2003-09-12 2004-04-02 Nec Kagoshima Ltd パターン形成方法及び薄膜トランジスタの製造方法
US6762802B2 (en) 2000-05-12 2004-07-13 Renesas Technology Corp. Liquid crystal display device and fabrication method thereof
US6869887B2 (en) 2002-06-04 2005-03-22 Nec Lcd Technologies, Ltd. Method for manufacturing thin film semiconductor device and method for forming resist pattern thereof
JP2005277428A (ja) * 1998-11-19 2005-10-06 Samsung Electronics Co Ltd 薄膜トランジスター基板及びその製造方法
KR100543042B1 (ko) * 1999-06-03 2006-01-20 삼성전자주식회사 액정 표시 장치용 박막 트랜지스터 기판의 제조 방법
KR100560971B1 (ko) * 1999-06-03 2006-03-15 삼성전자주식회사 액정 표시 장치용 박막 트랜지스터 기판의 제조 방법
KR100560975B1 (ko) * 1999-06-16 2006-03-15 삼성전자주식회사 액정 표시 장치용 박막 트랜지스터 기판 및 그 제조 방법
KR100623975B1 (ko) * 1999-05-07 2006-09-13 삼성전자주식회사 박막의 사진 식각 방법 및 이를 이용한 액정 표시 장치용 박막트랜지스터 기판의 제조 방법
KR100586245B1 (ko) * 1998-09-11 2006-10-24 엘지.필립스 엘시디 주식회사 액정 표시 장치 제조 방법
KR100646779B1 (ko) * 1999-08-12 2006-11-17 삼성전자주식회사 박막 트랜지스터 어레이 기판의 제조 방법
KR100656899B1 (ko) * 1999-06-30 2006-12-15 삼성전자주식회사 액정 표시 장치용 박막 트랜지스터 기판의 제조 방법 및 그 정렬 키 구조
JP2007059926A (ja) * 2006-09-27 2007-03-08 Nec Kagoshima Ltd パターン形成方法及び薄膜トランジスタの製造方法
KR100870659B1 (ko) * 2001-12-31 2008-11-26 엘지디스플레이 주식회사 액정표시소자 제조방법
JP2009075613A (ja) * 2008-10-31 2009-04-09 Sakae Tanaka 低コスト表示装置を製造するためのホトマスク構造
JP2009111412A (ja) * 2008-11-28 2009-05-21 Sakae Tanaka 薄膜トランジスタ素子と表示装置
JP2009116341A (ja) * 2008-10-31 2009-05-28 Sakae Tanaka 液晶表示装置とその製造方法
JP2009163247A (ja) * 2008-12-07 2009-07-23 Sakae Tanaka 高性能表示装置とその製造方法
US7602456B2 (en) 2006-05-19 2009-10-13 Mikuni Electoron Co. Ltd Method of manufacturing LCD apparatus by using halftone exposure method
US7615783B2 (en) 2001-02-26 2009-11-10 Samsung Electronics Co., Ltd. Thin film transistor array substrate using low dielectric insulating layer and method of fabricating the same
KR100935671B1 (ko) 2003-03-13 2010-01-07 삼성전자주식회사 박막 트랜지스터 표시판 및 그의 제조 방법
US7847290B2 (en) 2008-03-27 2010-12-07 Mitsubishi Electric Corporation Thin film transistor substrate with divided gate electrode
JP2011186484A (ja) * 1999-09-30 2011-09-22 Samsung Electronics Co Ltd 液晶表示装置用薄膜トランジスタ基板及びその製造方法

Cited By (49)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100586245B1 (ko) * 1998-09-11 2006-10-24 엘지.필립스 엘시디 주식회사 액정 표시 장치 제조 방법
JP4624161B2 (ja) * 1998-11-19 2011-02-02 三星電子株式会社 薄膜トランジスター基板及びその製造方法
JP2005277428A (ja) * 1998-11-19 2005-10-06 Samsung Electronics Co Ltd 薄膜トランジスター基板及びその製造方法
US7888677B2 (en) 1998-11-26 2011-02-15 Samsung Electronics Co., Ltd. Method for manufacturing a thin film transistor array panel for a liquid crystal display and a photolithography method for fabricating thin films
JP2000164584A (ja) * 1998-11-26 2000-06-16 Samsung Electronics Co Ltd 薄膜の写真エッチング方法及びこれを用いた液晶表示装置用薄膜トランジスタ基板の製造方法
JP2000180898A (ja) * 1998-12-12 2000-06-30 Samsung Electronics Co Ltd 液晶表示装置用薄膜トランジスタ基板及びその製造方法
JP2000206571A (ja) * 1998-12-31 2000-07-28 Samsung Electronics Co Ltd 液晶表示装置用薄膜トランジスタ基板及びその製造方法
US7978292B2 (en) 1998-12-31 2011-07-12 Samsung Electronics Co., Ltd. Thin film transistor array panels for a liquid crystal display and a method for manufacturing the same
JP2010085998A (ja) * 1998-12-31 2010-04-15 Samsung Electronics Co Ltd 液晶表示装置用薄膜トランジスタ基板及びその製造方法
JP2010087527A (ja) * 1998-12-31 2010-04-15 Samsung Electronics Co Ltd 液晶表示装置用薄膜トランジスタ基板及びその製造方法
JP2001005038A (ja) * 1999-04-26 2001-01-12 Samsung Electronics Co Ltd 表示装置用薄膜トランジスタ基板及びその製造方法
US7943939B2 (en) 1999-04-26 2011-05-17 Samsung Electronics Co., Ltd. Thin film transistor array panel and methods for manufacturing the same
KR100623975B1 (ko) * 1999-05-07 2006-09-13 삼성전자주식회사 박막의 사진 식각 방법 및 이를 이용한 액정 표시 장치용 박막트랜지스터 기판의 제조 방법
JP4694671B2 (ja) * 1999-06-03 2011-06-08 三星電子株式会社 液晶表示装置用薄膜トランジスタ基板及びその製造方法
USRE42670E1 (en) 1999-06-03 2011-09-06 Samsung Electronics Co., Ltd. Thin film transistor array substrate for a liquid crystal display
JP2011034105A (ja) * 1999-06-03 2011-02-17 Samsung Electronics Co Ltd 液晶表示装置用薄膜トランジスタ基板及びその製造方法
KR100543042B1 (ko) * 1999-06-03 2006-01-20 삼성전자주식회사 액정 표시 장치용 박막 트랜지스터 기판의 제조 방법
KR100560971B1 (ko) * 1999-06-03 2006-03-15 삼성전자주식회사 액정 표시 장치용 박막 트랜지스터 기판의 제조 방법
JP2001066639A (ja) * 1999-06-03 2001-03-16 Samsung Electronics Co Ltd 液晶表示装置用薄膜トランジスタ基板及びその製造方法
KR100560975B1 (ko) * 1999-06-16 2006-03-15 삼성전자주식회사 액정 표시 장치용 박막 트랜지스터 기판 및 그 제조 방법
KR100656899B1 (ko) * 1999-06-30 2006-12-15 삼성전자주식회사 액정 표시 장치용 박막 트랜지스터 기판의 제조 방법 및 그 정렬 키 구조
JP2001044439A (ja) * 1999-07-28 2001-02-16 Nec Corp トランジスタ及びその製造方法
KR100646779B1 (ko) * 1999-08-12 2006-11-17 삼성전자주식회사 박막 트랜지스터 어레이 기판의 제조 방법
JP2011186484A (ja) * 1999-09-30 2011-09-22 Samsung Electronics Co Ltd 液晶表示装置用薄膜トランジスタ基板及びその製造方法
JP2001296557A (ja) * 2000-02-10 2001-10-26 Samsung Electronics Co Ltd 液晶表示装置用薄膜トランジスタ基板及びその製造方法
JP2001358343A (ja) * 2000-04-19 2001-12-26 Samsung Electronics Co Ltd 配線の接触構造及びその形成方法並びにこれを含む薄膜トランジスター基板及びその製造方法
KR100467993B1 (ko) * 2000-05-12 2005-01-24 가부시키가이샤 히타치세이사쿠쇼 액정 표시 장치
US6762802B2 (en) 2000-05-12 2004-07-13 Renesas Technology Corp. Liquid crystal display device and fabrication method thereof
JP2002055364A (ja) * 2000-05-31 2002-02-20 Hynix Semiconductor Inc 薄膜トランジスタ液晶表示装置製造用フォトマスク
JP2002026333A (ja) * 2000-07-11 2002-01-25 Nec Corp アクティブマトリクス基板の製造方法
US6884569B2 (en) 2000-08-09 2005-04-26 Advanced Display, Inc. Method of manufacturing TFT array
JP2002057338A (ja) * 2000-08-09 2002-02-22 Advanced Display Inc Tftアレイの製造方法
WO2002013277A1 (fr) * 2000-08-09 2002-02-14 Advanced Display Inc. Procede permettant de produire un reseau de transistors a couche mince
WO2002037574A1 (en) * 2000-11-06 2002-05-10 Advanced Display Inc. Method of patterning thin film and tft array substrate using it and production method therefor
US7157319B2 (en) 2000-11-06 2007-01-02 Advanced Display Inc. Method of patterning a thin film transistor that includes simultaneously forming a gate electrode and a pixel electrode
US7615783B2 (en) 2001-02-26 2009-11-10 Samsung Electronics Co., Ltd. Thin film transistor array substrate using low dielectric insulating layer and method of fabricating the same
KR100870659B1 (ko) * 2001-12-31 2008-11-26 엘지디스플레이 주식회사 액정표시소자 제조방법
JP2003297850A (ja) * 2002-04-02 2003-10-17 Advanced Display Inc 薄膜トランジスタアレイ及びその製造方法並びにこれを用いた液晶表示装置
US7476470B2 (en) 2002-06-04 2009-01-13 Nec Lcd Technologies, Ltd. Method for manufacturing thin film semiconductor device and method for forming resist pattern thereof
US6869887B2 (en) 2002-06-04 2005-03-22 Nec Lcd Technologies, Ltd. Method for manufacturing thin film semiconductor device and method for forming resist pattern thereof
KR100935671B1 (ko) 2003-03-13 2010-01-07 삼성전자주식회사 박막 트랜지스터 표시판 및 그의 제조 방법
JP2004104134A (ja) * 2003-09-12 2004-04-02 Nec Kagoshima Ltd パターン形成方法及び薄膜トランジスタの製造方法
US7602456B2 (en) 2006-05-19 2009-10-13 Mikuni Electoron Co. Ltd Method of manufacturing LCD apparatus by using halftone exposure method
JP2007059926A (ja) * 2006-09-27 2007-03-08 Nec Kagoshima Ltd パターン形成方法及び薄膜トランジスタの製造方法
US7847290B2 (en) 2008-03-27 2010-12-07 Mitsubishi Electric Corporation Thin film transistor substrate with divided gate electrode
JP2009075613A (ja) * 2008-10-31 2009-04-09 Sakae Tanaka 低コスト表示装置を製造するためのホトマスク構造
JP2009116341A (ja) * 2008-10-31 2009-05-28 Sakae Tanaka 液晶表示装置とその製造方法
JP2009111412A (ja) * 2008-11-28 2009-05-21 Sakae Tanaka 薄膜トランジスタ素子と表示装置
JP2009163247A (ja) * 2008-12-07 2009-07-23 Sakae Tanaka 高性能表示装置とその製造方法

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