JPH0646245A - 文書画像データの解像度及び階調変換装置 - Google Patents
文書画像データの解像度及び階調変換装置Info
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- JPH0646245A JPH0646245A JP3307852A JP30785291A JPH0646245A JP H0646245 A JPH0646245 A JP H0646245A JP 3307852 A JP3307852 A JP 3307852A JP 30785291 A JP30785291 A JP 30785291A JP H0646245 A JPH0646245 A JP H0646245A
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- 238000001514 detection method Methods 0.000 claims description 24
- 238000004148 unit process Methods 0.000 claims 1
- 238000000034 method Methods 0.000 abstract description 5
- 238000010586 diagram Methods 0.000 description 15
- 208000015560 TCR-alpha-beta-positive T-cell deficiency Diseases 0.000 description 3
- 208000018099 immunodeficiency 7 Diseases 0.000 description 3
- 241001270131 Agaricus moelleri Species 0.000 description 2
- 230000005540 biological transmission Effects 0.000 description 2
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- 101001055227 Homo sapiens Cytokine receptor common subunit gamma Proteins 0.000 description 1
- 239000000284 extract Substances 0.000 description 1
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N1/00—Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
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- G—PHYSICS
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- G06T3/00—Geometric image transformations in the plane of the image
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- H04N1/40—Picture signal circuits
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Abstract
(57)【要約】
【目的】 文書画像データの解像度及び階調変換装置を
提供することを目的とする。 【構成】 画像制御データの変換値をセッティングする
ラッチ部と、解像度変換クロック信号を発生する解像度
変換クロック発生部と、画素クロック信号を選択するク
ロック選択部と、階調変換によるバイト検出クロック信
号を単位データで検出する単位データ検出部と、画像デ
ータの階調変換及び画像２値化処理を遂行する画像デー
タ変換部と、前記画像データ変換部の画像データ階調を
選択する画像データ選択部と、選択された階調の画像デ
ータ出力部を含む。 【効果】 これにより、画像データ処理を高速で行い、
ハードウェア的に解像度及び階調制御処理するので互換
性及び適用性が広い。
提供することを目的とする。 【構成】 画像制御データの変換値をセッティングする
ラッチ部と、解像度変換クロック信号を発生する解像度
変換クロック発生部と、画素クロック信号を選択するク
ロック選択部と、階調変換によるバイト検出クロック信
号を単位データで検出する単位データ検出部と、画像デ
ータの階調変換及び画像２値化処理を遂行する画像デー
タ変換部と、前記画像データ変換部の画像データ階調を
選択する画像データ選択部と、選択された階調の画像デ
ータ出力部を含む。 【効果】 これにより、画像データ処理を高速で行い、
ハードウェア的に解像度及び階調制御処理するので互換
性及び適用性が広い。
Description
【０００１】
【産業上の利用分野】本発明は文書画像データの解像度
及び階調変換装置に係り、特にイメージスキャナとファ
クシミリ及びディジタル複写機等のような文書画像入力
／出力装置の多様な性能にかなえるよう入力画像データ
の解像度と階調を変換し得る装置に関する。
及び階調変換装置に係り、特にイメージスキャナとファ
クシミリ及びディジタル複写機等のような文書画像入力
／出力装置の多様な性能にかなえるよう入力画像データ
の解像度と階調を変換し得る装置に関する。
【０００２】
【従来の技術】イメージスキャナ、ファクシミリ、ディ
ジタル複写機等のように文書画像を取り扱う装置におい
て、画質を決定する要素は解像度と階調である。通常的
な文書画像入力／出力装置において解像度は１インチ当
たり何個の画素まで示せるかを意味するｄｐｉという単
位に示し、階調は１画素当たり明暗の区別をどの程度ま
でできるかを決定する。前記階調は１画素当たりのデー
タの大きさにより決定され、１画素当たり１ビットの場
合は黒と白の２階調、４ビットの場合は１６階調、８ビ
ットの場合は２５６階調になる。ただ、擬似中間調の場
合は１画素当たり１ビットであっても面積階調として擬
似的に階調を拡張する。
ジタル複写機等のように文書画像を取り扱う装置におい
て、画質を決定する要素は解像度と階調である。通常的
な文書画像入力／出力装置において解像度は１インチ当
たり何個の画素まで示せるかを意味するｄｐｉという単
位に示し、階調は１画素当たり明暗の区別をどの程度ま
でできるかを決定する。前記階調は１画素当たりのデー
タの大きさにより決定され、１画素当たり１ビットの場
合は黒と白の２階調、４ビットの場合は１６階調、８ビ
ットの場合は２５６階調になる。ただ、擬似中間調の場
合は１画素当たり１ビットであっても面積階調として擬
似的に階調を拡張する。
【０００３】一般に、より良質の画像データを得るため
にはより高い解像度とより高い階調を有するべきであ
る。これを達成するためには前記両方のデータの大きさ
が大きくなるべきである。従って、画像データの利用目
的とこれを取り扱う装置の特性により解像度または階調
を色々変化させる必要が高まっている。
にはより高い解像度とより高い階調を有するべきであ
る。これを達成するためには前記両方のデータの大きさ
が大きくなるべきである。従って、画像データの利用目
的とこれを取り扱う装置の特性により解像度または階調
を色々変化させる必要が高まっている。
【０００４】一例としてイメージスキャナを用いて文書
画像を入力し、その入力された画像をレーザビームプリ
ンタ等のようなプリンタに出力させる時、プリンタは１
画素当り白黒の２種類の階調しか表現できないので階調
は１画素当たり１ビット、即ち２階調にすべき反面、解
像度はプリンタの性能により１８０ｄｐｉ，２４０ｄｐ
ｉ，３００ｄｐｉ，４００ｄｐｉまたはその以上で多様
である。従って、イメージスキャナにおいてはこれらの
プリンタの出力解像度に相応する解像度の画像を読み取
れるべきである。
画像を入力し、その入力された画像をレーザビームプリ
ンタ等のようなプリンタに出力させる時、プリンタは１
画素当り白黒の２種類の階調しか表現できないので階調
は１画素当たり１ビット、即ち２階調にすべき反面、解
像度はプリンタの性能により１８０ｄｐｉ，２４０ｄｐ
ｉ，３００ｄｐｉ，４００ｄｐｉまたはその以上で多様
である。従って、イメージスキャナにおいてはこれらの
プリンタの出力解像度に相応する解像度の画像を読み取
れるべきである。
【０００５】一方、イメージスキャナを用いて入力した
画像をグラフィックモニタに出力しようとする時、グラ
フィックモニタの解像度は１ライン当たり１，０００画
素内外に過ぎず、階調はモニタの種類により２階調、１
６階調、２５６階調など多様である。従って、前述した
通りの場合においては解像度と階調をモニタに相応する
条件で画像データを受けて出力させるべきである。
画像をグラフィックモニタに出力しようとする時、グラ
フィックモニタの解像度は１ライン当たり１，０００画
素内外に過ぎず、階調はモニタの種類により２階調、１
６階調、２５６階調など多様である。従って、前述した
通りの場合においては解像度と階調をモニタに相応する
条件で画像データを受けて出力させるべきである。
【０００６】前記のイメージスキャナを初めて文書画像
入力装置において従来の関連装置、即ち、レーザプリン
タとモニタの性能限界によって解像度及び階調は幾つか
のモードのみを採用しいるのでこれらとインターフェー
スのためのデータ処理は割合に容易である。しかし、シ
ステム及びその関連装置の複合化と多様な機能のみなら
ず、画像データの利用目的が細分化及び多様化されるに
つれ、解像度及び階調の多段階に及ぶ制御が必要となっ
た。従来には解像度及び階調を制御するそふとウェアを
用いて解決してきたが、これは文書画像データ量が非常
に膨大なので処理に長時間かかり、かつ解像度と階調を
同時に変換できなくて複雑な処理段階を要求しており、
システムの効率が落ちることになる。
入力装置において従来の関連装置、即ち、レーザプリン
タとモニタの性能限界によって解像度及び階調は幾つか
のモードのみを採用しいるのでこれらとインターフェー
スのためのデータ処理は割合に容易である。しかし、シ
ステム及びその関連装置の複合化と多様な機能のみなら
ず、画像データの利用目的が細分化及び多様化されるに
つれ、解像度及び階調の多段階に及ぶ制御が必要となっ
た。従来には解像度及び階調を制御するそふとウェアを
用いて解決してきたが、これは文書画像データ量が非常
に膨大なので処理に長時間かかり、かつ解像度と階調を
同時に変換できなくて複雑な処理段階を要求しており、
システムの効率が落ちることになる。
【０００７】
【発明が解決しようとする課題】従って、本発明は前述
した問題点を解決するために創出されたもので、プリン
タ、ファクシミリ、グラフィック等のように多様な装置
の特性及び性能にかなう画像データの獲得のために関連
装置の特性に合わせて入力画像データの解像度と階調の
変換が入力装置で直接に処理できるようにする文書画像
データの解像度及び階調変換装置を提供することであ
る。
した問題点を解決するために創出されたもので、プリン
タ、ファクシミリ、グラフィック等のように多様な装置
の特性及び性能にかなう画像データの獲得のために関連
装置の特性に合わせて入力画像データの解像度と階調の
変換が入力装置で直接に処理できるようにする文書画像
データの解像度及び階調変換装置を提供することであ
る。
【０００８】
【課題を解決するための手段】前述した目的を達成する
ために、本発明による文書画像データの解像度及び階調
変換装置は画像制御データを受けて所望の解像度と階調
を有する画像制御データに変換させるために変数値をセ
ッティングするラッチ部と、画像制御データの入力速度
に準じるマスタクロック信号に応じて前記ラッチ部で変
数値がセッティングされた画像制御データの解像度を変
換させるために解像度変換クロック信号を発生する解像
度変換クロック発生部と、画像制御データの入力速度に
準じるマスタクロック信号に応じて前記解像度クロック
発生部で伝送されるクロック信号中にラッチ部で入力さ
れる画像制御データの動作モード及び動作順序に適当な
画素クロック信号を選択するクロック選択部と、前記ク
ロック選択部で伝送される画素クロック信号をカウント
して階調変換による出力制御信号をバイト単位に検出す
る単位データ検出部と、前記クロック選択部で伝送され
る画素クロック信号に応じて入力された画像データの階
調変換及び画像２値化処理を行う画像データ変換部と、
前記ラッチ部でセッティングされた制御データと前記単
位データ検出部で供給するバイト検出クロック信号に応
じた画像データ階調を選択する画像データ選択部と、前
記画像データ選択部で選択された画像データ階調選択信
号に応じてイネーブルされ前記クロック選択部で供給さ
れた画素クロック信号に応じて解像度及び階調変換され
た画像データをバイト単位で出力する画像データ出力部
を含むことを特徴とする。
ために、本発明による文書画像データの解像度及び階調
変換装置は画像制御データを受けて所望の解像度と階調
を有する画像制御データに変換させるために変数値をセ
ッティングするラッチ部と、画像制御データの入力速度
に準じるマスタクロック信号に応じて前記ラッチ部で変
数値がセッティングされた画像制御データの解像度を変
換させるために解像度変換クロック信号を発生する解像
度変換クロック発生部と、画像制御データの入力速度に
準じるマスタクロック信号に応じて前記解像度クロック
発生部で伝送されるクロック信号中にラッチ部で入力さ
れる画像制御データの動作モード及び動作順序に適当な
画素クロック信号を選択するクロック選択部と、前記ク
ロック選択部で伝送される画素クロック信号をカウント
して階調変換による出力制御信号をバイト単位に検出す
る単位データ検出部と、前記クロック選択部で伝送され
る画素クロック信号に応じて入力された画像データの階
調変換及び画像２値化処理を行う画像データ変換部と、
前記ラッチ部でセッティングされた制御データと前記単
位データ検出部で供給するバイト検出クロック信号に応
じた画像データ階調を選択する画像データ選択部と、前
記画像データ選択部で選択された画像データ階調選択信
号に応じてイネーブルされ前記クロック選択部で供給さ
れた画素クロック信号に応じて解像度及び階調変換され
た画像データをバイト単位で出力する画像データ出力部
を含むことを特徴とする。
【０００９】
【作用】本発明は利用目的と関連出力装置の性能及び特
性にかなう画像データで解像度と階調を制御することが
できる。また、画像データの解像度及び階調制御をハー
ドウェア的に処理する。
性にかなう画像データで解像度と階調を制御することが
できる。また、画像データの解像度及び階調制御をハー
ドウェア的に処理する。
【００１０】
【実施例】以下、添付した図面に基づいて、図１に示し
た解像度及び階調変換装置を詳細に説明する。
た解像度及び階調変換装置を詳細に説明する。
【００１１】図１によれば、本発明による文書画像デー
タの解像度及び階調変換装置は実際画像データを変換す
るための制御信号を発生する制御信号発生部１０と、こ
の制御信号に応じて実際画像データを変換する画像デー
タ処理部２０より構成される。この制御信号発生部１０
はラッチ部１００と、解像度変換クロック発生器２００
と、クロック選択器３００及び単位データ検出器４００
を含んでいる。この制御信号発生部１０は実際画像デー
タの解像度と階調を変換するための制御信号を発生す
る。
タの解像度及び階調変換装置は実際画像データを変換す
るための制御信号を発生する制御信号発生部１０と、こ
の制御信号に応じて実際画像データを変換する画像デー
タ処理部２０より構成される。この制御信号発生部１０
はラッチ部１００と、解像度変換クロック発生器２００
と、クロック選択器３００及び単位データ検出器４００
を含んでいる。この制御信号発生部１０は実際画像デー
タの解像度と階調を変換するための制御信号を発生す
る。
【００１２】続いて、画像データ処理部２０は前記制御
信号発生部１０からの制御信号に応じて入力された画像
データを変換して出力する機能を有し、画像データ変換
部５００と画像データ選択器６００及び画像データ出力
部７００を含んでいる。
信号発生部１０からの制御信号に応じて入力された画像
データを変換して出力する機能を有し、画像データ変換
部５００と画像データ選択器６００及び画像データ出力
部７００を含んでいる。
【００１３】図３によれば、ラッチ部１００は８ビット
ラッチ１１０とデコーダ１２０を含んでいる。この８ビ
ットラッチ１１０は画像制御データＣＤ０〜ＣＤ７を受
けて外部のラッチイネーブル信号が“ハイ”レベルにな
ればその瞬間画像制御データＣＤ０〜ＣＤ７を貯蔵して
変数値をセッティングしている。この８ビットラッチ１
１０は貯蔵された画像制御データ中４ビットの選択信号
Ｓ０〜Ｓ３をデコーダ１２０に供給すると同時にクロッ
ク選択部３００に供給する。前記デコーダ１２０は８ビ
ットラッチ１１０に一時貯蔵された画像制御データＣＤ
０〜ＣＤ７中の４ビット変数値をデコーディングしてフ
レセット信号Ｐ０〜Ｐ３を出力している。
ラッチ１１０とデコーダ１２０を含んでいる。この８ビ
ットラッチ１１０は画像制御データＣＤ０〜ＣＤ７を受
けて外部のラッチイネーブル信号が“ハイ”レベルにな
ればその瞬間画像制御データＣＤ０〜ＣＤ７を貯蔵して
変数値をセッティングしている。この８ビットラッチ１
１０は貯蔵された画像制御データ中４ビットの選択信号
Ｓ０〜Ｓ３をデコーダ１２０に供給すると同時にクロッ
ク選択部３００に供給する。前記デコーダ１２０は８ビ
ットラッチ１１０に一時貯蔵された画像制御データＣＤ
０〜ＣＤ７中の４ビット変数値をデコーディングしてフ
レセット信号Ｐ０〜Ｐ３を出力している。
【００１４】図４によれば、解像度変換クロック発生部
２００はマスタクロック信号ＭＣＬＫに応じてＶＤＥＮ
（Valid Data Enable)信号と前記ラッチ部１００のデコ
ーダ１２０で供給されるフレセット信号Ｐ０〜Ｐ３を受
けてクロック選択器３００のための解像度変換クロック
信号を発生し、カウンター２１０、インバータ２２０、
ＡＮＤゲート２３０，２３１，２３２，２３３及びＯＲ
ゲート２４０より構成される。
２００はマスタクロック信号ＭＣＬＫに応じてＶＤＥＮ
（Valid Data Enable)信号と前記ラッチ部１００のデコ
ーダ１２０で供給されるフレセット信号Ｐ０〜Ｐ３を受
けてクロック選択器３００のための解像度変換クロック
信号を発生し、カウンター２１０、インバータ２２０、
ＡＮＤゲート２３０，２３１，２３２，２３３及びＯＲ
ゲート２４０より構成される。
【００１５】また、図４によれば、クロック選択部３０
０はマスタクロック信号ＭＣＬＫと前記解像度変換クロ
ック発生部２００のＡＮＤゲート２３０，２３１，２３
３で出力されるクロック信号と前記ラッチ部１００で供
給されるセレクト信号Ｓ０〜Ｓ２とその反転されたセレ
クト信号を論理組合わせて画像制御データの動作モード
及び動作順序に適当な画素クロック信号ＰＣＬＫを生成
するようにインバータ３１０，３１１，３１２、ＡＮＤ
ゲート３２０，３２１，３２２，３２３，３２４、ＯＲ
ゲート３２５及びＤフリップフロップ３３０，３３１よ
り構成される。図５において、単位データ検出部４００
は前記クロック選択部３００のＤフリップフロップ３３
１で伝送される画素クロック信号ＰＣＬＫをカウントし
て階調変換によるバイト検出出力信号ＷＣＬＫをバイト
単位に検出するためにＤフリップフロップ４１０、カウ
ンター４２０、インバータ４３０，４３１，４３２，４
３３、ＡＮＤゲート４４０，４４１，４４２及びＯＲゲ
ート４５０より構成される。
０はマスタクロック信号ＭＣＬＫと前記解像度変換クロ
ック発生部２００のＡＮＤゲート２３０，２３１，２３
３で出力されるクロック信号と前記ラッチ部１００で供
給されるセレクト信号Ｓ０〜Ｓ２とその反転されたセレ
クト信号を論理組合わせて画像制御データの動作モード
及び動作順序に適当な画素クロック信号ＰＣＬＫを生成
するようにインバータ３１０，３１１，３１２、ＡＮＤ
ゲート３２０，３２１，３２２，３２３，３２４、ＯＲ
ゲート３２５及びＤフリップフロップ３３０，３３１よ
り構成される。図５において、単位データ検出部４００
は前記クロック選択部３００のＤフリップフロップ３３
１で伝送される画素クロック信号ＰＣＬＫをカウントし
て階調変換によるバイト検出出力信号ＷＣＬＫをバイト
単位に検出するためにＤフリップフロップ４１０、カウ
ンター４２０、インバータ４３０，４３１，４３２，４
３３、ＡＮＤゲート４４０，４４１，４４２及びＯＲゲ
ート４５０より構成される。
【００１６】図６において、画像データ変換部５００は
前記クロック選択部３００で伝送される画素クロック信
号ＰＣＬＫに応じて入力された画像データの階調変換及
び画像２値化処理を行うよう多重イメージ／２値イメー
ジコンバータ５１０とＤフリップフロップ５２０、イン
バータ５３０及び４ビットラッチ５４０より構成され
る。
前記クロック選択部３００で伝送される画素クロック信
号ＰＣＬＫに応じて入力された画像データの階調変換及
び画像２値化処理を行うよう多重イメージ／２値イメー
ジコンバータ５１０とＤフリップフロップ５２０、イン
バータ５３０及び４ビットラッチ５４０より構成され
る。
【００１７】また、図６において、画像データ選択部６
００は前記ラッチ部１００の８ビットラッチ部１１０で
伝送されるスキャン信号ＳＣ０〜ＳＣ３と前記単位デー
タ検出部４００で供給されるバイト検出クロック信号Ｗ
ＣＬＫに応じて出力イネーブル信号を画像データ出力部
７００に供給することにより、画像データ変換部５００
の画像データ階調を選択するようインバータ６１０，６
１１，６１２、ＡＮＤゲート６２０及びＮＡＮＤゲート
６３０，６３１，６３２より構成される。
００は前記ラッチ部１００の８ビットラッチ部１１０で
伝送されるスキャン信号ＳＣ０〜ＳＣ３と前記単位デー
タ検出部４００で供給されるバイト検出クロック信号Ｗ
ＣＬＫに応じて出力イネーブル信号を画像データ出力部
７００に供給することにより、画像データ変換部５００
の画像データ階調を選択するようインバータ６１０，６
１１，６１２、ＡＮＤゲート６２０及びＮＡＮＤゲート
６３０，６３１，６３２より構成される。
【００１８】図６において、画像データ出力部７００は
前記画像データ選択部６００で選択された画像データ選
択階調信号に応じてイネーブルされ、前記クロック選択
部３００で供給された画素クロック信号に応じて解像度
及び階調変換された画像データをバイト単位に出力する
ようシフトレジスタ７３０及びラッチ部７３１，７３２
より構成される。前述した通りの構成を有する本発明を
より詳細に説明すると次の通りである。図１によれば、
本実施例においては画像データ変換部５００に入力され
る画像データＩＭＤ０〜ＩＭＤ７が３００ｄｐｉの２５
６階調、即ち８ビット／画素文書画像データと仮定して
これを３００ｄｐｉ、２４０ｄｐｉ、２００ｄｐｉ、１
８０ｄｐｉ、７５ｄｐｉ等の解像度に変換し、階調をそ
れぞれの解像度で８ビット／画素（２５６変調）、４ビ
ット／画素（１６階調）及び１ビット／画素（単純２
値、デザリング）で処理できるものに限って説明する。
前記画像データ選択部６００で選択された画像データ選
択階調信号に応じてイネーブルされ、前記クロック選択
部３００で供給された画素クロック信号に応じて解像度
及び階調変換された画像データをバイト単位に出力する
ようシフトレジスタ７３０及びラッチ部７３１，７３２
より構成される。前述した通りの構成を有する本発明を
より詳細に説明すると次の通りである。図１によれば、
本実施例においては画像データ変換部５００に入力され
る画像データＩＭＤ０〜ＩＭＤ７が３００ｄｐｉの２５
６階調、即ち８ビット／画素文書画像データと仮定して
これを３００ｄｐｉ、２４０ｄｐｉ、２００ｄｐｉ、１
８０ｄｐｉ、７５ｄｐｉ等の解像度に変換し、階調をそ
れぞれの解像度で８ビット／画素（２５６変調）、４ビ
ット／画素（１６階調）及び１ビット／画素（単純２
値、デザリング）で処理できるものに限って説明する。
【００１９】ラッチ部１００は画像データ変換部５００
に入力される本来の文書画像データＩＭＤ０〜ＩＭＤ７
を所望の解像度と階調の画像データＩＭ０〜ＩＭ７に変
換させるために所望の解像度と階調に相応する変数値を
セッティングする。
に入力される本来の文書画像データＩＭＤ０〜ＩＭＤ７
を所望の解像度と階調の画像データＩＭ０〜ＩＭ７に変
換させるために所望の解像度と階調に相応する変数値を
セッティングする。
【００２０】前記ラッチ部１００は３００ｄｐｉ，２４
０ｄｐｉ，２００ｄｐｉ，１８０ｄｐｉ，７５ｄｐｉ等
の解像度に変換するための変数値と８ビット／画素、４
ビット／画素、単純２値データ、擬似中間調データ等の
階調を示す変数値が貯蔵されるよう、図３に示した通り
にラッチ部１００の８ビットラッチ１１０に制御データ
ＣＤ０〜ＣＤ７を入力してラッチイネーブル信号を“ハ
イ”状態に８ビットラッチ部１１０に印加する。
０ｄｐｉ，２００ｄｐｉ，１８０ｄｐｉ，７５ｄｐｉ等
の解像度に変換するための変数値と８ビット／画素、４
ビット／画素、単純２値データ、擬似中間調データ等の
階調を示す変数値が貯蔵されるよう、図３に示した通り
にラッチ部１００の８ビットラッチ１１０に制御データ
ＣＤ０〜ＣＤ７を入力してラッチイネーブル信号を“ハ
イ”状態に８ビットラッチ部１１０に印加する。
【００２１】前記制御データＣＤ０〜ＣＤ７の構成は図
２に示した通りの形式を有するところ、解像度制御コー
ドＣＤ０〜ＣＤ２と階調制御コードＣＤ４，ＣＤ５，Ｃ
Ｄ６及び予備コードＣＤ３，ＣＤ７より構成される。
２に示した通りの形式を有するところ、解像度制御コー
ドＣＤ０〜ＣＤ２と階調制御コードＣＤ４，ＣＤ５，Ｃ
Ｄ６及び予備コードＣＤ３，ＣＤ７より構成される。
【００２２】前記図２及び図３の例においては、解像度
制御コードと階調制御コードを１バイト以内に示したも
のに限ったが、実際の具現において解像度と階調の制御
段階をより多くの段階にするためには制御データの解像
度制御コードと階調制御コードを２個の別途ラッチに分
けて具現すればすむ。ただ、本実施例においては解像度
を３００ｄｐｉ，２４０ｄｐｉ，２００ｄｐｉ，１８０
ｄｐｉ，７５ｄｐｉの５個に限定して説明するので解像
度制御コードを３ビットに設定し、また階調制御コード
も８ビット／画素、４ビット／画素、単純２値処理、擬
似中間調処理等４個の処理モードに限定されたので３ビ
ットに設定した。即ち、解像度制御を２５６種類に拡張
するためには１バイトコードに設定し、かつ階調制御を
拡張するためには１バイトコードに拡張させれば良い。
制御コードと階調制御コードを１バイト以内に示したも
のに限ったが、実際の具現において解像度と階調の制御
段階をより多くの段階にするためには制御データの解像
度制御コードと階調制御コードを２個の別途ラッチに分
けて具現すればすむ。ただ、本実施例においては解像度
を３００ｄｐｉ，２４０ｄｐｉ，２００ｄｐｉ，１８０
ｄｐｉ，７５ｄｐｉの５個に限定して説明するので解像
度制御コードを３ビットに設定し、また階調制御コード
も８ビット／画素、４ビット／画素、単純２値処理、擬
似中間調処理等４個の処理モードに限定されたので３ビ
ットに設定した。即ち、解像度制御を２５６種類に拡張
するためには１バイトコードに設定し、かつ階調制御を
拡張するためには１バイトコードに拡張させれば良い。
【００２３】前記ラッチ部１００の８ビットラッチ１１
０を用いて下記表１及び表２のような該当コードがセッ
ティングされれば、この８ビットラッチ１１０は出力端
Ｑ０〜Ｑ３を通じて解像度制御コードをデコーダ１２０
及びクロック選択部３００にＳ０〜Ｓ３信号で出力さ
せ、階調制御コードを出力端Ｑ４〜Ｑ７を通じてスキャ
ン信号ＳＣ０〜ＳＣ３で単位データ検出部４００及び画
像データ選択部６００に入力させる。
０を用いて下記表１及び表２のような該当コードがセッ
ティングされれば、この８ビットラッチ１１０は出力端
Ｑ０〜Ｑ３を通じて解像度制御コードをデコーダ１２０
及びクロック選択部３００にＳ０〜Ｓ３信号で出力さ
せ、階調制御コードを出力端Ｑ４〜Ｑ７を通じてスキャ
ン信号ＳＣ０〜ＳＣ３で単位データ検出部４００及び画
像データ選択部６００に入力させる。
【００２４】
【表１】
【００２５】
【表２】
【００２６】前記表１，表２においてＲと表示されたＣ
Ｄ３及びＣＤ６ビットは解像度制御コード拡張等の予備
ビットであって数の状態（don't care) である。
Ｄ３及びＣＤ６ビットは解像度制御コード拡張等の予備
ビットであって数の状態（don't care) である。
【００２７】図４は解像度変換クロック発生部２００と
クロック選択部３００の実施例図であって、図３に示し
た８ビットラッチ１１０とデコーダ１２０の出力信号を
受けて回路動作状態を決定する。
クロック選択部３００の実施例図であって、図３に示し
た８ビットラッチ１１０とデコーダ１２０の出力信号を
受けて回路動作状態を決定する。
【００２８】図４のマスタクロックＭＣＬＫはここで記
述されないイメージセンサで出力する画素データクロッ
ク信号の２倍に相応する周波数を有するクロック信号で
あってデューティサイクルは５０％である。また、ＶＤ
ＥＮは有効データの開始を終了を知らせる信号であって
イメージセンサが 実際１ラインのデータを読み取って
出力させる期間を知らせる信号である。前記解像度変換
クロック発生部２００に入力されるプレセット信号Ｐ０
〜Ｐ３はカウンター２１０のフレセット値であって、図
３に示したデコーダ１２０で出力されカウンター２１０
の周期を決定する。前記デコーダ１２０の出力は次の式
１により決定される。ここで、イメージセンサの出力解
像度をＳＲとし、この出力解像度を変換して得ようとす
る解像度をＷＲとすれば、イメージセンサの出力解像度
によるプレセット値は
述されないイメージセンサで出力する画素データクロッ
ク信号の２倍に相応する周波数を有するクロック信号で
あってデューティサイクルは５０％である。また、ＶＤ
ＥＮは有効データの開始を終了を知らせる信号であって
イメージセンサが 実際１ラインのデータを読み取って
出力させる期間を知らせる信号である。前記解像度変換
クロック発生部２００に入力されるプレセット信号Ｐ０
〜Ｐ３はカウンター２１０のフレセット値であって、図
３に示したデコーダ１２０で出力されカウンター２１０
の周期を決定する。前記デコーダ１２０の出力は次の式
１により決定される。ここで、イメージセンサの出力解
像度をＳＲとし、この出力解像度を変換して得ようとす
る解像度をＷＲとすれば、イメージセンサの出力解像度
によるプレセット値は
【００２９】
【数１】
【００３０】である。ただし、Ｇ・Ｃ・Ｍは最大公約数
である。
である。
【００３１】従って、イメージセンサの出力解像度が３
００ｄｐｉの場合、これを２４０ｄｐｉ解像度の画像に
変換するためのプレセット値は前記（１）式により次の
通りである。
００ｄｐｉの場合、これを２４０ｄｐｉ解像度の画像に
変換するためのプレセット値は前記（１）式により次の
通りである。
【００３２】
【数２】
【００３３】従って、前記のように３００ｄｐｉ画像を
２４０ｄｐｉ画像に変換するためには解像度変換クロッ
ク発生部２００のカウンター２１０に印加されるプレセ
ット値を１０とセッティングしてカウンター周期が１０
である２進カウンターとして動作させればよい。
２４０ｄｐｉ画像に変換するためには解像度変換クロッ
ク発生部２００のカウンター２１０に印加されるプレセ
ット値を１０とセッティングしてカウンター周期が１０
である２進カウンターとして動作させればよい。
【００３４】一方、（１）式によって、図４のカウンタ
ー２１０に印加されるプレセット値を決定してカウンタ
ーの動作周期を決定すれば、カウンター２１０に印加さ
れるマスタクロックＭＣＬＫが（１）式の周期ごとに所
定のクロックパルスを選択することにより解像度変換が
なされる。従って、変換される解像度によって（１）式
の周期ごとに選択すべきクロックパルスの数を示せば
（２）式の通りである。
ー２１０に印加されるプレセット値を決定してカウンタ
ーの動作周期を決定すれば、カウンター２１０に印加さ
れるマスタクロックＭＣＬＫが（１）式の周期ごとに所
定のクロックパルスを選択することにより解像度変換が
なされる。従って、変換される解像度によって（１）式
の周期ごとに選択すべきクロックパルスの数を示せば
（２）式の通りである。
【００３５】
【数３】
【００３６】である。
【００３７】一方、解像度変換のために（１）式に示さ
れるクロック周期ごとに（２）式に示されるクロックを
選択することは言い換えれば（１）式の周期毎に幾つか
のクロックパルスを除去することのような結果がもたら
せる。従って、解像度変換のために（１）式の周期ごと
に除去すべきクロックパルス数は、（１）式から（２）
式を減算させればよい。即ち、（１）式の周期毎に除去
すべきクロックパルス数は（３）式の通りである。
れるクロック周期ごとに（２）式に示されるクロックを
選択することは言い換えれば（１）式の周期毎に幾つか
のクロックパルスを除去することのような結果がもたら
せる。従って、解像度変換のために（１）式の周期ごと
に除去すべきクロックパルス数は、（１）式から（２）
式を減算させればよい。即ち、（１）式の周期毎に除去
すべきクロックパルス数は（３）式の通りである。
【００３８】
【数４】
【００３９】イメージセンサの出力解像度が３００ｄｐ
ｉから２４０ｄｐｉに変換される場合、前記（３）式に
よってイメージセンサから出力される画素１０個当たり
２個の画素を除去すればよいことが分かる。
ｉから２４０ｄｐｉに変換される場合、前記（３）式に
よってイメージセンサから出力される画素１０個当たり
２個の画素を除去すればよいことが分かる。
【００４０】前述した通り、イメージセンサの出力画素
を５個単位にして１画素ずつ規則的に除去すれば３００
ｄｐｉ画像を２４０ｄｐｉ画像に変換しうる。
を５個単位にして１画素ずつ規則的に除去すれば３００
ｄｐｉ画像を２４０ｄｐｉ画像に変換しうる。
【００４１】前記（３）式でのように解像度を変換させ
るために除去すべきクロックパルスを決定するためには
カウンター２１０の出力値を組み合わせるべきである
が、このカウンター２１０のＱＤ，ＱＣ，ＱＢ端子でそ
れぞれ伝送される出力値が一側端に印加されるＡＮＤゲ
ート２３０，２３１，２３２，２３３は３００ｄｐｉを
２４０ｄｐｉ，２００ｄｐｉ，１８０ｄｐｉ，７５ｄｐ
ｉにそれぞれ変換するめの論理素子である。
るために除去すべきクロックパルスを決定するためには
カウンター２１０の出力値を組み合わせるべきである
が、このカウンター２１０のＱＤ，ＱＣ，ＱＢ端子でそ
れぞれ伝送される出力値が一側端に印加されるＡＮＤゲ
ート２３０，２３１，２３２，２３３は３００ｄｐｉを
２４０ｄｐｉ，２００ｄｐｉ，１８０ｄｐｉ，７５ｄｐ
ｉにそれぞれ変換するめの論理素子である。
【００４２】一方、図４のクロック選択部３００は図３
に示したラッチ部１００の８ビットラッチ１１０で伝送
されるＳ０〜Ｓ３の信号に応じて解像度変換クロック発
生部２００のクロック信号を選択する回路であり、前記
Ｓ０〜Ｓ３の値は表１の解像制御コードＣＤ０，ＣＤ３
に準ずる。
に示したラッチ部１００の８ビットラッチ１１０で伝送
されるＳ０〜Ｓ３の信号に応じて解像度変換クロック発
生部２００のクロック信号を選択する回路であり、前記
Ｓ０〜Ｓ３の値は表１の解像制御コードＣＤ０，ＣＤ３
に準ずる。
【００４３】前述した通り、解像度変換クロック発生部
２００で変換されたクロック信号を選択して変換された
画素クロック比率を決定するためにはそのクロック信号
がクロック選択部３００を構成するインバータ３１０，
３１１，３１２とＡＮＤゲート３２０，３２１，３２
２，３２３，３２４，ＯＲゲート３２５及びフリップフ
ロップ３３０，３３１の論理回路を通じることになる。
この際、図４のクロック選択部３００を構成するＤフリ
ップフロップ３３１は２分周回路であってＰＣＬＫ信号
を単位データ検出部４００、画像データ変換部５００及
び画像データ出力部７００に伝送する。ＰＣＬＫ信号は
変換された画素クロック信号の比率を示す信号である。
２００で変換されたクロック信号を選択して変換された
画素クロック比率を決定するためにはそのクロック信号
がクロック選択部３００を構成するインバータ３１０，
３１１，３１２とＡＮＤゲート３２０，３２１，３２
２，３２３，３２４，ＯＲゲート３２５及びフリップフ
ロップ３３０，３３１の論理回路を通じることになる。
この際、図４のクロック選択部３００を構成するＤフリ
ップフロップ３３１は２分周回路であってＰＣＬＫ信号
を単位データ検出部４００、画像データ変換部５００及
び画像データ出力部７００に伝送する。ＰＣＬＫ信号は
変換された画素クロック信号の比率を示す信号である。
【００４４】図５は単位データ検出部４００の一実施例
図であって、多様なスキャニングモードに応じて処理さ
れた画素データをバイト単位に検出し、前記Ｄフリップ
フロップ３３１で出力される画素クロック信号ＰＣＬＫ
に応じてバイト検出信号を発生する。
図であって、多様なスキャニングモードに応じて処理さ
れた画素データをバイト単位に検出し、前記Ｄフリップ
フロップ３３１で出力される画素クロック信号ＰＣＬＫ
に応じてバイト検出信号を発生する。
【００４５】図５に示した単位データ検出部４００のＡ
ＮＤゲート４４０は８ビット／画素データを出力する論
理素子であり、ＡＮＤゲート４４１はＰＣＬＫをＤフリ
ップフロップ４１０に２分周して４ビット／画素データ
を出力する論理素子である。
ＮＤゲート４４０は８ビット／画素データを出力する論
理素子であり、ＡＮＤゲート４４１はＰＣＬＫをＤフリ
ップフロップ４１０に２分周して４ビット／画素データ
を出力する論理素子である。
【００４６】また、ＡＮＤゲート４４２は単位データ検
出部４００のカウンター周期８の２値カウンター４２０
で伝送されるキャリ信号を受けて単純２値と擬似中間調
の２値画像を決定する論理素子である。
出部４００のカウンター周期８の２値カウンター４２０
で伝送されるキャリ信号を受けて単純２値と擬似中間調
の２値画像を決定する論理素子である。
【００４７】この際、バイト検出クロック信号ＷＣＬＫ
の選択は論理素子であるＯＲゲート４５０を通じてえら
れるが、このＯＲゲート４５０の入力端子に伝送される
ＡＮＤゲート４４０，４４１，４４２の出力は階調制御
コードＳＣ０〜ＳＣ３とＰＣＬＫ、２分周されたＰＣＬ
Ｋ及び２値カウンター４２０で供給されるキャリ信号の
論理積に従う。
の選択は論理素子であるＯＲゲート４５０を通じてえら
れるが、このＯＲゲート４５０の入力端子に伝送される
ＡＮＤゲート４４０，４４１，４４２の出力は階調制御
コードＳＣ０〜ＳＣ３とＰＣＬＫ、２分周されたＰＣＬ
Ｋ及び２値カウンター４２０で供給されるキャリ信号の
論理積に従う。
【００４８】一方、図６は画像データ変換処理するため
の画像データ変換部５００、画像で選択部６００、そし
て画像データ出力部７００の詳細構成図であって、図４
のクロック選択部３００で出力される画像制御信号ＰＣ
ＬＫと図５の単位データ検出部４００で出力されるバイ
ト検出クロック信号ＷＣＬＫを受けて動作され、階調制
御コードは表２に準じる。
の画像データ変換部５００、画像で選択部６００、そし
て画像データ出力部７００の詳細構成図であって、図４
のクロック選択部３００で出力される画像制御信号ＰＣ
ＬＫと図５の単位データ検出部４００で出力されるバイ
ト検出クロック信号ＷＣＬＫを受けて動作され、階調制
御コードは表２に準じる。
【００４９】図６において、画像データ変換部５００を
構成する多重イメージ／２値イメージコンバータ５１０
はディジタル８ビット画像データの２値化処理を行う部
分であって単純２値化処理と擬似中間調処理を行い、画
像データ出力部７００のシフトレジスタ７３０は多重イ
メージ／２値イメージコンバータ５１０で伝送される２
値化されたデータを直列に入力を受けて、並列即ち８ビ
ットデータに変換させる。また、画像データ出力部７０
０の８ビットラッチ７３２は８ビット／画素データ処理
時入力されたデータをバイパスする機能を担当し、４ビ
ットラッチ５４０は４ビット／２画素処理時入力画像の
上位ニブル（nibble) のみを抜き出す部分であって、画
像クロック信号ＰＣＬＫを２分周するＤフリップフロッ
プ５２０により１番目画素クロック信号ＰＣＬＫが“ハ
イ”レベルになる瞬間に画像データの上位ニブルをラッ
チさせる。また２番目の画素クロック信号ＰＣＬＫが
“ハイ”レベルになる時、４ビットラッチ５４０でラッ
チされたデータは８ビットラッチ７３１の上位ニブルと
してラッチされ、入力画像データ中ＩＭＤ４〜ＩＭＤ７
の上位ニブルデータがこの８ビットラッチ７３１の下位
ニブルとしてラッチされ１バイトデータにさせる。
構成する多重イメージ／２値イメージコンバータ５１０
はディジタル８ビット画像データの２値化処理を行う部
分であって単純２値化処理と擬似中間調処理を行い、画
像データ出力部７００のシフトレジスタ７３０は多重イ
メージ／２値イメージコンバータ５１０で伝送される２
値化されたデータを直列に入力を受けて、並列即ち８ビ
ットデータに変換させる。また、画像データ出力部７０
０の８ビットラッチ７３２は８ビット／画素データ処理
時入力されたデータをバイパスする機能を担当し、４ビ
ットラッチ５４０は４ビット／２画素処理時入力画像の
上位ニブル（nibble) のみを抜き出す部分であって、画
像クロック信号ＰＣＬＫを２分周するＤフリップフロッ
プ５２０により１番目画素クロック信号ＰＣＬＫが“ハ
イ”レベルになる瞬間に画像データの上位ニブルをラッ
チさせる。また２番目の画素クロック信号ＰＣＬＫが
“ハイ”レベルになる時、４ビットラッチ５４０でラッ
チされたデータは８ビットラッチ７３１の上位ニブルと
してラッチされ、入力画像データ中ＩＭＤ４〜ＩＭＤ７
の上位ニブルデータがこの８ビットラッチ７３１の下位
ニブルとしてラッチされ１バイトデータにさせる。
【００５０】一方、図６の画像データ選択部６００は表
２による階調制御コードにより画像データ出力部７００
の動作を制御し、この画像データ出力部７００の出力端
ＩＭ０〜ＩＭ７に処理データが送り出される時データ衝
突が起こらないようシフトレジスタ７３０と８ビットラ
ッチ７３１，７３２の出力制御信号を相互排他的に制御
して特定階調が選択される時、他の階調の出力端はハイ
インピーダンス状態を保たせる。
２による階調制御コードにより画像データ出力部７００
の動作を制御し、この画像データ出力部７００の出力端
ＩＭ０〜ＩＭ７に処理データが送り出される時データ衝
突が起こらないようシフトレジスタ７３０と８ビットラ
ッチ７３１，７３２の出力制御信号を相互排他的に制御
して特定階調が選択される時、他の階調の出力端はハイ
インピーダンス状態を保たせる。
【００５１】図７は画像データの解像度を３００ｄｐｉ
で変換処理する場合、図４の解像度変換クロック発生部
２００の信号波形図である。
で変換処理する場合、図４の解像度変換クロック発生部
２００の信号波形図である。
【００５２】表１に示した解像度制御コードに応じてＳ
０ないしＳ３のデータが全部“０”になり、画素クロッ
ク信号の周波数の２倍に相応する周波数を有するＭＣＬ
Ｋはクロック選択部３００のＡＮＤゲート３２０とＯＲ
ゲート３２５を経由してＤフリップフロップ３３０で再
サンプリングされＤフリップフロップ３３１で図７に示
した通り２分周されたＰＣＬＫ信号を発生する。
０ないしＳ３のデータが全部“０”になり、画素クロッ
ク信号の周波数の２倍に相応する周波数を有するＭＣＬ
Ｋはクロック選択部３００のＡＮＤゲート３２０とＯＲ
ゲート３２５を経由してＤフリップフロップ３３０で再
サンプリングされＤフリップフロップ３３１で図７に示
した通り２分周されたＰＣＬＫ信号を発生する。
【００５３】この際、解像度変換クロック発生部２００
のカウンター２１０でのプレセット値Ｐ０〜Ｐ３と出力
値ＱＡ，ＱＢ，ＱＣ，ＱＤは選択論理により図７の斜線
を引いた数の状態（don't care) になる。前述した通り
３００ｄｐｉで画像データを画像データ変換部５００に
入力する場合は毎画素データを漏れなく選択すればす
む。
のカウンター２１０でのプレセット値Ｐ０〜Ｐ３と出力
値ＱＡ，ＱＢ，ＱＣ，ＱＤは選択論理により図７の斜線
を引いた数の状態（don't care) になる。前述した通り
３００ｄｐｉで画像データを画像データ変換部５００に
入力する場合は毎画素データを漏れなく選択すればす
む。
【００５４】一方、イメージセンサで入力される標準解
像度が３００ｄｐｉである画像データを２４０ｄｐｉの
画像データに変換するためには（１）式によりプレセッ
ト値を計算し、カウンター２１０の周期を１０としてカ
ウンター２１０のプレセット値Ｐ０〜Ｐ３の各ビットで
ローディングさせる。この際、Ｓ０〜Ｓ３を表１の２４
０ｄｐｉに相応するコード値で定めさせれば図８に示し
た波形のようにカウンター２１０のＱＤ出力とＭＣＬＫ
信号はＡＮＤゲート２３０で論理積され、このＡＮＤゲ
ート２３０の出力信号はＤフリップフロップ３３０で再
サンプリングされ再びＤフリップフロップ３３１を通じ
て２分周される。前記Ｄフリップフロップ３３１で２分
周された信号は２４０ｄｐｉ解像度を制御するための信
号である。即ち、イメージセンサで入力される画像デー
タが３００ｄｐｉである画像を２４０ｄｐｉに変換する
ためには、この画像データの出力クロック信号の５個中
１個を除去して画像データを取ればすむ。
像度が３００ｄｐｉである画像データを２４０ｄｐｉの
画像データに変換するためには（１）式によりプレセッ
ト値を計算し、カウンター２１０の周期を１０としてカ
ウンター２１０のプレセット値Ｐ０〜Ｐ３の各ビットで
ローディングさせる。この際、Ｓ０〜Ｓ３を表１の２４
０ｄｐｉに相応するコード値で定めさせれば図８に示し
た波形のようにカウンター２１０のＱＤ出力とＭＣＬＫ
信号はＡＮＤゲート２３０で論理積され、このＡＮＤゲ
ート２３０の出力信号はＤフリップフロップ３３０で再
サンプリングされ再びＤフリップフロップ３３１を通じ
て２分周される。前記Ｄフリップフロップ３３１で２分
周された信号は２４０ｄｐｉ解像度を制御するための信
号である。即ち、イメージセンサで入力される画像デー
タが３００ｄｐｉである画像を２４０ｄｐｉに変換する
ためには、この画像データの出力クロック信号の５個中
１個を除去して画像データを取ればすむ。
【００５５】図９は３００ｄｐｉ解像度を有する画像デ
ータが８ビット／画素で画像データ変換部５００に入力
される場合、図５の単位データ検出部４００の画素デー
タ伝送及び処理に合うように１バイトデータで検出する
信号波形図である。
ータが８ビット／画素で画像データ変換部５００に入力
される場合、図５の単位データ検出部４００の画素デー
タ伝送及び処理に合うように１バイトデータで検出する
信号波形図である。
【００５６】前記図９に示した波形の通り、クロック発
生部３００で送り出されるＰＣＬＫ信号を表２の階調制
御コードにより単位データ検出部４００のＡＮＤゲート
４４０及びＯＲゲート４５０を通過することによりバイ
ト検出クロック信号ＷＣＬＫを得る。
生部３００で送り出されるＰＣＬＫ信号を表２の階調制
御コードにより単位データ検出部４００のＡＮＤゲート
４４０及びＯＲゲート４５０を通過することによりバイ
ト検出クロック信号ＷＣＬＫを得る。
【００５７】図１０は画像データが解像度３００ｄｐ
ｉ、１６階調４ビット／画素の場合の単位データ検出部
４００の波形図である。
ｉ、１６階調４ビット／画素の場合の単位データ検出部
４００の波形図である。
【００５８】前記図１０に示した通り、１６階調で画像
処理をする場合、即ち毎画素当たり４ビットデータの場
合ＰＣＬＫ信号が“ハイ”レベルになる時ごとに４ビッ
トデータが送り出される。この際、図５のＤフリップフ
ロップ４１０は前記４ビットデータを２分周して２周期
のＰＣＬＫを入力することにより１バイトデータを検出
し、階調制御コードはＡＮＤゲート４４１で組み合わせ
られる。
処理をする場合、即ち毎画素当たり４ビットデータの場
合ＰＣＬＫ信号が“ハイ”レベルになる時ごとに４ビッ
トデータが送り出される。この際、図５のＤフリップフ
ロップ４１０は前記４ビットデータを２分周して２周期
のＰＣＬＫを入力することにより１バイトデータを検出
し、階調制御コードはＡＮＤゲート４４１で組み合わせ
られる。
【００５９】図１１は画像データが解像度３００ｄｐ
ｉ、２値データ処理時単位データ検出部４００の波形図
である。
ｉ、２値データ処理時単位データ検出部４００の波形図
である。
【００６０】図１１に示した通り、２値画像処理の場合
即ち単純２値化または擬似中間調処理時に毎画素クロッ
ク信号ＰＣＬＫが“ハイ”レベルになる時ごとに１ビッ
トが生成されるので、１バイトで送り出すためにはカウ
ンター４２０でキャリが発生する時毎にバイト検出クロ
ック信号ＷＣＬＫを出力する。
即ち単純２値化または擬似中間調処理時に毎画素クロッ
ク信号ＰＣＬＫが“ハイ”レベルになる時ごとに１ビッ
トが生成されるので、１バイトで送り出すためにはカウ
ンター４２０でキャリが発生する時毎にバイト検出クロ
ック信号ＷＣＬＫを出力する。
【００６１】
【発明の効果】以上述べたように、本発明は画像データ
の利用目的と関連出力装置の性能及び特性にかなう画像
データで解像度と階調が制御できるので、データ処理が
高速で行え、この画像データの解像度及び階調制御をハ
ードウェア的に処理するので装置の互換性及び広い適用
性を有する。
の利用目的と関連出力装置の性能及び特性にかなう画像
データで解像度と階調が制御できるので、データ処理が
高速で行え、この画像データの解像度及び階調制御をハ
ードウェア的に処理するので装置の互換性及び広い適用
性を有する。
【図１】本発明による文書画像データの解像度及び階調
変換装置の構成図である。
変換装置の構成図である。
【図２】図１に示したラッチの制御データ形式図であ
る。
る。
【図３】図１に示したラッチの詳細回路図である。
【図４】図１に示した解像度及び変換クロック発生器と
クロック選択部の詳細回路図である。
クロック選択部の詳細回路図である。
【図５】図１に示した単位データ検出器の詳細回路図で
ある。
ある。
【図６】図１に示した画像データ変換器、画像データ選
択器及び画像データ出力回路の詳細回路図である。
択器及び画像データ出力回路の詳細回路図である。
【図７】図１による画像データの解像度が３００ｄｐｉ
の場合の波形図である。
の場合の波形図である。
【図８】図１による画像データの解像度が２４０ｄｐｉ
の場合の波形図である。
の場合の波形図である。
【図９】図１による画像データの解像度が３００ｄｐｉ
で２５６階調の場合の単位データ検出器の波形図であ
る。
で２５６階調の場合の単位データ検出器の波形図であ
る。
【図１０】図１による画像データの解像度が３００ｄｐ
ｉで１６階調の場合の単位データ検出器の波形図であ
る。
ｉで１６階調の場合の単位データ検出器の波形図であ
る。
【図１１】図１による画像データの解像度が３００ｄｐ
ｉで２値データ処理時の単位データ検出器の波形図であ
る。
ｉで２値データ処理時の単位データ検出器の波形図であ
る。
１００ ラッチ部 １１０，７３１，７３２ ８ビットラッチ １２０ ディコーダ ２００ 解像度変換クロック発生部 ２１０，４２０ カウンター ３００ クロック選択部 ４００ 単位データ検出部 ５００ 画像データ変換部 ５１０ 多重イメージ／２値イメージコンバータ ５２０ シフトレジスタ ６００ 画像データ選択部
Claims (8)
- 【請求項１】 画像制御データを受けて所望の解像度と
階調を有する画像制御データに変換させるために変数値
をセッティングするラッチ部と、 画像制御データの入力速度に準ずるマスタクロック信号
に応じて前記ラッチ部で変数値がセッティングされた画
像制御データの解像度を変換させるために解像度変換ク
ロック信号を発生する解像度変換クロック発生部と、 画像制御データの入力速度に準ずるマスタクロック信号
に応じて前記解像度変換クロック発生部で伝送されるク
ロック信号中にラッチ部で入力される画像制御データの
動作モード及び動作順序に適当な画素クロック信号を選
択するクロック選択部と、 前記クロック選択部で伝送される画素クロック信号をカ
ウントして階調変換による制御信号をバイト単位に検出
する単位データ検出部と、 前記クロック選択部で伝送される画素クロック信号に応
じて入力された画像データの階調変換及び画像２値化処
理を行う画像データ変換部と、 前記ラッチ部でセッティングされた制御データと前記単
位データ検出部で供給されるバイト検出ロック信号に応
じた画像データ階調を選択する画像データ選択部と、 前記画像データ選択部で選択された画像データ階調選択
信号に応じてイネーブルされ前記クロック選択部で供給
された画素クロック信号に応じて解像度及び階調変換さ
れた画像データをバイト単位に出力する画像データ出力
を含むことを特徴とする文書画像データの解像度及び階
調変換装置。 - 【請求項２】 前記ラッチ部はラッチイネーブル信号が
“ハイ”レベルになれば、その瞬間画像制御データを受
けて貯蔵し、解像度及び階調制御コードの変数値をセッ
ティングし、それらを出力する８ビットラッチと、 前記８ビットラッチに一時貯蔵された解像度制御コード
の変数値をデコーディングして出力するディコーダを含
むことを特徴とする請求項１記載の文書画像データの解
像度及び階調変換装置。 - 【請求項３】 前記解像度クロック発生部はＶＤＥＮ信
号と前記ラッチ部でセッティングされ伝送されるフリセ
ット信号に応じてマスタクロック信号をカウンティング
するカウンター及びインバータと、カウンターの出力信
号中の一信号とマスタクロック信号を受けて所定の解像
度変換クロック信号を発生させる第１ないし第４アンド
ゲート及びＯＲゲードを含むことを特徴とする請求項１
記載の文書画像データの解像度及び階調変換装置。 - 【請求項４】 前記クロック選択部は前記解像度変換ク
ロック発生部の第１ないし第４アンドゲートで出力され
るクロック信号と前記ラッチ部で伝送されるセレクト信
号をを組み合わせる第１ないし第３インバータと第５な
いし第９ＡＮＤゲート及びＯＲゲートと、前記ＯＲゲー
トの出力信号を受けてマスタクロック信号に応じて画像
制御データの動作モード及び動作順序に適当な画素クロ
ック信号を選択する第１及び第２フリップフロップを含
むことを特徴とする請求項１記載の文書画像データの解
像度及び階調変換装置。 - 【請求項５】 前記単位データ検出部は前記クロック選
択部の２Ｄフリップフロップで伝送される画素クロック
信号を２分周するＤフリップフロップと、それをカウン
トするカウンターと、前記画素クロック信号、前記Ｄフ
リップフロップの出力及び前記カウンターの出力と、前
記ラッチ部からの階調制御コードを論理組み合わせる論
理回路を含んで階調変換によるバイト検出クロック信号
を単位データに検出することを特徴とする請求項１記載
の文書画像データの解像度及び階調変換装置。 - 【請求項６】 前記画像データの変換部は前記クロック
選択部で伝送される画素クロック信号に応じて入力され
た画像データの多重画像２値化処理を行うコンバータと
４ビット／画素データを処理するＤフリップフロップ、
インバータ及び４ビットラッチを含むことを特徴とする
請求項１記載の文書画像データの解像度及び階調変換装
置。 - 【請求項７】 前記画像データ選択部は前記ラッチ部の
８ビットラッチで伝送される階調制御データによる画像
データ変換部の画像データ階調を選択するように構成さ
れた論理回路を含むことを特徴とする請求項１記載の文
書画像データの解像度及び階調変換装置。 - 【請求項８】 前記画像データ出力部は前記画像データ
変換部で変換された画像データをそれぞれ受け入れるシ
フトレジスタ及び第１及び第２の８ビットラッチを含
み、前記画像データ選択部から供給された階調選択制御
信号に応じて所定の解像度及び階調を有する画像データ
をバイト単位で出力することを特徴とする請求項１記載
の文書画像データの解像度及び階調変換装置。
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| KR900019371 | 1990-11-28 | ||
| KR1019910019347A KR100188439B1 (ko) | 1990-11-28 | 1991-10-31 | 문서화상데이터의 해상도 및 계조변환장치 |
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| Publication Number | Publication Date |
|---|---|
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|---|---|---|---|---|
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-
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