JPH04255969A - 記録担体上にデジタル情報信号を記録する装置及び方法 - Google Patents
記録担体上にデジタル情報信号を記録する装置及び方法Info
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- JPH04255969A JPH04255969A JP3269076A JP26907691A JPH04255969A JP H04255969 A JPH04255969 A JP H04255969A JP 3269076 A JP3269076 A JP 3269076A JP 26907691 A JP26907691 A JP 26907691A JP H04255969 A JPH04255969 A JP H04255969A
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- G11B19/00—Driving, starting, stopping record carriers not specifically of filamentary or web form, or of supports therefor; Control thereof; Control of operating function ; Driving both disc and head
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- G11B5/00—Recording by magnetisation or demagnetisation of a record carrier; Reproducing by magnetic means; Record carriers therefor
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- G11B5/588—Disposition or mounting of heads or head supports relative to record carriers ; arrangements of heads, e.g. for scanning the record carrier to increase the relative speed with provision for moving the head for the purpose of maintaining alignment of the head relative to the record carrier during transducing operation, e.g. to compensate for surface irregularities of the latter or for track following for track following on tapes by controlling the position of the rotating heads
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- Indexing, Searching, Synchronizing, And The Amount Of Synchronization Travel Of Record Carriers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】この発明は、磁気記録担体上の情
報トラックにデジタル情報信号を記録すると共に、ｎ及
びｍが整数であり且つｍ≧１及びｎ＞ｍが成り立つとし
て、提供されたデジタル情報信号内のｎビットの情報語
を記録に先立ち（ｎ＋ｍ）ビットのチャンネル語に変換
するような装置に関する。
報トラックにデジタル情報信号を記録すると共に、ｎ及
びｍが整数であり且つｍ≧１及びｎ＞ｍが成り立つとし
て、提供されたデジタル情報信号内のｎビットの情報語
を記録に先立ち（ｎ＋ｍ）ビットのチャンネル語に変換
するような装置に関する。
【０００２】更に詳述すると、この発明は上記のような
装置であって、 −上記のｎビットの情報語を入力する入力端子と、−上
記入力端子に結合された入力端と出力端とを有すると共
に、ａを２以上の整数とした場合のａＴ前置符号器（ａ
Ｔプリコーダ）を有し、上記ｎビットの情報語を（ｎ＋
ｍ）ビットのチャンネル語に変換すると共にこれらチャ
ンネル語を上記出力端に供給するような符号化装置（ｅ
ｎｃｏｄｉｎｇ ｄｅｖｉｃｅ） と、−上記符号化装
置の出力端に結合された入力端を有し、上記の（ｎ＋ｍ
）ビットのチャンネル語を磁気記録担体上の情報トラッ
クに記録する記録装置と、を具備するような装置に関す
る。
装置であって、 −上記のｎビットの情報語を入力する入力端子と、−上
記入力端子に結合された入力端と出力端とを有すると共
に、ａを２以上の整数とした場合のａＴ前置符号器（ａ
Ｔプリコーダ）を有し、上記ｎビットの情報語を（ｎ＋
ｍ）ビットのチャンネル語に変換すると共にこれらチャ
ンネル語を上記出力端に供給するような符号化装置（ｅ
ｎｃｏｄｉｎｇ ｄｅｖｉｃｅ） と、−上記符号化装
置の出力端に結合された入力端を有し、上記の（ｎ＋ｍ
）ビットのチャンネル語を磁気記録担体上の情報トラッ
クに記録する記録装置と、を具備するような装置に関す
る。
【０００３】
【従来の技術】この種の装置は、例えばヨーロッパ特許
出願公開第３３９７２４号公報から既知である。
出願公開第３３９７２４号公報から既知である。
【０００４】この従来の装置に関しては、ｎビットの情
報語がルックアップテーブルを利用しながら（ｎ＋ｍ）
ビットのチャンネル語に変換され、次いで該チャンネル
語が２Ｔプリコーダにより記録装置に供給され、このよ
うに符号化された（ｎ＋ｍ）ビットのチャンネル語が該
記録装置により磁気記録担体上に記録されるような符号
化について述べられている。これに関しては、ＮＲＺ−
Ｉ記録が示されている。即ち、各々の８ビットの情報語
に関して上記テーブルからの互いに異なる不一致性（デ
ィスパリティー）を持つ少なくとも３個の１０ビット語
を利用することができる８／１０ビット変換について述
べられている。
報語がルックアップテーブルを利用しながら（ｎ＋ｍ）
ビットのチャンネル語に変換され、次いで該チャンネル
語が２Ｔプリコーダにより記録装置に供給され、このよ
うに符号化された（ｎ＋ｍ）ビットのチャンネル語が該
記録装置により磁気記録担体上に記録されるような符号
化について述べられている。これに関しては、ＮＲＺ−
Ｉ記録が示されている。即ち、各々の８ビットの情報語
に関して上記テーブルからの互いに異なる不一致性（デ
ィスパリティー）を持つ少なくとも３個の１０ビット語
を利用することができる８／１０ビット変換について述
べられている。
【０００５】これらの３個の１０ビット語からの適切な
選択により、プリコーダの出力端におけるチャンネル語
の直列データ流（ｄａｔａ ｓｔｒｅａｍ） における
動きつつあるデジタル和（以下、単にデジタル和）を、
この現デジタル和の値の所望の変化が時間の関数として
実現されるように、制御することが可能である。
選択により、プリコーダの出力端におけるチャンネル語
の直列データ流（ｄａｔａ ｓｔｒｅａｍ） における
動きつつあるデジタル和（以下、単にデジタル和）を、
この現デジタル和の値の所望の変化が時間の関数として
実現されるように、制御することが可能である。
【０００６】前記文献においては、上記直列データ流に
パイロット信号が含まれ、このパイロット信号を、記録
担体から再生される際に、トラッキングを実現するため
に使用することができる。
パイロット信号が含まれ、このパイロット信号を、記録
担体から再生される際に、トラッキングを実現するため
に使用することができる。
【０００７】本発明の目的は、上記のデジタル和の値を
時間の関数として望み通りに調整することが可能であり
ながら、簡単な構成を有し且つ高効率の符号化の可能性
を有するような異なる符号化法が用いられるような装置
を提供することにある。
時間の関数として望み通りに調整することが可能であり
ながら、簡単な構成を有し且つ高効率の符号化の可能性
を有するような異なる符号化法が用いられるような装置
を提供することにある。
【０００８】この目的を達成するため本発明による装置
は、ｍが１に等しいとして、前記符号化装置が連続する
ｎビット情報語にその都度ｍビットのデジタル語を付加
して（ｎ＋１）ビット情報語を得る信号付加手段を有し
、前記ａＴプリコーダが前記の（ｎ＋１）ビット情報語
を（ｎ＋１）ビットチャンネル語に変換するように構成
され、前記符号化装置が更に制御信号発生手段を有し、
この制御信号発生手段が前記ａＴプリコーダから前記（
ｎ＋１）ビットチャンネル語を入力すると共に当該（ｎ
＋１）ビットチャンネル語から制御信号を作成するよう
に構成され、前記信号付加手段が上記制御信号に応じて
前記ｎビット情報語に、前記プリコーダの出力信号にお
けるデジタル和が時間に対してプロットした場合に所望
のパターンを呈するように、１ビットデジタル語を付加
するように構成されていることを特徴している。
は、ｍが１に等しいとして、前記符号化装置が連続する
ｎビット情報語にその都度ｍビットのデジタル語を付加
して（ｎ＋１）ビット情報語を得る信号付加手段を有し
、前記ａＴプリコーダが前記の（ｎ＋１）ビット情報語
を（ｎ＋１）ビットチャンネル語に変換するように構成
され、前記符号化装置が更に制御信号発生手段を有し、
この制御信号発生手段が前記ａＴプリコーダから前記（
ｎ＋１）ビットチャンネル語を入力すると共に当該（ｎ
＋１）ビットチャンネル語から制御信号を作成するよう
に構成され、前記信号付加手段が上記制御信号に応じて
前記ｎビット情報語に、前記プリコーダの出力信号にお
けるデジタル和が時間に対してプロットした場合に所望
のパターンを呈するように、１ビットデジタル語を付加
するように構成されていることを特徴している。
【０００９】この点に関しては、ａ≧２が成り立つよう
なａＴプリコーダが使用されると有利であることに注意
されたい。先ず、プリコーダの選択は再生側に応用され
た検出機構により決定される。磁気記録においては、し
ばしば、ＰＲ４検出、即ち部分応答クラス４検出（ｐａ
ｒｔｉａｌ ｒｅｓｐｏｎｓｅ ｃｌａｓｓ ４ ｄｅ
ｔｅｃｔｉｏｎ）が用いられる。この検出自体は既知で
あるので、これ以上の説明は要しないであろう。しかし
ながら、このことは記録側にはエラーの拡大を避けるた
めに２Ｔプリコーダが必要であることを意味する。
なａＴプリコーダが使用されると有利であることに注意
されたい。先ず、プリコーダの選択は再生側に応用され
た検出機構により決定される。磁気記録においては、し
ばしば、ＰＲ４検出、即ち部分応答クラス４検出（ｐａ
ｒｔｉａｌ ｒｅｓｐｏｎｓｅ ｃｌａｓｓ ４ ｄｅ
ｔｅｃｔｉｏｎ）が用いられる。この検出自体は既知で
あるので、これ以上の説明は要しないであろう。しかし
ながら、このことは記録側にはエラーの拡大を避けるた
めに２Ｔプリコーダが必要であることを意味する。
【００１０】更に、このようなシステムにおいては、チ
ャンネル語の直列データ流におけるＴｍａｘ 、即ちこ
のデータ流における連続する「０」又は「１」の最大数
、が特定の値を越えないことが重要である。
ャンネル語の直列データ流におけるＴｍａｘ 、即ちこ
のデータ流における連続する「０」又は「１」の最大数
、が特定の値を越えないことが重要である。
【００１１】デジタル情報への１ビットデジタル語の挿
入は、ａＴプリコーダによる符号化と組み合わされるこ
とにより、Ｔｍａｘ を制限するという選択性を提供す
る。 ａ≧２のプリコーダにおいては、この制限は１Ｔプリコ
ーダにおけるよりも効果的である。
入は、ａＴプリコーダによる符号化と組み合わされるこ
とにより、Ｔｍａｘ を制限するという選択性を提供す
る。 ａ≧２のプリコーダにおいては、この制限は１Ｔプリコ
ーダにおけるよりも効果的である。
【００１２】本発明による装置におけるｎビット情報語
の（ｎ＋１）ビットチャンネル語への符号化は、ｎビッ
ト情報語に先行する１ビットデジタル語を容認すること
により、極めて簡単に実現される。このようにして得ら
れた（ｎ＋１）ビット情報語からのｎ個の最下位側の（
又は、むしろ最上位側の）ビットは元のｎビットの情報
語に等しい。このように、従来の装置のようなルックア
ップテーブルは最早必要ではない。
の（ｎ＋１）ビットチャンネル語への符号化は、ｎビッ
ト情報語に先行する１ビットデジタル語を容認すること
により、極めて簡単に実現される。このようにして得ら
れた（ｎ＋１）ビット情報語からのｎ個の最下位側の（
又は、むしろ最上位側の）ビットは元のｎビットの情報
語に等しい。このように、従来の装置のようなルックア
ップテーブルは最早必要ではない。
【００１３】更に、ｎを１０に等しいか又はそれより大
となるように選定することにより、非常に高効率な符号
化を実現することができる。例えば、ｎが２４であると
すると、９６％の効率を得ることができ、この効率は前
述した文献に述べられている符号化の効率に較べて非常
に高い。
となるように選定することにより、非常に高効率な符号
化を実現することができる。例えば、ｎが２４であると
すると、９６％の効率を得ることができ、この効率は前
述した文献に述べられている符号化の効率に較べて非常
に高い。
【００１４】本発明は連続したｎビット情報語のみを含
むデジタル情報システム（このことは前記の１ビットデ
ジタル語がデジタル情報信号のデータ流に等間隔で挿入
されることを意味する）のみに適用することができるだ
けではないことに注意されたい。上記の１ビットデジタ
ル語は等間隔でない時点で挿入することもできる。例え
ば、前記デジタル情報信号がｎビットとｐビットの交互
の情報語からなると仮定すると、１ビットデジタル語は
各ｎビット情報語に付加され、ｑビットデジタル語が各
ｐビット情報語に付加される。この場合、ｐ≠ｎが成り
立ち、ｑは１に等しくてもよい値である。ｑビットデジ
タル語のｐビット情報語への付加は、１ビットデジタル
語をｎビット情報語へ付加したのと同様の方法により実
施することができる。
むデジタル情報システム（このことは前記の１ビットデ
ジタル語がデジタル情報信号のデータ流に等間隔で挿入
されることを意味する）のみに適用することができるだ
けではないことに注意されたい。上記の１ビットデジタ
ル語は等間隔でない時点で挿入することもできる。例え
ば、前記デジタル情報信号がｎビットとｐビットの交互
の情報語からなると仮定すると、１ビットデジタル語は
各ｎビット情報語に付加され、ｑビットデジタル語が各
ｐビット情報語に付加される。この場合、ｐ≠ｎが成り
立ち、ｑは１に等しくてもよい値である。ｑビットデジ
タル語のｐビット情報語への付加は、１ビットデジタル
語をｎビット情報語へ付加したのと同様の方法により実
施することができる。
【００１５】この点に関しては、ヨーロッパ特許出願公
開第２５００４９号から、プリコーダの出力信号におけ
るデジタル和に影響させるために、ａＴプリコーダを有
する記録装置においてａビットのデジタル語をｎビット
の情報語に付加させることは既知であることに注意され
たい。 この出願においては、ｎビットの情報語にその都度ａＴ
プリコーダ内にあるメモリ素子の数だけのビットが付加
されるべきであると述べられている。従って、１Ｔプリ
コーダを有する従来装置においては１ビットデジタル語
が情報語に付加され、２Ｔプリコーダを有する装置にお
いては２ビットデジタル語が情報語に付加される。
開第２５００４９号から、プリコーダの出力信号におけ
るデジタル和に影響させるために、ａＴプリコーダを有
する記録装置においてａビットのデジタル語をｎビット
の情報語に付加させることは既知であることに注意され
たい。 この出願においては、ｎビットの情報語にその都度ａＴ
プリコーダ内にあるメモリ素子の数だけのビットが付加
されるべきであると述べられている。従って、１Ｔプリ
コーダを有する従来装置においては１ビットデジタル語
が情報語に付加され、２Ｔプリコーダを有する装置にお
いては２ビットデジタル語が情報語に付加される。
【００１６】１Ｔプリコーダが使用された場合には、１
ビットのデジタル語の付加であれば、前置符号化後に得
られるチャンネル語の全ビットの符号反転に充分であり
、またプリコーダの出力信号におけるデジタル和をこの
ような方法で制御するにも充分である。２Ｔプリコーダ
が使用された場合は、前置符号化後に得られるチャンネ
ル語の全ビットの符号に影響させるには２ビットのデジ
タル語を付加しなければならない。
ビットのデジタル語の付加であれば、前置符号化後に得
られるチャンネル語の全ビットの符号反転に充分であり
、またプリコーダの出力信号におけるデジタル和をこの
ような方法で制御するにも充分である。２Ｔプリコーダ
が使用された場合は、前置符号化後に得られるチャンネ
ル語の全ビットの符号に影響させるには２ビットのデジ
タル語を付加しなければならない。
【００１７】本発明によれば、２Ｔ（又はそれ以上のＴ
の）プリコーダを有する装置にとってはｎビット情報語
に単一ビットのみを付加するだけて充分である。この単
一のビットの付加では、得られたチャンネル語のビット
の半数しか符号反転を実現することができないのは事実
である。しかしながら、プリコーダの出力信号のデジタ
ル和を制御するには充分であることが分かった。更に、
上述したヨーロッパ特許出願公開第２５００４９号から
既知の符号化に較べて符号化が高効率であるという大き
な利点がある。
の）プリコーダを有する装置にとってはｎビット情報語
に単一ビットのみを付加するだけて充分である。この単
一のビットの付加では、得られたチャンネル語のビット
の半数しか符号反転を実現することができないのは事実
である。しかしながら、プリコーダの出力信号のデジタ
ル和を制御するには充分であることが分かった。更に、
上述したヨーロッパ特許出願公開第２５００４９号から
既知の符号化に較べて符号化が高効率であるという大き
な利点がある。
【００１８】
【実施例】図１は、並列／直列変換器２に結合された入
力端子１を有する当該装置を示している。例えば、上記
入力端子１における８ビットのデジタル語が順次並列に
変換器２に供給される。該変換器２は、例えば、これら
８ビットデジタル語の中の３個を単一の２４ビットのデ
ジタル情報語に変換し、出力端子３に供給する。また、
当該装置は信号付加手段４を有している。この信号付加
手段４は、その入力端子５に供給された連続するｎ（＝
２４）ビットの情報語に１ビットのデジタル語を付加す
るようになっている。このため、信号付加手段４は上記
の２４ビット情報語に「０」を付加、即ち接頭語として
付ける第１の付加ユニット６と、２４ビット情報語に「
１」を接頭語として付ける第２の付加ユニット７とを有
している。このようにして得られた２５ビットの情報語
は出力端子８及び９に各々供給され、これら出力端子を
介してａＴプリコーダ１０及び１１に各々供給される。 ここで、ａは２以上の整数である。
力端子１を有する当該装置を示している。例えば、上記
入力端子１における８ビットのデジタル語が順次並列に
変換器２に供給される。該変換器２は、例えば、これら
８ビットデジタル語の中の３個を単一の２４ビットのデ
ジタル情報語に変換し、出力端子３に供給する。また、
当該装置は信号付加手段４を有している。この信号付加
手段４は、その入力端子５に供給された連続するｎ（＝
２４）ビットの情報語に１ビットのデジタル語を付加す
るようになっている。このため、信号付加手段４は上記
の２４ビット情報語に「０」を付加、即ち接頭語として
付ける第１の付加ユニット６と、２４ビット情報語に「
１」を接頭語として付ける第２の付加ユニット７とを有
している。このようにして得られた２５ビットの情報語
は出力端子８及び９に各々供給され、これら出力端子を
介してａＴプリコーダ１０及び１１に各々供給される。 ここで、ａは２以上の整数である。
【００１９】図２は２Ｔプリコーダを示している。なお
、この種のプリコーダ自体は既知である。この種のプリ
コーダにおいては、出力端子１３に得られるＥＸＯＲの
出力信号が入力信号におけるクロック周期Ｔだけ遅延さ
れて当該ＥＸＯＲの入力端子に帰還される。ここで、上
記クロック周期Ｔは、ａＴプリコーダ１０及び１１に供
給される直列デジタル信号のクロック周期である。プリ
コーダ１０及び１１はそれらの入力端子に供給された（
ｎ＋１）ビットの情報語を（ｎ＋１）ビットのチャンネ
ル語に各々変換し、出力端子１３及び１４に供給する。 プリコーダ１０及び１１の出力端子１３及び１４は制御
信号発生手段１７の入力端子１５及び１６に各々結合さ
れている。この手段１７は、上記の（ｎ＋１）ビットの
各チャンネル語に応じて制御信号ｃｓを出力端子１８に
発生する。プリコーダ１０及び１１の出力端子１３及び
１４は、更に、可制御スイッチング手段２２の端子１９
及び２０に各々結合されている。このスイッチング手段
２２の他の端子は記録装置２４の入力端子２３に結合さ
れている。一方、前記手段１７の出力端子１８はスイッ
チング手段２２の制御信号入力端子２５と、ａＴプリコ
ーダ１０及び１１の各制御信号入力端子２６及び２７と
に結合されている。
、この種のプリコーダ自体は既知である。この種のプリ
コーダにおいては、出力端子１３に得られるＥＸＯＲの
出力信号が入力信号におけるクロック周期Ｔだけ遅延さ
れて当該ＥＸＯＲの入力端子に帰還される。ここで、上
記クロック周期Ｔは、ａＴプリコーダ１０及び１１に供
給される直列デジタル信号のクロック周期である。プリ
コーダ１０及び１１はそれらの入力端子に供給された（
ｎ＋１）ビットの情報語を（ｎ＋１）ビットのチャンネ
ル語に各々変換し、出力端子１３及び１４に供給する。 プリコーダ１０及び１１の出力端子１３及び１４は制御
信号発生手段１７の入力端子１５及び１６に各々結合さ
れている。この手段１７は、上記の（ｎ＋１）ビットの
各チャンネル語に応じて制御信号ｃｓを出力端子１８に
発生する。プリコーダ１０及び１１の出力端子１３及び
１４は、更に、可制御スイッチング手段２２の端子１９
及び２０に各々結合されている。このスイッチング手段
２２の他の端子は記録装置２４の入力端子２３に結合さ
れている。一方、前記手段１７の出力端子１８はスイッ
チング手段２２の制御信号入力端子２５と、ａＴプリコ
ーダ１０及び１１の各制御信号入力端子２６及び２７と
に結合されている。
【００２０】上記手段１７のある実施例が図４に示され
ている。この手段は、積算器３０及び３１を有し、これ
ら積算器の入力端子は当該手段の入力端子１５及び１６
に各々結合されている。これら積算器の出力端子は信号
合成ユニット３２及び３３の第１入力端子に各々結合さ
れている。これら合成ユニット３２及び３３の出力端子
は比較器３４の入力端子に結合され、この比較器の出力
端子は当該手段１７の出力端子１８に結合されて前記制
御信号ｃｓを発生する。
ている。この手段は、積算器３０及び３１を有し、これ
ら積算器の入力端子は当該手段の入力端子１５及び１６
に各々結合されている。これら積算器の出力端子は信号
合成ユニット３２及び３３の第１入力端子に各々結合さ
れている。これら合成ユニット３２及び３３の出力端子
は比較器３４の入力端子に結合され、この比較器の出力
端子は当該手段１７の出力端子１８に結合されて前記制
御信号ｃｓを発生する。
【００２１】当該手段１７は、もし望むならば、信号発
生器３５を有し、この信号発生器の出力端子は合成ユニ
ット３２及び３３の第２の入力端子に結合される。明ら
かなように、信号発生器３５がない場合は、合成ユニッ
ト３２及び３３も削除することができる。上記信号合成
ユニット３２及び３３は、以下の説明から明らかとなる
ように、減算器として各々動作する。更に、比較器３４
の出力端子は前記積算器３０及び３１の制御信号入力端
子３６及び３７にも結合されている。
生器３５を有し、この信号発生器の出力端子は合成ユニ
ット３２及び３３の第２の入力端子に結合される。明ら
かなように、信号発生器３５がない場合は、合成ユニッ
ト３２及び３３も削除することができる。上記信号合成
ユニット３２及び３３は、以下の説明から明らかとなる
ように、減算器として各々動作する。更に、比較器３４
の出力端子は前記積算器３０及び３１の制御信号入力端
子３６及び３７にも結合されている。
【００２２】図１に示した装置の動作は以下のようにな
る。即ち、先にも述べたように２４ビットの情報語が付
加ユニット６及び７に供給される。そして、出力端子８
及び９には２５ビット情報語が現れるが、ここでそれら
の中の２４ビット（この例においては、下位側のビット
）は元の２４ビットの情報語を表し、一方（ユニット６
）の場合は「０」が最上位ビットとして付加され、他方
（ユニット７）の場合は「１」が付加される。
る。即ち、先にも述べたように２４ビットの情報語が付
加ユニット６及び７に供給される。そして、出力端子８
及び９には２５ビット情報語が現れるが、ここでそれら
の中の２４ビット（この例においては、下位側のビット
）は元の２４ビットの情報語を表し、一方（ユニット６
）の場合は「０」が最上位ビットとして付加され、他方
（ユニット７）の場合は「１」が付加される。
【００２３】図３のａ及びｂは、このようにして実現さ
れる２個の２５ビット情報語の例を示している。この図
表の中央の欄は水平の線上に２５ビット情報語を各々示
している。ここでは、付加された（１ビットの）デジタ
ル数が括弧で示されている。
れる２個の２５ビット情報語の例を示している。この図
表の中央の欄は水平の線上に２５ビット情報語を各々示
している。ここでは、付加された（１ビットの）デジタ
ル数が括弧で示されている。
【００２４】前記プリコーダ内の２つのメモリの内容（
ｘ１ 、ｘ２ ）に応じて（図３のａ及びｂにおける左
欄を比較せよ）、これらのプリコーダは図３のａ及びｂ
の表における中央欄に表した４つの２５ビットチャンネ
ル語の中の１個を作成する。
ｘ１ 、ｘ２ ）に応じて（図３のａ及びｂにおける左
欄を比較せよ）、これらのプリコーダは図３のａ及びｂ
の表における中央欄に表した４つの２５ビットチャンネ
ル語の中の１個を作成する。
【００２５】プリコーダ１０及び１１において得られる
２つの２５ビットチャンネル語をこれらプリコーダのメ
モリにおける同一の内容（ｘ１ 、ｘ２ ）について比
較すると、その結果としては、偶数ビットは互いに等し
いが奇数ビットが互いに逆となっているような２つの２
５ビットチャンネル語が得られている。この特性は極め
て有利であり、ａが２に等しいようなａＴプリコーダが
使用される事実と関係がある。このことを図６を参照し
て更に説明する。図６は、実際上全て「０」からなる２
４ビット情報語が１Ｔプリコーダ、２Ｔプリコーダ及び
３Ｔプリコーダによりどの様に変換されるかを、当該２
４ビット情報語に「０」が付加される場合（図６のａ）
と「１」が付加される場合（図６のｂ）の２つの状況に
ついて、示している。
２つの２５ビットチャンネル語をこれらプリコーダのメ
モリにおける同一の内容（ｘ１ 、ｘ２ ）について比
較すると、その結果としては、偶数ビットは互いに等し
いが奇数ビットが互いに逆となっているような２つの２
５ビットチャンネル語が得られている。この特性は極め
て有利であり、ａが２に等しいようなａＴプリコーダが
使用される事実と関係がある。このことを図６を参照し
て更に説明する。図６は、実際上全て「０」からなる２
４ビット情報語が１Ｔプリコーダ、２Ｔプリコーダ及び
３Ｔプリコーダによりどの様に変換されるかを、当該２
４ビット情報語に「０」が付加される場合（図６のａ）
と「１」が付加される場合（図６のｂ）の２つの状況に
ついて、示している。
【００２６】図６は１Ｔプリコーダが、この場合は「０
」に等しいと仮定される当該プリコーダ内の（単一）メ
モリのある内容の場合、２５ビット情報語を、Ｔｍａｘ
即ち２５ビットチャンネル語の直列のデータ流におけ
る連続した「０」又は「１」の最大数が２５ビット情報
語の直列のデータ流におけるＴｍａｘ に較べて実際上
変化しないような形で、２５ビットのチャンネル語に符
号化していることを示している。このことは、当該情報
語の符号化に先立つプリコーダ内のメモリの内容に無関
係に、前記付加手段４が「０」を付加する場合及び同付
加手段が「１」を付加する場合の両方に関して成り立つ
。
」に等しいと仮定される当該プリコーダ内の（単一）メ
モリのある内容の場合、２５ビット情報語を、Ｔｍａｘ
即ち２５ビットチャンネル語の直列のデータ流におけ
る連続した「０」又は「１」の最大数が２５ビット情報
語の直列のデータ流におけるＴｍａｘ に較べて実際上
変化しないような形で、２５ビットのチャンネル語に符
号化していることを示している。このことは、当該情報
語の符号化に先立つプリコーダ内のメモリの内容に無関
係に、前記付加手段４が「０」を付加する場合及び同付
加手段が「１」を付加する場合の両方に関して成り立つ
。
【００２７】前記付加手段、即ちユニット６、が２４ビ
ット情報語に「０」を付加したとすると、２Ｔプリコー
ダは例えば図６のａに示される様に連続する「０」及び
「１」の数が大幅に減少された２５ビットチャンネル語
を生成する。結果として、直列のチャンネル語のデータ
流においてＴｍａｘ をよりよく制御することができる
。
ット情報語に「０」を付加したとすると、２Ｔプリコー
ダは例えば図６のａに示される様に連続する「０」及び
「１」の数が大幅に減少された２５ビットチャンネル語
を生成する。結果として、直列のチャンネル語のデータ
流においてＴｍａｘ をよりよく制御することができる
。
【００２８】２Ｔプリコーダは、「１」が付加手段、即
ちユニット７、により付加された場合は、例えば図６の
ｂに示すようにＴｍａｘ に関していかなる改善もなさ
ない。この２５ビットのチャンネル語のディスパリティ
ー、即ち図６のｂに示す「２３」は、ユニット６により
作成される２５ビットチャンネル語のディスパリティー
、即ち図６のａに示す「１」に較べて、ユニット６によ
って生成される２５ビットのチャンネル語が以下に説明
する選択段において概ね選択されてしまうであろう程度
に、好ましくない（好ましくないほど大きい）。上述し
た理由と同様な理由が、符号化前のプリコーダの可能性
のある他の内容に関しても成り立つ。
ちユニット７、により付加された場合は、例えば図６の
ｂに示すようにＴｍａｘ に関していかなる改善もなさ
ない。この２５ビットのチャンネル語のディスパリティ
ー、即ち図６のｂに示す「２３」は、ユニット６により
作成される２５ビットチャンネル語のディスパリティー
、即ち図６のａに示す「１」に較べて、ユニット６によ
って生成される２５ビットのチャンネル語が以下に説明
する選択段において概ね選択されてしまうであろう程度
に、好ましくない（好ましくないほど大きい）。上述し
た理由と同様な理由が、符号化前のプリコーダの可能性
のある他の内容に関しても成り立つ。
【００２９】３Ｔプリコーダが使用された場合は、図６
から明らかなように、両方の場合とも２５ビットチャン
ネル語における連続する「０」及び「１」の数は対応す
る２５ビット情報語におけるよりも小さい。一般に、符
号化前のプリコーダの内容の可能性のある他の内容に関
しても、２Ｔプリコーダを説明した際にあった理由と同
様の理由が存在する。
から明らかなように、両方の場合とも２５ビットチャン
ネル語における連続する「０」及び「１」の数は対応す
る２５ビット情報語におけるよりも小さい。一般に、符
号化前のプリコーダの内容の可能性のある他の内容に関
しても、２Ｔプリコーダを説明した際にあった理由と同
様の理由が存在する。
【００３０】したがって、結果として、ａ≧２が成り立
つａＴプリコーダが使用される場合の方が、チャンネル
語の直列のデータ流におけるＴｍａｘ をよりよく制御
することができるといえる。
つａＴプリコーダが使用される場合の方が、チャンネル
語の直列のデータ流におけるＴｍａｘ をよりよく制御
することができるといえる。
【００３１】プリコーダ１０及び１１により生成された
２つの２５ビットチャンネル語ＣＷ１ 及びＣＷ２ は
スイッチング手段２２と発生ユニット（制御信号発生手
段）１７とに供給される。ユニット１７においては図４
に示す積算器３０により、プリコーダ１０のチャンネル
語ＣＷ１ のディスパリティーが該積算器３０内に既に
在る値に加算される。この値は、スイッチング手段２２
の端子２１に供給されるチャンネル語の直列データ流の
動きつつあるデジタル和（以下、単にデジタル和）に相
当する。
２つの２５ビットチャンネル語ＣＷ１ 及びＣＷ２ は
スイッチング手段２２と発生ユニット（制御信号発生手
段）１７とに供給される。ユニット１７においては図４
に示す積算器３０により、プリコーダ１０のチャンネル
語ＣＷ１ のディスパリティーが該積算器３０内に既に
在る値に加算される。この値は、スイッチング手段２２
の端子２１に供給されるチャンネル語の直列データ流の
動きつつあるデジタル和（以下、単にデジタル和）に相
当する。
【００３２】同様に、積算器３１により、プリコーダ１
１のチャンネル語ＣＷ２ のディスパリティーが該積算
器３１に在る値に加算される。この値も端子２１におけ
るチャンネル語の直列データ流のデジタル和に相当し、
従って積算器３０に得られる値と等しい。信号発生器３
５は、端子２１におけるチャンネル語の直列データ流の
所望のデジタル和に相当する信号ＲＶを発生する。
１のチャンネル語ＣＷ２ のディスパリティーが該積算
器３１に在る値に加算される。この値も端子２１におけ
るチャンネル語の直列データ流のデジタル和に相当し、
従って積算器３０に得られる値と等しい。信号発生器３
５は、端子２１におけるチャンネル語の直列データ流の
所望のデジタル和に相当する信号ＲＶを発生する。
【００３３】合成ユニット３２及び３３における減算に
より、２つのエラー信号ｅ１ 及びｅ２ が得られ、こ
れらエラー信号はチャンネル語ＣＷ１ 及びＣＷ２ を
各々最後のチャンネル語として有する直列データ流にお
けるデジタル和がどの程度所望のデジタル和からずれて
いるかを示す。比較器３４においては、より小さい絶対
値を持つ方のエラー信号の選択がなされる。このように
、エラー信号ｅ１ の方が小さいと分かった場合は出力
端子１８に制御信号ｃｓ１ が発生されるので、スイッ
チング手段２２は端子１９と端子２１とが結合されるよ
うな位置をとる。かくして、チャンネル語ＣＷ１ が次
のチャンネル語として記録手段２４の入力端子２３に供
給される。前記出力端子１３及び１４からスイッチング
手段２２への信号線における遅延は、ユニット（検出器
）１７において制御信号を得るに必要な時間を補償する
ことを意図している。
より、２つのエラー信号ｅ１ 及びｅ２ が得られ、こ
れらエラー信号はチャンネル語ＣＷ１ 及びＣＷ２ を
各々最後のチャンネル語として有する直列データ流にお
けるデジタル和がどの程度所望のデジタル和からずれて
いるかを示す。比較器３４においては、より小さい絶対
値を持つ方のエラー信号の選択がなされる。このように
、エラー信号ｅ１ の方が小さいと分かった場合は出力
端子１８に制御信号ｃｓ１ が発生されるので、スイッ
チング手段２２は端子１９と端子２１とが結合されるよ
うな位置をとる。かくして、チャンネル語ＣＷ１ が次
のチャンネル語として記録手段２４の入力端子２３に供
給される。前記出力端子１３及び１４からスイッチング
手段２２への信号線における遅延は、ユニット（検出器
）１７において制御信号を得るに必要な時間を補償する
ことを意図している。
【００３４】更に、制御信号入力端子３６及び３７に供
給される前記制御信号ｃｓ１ の影響により、積算器３
０における値は信号線４０を介して積算器３１に転送さ
れ、これにより２つの積算器がそれらのメモリに再び同
一のデジタル和を記憶するようになる。
給される前記制御信号ｃｓ１ の影響により、積算器３
０における値は信号線４０を介して積算器３１に転送さ
れ、これにより２つの積算器がそれらのメモリに再び同
一のデジタル和を記憶するようになる。
【００３５】また、プリコーダ１０及び１１の制御信号
入力端子２６及び２７に供給される前記制御信号ｃｓ１
の影響により、プリコーダ１０内のメモリの内容（ｘ
１ 、ｘ２ ）が信号線４２を介してプリコーダ１１の
２つのメモリに転送されるので、２つのプリコーダのメ
モリは再び同一の内容（ｘ１ 、ｘ２ ）を有するよう
になる。
入力端子２６及び２７に供給される前記制御信号ｃｓ１
の影響により、プリコーダ１０内のメモリの内容（ｘ
１ 、ｘ２ ）が信号線４２を介してプリコーダ１１の
２つのメモリに転送されるので、２つのプリコーダのメ
モリは再び同一の内容（ｘ１ 、ｘ２ ）を有するよう
になる。
【００３６】もしエラー信号ｅ２ の方が小さいと分か
った場合は、制御信号ｃｓ２ が発生されるので、この
制御信号の影響によりスイッチング手段２２は図１に示
す位置になり、その端子２０及び２１が結合される。そ
して、チャンネル語ＣＷ２ がチャンネル語の直列デー
タ流における次のチャンネル語として記録手段２４に供
給される。更に、制御信号ｃｓ２ の影響により積算器
３１のメモリ中に記憶された値が信号線４１を介して積
算器３０のメモリに供給されて該メモリに記憶される一
方、プリコーダ１１の内容（ｘ１ 、ｘ２ ）が信号線
４３を介してプリコーダ１０のメモリに記憶される。
った場合は、制御信号ｃｓ２ が発生されるので、この
制御信号の影響によりスイッチング手段２２は図１に示
す位置になり、その端子２０及び２１が結合される。そ
して、チャンネル語ＣＷ２ がチャンネル語の直列デー
タ流における次のチャンネル語として記録手段２４に供
給される。更に、制御信号ｃｓ２ の影響により積算器
３１のメモリ中に記憶された値が信号線４１を介して積
算器３０のメモリに供給されて該メモリに記憶される一
方、プリコーダ１１の内容（ｘ１ 、ｘ２ ）が信号線
４３を介してプリコーダ１０のメモリに記憶される。
【００３７】エラー信号ｅ１ 及びｅ２ が一致する場
合は、例えば、常に制御信号ｃｓ１ を発生するように
判定されるようにしてもよい。
合は、例えば、常に制御信号ｃｓ１ を発生するように
判定されるようにしてもよい。
【００３８】上述した装置によれば、記録装置２４の入
力端子２３に直流を含まないデジタル信号を発生させる
ことができる。事実、このような信号は当該信号におけ
る前記デジタル和が零となるように調整がなされる故に
発生される。このことは、図４に示す制御信号発生手段
により、信号発生器３５と減算器３２及び３３とが無く
ても、又は信号発生器３５に零信号を発生させるように
することによっても、実施することができる。発生器３
５と減算器３２及び３３とを挿入することにより、デジ
タルデータ流にパイロット信号を付加的に挿入すること
もできる。このパイロット信号の積分は、発生器３５に
より提供される時間の関数としての前記デジタル和の所
望の変化の形状を有する。
力端子２３に直流を含まないデジタル信号を発生させる
ことができる。事実、このような信号は当該信号におけ
る前記デジタル和が零となるように調整がなされる故に
発生される。このことは、図４に示す制御信号発生手段
により、信号発生器３５と減算器３２及び３３とが無く
ても、又は信号発生器３５に零信号を発生させるように
することによっても、実施することができる。発生器３
５と減算器３２及び３３とを挿入することにより、デジ
タルデータ流にパイロット信号を付加的に挿入すること
もできる。このパイロット信号の積分は、発生器３５に
より提供される時間の関数としての前記デジタル和の所
望の変化の形状を有する。
【００３９】この符号化を直流のないものとし、コード
にデジタル和の所望の変化の形状のパイロット信号を付
加することは従来の技術である。例えば、前述したヨー
ロッパ特許出願公開第３３９７２４号を参照されたい。
にデジタル和の所望の変化の形状のパイロット信号を付
加することは従来の技術である。例えば、前述したヨー
ロッパ特許出願公開第３３９７２４号を参照されたい。
【００４０】図５は制御信号発生手段１７の他の実施例
１７’を示している。この制御信号発生手段１７’によ
れば、第２の周波数ｆ２ （＝ｗ２／２π）にディップ
（降下）を実現することができるのと同様に、ｆ＝０Ｈ
ｚでのディップ（即ち、直流電流のない）及び特定の周
波数ｆ１ のパイロット信号の両方が実現される。
１７’を示している。この制御信号発生手段１７’によ
れば、第２の周波数ｆ２ （＝ｗ２／２π）にディップ
（降下）を実現することができるのと同様に、ｆ＝０Ｈ
ｚでのディップ（即ち、直流電流のない）及び特定の周
波数ｆ１ のパイロット信号の両方が実現される。
【００４１】この制御信号発生手段１７’は乗算器５０
、５２、５４及び５６と、積算器５１、５３、５５及び
５７と、２つの信号合成ユニット５８及び５９と、二乗
要素６９．１ないし６９．６とを更に有している。積算
器５１、５３、５５及び５７は積算器３０及び３１と同
様に構成されている。チャンネル語ＣＷ１ は入力端子
１５を介して乗算器５０及び５２の第１入力端子に供給
されている。これら乗算器５０及び５２においては、チ
ャンネル語ＣＷ１ にｓｉｎ ｗ２ ｔとｃｏｓ ｗ２
ｔとが各々乗算される。図７は、連続するチャンネル
語に対してこの乗算がどのように実行されるかを示して
いる。ここで、図７のａはチャンネル語の直列データ流
を時間に対してプロットしたものであり、最後のチャン
ネル語と最後から２番目のチャンネル語の一部とが示さ
れている。また、図７のｂはｓｉｎ ｗ２ ｔ（又はｃ
ｏｓ ｗ２ ｔ）の変化を時間に対してプロットしたも
のを示し、図７のｃはサイン又はコサイン関数の連続し
た値であるこれらの積を示している。積算器５１及び５
３においては、各チャンネル語ＣＷ１ に関して得られ
たこれらの値が、これら積算器５１及び５３内のメモリ
（Ｍｅｍ）に既に存在する値に加算される。各チャンネ
ル語の後に、積算器５１及び５３内のメモリの内容は二
乗要素６９．２及び６９．３を各々介して信号合成ユニ
ット５８に供給される。この信号合成ユニットにおいて
は、３つの二乗要素６９．１、６９．２及び６９．３の
値が必要な重み付けの後合計される。
、５２、５４及び５６と、積算器５１、５３、５５及び
５７と、２つの信号合成ユニット５８及び５９と、二乗
要素６９．１ないし６９．６とを更に有している。積算
器５１、５３、５５及び５７は積算器３０及び３１と同
様に構成されている。チャンネル語ＣＷ１ は入力端子
１５を介して乗算器５０及び５２の第１入力端子に供給
されている。これら乗算器５０及び５２においては、チ
ャンネル語ＣＷ１ にｓｉｎ ｗ２ ｔとｃｏｓ ｗ２
ｔとが各々乗算される。図７は、連続するチャンネル
語に対してこの乗算がどのように実行されるかを示して
いる。ここで、図７のａはチャンネル語の直列データ流
を時間に対してプロットしたものであり、最後のチャン
ネル語と最後から２番目のチャンネル語の一部とが示さ
れている。また、図７のｂはｓｉｎ ｗ２ ｔ（又はｃ
ｏｓ ｗ２ ｔ）の変化を時間に対してプロットしたも
のを示し、図７のｃはサイン又はコサイン関数の連続し
た値であるこれらの積を示している。積算器５１及び５
３においては、各チャンネル語ＣＷ１ に関して得られ
たこれらの値が、これら積算器５１及び５３内のメモリ
（Ｍｅｍ）に既に存在する値に加算される。各チャンネ
ル語の後に、積算器５１及び５３内のメモリの内容は二
乗要素６９．２及び６９．３を各々介して信号合成ユニ
ット５８に供給される。この信号合成ユニットにおいて
は、３つの二乗要素６９．１、６９．２及び６９．３の
値が必要な重み付けの後合計される。
【００４２】同様な動作がチャンネル語ＣＷ２ に対し
ても乗算器５４及び５６と、積算器５５及び５７と、二
乗要素６９．５及び６９．６とにおいて行われる。例え
ば加算器として構成される信号合成ユニット５８及び５
９の出力信号はエラー信号ｅ１ 及びｅ２ であり、こ
れらエラー信号から比較器３４が前述したような方法に
より制御信号ｃｓを生成する。
ても乗算器５４及び５６と、積算器５５及び５７と、二
乗要素６９．５及び６９．６とにおいて行われる。例え
ば加算器として構成される信号合成ユニット５８及び５
９の出力信号はエラー信号ｅ１ 及びｅ２ であり、こ
れらエラー信号から比較器３４が前述したような方法に
より制御信号ｃｓを生成する。
【００４３】前述したようにして制御信号ｃｓ１ が発
生された場合は、当該制御信号は積算器５５及び５７内
のメモリにも付加的に供給され、積算器５１及び５３の
メモリの内容が信号線６１及び６２を介して積算器５５
及び５７のメモリに各々転送される。一方、制御信号ｃ
ｓ２ が発生された場合は、この制御信号の影響により
、積算器５５及び５７のメモリの内容が信号線６３及び
６４を介して積算器５１及び５３のメモリに各々転送さ
れる。
生された場合は、当該制御信号は積算器５５及び５７内
のメモリにも付加的に供給され、積算器５１及び５３の
メモリの内容が信号線６１及び６２を介して積算器５５
及び５７のメモリに各々転送される。一方、制御信号ｃ
ｓ２ が発生された場合は、この制御信号の影響により
、積算器５５及び５７のメモリの内容が信号線６３及び
６４を介して積算器５１及び５３のメモリに各々転送さ
れる。
【００４４】説明するまでもなく、周波数スペクトルに
おいて第３の周波数ｆ３ にも付加的なディップを得た
い場合は、当該制御信号発生手段１７’は入力端子１５
から加算器５８への２つの付加的な枝路を有する必要が
あり、この場合各枝路は乗算器と積算器と二乗要素との
直列接続を含み、この乗算器においてはｓｉｎ ｗ３
ｔとｃｏｓ ｗ３ ｔ（ｗ３ ＝２πｆ３ ）の乗算が
行われる。同様に、入力端子１６から加算器５９への２
つの付加的な枝路が必要であり、各枝路は乗算器と積算
器と二乗要素との直列接続を含む。ここでも、上記乗算
器はｓｉｎ ｗ３ ｔとｃｏｓ ｗ３ ｔによる乗算を
行う。また、得られる制御信号ｃｓに応じて、入力端子
１５から加算器５８への付加枝路における積算器の内容
が入力端子１６から加算器５９への付加枝路に含まれる
積算器のメモリに転送され、又はその逆が行われる。
おいて第３の周波数ｆ３ にも付加的なディップを得た
い場合は、当該制御信号発生手段１７’は入力端子１５
から加算器５８への２つの付加的な枝路を有する必要が
あり、この場合各枝路は乗算器と積算器と二乗要素との
直列接続を含み、この乗算器においてはｓｉｎ ｗ３
ｔとｃｏｓ ｗ３ ｔ（ｗ３ ＝２πｆ３ ）の乗算が
行われる。同様に、入力端子１６から加算器５９への２
つの付加的な枝路が必要であり、各枝路は乗算器と積算
器と二乗要素との直列接続を含む。ここでも、上記乗算
器はｓｉｎ ｗ３ ｔとｃｏｓ ｗ３ ｔによる乗算を
行う。また、得られる制御信号ｃｓに応じて、入力端子
１５から加算器５８への付加枝路における積算器の内容
が入力端子１６から加算器５９への付加枝路に含まれる
積算器のメモリに転送され、又はその逆が行われる。
【００４５】この点に関しては、図５の回路における発
生器３５によりなされるパイロット信号の振幅は、この
図５の回路により１以上の周波数でのディップを実現す
るような制御も可能なように、選択されなければならな
い。このことは、発生器３５におけるパイロット信号の
振幅が最適値に、即ち大き過ぎないように、調整されな
ければならないことを意味する。
生器３５によりなされるパイロット信号の振幅は、この
図５の回路により１以上の周波数でのディップを実現す
るような制御も可能なように、選択されなければならな
い。このことは、発生器３５におけるパイロット信号の
振幅が最適値に、即ち大き過ぎないように、調整されな
ければならないことを意味する。
【００４６】図８は、その部分ａに図１における信号付
加手段４の出力端子９とａＴプリコーダ１１の入力端子
との間に介挿することができる信号合成手段７３を示し
ている。また、信号付加手段４の出力端子８とａＴプリ
コーダ１０の入力端子１２との間にも同様の信号合成手
段を介挿することができる。図８のａはメモリ７４を示
し、このメモリには信号付加手段４で得られた（ｎ＋１
）ビットの情報語を記憶することができる。このメモリ
７４は信号付加手段４の一部を形成してもよく、又は当
該信号合成手段７３の一部を形成するようにしてもよい
。信号合成手段７３は、例えばＥＸＯＲの形の少なくと
も１個の信号合成ユニットを有する。図８のａは２つの
そのような合成ユニット７６．１と７６．２を有してい
る。ＥＸＯＲはｎビット情報語に付加された１ビットデ
ジタル語とこのｎビット情報語のｉ番目のビットとを合
成して新たな情報語のｉ番目のビットを作成し、この新
情報語は前記１ビットデジタル語と一緒にメモリ７５に
供給され、該メモリに（ｎ＋１）ビットの新情報語とし
て記憶される。このメモリ７５は当該信号合成手段７３
の一部を形成しても、又はａＴプリコーダ１０又は１１
の一部を形成するようにしてもよい。
加手段４の出力端子９とａＴプリコーダ１１の入力端子
との間に介挿することができる信号合成手段７３を示し
ている。また、信号付加手段４の出力端子８とａＴプリ
コーダ１０の入力端子１２との間にも同様の信号合成手
段を介挿することができる。図８のａはメモリ７４を示
し、このメモリには信号付加手段４で得られた（ｎ＋１
）ビットの情報語を記憶することができる。このメモリ
７４は信号付加手段４の一部を形成してもよく、又は当
該信号合成手段７３の一部を形成するようにしてもよい
。信号合成手段７３は、例えばＥＸＯＲの形の少なくと
も１個の信号合成ユニットを有する。図８のａは２つの
そのような合成ユニット７６．１と７６．２を有してい
る。ＥＸＯＲはｎビット情報語に付加された１ビットデ
ジタル語とこのｎビット情報語のｉ番目のビットとを合
成して新たな情報語のｉ番目のビットを作成し、この新
情報語は前記１ビットデジタル語と一緒にメモリ７５に
供給され、該メモリに（ｎ＋１）ビットの新情報語とし
て記憶される。このメモリ７５は当該信号合成手段７３
の一部を形成しても、又はａＴプリコーダ１０又は１１
の一部を形成するようにしてもよい。
【００４７】図８のａはＥＸＯＲ７６．１を示し、該Ｅ
ＸＯＲはメモリ７４の記憶位置７４．１に記憶された１
ビットデジタル語と該メモリの２番目の記憶位置７４．
２に記憶された情報語の第１ビットとを合成する。ＥＸ
ＯＲ７６．１の出力端子はメモリ７５の２番目の記憶位
置７５．２の入力端子に結合されている。更に、第２の
ＥＸＯＲ７６．２が設けられ、該ＥＸＯＲは記憶位置７
４．１と７４．８との内容を合成してメモリ７５におけ
る記憶位置７５．８の内容を得る。
ＸＯＲはメモリ７４の記憶位置７４．１に記憶された１
ビットデジタル語と該メモリの２番目の記憶位置７４．
２に記憶された情報語の第１ビットとを合成する。ＥＸ
ＯＲ７６．１の出力端子はメモリ７５の２番目の記憶位
置７５．２の入力端子に結合されている。更に、第２の
ＥＸＯＲ７６．２が設けられ、該ＥＸＯＲは記憶位置７
４．１と７４．８との内容を合成してメモリ７５におけ
る記憶位置７５．８の内容を得る。
【００４８】上記メモリ７４における他の各記憶位置は
メモリ７５における対応する記憶位置の入力端子に直接
結合されている。そして、このようにしてメモリ７５に
得られ且つ該メモリに記憶された新たな（ｎ＋１）ビッ
トの情報語は前記ａＴプリコーダに供給される。
メモリ７５における対応する記憶位置の入力端子に直接
結合されている。そして、このようにしてメモリ７５に
得られ且つ該メモリに記憶された新たな（ｎ＋１）ビッ
トの情報語は前記ａＴプリコーダに供給される。
【００４９】図８のｂは、上記メモリ７４内にある（ｎ
＋１）ビット情報語を２Ｔで前置符号化した後に得られ
たであろう（ｎ＋１）ビットチャンネル語を示し、又図
８のｃは、メモリ７５内にある（ｎ＋１）ビット情報語
を２Ｔで前置符号化した後に得られたであろう（ｎ＋１
）ビットチャンネル語を示している。なお、上記は両方
の場合ともａＴプリコーダの内容が「０１」であったと
の仮定の場合に成り立つ。
＋１）ビット情報語を２Ｔで前置符号化した後に得られ
たであろう（ｎ＋１）ビットチャンネル語を示し、又図
８のｃは、メモリ７５内にある（ｎ＋１）ビット情報語
を２Ｔで前置符号化した後に得られたであろう（ｎ＋１
）ビットチャンネル語を示している。なお、上記は両方
の場合ともａＴプリコーダの内容が「０１」であったと
の仮定の場合に成り立つ。
【００５０】前記のＥＸＯＲ７６．１による拡張の利点
は、結果としてｎビット情報語における奇数ビットも前
記の１ビットの付加ビットによる影響を受けるよにする
ことができる点にある。このことはＥＸＯＲ７６．２の
ような次の各ＥＸＯＲに関しても成り立つ。これに関し
は、図８のｃが記憶位置７５．８以降全てのビットが再
び「１」となっていることを明らかに示している。
は、結果としてｎビット情報語における奇数ビットも前
記の１ビットの付加ビットによる影響を受けるよにする
ことができる点にある。このことはＥＸＯＲ７６．２の
ような次の各ＥＸＯＲに関しても成り立つ。これに関し
は、図８のｃが記憶位置７５．８以降全てのビットが再
び「１」となっていることを明らかに示している。
【００５１】以下に更に説明するように、再生時のＰＲ
４検出によれば、検出されたチャンネル語はメモリ７５
に記憶された（ｎ＋１）ビット情報語のようになる。
４検出によれば、検出されたチャンネル語はメモリ７５
に記憶された（ｎ＋１）ビット情報語のようになる。
【００５２】再生側にも、図８のｄに表したような信号
合成手段７３’を設ける必要がある。この合成手段７３
’は前記合成手段７３と実際に同一である。メモリ７７
には、ＰＲ４検出の後、メモリ７５中にあった（ｎ＋１
）ビットの情報語が現れる。この（ｎ＋１）ビット情報
語がＥＸＯＲ７８．１及び７８．２で処理された後、図
８のａに示したメモリ７４内に記憶された元の（ｎ＋１
）ビット情報語が再びメモリ７９に得られる。
合成手段７３’を設ける必要がある。この合成手段７３
’は前記合成手段７３と実際に同一である。メモリ７７
には、ＰＲ４検出の後、メモリ７５中にあった（ｎ＋１
）ビットの情報語が現れる。この（ｎ＋１）ビット情報
語がＥＸＯＲ７８．１及び７８．２で処理された後、図
８のａに示したメモリ７４内に記憶された元の（ｎ＋１
）ビット情報語が再びメモリ７９に得られる。
【００５３】説明するまでもなく、好みに応じて、信号
合成手段７３（そして７３’）は単一の又はむしろ３以
上のＥＸＯＲを有してもよい。
合成手段７３（そして７３’）は単一の又はむしろ３以
上のＥＸＯＲを有してもよい。
【００５４】図９は信号合成手段における処理の他の実
施例を示している。先にも見たように、２４ビット情報
語は３個の８ビット情報語を組み合わせることにより得
られる。これが図９のａに示されている。ここで、もし
信号合成手段８３内に２以上の排他的論理和ゲートがあ
るとすると、８ビット情報語の中の１個に属するビット
のみが１ビットデジタル語と合成されるのが好ましい。 その理由は、再生中のエラーの拡大を避けるためであり
、このようなエラー拡大は付加ビットの誤った読取の結
果である。
施例を示している。先にも見たように、２４ビット情報
語は３個の８ビット情報語を組み合わせることにより得
られる。これが図９のａに示されている。ここで、もし
信号合成手段８３内に２以上の排他的論理和ゲートがあ
るとすると、８ビット情報語の中の１個に属するビット
のみが１ビットデジタル語と合成されるのが好ましい。 その理由は、再生中のエラーの拡大を避けるためであり
、このようなエラー拡大は付加ビットの誤った読取の結
果である。
【００５５】２５ビット情報語にわたるＥＸＯＲの正し
い広がりを実現するために、関係する８ビット情報語の
１以上のビットの位置の変更を行う。このことが図９の
ａに示されている。
い広がりを実現するために、関係する８ビット情報語の
１以上のビットの位置の変更を行う。このことが図９の
ａに示されている。
【００５６】追加ビットの前述した誤った読取の影響を
低減するために、好ましくは８ビット情報語の最下位側
のビットと該付加ビットとを信号合成手段８３において
合成する。図９のａから、２４ビット情報語に含まれる
２番目の８ビット情報語の２つの最下位側のビットが追
加ビットと合成されていることは明らかである。即ち、
２４ビット情報語ｉｗ１ は２４ビット情報語ｉｗ１’
に変換され、この間、情報語ｉｗ１ のビット１５及び
１６は情報語ｉｗ１ ’における位置７及び１９に移動
される。この移動の間、ビット１ないし６とビット２０
ないし２４は同じ位置を維持する。そして、ビット７な
いし１４は右方向に１個だけ位置をずらし、ビット１７
、１８及び１９は左方向に１個だけ位置をずらす。
低減するために、好ましくは８ビット情報語の最下位側
のビットと該付加ビットとを信号合成手段８３において
合成する。図９のａから、２４ビット情報語に含まれる
２番目の８ビット情報語の２つの最下位側のビットが追
加ビットと合成されていることは明らかである。即ち、
２４ビット情報語ｉｗ１ は２４ビット情報語ｉｗ１’
に変換され、この間、情報語ｉｗ１ のビット１５及び
１６は情報語ｉｗ１ ’における位置７及び１９に移動
される。この移動の間、ビット１ないし６とビット２０
ないし２４は同じ位置を維持する。そして、ビット７な
いし１４は右方向に１個だけ位置をずらし、ビット１７
、１８及び１９は左方向に１個だけ位置をずらす。
【００５７】次いで、上記追加ビットが付加され、当該
合成ユニット８３内で合成処理が行われる。かくして情
報語ｉｗｏｕｔ が得られ、前述したプリコーダに供給
される。
合成ユニット８３内で合成処理が行われる。かくして情
報語ｉｗｏｕｔ が得られ、前述したプリコーダに供給
される。
【００５８】図９のｂは再生時における逆の処理を示し
ている。再生の結果、語ｉｗｏｕｔ が得られ、該語は
合成手段８３’により図８のｄに示したのと同様の方法
により変換される。この場合、ビット７及び１９はそれ
らの正しい位置に戻され、その後元の２４ビット情報語
ｉｗ１ が得られる。
ている。再生の結果、語ｉｗｏｕｔ が得られ、該語は
合成手段８３’により図８のｄに示したのと同様の方法
により変換される。この場合、ビット７及び１９はそれ
らの正しい位置に戻され、その後元の２４ビット情報語
ｉｗ１ が得られる。
【００５９】図１に示した回路を拡張した態様を図１０
に示す。この場合、プリコーダ１０の出力端子１３は「
Ｔｍａｘ より大」なる検出器９０の入力端子に結合さ
れている。また、プリコーダ１１の出力端子１４はＴｍ
ａｘ 検出器９１の入力端子に結合されている。ここで
、チャンネル語の直列データ流における連続する「０」
又は「１」の最大数が９に等しいと仮定すると、チャン
ネル語ＣＷ１ とＣＷ２ との直列データ流の各々にお
いて１０個以上連続した「０」又は「１」が発生した場
合に、検出器９０及び９１がそれらの出力端子に制御信
号を発生する。これら検出器９０及び９１の出力端子は
判定ユニット９２の入力端子９３．１及び９３．２に各
々結合され、該判定ユニットは前記制御信号発生手段１
７の下流側に設けられている。
に示す。この場合、プリコーダ１０の出力端子１３は「
Ｔｍａｘ より大」なる検出器９０の入力端子に結合さ
れている。また、プリコーダ１１の出力端子１４はＴｍ
ａｘ 検出器９１の入力端子に結合されている。ここで
、チャンネル語の直列データ流における連続する「０」
又は「１」の最大数が９に等しいと仮定すると、チャン
ネル語ＣＷ１ とＣＷ２ との直列データ流の各々にお
いて１０個以上連続した「０」又は「１」が発生した場
合に、検出器９０及び９１がそれらの出力端子に制御信
号を発生する。これら検出器９０及び９１の出力端子は
判定ユニット９２の入力端子９３．１及び９３．２に各
々結合され、該判定ユニットは前記制御信号発生手段１
７の下流側に設けられている。
【００６０】この点に関しては、Ｔｍａｘ を判定する
ために、連続した「０」又は「１」の列が許容される数
を越えて発生しているか否かを検出するためにチャンネ
ル語の境界を越えて見ることが可能であることに注意さ
れたい。
ために、連続した「０」又は「１」の列が許容される数
を越えて発生しているか否かを検出するためにチャンネ
ル語の境界を越えて見ることが可能であることに注意さ
れたい。
【００６１】上記各検出器がそれらの出力端子に制御信
号を発生しない場合は、判定回路９２の入力端子９３．
３に供給される手段１７の出力端子１８の制御信号ｃｓ
が当該回路９２の出力端子９４に転送される。この場合
、当該装置は図１を参照して説明したように動作する。
号を発生しない場合は、判定回路９２の入力端子９３．
３に供給される手段１７の出力端子１８の制御信号ｃｓ
が当該回路９２の出力端子９４に転送される。この場合
、当該装置は図１を参照して説明したように動作する。
【００６２】ここで、検出器９０が制御信号を発生した
と仮定する。このことは、チャンネル語ＣＷ１ に関し
て端子２１の直列データ流における連続した「０」また
は「１」の最大数が超過したであろうことを意味する。 検出器９０のこの制御信号は入力端子９３．１に供給さ
れ、手段１７の制御信号ｃｓが判定回路９２において阻
止されるようにする。この場合、判定回路９２は自身で
第２の制御信号ｃｓ２ を発生するので、チャンネル語
ＣＷ２ をスイッチング手段２２を介して記録装置２４
に供給するよう決定される。
と仮定する。このことは、チャンネル語ＣＷ１ に関し
て端子２１の直列データ流における連続した「０」また
は「１」の最大数が超過したであろうことを意味する。 検出器９０のこの制御信号は入力端子９３．１に供給さ
れ、手段１７の制御信号ｃｓが判定回路９２において阻
止されるようにする。この場合、判定回路９２は自身で
第２の制御信号ｃｓ２ を発生するので、チャンネル語
ＣＷ２ をスイッチング手段２２を介して記録装置２４
に供給するよう決定される。
【００６３】逆に、もし検出器９１が制御信号を発生し
た場合は、判定回路９２は同様にして手段１７の制御信
号を阻止し自身で出力端子９４に制御信号ｃｓ１ を発
生するので、スイッチング手段２２は端子１９が端子２
１に接続されるような位置になる。かくして、チャンネ
ル語ＣＷ１ が記録装置２４に供給される。
た場合は、判定回路９２は同様にして手段１７の制御信
号を阻止し自身で出力端子９４に制御信号ｃｓ１ を発
生するので、スイッチング手段２２は端子１９が端子２
１に接続されるような位置になる。かくして、チャンネ
ル語ＣＷ１ が記録装置２４に供給される。
【００６４】他の例として、２つの検出器９０及び９１
が制御信号を発生し、該制御信号を判定回路の入力端子
９３．１及び９３．２に供給するようにすることもでき
る。この場合も、回路９２はユニット１７の制御信号ｃ
ｓを阻止する。プリコーダ１１の出力端子の直列データ
流におけるよりもプリコーダ１０の出力端子の直列デー
タ流において数の少ない連続した「０」又は「１」が発
生するようになると、判定回路９２は制御信号ｃｓ１
を発生するので、チャンネル語ＣＷ１ が転送される。 明らかなように、２つの検出器９０及び９１はこの場合
プリコーダ１０及び１１の出力信号における連続した「
０」又は「１」の最大数を検出する手段を有していなけ
ればならず、これら２つのチャンネル語に関する各最大
数は、判定回路９２が所望の制御信号ｃｓを発生するこ
とができるように当該回路９２に供給されねばならない
。
が制御信号を発生し、該制御信号を判定回路の入力端子
９３．１及び９３．２に供給するようにすることもでき
る。この場合も、回路９２はユニット１７の制御信号ｃ
ｓを阻止する。プリコーダ１１の出力端子の直列データ
流におけるよりもプリコーダ１０の出力端子の直列デー
タ流において数の少ない連続した「０」又は「１」が発
生するようになると、判定回路９２は制御信号ｃｓ１
を発生するので、チャンネル語ＣＷ１ が転送される。 明らかなように、２つの検出器９０及び９１はこの場合
プリコーダ１０及び１１の出力信号における連続した「
０」又は「１」の最大数を検出する手段を有していなけ
ればならず、これら２つのチャンネル語に関する各最大
数は、判定回路９２が所望の制御信号ｃｓを発生するこ
とができるように当該回路９２に供給されねばならない
。
【００６５】この点に関しては、チャンネル語のいずれ
かに関して一旦判定がなされたならば、Ｔｍａｘ 検出
器９０及び９１内の情報は回路９２の出力端子の制御信
号の影響により、プリコーダ１０及び１１並びに図４及
び５に示した積算器に関して既に説明したのと同様の方
法により、等しくされる。
かに関して一旦判定がなされたならば、Ｔｍａｘ 検出
器９０及び９１内の情報は回路９２の出力端子の制御信
号の影響により、プリコーダ１０及び１１並びに図４及
び５に示した積算器に関して既に説明したのと同様の方
法により、等しくされる。
【００６６】なお、図１の装置の図８及び９に示した拡
張態様を図１０を参照して説明した装置に適用すること
が可能であることは明らかである。
張態様を図１０を参照して説明した装置に適用すること
が可能であることは明らかである。
【００６７】チャンネル語の直列データ流への同期語の
付加は以下のようにして行われる。
付加は以下のようにして行われる。
【００６８】ここで、データ流におけるＴｍａｘ が先
に述べたように９であると決定されていると仮定する。 このデータ流における同期語を検出するためには、この
同期語は独特のものでなければならない。可能性として
は、例えば１０個の連続した「０」又は「１」が発生す
るような同期語がある。
に述べたように９であると決定されていると仮定する。 このデータ流における同期語を検出するためには、この
同期語は独特のものでなければならない。可能性として
は、例えば１０個の連続した「０」又は「１」が発生す
るような同期語がある。
【００６９】図１１はそのような同期語をどのよにして
チャンネル語のデータ流に含めるかを示している。並列
／直列変換器２’は、前述したようにして３個の８ビッ
トデジタル語を２４ビットの情報語に合成するために配
置されている。規則的な反復時点（同期時点）において
、３個の８ビットデジタル語の代わりに単一の８ビット
デジタル語ｂ２ のみが例えば１２図に示す「０１１０
０００００００１１０１」の形の１５ビットの同期語ｂ
１ と合成され、その際該同期語ｂ１ が先に来、次に
８ビットのデジタル語ｂ２ が来る。信号付加ユニット
６’においては、「００」に等しい２ビット語ｂ３ が
この２３ビット語に付加されて２５ビットの情報語ｉ１
が得られ、該情報語が２Ｔプリコーダ１０に供給され
る。また、信号付加手段７’においては、「１１」に等
しい２ビット語ｂ３ が２３ビット語に付加されて２５
ビットの情報語ｉ２ が得られ、該情報語が２Ｔプリコ
ーダ１１に供給される。
チャンネル語のデータ流に含めるかを示している。並列
／直列変換器２’は、前述したようにして３個の８ビッ
トデジタル語を２４ビットの情報語に合成するために配
置されている。規則的な反復時点（同期時点）において
、３個の８ビットデジタル語の代わりに単一の８ビット
デジタル語ｂ２ のみが例えば１２図に示す「０１１０
０００００００１１０１」の形の１５ビットの同期語ｂ
１ と合成され、その際該同期語ｂ１ が先に来、次に
８ビットのデジタル語ｂ２ が来る。信号付加ユニット
６’においては、「００」に等しい２ビット語ｂ３ が
この２３ビット語に付加されて２５ビットの情報語ｉ１
が得られ、該情報語が２Ｔプリコーダ１０に供給され
る。また、信号付加手段７’においては、「１１」に等
しい２ビット語ｂ３ が２３ビット語に付加されて２５
ビットの情報語ｉ２ が得られ、該情報語が２Ｔプリコ
ーダ１１に供給される。
【００７０】上記２ビット語ｂ３ は２３ビット語に２
５ビットの情報語を得るために接頭語として付加される
。 この例においては、実際に、これらの２ビットは２５ビ
ット情報語の２つの最上位ビットである。
５ビットの情報語を得るために接頭語として付加される
。 この例においては、実際に、これらの２ビットは２５ビ
ット情報語の２つの最上位ビットである。
【００７１】情報語ｉ１ 及びｉ２ がプリコーダ１０
及び１１に各々供給されるやいなや、これらプリコーダ
は先ずそれらの２つの記憶位置の内容、即ち「００」、
にプリセットされる。これらプリコーダにおける符号化
処理の後、情報語ｉ１ 及びｉ２ は図１２に示された
ようにチャンネル語ＣＷ１ 及びＣＷ２ を生成する。 これら２つのチャンネル語は１０個の連続した「１」又
は「０」を有しているので同期用に使用することができ
、従ってこれらチャンネル語は読み出された時に同期検
出器により検出することができるのは明らかである。
及び１１に各々供給されるやいなや、これらプリコーダ
は先ずそれらの２つの記憶位置の内容、即ち「００」、
にプリセットされる。これらプリコーダにおける符号化
処理の後、情報語ｉ１ 及びｉ２ は図１２に示された
ようにチャンネル語ＣＷ１ 及びＣＷ２ を生成する。 これら２つのチャンネル語は１０個の連続した「１」又
は「０」を有しているので同期用に使用することができ
、従ってこれらチャンネル語は読み出された時に同期検
出器により検出することができるのは明らかである。
【００７２】Ｔｍａｘ 検出器９０及び９１がプリコー
ダ１０及び１１が符号化された１５ビットの同期語を発
生している期間中オフとされるべきであることは言うま
でもない。
ダ１０及び１１が符号化された１５ビットの同期語を発
生している期間中オフとされるべきであることは言うま
でもない。
【００７３】図１３は磁気チャンネル語記録に関して上
述した装置の多数の可能性のある応用を示している。図
１３のａには螺旋走査原理に基づく記録装置が示され、
そこでは２つの書込ヘッドＫ１ 及びＫ２ が回転ヘッ
ドドラム１００ 上に互いに直径方向反対側に位置され
ている。 また、記録担体は当該ヘッドの周りに１８０度にわたっ
て巻かれる。ヘッドＫ１ 及びＫ２ はトラックＴ１
、Ｔ２ 、Ｔ３ …を順次記録担体１０１ 上に記録し
、この場合偶数トラックは例えばヘッドＫ２ により記
録され、奇数トラックはヘッドＫ１ により記録される
。
述した装置の多数の可能性のある応用を示している。図
１３のａには螺旋走査原理に基づく記録装置が示され、
そこでは２つの書込ヘッドＫ１ 及びＫ２ が回転ヘッ
ドドラム１００ 上に互いに直径方向反対側に位置され
ている。 また、記録担体は当該ヘッドの周りに１８０度にわたっ
て巻かれる。ヘッドＫ１ 及びＫ２ はトラックＴ１
、Ｔ２ 、Ｔ３ …を順次記録担体１０１ 上に記録し
、この場合偶数トラックは例えばヘッドＫ２ により記
録され、奇数トラックはヘッドＫ１ により記録される
。
【００７４】上述した装置により、連続するトラックに
記録されるチャンネル語はその都度異なる周波数のパイ
ロット信号により拡張される。図１３のａは異なる周波
数ｆ１ 、ｆ２ 、ｆ３ 及びｆ４ の４個のパイロッ
ト信号の繰り返しを示している。例えばトラックＴ４
に記録される信号の周波数特性が図１４に概念的に示さ
れている。 周波数ｆ１ のパイロット信号に加えて、ｆ＝０、ｆ＝
ｆ４ 及びｆ＝ｆ２ なる周波数にディップがある。
記録されるチャンネル語はその都度異なる周波数のパイ
ロット信号により拡張される。図１３のａは異なる周波
数ｆ１ 、ｆ２ 、ｆ３ 及びｆ４ の４個のパイロッ
ト信号の繰り返しを示している。例えばトラックＴ４
に記録される信号の周波数特性が図１４に概念的に示さ
れている。 周波数ｆ１ のパイロット信号に加えて、ｆ＝０、ｆ＝
ｆ４ 及びｆ＝ｆ２ なる周波数にディップがある。
【００７５】再生中にトラッキングを可能にすることが
パイロット信号の一つの目的である。また、２つの隣接
するトラックＴ３ とＴ５ からのパイロット信号の漏
れも、トラックＴ４ がヘッドＫ２ により読み取られ
る時に読み出される。この合成信号からトラッキング制
御信号が作成され、この信号に応答して読出ヘッドが読
み取られるべきトラック上に、例えば該ヘッドが取りつ
けられたピエゾ素子を駆動することにより又はテープ移
送部を制御することにより、位置決めされる。隣接する
トラックＴ３ とＴ５ からパイロット信号の漏れを読
むということは、パイロット信号ｆ２ 及びｆ４ の漏
れが各トラックＴ３ 及びＴ５ から読み取られるべき
であるということを意味する。
パイロット信号の一つの目的である。また、２つの隣接
するトラックＴ３ とＴ５ からのパイロット信号の漏
れも、トラックＴ４ がヘッドＫ２ により読み取られ
る時に読み出される。この合成信号からトラッキング制
御信号が作成され、この信号に応答して読出ヘッドが読
み取られるべきトラック上に、例えば該ヘッドが取りつ
けられたピエゾ素子を駆動することにより又はテープ移
送部を制御することにより、位置決めされる。隣接する
トラックＴ３ とＴ５ からパイロット信号の漏れを読
むということは、パイロット信号ｆ２ 及びｆ４ の漏
れが各トラックＴ３ 及びＴ５ から読み取られるべき
であるということを意味する。
【００７６】この測定がトラックＴ４ の信号により妨
害されるのを出来るだけ少なくするため、周波数ｆ４
及びｆ２ にディップが導入されている。他のトラック
に関しても図１４に示した周波数特性と類似の周波数特
性が有効であることは明らかであろう。この場合、ピー
クは異なる周波数（ｆ２ 、ｆ３ 又はｆ４ ）に発生
し、ディップもそのように発生する（各々ｆ１ 及びｆ
３ 、ｆ２ 及びｆ４ 又はｆ３ 及びｆ１ ）。
害されるのを出来るだけ少なくするため、周波数ｆ４
及びｆ２ にディップが導入されている。他のトラック
に関しても図１４に示した周波数特性と類似の周波数特
性が有効であることは明らかであろう。この場合、ピー
クは異なる周波数（ｆ２ 、ｆ３ 又はｆ４ ）に発生
し、ディップもそのように発生する（各々ｆ１ 及びｆ
３ 、ｆ２ 及びｆ４ 又はｆ３ 及びｆ１ ）。
【００７７】トラッキングを実現するための読取動作中
のパイロット信号の検出は前述したヨーロッパ特許出願
公開第３３９７２４号に詳細に述べられているので、こ
こではこれ以上詳細には説明しない。
のパイロット信号の検出は前述したヨーロッパ特許出願
公開第３３９７２４号に詳細に述べられているので、こ
こではこれ以上詳細には説明しない。
【００７８】図１３のｂは隣接し且つ強固に結合された
２つのヘッドＫ１ 及びＫ２ を示している。これらの
ヘッドＫ１ 及びＫ２ はヘッドドラム１００ が順次
回転する間にトラック対Ｔ１ 及びＴ２ 、Ｔ３ 及び
Ｔ４ 、Ｔ５ 及びＴ６ …を記録する。記録担体１０
１ は上記ヘッドドラム１００ に任意の角度にわたっ
て巻くことができる。図６のｃの各トラックにおける文
字符号ａ、ｂ及びｃは図１５のａ、ｂ及びｃにおける各
周波数特性を参照している。これらの周波数特性は各ト
ラックに記録される情報の周波数特性を示している。
２つのヘッドＫ１ 及びＫ２ を示している。これらの
ヘッドＫ１ 及びＫ２ はヘッドドラム１００ が順次
回転する間にトラック対Ｔ１ 及びＴ２ 、Ｔ３ 及び
Ｔ４ 、Ｔ５ 及びＴ６ …を記録する。記録担体１０
１ は上記ヘッドドラム１００ に任意の角度にわたっ
て巻くことができる。図６のｃの各トラックにおける文
字符号ａ、ｂ及びｃは図１５のａ、ｂ及びｃにおける各
周波数特性を参照している。これらの周波数特性は各ト
ラックに記録される情報の周波数特性を示している。
【００７９】トラックＴ１ 及びＴ２ がヘッドＫ１
及びＫ２ により各々読み取られる際に、トラックＴ１
を読んでいるヘッドＫ１ はトラックＴ２ からのパ
イロット信号ｆ２ の漏れも読み取る。最適な読取動作
を可能にするために、トラックＴ１ に記録される信号
の周波数特性に、例えば図１５のａに示すように、この
周波数ｆ２ のとろろにディップを設ける。ヘッドＫ２
は、同様に、トラックＴ２ からの情報を読み取ると
共にトラックＴ１ からのパイロット信号ｆ１ の漏れ
も読み取る。したがって、トラックＴ２ 上の情報の周
波数特性に、例えば図１５のｂに示すように、周波数ｆ
１ のところにディップを発生させる。
及びＫ２ により各々読み取られる際に、トラックＴ１
を読んでいるヘッドＫ１ はトラックＴ２ からのパ
イロット信号ｆ２ の漏れも読み取る。最適な読取動作
を可能にするために、トラックＴ１ に記録される信号
の周波数特性に、例えば図１５のａに示すように、この
周波数ｆ２ のとろろにディップを設ける。ヘッドＫ２
は、同様に、トラックＴ２ からの情報を読み取ると
共にトラックＴ１ からのパイロット信号ｆ１ の漏れ
も読み取る。したがって、トラックＴ２ 上の情報の周
波数特性に、例えば図１５のｂに示すように、周波数ｆ
１ のところにディップを発生させる。
【００８０】読み取られた漏れ信号から制御信号を作成
することができ、該制御信号を読取動作中のトラッキン
グを実現するために使用することができる。ここで、ヘ
ッドＫ１ 及びＫ２ の対はピエゾ素子上に設けられる
か、又はトラッキングは記録担体の移送速度を制御する
ことにより行われる。
することができ、該制御信号を読取動作中のトラッキン
グを実現するために使用することができる。ここで、ヘ
ッドＫ１ 及びＫ２ の対はピエゾ素子上に設けられる
か、又はトラッキングは記録担体の移送速度を制御する
ことにより行われる。
【００８１】もしヘッドＫ１ 及びＫ２ が次いでトラ
ックＴ３ 及びＴ４ の対を読み取る場合は、トラック
Ｔ３ を読み取るヘッドＫ１ はトラックＴ２ からの
パイロット信号ｆ２ の漏れも検出し、ヘッドＫ２ は
トラックＴ５からのパイロット信号ｆ１ の漏れを検出
する。トラッキング用の適切な制御信号を実現するため
に、２つの検出された漏れ信号に先ず信号反転を施さな
ければならない。
ックＴ３ 及びＴ４ の対を読み取る場合は、トラック
Ｔ３ を読み取るヘッドＫ１ はトラックＴ２ からの
パイロット信号ｆ２ の漏れも検出し、ヘッドＫ２ は
トラックＴ５からのパイロット信号ｆ１ の漏れを検出
する。トラッキング用の適切な制御信号を実現するため
に、２つの検出された漏れ信号に先ず信号反転を施さな
ければならない。
【００８２】トラックＴ３ 上の信号の周波数特性に関
しては図１５のｃに示すように（周波数ｆ１ にではな
く）周波数ｆ２ におけるディップで充分であり、又ト
ラックＴ４ 上の信号の周波数特性に関しては（周波数
ｆ２ にではなく）周波数ｆ１ におけるディップで充
分であろう。 しかしながら、パイロット信号の最適な検出のためには
、両周波数にディップを有することがより望ましい。 更に、トラックＴ１ 、Ｔ５ 、Ｔ９ …におけるパイ
ロット信号ｆ１ の位相は、パイロット信号があるトラ
ック（例えばＴ５ ）で検出された際にこの検出がトラ
ックＴ１ 及びＴ９ におけるパイロット信号ｆ１ に
よって可能な限り影響されないように、９０度にわたっ
て相互にシフトされていることが望ましい。当然、上記
と同様な方法がトラックＴ２ 、Ｔ６ …におけるパイ
ロット信号ｆ２ にも適用される。この対策は同期の検
出が再生中に使用されるという事実に関係している。
しては図１５のｃに示すように（周波数ｆ１ にではな
く）周波数ｆ２ におけるディップで充分であり、又ト
ラックＴ４ 上の信号の周波数特性に関しては（周波数
ｆ２ にではなく）周波数ｆ１ におけるディップで充
分であろう。 しかしながら、パイロット信号の最適な検出のためには
、両周波数にディップを有することがより望ましい。 更に、トラックＴ１ 、Ｔ５ 、Ｔ９ …におけるパイ
ロット信号ｆ１ の位相は、パイロット信号があるトラ
ック（例えばＴ５ ）で検出された際にこの検出がトラ
ックＴ１ 及びＴ９ におけるパイロット信号ｆ１ に
よって可能な限り影響されないように、９０度にわたっ
て相互にシフトされていることが望ましい。当然、上記
と同様な方法がトラックＴ２ 、Ｔ６ …におけるパイ
ロット信号ｆ２ にも適用される。この対策は同期の検
出が再生中に使用されるという事実に関係している。
【００８３】図１３のｂの場合における再生中のトラッ
キングを実現するためのパイロット信号の検出は、ヨー
ロッパ特許出願公開第３４３７２６号に詳細に述べられ
ているので、これに関してはこれ以上説明しない。
キングを実現するためのパイロット信号の検出は、ヨー
ロッパ特許出願公開第３４３７２６号に詳細に述べられ
ているので、これに関してはこれ以上説明しない。
【００８４】図１３のｃは、ヘッドドラム１００ 上に
互いに直径方向の反対側に配置された２組のヘッド対Ｋ
１ 、Ｋ２ 及びＫ３、Ｋ４ を示している。この場合
、記録担体１０１ はヘッドドラム１００ に１８０度
にわたって卷回される。ヘッドＫ１ 及びＫ２ の対は
トラックの各対Ｔ１ 及びＴ２ 、Ｔ５ 及びＴ６ 、
Ｔ９ 及びＴ１０…を読み取る。また、ヘッドＫ３ 及
びＫ４ の対はトラックの各対Ｔ３ 及びＴ４ 、Ｔ７
及びＴ８ …を読み取る。ここでも、各トラックにお
ける文字符号ａ、ｂ及びｃは図１５におけるａ、ｂ及び
ｃにおける各周波数特性を参照している。
互いに直径方向の反対側に配置された２組のヘッド対Ｋ
１ 、Ｋ２ 及びＫ３、Ｋ４ を示している。この場合
、記録担体１０１ はヘッドドラム１００ に１８０度
にわたって卷回される。ヘッドＫ１ 及びＫ２ の対は
トラックの各対Ｔ１ 及びＴ２ 、Ｔ５ 及びＴ６ 、
Ｔ９ 及びＴ１０…を読み取る。また、ヘッドＫ３ 及
びＫ４ の対はトラックの各対Ｔ３ 及びＴ４ 、Ｔ７
及びＴ８ …を読み取る。ここでも、各トラックにお
ける文字符号ａ、ｂ及びｃは図１５におけるａ、ｂ及び
ｃにおける各周波数特性を参照している。
【００８５】トラック対Ｔ１ 及びＴ２ がヘッドＫ１
及びＫ２ の対により検出される際は、ヘッドＫ２
は更にトラックＴ１ 及びＴ３ からのパイロット信号
ｆ１ 及びｆ２ の各漏れ信号をも検出する。これらの
漏れ信号に応じてトラッキング用の制御信号を抽出する
ことが可能である。 一方、トラック対Ｔ３ 及びＴ４ がヘッドＫ３ 及び
Ｋ４ の対により検出される際は、ヘッドＫ４ は更に
トラックＴ３ 及びＴ５ からのパイロット信号ｆ２
及びｆ１ の各漏れ信号をも検出する。これらの漏れ信
号に応じてトラッキング用の制御信号を抽出することが
可能である。
及びＫ２ の対により検出される際は、ヘッドＫ２
は更にトラックＴ１ 及びＴ３ からのパイロット信号
ｆ１ 及びｆ２ の各漏れ信号をも検出する。これらの
漏れ信号に応じてトラッキング用の制御信号を抽出する
ことが可能である。 一方、トラック対Ｔ３ 及びＴ４ がヘッドＫ３ 及び
Ｋ４ の対により検出される際は、ヘッドＫ４ は更に
トラックＴ３ 及びＴ５ からのパイロット信号ｆ２
及びｆ１ の各漏れ信号をも検出する。これらの漏れ信
号に応じてトラッキング用の制御信号を抽出することが
可能である。
【００８６】図１５のａにおける周波数ｆ１ を持つパ
イロット信号のようなパイロット信号の検出の一層の改
善は、記録の際に周波数ｆ１ の近傍の周波数スペクト
ルにディップを設けることにより実現することができる
。これが図１６に表されている。明らかなように、周波
数スペクトルが周波数ｆ１ 付近で減少されている。こ
のことは、周波数ｆ１ におけるパイロット信号の検出
に関する信号対雑音比が増加されることを意味している
。これを実現するため、図５の回路を拡張する。図１７
にこの拡張を示すが、ここには図５の半分、即ち図５に
おける入力端子１５と加算器５８の出力端子５８．１と
の間の回路である上半部のみが示されている。
イロット信号のようなパイロット信号の検出の一層の改
善は、記録の際に周波数ｆ１ の近傍の周波数スペクト
ルにディップを設けることにより実現することができる
。これが図１６に表されている。明らかなように、周波
数スペクトルが周波数ｆ１ 付近で減少されている。こ
のことは、周波数ｆ１ におけるパイロット信号の検出
に関する信号対雑音比が増加されることを意味している
。これを実現するため、図５の回路を拡張する。図１７
にこの拡張を示すが、ここには図５の半分、即ち図５に
おける入力端子１５と加算器５８の出力端子５８．１と
の間の回路である上半部のみが示されている。
【００８７】図１７は２つの追加枝路の形の拡張をしめ
し、該枝路は減算器により構成される信号合成ユニット
１７０ と、乗算器１７２ 及び１７３ と、積算器１
７４ 及び１７５ と、二乗要素１６９．１ 及び１６
９．２ とを有している。減算器１７０ の第２入力端
子１７６ には図１８のｂに示すような周波数ｆ１ を
持つ矩形波が供給される。この矩形波は信号源１７１
により発生され、実際にパイロット信号の理想波形に相
当する。また、信号源３５は実際に図１８のａに示すよ
うな積分された矩形波を作成する。
し、該枝路は減算器により構成される信号合成ユニット
１７０ と、乗算器１７２ 及び１７３ と、積算器１
７４ 及び１７５ と、二乗要素１６９．１ 及び１６
９．２ とを有している。減算器１７０ の第２入力端
子１７６ には図１８のｂに示すような周波数ｆ１ を
持つ矩形波が供給される。この矩形波は信号源１７１
により発生され、実際にパイロット信号の理想波形に相
当する。また、信号源３５は実際に図１８のａに示すよ
うな積分された矩形波を作成する。
【００８８】減算器１７０ においては、上記矩形波が
入力端子１５の信号から減算される。その差分信号は乗
算器１７２ 及び１７３ に供給され、これら乗算器に
おいてはこの差分信号にｓｉｎ ｗ１ ｔとｃｏｓ ｗ
１ ｔとが各々乗算される。このようにして得られた信
号は積算器１７４ 及び１７５ において再生されるが
、これら積算器も図５に示したような形を有している。 二乗要素１６９．１ 及び１６９．２ により、上記２
つの信号は加算器５８’に供給される。
入力端子１５の信号から減算される。その差分信号は乗
算器１７２ 及び１７３ に供給され、これら乗算器に
おいてはこの差分信号にｓｉｎ ｗ１ ｔとｃｏｓ ｗ
１ ｔとが各々乗算される。このようにして得られた信
号は積算器１７４ 及び１７５ において再生されるが
、これら積算器も図５に示したような形を有している。 二乗要素１６９．１ 及び１６９．２ により、上記２
つの信号は加算器５８’に供給される。
【００８９】明らかなように、積算器１７４ 及び１７
５ は各々図５の回路の下半部における対応する積算器
に接続する図示せぬ２本の信号線を有し、これら２つの
半部における対応する積算器の内容は各情報語が符号化
された後に制御信号ｃｓにより互いに等しくされる。
５ は各々図５の回路の下半部における対応する積算器
に接続する図示せぬ２本の信号線を有し、これら２つの
半部における対応する積算器の内容は各情報語が符号化
された後に制御信号ｃｓにより互いに等しくされる。
【００９０】図４、５及び１７に示した制御信号発生手
段は、これらとは僅かに異なる回路によっても実現する
ことができる。これが、図１７の回路に関して図２２の
回路によって示されている。この場合、図１７の発生器
１７１ は各枝路に分岐する前に挿入されている。この
図２２の回路はデータ流内にパイロット信号を周波数ｆ
１ で挿入することが可能である。データ流中にパイロ
ット信号を挿入する必要がない場合は、発生器１７１
は削除することができる。一番上の枝路はローパスフィ
ルタ１７９ を有している。このフィルタ１７９ の存
在によりデータ流は直流なしとなる。第２の枝路は中心
周波数ｆ２ を持つバンドパスフィルタ１８０ を有し
ている。このフィルタ１８０ の存在により、ディップ
が周波数ｆ２ で実現される。また、ｆ１ のピーク付
近におけるディップは、中心周波数ｆ１ を持つバンド
パスフィルタ１８１ の存在により実現される。
段は、これらとは僅かに異なる回路によっても実現する
ことができる。これが、図１７の回路に関して図２２の
回路によって示されている。この場合、図１７の発生器
１７１ は各枝路に分岐する前に挿入されている。この
図２２の回路はデータ流内にパイロット信号を周波数ｆ
１ で挿入することが可能である。データ流中にパイロ
ット信号を挿入する必要がない場合は、発生器１７１
は削除することができる。一番上の枝路はローパスフィ
ルタ１７９ を有している。このフィルタ１７９ の存
在によりデータ流は直流なしとなる。第２の枝路は中心
周波数ｆ２ を持つバンドパスフィルタ１８０ を有し
ている。このフィルタ１８０ の存在により、ディップ
が周波数ｆ２ で実現される。また、ｆ１ のピーク付
近におけるディップは、中心周波数ｆ１ を持つバンド
パスフィルタ１８１ の存在により実現される。
【００９１】チャンネル語を検出し次いでこれらチャン
ネル語に情報語に変換する装置が図１９に示されている
。この装置はＰＲ４検出器１８７ の入力端子１８６
に結合された読取ヘッド１８５ を有し、この検出器１
８７ の出力端子１８８ はデコードユニット１９０
の入力端子１８９ に結合されている。このデコードユ
ニット１９０ の出力端子１９１ は出力端子１９２
に結合されている。
ネル語に情報語に変換する装置が図１９に示されている
。この装置はＰＲ４検出器１８７ の入力端子１８６
に結合された読取ヘッド１８５ を有し、この検出器１
８７ の出力端子１８８ はデコードユニット１９０
の入力端子１８９ に結合されている。このデコードユ
ニット１９０ の出力端子１９１ は出力端子１９２
に結合されている。
【００９２】更に、前記読取ヘッド１８５ の出力端子
は、例えばパイロット信号の周波数の近傍に中心周波数
をもつフィルタを具備するようなパイロット信号検出器
１９３ に結合されている。この検出器１９３ は出力
端子１９４ にトラッキング制御信号を発生する。
は、例えばパイロット信号の周波数の近傍に中心周波数
をもつフィルタを具備するようなパイロット信号検出器
１９３ に結合されている。この検出器１９３ は出力
端子１９４ にトラッキング制御信号を発生する。
【００９３】前記デコードユニット１９０ はその入力
端子に（ｎ＋１）ビットの情報語を入力する。このデコ
ードユニット１９０ は同期信号検出器１９５ を有し
、該検出器は上記情報語の直列データ流から図１２に示
すような同期語ｂ１ を検出する。同期語ｂ１ が一旦
検出されると、デコードユニット１９０ は（ｎ＋１）
ビット情報語の直列データ流のどの位置で前記１ビット
デジタル語が見つかるかが分かる。同期検出器１９５
により当該デコードユニット１９０ に属するユニット
１９６ へ供給される制御信号は、このユニット１９６
が上記１ビットデジタル語を情報語の直列データ流か
ら取り除くようにさせる。かくして、ｎビット情報語の
元のデータ流が出力端子１９２ に現れる。
端子に（ｎ＋１）ビットの情報語を入力する。このデコ
ードユニット１９０ は同期信号検出器１９５ を有し
、該検出器は上記情報語の直列データ流から図１２に示
すような同期語ｂ１ を検出する。同期語ｂ１ が一旦
検出されると、デコードユニット１９０ は（ｎ＋１）
ビット情報語の直列データ流のどの位置で前記１ビット
デジタル語が見つかるかが分かる。同期検出器１９５
により当該デコードユニット１９０ に属するユニット
１９６ へ供給される制御信号は、このユニット１９６
が上記１ビットデジタル語を情報語の直列データ流か
ら取り除くようにさせる。かくして、ｎビット情報語の
元のデータ流が出力端子１９２ に現れる。
【００９４】図２０及び２１は、上述した装置とは異な
り、ｎビット情報語ｉｗ１ に付加すべき１ビットデジ
タル語を決定するために、１個の情報語を越えて先を見
るような装置を示している。
り、ｎビット情報語ｉｗ１ に付加すべき１ビットデジ
タル語を決定するために、１個の情報語を越えて先を見
るような装置を示している。
【００９５】図２０は連続する情報語ｉｗ１ 、ｉｗ２
及びｉｗ３ の直列データ流を示している。この場合
、ｙ１ で参照される１ビットデジタル語が情報語ｉｗ
１ に付加されるべきであり、又ｙ２ で参照される１
ビットデジタル語が情報語ｉｗ２ に付加されるべきで
ある。
及びｉｗ３ の直列データ流を示している。この場合
、ｙ１ で参照される１ビットデジタル語が情報語ｉｗ
１ に付加されるべきであり、又ｙ２ で参照される１
ビットデジタル語が情報語ｉｗ２ に付加されるべきで
ある。
【００９６】ａＴプリコーダにより（ｎ＋１）ビット情
報語から得られるチャンネル語のａＴ前置符号化後のデ
ジタル和は、情報語ｉｗ１ の符号化時点までのチャン
ネル語の直列データ流のデジタル和であるＤＳＶ０ か
ら、符号化された情報語ｉｗ１ によりＤＳＶ１ に変
化し、その後、符号化された情報語ｉｗ２ によりＤＳ
Ｖ２ に変化する。
報語から得られるチャンネル語のａＴ前置符号化後のデ
ジタル和は、情報語ｉｗ１ の符号化時点までのチャン
ネル語の直列データ流のデジタル和であるＤＳＶ０ か
ら、符号化された情報語ｉｗ１ によりＤＳＶ１ に変
化し、その後、符号化された情報語ｉｗ２ によりＤＳ
Ｖ２ に変化する。
【００９７】先の実施例においては、情報語ｉｗ１ に
付加すべきビットｙ１ の選択は過去の和（ＤＳＶ０
）と情報語ｉｗ１とにより決定されていたので、符号化
された情報語ｉｗ１ を含むチャンネル語のデジタル和
は当該デジタル和の所望の変化の最適近似である。
付加すべきビットｙ１ の選択は過去の和（ＤＳＶ０
）と情報語ｉｗ１とにより決定されていたので、符号化
された情報語ｉｗ１ を含むチャンネル語のデジタル和
は当該デジタル和の所望の変化の最適近似である。
【００９８】図２１に示す装置においては、ｙ１ の選
択は、符号化された情報語ｉｗ２ を含むチャンネル語
のデータ流のデジタル和の変化によっても決定される。 実際には、１ビットデジタル語ｙ１ が情報語ｉｗ１
に付加され、１ビットデジタル語ｙ２ が情報語ｉｗ２
に付加され、ここでデジタル語ｙ１ 及びｙ２ はデ
ジタル和ＤＳＶ０ 、ＤＳＶ０ 及びＤＳＶ０ が所望
の現デジタル和の最適近似となるような語である。
択は、符号化された情報語ｉｗ２ を含むチャンネル語
のデータ流のデジタル和の変化によっても決定される。 実際には、１ビットデジタル語ｙ１ が情報語ｉｗ１
に付加され、１ビットデジタル語ｙ２ が情報語ｉｗ２
に付加され、ここでデジタル語ｙ１ 及びｙ２ はデ
ジタル和ＤＳＶ０ 、ＤＳＶ０ 及びＤＳＶ０ が所望
の現デジタル和の最適近似となるような語である。
【００９９】図２１はこのような装置の概念を示してい
る。この図において、入力端子１９９ を介して２つの
情報語ｉｗ１ 及びｉｗ２ が当該装置に供給される。 この場合、ｎビットの情報語ｉｗ１ はユニット２００
．２ 、２０１．２ 、２０２．２ 及び２０３．２
に記憶され、ここで「０」ビット（ユニット２００．２
及び２０２．２ において）又は「１」ビット（ユニ
ット２０１．１ 及び２０３．２ ）が当該情報語ｉｗ
１ に付加される。また、情報語ｉｗ２ はユニット２
００．１ 、２０１．１ 、２０２．１ 及び２０３．
１ に記憶され、ここで「０」ビット（ユニット２００
．１及び２０１．１ において）又は「１」ビット（ユ
ニット２０２．１ 及び２０３．１ ）が当該情報語ｉ
ｗ２ に付加される。次いで、各々に「０」又は「１」
が付加された２個の情報語ｉｗ１ 及びｉｗ２ の４つ
の直列データ流はプリコーダ２０４．１ ないし２０４
．４ に移送され、ここでは２つの（ｎ＋１）ビット情
報語のデータ流が２つの（ｎ＋１）ビットチャンネル語
のデータ流に変換される。その後、４つのデータ流が検
出器２０５ に供給される。この場合、検出器２０５
は可制御スイッチ２０７ に供給すべき制御信号をその
出力端子２０６ に発生し、該スイッチ２０７ はこの
制御信号に応答して端子２０７．１ 、２０７．２ 、
２０７．３ 及び２０７．４ の中の１つが端子２０７
．５ に接続されるような位置になる。
る。この図において、入力端子１９９ を介して２つの
情報語ｉｗ１ 及びｉｗ２ が当該装置に供給される。 この場合、ｎビットの情報語ｉｗ１ はユニット２００
．２ 、２０１．２ 、２０２．２ 及び２０３．２
に記憶され、ここで「０」ビット（ユニット２００．２
及び２０２．２ において）又は「１」ビット（ユニ
ット２０１．１ 及び２０３．２ ）が当該情報語ｉｗ
１ に付加される。また、情報語ｉｗ２ はユニット２
００．１ 、２０１．１ 、２０２．１ 及び２０３．
１ に記憶され、ここで「０」ビット（ユニット２００
．１及び２０１．１ において）又は「１」ビット（ユ
ニット２０２．１ 及び２０３．１ ）が当該情報語ｉ
ｗ２ に付加される。次いで、各々に「０」又は「１」
が付加された２個の情報語ｉｗ１ 及びｉｗ２ の４つ
の直列データ流はプリコーダ２０４．１ ないし２０４
．４ に移送され、ここでは２つの（ｎ＋１）ビット情
報語のデータ流が２つの（ｎ＋１）ビットチャンネル語
のデータ流に変換される。その後、４つのデータ流が検
出器２０５ に供給される。この場合、検出器２０５
は可制御スイッチ２０７ に供給すべき制御信号をその
出力端子２０６ に発生し、該スイッチ２０７ はこの
制御信号に応答して端子２０７．１ 、２０７．２ 、
２０７．３ 及び２０７．４ の中の１つが端子２０７
．５ に接続されるような位置になる。
【０１００】ここで、スイッチ２０７ が上記制御信号
に応答して端子２０７．２ が端子２０７．５ に結合
されるような位置になったとする（このことはプリコー
ダ２０４．２ の出力信号が出力端子２０８ に供給さ
れることを意味する）。
に応答して端子２０７．２ が端子２０７．５ に結合
されるような位置になったとする（このことはプリコー
ダ２０４．２ の出力信号が出力端子２０８ に供給さ
れることを意味する）。
【０１０１】この場合の当該装置の動作は次のようにな
る。即ち、その都度ｉｗ１ 及びｉｗ２ のような連続
した情報語の対、及びｉｗ３ 及びｉｗ４ 、ｉｗ５
及びｉｗ５ 、…のような後続する連続した情報語の各
対が前述したような単一の工程で符号化され、出力端子
２０８ にチャンネル語の各対として供給される。この
ことは、情報語ｉｗ１ 及びｉｗ２ の対のチャンネル
語ＣＷ１ 及びＣＷ２ の対への符号化の後、４つのプ
リコーダ２０４．１ ないし２０４．４ 内の記憶位置
の内容が検出器２０５ の制御信号により再び同一にな
ることを意味している。上記の例においては、このこと
はプリコーダ２０４．２ 内の記憶位置の内容がプリコ
ーダ２０４．１ 、２０４．３ 及び２０４．４ のメ
モリに複写されることを意味する。
る。即ち、その都度ｉｗ１ 及びｉｗ２ のような連続
した情報語の対、及びｉｗ３ 及びｉｗ４ 、ｉｗ５
及びｉｗ５ 、…のような後続する連続した情報語の各
対が前述したような単一の工程で符号化され、出力端子
２０８ にチャンネル語の各対として供給される。この
ことは、情報語ｉｗ１ 及びｉｗ２ の対のチャンネル
語ＣＷ１ 及びＣＷ２ の対への符号化の後、４つのプ
リコーダ２０４．１ ないし２０４．４ 内の記憶位置
の内容が検出器２０５ の制御信号により再び同一にな
ることを意味している。上記の例においては、このこと
はプリコーダ２０４．２ 内の記憶位置の内容がプリコ
ーダ２０４．１ 、２０４．３ 及び２０４．４ のメ
モリに複写されることを意味する。
【０１０２】当該装置の動作は次のようなものであって
もよい。即ち、上述したのと同様の方法により２つの連
続する符号化された情報語ｉｗ１ 及びｉｗ２ から制
御信号が作成されるが、この制御信号に基づいては符号
化された情報語ｉｗ１ のみが出力端子２０８ に供給
され、このような手順が２つの連続した情報語ｉｗ２
及びｉｗ３ 、ｉｗ３ 及びｉｗ４ 、…に関して繰り
返される。
もよい。即ち、上述したのと同様の方法により２つの連
続する符号化された情報語ｉｗ１ 及びｉｗ２ から制
御信号が作成されるが、この制御信号に基づいては符号
化された情報語ｉｗ１ のみが出力端子２０８ に供給
され、このような手順が２つの連続した情報語ｉｗ２
及びｉｗ３ 、ｉｗ３ 及びｉｗ４ 、…に関して繰り
返される。
【０１０３】上記例においては、このことはプリコーダ
２０４．２ により符号化された情報語ｉｗ１ が出力
端子２０８ に供給され、情報語ｉｗ１ の符号化の後
にプリコーダ２０４．２ 内の記憶位置の内容が次の情
報語ｉｗ２ 及びｉｗ３ の対の符号化のために全ての
プリコーダに複写されるべきであるということを意味す
るであろう。
２０４．２ により符号化された情報語ｉｗ１ が出力
端子２０８ に供給され、情報語ｉｗ１ の符号化の後
にプリコーダ２０４．２ 内の記憶位置の内容が次の情
報語ｉｗ２ 及びｉｗ３ の対の符号化のために全ての
プリコーダに複写されるべきであるということを意味す
るであろう。
【０１０４】次に検出器２０５ の動作を説明する。こ
の検出器２０５ は図４、５又は１７に示した検出器の
中の１個と同様の構成を有してもよい。
の検出器２０５ は図４、５又は１７に示した検出器の
中の１個と同様の構成を有してもよい。
【０１０５】入力端子２０９．１ ないし２０９．４
から当該検出器２０５ に含まれる図示せぬ比較器への
各枝路は、例えば図２０に示す（ｎ＋１）ビット情報語
ｉｗ１ 又は（ｎ＋１）ビット情報語ｉｗ２ の符号化
の後に、エラー信号ｅｉ．１ 及びｅｉ．２ を発生す
る。これらのエラー信号は図２１にも示されている。
から当該検出器２０５ に含まれる図示せぬ比較器への
各枝路は、例えば図２０に示す（ｎ＋１）ビット情報語
ｉｗ１ 又は（ｎ＋１）ビット情報語ｉｗ２ の符号化
の後に、エラー信号ｅｉ．１ 及びｅｉ．２ を発生す
る。これらのエラー信号は図２１にも示されている。
【０１０６】判定規準は、例えば、１から４の範囲のｉ
に対してｅｉ．１２＋ｅｉ．２２の大きさを決めること
である。
に対してｅｉ．１２＋ｅｉ．２２の大きさを決めること
である。
【０１０７】次いで、上記４つの値のうちの一番小さい
ものが決定され、この選択によりどの制御信号が発生さ
れるかを決定する。上述した例においては、ｅ２．１２
＋ｅ２．２２が最小値を発生すると思われる。
ものが決定され、この選択によりどの制御信号が発生さ
れるかを決定する。上述した例においては、ｅ２．１２
＋ｅ２．２２が最小値を発生すると思われる。
【０１０８】明らかなように、「先を見る」とは２つ以
上の連続する情報語を越えて先を見るということを意味
してもよい。
上の連続する情報語を越えて先を見るということを意味
してもよい。
【０１０９】上記においてはハードウエアの構成を述べ
たが、このような構成はマイクロプロセサ等を利用して
ソフトウエアにより構成することも当然可能である。更
に、図１、８及び１０を参照して説明した装置は、制御
信号が発生されるチャンネル語が時間的に概ね並列に発
生されるという点で並列構成であるということに注目さ
れたい。他の例として、選択が行われるチャンネル語を
順次生成することも可能である。この場合は、例えば図
１に示すような単一のａＴプリコーダ１０及び単一のユ
ニット６のみが必要であり、ここで該ユニットはｎビッ
ト情報語に「０」及び「１」の両方を付加することがで
きる必要がある。この解決策は、得られるチャンネル語
の一時記憶のためにより多くの記憶容量を必要とする。
たが、このような構成はマイクロプロセサ等を利用して
ソフトウエアにより構成することも当然可能である。更
に、図１、８及び１０を参照して説明した装置は、制御
信号が発生されるチャンネル語が時間的に概ね並列に発
生されるという点で並列構成であるということに注目さ
れたい。他の例として、選択が行われるチャンネル語を
順次生成することも可能である。この場合は、例えば図
１に示すような単一のａＴプリコーダ１０及び単一のユ
ニット６のみが必要であり、ここで該ユニットはｎビッ
ト情報語に「０」及び「１」の両方を付加することがで
きる必要がある。この解決策は、得られるチャンネル語
の一時記憶のためにより多くの記憶容量を必要とする。
【図１】 図１は、本発明による装置の一実施例のブ
ロック図、
ロック図、
【図２】 図２は、ａＴプリコーダの一例のブロック
図、
図、
【図３】 図３は、２４ビット情報語の２５ビットチ
ャンネル語への変換例を示す図表、
ャンネル語への変換例を示す図表、
【図４】 図４は、制御信号発生手段の一例のブロッ
ク図、
ク図、
【図５】 図５は、制御信号発生手段の他の例のブロ
ック図、
ック図、
【図６】 図６は、２４ビット情報語の２５ビットチ
ャンネル語への変換例を１Ｔプリコーダ、２Ｔプリコー
ダ及び３Ｔプリコーダについて示す図表、
ャンネル語への変換例を１Ｔプリコーダ、２Ｔプリコー
ダ及び３Ｔプリコーダについて示す図表、
【図７】
図７は、図５の制御信号発生手段の動作の一例を、ある
周波数においてディップが実現される場合について示す
波形図、
図７は、図５の制御信号発生手段の動作の一例を、ある
周波数においてディップが実現される場合について示す
波形図、
【図８】 図８は、信号付加手段とａＴプリコーダと
の間に介挿することができる信号合成手段の一例を示す
概念図、
の間に介挿することができる信号合成手段の一例を示す
概念図、
【図９】 図９は、信号合成手段の他の例を示すブロ
ック図、
ック図、
【図１０】 図１０は、本発明による装置の他の実施
例のブロック図、
例のブロック図、
【図１１】 図１１は、チャンネル語に同期情報を付
加する構成例を示すブロック図、
加する構成例を示すブロック図、
【図１２】 図１２は、チャンネル語に同期情報を付
加する過程を示す概念図、
加する過程を示す概念図、
【図１３】 図１３は、本発明を磁気記録担体上にチ
ャンネル語の直列データ流を記録する記録装置に適用す
る幾つかの例を示す概念図、
ャンネル語の直列データ流を記録する記録装置に適用す
る幾つかの例を示す概念図、
【図１４】 図１４は、チャンネル語直列データ流の
周波数特性の一例を示す特性図、
周波数特性の一例を示す特性図、
【図１５】 図１５は、チャンネル語直列データ流の
周波数特性の他の例を示す特性図、
周波数特性の他の例を示す特性図、
【図１６】 図１６は、チャンネル語直列データ流の
周波数特性の更に他の例を示す特性図、
周波数特性の更に他の例を示す特性図、
【図１７】 図１７は、図５の制御信号発生手段の他
の例を示すブロック図、
の例を示すブロック図、
【図１８】 図１８は、図１７の制御信号発生手段に
おいて発生する信号の波形図、
おいて発生する信号の波形図、
【図１９】 図１９は、（ｎ＋１）ビットチャンネル
語の直列データ流を読み出し且つデコードする再生装置
の一例のブロック図、
語の直列データ流を読み出し且つデコードする再生装置
の一例のブロック図、
【図２０】 図２０は、連続した情報語の直列データ
流の一例を示す概念図、
流の一例を示す概念図、
【図２１】 図２１は、符号化動作時に符号化すべき
１情報語を越えて先をみる装置の一例を示すブロック図
、
１情報語を越えて先をみる装置の一例を示すブロック図
、
【図２２】 図２２は、図１７に示す制御信号発生
手段の他の例を示すブロック図である。
手段の他の例を示すブロック図である。
１：入力端子
２：並列／直列変換器 ４：信号付加手段 １０、１１：ａ
Ｔプリコーダ １７：制御信号発生手段 ２２
：スイッチング手段 ２４：記録装置
２：並列／直列変換器 ４：信号付加手段 １０、１１：ａ
Ｔプリコーダ １７：制御信号発生手段 ２２
：スイッチング手段 ２４：記録装置
Claims (10)
- 【請求項１】 デジタル情報信号を磁気記録担体上の
情報トラックに記録する装置であって、ｎ及びｍが整数
であり且つｍ≧１及びｎ＞ｍであるとして、提供された
デジタル情報語信号におけるｎビットの情報語を記録に
先立ち（ｎ＋ｍ）ビットのチャンネル語に変換する一方
、前記のｎビット情報語を入力するための入力端子と、
前記入力端子に結合された入力端と出力端とを有する一
方ａが２以上の整数であるとしてａＴプリコーダを更に
具備し、且つ前記のｎビット情報語を前記の（ｎ＋ｍ）
ビットのチャンネル語に変換すると共にこれらチャンネ
ル語を前記出力端に供給する符号化装置と、前記符号化
装置の出力端に結合された入力端を有し、前記の（ｎ＋
ｍ）ビットチャンネル語を前記磁気記録担体上の情報ト
ラックに記録する記録装置と、を有するような装置にお
いて、前記符号化装置は、ｍが１に等しいとして、連続
するｎビット情報語にその都度ｍビットのデジタル語を
付加して（ｎ＋１）ビット情報語を得る信号付加手段を
有し、前記ａＴプリコーダは前記の（ｎ＋１）ビット情
報語を（ｎ＋１）ビットチャンネル語に変換するように
構成され、前記符号化装置は更に制御信号発生手段を有
し、前記制御信号発生手段は前記ａＴプリコーダから前
記（ｎ＋１）ビットチャンネル語を入力すると共に当該
（ｎ＋１）ビットチャンネル語から制御信号を作成する
ように構成され、前記信号付加手段は上記制御信号に応
じて前記ｎビット情報語に、前記プリコーダの出力信号
におけるデジタル和が時間に対してプロットした場合に
所望のパターンを呈するように、１ビットデジタル語を
付加するように構成されている、ことを特徴とする装置
。 - 【請求項２】 請求項１に記載の装置において、前記
ｎが１０より大または１０に等しいことを特徴とする装
置。 - 【請求項３】 請求項２に記載の装置において、前記
ｎが２４に等しいことを特徴とする装置。 - 【請求項４】 請求項１ないし３のいずれか一項に記
載の装置において、前記ａが２または３に等しいことを
特徴とする装置。 - 【請求項５】 請求項１ないし４のいずれか一項に記
載の装置において、前記信号付加手段は前記制御信号に
より前記ｎビット情報語にその都度１ビットデジタル語
を付加するように構成され、これによりａＴプリコーダ
の出力信号の周波数特性が少なくとも１つの特定周波数
においてディップを呈することを特徴とする装置。 - 【請求項６】 請求項１ないし５のいずれか一項に記
載の装置において、前記信号付加手段は前記制御信号に
より前記ｎビット情報語にその都度１ビットデジタル語
を付加するように構成され、これにより前記ａＴプリコ
ーダの出力信号の周波数特性が少なくとも１つの特定周
波数においてピークを有することを特徴とする装置。 - 【請求項７】 請求項６に記載の装置において、前記
信号付加手段は、更に、前記ｎビットデジタル語にその
都度１ビットデジタル語を付加するように構成され、こ
れにより前記周波数特性が前記周波数のピークの近傍に
ディップを呈することを特徴とする装置。 - 【請求項８】 請求項１ないし７のいずれか一項に記
載の装置において、当該装置はａＴプリコーダの出力信
号における連続した「０」または「１」の最大数を決定
するためのＴｍａｘ 決定手段を有し、該手段は「０
」または「１ 」の当該最大数が特定のしきい値を越え
た場合に制御信号を発生するように構成され、当該装置
は前記制御信号発生手段の制御信号を前記Ｔｍａｘ 決
定手段の制御信号により阻止し且つ前記信号付加手段用
の制御信号を発生する阻止手段を更に有し、前記信号付
加手段は前記阻止手段の制御信号により前記ｎ ビット
情報語に１ビットデジタル語を付加するように構成され
、これにより前記ａＴプリコーダの出力信号における「
０」又は「１」の前記最大数が前記しきい値を越えない
か、又は前記プリコーダの出力信号における最小の「１
」または「０」の最大数を持つチャンネル語が前記ｎビ
ット情報語から得られるであろう全ての（ｎ＋１）ビッ
トチャンネル語から得られるようにすることを特徴とす
る装置。 - 【請求項９】 請求項１ないし８のいずれか一項に記
載の装置において、当該装置は更に前記信号付加手段と
前記ａＴプリコーダとの間に介挿された信号合成手段を
有し、該信号合成手段はその入力端子において前記信号
付加手段から（ｎ＋１）ビット情報語を入力すると共に
（ｎ＋１）ビット情報語をその出力端子に供給するよう
に構成され、また該信号合成手段は前記１ビットデジタ
ル語とその入力端子に供給された（ｎ＋１）ビット情報
語のｉ番目のビットとを合成してその出力端子に当該（
ｎ＋１）ビット情報語のｉ番目のビットを得るように構
成されていることを特徴とする装置。 - 【請求項１０】 請求項９に記載の装置において、前
記信号合成手段が少なくとも１個のＥＸＯＲゲートを有
していることを特徴とする装置。
Applications Claiming Priority (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| NL9002069 | 1990-09-21 | ||
| NL9002069A NL9002069A (nl) | 1990-09-21 | 1990-09-21 | Inrichting voor het optekenen van een digitaal informatiesignaal in een registratiedrager. |
| NL9002772A NL9002772A (nl) | 1990-09-21 | 1990-12-17 | Inrichting voor het optekenen van een digitaal informatiesignaal in een registratiedrager. |
| NL9002772 | 1990-12-17 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH04255969A true JPH04255969A (ja) | 1992-09-10 |
| JP3130345B2 JP3130345B2 (ja) | 2001-01-31 |
Family
ID=26646745
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP03269076A Expired - Lifetime JP3130345B2 (ja) | 1990-09-21 | 1991-09-19 | 記録担体上にデジタル情報信号を記録する装置及び方法 |
Country Status (19)
| Country | Link |
|---|---|
| US (1) | US5142421A (ja) |
| EP (1) | EP0476767B1 (ja) |
| JP (1) | JP3130345B2 (ja) |
| KR (1) | KR100221903B1 (ja) |
| CN (1) | CN1027664C (ja) |
| AT (1) | ATE136149T1 (ja) |
| AU (1) | AU643921B2 (ja) |
| BR (1) | BR9104007A (ja) |
| CZ (1) | CZ288091B6 (ja) |
| DE (1) | DE69118288T2 (ja) |
| DK (1) | DK0476767T3 (ja) |
| ES (1) | ES2088785T3 (ja) |
| HK (1) | HK1006478A1 (ja) |
| NL (1) | NL9002772A (ja) |
| RU (1) | RU2067781C1 (ja) |
| SG (1) | SG44720A1 (ja) |
| SK (1) | SK280674B6 (ja) |
| TW (1) | TW200587B (ja) |
| UA (1) | UA29376C2 (ja) |
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| US6005741A (en) * | 1993-05-28 | 1999-12-21 | Canon Kabushiki Kaisha | Reproducing apparatus using pilot signal crosstalk for tracking control and using pilot signals to eliminate a back lock condition |
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| DE4319389C3 (de) * | 1992-06-09 | 1999-11-25 | Mitsubishi Electric Corp | Anordnung zum Einfügen einer Frequenzkomponente zu eingegebenen n-Bit-Daten |
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