JP2898132B2 - ディジタル変調方法および装置 - Google Patents
ディジタル変調方法および装置Info
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Description
【０００１】
【産業上の利用分野】本発明は、ディジタル変調方法お
よび装置に関するものである。
よび装置に関するものである。
【０００２】さらに詳述すれば、本発明は、符号のディ
ジタル伝送，ディジタル記録のためのディジタル変調方
法および装置に関するものである。
ジタル伝送，ディジタル記録のためのディジタル変調方
法および装置に関するものである。
【０００３】
【従来の技術】一般に、ディジタルＶＴＲ，ディジタル
データレコーダなどに代表されるディジタル記録システ
ムにおいては、一定の記録速度のもとで実用的に記録で
きる周波数帯域に上限および下限が存在する。
データレコーダなどに代表されるディジタル記録システ
ムにおいては、一定の記録速度のもとで実用的に記録で
きる周波数帯域に上限および下限が存在する。
【０００４】この上限は記録密度の限界から来るもので
あり、下限は磁気記録の場合に信号再生系が微分特性を
持つこと、および回転ヘッドとの信号の受渡しにトラン
スを用いることなどによって生ずる。
あり、下限は磁気記録の場合に信号再生系が微分特性を
持つこと、および回転ヘッドとの信号の受渡しにトラン
スを用いることなどによって生ずる。
【０００５】また、ディジタル磁気記録において通常よ
く用いられる記録信号の形はＮＲＺ信号である。ＮＲＺ
信号は、例えば８ビットの並列データを直列に並べ換え
ただけのものである。したがって、同一ビットの連続数
に制限がなく、直流分を含む低域成分を有するので記録
時の前処理としてスクランブル処理を施し、低域成分を
減らしている。
く用いられる記録信号の形はＮＲＺ信号である。ＮＲＺ
信号は、例えば８ビットの並列データを直列に並べ換え
ただけのものである。したがって、同一ビットの連続数
に制限がなく、直流分を含む低域成分を有するので記録
時の前処理としてスクランブル処理を施し、低域成分を
減らしている。
【０００６】このスクランブル処理とは、具体的には、
一定周期の擬似ランダム最長系列の符号をデータにｍｏ
ｄ２加算（ＥＸＯＲ演算）することである。
一定周期の擬似ランダム最長系列の符号をデータにｍｏ
ｄ２加算（ＥＸＯＲ演算）することである。
【０００７】このスクランブル処理を施した信号を記録
し、再生時に同一の擬似ランダム信号を再びｍｏｄ２加
算して復元する。しかしＮＲＺ信号はスクランブルを施
しても低域成分がかなり残るので、再生時に微分特性を
持つ低域をフィードバックにより等化すると誤りが発生
したとき伝播を起して誤りが拡大し易い。
し、再生時に同一の擬似ランダム信号を再びｍｏｄ２加
算して復元する。しかしＮＲＺ信号はスクランブルを施
しても低域成分がかなり残るので、再生時に微分特性を
持つ低域をフィードバックにより等化すると誤りが発生
したとき伝播を起して誤りが拡大し易い。
【０００８】そこで、第２の方法として、直流分のない
ミラースクエア符号が用いられる。この符号の符号化則
は（１）データが１のとき、ビット区間の中心で反転、
（２）データ０が連続するとき、ビットの境界で反転、
（３）例外として１個のデータ０のあとに偶数個のデー
タ１が続くとき、最後のデータ１についてはビット区間
の中心で反転しない、というものである。
ミラースクエア符号が用いられる。この符号の符号化則
は（１）データが１のとき、ビット区間の中心で反転、
（２）データ０が連続するとき、ビットの境界で反転、
（３）例外として１個のデータ０のあとに偶数個のデー
タ１が続くとき、最後のデータ１についてはビット区間
の中心で反転しない、というものである。
【０００９】符号波形の立上りから立下りまでの間隔の
最小値は変換前のＮＲＺ信号の最小値と同じである。ま
た、間隔の最大値は最小値の３倍となっているため低域
成分は小さい。
最小値は変換前のＮＲＺ信号の最小値と同じである。ま
た、間隔の最大値は最小値の３倍となっているため低域
成分は小さい。
【００１０】しかし、符号の極性が上に述べた符号化則
をもって決定されるため、誤りの伝播は存在する。ま
た、再生時に符号極性の識別を行うとき、信号の位相変
動に対する時間方向の余裕がＮＲＺ信号の１／２となっ
てしまう。
をもって決定されるため、誤りの伝播は存在する。ま
た、再生時に符号極性の識別を行うとき、信号の位相変
動に対する時間方向の余裕がＮＲＺ信号の１／２となっ
てしまう。
【００１１】さらに第３の方法として、ブロック変換符
号が用いられる。通常は８ビットのデータ語をＮビット
（Ｎ＞８）のコード語に変換し、２N 個のコード語の中
から周波数の高い成分および低い成分の少ないものを選
択する。
号が用いられる。通常は８ビットのデータ語をＮビット
（Ｎ＞８）のコード語に変換し、２N 個のコード語の中
から周波数の高い成分および低い成分の少ないものを選
択する。
【００１２】８ビット毎の符号変換であるから、８ビッ
トを越える誤りの伝播は発生しない。
トを越える誤りの伝播は発生しない。
【００１３】Ｎ＝９およびＮ＝１０の場合は、変換によ
って低域成分は少なくなるが最小ビット間隔が狭くなる
ので、記録信号の帯域は変換前の帯域よりも増加する。
したがって再生出力が減少し、誤りが増加し易くなるの
で得策ではない。
って低域成分は少なくなるが最小ビット間隔が狭くなる
ので、記録信号の帯域は変換前の帯域よりも増加する。
したがって再生出力が減少し、誤りが増加し易くなるの
で得策ではない。
【００１４】これに対してＮ＝１４，Ｎ＝１２などの場
合は変換後のコード語の中からビット０の連続数が１以
上のものだけを選択できるので、記録信号の最高周波数
は変換前のＮＲＺ信号よりも低くできる。
合は変換後のコード語の中からビット０の連続数が１以
上のものだけを選択できるので、記録信号の最高周波数
は変換前のＮＲＺ信号よりも低くできる。
【００１５】８−１４変換はＮＲＺ信号に対して最高周
波数が７／８であり、８−１２変換はＮＲＺ信号に対し
て最高周波数が６／８となる。
波数が７／８であり、８−１２変換はＮＲＺ信号に対し
て最高周波数が６／８となる。
【００１６】８−１４変換の例としては、テレビジョン
学会技術報告Ｖｏｌ．１４，Ｎｏ．２０，ＶＩＲ９０−
１９（Ｍａｒｃｈ １９９０）に述べられたものがあ
る。この例では、コード語中のビット１を＋１，ビット
０を−１として加算した累積電荷ＣＤＳについてＣＤＳ
≧０のコード語とＣＤＳ≦０のコード語とを組合せて１
つのデータ語に対応させ、記録信号として直流分が発生
しないようにしている。この直流分のないコード列をＤ
Ｃフリーコードという。
学会技術報告Ｖｏｌ．１４，Ｎｏ．２０，ＶＩＲ９０−
１９（Ｍａｒｃｈ １９９０）に述べられたものがあ
る。この例では、コード語中のビット１を＋１，ビット
０を−１として加算した累積電荷ＣＤＳについてＣＤＳ
≧０のコード語とＣＤＳ≦０のコード語とを組合せて１
つのデータ語に対応させ、記録信号として直流分が発生
しないようにしている。この直流分のないコード列をＤ
Ｃフリーコードという。
【００１７】また、８−１２変換に関する先行出願例と
して「符号変換装置」特開昭６３−２０９２０（松下電
器，池谷章）がある。この出願は、同一ビットの連続数
が２以上，１０以下となる８−１２変換方法を開示して
いる。
して「符号変換装置」特開昭６３−２０９２０（松下電
器，池谷章）がある。この出願は、同一ビットの連続数
が２以上，１０以下となる８−１２変換方法を開示して
いる。
【００１８】
【発明が解決しようとする課題】前項に述べた従来技術
のうち、まず、スクランブルを施したＮＲＺ信号は低域
成分が多いため、再生系で減衰した低域を強調しようと
すると誤り伝播の可能性が大きくなるという欠点があ
る。
のうち、まず、スクランブルを施したＮＲＺ信号は低域
成分が多いため、再生系で減衰した低域を強調しようと
すると誤り伝播の可能性が大きくなるという欠点があ
る。
【００１９】つぎにミラースクエア符号は、ビット区間
の中心で反転したり、境界で反転したりするので、再生
時に符号識別をするときの時間余裕が小さいという欠点
がある。また誤り伝播の可能性もある。
の中心で反転したり、境界で反転したりするので、再生
時に符号識別をするときの時間余裕が小さいという欠点
がある。また誤り伝播の可能性もある。
【００２０】さらに、ブロック変換符号のうち、８−９
変換符号，８−１０変換符号などはＮＲＺ符号に比べて
低域成分は少なくなるが、高域成分については最高周波
数が高くなってしまうという欠点がある。
変換符号，８−１０変換符号などはＮＲＺ符号に比べて
低域成分は少なくなるが、高域成分については最高周波
数が高くなってしまうという欠点がある。
【００２１】よって本発明の目的は、上述した従来のデ
ィジタル変調方式よりも信号の周波数帯域を狭くすると
共に、誤り伝播も小さく、且つ符号識別時の時間余裕も
できるだけ大きくすることを可能としたディジタル変調
方法および装置を提供することにある。
ィジタル変調方式よりも信号の周波数帯域を狭くすると
共に、誤り伝播も小さく、且つ符号識別時の時間余裕も
できるだけ大きくすることを可能としたディジタル変調
方法および装置を提供することにある。
【００２２】上記の目的を達成するために、本発明に係
るディジタル変調方法は、シリアル形式で表されるディ
ジタル信号列において、８ビットのディジタルデータを
１２ビットのディジタルコードに変換するにあたり、直
列に配列した１２ビット列中においてビット１を連続さ
せずビット１とビット１に挟まれたビット０の連続数を
１以上７以下とするコード列の中から、始端１ビットの
２進値が同一であり、かつ終端を含む最後の４ビットが
００００であるコード（以下、形Ａとする）と最後の２
ビットが１０であるコード（以下、形Ｃとする）とを１
組とし、最後の２ビットが０１であるコード（以下、形
Ｂとする）と前記形Ｃのコードとを１組とし、前記形Ｂ
のコードと最後の３ビットが１００であるコード（以
下、形Ｄとする）とを１組とし、前記形Ｂのコードと最
後の４ビットが１０００であるコード（以下、形Ｅとす
る）とを１組とし、ディジタル信号列において任意のコ
ードの直前のコードが前記形Ｃ、前記形Ｄまたは前記形
Ｅである場合を、直前のコードが前記形Ａまたは前記形
Ｂである場合に対して異なるディジタルデータに対応さ
せることにより変調することを特徴としたものである。
ここで、終端のコードが前記形Ｂのコードのとき、次の
コードの始端がビット０で始まるコードを対応させるこ
とが可能である。
るディジタル変調方法は、シリアル形式で表されるディ
ジタル信号列において、８ビットのディジタルデータを
１２ビットのディジタルコードに変換するにあたり、直
列に配列した１２ビット列中においてビット１を連続さ
せずビット１とビット１に挟まれたビット０の連続数を
１以上７以下とするコード列の中から、始端１ビットの
２進値が同一であり、かつ終端を含む最後の４ビットが
００００であるコード（以下、形Ａとする）と最後の２
ビットが１０であるコード（以下、形Ｃとする）とを１
組とし、最後の２ビットが０１であるコード（以下、形
Ｂとする）と前記形Ｃのコードとを１組とし、前記形Ｂ
のコードと最後の３ビットが１００であるコード（以
下、形Ｄとする）とを１組とし、前記形Ｂのコードと最
後の４ビットが１０００であるコード（以下、形Ｅとす
る）とを１組とし、ディジタル信号列において任意のコ
ードの直前のコードが前記形Ｃ、前記形Ｄまたは前記形
Ｅである場合を、直前のコードが前記形Ａまたは前記形
Ｂである場合に対して異なるディジタルデータに対応さ
せることにより変調することを特徴としたものである。
ここで、終端のコードが前記形Ｂのコードのとき、次の
コードの始端がビット０で始まるコードを対応させるこ
とが可能である。
【００２３】また、本発明に係るディジタル変調装置
は、シリアル形式で表されるディジタル信号列におい
て、８ビットのディジタルデータを１２ビットのディジ
タルコードに変換するディジタル変調装置であって、直
列に配列した１２ビット列中においてビット１を連続さ
せずビット１とビット１に挟まれたビット０の連続数を
１以上７以下とするコード列の中から、始端１ビットの
２進値が同一であり、かつ終端を含む最後の４ビットが
００００であるコード（以下、形Ａとする）と最後の２
ビットが１０であるコード（以下、形Ｃとする）とを１
組とし、最後の２ビットが０１であるコード（以下、形
Ｂとする）と前記形Ｃのコードとを１組とし、前記形Ｂ
のコードと最後の３ビットが１００であるコード（以
下、形Ｄとする）とを１組とし、前記形Ｂのコードと最
後の４ビットが１０００であるコード（以下、形Ｅとす
る）とを１組とする手段を備え、ディジタル信号列にお
いて任意のコードの直前のコードが前記形Ｃ、前記形Ｄ
または前記形Ｅである場合を、直前のコードが前記形Ａ
または前記形Ｂである場合に対して異なるディジタルデ
ータに対応させることにより変調することを特徴とする
ものである。ここで、終端のコードが前記形Ｂのコード
のとき、次のコードの始端がビット０で始まるコードを
対応させることが可能である。
は、シリアル形式で表されるディジタル信号列におい
て、８ビットのディジタルデータを１２ビットのディジ
タルコードに変換するディジタル変調装置であって、直
列に配列した１２ビット列中においてビット１を連続さ
せずビット１とビット１に挟まれたビット０の連続数を
１以上７以下とするコード列の中から、始端１ビットの
２進値が同一であり、かつ終端を含む最後の４ビットが
００００であるコード（以下、形Ａとする）と最後の２
ビットが１０であるコード（以下、形Ｃとする）とを１
組とし、最後の２ビットが０１であるコード（以下、形
Ｂとする）と前記形Ｃのコードとを１組とし、前記形Ｂ
のコードと最後の３ビットが１００であるコード（以
下、形Ｄとする）とを１組とし、前記形Ｂのコードと最
後の４ビットが１０００であるコード（以下、形Ｅとす
る）とを１組とする手段を備え、ディジタル信号列にお
いて任意のコードの直前のコードが前記形Ｃ、前記形Ｄ
または前記形Ｅである場合を、直前のコードが前記形Ａ
または前記形Ｂである場合に対して異なるディジタルデ
ータに対応させることにより変調することを特徴とする
ものである。ここで、終端のコードが前記形Ｂのコード
のとき、次のコードの始端がビット０で始まるコードを
対応させることが可能である。
【００２４】
【作用】本発明では、シリアル形式で表されるディジタ
ル信号列において、Ｍビットの原ディジタルデータをＮ
ビット（２Ｍ≧Ｎ＞Ｍ）のディジタルコードに変換し、
２つのディジタルコードを１組として１つまたは２つの
ディジタルデータに対応させることにより、記録信号の
周波数帯域を従来のものより狭くすることができる。そ
の結果として、伝送や記録における要求性能の限界を下
げることができ、またその性能が同じであれば、再生時
の符号誤り率を小さくでき、記録システムの信頼性を向
上することが可能となる。
ル信号列において、Ｍビットの原ディジタルデータをＮ
ビット（２Ｍ≧Ｎ＞Ｍ）のディジタルコードに変換し、
２つのディジタルコードを１組として１つまたは２つの
ディジタルデータに対応させることにより、記録信号の
周波数帯域を従来のものより狭くすることができる。そ
の結果として、伝送や記録における要求性能の限界を下
げることができ、またその性能が同じであれば、再生時
の符号誤り率を小さくでき、記録システムの信頼性を向
上することが可能となる。
【００２５】このように、２個のコード語を組合せてデ
ータ語と対応させる理由は、次のとおりである。
ータ語と対応させる理由は、次のとおりである。
【００２６】まず、コード語を構成するビットをシリア
ルに並べて、その高周波数成分を少なくする方法とし
て、Ｎビットで表される２N の組合せのコード語の中か
らビット０の連続数が１以上のもの、すなわち、ビット
１が連続しないコード語だけを選ぶ。
ルに並べて、その高周波数成分を少なくする方法とし
て、Ｎビットで表される２N の組合せのコード語の中か
らビット０の連続数が１以上のもの、すなわち、ビット
１が連続しないコード語だけを選ぶ。
【００２７】さらにコード語の終端ビットと次のコード
語の始端ビットがともに１になることを避けるために２
個のコード語を組合せて使う。
語の始端ビットがともに１になることを避けるために２
個のコード語を組合せて使う。
【００２８】なお、上記コード語の表現では０を極性反
転なし、１を極性反転ありに対応させている。その結
果、Ｍビットのデータ語の長さをＴとし、また変換後の
Ｎビットの１コード語の長さも同一のＴとしたときに、
Ｎビットのコード語のビット１の間隔の最小値は（２
Ｔ）／Ｎであり、もとのデータ語における２進値の長さ
の最小値Ｔ／Ｍより大きくすることができる。
転なし、１を極性反転ありに対応させている。その結
果、Ｍビットのデータ語の長さをＴとし、また変換後の
Ｎビットの１コード語の長さも同一のＴとしたときに、
Ｎビットのコード語のビット１の間隔の最小値は（２
Ｔ）／Ｎであり、もとのデータ語における２進値の長さ
の最小値Ｔ／Ｍより大きくすることができる。
【００２９】したがって、原ディジタル信号列に比べ
て、変換後におけるコード語の信号帯域の上限はＮ／
（２Ｍ）に狭めることができる。
て、変換後におけるコード語の信号帯域の上限はＮ／
（２Ｍ）に狭めることができる。
【００３０】上述した原データ語の長さとしては、８ビ
ットが用いられることが多いので、Ｍ＝８とした具体例
について、次に述べる。ここで、コード語のビット０の
連続数が１以上という条件のもとでＮをできるだけ小さ
くすることを考えて、Ｎ＝１２とする。
ットが用いられることが多いので、Ｍ＝８とした具体例
について、次に述べる。ここで、コード語のビット０の
連続数が１以上という条件のもとでＮをできるだけ小さ
くすることを考えて、Ｎ＝１２とする。
【００３１】Ｎ＝１２のとき、上記の条件に合致したコ
ード語は３５６個存在するので、この中から２8 ＝２５
６個を選べばよい。但し、コード語はシリアルに並べら
れるので、上記の条件はコード語の接続部分においても
満たされる必要がある。また接続可能なコード語の個数
は、直前のコード語の終端の形によって変化する。
ード語は３５６個存在するので、この中から２8 ＝２５
６個を選べばよい。但し、コード語はシリアルに並べら
れるので、上記の条件はコード語の接続部分においても
満たされる必要がある。また接続可能なコード語の個数
は、直前のコード語の終端の形によって変化する。
【００３２】例えば、コード語終端の形が“…１０”の
場合に接続可能なコード語は３５６個であるが、コード
語終端の形が“…０１”の場合には２１８個であり、２
５６個より少ないのでこのままではコード語を構成でき
ない。なお、上記コード語の表現では“０”を極性反転
無し、“１”を極性反転ありに対応させている。
場合に接続可能なコード語は３５６個であるが、コード
語終端の形が“…０１”の場合には２１８個であり、２
５６個より少ないのでこのままではコード語を構成でき
ない。なお、上記コード語の表現では“０”を極性反転
無し、“１”を極性反転ありに対応させている。
【００３３】そこで本発明では、接続可能な数の多い終
端の形のコード語と接続可能な数の少ない終端の形のコ
ード語を組合せることにより、如何なる組合せの場合で
も接続可能な数を、２５６組以上とすることができる。
たとえば終端の形が“…１０”のコード語と“…０１”
のコード語とを組合せた場合の接続可能なコード語数は
上述した結果から３５６／２組＋２１８／２組＝２７８
組とすることができる。但し、ここで組合せる２つのコ
ード語の始端ビットは同一であるものとする。
端の形のコード語と接続可能な数の少ない終端の形のコ
ード語を組合せることにより、如何なる組合せの場合で
も接続可能な数を、２５６組以上とすることができる。
たとえば終端の形が“…１０”のコード語と“…０１”
のコード語とを組合せた場合の接続可能なコード語数は
上述した結果から３５６／２組＋２１８／２組＝２７８
組とすることができる。但し、ここで組合せる２つのコ
ード語の始端ビットは同一であるものとする。
【００３４】
【実施例】次に、図面を参照して本発明の一実施例を詳
細に説明する。
細に説明する。
【００３５】図１は、本発明を適用したディジタルＶＴ
Ｒの一実施例を示すブロック図である。
Ｒの一実施例を示すブロック図である。
【００３６】図１に示したブロック図の動作を説明する
に先立って、まず本実施例で用いる１２ビットのコード
語の組について説明する。まず２個のコード語の組合せ
の例を、表１−１から表１−４に示す。組番号に示す通
り、全部で１６５組存在する。ここで各コード語はＡ，
Ｂ，Ｃ，Ｄ，Ｅの５種に分類した終端の形の中から表２
に示すような４通りの組のいずれかになるように組合せ
る。なお、ここで示した１２ビットのコード語はＮＲＺ
Ｉ形式で表されている。
に先立って、まず本実施例で用いる１２ビットのコード
語の組について説明する。まず２個のコード語の組合せ
の例を、表１−１から表１−４に示す。組番号に示す通
り、全部で１６５組存在する。ここで各コード語はＡ，
Ｂ，Ｃ，Ｄ，Ｅの５種に分類した終端の形の中から表２
に示すような４通りの組のいずれかになるように組合せ
る。なお、ここで示した１２ビットのコード語はＮＲＺ
Ｉ形式で表されている。
【００３７】コード語の表現にはＮＲＺＬ形式とＮＲＺ
Ｉ形式とがある。ＮＲＺＬ形式はＮＲＺ符号のレベルＬ
を０で表し、レベルＨを１で表したものである。
Ｉ形式とがある。ＮＲＺＬ形式はＮＲＺ符号のレベルＬ
を０で表し、レベルＨを１で表したものである。
【００３８】これに対してＮＲＺＩ形式ではレベルでは
なく、符号の反転の有無を表示する。反転なしを０で表
し、反転ありを１で表す。この反転の有無は磁気テープ
上での磁化の反転の有無とよく対応するのでＮＲＺＩ形
式はディジタル磁気記録システムではよく使われる。
なく、符号の反転の有無を表示する。反転なしを０で表
し、反転ありを１で表す。この反転の有無は磁気テープ
上での磁化の反転の有無とよく対応するのでＮＲＺＩ形
式はディジタル磁気記録システムではよく使われる。
【００３９】表１−１〜表１−４に示したコード語は１
のビットを連続させず１が１と１に挾まれた０の連続数
を最小１、最大７としてある。したがってＮＲＺＬ形式
で表わしたとすれば、同一ビットの連続数が２以上、８
以下ということになる。次に８ビットデータ語０〜２５
５に対してコード語の組番号をたとえば表３に示すよう
に対応させる。
のビットを連続させず１が１と１に挾まれた０の連続数
を最小１、最大７としてある。したがってＮＲＺＬ形式
で表わしたとすれば、同一ビットの連続数が２以上、８
以下ということになる。次に８ビットデータ語０〜２５
５に対してコード語の組番号をたとえば表３に示すよう
に対応させる。
【００４０】組番号がデータ語に対応して決まった後、
１組のコード語のどちらを選択するかはその次のデータ
語に対応して表３により決められる。すなわち、１つの
コード語は相続く２つのデータ語によって決定される。
１組のコード語のどちらを選択するかはその次のデータ
語に対応して表３により決められる。すなわち、１つの
コード語は相続く２つのデータ語によって決定される。
【００４１】表３を見ると、組番号１１〜１０１および
１０６〜１６５のコード語が８ビットのデータ語の２種
類と対応しているが、それら２種類について直前のコー
ド語の終端４ビットのいずれかが異なるので、この４ビ
ットを加えた合計１６ビットのコード語として識別すれ
ば、８ビットのデータ語と１対１の対応がつく。
１０６〜１６５のコード語が８ビットのデータ語の２種
類と対応しているが、それら２種類について直前のコー
ド語の終端４ビットのいずれかが異なるので、この４ビ
ットを加えた合計１６ビットのコード語として識別すれ
ば、８ビットのデータ語と１対１の対応がつく。
【００４２】次に、ディジタルＶＴＲに本発明を適用す
る例について図１を用いて説明する。なお、ディジタル
ＶＴＲの構成要素の中で、本発明に直接関係しない部分
の説明はできるだけ省略する。
る例について図１を用いて説明する。なお、ディジタル
ＶＴＲの構成要素の中で、本発明に直接関係しない部分
の説明はできるだけ省略する。
【００４３】まず、入力端子１に映像信号を加え、Ａ／
Ｄコンバータ２により８ビットのディジタル符号に変換
する。
Ｄコンバータ２により８ビットのディジタル符号に変換
する。
【００４４】次に、誤り訂正符号およびＩＤ識別符号付
加回路３により誤り訂正符号およびＩＤ識別符号を付加
した後、この回路３の出力をスクランブル回路４に加え
る。
加回路３により誤り訂正符号およびＩＤ識別符号を付加
した後、この回路３の出力をスクランブル回路４に加え
る。
【００４５】スクランブル回路４では一定周期の擬似ラ
ンダム最長系列符号を発生し、入力データにｍｏｄ２加
算（ＥＸＯＲ演算）をする。スクランブル回路４の出力
の後に、ここで提案するディジタル変調回路（エンコー
ダ）が設けられる。
ンダム最長系列符号を発生し、入力データにｍｏｄ２加
算（ＥＸＯＲ演算）をする。スクランブル回路４の出力
の後に、ここで提案するディジタル変調回路（エンコー
ダ）が設けられる。
【００４６】読み出し専用メモリＲＯＭ５の入力１にス
クランブル回路４の出力（８ビット）を加える。ＲＯＭ
５の出力１からは、１２ビットのコード語の組番号を出
力する。この組番号は先に説明した表１に示してあるも
のである。
クランブル回路４の出力（８ビット）を加える。ＲＯＭ
５の出力１からは、１２ビットのコード語の組番号を出
力する。この組番号は先に説明した表１に示してあるも
のである。
【００４７】この組番号は表３に示した通り、直前のコ
ード語の終端の形によって変わる場合がある。そこで、
ＲＯＭ５の出力２としてコード語の終端の形がＡである
か否かを出力する。この出力２をラッチ回路６に加え
る。
ード語の終端の形によって変わる場合がある。そこで、
ＲＯＭ５の出力２としてコード語の終端の形がＡである
か否かを出力する。この出力２をラッチ回路６に加え
る。
【００４８】ラッチ回路６の出力は１語分の遅れを生ず
るので、これをＲＯＭ５の入力２（１ビット）として加
える。その結果、直前のコード語の終端のケース番号が
ＲＯＭ５に与えられたので、出力１に組番号が出力され
る。
るので、これをＲＯＭ５の入力２（１ビット）として加
える。その結果、直前のコード語の終端のケース番号が
ＲＯＭ５に与えられたので、出力１に組番号が出力され
る。
【００４９】ＲＯＭ５の入力１に対する出力１の値の一
例として、表１，表３より得られる対応表を表４に示
す。
例として、表１，表３より得られる対応表を表４に示
す。
【００５０】つぎに、ＲＯＭ５の出力１に出力された組
番号に対応する１組２個のコード語の中から、どちらか
を選ぶこと、すなわち、コード語の終端の形を決めるこ
とが必要である。
番号に対応する１組２個のコード語の中から、どちらか
を選ぶこと、すなわち、コード語の終端の形を決めるこ
とが必要である。
【００５１】表３を見てわかるように、コード語の終端
の形は次のデータ語が与えられた段階で決定される。直
前のコード語の終端の形はＲＯＭ５の出力３に与えられ
る。この出力３は終端の形が表２に示すＡ，Ｂのいずれ
かであるときに０となり、Ｃ，Ｄ，Ｅのいずれかである
ときに１とする。この値をラッチ回路７を介してＲＯＭ
８に供給する。
の形は次のデータ語が与えられた段階で決定される。直
前のコード語の終端の形はＲＯＭ５の出力３に与えられ
る。この出力３は終端の形が表２に示すＡ，Ｂのいずれ
かであるときに０となり、Ｃ，Ｄ，Ｅのいずれかである
ときに１とする。この値をラッチ回路７を介してＲＯＭ
８に供給する。
【００５２】ここで、いまＲＯＭ５の出力１に与えられ
ている組番号よりも１語分前の組のコード語がラッチ回
路７の出力により選ばれる対象であるから、ＲＯＭ５の
出力１の後にラッチ回路９，ラッチ回路１０を挿入して
タイミングを合わせてから、ＲＯＭ８に加える。
ている組番号よりも１語分前の組のコード語がラッチ回
路７の出力により選ばれる対象であるから、ＲＯＭ５の
出力１の後にラッチ回路９，ラッチ回路１０を挿入して
タイミングを合わせてから、ＲＯＭ８に加える。
【００５３】ＲＯＭ８において入力された組番号に対応
する２個のコード語のうち、ラッチ回路７の出力により
決められた方が選択されてＲＯＭ８の出力となる。
する２個のコード語のうち、ラッチ回路７の出力により
決められた方が選択されてＲＯＭ８の出力となる。
【００５４】上述した実施例において、本発明に関係す
るディジタル変調回路（エンコーダ）は、以上に説明し
たＲＯＭ５からＲＯＭ８，ラッチ回路１０までの部分で
ある。
るディジタル変調回路（エンコーダ）は、以上に説明し
たＲＯＭ５からＲＯＭ８，ラッチ回路１０までの部分で
ある。
【００５５】ＲＯＭ８の出力を同期ワード付加回路１１
に加えて、同期ワードを一定数のコード語ごとに付加す
る。同期ワードもＮＲＺＩ形式で与えられる。
に加えて、同期ワードを一定数のコード語ごとに付加す
る。同期ワードもＮＲＺＩ形式で与えられる。
【００５６】同期ワード付加回路１１の出力をＮＲＺＩ
−ＮＲＺＬ変換回路１２の入力１に加える。この変換回
路１２の出力１にＮＲＺＬ符号を出力する。また、この
変換回路１２の出力２にコード語の終端のレベル（Ｌま
たはＨ）を出力する。この出力２はラッチ回路１３を通
して入力２に加える。なお、この変換回路１２の出力１
の極性は、入力２に加えられた直前のコード語の終端の
レベルによって規定される。
−ＮＲＺＬ変換回路１２の入力１に加える。この変換回
路１２の出力１にＮＲＺＬ符号を出力する。また、この
変換回路１２の出力２にコード語の終端のレベル（Ｌま
たはＨ）を出力する。この出力２はラッチ回路１３を通
して入力２に加える。なお、この変換回路１２の出力１
の極性は、入力２に加えられた直前のコード語の終端の
レベルによって規定される。
【００５７】ＮＲＺＩ−ＮＲＺＬ変換回路１２の出力１
を並列−直列変換回路１４に加え、１２ビット並列信号
を１本の直列信号に変換する。
を並列−直列変換回路１４に加え、１２ビット並列信号
を１本の直列信号に変換する。
【００５８】記録再生モード切換スイッチ１５を記録側
に倒し、直列ディジタル信号を回転トランス１６を経由
して磁気ヘッド１７に供給する。これら回転トランス１
６および磁気ヘッド１７は回転ドラム（図示せず）に実
装されている。そして、この回転ドラムに巻付けられて
走行するテープ１８に信号が記録される。
に倒し、直列ディジタル信号を回転トランス１６を経由
して磁気ヘッド１７に供給する。これら回転トランス１
６および磁気ヘッド１７は回転ドラム（図示せず）に実
装されている。そして、この回転ドラムに巻付けられて
走行するテープ１８に信号が記録される。
【００５９】再生時には、テープ１８に記録されている
信号が磁気ヘッド１７により再生される。モード切換ス
イッチ１５を再生側に倒すと、信号は回転トランス１６
およびスイッチ１５を経由して時間軸変動補正回路２１
およびクロック再生回路２２に入る。
信号が磁気ヘッド１７により再生される。モード切換ス
イッチ１５を再生側に倒すと、信号は回転トランス１６
およびスイッチ１５を経由して時間軸変動補正回路２１
およびクロック再生回路２２に入る。
【００６０】時間軸変動補正回路２１は記録および再生
時に発生した信号の時間軸の変動を補正する回路であ
り、メモリ（ＲＡＭ）で構成される。クロック再生回路
２２により再生したクロックを使ってそのメモリに書き
込みを行い、一定周期のクロックにより読み出しをすれ
ば時間軸変動が補正される。
時に発生した信号の時間軸の変動を補正する回路であ
り、メモリ（ＲＡＭ）で構成される。クロック再生回路
２２により再生したクロックを使ってそのメモリに書き
込みを行い、一定周期のクロックにより読み出しをすれ
ば時間軸変動が補正される。
【００６１】時間軸変動補正回路２１の出力は、直列−
並列変換回路２３および同期検出回路２４に供給され
る。記録系で付加した同期ワードを同期検出回路２４に
より分離検出する。直列に変換して記録された１２ビッ
トのコード語を直列−並列変換回路２３により１２ビッ
トの並列信号に戻す。このとき、同期検出回路２４から
供給される同期ワードにより１２ビットごとの同期をと
る。
並列変換回路２３および同期検出回路２４に供給され
る。記録系で付加した同期ワードを同期検出回路２４に
より分離検出する。直列に変換して記録された１２ビッ
トのコード語を直列−並列変換回路２３により１２ビッ
トの並列信号に戻す。このとき、同期検出回路２４から
供給される同期ワードにより１２ビットごとの同期をと
る。
【００６２】直列−並列変換回路２３の出力は、ＲＯＭ
２５およびラッチ回路２６からなる８−１２変換の復調
回路（テコーダ）に入る。
２５およびラッチ回路２６からなる８−１２変換の復調
回路（テコーダ）に入る。
【００６３】ラッチ回路２６には１２ビットのうち、終
端の４ビットだけを入力し、その出力はＲＯＭ２５の入
力１に加えられる。この４ビットはラッチ回路２６を経
由して１語分の遅れを生じているので、ＲＯＭ２５の入
力２に対して直前のコード語の終端の４ビットというこ
とになる。
端の４ビットだけを入力し、その出力はＲＯＭ２５の入
力１に加えられる。この４ビットはラッチ回路２６を経
由して１語分の遅れを生じているので、ＲＯＭ２５の入
力２に対して直前のコード語の終端の４ビットというこ
とになる。
【００６４】先に説明したように、この４ビットを加え
た合計１６ビットのコード語は表３の通り、８ビットの
データ語と対応しているので、ＲＯＭ２５の出力１に８
ビットのデータ語を復元して出力することができる。な
お、ＲＯＭ２５に入力されるコード語は通常ＮＲＺＬ形
式となるがＲＯＭの変換表をＮＲＺＬに対応した表にす
ればよい。
た合計１６ビットのコード語は表３の通り、８ビットの
データ語と対応しているので、ＲＯＭ２５の出力１に８
ビットのデータ語を復元して出力することができる。な
お、ＲＯＭ２５に入力されるコード語は通常ＮＲＺＬ形
式となるがＲＯＭの変換表をＮＲＺＬに対応した表にす
ればよい。
【００６５】ここで、ＲＯＭ２５の出力２から誤りフラ
グを出力する。ＲＯＭ５，ラッチ回路６および７，ＲＯ
Ｍ８，ラッチ回路９および１０により構成されるディジ
タル変調器（エンコーダ）では、先に説明したように１
６５組のコード語しか発生しないので、これらとは異な
るコード語がＲＯＭ２５に入力されたときは、そのコー
ド語は誤りであると判断して上記誤りフラグを出力す
る。
グを出力する。ＲＯＭ５，ラッチ回路６および７，ＲＯ
Ｍ８，ラッチ回路９および１０により構成されるディジ
タル変調器（エンコーダ）では、先に説明したように１
６５組のコード語しか発生しないので、これらとは異な
るコード語がＲＯＭ２５に入力されたときは、そのコー
ド語は誤りであると判断して上記誤りフラグを出力す
る。
【００６６】但し、誤りが発生したとき必ずフラグを出
せるとは限らない。その理由は、誤った結果、１６５組
のいずれか別のコード語に変化する場合もあるからであ
る。
せるとは限らない。その理由は、誤った結果、１６５組
のいずれか別のコード語に変化する場合もあるからであ
る。
【００６７】ＲＯＭ２５の出力１はデスクランブル回路
２７に加えられる。先にスクランブル回路４において用
いたのと同じ擬似ランダム最長系列符号を発生し、入力
データにｍｏｄ２加算（ＥＸＯＲ演算）をする。その結
果、スクランブルは解除され、もとの８ビットデータに
戻る。
２７に加えられる。先にスクランブル回路４において用
いたのと同じ擬似ランダム最長系列符号を発生し、入力
データにｍｏｄ２加算（ＥＸＯＲ演算）をする。その結
果、スクランブルは解除され、もとの８ビットデータに
戻る。
【００６８】デスクランブル回路２７の出力を誤り訂正
回路２８に加え、誤りの訂正を行う。このとき、ＲＯＭ
２５の出力２より誤りフラグを供給すれば、誤り訂正能
力を一段と強化することができる。
回路２８に加え、誤りの訂正を行う。このとき、ＲＯＭ
２５の出力２より誤りフラグを供給すれば、誤り訂正能
力を一段と強化することができる。
【００６９】遅延回路２９は、８ビットデータがデスク
ランブル回路２７を通るために生じるデータの遅延に対
し、誤りフラグのタイミングを合わせるために挿入す
る。
ランブル回路２７を通るために生じるデータの遅延に対
し、誤りフラグのタイミングを合わせるために挿入す
る。
【００７０】誤り訂正回路２８の出力をＤ／Ａコンバー
タ３０に加え、出力端子３１から再生した映像信号を得
る。
タ３０に加え、出力端子３１から再生した映像信号を得
る。
【００７１】
【表１】
【００７２】
【表２】
【００７３】
【表３】
【００７４】
【表４】
【００７５】
【表５】
【００７６】
【表６】
【００７７】
【表７】
【００７８】
【表８】
【００７９】
【発明の効果】以上説明したとおり、本発明ではＭビッ
トのディジタルデータをＮビットのディジタルコードに
変換するにあたり、２つのディジタルコードを１組とし
て１つまたは２つのディジタルデータに対応させること
により記録信号の帯域を従来の方法より狭くする構成と
してあるので、その結果として再生時の符号誤り率を小
さくでき、記録システムの信頼性を向上することができ
る。
トのディジタルデータをＮビットのディジタルコードに
変換するにあたり、２つのディジタルコードを１組とし
て１つまたは２つのディジタルデータに対応させること
により記録信号の帯域を従来の方法より狭くする構成と
してあるので、その結果として再生時の符号誤り率を小
さくでき、記録システムの信頼性を向上することができ
る。
【００８０】より具体的には、本発明を実施することに
より、例えば８ビットを１２ビットに変換して変換後の
ビット０の連続数を１以上とするので、記録信号の最高
周波数は変換前のＮＲＺ信号に比べて６／８となる。こ
のため、記録再生したときの誤り率を小さくでき、信頼
性を向上できる。
より、例えば８ビットを１２ビットに変換して変換後の
ビット０の連続数を１以上とするので、記録信号の最高
周波数は変換前のＮＲＺ信号に比べて６／８となる。こ
のため、記録再生したときの誤り率を小さくでき、信頼
性を向上できる。
【００８１】また、見方を変えて記録信号の最高周波数
を同じとするならば、８／６倍のデータを同じテープ面
積に記録できることになる。
を同じとするならば、８／６倍のデータを同じテープ面
積に記録できることになる。
【００８２】このほか、ブロック変換符号の特徴として
再生時に変換の規則に当てはまらないコード語が発生し
たとき、そのコード語は誤りであると判断できる。従っ
て、この誤りフラグを使って誤り訂正能力を向上するこ
とができる。
再生時に変換の規則に当てはまらないコード語が発生し
たとき、そのコード語は誤りであると判断できる。従っ
て、この誤りフラグを使って誤り訂正能力を向上するこ
とができる。
【図１】本発明の一実施例によるディジタルＶＴＲを示
すブロック図である。
すブロック図である。
１ 入力端子 ２ Ａ／Ｄコンバータ ３ 誤り訂正符号およびＩＤ識別符号付加回路 ４ スクランブル回路 ５ ＲＯＭ ６ ラッチ回路 ７ ラッチ回路 ８ ＲＯＭ ９ ラッチ回路 １０ ラッチ回路 １１ 同期ワード付加回路 １２ ＮＲＺＩ−ＮＲＺＬ変換回路 １３ ラッチ回路 １４ 並列−直列変換回路 １５ 記録再生モード切換スイッチ １６ 回転トランス １７ 磁気ヘッド １８ テープ ２１ 時間軸変動補正回路 ２２ クロック再生回路 ２３ 直列−並列変換回路 ２４ 同期検出回路 ２５ ＲＯＭ ２６ ラッチ回路 ２７ デスクランブル回路 ２８ 誤り訂正回路 ２９ 遅延回路 ３０ Ｄ／Ａコンバータ ３１ 出力端子
フロントページの続き (58)調査した分野(Int.Cl.6，ＤＢ名) G11B 20/10 - 20/14 H03M 7/00 H04L 25/49
Claims (4)
- 【請求項１】 シリアル形式で表されるディジタル信号
列において、８ビットのディジタルデータを１２ビット
のディジタルコードに変換するにあたり、 直列に配列した１２ビット列中においてビット１を連続
させずビット１とビット１に挟まれたビット０の連続数
を１以上７以下とするコード列の中から、 始端１ビットの２進値が同一であり、かつ終端を含む最
後の４ビットが００００であるコード（以下、形Ａとす
る）と最後の２ビットが１０であるコード（以下、形Ｃ
とする）とを１組とし、最後の２ビットが０１であるコ
ード（以下、形Ｂとする）と前記形Ｃのコードとを１組
とし、前記形Ｂのコードと最後の３ビットが１００であ
るコード（以下、形Ｄとする）とを１組とし、前記形Ｂ
のコードと最後の４ビットが１０００であるコード（以
下、形Ｅとする）とを１組とし、 ディジタル信号列において任意のコードの直前のコード
が前記形Ｃ、前記形Ｄまたは前記形Ｅである場合を、直
前のコードが前記形Ａまたは前記形Ｂである場合に対し
て異なるディジタルデータに対応させることにより変調
することを特徴とするディジタル変調方法。 - 【請求項２】 請求項１に記載のディジタル変調方法に
おいて、 終端のコードが前記形Ｂのコードのとき、次のコードの
始端がビット０で始まるコードを対応させることを特徴
とするディジタル変調方法。 - 【請求項３】 シリアル形式で表されるディジタル信号
列において、８ビットのディジタルデータを１２ビット
のディジタルコードに変換するディジタル変調装置であ
って、 直列に配列した１２ビット列中においてビット１を連続
させずビット１とビット１に挟まれたビット０の連続数
を１以上７以下とするコード列の中から、 始端１ビットの２進値が同一であり、かつ終端を含む最
後の４ビットが００００であるコード（以下、形Ａとす
る）と最後の２ビットが１０であるコード（以下、形Ｃ
とする）とを１組とし、最後の２ビットが０１であるコ
ード（以下、形Ｂとする）と前記形Ｃのコードとを１組
とし、前記形Ｂのコードと最後の３ビットが１００であ
るコード（以下、形Ｄとする）とを１組とし、前記形Ｂ
のコードと最後の４ビットが１０００であるコード（以
下、形Ｅとする）とを１組とする手段を備え、 ディジタル信号列において任意のコードの直前のコード
が前記形Ｃ、前記形Ｄまたは前記形Ｅである場合を、直
前のコードが前記形Ａまたは前記形Ｂである場合に対し
て異なるディジタルデータに対応させることにより変調
することを特徴とするディジタル変調装置。 - 【請求項４】 請求項３に記載のディジタル変調装置に
おいて、 終端のコードが前記形Ｂのコードのとき、次のコードの
始端がビット０で始まるコードを対応させることを特徴
とするディジタル変調装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27258791A JP2898132B2 (ja) | 1991-10-21 | 1991-10-21 | ディジタル変調方法および装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27258791A JP2898132B2 (ja) | 1991-10-21 | 1991-10-21 | ディジタル変調方法および装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH05114249A JPH05114249A (ja) | 1993-05-07 |
| JP2898132B2 true JP2898132B2 (ja) | 1999-05-31 |
Family
ID=17516003
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP27258791A Expired - Fee Related JP2898132B2 (ja) | 1991-10-21 | 1991-10-21 | ディジタル変調方法および装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2898132B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP4135497B2 (ja) | 2002-12-26 | 2008-08-20 | 株式会社日立製作所 | データ再生方法及びデータ再生装置 |
-
1991
- 1991-10-21 JP JP27258791A patent/JP2898132B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH05114249A (ja) | 1993-05-07 |
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Legal Events
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|---|---|---|---|
| R250 | Receipt of annual fees |
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| LAPS | Cancellation because of no payment of annual fees |