JPH03106215A - スイツチングヒステリシスを有するトリガ回路 - Google Patents

スイツチングヒステリシスを有するトリガ回路

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JPH03106215A
JPH03106215A JP2238811A JP23881190A JPH03106215A JP H03106215 A JPH03106215 A JP H03106215A JP 2238811 A JP2238811 A JP 2238811A JP 23881190 A JP23881190 A JP 23881190A JP H03106215 A JPH03106215 A JP H03106215A
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JP
Japan
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pair
load
circuits
circuit
current source
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JP2238811A
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English (en)
Inventor
Claude Barre
クラウデ、バレ
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Siemens AG
Original Assignee
Siemens AG
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Publication date
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    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03K—PULSE TECHNIQUE
    • H03K3/00—Circuits for generating electric pulses; Monostable, bistable or multistable circuits
    • H03K3/02—Generators characterised by the type of circuit or by the means used for producing pulses
    • H03K3/26—Generators characterised by the type of circuit or by the means used for producing pulses by the use, as active elements, of bipolar transistors with internal or external positive feedback
    • H03K3/28—Generators characterised by the type of circuit or by the means used for producing pulses by the use, as active elements, of bipolar transistors with internal or external positive feedback using means other than a transformer for feedback
    • H03K3/281—Generators characterised by the type of circuit or by the means used for producing pulses by the use, as active elements, of bipolar transistors with internal or external positive feedback using means other than a transformer for feedback using at least two transistors so coupled that the input of one is derived from the output of another, e.g. multivibrator
    • H03K3/286—Generators characterised by the type of circuit or by the means used for producing pulses by the use, as active elements, of bipolar transistors with internal or external positive feedback using means other than a transformer for feedback using at least two transistors so coupled that the input of one is derived from the output of another, e.g. multivibrator bistable
    • H03K3/2893—Bistables with hysteresis, e.g. Schmitt trigger
    • H03K3/2897—Bistables with hysteresis, e.g. Schmitt trigger with an input circuit of differential configuration

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  • Engineering & Computer Science (AREA)
  • Power Engineering (AREA)
  • Manipulation Of Pulses (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 この発明は、スイッチングヒステリシスを有するトリガ
回路に関するものである． 〔従来の技術〕 ディジタル回路、たとえばゲートアレイの入力端の前に
、一方では特にスイッチングしきいの範囲内のノイズイ
ミエニティを高めるため、他方では緩慢なエッジを有す
る入力信号をも処理し得るように、しばしばスイッチン
グヒステリシスを有するトリガ回路が接続されている．
シュ逅シトトリガとも呼ばれるスイッチングヒステリシ
スを有する好ましいトリガ回路はたとえばウー．テイー
ツェ（Ｕ．Ｔｉｅｔｚｅ）およびツエーハー．シェンク
（Ｃｈ．ｓｃｈｅｎｋ）著、「半導体回路工学（Ｈａｌ
ｂｌｅｉ　ｔａｒ−ＳｃｈａｌｔｕｎｌＨｓｔｅｃｈｎ
ｉｋ）　Ｊ第５版、ｌ９８０年、第１３５頁から知られ
ている．このトリガ回路には、エミッタ結合されており
、ほぼ一定のエミッタ電流により作動し、負荷回路にそ
れぞれ負荷抵抗を有し、また分圧器により両負荷回路の
１つと相応の入力回路との間に接続されているトランジ
スタ対が用いられている．回路の適当なディメンジタニ
ングにより、跳躍の際に、トランジスタ対が飽和状態に
入ることなく、一定のエミッタ電流が１つのトランジス
タから他方のトランジスタへ切り換わることが達戒され
得る．それにより切り換えの際に蓄積効果が生ぜず、本
質的に高いスイッチング周波数が得られる． 多くの他のディジタル回路でもそうであるが、まさにゲ
ートアレイでは、論理状態に対応付けられている回路内
部の信号レベルが入力端における信号レベルと一敗せず
、従ってレベル変換を必要とすることがしばしばある．
さらに、多くの場合に、入力信号の挙動へのヒステリシ
ス挙動のマッチングが必要である．しかし、公知のトリ
ガ回路ではトランジスタの飽和度、出力信号レベルおよ
びヒステリシス挙動が互いに無関係に設定され得す、そ
れによりトリガ回路の＃Ｊ４Ｉｌｆｆに問題がある．〔
発明が解決しようとする課題〕 本発明の課題は、トランジスタの飽和度、出力信号レベ
ルおよびヒステリシス挙動が互いに無間係に設定され得
る、ヒステリシスを有するトリガ回路を提供することで
ある． 〔課題を解決するための手段〕 この課題を解決するため、本発明のトリガ回路において
は、エミッタ結合され第１の電流源から給電される第１
のトランジスタ対が設けられており、その負荷回路にそ
れぞれ負荷抵抗が接続されており、その負荷回路が結合
抵抗を介して互いに接続されており、その他の入力回路
が入力信号を与えられており、エミッタ結合され第２の
電流源から給電される第２のトランジスタ対が設けられ
ており、その負荷回路が直接に、またその入力回路が交
叉を介して第１のトランジスタ対の相応の負荷回路と結
合されており、エミッタ結合され第３のｔ流源から給電
される第３のトランジスタ対が設けられており、その負
荷回路にそれぞれ別の負荷抵抗が接続されており、また
その入力回路が第１のトランジスタ対の相応の負荷回路
と結合されるものである． 本発明の他の構或は請求項２以下にあげられている． 〔実施例〕 次に図面に示されている実施例により本発明を一層詳細
に説明する。
実施例には、本発明により、エミッタ結合され第１の電
流源Ｓｌから給電され、第１および第２のｎｐｎ　トラ
ンジスタＴｌｌおよびＴＩ２を有する第ｌのトランジス
タ対ＴＰＩが示されている．第ｌのｎｐｎ｝ランジスタ
Ｔｌｌのベースは第１の入力回路を形威して入力信号Ｅ
を、また第２のｎｐｎトランジスタＴ１２のベースは第
２の入力回路を形成して参照電位ＶＲを与えられている
．第１のトランジスタ対ＴＰＩの両負荷回路のなかにそ
れぞれ負荷抵抗Ｒ１およびＲ２が接続されている．負荷
抵抗Ｒ１は第１のｎｐｎトランジスタＴｌｌのコレクタ
を、また負荷抵抗Ｒ２は第２のｎｐｎ｝ランジスタＴ１
２のコレクタを供給電位ｖ２と接続する．両負荷回路は
本発明の実施例では、第１および第２のｎｐｎ｝ランジ
スタＴｌｌおよびＴ１２のコレクタの間に接続されてい
る結合抵抗ＲＫを介して飽和防止のために互いに接続さ
れている．図示されている負荷抵抗Ｒ１、Ｒ２および負
荷抵抗ＲＫの三角接続の代わりに、等しい仕方で星形接
続も可能である． さらに、実施例には、エミッタ結合され第２の電流ａＳ
２から給電され、第３および第４のｎｐｎトランジスタ
Ｔ２１およびＴ２２を有する第２のトランジスタ対ＴＰ
２が示されている．第２のトランジスタ対ＴＰ２の負荷
回路は直接に、またその入力回路は交叉を介して第ｌの
トランジスタ対ＴＰＩの対向する負荷回路と接続されて
いる．それによって第３のｎｐｎトランジスタＴ２１の
ベースおよび第４のｎｐｎ　トランジスタＴ２２のコレ
クタは第２のｎｐｎ　｝ランジスタＴ１２のコレクタと
、また第４のｎｐｎ　トランジスタＴ２２のベースおよ
び第３のｎｐｎ｝ランジスタＴ２１のコレクタは第１の
ｎｐｎトランジスタＴｌｌのコレクタと接続されている
． 最後に、エミンタ結合され第３の電流ａＳＳから給電さ
れ、第５および第６のｎｐｎ　｝ランジスタＴ３１およ
びＴ３２を有する第３のトランジスタ対ＴＰ３が設けら
れており、その負荷回路にはそれぞれ別の負荷抵抗Ｒ３
およびＲ４が接続されており、またその入力回路は第１
のトランジスタ対ＴＰＩの相応の負荷回路と結合されて
いる．そのために第５のｎｐｎトランジスタＴ３１のベ
ースは第２のｎｐｎトランジスタＴ１２のコレクタと、
また第６のｎｐｎ　トランジスタＴ３２のベースは第１
のｎｐｎトランジスタＴｌｌのコレクタと接続されてい
る。第５および第６のｎｐｎ　トランジスタＴ３１およ
びＴ３２のコレクタは負荷抵抗Ｒ３またはＲ４を介して
供給電位ｖ２を与えられている。第６のｎｐｎ｝ランジ
スタＴ３２のコレクタには出力信号Ａが、また第５のｎ
ｐｎ　トランジスタＴ３１のコレクタにはそれに対して
反転された出力信号Ａが生ずる。
電流ｆｉＳ１，Ｓ２およびＳ３はそれぞれトランジスタ
対ＴＰＩ、ＴＰ２、ＴＰ３の結合されたエミッタと第１
の供給電位■１との間に接続されている．本発明の実施
例では、電流源Ｓ２およびＳ３は外部で可変の電流源と
して構威されている．同しく参照電位ＶＲも外部で可変
である．その際の利点は種々の入力および出力信号レベ
ルへの可変一のマッチングである． 入力ヒステリシスレベルの調整は基準電圧ＶＲの変更に
よって行われる．そのヒステリシス幅は第２の電流源Ｓ
２の電流の第１の電流源Ｓ１の電流に対する比によって
決定される。トリガ回路の出力レベルは第３の電流源Ｓ
３から取り出されるｔ流によって決定される．結合抵抗
ＲＫと結合して負荷抵抗Ｒ１、Ｒ２により決定される回
路の飽和自由度は、すべての調整を影響外におく．〔発
明の効果〕 本発明によれば、種々の形式の論理回路とトリガ回路と
を組み合わせることができ、差入力を実現することがで
き、また内部および外部で信号レベルが異なっていても
よいという利点を有するものである．
【図面の簡単な説明】
図面は本発明の実施例の回路図である．Ａ，Ａ・・・出
力信号 Ｅ・・・入力信号 Ｒｌ〜Ｒ４・・・負荷抵抗 ＲＫ・・・結合抵抗 ３１〜Ｓ３・・・電流源 Ｔｌｌ〜Ｔ３２・・・ｎｐｎ　トランジスタＴＰＩ〜Ｔ
Ｐ３・・・トランジスタ対 Ｖ１、Ｖ２・・・供給電位 ＶＲ・・・参照電位

Claims (1)

  1. 【特許請求の範囲】 １）エミッタ結合され第１の電流源（Ｓ１）から給電さ
    れる第１のトランジスタ対（ＴＰ１）が設けられており
    、その負荷回路にそれぞれ負荷抵抗（Ｒ１、Ｒ２）が接
    続されており、その負荷回路が結合抵抗（ＲＫ）を介し
    て互いに接続されており、その他の入力回路が入力信号
    （Ｅ）を与えられており、 エミッタ結合され第２の電流源（Ｓ２）から給電される
    第２のトランジスタ対（ＴＰ２）が設けられており、そ
    の負荷回路が直接に、またその入力回路が交叉を介して
    第１のトランジスタ対（ＴＰ１）の相応の負荷回路と結
    合されており、 エミッタ結合され第３の電流源（Ｓ３）から給電される
    第３のトランジスタ対（ＴＰ３）が設けられており、そ
    の負荷回路にそれぞれ別の負荷抵抗（Ｒ３、Ｒ４）が接
    続されており、またその入力回路が第１のトランジスタ
    対（ＴＰ１）の相応の負荷回路と結合されている ことを特徴とするスイッチングヒステリシスを有するト
    リガ回路。 ２）参照電位（ＶＲ）が可変であることを特徴とする請
    求項１記載のトリガ回路。 ３）第３の電流源（Ｓ３）において定電流が可変である
    ことを特徴とする請求項１または２記載のトリガ回路。 ４）第１の電流源（Ｓ１）において、または第２の電流
    源（Ｓ２）において、または双方において、定電流が可
    変であることを特徴とする請求項１ないし３の１つに記
    載のトリガ回路。 ５）第１のトランジスタ対（ＴＰ１）の負荷回路が結合
    抵抗（ＲＫ）を介して互いに接続されていることを特徴
    とする請求項１ないし４の１つに記載のトリガ回路。
JP2238811A 1989-09-11 1990-09-07 スイツチングヒステリシスを有するトリガ回路 Pending JPH03106215A (ja)

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