JPH0132997B2 - - Google Patents

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JPH0132997B2
JPH0132997B2 JP56126995A JP12699581A JPH0132997B2 JP H0132997 B2 JPH0132997 B2 JP H0132997B2 JP 56126995 A JP56126995 A JP 56126995A JP 12699581 A JP12699581 A JP 12699581A JP H0132997 B2 JPH0132997 B2 JP H0132997B2
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JP
Japan
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data
note
note length
chord
switch
Prior art date
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JP56126995A
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English (en)
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JPS5828786A (ja
Inventor
Eiichiro Aoki
Kunihiko Watanabe
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Yamaha Corp
Original Assignee
Yamaha Corp
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Publication of JPS5828786A publication Critical patent/JPS5828786A/ja
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【発明の詳細な説明】 この発明は電子楽器に関し、特に鍵盤部での押
圧鍵に対応する鍵データを演奏操作の時間経過と
ともに順次記憶するメモリを備えた電子楽器に関
するものである。
従来において、鍵盤部での押圧鍵に対応する鍵
データを演奏操作の時間経過とともに順次記憶し
ておき、その後この記憶内容を読み出して演奏者
による演奏音を再生するようにした電子楽器があ
る。この場合、鍵データとともに各押圧鍵の押圧
時間、換言すれば音符長に対応する符長データも
記憶される。
ところが、従来においては各押圧鍵の押圧時間
を計時回路によつて自動的に測定し、この測定値
を音符長に対応する符長データとしてメモリ等に
自動的に記憶させるようにしていたため、演奏者
は記憶させるべき演奏曲の演奏操作に習熟してい
なければ楽譜通りの再生音が得られず、初心者に
とつてはこのような自動再生機能を有意義に使う
ことができないという欠点があつた。
この発明はこのような欠点に鑑みなされたもの
で、その目的は演奏操作に習熟していなくても楽
譜通りの再生音が簡単に得られるようにした電子
楽器を提供することにある。
このためにこの発明は1操作数が所定音符長に
重み付けされた基準音符長スイツチを設け、記憶
すべき音符長に対応した回数だけこの基準音符長
スイツチを操作して符長データを形成し、この符
長データと鍵データとをメモリに記憶させるよう
にしたものである。
以下、図示する実施例に基づいてこの発明を詳
細に説明する。
図はこの発明の一実施例を示すブロツク図であ
つて、この実施例は和音発生用の和音データを符
長データとともに記憶させるものに適用したもの
である。
図において、鍵盤部1はメロデイ音用の上鍵盤
および伴奏音用の下鍵盤を有し、上鍵盤でいずれ
かの鍵が押圧されるとこの押圧鍵に対応した鍵デ
ータKDを形成し、この鍵データKDをメロデイ
音形成回路2に供給する。また、下鍵盤において
伴奏用の和音に対応する複数の鍵が押圧されると
これらの押圧鍵に対応した鍵データKDを形成し
て和音検出回路3に供給する。
メロデイ音形成回路2は、上鍵盤の押圧鍵に対
応した鍵データKDが供給されると、この押圧鍵
に対応したメロデイ音信号を形成し、このメロデ
イ音信号を増幅器4を介してスピーカ5に供給す
る。これによつて、スピーカ5から上鍵盤の押圧
鍵に対応したメロデイ音が発生される。
一方、和音検出回路3は、下鍵盤における押圧
鍵が所定の和音に対応するものであれば、その和
音に対応する和音データ(根音を示すデータおよ
びマイナコードなどのコードの種類を示すデー
タ)をデータメモリ6に供給する。
データメモリ6は、C、G7などの和音の連続
時間を表わす符長データと、和音検出回路3から
出力される和音データとを1組として音符データ
として入力順に順次記憶するものであり、この場
合の符長データは符長データ発生回路7から供給
される。また、符長データと和音データとから成
る音符データを書込むためのアドレス信号および
読出すためのアドレス信号はメモリ制御回路8か
ら与えられる。
符長データ発生回路7は、所定の音符長(例え
ば4分音符)に対応した基準データDを発生する
基準データ発生回路70と、微分パルス信号DP1
が与えられる都度基準データDを取込み、微分パ
ルスDP1の発生数nとデータDとを乗算した乗算
値に相当する累算値n・Dを符長データとして出
力する累算器71とから構成されている。そし
て、累算器71は遅延回路10の出力信号、すな
わち書込み指令スイツチW・SWのオン信号を微
分回路9によつて微分した微分パルス信号DP1
若干遅延した信号によつてリセツトされるように
構成されている。また、基準音符長スイツチSW1
のオン信号を微分回路11によつて微分した微分
パルス信号DP1により基準データDを取込むよう
に構成されている。この場合、スイツチSW1およ
びW・SWは、記憶および再生のモードを切換え
るモード切換スイツチSW2が記憶側(REC側)
に切換えられている時のみ“1”信号が接続され
て有効になる。
従つて、モード切換スイツチSW2が記憶側に切
換えられている状態において、基準音符長スイツ
チSW1をn回だけオン操作すると、累算器71の
出力には「n・D」で示される符長データが得ら
れる。例えば、基準データDを4分音符に対応す
るものとすると、スイツチSW1を2回だけオンす
れば累算器71の出力には2分音符に対応する符
長データが得られる。換言すれば、4分音符の長
さに重み付けされた基準音符長スイツチSW1の操
作数nと4分音符の長さとの乗算値に相当する音
符長に相当する符長データが形成される。
このようにして形成された符長データはデータ
メモリ6に供給されるが、この状態において書込
み指令スイツチW・SWがオンされて微分回路9
から微分パルス信号DP2が発生されると、この微
分パルス信号DP2によつてデータメモリ6は書込
みモードとなつて符長データおよび和音データが
音符データとして書込まれる。この場合、音符デ
ータの書込みのためのアドレス信号はメモリ制御
回路8から与えられるが、このアドレス信号は微
分パルス信号DP2が発生する都度「+1」ずつ更
新される。これによつて、音符データは書込み指
令スイツチW・SWの操作毎にデータメモリ6の
各アドレスに順次書込まれる。
なお、書込動作終了後においては累算器71の
符長データは遅延回路10の出力信号によつてリ
セツトされる。
例えば、4/4拍子の演奏曲において、第1小節
目から第2小節目までがCの和音であり、第3小
節目がG7の和音の場合、基準音符長スイツチ
SW1を8回だけオンして第1小節目から第2小節
目までのCの和音の符長データを形成し、この状
態で書込み指令スイツチW・SWをオンする。こ
れによつて、Cの和音の連続時間に対応する符長
データがデータメモリ6に記憶される。次に、ス
イツチSW1を4回だけオンして第3小節目のG7
の和音の符長データを形成し、この状態でスイツ
チW・SWをオンする。これによつて、G7の和音
の連続時間に相当する符長データがデータメモリ
6に記憶される。
このようにしてデータメモリ6に記憶された音
符データは、スイツチSW2が再生側(PLAY側)
に切換えられている状態の時、メモリ制御回路8
から出力されるアドレス信号によつて順次読出さ
れる。そして、この読出された音符データのうち
和音データは伴奏音形成回路12に供給され、ま
た符長データは符長検出回路13へ供給される。
符長検出回路13は、スイツチSW2が再生側に
切換えられている状態の時にイネーブル状態とな
り、発振器14から出力されるテンポクロツク
TCLを順次カウントし、そのカウント値が符長
データと一致するとメモリ制御回路8に対して読
出しアドレス信号のインクリメント信号を与える
ものである。すなわち、和音データに対応する和
音の連続時間が符長データで示される時間に達す
ると、読出しアドレス信号を「+1」だけ更新す
る信号RAIを送出するものである。これによつ
て、データメモリ6の各アドレスに記憶された音
符データは符長データにより示される時間だけ連
続的に読出しが続行される。この結果、伴奏音形
成回路12においては、符長データで示される時
間の間、この時の和音データに基づく和音が伴奏
音として形成される。
この場合、回路12において形成された伴奏音
はリズム音に対応した周期でオン・オフされる。
すなわち、パターンメモリ16は所定のリズム音
を発生するためのリズムパターン信号および伴奏
音をリズム音に対応してオン・オフするためのオ
ン・オフ信号を各アドレスに記憶しているが、テ
ンポクロツクTCLをカウントするカウンタ15
から所定のリズム音に対応した繰り返し周期のア
ドレス信号が入力されると、リズム音を発生させ
るためのリズムパターン信号を出力すると共に、
伴奏音のオン・オフ信号を出力する。そして、リ
ズムパターン信号はリズム音形成回路17に供給
され、ここにおいてリズム音が形成される。一
方、伴奏音のオン・オフ信号は伴奏音形成回路1
2に供給される。これによつて、和音データに基
づいて形成された伴奏音はこのオン・オフ信号に
よつてオン・オフされて増幅器4を介してスピー
カ5に供給される。また、リズム音形成回路17
において形成されたリズム音も増幅器4を介して
スピーカ5に供給される。この結果、データメモ
リ6に記憶させた和音データに基づく伴奏音と、
パターンメモリ16に記憶させたリズムパターン
信号に基づくリズム音とがスピーカ5から発音さ
れる。
従つて、このように構成された電子楽器におい
ては、演奏操作に習熟していなくても楽譜の音符
長さえ読取ることができれば同一伴奏音の連続時
間を基準音符長スイツチの操作回数によつて簡単
に指定できる。このため、初心者であつても楽譜
通りの伴奏音を記憶しまた再生することができ
る。そして、この場合の伴奏音と共に上鍵盤にお
いてメロデイ音の演奏操作を行なえば、初心者で
あつても熟練者と同様の演奏を楽しむことができ
る。
なお、実施例においては伴奏用の和音データを
記憶させる場合について説明したが、メロデイ音
のための鍵データを記憶させる場合についても同
様に適用できることは言うまでもない。
以上の説明から明らかなようにこの発明によれ
ば、演奏操作に習熟していなくてもメモリに記憶
されたデータに基づく楽音を楽譜通りの長さで正
しく簡単に再生することができ、初心者にとつて
極めて有効なものとなる優れた効果がある。
【図面の簡単な説明】
図はこの発明による電子楽器の一実施例を示す
ブロツク図である。 1……鍵盤部、2……メロデイ音形成回路、6
……データメモリ、7……符長データ発生回路、
8……メモリ制御回路、SW1……基準音符長スイ
ツチ。

Claims (1)

    【特許請求の範囲】
  1. 1 複数の鍵を有し、押圧鍵に対応した鍵データ
    を出力する鍵盤部と、1操作数が所定音符長に重
    み付けされている基準音符長スイツチと、この基
    準音符長スイツチの出力を入力し、該基準音符長
    スイツチの操作数と前記所定音符長とを乗じた音
    符長に相当する符長データを発生する符長データ
    発生回路と、前記鍵データおよび符長データを音
    符データとして記憶するメモリと、前記音符デー
    タの書込みおよび読出しを制御するメモリ制御回
    路とを備えることを特徴とする電子楽器。
JP56126995A 1981-08-13 1981-08-13 電子楽器 Granted JPS5828786A (ja)

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JP56126995A JPS5828786A (ja) 1981-08-13 1981-08-13 電子楽器

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JP56126995A JPS5828786A (ja) 1981-08-13 1981-08-13 電子楽器

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JPS5828786A JPS5828786A (ja) 1983-02-19
JPH0132997B2 true JPH0132997B2 (ja) 1989-07-11

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JPS5828786A (ja) 1983-02-19

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