JPH01133879A - 荷重従属型のケージ制御装置を具備したエレベータ用群制御装置 - Google Patents
荷重従属型のケージ制御装置を具備したエレベータ用群制御装置Info
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- JPH01133879A JPH01133879A JP63263831A JP26383188A JPH01133879A JP H01133879 A JPH01133879 A JP H01133879A JP 63263831 A JP63263831 A JP 63263831A JP 26383188 A JP26383188 A JP 26383188A JP H01133879 A JPH01133879 A JP H01133879A
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Classifications
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B66—HOISTING; LIFTING; HAULING
- B66B—ELEVATORS; ESCALATORS OR MOVING WALKWAYS
- B66B1/00—Control systems of elevators in general
- B66B1/24—Control systems with regulation, i.e. with retroactive action, for influencing travelling speed, acceleration, or deceleration
- B66B1/2408—Control systems with regulation, i.e. with retroactive action, for influencing travelling speed, acceleration, or deceleration where the allocation of a call to an elevator car is of importance, i.e. by means of a supervisory or group controller
- B66B1/2458—For elevator systems with multiple shafts and a single car per shaft
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B66—HOISTING; LIFTING; HAULING
- B66B—ELEVATORS; ESCALATORS OR MOVING WALKWAYS
- B66B2201/00—Aspects of control systems of elevators
- B66B2201/10—Details with respect to the type of call input
- B66B2201/103—Destination call input before entering the elevator car
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B66—HOISTING; LIFTING; HAULING
- B66B—ELEVATORS; ESCALATORS OR MOVING WALKWAYS
- B66B2201/00—Aspects of control systems of elevators
- B66B2201/20—Details of the evaluation method for the allocation of a call to an elevator car
- B66B2201/211—Waiting time, i.e. response time
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B66—HOISTING; LIFTING; HAULING
- B66B—ELEVATORS; ESCALATORS OR MOVING WALKWAYS
- B66B2201/00—Aspects of control systems of elevators
- B66B2201/20—Details of the evaluation method for the allocation of a call to an elevator car
- B66B2201/222—Taking into account the number of passengers present in the elevator car to be allocated
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- Engineering & Computer Science (AREA)
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- Lift-Guide Devices, And Elevator Ropes And Cables (AREA)
- Electromagnets (AREA)
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- Maintenance And Inspection Apparatuses For Elevators (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、荷重に従属してケージを制御する装置を具備
したエレベータ用の群制御装置に係わり、この群制御装
置は各階に配置された、所望の目的階を指す指定の入力
に用いられ得る指定登録装置と、群を成す複数基のエレ
ベータに関連し、かつ前記指定登録装置と接続された２
種の指定メモリで、階で指定が入力されると該指定を入
力附を明示するものとして記憶する階指定メモリ並びに
階で指定が入力されると該指定を目的階を明示するもの
として記憶するケージ指定メモリと、エレベータ群のケ
ージ内に設置され、荷重メモリと有効に接続された荷重
測定装置と、エレベータ群の各エレベータに関連し、そ
の時々の停止可能階を指示するセレクタと、エレベータ
群の各エレベータに関連し、各階につき少なくとも１個
の位置を有する第一及び第二のスキャナと、入力された
指定をエレベータ群のケージに割り当てる装置とを有し
、その際指定を割り当てる前記装置は各エレベータ毎に
１個の計算デバイス並びに１個の比較装置を有し、計算
デバイスは第一のスキャナが指示する各階毎にエレベー
タ固有のデータから乗客の待ち時間に対応する応答コス
トを算出し、また割り当てメモリ並びに応答コストを記
憶するコストメモリが設置されており、第二のスキャナ
の各位置毎に全ケージの応答コストが比較装置によって
互いに比較され、最小の応答コストを有するケージに当
該指定が、割り当てメモリに割り当て指示を書き込むこ
とによって確定的に割り当てられる。
したエレベータ用の群制御装置に係わり、この群制御装
置は各階に配置された、所望の目的階を指す指定の入力
に用いられ得る指定登録装置と、群を成す複数基のエレ
ベータに関連し、かつ前記指定登録装置と接続された２
種の指定メモリで、階で指定が入力されると該指定を入
力附を明示するものとして記憶する階指定メモリ並びに
階で指定が入力されると該指定を目的階を明示するもの
として記憶するケージ指定メモリと、エレベータ群のケ
ージ内に設置され、荷重メモリと有効に接続された荷重
測定装置と、エレベータ群の各エレベータに関連し、そ
の時々の停止可能階を指示するセレクタと、エレベータ
群の各エレベータに関連し、各階につき少なくとも１個
の位置を有する第一及び第二のスキャナと、入力された
指定をエレベータ群のケージに割り当てる装置とを有し
、その際指定を割り当てる前記装置は各エレベータ毎に
１個の計算デバイス並びに１個の比較装置を有し、計算
デバイスは第一のスキャナが指示する各階毎にエレベー
タ固有のデータから乗客の待ち時間に対応する応答コス
トを算出し、また割り当てメモリ並びに応答コストを記
憶するコストメモリが設置されており、第二のスキャナ
の各位置毎に全ケージの応答コストが比較装置によって
互いに比較され、最小の応答コストを有するケージに当
該指定が、割り当てメモリに割り当て指示を書き込むこ
とによって確定的に割り当てられる。
上記のような群制御装置でヨーロッパ特許公開第０２４
６３９５号がら公知であるものでは、ケージの入力され
た指定に対する配分が時間的に最適化され得る。この群
制御装置の１基のエレベータに関連するケージ指定メモ
リは、割り当て済みのケージ指定を保有する第一のメモ
リと各階に関連するその他のメモリとがら成り、各階に
関連するメモリには当該階で入力された所望の目的階を
指す指定であって、未だケージに割り当てられていない
ものが記憶されている。入力された指定をエレベータ群
のケージに割り当てる装置は、マイクロプロセッサの形
態の計算デバイスと比較装置とを有する。計算デバイス
は、指定が登録されると直ちに走査装置の第一のスキャ
ナの１走査周期の間に各階に関して、少なくとも当該階
とセレクタが指示するケージ位置との間の距離、この距
離内で予期される中途停止並びに瞬間的なケージ荷重か
ら、階で待つ乗客並びにケージ内の乗客の時間損失に比
例する和を計算する。第一のスキャナが未だ割り当てら
れていない階指定を見いだした場合、当該階で入力され
、かつケージ指定メモリの階に関連するメモリに記憶さ
れた所望の目的階を指す指定が考慮に入れられなければ
ならない。従って、ケージ内の乗客の時間損失に比例す
る付加的な和が求められて、総和が算出される。応答コ
ストとも呼称されるこの総和がコストメモリに記憶され
る。その後直ちに続く走査装置の第二のスキャナの走査
周期の間に全エレベータの応答コストが比較装置によっ
て互いに比較され、その際その時々の最小応答コストを
有するエレベータの割り当てメモリに割り当て指示が記
憶され、この指示は当該ケージが時間的に最も好ましく
配分される階を指示する。
６３９５号がら公知であるものでは、ケージの入力され
た指定に対する配分が時間的に最適化され得る。この群
制御装置の１基のエレベータに関連するケージ指定メモ
リは、割り当て済みのケージ指定を保有する第一のメモ
リと各階に関連するその他のメモリとがら成り、各階に
関連するメモリには当該階で入力された所望の目的階を
指す指定であって、未だケージに割り当てられていない
ものが記憶されている。入力された指定をエレベータ群
のケージに割り当てる装置は、マイクロプロセッサの形
態の計算デバイスと比較装置とを有する。計算デバイス
は、指定が登録されると直ちに走査装置の第一のスキャ
ナの１走査周期の間に各階に関して、少なくとも当該階
とセレクタが指示するケージ位置との間の距離、この距
離内で予期される中途停止並びに瞬間的なケージ荷重か
ら、階で待つ乗客並びにケージ内の乗客の時間損失に比
例する和を計算する。第一のスキャナが未だ割り当てら
れていない階指定を見いだした場合、当該階で入力され
、かつケージ指定メモリの階に関連するメモリに記憶さ
れた所望の目的階を指す指定が考慮に入れられなければ
ならない。従って、ケージ内の乗客の時間損失に比例す
る付加的な和が求められて、総和が算出される。応答コ
ストとも呼称されるこの総和がコストメモリに記憶され
る。その後直ちに続く走査装置の第二のスキャナの走査
周期の間に全エレベータの応答コストが比較装置によっ
て互いに比較され、その際その時々の最小応答コストを
有するエレベータの割り当てメモリに割り当て指示が記
憶され、この指示は当該ケージが時間的に最も好ましく
配分される階を指示する。
上述の群制御装置では、入力された指定は実際上登録直
後にケージに割り当てられ得る。その結果、指定がどの
ケージに割り当てられたかを、階で待つ乗客の便宜を図
り適時に知らせる可能性が生じ、この可能性を実現する
べく上述のような制御装置は、初めにケージに割り当て
られた指定は当該エレベータの駆動制御装置によって受
は取られ、かつ処理されるまで当該ケージに割り当てら
れたままであるように変更され得る。応答コストの計算
と、従って将来応答されるべき指定の割り当てとは応答
時点に存在するケージ荷重に従属し、この荷重は上述の
群制御装置では、登録された所望の目的階を指す指定に
基づき有利に求められ得る。しかしその場合、指定を入
力していない乗客が乗り込み、その結果確定的に割り当
てられた指定に基づくその後の停止の際に更に乗り込ん
でくる乗客によってケージに過剰な荷重が付与される恐
れが有る。
後にケージに割り当てられ得る。その結果、指定がどの
ケージに割り当てられたかを、階で待つ乗客の便宜を図
り適時に知らせる可能性が生じ、この可能性を実現する
べく上述のような制御装置は、初めにケージに割り当て
られた指定は当該エレベータの駆動制御装置によって受
は取られ、かつ処理されるまで当該ケージに割り当てら
れたままであるように変更され得る。応答コストの計算
と、従って将来応答されるべき指定の割り当てとは応答
時点に存在するケージ荷重に従属し、この荷重は上述の
群制御装置では、登録された所望の目的階を指す指定に
基づき有利に求められ得る。しかしその場合、指定を入
力していない乗客が乗り込み、その結果確定的に割り当
てられた指定に基づくその後の停止の際に更に乗り込ん
でくる乗客によってケージに過剰な荷重が付与される恐
れが有る。
従って本発明は、冒頭に述べた群制御装置を、ケージに
確定的に割り当てられた指定は常に同じ当該ケージによ
って応答され、かつ当該階への停止時に荷重超過が生起
する恐れは無いように改良することを目的とする。
確定的に割り当てられた指定は常に同じ当該ケージによ
って応答され、かつ当該階への停止時に荷重超過が生起
する恐れは無いように改良することを目的とする。
この目的は、特許請求の範囲第１項にその特徴を記した
本発明によって達成される。本発明によれば、階に関連
する第一及び第二の回路が設置されており、これらの回
路はセレクタの各位置毎に能動化される。その際、各セ
レクタ位置に対応する階に関連する第一の回路は、当該
階に停止するとケージ内で荷重超過が起こる場合ケージ
が確定的に割り当てられた指定に応答しないように機能
する。その場合関連する第二の回路は、反対方向の指定
に関連する階及びケージ指定メモリのセレクタによる走
査がまず阻止され、その結果当該階を通過して運行の折
り返し点に到達したケージはその後中断熱く運行し続け
て、往路で無視した階に戻り、この階で入力された指定
に応答するように機能する。
本発明によって達成される。本発明によれば、階に関連
する第一及び第二の回路が設置されており、これらの回
路はセレクタの各位置毎に能動化される。その際、各セ
レクタ位置に対応する階に関連する第一の回路は、当該
階に停止するとケージ内で荷重超過が起こる場合ケージ
が確定的に割り当てられた指定に応答しないように機能
する。その場合関連する第二の回路は、反対方向の指定
に関連する階及びケージ指定メモリのセレクタによる走
査がまず阻止され、その結果当該階を通過して運行の折
り返し点に到達したケージはその後中断熱く運行し続け
て、往路で無視した階に戻り、この階で入力された指定
に応答するように機能する。
本発明によって得られる長所は、当該階における荷重超
過の予期せぬ生起により無視された割り当て済みの指定
に後がら応答することによって、指定のケージへの最初
の割り当てが確定的がっ最終的なものとなり得る点であ
る。無視された指定の入力術までの戻り運行は折り返し
点到達後間を置かず直ちに行なわれ、また当該階通過の
際に時間が節約されるので、大きい時間損失は生じない
。
過の予期せぬ生起により無視された割り当て済みの指定
に後がら応答することによって、指定のケージへの最初
の割り当てが確定的がっ最終的なものとなり得る点であ
る。無視された指定の入力術までの戻り運行は折り返し
点到達後間を置かず直ちに行なわれ、また当該階通過の
際に時間が節約されるので、大きい時間損失は生じない
。
本発明を、添付図面に示した具体例に基づき以下に詳述
する。
する。
第１図に、エレベータ群の２基のエレベータを記号＾及
びＢを付して示す。各エレベータ＾乃至Ｂにおいて、エ
レベータシャフト１内を案内されるケージ２は巻き上げ
機械３により巻き網４を介して駆動され、このケージ２
には１３個の階ＥＯ〜Ｅ１２において乗降が行なわれる
。巻き上げ機械３はヨーロッパ特許箱００２６４０６号
がら公知である駆動制御装置によって制御され、その際
目標値の発生、調整、／ 並びに停止の開始は、駆動制御装置の測定及び最終調整
要素６と接続されたマイクロコンピュータシステム５に
よって実現される。マイクロコンピュータシステム５は
またエレベータ固有のデータがら全乗客の平均待ち時間
に対応する和を計算し、この和は応答コストとも呼称さ
れ、指定の割り当ての基礎となる。ケージ２は、やはり
マイクロコンピュータシステム５と接続された荷重測定
装置７を有する。各階にはテンキーの形態の指定登録装
Ｗ８が設置されており、この装置８によって所望の目的
階までの運行を求める指定が入力され得る。
びＢを付して示す。各エレベータ＾乃至Ｂにおいて、エ
レベータシャフト１内を案内されるケージ２は巻き上げ
機械３により巻き網４を介して駆動され、このケージ２
には１３個の階ＥＯ〜Ｅ１２において乗降が行なわれる
。巻き上げ機械３はヨーロッパ特許箱００２６４０６号
がら公知である駆動制御装置によって制御され、その際
目標値の発生、調整、／ 並びに停止の開始は、駆動制御装置の測定及び最終調整
要素６と接続されたマイクロコンピュータシステム５に
よって実現される。マイクロコンピュータシステム５は
またエレベータ固有のデータがら全乗客の平均待ち時間
に対応する和を計算し、この和は応答コストとも呼称さ
れ、指定の割り当ての基礎となる。ケージ２は、やはり
マイクロコンピュータシステム５と接続された荷重測定
装置７を有する。各階にはテンキーの形態の指定登録装
Ｗ８が設置されており、この装置８によって所望の目的
階までの運行を求める指定が入力され得る。
指定登録装置８はアドレスバス＾Ｂ及びデータ入力ライ
ンＣＲＵＩＮを介して、マイクロコンピュータシステム
５並びにヨーロッパ特許箱００６２１４１号ニょって公
知である入力装置９に接続されている。指定登録装置８
はエレベータ群の２基以上のエレベータに関連し得、そ
の際例えばエレベータへの指定登針装置８が、マルチプ
レクサ１ｏの形態の接続要素を介してエレベータＢのマ
イクロコンピュータシステム５及び入力装置９と接続さ
れている。エレベータ群の個々のエレベータのマイクロ
コンピュータシステム５はヨーロッパ特許箱００５０３
０４号がら公知である比較装置１１並びにヨーロッパ特
許箱００５０３０５号から公知であるパーティライン転
送システム１２を介して互いに接続され、このようにし
て指定登録装置８及び入力装置９と共に群制御装置を構
成し、この装置は構造的に、ヨーロッパ特許公開第０２
４６３９５号に開示された群制御装置に一致する。荷重
メモリに符号１３を、才なケージ２内での荷重超過を調
べる第一の回路に符号１４を付す。第二の回路工５は、
荷重超過の故に無視された指定への後がらの応答を実現
する。荷重メモリ１３、第一の回路１４並びに第二の回
路１５は互いに接続され、かつマイクロコンピュータシ
ステム５とも接続されており、これらについては第２図
及び第３図に基づき後述する。
ンＣＲＵＩＮを介して、マイクロコンピュータシステム
５並びにヨーロッパ特許箱００６２１４１号ニょって公
知である入力装置９に接続されている。指定登録装置８
はエレベータ群の２基以上のエレベータに関連し得、そ
の際例えばエレベータへの指定登針装置８が、マルチプ
レクサ１ｏの形態の接続要素を介してエレベータＢのマ
イクロコンピュータシステム５及び入力装置９と接続さ
れている。エレベータ群の個々のエレベータのマイクロ
コンピュータシステム５はヨーロッパ特許箱００５０３
０４号がら公知である比較装置１１並びにヨーロッパ特
許箱００５０３０５号から公知であるパーティライン転
送システム１２を介して互いに接続され、このようにし
て指定登録装置８及び入力装置９と共に群制御装置を構
成し、この装置は構造的に、ヨーロッパ特許公開第０２
４６３９５号に開示された群制御装置に一致する。荷重
メモリに符号１３を、才なケージ２内での荷重超過を調
べる第一の回路に符号１４を付す。第二の回路工５は、
荷重超過の故に無視された指定への後がらの応答を実現
する。荷重メモリ１３、第一の回路１４並びに第二の回
路１５は互いに接続され、かつマイクロコンピュータシ
ステム５とも接続されており、これらについては第２図
及び第３図に基づき後述する。
第２図において一部を概略的に示したマイクロコンピュ
ータシステム５は、階指定メモリＲＡＭＩ、ケージ指定
メモリＲＡＭ２、コストメモリＲＡ１４４及び割り当て
メモリＲＡＭ５を有し、この図には上昇方向に関連する
メモリのみを示す。レジスタの形態である第一及び第二
のスキャナＲ１、Ｒ２並びにセレクタＲ３がアドレスを
発生し、これらのアドレスによってメモリＲＡＭＩ、Ｒ
ＡＭ２、ＲＡＭ４及びＲＡＭ５の記憶場所がアドレス指
定され得る。ケージ指定メモリＲＡＭ２は階の個数に対
応する個数の記憶場所を有する第一のメモリＲＡＭＰ’
を含み、このメモリＲＡＭ２ ’には割り当て済みの指
定が記憶されている。ケージ指定メモリＲＡＭ２は更に
、やはり階の個数に対応する個数の記憶場所を各々有す
る、階ＥＯ５Ｅ１、・・・・・・、Ｒ１２に関連するメ
モリＲＡＭ２．０、ＲＡＭ２．１、・・・・・・、ＲＡ
Ｍ２．１２も有し、これらのメモリＲＡＭ２．０、ＲＡ
Ｍ２ 、１、・・・・・・、ＲＡＭ２．．１２には当該
階で入力され、かつ未だ特定ケージに割り当てられてい
ない指定が転送される。即ち、第２図では例えば階Ｅ２
で入力された階Ｅ３、Ｒ９及びＥｌｌに関する指定がメ
モリＲＡＭ２．’２に転送され、その際同時に階指定メ
モリＲＡＭＩに階Ｅ２に関する指定が記憶される。通常
の論理記号論に対応して、記憶された指定を第２図にお
いて“１″で表す。
ータシステム５は、階指定メモリＲＡＭＩ、ケージ指定
メモリＲＡＭ２、コストメモリＲＡ１４４及び割り当て
メモリＲＡＭ５を有し、この図には上昇方向に関連する
メモリのみを示す。レジスタの形態である第一及び第二
のスキャナＲ１、Ｒ２並びにセレクタＲ３がアドレスを
発生し、これらのアドレスによってメモリＲＡＭＩ、Ｒ
ＡＭ２、ＲＡＭ４及びＲＡＭ５の記憶場所がアドレス指
定され得る。ケージ指定メモリＲＡＭ２は階の個数に対
応する個数の記憶場所を有する第一のメモリＲＡＭＰ’
を含み、このメモリＲＡＭ２ ’には割り当て済みの指
定が記憶されている。ケージ指定メモリＲＡＭ２は更に
、やはり階の個数に対応する個数の記憶場所を各々有す
る、階ＥＯ５Ｅ１、・・・・・・、Ｒ１２に関連するメ
モリＲＡＭ２．０、ＲＡＭ２．１、・・・・・・、ＲＡ
Ｍ２．１２も有し、これらのメモリＲＡＭ２．０、ＲＡ
Ｍ２ 、１、・・・・・・、ＲＡＭ２．．１２には当該
階で入力され、かつ未だ特定ケージに割り当てられてい
ない指定が転送される。即ち、第２図では例えば階Ｅ２
で入力された階Ｅ３、Ｒ９及びＥｌｌに関する指定がメ
モリＲＡＭ２．’２に転送され、その際同時に階指定メ
モリＲＡＭＩに階Ｅ２に関する指定が記憶される。通常
の論理記号論に対応して、記憶された指定を第２図にお
いて“１″で表す。
第２図によれば、荷重メモリ１３はマトリクスの形態の
書き込み−読み出しメモリから成り、マトリクスは階と
ちょうど同個数の行並びに３個の列Ｓ１、Ｓ２、Ｓ３を
有する。マトリクスの第一の列Ｓ１は運行方向において
ケージ２の前方に存在する同一方向指定に、第二の列Ｓ
２は反対方向指定に、また第三の列Ｓ３は運行方向にお
いてケージ２の後方に存在する同一方向指定に関連する
。荷重メモリ１３の記憶場所には荷重値が、階を出発あ
るいは通過する際にケージ２内に存在する人間の数の形
態で記憶されている。更に詳述するべく第２図に関して
、例えばケージ２は上昇中でかつ階Ｅ１の領域に有り、
また階Ｅ２、Ｒ３及びＲ５で上方指定が入力されたもの
とする。指定が階指定メモリＲＡＭＩ並びにメモリＲＡ
Ｍ２．２、ＲＡＭ２．３及びＲＡＭ２．５に転送された
後、階で入力された指定（乗る者）の数と該階を行き先
として指示する指定（降りる者）の数とから和が算出さ
れ、荷重値として荷重メモリ１３に記憶される。
書き込み−読み出しメモリから成り、マトリクスは階と
ちょうど同個数の行並びに３個の列Ｓ１、Ｓ２、Ｓ３を
有する。マトリクスの第一の列Ｓ１は運行方向において
ケージ２の前方に存在する同一方向指定に、第二の列Ｓ
２は反対方向指定に、また第三の列Ｓ３は運行方向にお
いてケージ２の後方に存在する同一方向指定に関連する
。荷重メモリ１３の記憶場所には荷重値が、階を出発あ
るいは通過する際にケージ２内に存在する人間の数の形
態で記憶されている。更に詳述するべく第２図に関して
、例えばケージ２は上昇中でかつ階Ｅ１の領域に有り、
また階Ｅ２、Ｒ３及びＲ５で上方指定が入力されたもの
とする。指定が階指定メモリＲＡＭＩ並びにメモリＲＡ
Ｍ２．２、ＲＡＭ２．３及びＲＡＭ２．５に転送された
後、階で入力された指定（乗る者）の数と該階を行き先
として指示する指定（降りる者）の数とから和が算出さ
れ、荷重値として荷重メモリ１３に記憶される。
従って、荷重メモリ１３の第一の列Ｓ１は、選択された
乗降者数に基づき第２図に示した荷重値を保有すること
になる。即ち、例えば階Ｅ２及びＲ３で５人ずつ乗り込
み、かつ階Ｅ３で１人降りるとすると、階Ｅ３に関して
荷重値は９°′となる。
乗降者数に基づき第２図に示した荷重値を保有すること
になる。即ち、例えば階Ｅ２及びＲ３で５人ずつ乗り込
み、かつ階Ｅ３で１人降りるとすると、階Ｅ３に関して
荷重値は９°′となる。
先に述べたように、荷重メモ１月３への書き込みの際、
入力された指定から将来の乗降者と、該乗降者によって
ケージ２内に発生する荷重とが推定される。しかし、乗
客が自身の指定を複数回入力したり、あるいはまた指定
を入力せずに乗り込んだりすることがあるかもしれない
。そのような場合、記憶された荷重値は補正されなけれ
ばならない。この補正のために、荷重メモリ１３はマイ
クロコンピュータシステム５を介してケージ２の荷重測
定装置７と接続されている（第１図）。上記前者の場合
は当該階で、入力された同一階を指す目的階指定が、記
憶された荷重値と実際に測定されたケージ荷重との差に
対応する個数だけ削除される。その後、入力階と複数回
入力された指定が指す目的階との間の総ての階の記憶さ
れた荷重値が補正される。後者の場合は記憶された荷重
値は増大されなければならず、その際指定を入力しなか
った乗客は既に他の乗客によって入力されていた指定が
指す目的階までの運行を希望することが前提とされる。
入力された指定から将来の乗降者と、該乗降者によって
ケージ２内に発生する荷重とが推定される。しかし、乗
客が自身の指定を複数回入力したり、あるいはまた指定
を入力せずに乗り込んだりすることがあるかもしれない
。そのような場合、記憶された荷重値は補正されなけれ
ばならない。この補正のために、荷重メモリ１３はマイ
クロコンピュータシステム５を介してケージ２の荷重測
定装置７と接続されている（第１図）。上記前者の場合
は当該階で、入力された同一階を指す目的階指定が、記
憶された荷重値と実際に測定されたケージ荷重との差に
対応する個数だけ削除される。その後、入力階と複数回
入力された指定が指す目的階との間の総ての階の記憶さ
れた荷重値が補正される。後者の場合は記憶された荷重
値は増大されなければならず、その際指定を入力しなか
った乗客は既に他の乗客によって入力されていた指定が
指す目的階までの運行を希望することが前提とされる。
複数種類の指定が入力されている場合は、指定を入力し
なかった乗客は最も遠い目的階までの運行を希望するも
のとされる。
なかった乗客は最も遠い目的階までの運行を希望するも
のとされる。
類似の形態においてヨーロッパ特許公開第０１９９０１
５号から公知である第一の回路１４は第２図によれば、
比較器１６と、２個の入力を有する第一のＡＮＤ素子１
７と、３個の入力を有する第二の＾ＮＤ素子１８と、Ｎ
ＯＴ素子１９とがら成る。比較器１６の一方の入力は荷
重メモリ１３と接続されており、またその他方の入力に
は、許容可能な最大乗客数に対応する荷重限界値り、、
、が付与される。出力側では、比較器１６は第二の回路
１５に接続され、かつＮＯＴ素子１９を介して第二のＡ
ＮＤ素子１８の第一の入力にも接続されている。第二の
へＮＤ素子１８の第二の入力は第一のＡＮＤ素子１７の
出力と接続されており、ＡＮＤ素子１７の２個の入力は
、階指定メモリＲＡＭ１及び割り当てメモリＲＡＭ５の
当該メモリセルの出力と接続されている。第二のへＮＤ
素子１８の第三の入力は、第二の回路１５を介してセレ
クタＲ３と接続されている。第二のへＮＤ素子１８の出
力は当該エレベータの駆動制御装置に接続されており、
その際ＡＮＤ条件が満たされるとそのことが当該階まで
の運行命令と解釈される。第一の回路１４はマイクロコ
ンピュータシステム５のマイクロプロセッサによって、
プログラムに基づきセレクタＲ３の各位置毎に当該階に
関して構成され得る。
５号から公知である第一の回路１４は第２図によれば、
比較器１６と、２個の入力を有する第一のＡＮＤ素子１
７と、３個の入力を有する第二の＾ＮＤ素子１８と、Ｎ
ＯＴ素子１９とがら成る。比較器１６の一方の入力は荷
重メモリ１３と接続されており、またその他方の入力に
は、許容可能な最大乗客数に対応する荷重限界値り、、
、が付与される。出力側では、比較器１６は第二の回路
１５に接続され、かつＮＯＴ素子１９を介して第二のＡ
ＮＤ素子１８の第一の入力にも接続されている。第二の
へＮＤ素子１８の第二の入力は第一のＡＮＤ素子１７の
出力と接続されており、ＡＮＤ素子１７の２個の入力は
、階指定メモリＲＡＭ１及び割り当てメモリＲＡＭ５の
当該メモリセルの出力と接続されている。第二のへＮＤ
素子１８の第三の入力は、第二の回路１５を介してセレ
クタＲ３と接続されている。第二のへＮＤ素子１８の出
力は当該エレベータの駆動制御装置に接続されており、
その際ＡＮＤ条件が満たされるとそのことが当該階まで
の運行命令と解釈される。第一の回路１４はマイクロコ
ンピュータシステム５のマイクロプロセッサによって、
プログラムに基づきセレクタＲ３の各位置毎に当該階に
関して構成され得る。
第３図では、階指定メモリＲＡＭＩ、割り当てメモリＲ
ＡＭ５並びにケージ指定メモリＲＡＮ２の第一のメモリ
ＲＡＭ２ ’を、上方指定のためのメモリの記号にはＵ
、下方指定のためのメモリの記号にはｄを付加して示す
。階指定メモリＲＡＭ１ｕ、 ＲＡＭ１ｄの各メモリセ
ルに第二の回路１５が関連し、この図には一例として、
階Ｅ５で入力された上方指定に関連する第二の回路１５
と、階Ｅ８で入力された下方指定に関連する第二の回路
１５とを示す。第３図によれば第二の回路１５は、各々
２個の入力を有する第一及び第二のＡＮＤ素子２０及び
２１と、３個の入力を有する第三のへＮＤ素子２２と、
２個の入力を有するＯＲ素子２３と、Ｒ−Ｓフリップフ
ロップ２４とから成る。第一のＡＮＤ素子２０は入力側
で一方の入力ａ′を介してセレクタＲ３と接続され、ま
た出力側ではＯＲ素子２３の一方の入力に接続されてお
り、ＯＲ素子２３の他方の入力は第二のＡＮＤ素子２１
の出力と接続されており、更にＯＲ素子２３の出力は、
第三のＡＮＤ素子２２の第一の入力並びに第一の回路１
４の第二のＡＮＤ素子１８の第三の入力に接続されてい
る。第三のＡＮＤ素子２２はその第二の入力を介して第
一の回路１４の比較器１６の出力と、またその第三の入
力を介して第一の回路１４の第一のＡＮＤ素子１７の出
力と接続されている。第三のＡＮＤ素子２２は出力側で
は、Ｒ−Ｓフリップフロ・ツブ２４のセ・ット端子Ｓに
接続されている。第一のＡＮＤ素子２０の他方の入力は
、反対方向に関連する第二の回路１５のＲ−Ｓフリップ
フロップ２４の一方の出力Ｑと接続されている。Ｒ−Ｓ
フリップフロップ２４の一方の出力Ｑは反対方向に関連
する第二の回路１５の第一のＡＮＤ素子２０の他方の入
力に接続されており、またその他方の出力Ｑは第二のへ
ＮＤ素子２１の一方の入力に接続されている。第二のＡ
ＮＤ素子２１の他方の入力は、同一階の反対方向に関連
する第二の回路１５の第一の＾ＮＤ素子２０の一方の入
力ａ′と接続されている。
ＡＭ５並びにケージ指定メモリＲＡＮ２の第一のメモリ
ＲＡＭ２ ’を、上方指定のためのメモリの記号にはＵ
、下方指定のためのメモリの記号にはｄを付加して示す
。階指定メモリＲＡＭ１ｕ、 ＲＡＭ１ｄの各メモリセ
ルに第二の回路１５が関連し、この図には一例として、
階Ｅ５で入力された上方指定に関連する第二の回路１５
と、階Ｅ８で入力された下方指定に関連する第二の回路
１５とを示す。第３図によれば第二の回路１５は、各々
２個の入力を有する第一及び第二のＡＮＤ素子２０及び
２１と、３個の入力を有する第三のへＮＤ素子２２と、
２個の入力を有するＯＲ素子２３と、Ｒ−Ｓフリップフ
ロップ２４とから成る。第一のＡＮＤ素子２０は入力側
で一方の入力ａ′を介してセレクタＲ３と接続され、ま
た出力側ではＯＲ素子２３の一方の入力に接続されてお
り、ＯＲ素子２３の他方の入力は第二のＡＮＤ素子２１
の出力と接続されており、更にＯＲ素子２３の出力は、
第三のＡＮＤ素子２２の第一の入力並びに第一の回路１
４の第二のＡＮＤ素子１８の第三の入力に接続されてい
る。第三のＡＮＤ素子２２はその第二の入力を介して第
一の回路１４の比較器１６の出力と、またその第三の入
力を介して第一の回路１４の第一のＡＮＤ素子１７の出
力と接続されている。第三のＡＮＤ素子２２は出力側で
は、Ｒ−Ｓフリップフロ・ツブ２４のセ・ット端子Ｓに
接続されている。第一のＡＮＤ素子２０の他方の入力は
、反対方向に関連する第二の回路１５のＲ−Ｓフリップ
フロップ２４の一方の出力Ｑと接続されている。Ｒ−Ｓ
フリップフロップ２４の一方の出力Ｑは反対方向に関連
する第二の回路１５の第一のＡＮＤ素子２０の他方の入
力に接続されており、またその他方の出力Ｑは第二のへ
ＮＤ素子２１の一方の入力に接続されている。第二のＡ
ＮＤ素子２１の他方の入力は、同一階の反対方向に関連
する第二の回路１５の第一の＾ＮＤ素子２０の一方の入
力ａ′と接続されている。
符号２５によって、各々２個の入力を有する更に別のＡ
ＮＤ素子を示す。これらのＡＮＤ素子２５の一方の入力
はケージ指定メモリの第一のメモリＲＡＭ２’ｕ、ＲＡ
Ｍ２’ｄのメモリセルの出力と接続されており、またそ
の他方の入力は当該メモリセルに対応する階の第二の回
路１５のＯＲ素子２３の出力と接続されている。ＡＮＤ
素子２５の出力は駆動制御装置に接続されており、その
際ＡＮＤ条件が満たされるとそのことが当該階までの運
行命令と解釈される。第３図に基づいて説明した論理回
路はマイクロコンピュータシステム５のマイクロプロセ
ッサによって、プログラムに基づきセレクタＲ３の各位
置毎に当該階に関して構成され得る。
ＮＤ素子を示す。これらのＡＮＤ素子２５の一方の入力
はケージ指定メモリの第一のメモリＲＡＭ２’ｕ、ＲＡ
Ｍ２’ｄのメモリセルの出力と接続されており、またそ
の他方の入力は当該メモリセルに対応する階の第二の回
路１５のＯＲ素子２３の出力と接続されている。ＡＮＤ
素子２５の出力は駆動制御装置に接続されており、その
際ＡＮＤ条件が満たされるとそのことが当該階までの運
行命令と解釈される。第３図に基づいて説明した論理回
路はマイクロコンピュータシステム５のマイクロプロセ
ッサによって、プログラムに基づきセレクタＲ３の各位
置毎に当該階に関して構成され得る。
上述の群制御装置の機能方法を、第２図及び第３図に基
づき以下に詳述する。
づき以下に詳述する。
先に述べたヨーロッパ特許公開第０２４６３９５号の場
合と同様に、指定が入力されるとエレベータ群の全エレ
ベータに関して、荷重メモリ１３に記憶された荷重値を
用いて応答コスト計算が開始され、この計算は第一のス
キャナＲ１が指示する各階毎に実行される。計算された
応答コストは階毎にコストメモリＲＡＭ４に記憶される
。やはり上記ヨーロッパ特許公開から公知であるように
、コスト計算周期が終了するとコスト比較周期が開始さ
れる。この周期において、第二のスキャナＲ２が指示す
る各階に関し全エレベータのコストメモリＲＡＭ４に記
憶された応答コストが互いに比較され、最小の応答コス
トを有するケージに当該指定が割り当てられる。
合と同様に、指定が入力されるとエレベータ群の全エレ
ベータに関して、荷重メモリ１３に記憶された荷重値を
用いて応答コスト計算が開始され、この計算は第一のス
キャナＲ１が指示する各階毎に実行される。計算された
応答コストは階毎にコストメモリＲＡＭ４に記憶される
。やはり上記ヨーロッパ特許公開から公知であるように
、コスト計算周期が終了するとコスト比較周期が開始さ
れる。この周期において、第二のスキャナＲ２が指示す
る各階に関し全エレベータのコストメモリＲＡＭ４に記
憶された応答コストが互いに比較され、最小の応答コス
トを有するケージに当該指定が割り当てられる。
今、指定入力後最初の比較の際に階Ｅ２、Ｅ３及びＥ５
で入力された上方指定がエレベータ＾に割り当てられ、
その際メモリＲＡＭ２．２、ＲＡＭ２．３及びＲＡＭ２
．５に記憶された上記指定はケージ指定メモリＲＡＭ２
の第一のメモリＲＡＭ２ ’へ転送され、指定の割り当
ては確定的かつ最終的なものであるものとする。更に、
ケージ２は最大荷重り、、、＝１２人として設計されて
いるものとし、またエレベータへのケージ２が階Ｅ３に
停止した際に１人の乗客が指定を入力せずに乗り込むも
のとする。先に述べたように、この場合荷重メモリ１３
の内容は補正され、その際階Ｅ３〜ＥＩＯの荷重値が１
だけ増大される。上昇が継続され、セレクタＲ３が階Ｅ
５のアドレスに切り替わると関連する第一の回路１４が
能動化され、その際荷重値Ｌ；１３人が確認され、比較
器１６はＬ＞Ｌ、。。であるので論理信号ＩＩ Ｉ Ｉ
＋を発生する。この時、ＮＯＴ素子１９が設置されてい
るため第二のＡＮＤ素子１８の第一の入力と、従って該
ＡＮＤ素子１８の出力とは論理状態“０″となり、その
結果階Ｅ５から入力された割り当て済みの指定は駆動制
御装置に付与され得ず、ケージ２はこの階Ｅ５を通過す
る。
で入力された上方指定がエレベータ＾に割り当てられ、
その際メモリＲＡＭ２．２、ＲＡＭ２．３及びＲＡＭ２
．５に記憶された上記指定はケージ指定メモリＲＡＭ２
の第一のメモリＲＡＭ２ ’へ転送され、指定の割り当
ては確定的かつ最終的なものであるものとする。更に、
ケージ２は最大荷重り、、、＝１２人として設計されて
いるものとし、またエレベータへのケージ２が階Ｅ３に
停止した際に１人の乗客が指定を入力せずに乗り込むも
のとする。先に述べたように、この場合荷重メモリ１３
の内容は補正され、その際階Ｅ３〜ＥＩＯの荷重値が１
だけ増大される。上昇が継続され、セレクタＲ３が階Ｅ
５のアドレスに切り替わると関連する第一の回路１４が
能動化され、その際荷重値Ｌ；１３人が確認され、比較
器１６はＬ＞Ｌ、。。であるので論理信号ＩＩ Ｉ Ｉ
＋を発生する。この時、ＮＯＴ素子１９が設置されてい
るため第二のＡＮＤ素子１８の第一の入力と、従って該
ＡＮＤ素子１８の出力とは論理状態“０″となり、その
結果階Ｅ５から入力された割り当て済みの指定は駆動制
御装置に付与され得ず、ケージ２はこの階Ｅ５を通過す
る。
回路１４．１５は、セレクタＲ３の発生するアドレスに
より上昇及び下降方向で連続的に能動化される。
より上昇及び下降方向で連続的に能動化される。
その場合、アドレスが当該階に関連するものどなる度に
第二の回路１５の第一の＾ＮＤ素子２０の一方の入力ａ
′が状態パ１′′とされる。従って、階Ｅ５の上昇方向
での走査の際当該ＡＮＤ素子２０の一方の入力ａ′は状
態゛１″′を有し、その際、他方の入力は反対方向に関
連する第二の回路１５のＲ−Ｓフリップフロップ２４が
セットされないためやはり“′１′″であるものとする
。それによって、ＯＲ素子２３の出力並びに第三のＡＮ
Ｄ素子２２の３個の入力の総てが状態“１′′を有し、
その結果当該Ｒ−Ｓフリップフロップ２４がセットされ
て、無視された指定が記憶される。
第二の回路１５の第一の＾ＮＤ素子２０の一方の入力ａ
′が状態パ１′′とされる。従って、階Ｅ５の上昇方向
での走査の際当該ＡＮＤ素子２０の一方の入力ａ′は状
態゛１″′を有し、その際、他方の入力は反対方向に関
連する第二の回路１５のＲ−Ｓフリップフロップ２４が
セットされないためやはり“′１′″であるものとする
。それによって、ＯＲ素子２３の出力並びに第三のＡＮ
Ｄ素子２２の３個の入力の総てが状態“１′′を有し、
その結果当該Ｒ−Ｓフリップフロップ２４がセットされ
て、無視された指定が記憶される。
その際下降方向に関連する第二の回路１５の第一のＡＮ
Ｄ素子２０の他方の入力が”ｏ”とされるので、無視さ
れた指定が記憶されている間下方指定のためのメモリの
走査が阻止される。
Ｄ素子２０の他方の入力が”ｏ”とされるので、無視さ
れた指定が記憶されている間下方指定のためのメモリの
走査が阻止される。
今、階Ｅ８で階Ｅ６までの運行を求める指定が入力され
たものとする。従ってケージ２は、上昇方向で最後の指
定に応答しく階Ｅ１１）、かつ荷重測定装置７によって
ゼロ荷重が確認された後下方へ移動される。下降の際、
セレクタＲ３は下方指定のための階指定メモリＲＡＭ１
ｄ及び第一のメモリＲＡＭ２’ｄを走査し、その時々の
セレクタ走査位置に対応する階の下降方向に関連する第
二の回路１５の第一の＾ＮＤ素子２０の一方の入力ａ′
が状態゛１°′とされる。
たものとする。従ってケージ２は、上昇方向で最後の指
定に応答しく階Ｅ１１）、かつ荷重測定装置７によって
ゼロ荷重が確認された後下方へ移動される。下降の際、
セレクタＲ３は下方指定のための階指定メモリＲＡＭ１
ｄ及び第一のメモリＲＡＭ２’ｄを走査し、その時々の
セレクタ走査位置に対応する階の下降方向に関連する第
二の回路１５の第一の＾ＮＤ素子２０の一方の入力ａ′
が状態゛１°′とされる。
しかしそれによって、先に述べたことから明らかなよう
に、ＯＲ素子２３の出力は１″とされ得ず、従ってその
時々の関連する第一の回路１４の第二のＡＮＤ素子１８
の第三の入力は状態“０″に留まり、その結果階Ｅ８及
びＥ６に関する指定は無視される。下降の間、上昇方向
に関連する第一の＾ＮＤ素子２０の入力ａ′は状態゛０
”である。従って、ＡＮＤ素子２０の出力、並びに当面
はＯＲ素子２３の出力もやはり状態“０”を有し、その
結果上昇方向に関連する第二の回路１５は能動化され得
ない。従ってケージ２は、階Ｅ５で入力されて第一のメ
モリＲＡＭ２’ｕに記憶された、階Ｅ７及びＥ９までの
運行を求める指定には応答しない。
に、ＯＲ素子２３の出力は１″とされ得ず、従ってその
時々の関連する第一の回路１４の第二のＡＮＤ素子１８
の第三の入力は状態“０″に留まり、その結果階Ｅ８及
びＥ６に関する指定は無視される。下降の間、上昇方向
に関連する第一の＾ＮＤ素子２０の入力ａ′は状態゛０
”である。従って、ＡＮＤ素子２０の出力、並びに当面
はＯＲ素子２３の出力もやはり状態“０”を有し、その
結果上昇方向に関連する第二の回路１５は能動化され得
ない。従ってケージ２は、階Ｅ５で入力されて第一のメ
モリＲＡＭ２’ｕに記憶された、階Ｅ７及びＥ９までの
運行を求める指定には応答しない。
下方への運行が継続されるうちにセレクタＲ３が階Ｅ５
のアドレスに切り替わり、それによって第二のＡＮＤ素
子２１の出力と、従ってＯＲ素子２３の出力とが” １
”となる。ケージ２は空であるので、第一の回路１４
のＮＯＴ素子１９の出力と、従って第二のＡＮＤ素子１
８の出力とは状態″１°′を有し、その結果駆動制御装
置は減速を開始し得、ケージ２は階Ｅ５に停止する。待
っていた乗客が乗り込むとケージ２は上方へ運行して階
Ｅ７及びＥ９に達し、最後の乗客が階Ｅｌｌで降りた後
は、ｌ！ｌＥ８で指定が入力されているので再び下降す
る。階Ｅ５への停止後関連するＲ−Ｓフリップフロップ
２４がリセットされ、該フリップフロップ２４の一方の
出力Ｑと、従って下降方向に関連する第二の回路１５の
第一の八Ｎｌ）素子２０の他方の入力とが状態°“１ｎ
となったので、第二の回路１５は再びセレクタＲ３の発
生するアドレスによって能動化され得る。セレクタＲ３
が階Ｅ８のアドレスに切り替わり、ａ’−１であると、
第一のへＮＤ素子２０、ＯＲ素子２３並びに第二のＡＮ
Ｄ素子１８の出力が′１′′となり、その結果減速が開
始され、ケージ２は階Ｅ８に停止する。
のアドレスに切り替わり、それによって第二のＡＮＤ素
子２１の出力と、従ってＯＲ素子２３の出力とが” １
”となる。ケージ２は空であるので、第一の回路１４
のＮＯＴ素子１９の出力と、従って第二のＡＮＤ素子１
８の出力とは状態″１°′を有し、その結果駆動制御装
置は減速を開始し得、ケージ２は階Ｅ５に停止する。待
っていた乗客が乗り込むとケージ２は上方へ運行して階
Ｅ７及びＥ９に達し、最後の乗客が階Ｅｌｌで降りた後
は、ｌ！ｌＥ８で指定が入力されているので再び下降す
る。階Ｅ５への停止後関連するＲ−Ｓフリップフロップ
２４がリセットされ、該フリップフロップ２４の一方の
出力Ｑと、従って下降方向に関連する第二の回路１５の
第一の八Ｎｌ）素子２０の他方の入力とが状態°“１ｎ
となったので、第二の回路１５は再びセレクタＲ３の発
生するアドレスによって能動化され得る。セレクタＲ３
が階Ｅ８のアドレスに切り替わり、ａ’−１であると、
第一のへＮＤ素子２０、ＯＲ素子２３並びに第二のＡＮ
Ｄ素子１８の出力が′１′′となり、その結果減速が開
始され、ケージ２は階Ｅ８に停止する。
第１図はエレベータ群の２基のエレベータのための本発
明による群制御装置の概略的説明図、第２図は第１図の
群制御装置の、１基のエレベータに関連する荷重メモリ
並びに第一の回路の概略的説明図、第３図は第１図の群
制御装置の、１基のエレベータに関連する２個の第二の
回路の概略的説明図である。 ２・・・・・・ケージ、７・・・・・・荷重測定装置、
８・・・・・・指定登録装置、１１・・・・・・比較装
置、１３・・・・・・荷重メモリ、１４・・・・・・第
一の回路、１５・・・・・・第二の回路。
明による群制御装置の概略的説明図、第２図は第１図の
群制御装置の、１基のエレベータに関連する荷重メモリ
並びに第一の回路の概略的説明図、第３図は第１図の群
制御装置の、１基のエレベータに関連する２個の第二の
回路の概略的説明図である。 ２・・・・・・ケージ、７・・・・・・荷重測定装置、
８・・・・・・指定登録装置、１１・・・・・・比較装
置、１３・・・・・・荷重メモリ、１４・・・・・・第
一の回路、１５・・・・・・第二の回路。
Claims (3)
- （１）荷重に従属してケージを制御する装置を具備した
エレベータ用の群制御装置であって、各階に配置された
、所望の目的階を指す指定の入力に用いられ得る指定登
録装置と、群を成す複数基のエレベータに関連し、かつ
前記指定登録装置と接続された２種の指定メモリで、階
で指定が入力されると該指定を入力階を明示するものと
して記憶する階指定メモリ並びに階で指定が入力される
と該指定を目的階を明示するものとして記憶するケージ
指定メモリと、エレベータ群のケージ内に設置され、荷
重メモリと有効に接続された荷重測定装置と、エレベー
タ群の各エレベータに関連し、その時々の停止可能階を
指示するセレクタと、エレベータ群の各エレベータに関
連し、各階につき少なくとも１個の位置を有する第一及
び第二のスキャナと、入力された指定をエレベータ群の
ケージに割り当てる装置とを有し、その際指定を割り当
てる前記装置は各エレベータ毎に１個の計算デバイス並
びに１個の比較装置を有し、計算デバイスは第一のスキ
ャナが指示する各階毎にエレベータ固有のデータから乗
客の待ち時間に対応する応答コストを算出し、また割り
当てメモリ並びに応答コストを記憶するコストメモリが
設置されており、第二のスキャナの各位置毎に全ケージ
の応答コストが比較装置によって互いに比較され、最小
の応答コストを有するケージに当該指定が、割り当てメ
モリに割り当て指示を書き込むことによって確定的に割
り当てられ、 一階に関連する第一の回路が設置されており、この回路
はセレクタ、荷重メモリ、割り当てメモリ及び階指定メ
モリと接続されており、 −第一の回路はセレクタの各位置毎に能動化され、その
際ケージはそれ自体公知であるように、当該階に停止す
るとケージ内で荷重超過が起こる場合は確定的に割り当
てられた指定に応答せず、一階に関連する第二の回路が
設置されており、この回路はセレクタ並びに第一の回路
と接続されており、 −上昇方向に関連する第二の回路と下降方向に関連する
第二の回路とは互いに接続されており、−第二の回路は
セレクタの各位置毎に能動化され、その際ケージは、当
該階を通過して運行の折り返し点に到達後中断無く運行
し続けて当該階に戻り、この階で入力された指定に応答
する ことを特徴とするエレベータ用群制御装置。 - （２）第一の回路が比較器と、２個の入力を有する第一
のＡＮＤ素子と、３個の入力を有する第二のＡＮＤ素子
とから成り、その際第一のＡＮＤ素子は入力側では階指
定メモリ及び割り当てメモリの当該メモリセルの出力と
接続され、出力側では第二のＡＮＤ素子の第二の入力に
接続されており、第二のＡＮＤ素子の第三の入力はセレ
クタと接続されており、更に比較器は一方の入力を介し
て荷重メモリと接続されており、また該比較器の他方の
入力には荷重限界値が付与され、 ＮＯＴ素子が設置されており、比較器の出力は第二の回
路に接続されると共にこのＮＯＴ素子の入力に接続され
ており、ＮＯＴ素子の出力は第二のΛＮＤ素子の第一の
入力に接続されている ことを特徴とする請求項１に記載の装置。 - （３）−第二の回路が各々２個の入力を有する第一及び
第二のＡＮＤ素子と、３個の入力を有する第三のＡＮＤ
素子と、２個の入力を有するＯＲ素子と、Ｒ−Ｓフリッ
プフロップとから成り、 −第一のＡＮＤ素子は入力側では一方の入力を介してセ
レクタと接続され、出力側ではＯＲ素子の一方の入力に
接続されており、その際ＯＲ素子の他方の入力は第二の
ＡＮＤ素子の出力と接続され、またその出力は第三のＡ
ＮＤ素子の第一の入力並びに第一の回路の第二のＡＮＤ
素子の第三の入力に接続されており、 −第三のＡＮＤ素子は第二の入力を介して比較器の出力
と接続され、かつ第三の入力を介して第一の回路の第一
のＡＮＤ素子の出力と接続されており、また出力側では
Ｒ−Ｓフリップフロップのセット端子に接続されており
、 −Ｒ−Ｓフリップフロップの一方の出力は同一階の反対
方向に関連する第二の回路の第一のＡＮＤ素子の他方の
入力に接続されており、Ｒ−Ｓフリップフロップの他方
の出力は第二のＡＮＤ素子の一方の入力に接続されてお
り、第二のＡＮＤ素子の他方の入力は同一階の反対方向
に関連する第二の回路の第一のＡＮＤ素子の一方の入力
と接続されており、 −未だ応答されない割り当て済みの指定に関連する第二
の回路の能動化の際当該Ｒ−Ｓフリップフロップがセッ
トされ、それによって反対方向に関連する階及びケージ
指定メモリはセレクタにより走査され得ず、従って反対
方向への戻り運行の際には未だ応答されない割り当て済
みの指定に関連する第二の回路が専ら能動化され、関連
する第一の回路の第二のＡＮＤ素子の出力に当該階まで
の運行命令が出現する ことを特徴とする請求項２に記載の装置。
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