JPH01108734A - 半導体装置 - Google Patents

半導体装置

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JPH01108734A
JPH01108734A JP62266964A JP26696487A JPH01108734A JP H01108734 A JPH01108734 A JP H01108734A JP 62266964 A JP62266964 A JP 62266964A JP 26696487 A JP26696487 A JP 26696487A JP H01108734 A JPH01108734 A JP H01108734A
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JP
Japan
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wiring board
chip
printed wiring
board
deterioration
Prior art date
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Pending
Application number
JP62266964A
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English (en)
Inventor
Takayoshi Togawa
外川 崇芳
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Toshiba Components Co Ltd
Original Assignee
Toshiba Components Co Ltd
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Publication date
Application filed by Toshiba Components Co Ltd filed Critical Toshiba Components Co Ltd
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Publication of JPH01108734A publication Critical patent/JPH01108734A/ja
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    • H01L2924/15312Connection portion the connection portion being formed only on the surface of the substrate opposite to the die mounting surface being a pin array, e.g. PGA

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  • Wire Bonding (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [産業上の利用分野] 本発明は半導体装置に関し、特に半導体用ステムに配線
用印刷配線板を固着させた半導体装置に係わる。
[従来の技術] 従来、半導体装置としては、第3図及び第4図に示すも
のが知られている。ここで、第3因は従来の半導体装置
の概略を示す斜視図、第4図は第3図の部分拡大断面図
である。
図中の1は、上下に貫通する開口部2を有する金属ベー
スである。この金属ベース1の開口部2には、ピン挿入
用の貫通孔を有した絶縁体3が充填されている。前記金
属ベース1上には、表面に配線パターン4aが形成され
た環状の印刷配線板4が設けられている。この配線板4
の中央部(開口部)には、図示しないチップが設けられ
ている。
このチップの周Illには、該チップ表面に設けられた
パッド部(図示せず)に接続されたワイヤ溶着用の端子
が設けられている。前記金属ベース1及び配線板4には
、ピン5が金属ベース1の開口部2に充填された絶縁体
3を貫通ししかも前記配線板4の表面から露出するよう
に設けられている。
前記ピン5の頂面及びその周辺には、半田等の口ウ材I
6が被覆されている。このOつ材l16は前記配線パタ
ーン4aの一端に接続され、該配線パターン4aの他端
と前記チップ周辺の端子とはボンディングワイヤ(図示
せず)によって接続されている。
[発明が解決しようとする問題点] しかしながら、従来の半導体装置によれば、金属ベース
1及び印刷配線板4を貫通するピン5の頂面及びその周
辺を半田等のロウ材層6により被覆する構造となってい
るため、ロウ材層6の中に含まれているフラックスやガ
スがワイヤ固着部に流れ出し、ワイヤ固着部の機械的強
度の劣化、電気的特性の劣化、熱的安定性の劣化などの
原因となる。
本発明は上記事情に鑑みてなされたもので、ロウ材層中
に含まれるフラックスやガスがチップ周辺の端子部に流
出するのを防止し、ワイヤ固着部の機械的強度の劣化や
電気的特性の劣化、熱的安定性の劣化等を回避し得る半
導体装置を提供することを目的とする。
【問題点を解決するための手段と作用〕本発明は、金属
ベースと、この金属ベース内に設けられたピン゛挿入用
の絶縁性筒体と、前記金属ベース上に設けられた環状の
印刷配線板と、この印刷配線板の開口部に配置され周辺
に溶着用の端子を有したチップと、前記金属ベース及び
印刷配線板に該印刷配線板表面に露出するように貫通し
て設けられたピンと、これらピンを覆うロウ材層と、こ
れらロウ材層と前記チップ周辺の端子を接続するボンデ
ィングワイヤと、前記印刷配線板上でかつ該印刷配線板
の開口部と前記ロウ材1IllIlに設けられた環状の
堤とを具備することを要旨とする。
本発明に係る環状の堤は、例えば印刷配線板の形成に用
いられるレジストなどを用いてもよい。
本発明によれば、印刷配線板の開口部と前記ロウ材層部
に環状の堤を設けることにより、ロウ材層中に含まれる
フラックスやガスがワイヤ固着部に流出するのを防止し
、もってワイヤ固着部の機械的強度の劣化や電気特性の
劣化、熱的安定性の劣化などを回避出来る。
[実施例] 以下、本発明の一実施例を第1図及び第2図を参照して
説明する。ここで、第1図は本発明に係る半導体装置の
平面図、第21は第1図のx−X線に沿う断面図である
図中の11は、上下に貫通する開口部12を有する金属
ベースである。この金属ベース11の開口部12には、
ピン挿入用の貫通孔を有した絶縁体13が充填されてい
る。前記金属ベース11上には、表面に配線パターン1
4aが形成された環状の印−配線板14が設けられてい
る。この配線板14の中央部(開口部)には、チップ1
5が設けられている。このチップ15の周辺には、該チ
ップ15表面に設けられたパッド部(図示せず)と接続
するワイヤ溶着用の端子16が設けられている。前記金
属ベース11及び配線板14には、ピン17が金属ベー
ス11の開口部12に充填された絶縁体13を貫通しし
かも前記配線板14の表面から露出するように設けられ
ている。前記ピン17の馬面及びその周辺には、半田等
のロウ材層18が被覆されている。このロウ材層18は
前記配線パターン14aの一端に接続され、該配線パタ
ーン14aの他端と前記チップ周辺の端子16とはボン
ディングワイヤ19によって接続されている。前記印刷
配線板14の開口部14aと前記ロウ材層18mの前記
印刷配線板14上には、例えばレジストからなる環状の
堤20が設けられている。かかる堤20は、例えば印刷
配線板14上にレジスト膜を作った後に一度に形成され
る。
しかして、上記実施例に係る半導体装置によれば、前記
印刷配線板14の開口部14aと前記ロウ材層18mの
前記印刷配線板14上に、例えばレジストからなる環状
の堤20を設けた構造となっているため、堤20により
ロウ材層18の溶融時に発生するフラックスや酸化物の
ガスの流れが前記ワイヤ固着部Aに流れるのを阻止でき
る。従って、ワイヤ固着部の機械的強度の劣化、電気的
特性の劣化及び熱的安定性の劣化等を防止でき、良好な
ワイヤポンディング性を保持し得る。
なお、上記実施例では、堤をレジストにより形成した場
合について述べたが、これに限定されず、フィルム、テ
ープなどの絶縁物を用いてもよい。
「発明の効果」 以上詳述した如く本発明によれば、ロウ材層の溶融時に
発生するフラックスや酸化物のガスがワイヤ固着部に流
れるのを阻止し、もってワイヤ固着部の機械的強度の劣
化、電気的特性の劣化及び熱的安定性の劣化等を防止し
得る半導体装置を提供できる。
【図面の簡単な説明】
第1図は本発明の一実施例に係る半導体装置の平面図、
第2図は第1図のx−X線に沿う断面図、第3図は従来
の半導体装置の概略を示す斜視図、第4図は第3図の部
分拡大断面図である。 11・・・金属ベース、12・・・開口部゛、13−・
・絶縁体、14・・・印刷配線板、14a・・・配線パ
ターン、15・・・チップ、ia−・・端子、17−・
・リード、18・・・ロウ材層、19・・・ボンディン
グワイヤ、20−・・堤。 111図 第2図

Claims (1)

    【特許請求の範囲】
  1.  金属ベースと、この金属ベース内に設けられたピン挿
    入用の絶縁性筒体と、前記金属ベース上に設けられた環
    状の印刷配線板と、この印刷配線板の開口部に配置され
    周辺に溶着用の端子を有したチップと、前記金属ベース
    及び印刷配線板に該印刷配線板表面に露出するように貫
    通して設けられたピンと、これらピンを覆うロウ材層と
    、これらロウ材層と前記チップ周辺の端子を接続するボ
    ンディングワイヤと、前記印刷配線板上でかつ該印刷配
    線板の関口部と前記ロウ材層間に設けられた環状の堤と
    を具備することを特徴とする半導体装置。
JP62266964A 1987-10-22 1987-10-22 半導体装置 Pending JPH01108734A (ja)

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5923956A (en) * 1996-01-30 1999-07-13 Nec Corporation Method of securing a semiconductor chip on a base plate and structure thereof
US7309916B2 (en) 2004-07-14 2007-12-18 Samsung Electronics Co., Ltd. Semiconductor package and method for its manufacture

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6144837B2 (ja) * 1980-10-29 1986-10-04 Mitsubishi Kakoki Kk

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