JP5403592B2 - 電流駆動回路 - Google Patents
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Description
また、特許文献2に記載された技術では、オペアンプを使用しているため、消費電力が
大きくなってしまうという問題がある。更に、この文献に記載された回路においても、トランジスタが2段に直列接続されているため、ドレイン端子電圧を低くすることができない。
本発明は、上記の問題点を解決するためになされたものであり、ESD抵抗のように、大きな抵抗を用いる場合にも低い出力電圧において電流を確保することができる電流駆動回路を提供することにある。
また、本発明は、前記第1トランジスタのソース端子及びドレイン端子に並列に接続された抵抗を更に設けたことを要旨とする。これにより、第1トランジスタの動作による電流値の変化を調整することができる。
まず、電流駆動回路10の回路構成を説明する。
電流駆動回路10の出力端子には、抵抗R3が接続されている。この抵抗R3はESD抵抗として機能する。
電源線には、参照電流としての電流I1を供給する電流源CS1(第1電流源)が接続されている。この電流源CS1は、トランジスタM4のゲート端子、トランジスタM3のドレイン端子、トランジスタM1のドレイン端子、抵抗R1に接続される。本実施形態では、このトランジスタM1は第1トランジスタとして機能し、トランジスタM3は第3トランジスタとして機能し、それぞれN型MOSトランジスタを用いて構成する。
抵抗R3とトランジスタM6のドレイン端子の接続ノードには、抵抗R2を介してトランジスタM3のゲート端子に接続される。
この電圧V5は、素子L0を駆動する電圧V0を監視するシステム(図示せず)から供
給される。そして、電圧V0が徐々に上昇した場合には、トランジスタM5をオンさせる電圧V5を供給する。
一方、電圧V7はICの内部レギュレータ出力電圧で、チップが動作していないときには0Vとなる。
次に、電流駆動回路10の動作を説明する。
これにより、トランジスタM6は、よりオン抵抗が下がり、素子L0に多くの電流I0を供給することができる。
・ 上記実施形態では、通常動作において電圧Vdが高い場合には、抵抗R3、R2を介して供給される電圧が高いため、トランジスタM3がオンする。電圧Vdが下がってきた場合には、トランジスタM3のオン抵抗が上昇し、トランジスタM1とトランジスタM2とが直列に接続される形態に遷移する。これにより、トランジスタM6のゲート電圧が高くなり、出力電流を維持することができる。
○ 上記実施形態では、素子L0としてLEDに電流を供給する電流駆動回路10として説明したが、適用対象はこれに限定されるものではない。
Claims (5)
- 電源電圧に接続された負荷を接続する出力端子と、
前記出力端子にドレイン端子が接続され、ソース端子は共通電位ラインに接続された出力トランジスタと、
前記出力トランジスタのゲート端子にゲート端子が接続され、ドレイン端子に参照電流を供給する第1電流源が接続された第1トランジスタと、
前記出力トランジスタのゲート端子にゲート端子が接続され、ドレイン端子に前記第1トランジスタのソース端子が接続され、ソース端子は共通電位ラインに接続された第2トランジスタと、
前記第1トランジスタのソース端子及びドレイン端子に並列に接続された第3トランジスタと、
前記第1電流源にゲート端子が接続され、ソース端子が前記出力トランジスタのゲート端子に接続された第4トランジスタと、
前記出力トランジスタのゲート端子と前記共通電位ラインとの間に設けられた第2電流源とを備え、
前記第3トランジスタのゲート端子に前記出力端子の電圧を供給するように接続したことを特徴とする電流駆動回路。 - 前記出力端子と前記出力トランジスタとの間に抵抗を更に設けたことを特徴とする請求項1に記載の電流駆動回路。
- 前記第1トランジスタのソース端子及びドレイン端子に並列に接続された抵抗を更に設けたことを特徴とする請求項1又は2に記載の電流駆動回路。
- 前記第3トランジスタと前記出力端子の間に整流素子を設け、
前記整流素子に、前記電源電圧が異常値になった場合にオンして接地されるトランジスタを更に設けたことを特徴とする請求項1〜3のいずれか一つに記載の電流駆動回路。 - 前記整流素子に、前記電源電圧が停止状態でオンして接地されるトランジスタを更に設けたことを特徴とする請求項4に記載の電流駆動回路。
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