JP4868864B2 - 半導体装置の製造方法 - Google Patents
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Description
図1はNAND型フラッシュメモリのメモリセルアレイの一部を示す平面パターン、図2は図1に示したメモリセルアレイ10の等価回路を示している。
シリコン基板1上にシリコン酸化膜2が熱酸化法により形成される。
シリコン酸化膜2は、NOガスを用いた処理により、オキシナイトライド膜3に変えられる。このオキシナイトライド膜3は、一般に、トンネル絶縁膜と称される。
オキシナイトライド膜3上に、不純物としてリンが添加された多結晶のシリコン膜4がCVDプロセスにより形成される。このシリコン膜4は、FG電極となる。なお、最初に、非結晶のシリコン膜を形成し、しかる後、加熱処理により多結晶のシリコン膜4に変えても構わない。
シリコン窒化膜7上にレジストパターン8が形成される。レジストパターン8をマスクにしてシリコン窒化膜7をエッチングすることにより、レジストパターン8のパターンがシリコン窒化膜7に転写される。シリコン窒化膜7のエッチングは、例えば、RIE(Reactive Ion Etching)プロセスを用いて行われる。
レジストパターン8が除去され、シリコン窒化膜7をマスクにして、シリコン膜6、ゲート電極間絶縁膜5、シリコン膜4、オキシナイトライド膜3が垂直方向にエッチングされる。これらの膜6−3のエッチングは、例えば、RIEプロセスを用いて行われる。
図7の工程でのエッチングで生じたダメージを回復するために、後酸化と呼ばれる酸化処理が行われる。後酸化により後酸化膜9が形成される。シリコン基板1の表面にイオンをイオン注入プロセスにより注入し、注入されたイオンを熱アニールにより活性化することにより、ソース/ドレイン領域10が形成される。エクステンションと呼ばれる浅い拡散領域も形成されることが多いが、ここでは簡単のため省略する。
セル間が絶縁膜11で埋め込まれるとともに、表面が平坦化される。具体的には、セル間が埋め込まれるように、絶縁膜11としての熱酸化膜、シリコン窒化膜およびBPSG膜が順次形成され、その後、CMP(Chemical Mechanical Polishing)プロセスにより表面が平坦化される。
シリコン窒化膜7がエッチングにより除去される。絶縁膜11はシリコン窒化膜7よりもエッチングレートが大きい。そのため、シリコン窒化膜7のエッチング時には、絶縁膜11もエッチングされ、その高さが低くなる。シリコン窒化膜7が除去されて生じた凹部が埋め込まれるように、Co(コバルト)膜12がスパッタプロセスにより全面上に堆積される。Co膜12の厚さは、例えば、26nmである。
熱処理により、Co膜12とシリコン膜6とを反応させ、シリコン膜6を完全にCoシリサイド膜13に変える。ここで、Coシリサイド膜は、実質的にゲート電極間絶縁膜5の界面までシリサイド化されている。Coシリサイド膜13はCG電極として使用される。未反応のCo膜12は除去される。この後、周知の工程を経てNAND型フラッシュメモリが完成する。
図12−図18は、本発明の第2の実施形態に係るNAND型フラッシュメモリの製造方法を示す断面図。なお、第1の実施形態の説明で用いた図3−図11と対応する部分には図3−図11と同一符号を付してあり、詳細な説明は省略する。
まず、第1の実施形態と同様に、シリコン基板1上に、オキシナイトライド膜3、多結晶のシリコン膜4、ゲート電極間絶縁膜5が形成される。ゲート電極間絶縁膜5上に多結晶のシリコン膜6’が形成される。非結晶のシリコン膜を形成し、その後、熱処理等により、上記シリコン膜を多結晶に変えたものをシリコン膜6’として用いても構わない。シリコン膜6’の厚さは、ここでは、40nmである。
シリコン膜6’上に絶縁膜15が形成される。絶縁膜15は、Si,O,Nを含むSiO膜、SiN膜またはSiON膜である。絶縁膜15の膜厚は下限がシリサイド形成をブロックする膜厚(0.5nm以上)、上限は多結晶シリコン膜とシリサイド膜の導電性を阻害しない膜厚(2nm以下)である。絶縁膜15の形成は、シリコン膜6’の表面に形成された自然酸化膜を希フッ酸処理により予め除去した後、H2 O2 またはO3 が添加された溶液を用いて、シリコン膜6’の表面をウエット処理することにより行われる。上記ウエット処理の後、ラジカル窒素雰囲気中で絶縁膜15の極表面を窒化しても構わない。絶縁膜15上に、不純物としてリンが添加された非結晶のシリコン膜16がLPCVDプロセスにより形成される。シリコン膜16の厚さは、例えば、125nmである。シリコン膜16上にシリコン窒化膜7がLPCVDプロセスにより形成される。
シリコン窒化膜7上にレジストパターン8が形成される。レジストパターン8をマスクにしてシリコン窒化膜7をエッチングすることにより、レジストパターン8のパターンがシリコン窒化膜7に転写される。
レジストパターン8が除去され、シリコン窒化膜7をマスクにして、シリコン膜16、絶縁膜15、シリコン膜6’、ゲート電極間絶縁膜5、シリコン膜4、オキシナイトライド膜3が垂直方向に順次エッチングされる。これらの膜3−6’,15,16のエッチングは、例えば、RIEプロセスを用いて行われる。このときのエッチングで生じたダメージを回復するために、後酸化が行われ、後酸化膜9が形成される。
シリコン基板1の表面にイオンをイオン注入プロセスにより注入し、注入されたイオンを熱アニールにより活性化することにより、ソース/ドレイン領域10が形成される。エクステンションと呼ばれる浅い拡散領域も形成されることが多いが、ここでは簡単のため省略する。
セル間が絶縁膜11で埋め込まれるとともに、表面が平坦化される。
シリコン窒化膜7がエッチングにより除去され、膜厚が例えば26nmのCo膜がスパッタプロセスにより全面上に堆積され、その後、熱処理により、上記Co膜とシリコン膜16とを反応させることにより、シリコン膜16を完全にCoシリサイド膜17に変える。Coシリサイド膜17、絶縁膜15およびシリコン膜16は、CG電極として使用される。CG電極は絶縁膜15を含むが、絶縁膜15は先に説明した厚さに設定されているので、電極として支障はない。絶縁膜11はシリコン窒化膜7よりもエッチングレートが大きいため、シリコン窒化膜7のエッチング時には、絶縁膜11もエッチングされ、その高さが低くなる。この後、周知の工程を経てNAND型フラッシュメモリが完成する。
なお、本実施形態では、金属シリサイドとしてCoシリサイドを用いたが、少なくとも一つ以上の高融点金属を含むものであれば構わない。高融点金属としては、例えば、Ni、Co、Ptがあげられる。
Claims (3)
- 半導体基板と、
前記半導体基板上に設けられ、絶縁膜と、前記絶縁膜上に設けられた制御ゲート電極とを含むゲート構造を備えた不揮発半導体メモリと
を具備してなる半導体装置の製造方法であって、
前記絶縁膜として最上層が窒化膜である絶縁膜を形成する工程と、
前記絶縁膜上に非結晶の半導体膜を形成する工程と、
前記半導体膜、前記絶縁膜をゲート加工した後、前記半導体膜を含む領域上に高融点金属膜を形成する工程と、
熱処理により前記半導体膜の全体を金属シリサイド膜に変え、前記金属シリサイドからなる単層の制御ゲート電極を形成する工程と
を有することを特徴とする半導体装置の製造方法。 - 前記絶縁膜および前記半導体膜を同一チャンバー内で連続して形成することを特徴とする請求項1に記載の半導体装置の製造方法。
- 前記絶縁膜は、酸化膜、窒化膜、酸窒化膜、高誘電金属酸化膜、高誘電金属窒化膜および高誘電金属酸窒化膜の少なくとも一つを含むことを特徴とする請求項1に記載の半導体装置の製造方法。
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US10504596B2 (en) * | 2012-04-18 | 2019-12-10 | Micron Technology, Inc. | Apparatuses and methods of forming apparatuses using a partial deck-by-deck process flow |
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KR930007527B1 (ko) * | 1990-09-22 | 1993-08-12 | 삼성전자 주식회사 | 스토리지 셀 어레이와 주변회로를 갖는 불휘발성 반도체 메모리 장치의 제조방법 및 그 구조 |
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JP3875455B2 (ja) * | 1999-04-28 | 2007-01-31 | 株式会社東芝 | 半導体装置の製造方法 |
JP3464414B2 (ja) * | 1999-06-15 | 2003-11-10 | 富士通株式会社 | 不揮発性半導体記憶装置及びその製造方法 |
JP2003037190A (ja) * | 2001-07-23 | 2003-02-07 | Mitsubishi Electric Corp | 半導体記憶装置の製造方法及び半導体記憶装置 |
JP2003197781A (ja) | 2001-12-27 | 2003-07-11 | Toshiba Corp | 半導体装置およびその製造方法 |
JP2003309182A (ja) * | 2002-04-17 | 2003-10-31 | Hitachi Ltd | 半導体装置の製造方法及び半導体装置 |
JP2004087720A (ja) * | 2002-08-26 | 2004-03-18 | Toshiba Corp | 半導体装置および半導体装置の製造方法 |
JP2005191489A (ja) * | 2003-12-26 | 2005-07-14 | Sharp Corp | 半導体記憶装置およびその製造方法 |
JP2005310990A (ja) * | 2004-04-20 | 2005-11-04 | Renesas Technology Corp | 半導体装置の製造方法および半導体製造装置 |
JP2006024738A (ja) * | 2004-07-08 | 2006-01-26 | Seiko Instruments Inc | 抵抗回路と不揮発性メモリーとを有する半導体装置の製造方法 |
KR100685880B1 (ko) * | 2004-12-30 | 2007-02-23 | 동부일렉트로닉스 주식회사 | 플래쉬 이이피롬 셀 및 그 제조방법 |
JP2005276428A (ja) * | 2005-04-11 | 2005-10-06 | Toshiba Corp | 不揮発性半導体記憶装置 |
US7602006B2 (en) * | 2005-04-20 | 2009-10-13 | Taiwan Semiconductor Manufacturing Co., Ltd. | Semiconductor flash device |
JP4731262B2 (ja) * | 2005-09-22 | 2011-07-20 | ルネサスエレクトロニクス株式会社 | 不揮発性半導体記憶装置および、不揮発性半導体記憶装置の製造方法 |
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