JP4620880B2

JP4620880B2 - 半導体装置、及びデータ転送方法

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Publication number: JP4620880B2
Application number: JP2001018831A
Authority: JP
Inventors: 高志杉本
Original assignee: Fujitsu Semiconductor Ltd
Current assignee: Fujitsu Semiconductor Ltd
Priority date: 2001-01-26
Filing date: 2001-01-26
Publication date: 2011-01-26
Anticipated expiration: 2021-01-26
Also published as: JP2002222161A

Description

【０００１】
【発明の属する技術分野】
本発明は、半導体装置、及びデータ転送方法に関する。
データ転送を行う情報機器システム等の半導体装置には、中央処理装置（ＣＰＵ）の負荷を軽減し、データ転送の処理効率の向上を図るため、ダイレクトメモリアクセス（ＤＭＡ）制御装置が内蔵されるようになってきている。ＣＰＵは、データ転送を行っているとき、演算処理等の他の処理を行うことができない。ＤＭＡ転送方式は、ＣＰＵを介さずにデータ転送を行う転送方式であり、データ転送を高速に行うことができる。近年、データ転送をより高速に処理する技術が確立されてきている。そこで、ＤＭＡ制御装置を搭載した半導体装置において、外部入出力装置より高速動作するＤＭＡ制御装置が半導体装置の外部に対しＤＭＡ転送を行う際の動作効率の向上が要求されている。
【０００２】
【従来の技術】
図３は、従来のＤＭＡ転送のタイミングチャートを示す。尚、同図は、半導体装置に３つのＤＭＡ制御装置を搭載した例を示し、それら各ＤＭＡ制御装置のデータ転送路（チャネル）は、それぞれチャネルＣｈ１，チャネルＣｈ２，チャネルＣｈ３に設定される。３つのＤＭＡ制御装置には優先度が付与され、それらに同時に転送要求が発生すると、各装置はチャネルＣｈ１、チャネルＣｈ２、チャネルＣｈ３を介して、順次ＤＭＡ転送を実行する。
【０００３】
図中、バス動作は、半導体装置が有するシステムバス（内部バス）（図示略）の使用状態を示し、外バス動作は、半導体装置が接続された外部バス（図示略）の使用状態を示す。
【０００４】
今、チャネルＣｈ１は、ＤＭＡ転送を外部に対して行うように設定され、チャネルＣｈ２，Ｃｈ３は、ＤＭＡ転送を半導体装置内部の周辺回路（ＲＯＭ，ＲＡＭ等）に対して行うように設定されている。
【０００５】
図３に示すように、各ＤＭＡ制御装置が転送要求を同時に受けると、先ず優先度の高いチャネルＣｈ１を介してＤＭＡ転送が開始される。このチャネルＣｈ１の動作により、内部周辺回路，内部バス，外部入出力装置の経路にてＤＭＡ転送が実行され、内部周辺回路から外部バスに接続された外部周辺回路へデータが転送される。
【０００６】
しかしながら、内部バスの転送速度は、外部バスの転送速度より高速であるため、外部入出力装置による外部アクセス動作が完全に終了する前に、チャネルＣｈ１を介して２回目のＤＭＡ転送が開始される。つまり、例えば内部バスの転送速度が外部バスのそれの２倍の転送速度であるとすれば、外部入出力装置による外部アクセス動作に要する時間は、チャネルＣｈ１が内部バスを専有している時間のおよそ２倍となる。また、チャネルＣｈ１の転送要求を停止する信号は、外部入出力装置による外部アクセス動作の状態を監視して入力される。このため、外部バスの状態によって外部転送の終了と同時に半導体装置の外部制御端子より停止要求信号を入力すると、当該チャネルＣｈ１の優先度が他のチャネルＣｈ２，Ｃｈ３より高いことにより、外部転送が再度行われる。
【０００７】
そこで、上記のような不具合を解決するため、外部入出力装置より高速動作するＤＭＡ制御装置が搭載された半導体装置において、ＤＭＡ転送を外部に対して行う場合には、ＤＭＡ制御装置を外部入出力装置と同期させる必要がある。
【０００８】
図４は、前述同様に、３つのＤＭＡ制御装置（チャネルＣｈ１〜Ｃｈ３）を搭載した半導体装置において、同期をとった例を示す従来のＤＭＡ転送のタイミングチャートである。
【０００９】
同図に示す従来例では、チャネルＣｈ１を介して１回目のＤＭＡ転送が終了すると、このチャネルＣｈ１を介しての２回目の転送動作は停止する。従って、チャネルＣｈ１を介して１回目のＤＭＡ転送が開始され、これにより外部入出力装置による外部アクセス動作が開始された後、その外部アクセス動作が行われる間にチャネルＣｈ１を介して２回目のＤＭＡ転送が開始されることはなく、該チャネルＣｈ１は内部バスを開放する。
【００１０】
このため、外部アクセス動作を監視して、その転送終了と同時に半導体装置の外部制御端子より停止要求信号を入力すると、チャネルＣｈ１による転送動作が停止しているため、外部転送を実行するＤＭＡ制御装置（チャネルＣｈ１）と外部入出力装置とは同期して動作する。
【００１１】
【発明が解決しようとする課題】
ところが、チャネルＣｈ１による転送動作を停止して外部入出力装置と同期させる従来方法では、チャネルＣｈ１の優先度はチャネルＣｈ２，Ｃｈ３のそれよりも高いため、その停止状態においてもチャネルＣｈ１は内部バスを専有する。
【００１２】
この状態では、チャネルＣｈ１より優先度の低いチャネルＣｈ２及びチャネルＣｈ３のＤＭＡ制御装置は転送要求に応答することができない。この結果、全チャネルＣｈ１〜Ｃｈ３による転送動作が停止する。
【００１３】
更に、このようにチャネルＣｈ１〜Ｃｈ３による転送動作が停止している期間は、ＣＰＵも内部バスを使用することができないため、その時間だけ処理が遅くなる。従って、特に外部アクセスによるＤＭＡ転送を多く行う半導体装置においては、上記したような同期方法を行うことに起因して全てのＤＭＡ制御装置（チャネル）の動作停止の期間を頻繁に生じさせることとなり、それにより半導体装置の性能が低下するという問題がある。
【００１４】
本発明は、上述した問題点を解消するためになされたものであって、その目的は、外部転送を行うＤＭＡ制御装置の動作効率の向上を図ることのできる半導体装置、及びデータ転送方法を提供することにある。
【００１５】
【課題を解決するための手段】
上記目的を達成するため、請求項１に記載の発明によれば、複数のＤＭＡ制御装置は、優先度回路により付与される予め設定した第１の優先度に従ってデータ転送を行う。動作状態レジスタは、対応するＤＭＡ制御装置の動作状態を示す。
そして、複数のＤＭＡ制御装置は、それらの少なくともいずれか１つが外部入出力装置及び外部バスを介した外部転送を開始すると、動作状態レジスタが示す状態に基づいて優先度回路により付与される第２の優先度に従ってデータ転送を行う。
【００１６】
そして、優先度回路は、外部転送を開始したＤＭＡ制御装置の優先度を他の少なくともいずれか１つのＤＭＡ制御装置の優先度よりも低く設定した第２の優先度を付与する。
【００１７】
そして、動作状態レジスタは、外部転送を開始したＤＭＡ制御装置によってセットされる。また、動作状態レジスタは、ＤＭＡ制御装置が開始した外部転送が終了すると、外部入出力装置によってクリアされる。
【００１８】
そして、優先度回路は、ＤＭＡ制御装置によってセットされる動作状態レジスタの出力信号に応答して第２の優先度を付与した後、外部入出力装置によってクリアされる動作状態レジスタの出力信号に応答して再度予め設定した第１の優先度を付与する。
【００１９】
請求項２に記載の発明によれば、複数のＤＭＡ制御装置は、優先度回路に付与される予め設定した第１の優先度に従ってデータ転送を実行する。次いで、複数のＤＭＡ制御装置が接続された内部バスに接続された外部入出力装置とその外部入出力装置に接続された外部バスを介した外部転送を開始したＤＭＡ制御装置により動作状態レジスタがセットされると、優先度回路により外部転送を開始したＤＭＡ制御装置の他のＤＭＡ制御装置のうち少なくともいずれか１つのＤＭＡ制御装置の優先度よりも低く設定された第２の優先度を、外部転送を開始したＤＭＡ制御装置に付与する。そして、外部転送が終了して動作状態レジスタが外部入出力装置によりクリアされると、優先度回路より外部転送を開始したＤＭＡ制御装置に、第１の優先度を付与する。
【００２０】
【発明の実施の形態】
以下、本発明を具体化した一実施形態を図１及び図２に従って説明する。
図１は、ダイレクトメモリアクセス（以下、ＤＭＡという）制御装置を搭載した半導体装置の概略ブロック図を示す。
【００２１】
半導体装置１は、中央処理装置（図中、ＣＰＵで示す）２、複数のＤＭＡ制御装置３〜５、第１〜第３の周辺回路（例えば、ＲＯＭ，ＲＡＭ，ＵＡＲＴ等）６〜８、及び外部入出力装置としての外部バス制御装置９を備え、それらはシステムバス１０を介して相互に接続されている。
【００２２】
ＤＭＡ制御装置３〜５は制御端子１１〜１３に接続され、それら制御端子１１〜１３によって個別に制御される。各ＤＭＡ制御装置３〜５のデータ転送路（以下、チャネルという）は、それぞれチャネルＣｈ１，チャネルＣｈ２，チャネルＣｈ３に設定される。
【００２３】
外部バス制御装置９は外部バス端子に接続され、図示しない外部バスを介して外部周辺回路（図示略）と接続されている。即ち、外部周辺回路と第１〜第３の周辺回路６〜８のいずれか１つとの間で行われるＤＭＡ転送（以下、外部転送という）は、外部バス制御装置９を介して行われる。本実施形態では、ＤＭＡ制御装置３によりチャネルＣｈ１を介して行われるＤＭＡ転送は外部転送である。また、ＤＭＡ制御装置４，５によりチャネルＣｈ２，Ｃｈ３を介して行われるＤＭＡ転送は、半導体装置１内における第１〜第３の周辺回路６〜８の間でデータの転送を行う。
【００２４】
半導体装置１には、各ＤＭＡ制御装置３〜５毎にそれぞれ動作状態レジスタ１４〜１６が接続され、それら動作状態レジスタ１４〜１６は外部バス制御装置９にそれぞれ接続される。
【００２５】
動作状態レジスタ１４〜１６は、各々対応するＤＭＡ制御装置３〜５により行われる外部転送の動作状態を示す。そして、動作状態レジスタ１４〜１６は、対応するＤＭＡ制御装置３〜５が外部転送を行うと、当該ＤＭＡ制御装置３〜５によってセットされる。動作状態レジスタ１４〜１６がセットされると、このセットされている期間、当該レジスタ１４〜１６に対応するＤＭＡ制御装置３〜５の転送動作は一時停止する。そして、外部バス制御装置９を介して行われる外部転送が終了すると、動作状態レジスタ１４〜１６は外部バス制御装置９によりクリアされ、これにより転送動作を一時停止していたＤＭＡ制御装置３〜５は動作を再開する。
【００２６】
各動作状態レジスタ１４〜１６は優先度回路１７に接続され、この優先度回路１７は、各ＤＭＡ制御装置３〜５と接続される。そして、動作状態レジスタ１４〜１６は、前述したセット或いはクリアの状態を示す信号を優先度回路１７に出力する。
【００２７】
優先度回路１７は、各ＤＭＡ制御装置３〜５に対し予め第１の優先度を付与する。また、優先度回路１７は、動作状態レジスタ１４〜１６の出力信号に基づいて、各ＤＭＡ制御装置３〜５に対し第２の優先度を付与する。本実施形態では、各ＤＭＡ制御装置３〜５に対して優先度回路１７により予め付与される第１の優先度は、ＤＭＡ制御装置３＞ＤＭＡ制御装置４＞ＤＭＡ制御装置５、に設定される。
【００２８】
各ＤＭＡ制御装置３〜５は、優先度回路１７により付与される第１又は第２の優先度に従って、それらに設定されるチャネルＣｈ１〜Ｃｈ３を介して順次ＤＭＡ転送を実行する。従って、本実施形態において、転送要求の信号が制御端子１１〜１３からＤＭＡ制御装置３〜５に同時に入力されると、優先度回路１７により付与された第１の優先度に従って、先ず最も優先度が高く設定されたＤＭＡ制御装置３がＤＭＡ転送を実行する。
【００２９】
このとき、上述したようにＤＭＡ制御装置３は、チャネルＣｈ１を介して外部転送を行うことにより、動作状態レジスタ１４はセットされる。
動作状態レジスタ１４がセットされると、優先度回路１７は、これに応答してＤＭＡ制御装置３の優先度を他のＤＭＡ制御装置４，５よりも低く設定する。つまり、優先度回路１７は、ＤＭＡ制御装置３〜５に対して第２の優先度を付与し、その優先度は、ＤＭＡ制御装置４＞ＤＭＡ制御装置５＞ＤＭＡ制御装置３、に設定される。
【００３０】
そして、優先度回路１７は、動作状態レジスタ１４がクリアされると、これに応答して各ＤＭＡ制御装置３〜５の優先度を予め付与した前記第１の優先度に戻す。
【００３１】
図２は、ＤＭＡ制御装置３〜５に転送要求の信号が同時に入力されたときのＤＭＡ転送のタイミングチャートを示す。同図において、バス動作は、半導体装置１が有するシステムバス（内部バス）１０の使用状態を示し、外バス動作は、半導体装置１が接続された外部バスの使用状態を示す。
【００３２】
全てのＤＭＡ制御装置３〜５に対して、転送要求の信号が制御端子１１〜１３に同時に入力されると、図２に示すように、先ず最も優先度の高いＤＭＡ制御装置３がチャネルＣｈ１を介して転送動作を開始する。このとき、チャネルＣｈ１による転送は外部転送であり、外部バス制御装置９を介して外部周辺回路（図示略）にアクセスされる。
【００３３】
動作状態レジスタ１４は、ＤＭＡ制御装置３による外部転送が開始されることによりセットされ、これによりＤＭＡ制御装置３の転送動作は一時停止する。
また、動作状態レジスタ１４がセットされると、これに応答して優先度回路１７は、ＤＭＡ制御装置３の優先度を他のＤＭＡ制御装置４，５より低くする。即ち、各ＤＭＡ制御装置３〜５に対して第２の優先度、ＤＭＡ制御装置４＞ＤＭＡ制御装置５＞ＤＭＡ制御装置３、が付与される。これにより、ＤＭＡ制御装置３の動作停止に起因してＤＭＡ制御装置４，５の動作が停止することはなく、当該ＤＭＡ制御装置４，５は、制御端子１２，１３に入力される転送要求に応答し、チャネルＣｈ２，Ｃｈ３を介してＤＭＡ転送を順次実行する。
【００３４】
そして、チャネルＣｈ１を介しての外部転送が外部バス制御装置９を介して終了し、動作状態レジスタ１４が外部バス制御装置９によりクリアされると、当該ＤＭＡ制御装置３の動作停止が解除される。
【００３５】
また、動作状態レジスタ１４がクリアされると、これに応答して優先度回路１７は、ＤＭＡ制御装置３の優先度を予め定めた第１の優先度、つまり、ＤＭＡ制御装置３＞ＤＭＡ制御装置４＞ＤＭＡ制御装置５、の優先度に戻す。
【００３６】
その後、チャネルＣｈ３を介してのＤＭＡ転送処理が終了した後、制御端子１１に転送要求の信号が再度入力される場合には、ＤＭＡ制御装置３によるＤＭＡ転送（外部転送）が再び行われる。
【００３７】
このように、外部バス制御装置９による外部アクセス動作が行われる期間において、ＤＭＡ制御装置３は転送動作を一時停止するとともに、その優先度が他のＤＭＡ制御装置４，５より低く設定される。このため、外部アクセス動作を監視してその転送終了と同時に制御端子１１に転送要求を停止する信号を入力することにより、その外部アクセス動作が行われる期間に他のＤＭＡ制御装置４，５の転送動作が停止することなく、外部転送を行うＤＭＡ制御装置３（チャネルＣｈ１）と外部バス制御装置９は同期して動作する。
【００３８】
以上記述したように、本実施の形態によれば、以下の効果を奏する。
（１）各ＤＭＡ制御装置３〜５毎に動作状態レジスタ１４〜１６が接続され、各動作状態レジスタ１４〜１６は優先度回路１７に接続される。優先度の最も高いＤＭＡ制御装置３によりチャネルＣｈ１を介して外部転送が行われると、動作状態レジスタ１４はセットされ、ＤＭＡ制御装置３の転送動作は一時停止する。優先度回路１７は、動作状態レジスタ１４がセットされると、ＤＭＡ制御装置３の優先度を最も低くするため、ＤＭＡ制御装置４，５は転送動作を順次実行する。このため、内部バスと外部バスとでその転送速度が異なる場合に、ＤＭＡ制御装置３がチャネルＣｈ１を介して外部転送を実行するとき、ＤＭＡ制御装置３と外部バス制御装置９とを同期させて動作させても全てのＤＭＡ制御装置３〜５の転送動作が停止することはない。従って、その動作効率を向上させることができる。
【００３９】
尚、本発明は上記各実施形態に限定されるものではなく、以下のように実施してもよい。
・本実施形態では、半導体装置１に、３つのＤＭＡ制御装置３〜５（チャネルＣｈ１〜Ｃｈ３）を搭載したが、２つ又は４以上のＤＭＡ制御装置（チャネル）により構成してもよい。このように構成される場合、それらＤＭＡ制御装置の数に対応して動作状態レジスタが設けられる。
【００４０】
・本実施形態では、優先度回路１７により予め定めた第１の優先度を、ＤＭＡ制御装置３，ＤＭＡ制御装置４，ＤＭＡ制御装置５の順に設定したが、この優先度に限られることはない。
【００４１】
・本実施形態では、ＤＭＡ制御装置３によるチャネルＣｈ１を介してのＤＭＡ転送を外部転送としたが、ＤＭＡ制御装置４，５によるＤＭＡ転送を外部転送としてもよい。このような場合には、各々対応する動作状態レジスタ１５，１６の出力信号に基づいてＤＭＡ制御装置４，５の優先度が変更される。
【００４２】
・本実施形態では、動作状態レジスタ１４がセットされるときに各ＤＭＡ制御装置３〜５に付与される第２の優先度において、ＤＭＡ制御装置３の優先度は、ＤＭＡ制御装置４，５の優先度より低く設定したが、必ずしもこれらＤＭＡ制御装置４，５より低く設定される必要はない。
【００４３】
上記実施形態をまとめると、以下のようになる。
（付記１）複数のＤＭＡ制御装置を搭載した半導体装置において、
前記複数のＤＭＡ制御装置の転送動作の状態をそれぞれ示す複数の動作状態レジスタと、
前記複数のＤＭＡ制御装置に対して予め設定した第１の優先度を付与し、前記複数のＤＭＡ制御装置の少なくともいずれか１つが外部転送を開始したとき、前記複数の動作状態レジスタが示す状態に基づいて当該外部転送を開始したＤＭＡ制御装置に第２の優先度を付与する優先度回路と
を備えたことを特徴とする半導体装置。
（付記２）前記優先度回路は、前記外部転送を開始したＤＭＡ制御装置の優先度を他の少なくともいずれか１つのＤＭＡ制御装置の優先度よりも低く設定した前記第２の優先度を付与することを特徴とする付記１に記載の半導体装置。
（付記３）前記複数のＤＭＡ制御装置が接続された内部バスと、外部バスとに接続された外部入出力装置を備え、
前記動作状態レジスタは、前記外部転送を開始したＤＭＡ制御装置によってセットされ、当該ＤＭＡ制御装置が前記外部転送を終了したとき、前記外部入出力装置によってクリアされることを特徴とする付記１又は２に記載の半導体装置。
（付記４）前記優先度回路は、前記ＤＭＡ制御装置によってセットされる動作状態レジスタの出力信号に応答して前記第２の優先度を付与し、前記外部入出力装置によってクリアされる動作状態レジスタの出力信号に応答して予め設定した前記第１の優先度を付与することを特徴とする付記３に記載の半導体装置。
（付記５）前記外部転送を開始したＤＭＡ制御装置は、前記動作状態レジスタをセットして自身の転送動作を一時停止し、前記動作状態レジスタがクリアされると一時停止を解除する機能を備えていることを特徴とする付記３又は４に記載の半導体装置。
（付記６）複数のＤＭＡ制御装置を搭載した半導体装置におけるデータ転送方法であって、
前記優先度回路により付与される予め設定した第１の優先度に従って前記複数のＤＭＡ制御装置によるデータ転送を順次実行し、当該データ転送を行うＤＭＡ制御装置が前記外部転送を開始して前記動作状態レジスタがセットされた後に、前記優先度回路により付与される第２の優先度に従って他のＤＭＡ制御装置によるデータ転送を順次実行し、前記外部転送を終了して前記動作状態レジスタがクリアされた後に、前記第１の優先度に従って前記複数のＤＭＡ制御装置によるデータ転送を順次実行することを特徴とするデータ転送方法。
（付記７）半導体装置に備えた複数のＤＭＡ制御装置の優先度制御方法であって、
前記複数のＤＭＡ制御装置に対して予め設定した第１の優先度を付与し、前記複数のＤＭＡ制御装置の少なくともいずれか１つが外部転送を開始したとき、当該ＤＭＡ制御装置に第２の優先度を付与することを特徴とするＤＭＡ制御装置の優先度制御方法。
（付記８）前記外部転送を開始したＤＭＡ制御装置が転送動作を終了したとき、当該ＤＭＡ制御装置に前記第１の優先度を付与することを特徴とする付記７に記載のＤＭＡ制御装置の優先度制御方法。
（付記９）前記外部転送を開始したＤＭＡ制御装置に付与する前記第２の優先度は、他の少なくともいずれか１つのＤＭＡ制御装置の優先度よりも低く設定されることを特徴とする付記７又は８に記載のＤＭＡ制御装置の優先度制御方法。
【００４４】
【発明の効果】
以上記述したように、この発明は、外部転送を行うＤＭＡ制御装置の動作効率の向上を図ることのできる半導体装置、及びデータ転送方法を提供することができる。
【図面の簡単な説明】
【図１】一実施形態を示す半導体装置の概略平面図である。
【図２】一実施形態のＤＭＡ転送を示すタイミングチャートである。
【図３】従来のＤＭＡ転送を示すタイミングチャートである。
【図４】従来のＤＭＡ転送を示すタイミングチャートである。
【符号の説明】
１半導体装置
３〜５ダイレクトメモリアクセス（ＤＭＡ）制御装置
９外部入出力装置（外部バス制御装置）
１４〜１６動作状態レジスタ
１７優先度回路

Claims

複数のＤＭＡ制御装置を搭載した半導体装置において、
前記複数のＤＭＡ制御装置の転送動作の状態をそれぞれ示す複数の動作状態レジスタと、
前記複数のＤＭＡ制御装置が接続された内部バスと外部バスとに接続された外部入出力装置と、
前記複数のＤＭＡ制御装置に対して予め設定した第１の優先度を付与し、前記複数のＤＭＡ制御装置の少なくともいずれか１つが前記外部入出力装置及び前記外部バスを介した外部転送を開始したとき、前記複数の動作状態レジスタが示す状態に基づいて当該外部転送を開始したＤＭＡ制御装置に第２の優先度を付与する優先度回路とを備え、
前記動作状態レジスタは、前記外部転送を開始したＤＭＡ制御装置によってセットされ、当該ＤＭＡ制御装置が開始した前記外部転送を終了したときに、前記外部入出力装置によってクリアされ、
前記優先度回路は、前記外部転送を開始したＤＭＡ制御装置に、他の少なくともいずれか１つのＤＭＡ制御装置の優先度よりも低く設定した前記第２の優先度を、前記外部転送を開始したＤＭＡ制御装置によってセットされた動作状態レジスタの出力信号に応答して付与し、前記外部入出力装置によってクリアされる動作状態レジスタの出力信号に応答して前記第１の優先度を付与する、
ことを特徴とする半導体装置。
複数のＤＭＡ制御装置を搭載した半導体装置におけるデータ転送方法であって、
優先度回路により付与される予め設定した第１の優先度に従って前記複数のＤＭＡ制御装置によるデータ転送を実行し、
前記データ転送を行うＤＭＡ制御装置が、前記複数のＤＭＡ制御装置が接続された内部バスに接続された外部入出力装置とその外部入出力装置に接続された外部バスを介した外部転送を開始して前記外部転送を開始したＤＭＡ制御装置により動作状態レジスタがセットされた後に、前記優先度回路により前記外部転送を開始したＤＭＡ制御装置の他のＤＭＡ制御装置のうち少なくともいずれか１つのＤＭＡ制御装置の優先度よりも低く設定された第２の優先度を、前記外部転送を開始したＤＭＡ制御装置に付与し、
前記外部転送を終了して前記外部入出力装置により前記動作状態レジスタがクリアされた後に、前記外部転送を開始したＤＭＡ制御装置に前記第１の優先度を付与する
ことを特徴とするデータ転送方法。