JP4564514B2 - 半導体装置 - Google Patents
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Description
図1は、本発明の実施の形態にかかる半導体装置の模式断面図である。
低抵抗の第1導電型基板(n型半導体基板)10の上に、第1導電型エピタキシャル層11が形成され、この第1導電型エピタキシャル層11の上には、ゲートトレンチを有するUMOS構造が形成されている。すなわち、第2導電型ベース領域12にトレンチ13が形成され、ゲート酸化膜14を介してゲート電極15が埋め込まれている。また、第2導電型ベース領域12の上には、高濃度の第1導電型(n+)ソース領域20が形成されている。そして、本実施形態においては、第2導電型ベース領域12に隣接して高濃度の第2導電型領域17が設けられている。ここで、第2導電型ベース領域12の不純物濃度は、1×1017cm−3程度とし、高濃度の第2導電型領域17の不純物濃度は、1.8×1017〜3×1017cm−3程度とすることができる。第2導電型領域17の上には、第2導電型のコンタクト領域21が設けられている。
図3は、ゲート酸化膜14の膜厚を50nm、60nm、70nmと変化させたときの距離xと洩れ電流との関係を表すグラフ図である。
ここでは、隣接するトレンチゲートの間隔が1.5μmとなる構造について計算を行った。すなわち、x=0.75μmは、高濃度の第2導電型領域17が設けられていない場合に対応する。また、ゲート酸化膜14の厚みを厚くすると閾値(ドレイン電流1μAのときのゲート電圧)が上がるため、閾値が一定となるように第2導電型ベース領域12の濃度を調節した。x=0.75μmのときの閾値を1.3V、1.1Vとし、高濃度の第2導電型領域17の濃度は2.3×1017cm−3と一定としている。
x=0.14×f×10−17+0.022
図5は、トレンチゲートの酸化膜14から高濃度の第2導電型領域17までの間の距離xに対するオン抵抗RONの関係を表すグラフ図である。
ここでは閾値が一定となるように第2導電型ベース領域12の濃度を調節しているため、距離xが小さくなるにつれて第2導電型ベース領域12の濃度は低くしている。また、高濃度の第2導電型領域17の濃度は、3.0×1017cm−3と一定として計算した。図5に表したように、距離xが0.3μm以下でオン抵抗RONが顕著に減少し始めていることが分かる。
本実施形態においても、第2導電型ベース領域12に隣接して高濃度の第2導電型領域17が設けられている。ただし、これら領域の境界は必ずしも明確ではなく、不純物濃度が連続的に変化している。
まず、図7(a)に表したように、低抵抗の第1導電型基板10上に第1導電型エピタキシャル層11と第2導電型領域17を形成する。
そして、図7(b)に表したように、マスク60を用いて部分的にエッチングし、第2導電型領域17を貫通して第1導電型エピタキシャル層11に至るトレンチ13を形成する。
次に、図7(c)に表したように、トレンチ13の内壁に薄い酸化シリコン膜65を形成する。そして、トレンチ13の内側壁に対して斜め方向から第1導電型の不純物をイオン注入する。ここで、薄い酸化シリコン膜65は、トレンチ13の内壁面を保護し、またイオン注入される不純物の注入深さを調節する役割も有する。
しかる後に、図8(c)に表したように、第2導電型領域17の上の第1導電型ソース領域20を選択的にエッチングし、さらにその下の第2導電型領域17の一部もエッチングする。この後、ゲート電極15の上に層間絶縁膜16を形成し、ソース電極24を形成すると、図6に表した半導体装置が完成する。
本実施形態においては、第2導電型領域17は、一対のゲート電極15の間においてトレンチ状に設けられている。ここで、第1実施形態に関して前述したように、第2導電型領域17は、ゲート酸化膜14の近傍に位置精度よく形成することが望ましい。ところが、ゲート用のトレンチ13と、第2導電型領域17と、を別々のマスクを用いて形成すると、マスクの合わせズレにより、これらの位置関係を精密に制御することが容易でない。これに対して、本実施形態においては、第2導電型領域17も埋め込みトレンチ構造とすることにより、ゲートと同一のマスクを用いて合わせズレなく形成することができる。
まず、図10(a)に表したように、低抵抗の第1導電型基板10上に第1導電型エピタキシャル層11を形成し、ゲートを形成するためのトレンチ13を形成する。 そして、図10(b)に表したように、トレンチ13の内側壁にゲート酸化膜14を形成し、さらに導電性材料を埋め込むことによりゲート電極15を形成する。
しかる後に、図11(b)に表したように、第1導電型エピタキシャル層11に至るトレンチ18を形成する。その後、トレンチ18に第2導電型の半導体を埋め込むことにより、第2導電型領域17を形成する。その後、ソース電極24を形成すれば、図9表した本実施形態の半導体装置が完成する。
本実施形態においては、ソース電極24のトレンチコンタクトの部分に隣接して第2導電型領域17が形成されている。この構造も、トレンチゲートの近傍に第2導電型領域17を形成することができる。
まず、図13(a)に表したように、低抵抗の第1導電型基板10上に第1導電型エピタキシャル層11を形成し、トレンチ13を形成してその内側壁にゲート酸化膜14とゲート電極15とを形成する。 その後、図13(b)に表したように、第2導電型の不純物をウェーハ表面からイオン注入法などにより導入して第2導電型ベース領域12を形成する。ここで、第2導電型ベース領域12は、トレンチ13よりも浅くなるように形成する。
そして、図14(b)に表したように、トレンチ19の底面及び内側面に対して斜め方向から第2導電型の不純物をイオン注入する。
Claims (5)
- 第1導電型半導体層の上に設けられた第2導電型ベース領域と、
前記第2導電型ベース領域の上に設けられた第1導電型ソース領域と、
前記第1導電型ソース領域と前記第2導電型ベース領域を貫通し前記第1導電型半導体層に至る第1のトレンチと、
前記第1のトレンチの内壁を覆うゲート絶縁膜と、
前記ゲート絶縁膜を介して前記第1のトレンチに埋められたゲート電極と、
前記第1導電型ソース領域よりも下方において前記第2導電型ベース領域に隣接し且つ前記ゲート絶縁膜から離間して設けられ前記第2導電型ベース領域よりも濃度が高い第2導電型領域と、
を備え、
前記第1導電型ソース領域の上面から前記ゲート電極の下端までの深さをdとし、前記第1導電型ソース領域の上面から前記第2導電型ベース領域の下面までの深さをcとしたとき、c≧dであることを特徴とする半導体装置。 - 前記ゲート絶縁膜から前記第2導電型領域までの距離は、0.3マイクロメータ以下であることを特徴とする請求項1記載の半導体装置。
- 前記第2導電型領域の上において前記第1導電型ソース領域に隣接して設けられた第2導電型コンタクト領域をさらに備え、
前記第1のトレンチの深さ方向に対して垂直な方向にみた前記第2導電型領域の幅は、前記第2導電型コンタクト領域の幅よりも大なることを特徴とする請求項1または2に記載の半導体装置。 - 前記第1導電型ソース領域の上から前記第1導電型ソース領域に隣接して前記第2導電型領域に達するトレンチコンタクトが形成されたソース電極をさらに備え、
前記第2導電型領域が前記ソース電極の前記トレンチコンタクトの端部から前記ゲート電極の前記トレンチの方向に向けて形成された、
ことを特徴とする請求項1記載の半導体装置。 - 前記第2導電型ベース領域を貫通し前記第1導電型半導体層に至る第2のトレンチに形成された第2導電型領域をさらに備えたことを特徴とする請求項1〜3のいずれか1つに記載の半導体装置。
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