JP4549589B2 - シリコン半導体基板およびその製造方法 - Google Patents

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Description

【0001】
【発明の属する技術分野】
本発明は、シリコン半導体基板およびその製造方法に関するものである。詳しく述べると、ボイド系製品の無欠陥領域を得るため、該ボイド系欠陥を熱処理により消滅が容易な形状にしたシリコン半導体基板を使用し、その後の熱処理により表層無欠陥層が深く、デバイス特性に優れ、良好なゲッタリング特性を持つシリコン半導体基板およびその製造方法に関するものである。
【0002】
【従来の技術】
従来、半導体基板の表層無欠陥性の改善では、水素雰囲気中で1200℃の温度にて1時間以上の熱処理を実施し、表層から10μmまで酸素析出物欠陥のない無欠陥層が広がっている技術が報告されており(特開平6−252154)、この時1ないし3μmまでの深さまで空孔型欠陥が消滅していることが知られている。最近では窒素を添加することにより空孔型欠陥を高密度で小さくすることにより表層からより深い領域まで該空孔型欠陥を消滅させる技術も報告されるに至った(特開平11−135511、特開2000-256092)。このうちの後者の発明においては、空孔型欠陥の形態の変化に着目してその形状で窒素添加効果を記載している。
【0003】
しかし、該先行技術は窒素添加効果が空孔型欠陥に及ぼす形態変化効果を記載したにすぎず、空孔型欠陥を消滅させるために実施される熱処理に対する効果的な窒素濃度、酸素濃度、引上げ時の1100℃の温度域を通過する時の冷却速度(以下冷却速度とのみ記述)の限定がなされていない。すなわち、空孔型欠陥において、熱処理で消滅する際に空孔型欠陥の表面から点欠陥である空孔が拡散していくわけであるが、その時にその拡散は空孔型欠陥の外周部分の表面積に比例するわけであり、空孔型欠陥消滅に必要な限定がなされたとは言えない。
【0004】
実際、先行技術では熱処理後の欠陥も表層から0.5μm深さで欠陥残存率がパーセントオーダーまでしか消滅しておらず、空孔型欠陥を工業的に生産性の優れた製造条件でデバイス作成に影響の出ない密度まで消滅させる十分な限定がなされていない。
【0005】
さらに該先行技術では現在要求されている大口径化により空孔型欠陥がその製造条件により、より大型の空孔型欠陥に成長することを考えると、適量な窒素添加がなされないとその効果が不十分であることが予想され、表層から深い領域までは空孔型欠陥が消滅した工業的に有用なシリコン半導体基板を作成する上では条件限定の不足という欠点を有している。
【0006】
【発明が解決しようとする課題】
従って、本発明の目的は、以上のような従来技術の欠点に鑑み、新規なシリコン半導体基板およびその製造方法を提供することにある。
【0007】
すなわち、本発明では従来技術で製造できていない表層からより深い領域まで空孔型欠陥を消滅させることが可能で、同一熱処理温度で比べた場合、従来よりもより深い領域まで空孔型欠陥を消滅させることが可能である。
【0008】
また同じ深さの無欠陥層を得るのに、従来技術に比べより短時間の熱処理で所望の深さの無欠陥層を有するシリコン半導体基板を作成する製造法およびそのために必要なシリコン半導体基板を提供するものである。
【0009】
【課題を解決するための手段】
上記諸目的は、下記(1)〜(10)により達成される。
【0010】
(1) チョクラルスキー法または磁場印加チョクラルスキー法により育成したシリコン単結晶から得たシリコン半導体基板であって、空孔型欠陥の体積をV、表面積をSとし、体積Vを持つ該空孔型欠陥と同じ体積を持つ球型欠陥を仮定した場合の該球型欠陥の半径をRとした時に、0.2≧V/S/Rの関係を満たすことを特徴とするシリコン半導体基板。
【0011】
(2) 窒素を1×1014atoms/cm3以上かつ1×1016atoms/cm3以下で含有することを特徴とする前記(1)に記載のシリコン半導体基板。
【0012】
(3) 酸素濃度が9.5×1017atoms/cm3以下であり、かつ窒素濃度が5×1014atoms/cm3以上かつ1×1016atoms/cm3以下であるシリコン半導体基板中の空孔型欠陥の体積を球型とした時にその半径RがR≦30nmであることを特徴とする前記(1)に記載のシリコン半導体基板。
【0013】
(4) 酸素濃度が8.5×1017atoms/cm3以下であり、かつ窒素濃度が1×1015atoms/cm3以上かつ1×1016atoms/cm3以下であるシリコン半導体基板中の空孔型欠陥の体積を球型とした時にその半径RがR≦75nmであることを特徴とする前記(1)記載のシリコン半導体基板。
【0014】
(5) チョクラルスキー法または磁場印加チョクラルスキー法により冷却速度が1℃/分以上で育成したシリコン単結晶から得た前記(1)に記載のシリコン半導体基板を、非酸化性雰囲気中にて1150℃以上の温度で少なくとも1時間以上熱処理することを特徴とするシリコン半導体基板の製造方法。
【0015】
(6) 1×1017atoms/cm3以上かつ1.5×1019atoms/cm3以下の窒素を含有するシリコン融液を用いてチョクラルスキー法または磁場印加チョクラルスキー法により冷却速度が1℃/分以上で育成したシリコン単結晶から得た前記(2)に記載のシリコン半導体基板を、非酸化性雰囲気中にて1150℃以上の温度で少なくとも1時間以上熱処理することを特徴とするシリコン半導体基板の製造方法。
【0016】
(7) 5×1017atoms/cm3以上かつ1.5×1019atoms/cm3以下の窒素を含有するシリコン融液を用いてチョクラルスキー法または磁場印加チョクラルスキー法により冷却速度が5℃/分以上で育成したシリコン単結晶から得た前記(3)に記載のシリコン半導体基板を、非酸化性雰囲気中にて1150℃以上の温度で少なくとも1時間以上熱処理することを特徴とするシリコン半導体基板の製造方法。
【0017】
(8) 1×1018atoms/cm3以上かつ1.5×1019atoms/cm3以下の窒素を含有するシリコン融液を用いてチョクラルスキー法または磁場印加チョクラルスキー法により1100℃での冷却速度が1℃/分以上かつ5℃/分未満で育成したシリコン単結晶から得た前記(4)に記載のシリコン半導体基板を、非酸化性雰囲気中にて1150℃以上の温度で少なくとも1時間以上熱処理することを特徴とするシリコン半導体基板の製造方法。
【0018】
(9) 前記(3)に記載のシリコン半導体基板を非酸化性雰囲気で1200℃以上での熱処理を行なうことにより、半導体基板中心の表面から1μm深さでの酸素濃度が6×1016atoms/cm3以下であり、二次イオン質量分析法(SIMS)による窒素濃度測定において該シリコン基板深さ中心に平均信号強度の2倍以上の濃度を示す窒素偏析による局所濃化部を持ち、表面から少なくとも5μm以上かつ12μm未満の深さの表層無欠陥層を持ち、さらに酸素析出物密度がシリコン基板中央部の深さ中心で1×109個/cm3以上であることを特徴とするシリコン半導体基板の製造方法。
【0019】
(10) 前記(4)に記載のシリコン半導体基板を非酸化性雰囲気で1200℃以上での熱処理を行なうことにより、半導体基板中心の表面から1μm深さでの酸素濃度が5×1016atoms/cm3以下であり、二次イオン質量分析法(SIMS)による窒素濃度測定において該シリコン基板深さ中心に平均信号強度の2倍以上の濃度を示す窒素偏析による局所濃度部を持ち、表面から少なくとも5μm以上かつ12μm未満の深さの表層無欠陥層を持ち、さらに酸素析出物密度がシリコン基板中央部の深さ中心で5×108個/cm3以上であることを特徴とするシリコン半導体基板の製造方法。
【0020】
【発明の実施の形態】
本発明によるシリコン半導体基板は、チョクラルスキー法(以下、「CZ法」という。)または磁場印加チョクラルスキー法(以下、「磁場印加CZ法」という。)により育成したシリコン単結晶棒を所定の厚みにスライスして得られるものである。
【0021】
すなわち、CZ法は、石英ルツボ中に収容された多結晶シリコン原料の融液に種結晶を接触させ、これを回転させながらゆっくりと引き上げて所望直径のシリコン単結晶棒を育成する方法であるが、予め石英ルツボ内に窒化物を入れておくか、シリコン融液中に窒化物を投入するか、または雰囲気ガスを窒素を含む雰囲気とすること等によって、引き上げ結晶中に窒素をドープすることができる。この際、窒化物の量あるいは窒素ガスの濃度あるいは導入時間等を調整することによって、結晶中のドープ量を制御することができる。また、磁場印加CZ法の場合にも、石英ルツボ内に磁場を印加させながら行なう以外はCZ法の場合と同様である。このようにして、例えばシリコンウエ−ハの状態で、1×1014〜1×1016atoms/cm3あるいはシリコン融液の状態で、1×1017〜1.5×1019atoms/cm3の窒素濃度に制御することも容易に行なうことができる。
【0022】
また、前述したように本発明では、CZ法または磁場印加CZ法によって窒素をドープしたシリコン単結晶棒を育成する際に、単結晶棒に含有される酸素濃度を6×1017〜1×1018atoms/cm3の範囲に制御することが好ましい。
【0023】
シリコン単結晶棒を育成する際に、含有される酸素濃度を上記範囲に低下させる方法は、従来から慣用されている方法によれば良い。例えば、ルツボ回転数の減少、導入ガス流量の増加、雰囲気圧力の低下、シリコン融液の温度分布および対流の調整等の手段によって、簡単に上記酸素濃度範囲とすることが出来る。
【0024】
また、前述したように本発明では、CZ法または磁場印加CZ法によって窒素をドープしたシリコン単結晶棒を育成する際に、結晶成長中の冷却速度を1〜15℃/minに制御することが好ましい。実際にこのような結晶製造条件を実現するためには、例えば結晶の引上げ速度を調整して結晶の成長速度を増減させる方法により行なうことが可能である。あるいは、CZ法または磁場印加CZ法シリコン単結晶製造装置のチャンバー内において、結晶を任意の冷却速度で冷却することができる装置を設ければ良い。このような冷却装置としては、冷却ガスを吹き付けて結晶を冷却できる装置あるいは、融液面上の一定位置に、結晶を囲うように水冷リングを設ける等の方法を適用することができる。この場合、上記冷却法と結晶の引上速度を調整することによって、上記冷却速度範囲内とすることができる。
【0025】
このようにしてCZ法または磁場印加CZ法において、所望濃度の窒素がドープされ、所望濃度の酸素を含有し、所望の冷却速度で結晶成長がなされたシリコン単結晶棒を得ることができる。これを通常の方法にしたがい、内周刃スライサあるいはワイヤソー等の切断装置でスライスした後、面取り、ラッピング、エッチング、研磨等の工程を経てシリコン単結晶ウエーハに加工する。もちろん、これらの工程は例示列挙したにとどまり、この他にも洗浄等種々の工程があり得るし、工程順の変更、一部省略等目的に応じ適宜工程は変更使用されている。
【0026】
そして、このようにして得られたシリコン単結晶ウエーハは、空孔型欠陥(以下、ボイド系欠陥ともいう)の体積をV、表面積をSとし、体積Vを持つ該空孔型欠陥と同じ体積を持つ球型欠陥を仮定した場合の該球型欠陥の半径をRとした時に 0.2≧V/S/R の関係を満すシリコン半導体基板が得られる。その後のゲッタリング熱処理および/またはデバイス製造熱処理において熱処理を施すことにより、工業的に生産性に優れ、かつデバイス不良を発生させない程度まで表層のボイド系欠陥を低減させることができる。
【0027】
本発明において、空孔型欠陥の体積を規定しているが、実施例では体積Vおよび表面積SはTEMの試料を傾斜させ、三次元的に空孔型欠陥の形状を測定して求めた値であり、また半径RはこのTEM観察により求められた体積をVとした時にV=4πR3/3の関係式から計算により求めたものである。
【0028】
また、本発明によるシリコン半導体基板は、二次イオン質量分析法(SIMS)による窒素分析において測定を行い。その窒素濃度は1×1014atoms/cm3〜1×1016atoms/cm3である。そして、後述するように、シリコン単結晶中の空孔型欠陥は、添加された窒素濃度と引上げ時にそのシリコン単結晶が1100℃の温度域を通過する時の冷却速度によりその形態が八面体から板状さらには板または/かつ板状の変形率の大きいものから酸素析出物(全面OSF領域)となる。この領域のうち、八面体以外の形態の空孔型欠陥は、同じ体積を持つ従来の八面体空孔型欠陥系に比べて空孔型欠陥の表面積が大きくなることから、その後の熱処理で点欠陥である空孔の拡散が促進され、表面の無欠陥層を作りやすくなる。したがって、八面体空孔型欠陥に比べて表面積が増加した板状さらには板または/かつ棒状の空孔型欠陥体積と表面積の比の範囲としては条件式 0.2≧V/S/R の関係を満たす形状の空孔型欠陥に熱処理前の状態で制御すれば良く、上記関係式を満たせば、その後の熱処理によりその空孔型欠陥を消滅させやすく出来る。そして、該条件を満足するために必要な窒素添加量は少なくとも本発明条件である1×1014atoms/cm3〜1×1016atoms/cm3が必要である。
【0029】
さらに該ボイド系欠陥を熱処理により消滅しやすくしたシリコン半導体基板は、非酸化性雰囲気中、例えば水素、窒素、アルゴン、ヘリウム、これらのガスの1種または2種以上の混合ガス等の雰囲気中で熱処理する以前において、冷却速度が5℃/分以上のときは酸素濃度が9.5×1017atoms/cm3以下、かつ窒素濃度が5×1014〜1×1016atoms/cm3であることが好ましい。また、冷却速度が1℃/分以上5℃/分未満では、8.5×1017atoms/cm3以下、窒素濃度が1×1015〜1×1016atoms/cm3であることが望ましい。そして、それぞれの窒素濃度に制御されたシリコン半導体基板中の空孔型欠陥の体積を球型とした時に冷却速度が5℃/分以上のときはその半径RがR≦30nm、冷却速度が1℃/分以上5℃/分未満の時はその半径RがR≦75nmであることが望ましい。
【0030】
ここで、冷却速度が1℃/分以上5℃/分未満と冷却速度が5℃/分以上で場合分けをしているのは、おおむね冷却速度5℃/分を境として、空孔型欠陥の八面体から板状、棒状を経る形態変化を引き起こす窒素濃度が変化し、同じ窒素添加量で見た場合、前者の方が表面積をより増加させる傾向があり、より大型の空孔型欠陥であってもその後の熱処理での空孔型欠陥の消滅効果は大きくなる。したがって、本発明における空孔型欠陥を球形と仮定した時の半径Rは前者の遅い冷却速度の場合の方がより大きい値を許容できる。
【0031】
さらに、酸素濃度範囲を本発明記載ように冷却速度で場合分けしているのは、冷却速度が遅いほど空孔型欠陥の内壁にシリコン酸化膜が成長しやすく、空孔型欠陥が消滅するためには、初期段階としてこの内壁酸化膜を全て拡散消滅させる必要があるためである。このことから、冷却速度が遅い場合は該内壁酸化膜を薄くする必要がある。すなわち、空孔型欠陥の消滅のためになされる熱処理前のシリコン半導体基板中の酸素濃度を冷却速度が速い場合よりも低く制限する必要がある。実際には後述する本発明の範囲に熱処理前のシリコン半導体基板の酸素濃度を限定することが望ましい。
【0032】
CZ法または磁場印加CZ法により冷却速度が1℃/分以上、好ましくは1〜15℃/分で育成したシリコン単結晶から得たシリコン半導体基板のうち、本発明記載の熱処理を実施する前に0.2≧V/S/Rの関係を満たすシリコン半導体基板は、前記非酸化性雰囲気中にて1150℃以上、好ましくは1150〜1250℃の温度で、1時間以上、好ましくは最高到達温度が1150℃では2〜4時間、最高到達温度1200〜1250℃では1〜2時間熱処理することにより表層に空孔型欠陥のないデバイス歩留まりの優れた無欠陥層を有するシリコン半導体基板が得られる。
【0033】
本発明の目的とするシリコン半導体基板表層で空孔型欠陥を消滅させたシリコン半導体基板を得るために、空孔型欠陥の消滅しやすい形状である条件0.2≧V/S/Rを満たすためには、熱処理前のシリコン半導体基板中に窒素を1×1014〜1×1016atoms/cm3含有させれば良く、シリコン半導体基板中に該窒素濃度が添加されるためには、引き上げ時に、2×1017〜1.5×1019atoms/cm3の窒素を含有するシリコン融液を用いてCZ法または磁場印加CZ法により引き上げれば良い。そしてこのシリコン単結晶引上げ時の1100℃の温度域を通過する時の冷却速度が1℃/分以上であれば良い。さらにより好ましくは窒素濃度と冷却速度をそれぞれ限定した方が、空孔型欠陥の消滅を目的とした熱処理後にシリコン基板表面の空孔型欠陥の消滅領域をより深い領域まで確保できる。その限定は冷却速度が1℃/分以上5℃/分未満の場合は、シリコン半導体基板中で窒素濃度1×1015〜1×1016atoms/cm3、該濃度の窒素添加がされるためには引き上げ時のシリコン融液中では1×1018〜1.5×1019atoms/cm3であることが望ましい。また、冷却速度が5℃/分以上の場合はシリコン半導体基板中で窒素濃度5×1014〜1×1016atoms/cm3、該濃度の窒素添加がされるためには引き上げ時のシリコン融液中では2×1017〜1.5×1019atoms/cm3であることが望ましい。そして該条件にて育成したシリコン単結晶から得たシリコン半導体基板を、前記非酸化性雰囲気中にて1150℃以上、好ましくは1150〜1250℃の温度で、1時間以上、好ましくは最高到達温度が1150℃では2〜4時間、最高到達温度1200〜1250℃では1〜2時間熱処理することにより表層に空孔型欠陥のないデバイス歩留まりの優れた半導体基板が得られる。
【0034】
また、前述した通り空孔型欠陥の内壁酸化膜も制御する必要があり、引き上げ時に冷却速度が1℃/分以上5℃/分未満の場合は熱処理前の酸素濃度が8.5×1017atoms/cm3以下が望ましく、冷却速度が5℃/分以上の場合は、熱処理前の酸素濃度が9.5×1017atoms/cm3以下であることが望ましい。
【0035】
また、本発明によれば、前記半径RがR≦30nmである前記シリコン半導体基板を、前記非酸化性雰囲気で1200℃以上、好ましくは1200〜1250℃での熱処理を行ない、該熱処理により半導体基板中心の表面から1μm深さでの酸素濃度が6×1016atoms/cm3以下であり、二次イオン質量分析法(SIMS)による窒素濃度測定において該シリコン基板深さ中心に平均信号強度2倍以上の濃度を示す窒素偏析による局所濃化部を持つようにシリコン半導体基板を製造した場合、表面から少なくとも5μm以上かつ12μm未満の深さの表層無欠陥層を持ち、さらに酸素析出物密度がシリコン基板中央部の深さ中心で1×109個/cm3以上であるデバイス歩留まりの良い、ゲッタリング特性に優れたシリコン半導体基板を製造できる。
【0036】
また、本発明によれば前記半径RがR≦75nmである前記シリコン半導体基板を、前記非酸化性雰囲気で1200℃以上、好ましくは1200〜1250℃での熱処理を行なうことにより、半導体基板中心の表面から1μm深さでの酸素濃度が5×1016atoms/cm3以下であり、二次イオン質量分析法(SIMS)による窒素濃度測定において該シリコン基板深さ中心に平均信号強度の2倍以上の濃度を示す窒素偏析による局所濃化部を持つようなシリコン半導体基板を製造した場合、表面から少なくとも5μm以上かつ12μm未満の深さの表層無欠陥層を持ち、さらに酸素析出物密度がシリコン基板中央部の深さ中心で5×108個/cm3以上であるデバイス歩留まりに優れ、かつゲッタリング特性の優れたシリコン半導体基板を製造できる。
【0037】
【実施例】
以下、本発明を、実施例および比較例を挙げてより具体的に説明するが、本発明はこれらに限定されるものではない。
【0038】
CZ法により、直径6インチウエーハの場合は18インチ、また8インチウエーハの場合は22インチ、12インチウエーハの場合は24インチの石英ルツボに、原料多結晶シリコンをチャージし、表1に示すように、直径6インチおよび8インチ、12インチ、P型、方位<100>、抵抗率8.5〜11.5Ω・cmのシリコン単結晶棒を、窒素濃度、酸素濃度、平均SLおよび冷却速度の条件を変えて調製した。
【0039】
窒素ドープ量の制御は、原料中に予め所定量の窒化珪素膜を有するシリコンウエーハを投入しておくことにより行なった。酸素濃度の制御は、引き上げ中ルツボ回転を制御することにより行なった。冷却速度の制御は、単結晶棒の引上げ速度を変化させ、結晶の成長速度を変化させることにより行なった。得られたシリコン単結晶棒の測定値は、表1に示すとおりであった。
【0040】
【表1】
Figure 0004549589
【0041】
このようにして得られた単結晶棒から、ワイヤソーを用いてウエーハを切り出し、面取り、ラッピング、エッチング、鏡面研磨加工を施して、窒素のドープ量、酸素濃度及び冷却速度以外の条件はほぼ同一としたシリコン単結晶鏡面ウエーハを各々複数枚作製した。
【0042】
そしてこのようにして得られたシリコン単結晶ウエーハに空孔型欠陥消滅およびゲッタリング熱処理を目的とした熱処理を施した。この場合の熱処理は、シリコン単結晶ウエーハを水素20容量%とアルゴン80容量%から成る雰囲気下で、800〜1000℃の温度域では、8℃/minの昇温率、1000〜1100℃の温度域では4℃/minの昇温率、1100〜1150℃の温度域では1℃/minの昇温率、1150〜1200℃の温度域では1℃/minの昇温率で昇温し、最高到達温度が1150℃では4時間または8時間保持または1200℃では30分から2時間保持した後、1200〜1150℃の温度域では1℃/minの降温率、1150〜1100℃の温度域では1℃/minの降温率、1100〜800℃の温度域では4℃/minの降温率で冷却することにより行なった。なお、この熱処理の際の非酸化性雰囲気はアルゴンおよび水素容量%の比率を変えても同様であり、極端にはアルゴン100容量%であっても良い。
【0043】
ついで、これらのシリコン単結晶ウエーハの無欠陥層深さを評価した。この無欠陥層深さの評価は、まず表面再研磨を行い、表面からの研磨除去量を変えたウエーハを準備した。そして、SC−1混合液(アンモニア水(NH4OH)と過酸化水素水(H22)及び超純水の1:1:20の混合液)にて、ウエーハを温度約80℃で1時間洗浄することにより微小なCOPを顕在化させ、ウエーハ表面をKLA/Tencor社製SP1パーティクル測定装置にて、そのウエーハ表面に存在する大きさが0.10μm以上のCOP(Crystal Originated Particle)について、COP数をカウントすることによって測定する。そして、このSC−1混合液による洗浄を10回繰り返し、洗浄前のCOP数から10回洗浄後に測定したCOP数の増加分を、SC−1混合液でエッチングにより除去した体積で除し、COP体積密度を計算する。研磨除去は除去量の狙いとして、1,3,5,7,10,12μmの深さまで行なった。
【0044】
また、無欠陥層深さについては、上記と同様に、表面からの研磨除去量を変えたウエーハについて、酸化膜耐圧品質を評価することによっても行なった。酸化膜耐圧品質評価は、TZDB(Time Zero Dielectric Breakdown)のCモード収率、詳しくはリンドープポリシリコン電極(酸化膜厚25nm、電極面積20mm2)を作製し、判定電流値100mA/cm2で評価した絶縁破壊電界11MV/cm以上のものを良品として、ウエーハ面内の全ての電極を測定した場合の良品率を調べた。
【0045】
実施例1(直径6インチウエーハ)
請求項1項記載の空孔型欠陥形状の関係式 0.2≧V/S/R を満たす例を【表2】に示す。
空孔型欠陥(以下ボイド)体積は、単結晶体Qから加工したウエーハの方がやや大きいにもかかわらず、ボイド変形率(V/S/R)が高いため、5μm深さでのTZDB合格率(100mAを印加した時に、ウエーハの全セル中に占める11MV/cm以上のセルの比)が高いことが確認された。このことから、本請求項1で規定したボイド変形率の範囲にボイドの形態変化を制御すれば、ウエーハに加工後の熱処理において空孔型欠陥を消滅させやすいといえる。
【0046】
実施例2(直径6インチウエーハ)
請求項3(請求項1および2も満たす)の熱処理前ウエーハを使用し、請求項7(請求項5および6も満足する)の条件内のシリコン半導体基板の実施例を以下の【表3】に示す。
本発明の規定している窒素濃度および酸素濃度、冷却速度が本発明の範囲を満たしていることから、請求項1のボイド形態変化の関係式0.2≧V/S/Rを満たすとともに、空孔型欠陥の存在する無欠陥層深さ(表中ではCOP DZと表記)が従来よりも深い領域まで達成できている。なお、このCOP DZ層には酸素析出物欠陥は観察されていなかった。
【0047】
なお、COP DZの定義はSC-1繰り返し洗浄によるCOP体積密度が2×105個/cm3以下であり、かつTZDB評価により100mA/cm2を印加した時の11MV/cm以上を満たす領域が90%以上を満たす深さである。
【0048】
比較例1(直径6インチウエーハ)
本発明の請求項3(請求項1および2についても)を満足しない熱処理前のシリコン半導体基板を使用し、請求項7を満たす条件で熱処理を実施した場合の熱処理後のシリコン半導体基板についてCOP DZを確認した結果を【表4】に示す。
【0049】
その結果、本比較例においては、窒素濃度が請求項2および3を満足しないため請求項1を満たさないことにより、前述した実施例2に比べてCOP DZが従来並に浅いことが確認された。
【0050】
実施例3(直径8インチウエーハ)
請求項4(請求項1および2も満たす)の熱処理前ウエーハを使用し、請求項8(請求項5および6も満足する)の条件内のシリコン半導体基板の実施例を以下の【表5】のインゴット(IGの列)H,Iに示し、請求項1を満たすシリコン半導体基板の実施例をインゴットOで確認した。
【0051】
その結果、本発明の規定している熱処理を実施する前の窒素濃度および酸素濃度、冷却速度が発明記載の条件を満たしていることから、請求項1のボイド形態変化の関係式0.2≧V/S/Rを満たしており、上記表5の実施例において、空孔型欠陥の存在する無欠陥層深さ(表中ではCOP DZと表記)が従来よりも深い領域まで達成できている。なお、このCOP DZ層内には酸素析出物欠陥は観察されていなかった。なお、インゴットH,Iにおいては請求項4に規定した窒素濃度範囲を満足しているが、インゴットOは満足せず、請求項1のみ満たしている。このため、熱処理時間が不十分であるとCOP DZは浅くなっている。
【0052】
比較例2(直径8および12インチウエーハ)
本発明の規定範囲を満たさない比較例を以下の【表6】に示す。本比較例において窒素濃度が本発明の範囲外であるため、ボイド形態変化の関係式0.2≧V/S/Rを満足していない。この比較例は従来技術の発明の範囲であり、前述した実施例3に比べてCOP DZが非常に浅くなっている。
【0053】
ここでインゴットMは8インチであるが、冷却速度が低く、Pは12インチであり、前述した非酸化性雰囲気で1150℃の熱処理を8時間行っても、ボイド体積が大きいためボイドが消滅しにくい。このようにシリコン半導体基板の口径が大型化するほどボイドは消滅させにくくなり、本発明の効果が必要であることが示唆される。
【0054】
比較例3(直径8インチウエーハ)
【0055】
【表7】に本発明の請求項1は満足するが、請求項4を満足しない熱処理前シリコン半導体基板を使用し、請求項8の熱処理条件を実施した例を示す。
【0056】
上記条件ではボイド形態が本発明の請求項1の規定範囲の変化を起しているが、ボイド体積が大きすぎて熱処理でボイドの消滅がしにくい。従って、より望ましいのは前述した実施例3に示したように窒素濃度を請求項4の範囲にすることがより望ましいことが示されている。しかし、先の比較例2で示したような本発明請求項1記載のボイド形態変化を起していない場合(窒素無添加材の熱処理後ウエハ)に比べて、より深い領域までCOP DZが広がっている。
【0057】
以上の実施例および比較例から、より深いCOP DZを持シリコン半導体基板を製造するには本発明の請求項1を満たし、さらに請求項4に記載の窒素濃度、酸素濃度、冷却速度の範囲の熱処理前ウエーハを使用して、請求項8記載の熱処理条件で熱処理をすることが望ましいことが解る。
【0058】
実施例5(直径6,8,12インチウエーハで最高到達温度1200℃の場合)
本発明の請求項9および10に記載した発明に対しての実施例であり、10μm程度までの非常に深いCOP DZを実現できるシリコン半導体基板を提供することを目的とする。さらに、請求項7および8と同程度の深さのCOP DZを実現すると共に、製造時間の短縮化も実現することも目的とした実施例を【表8】に示す。
【0059】
請求項9および10は本発明の請求項3および4を満たす熱処理前シリコン半導体基板を使用し、請求項9および10の熱処理をすることにより、COP DZが5μm以上12μm未満のシリコン半導体基板の製造技術である。
【0060】
【表8】において、インゴットAおよびCのように請求項3を満たす熱処理前シリコン半導体基板を請求項9記載の熱処理を実施したところ、COP DZは全て5μm以上12μm未満であった。なお、この時の表面から1μm深さの酸素濃度を二次イオン質量分析法(SIMS)で測定したところ、6×1016atoms/cm3以下であった。そして不純物ゲッタリングに有効な酸素析出物密度をBMDアナライザーで測定したところ、1×109個/cm3以上であった。
【0061】
また、インゴットH,I,Oのように請求項4を満たす熱処理前シリコン半導体基板を請求項10記載の熱処理を実施したところ、COP DZは全て5μm以上12μm未満であった。なお、この時の表面から1μm深さの酸素濃度を二次イオン質量分析法(SIMS)で測定したところ、5×1016atoms/cm3以下であった。そして不純物ゲッタリングに有効な酸素析出物密度をBMDアナライザーで測定したところ、1×109個/cm3以上であった。
【0062】
また、請求項7および8との比較がしやすいように、表8の結果をまとめた。
つまり実施例1および2のように熱処理温度が1150℃で熱処理をした場合と、1200℃で熱処理をした場合の熱処理時間比の比較を行い、その結果を【表9】に示した(1150℃×4時間を1とした時の比率で表記)。なお、熱処理時間とは6インチの場合は800℃にて炉内挿入、8インチ、12インチの場合は700℃挿入し、1150℃および1200℃までの昇温および降温の時間を含んでいる。
【0063】
【表2】
Figure 0004549589
【0064】
【表3】
Figure 0004549589
【0065】
【表4】
Figure 0004549589
【0066】
【表5】
Figure 0004549589
【0067】
【表6】
Figure 0004549589
【0068】
【表7】
Figure 0004549589
【0069】
【表8】
Figure 0004549589
【0070】
【表9】
Figure 0004549589
【0071】
上記【表9】の通り、請求項1のようなボイドの表面積が大きくなり、ボイドの体積が請求項3および4になったウエーハを使用し、本発明の条件にて1200℃の温度で熱処理をすると、同一ウエーハ径で比較した場合、アニール工程時間が同じであればCOP DZを広くできたり、同程度のCOP DZを実現しようとすれば熱処理工程時間の短縮が図れるという品質および生産性に適したシリコン半導体基板を作成可能となる。
【0072】
また、ウエーハ径が大型化し、ボイド体積が大型化しても5μmという十分深い表層無欠陥層(COP DZ)を達成できる。
【0073】
なお、本明細において、COP DZとは繰り返し洗浄によるCOP体積密度が2×105個/cm3以下であり、かつTZDB合格率90%以上を満たした時にその深さの無欠陥性有りと定義しており、むろんこの領域には不純物ゲッタリングに有用な酸素析出物は見られない。
【0074】
【発明の効果】
以上述べたように、本発明によるシリコン半導体基板は、アニール材による空孔欠陥の消滅しやすい範囲に窒素添加量および酸素濃度、引き上げ時の1100℃の温度域を通過する時の冷却速度を特定の範囲にすることによりデバイス歩留まりの良い高品質シリコン半導体基板を製造することができる。また、製造時間の短縮化も実現できる。

Claims (3)

  1. 1×1017atoms/cm以上かつ1.5×1019atoms/cm以下の窒素を含有するシリコン融液を用いてチョクラルスキー法または磁場印加チョクラルスキー法によりシリコン単結晶引上げ時の1100℃の温度域を通過する時の冷却速度が1℃/分以上で育成したシリコン単結晶から得た、チョクラルスキー法または磁場印加チョクラルスキー法により育成したシリコン単結晶から得たシリコン半導体基板であって、空孔型欠陥の体積をV、表面積をSとし、体積Vを持つ該空孔型欠陥と同じ体積を持つ球型欠陥を仮定した場合の該球型欠陥の半径をRとした時に、0.2≧V/S/Rの関係を満たし、窒素を1×10 14 atoms/cm 以上かつ1×10 16 atoms/cm 以下で含有することを特徴とするシリコン半導体基板を、非酸化性雰囲気中にて1150℃以上の温度で少なくとも1時間以上熱処理することを特徴とするシリコン半導体基板の製造方法。
  2. 5×1017atoms/cm以上かつ1.5×1019atoms/cm以下の窒素を含有するシリコン融液を用いてチョクラルスキー法または磁場印加チョクラルスキー法によりシリコン単結晶引上げ時の1100℃の温度域を通過する時の冷却速度が5℃/分以上で育成したシリコン単結晶から得た、チョクラルスキー法または磁場印加チョクラルスキー法により育成したシリコン単結晶から得たシリコン半導体基板であって、空孔型欠陥の体積をV、表面積をSとし、体積Vを持つ該空孔型欠陥と同じ体積を持つ球型欠陥を仮定した場合の該球型欠陥の半径をRとした時に、0.2≧V/S/Rの関係を満たし、酸素濃度が9.5×10 17 atoms/cm 以下であり、かつ窒素濃度が5×10 14 atoms/cm 以上かつ1×10 16 atoms/cm 以下であるシリコン半導体基板中の空孔型欠陥の体積を球型とした時にその半径RがR≦30nmであることを特徴とするシリコン半導体基板を、非酸化性雰囲気中にて1150℃以上の温度で少なくとも1時間以上熱処理することを特徴とするシリコン半導体基板の製造方法。
  3. 1×1018atoms/cm以上かつ1.5×1019atoms/cm以下の窒素を含有するシリコン融液を用いてチョクラルスキー法または磁場印加チョクラルスキー法によりシリコン単結晶引上げ時の1100℃の温度域を通過する時の冷却速度が1℃/分以上かつ5℃/分未満で育成したシリコン単結晶から得た、チョクラルスキー法または磁場印加チョクラルスキー法により育成したシリコン単結晶から得たシリコン半導体基板であって、空孔型欠陥の体積をV、表面積をSとし、体積Vを持つ該空孔型欠陥と同じ体積を持つ球型欠陥を仮定した場合の該球型欠陥の半径をRとした時に、0.2≧V/S/Rの関係を満たし、酸素濃度が8.5×10 17 atoms/cm 以下であり、かつ窒素濃度が1×10 15 atoms/cm 以上かつ1×10 16 atoms/cm 以下であるシリコン半導体基板中の空孔型欠陥の体積を球型とした時にその半径RがR≦75nmであることを特徴とするシリコン半導体基板を、非酸化性雰囲気中にて1150℃以上の温度で少なくとも1時間以上熱処理することを特徴とするシリコン半導体基板の製造方法。
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