JP4135651B2 - 積層型正特性サーミスタ - Google Patents
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Description
実験例1においては、図1および図2を参照して説明した第1の実施形態についての評価を行なった。
実験例2においては、図3および図4を参照して説明した第2の実施形態についての評価を行なった。
実験例3においては、図5および図6を参照して説明した第3の実施形態についての評価を行なうため、以下のような試料21を作製した。
2 積層体
3 サーミスタ層
4,5 内部電極
6,7 端面
8,9 外部電極
13 空洞
19,22 開口
32 切り込み
Claims (13)
- 正の抵抗温度係数を有する、積層された複数のサーミスタ層をもって構成される積層体と、
前記積層体の外表面上の互いに異なる位置に形成される第1および第2の外部電極と
を備え、
前記積層体の内部であって複数の前記サーミスタ層間の所定の界面に沿って、各々複数の第1および第2の内部電極が、それぞれ、前記第1および第2の外部電極に電気的に接続されるように形成され、
前記第1および第2の内部電極は、各々の一部が前記サーミスタ層を挟んで互いに重なり合った状態で積層方向に交互に配置されている、
積層型正特性サーミスタであって、
前記第1および第2の内部電極間に電圧が印加されても発熱しない非発熱部分が、前記第1および第2の内部電極の配置部分における、積層方向に対して垂直な方向での中央部であって、積層方向での少なくとも中央部に設けられている、
積層型正特性サーミスタ。 - 前記非発熱部分は、少なくとも1つの前記サーミスタ層に空洞を設けることによって与えられる、請求項1に記載の積層型正特性サーミスタ。
- 前記非発熱部分は、前記第1および第2の内部電極の少なくとも一方の内部電極のうちの少なくとも1つに電極が形成されない部分を設けることによって与えられる、請求項1または2に記載の積層型正特性サーミスタ。
- 前記電極が形成されない部分は、前記内部電極に開口を設けることによって与えられる、請求項3に記載の積層型正特性サーミスタ。
- 前記電極が形成されない部分は、前記内部電極に切り込みを設けることによって与えられる、請求項3に記載の積層型正特性サーミスタ。
- 正の抵抗温度係数を有する、積層された複数のサーミスタ層をもって構成される積層体と、
前記積層体の外表面上の互いに異なる位置に形成される第1および第2の外部電極と
を備え、
前記積層体の内部であって複数の前記サーミスタ層間の所定の界面に沿って、各々複数の第1および第2の内部電極が、それぞれ、前記第1および第2の外部電極に電気的に接続されるように形成され、
前記第1および第2の内部電極は、各々の一部が前記サーミスタ層を挟んで互いに重なり合った状態で積層方向に交互に配置されている、
積層型正特性サーミスタであって、
前記第1および第2の内部電極が重なり合った部分における、積層方向に対して垂直な方向での中央部に位置する空洞が少なくとも1つの前記サーミスタ層に設けられ、前記空洞は、前記第1および第2の内部電極の配置部分における、積層方向での少なくとも中央部に位置されている、
積層型正特性サーミスタ。 - 前記空洞は、前記サーミスタ層を厚み方向に貫通するように設けられている、請求項6に記載の積層型正特性サーミスタ。
- 前記空洞の一方端面側に位置する前記内部電極には、前記空洞に連通する開口が設けられている、請求項7に記載の積層型正特性サーミスタ。
- 正の抵抗温度係数を有する、積層された複数のサーミスタ層をもって構成される積層体と、
前記積層体の外表面上の互いに異なる位置に形成される第1および第2の外部電極と
を備え、
前記積層体の内部であって複数の前記サーミスタ層間の所定の界面に沿って、各々複数の第1および第2の内部電極が、それぞれ、前記第1および第2の外部電極に電気的に接続されるように形成され、
前記第1および第2の内部電極は、各々の一部が前記サーミスタ層を挟んで互いに重なり合った状態で積層方向に交互に配置されている、
積層型正特性サーミスタであって、
前記第1および第2の内部電極の配置部分における、積層方向での少なくとも中央部に位置する前記第1および第2の内部電極のうちの少なくとも1つの前記内部電極には、前記第1および第2の内部電極が重なり合った部分における、積層方向に対して垂直な方向での中央部に、電極が形成されない部分が設けられている、
積層型正特性サーミスタ。 - 前記電極が形成されない部分は、前記内部電極に開口を設けることによって与えられる、請求項9に記載の積層型正特性サーミスタ。
- 前記電極が形成されない部分は、前記内部電極に切り込みを設けることによって与えられる、請求項9に記載の積層型正特性サーミスタ。
- 前記電極が形成されない部分は、すべての前記第1の内部電極またはすべての前記第2の内部電極に設けられている、請求項9ないし11のいずれかに記載の積層型正特性サーミスタ。
- 前記電極が形成されない部分は、すべての前記第1および第2の内部電極に設けられている、請求項9ないし11のいずれかに記載の積層型正特性サーミスタ。
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