JP3138866B2 - Tft−lcd駆動回路 - Google Patents
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Description
動に関し、特にTFT−LCDのドット反転、すなわち
画素ごとに極性を反転させて表示するためのソース駆動
回路に関する。
(LCD)の応用分野がモニタ、TV等の高画質が要求
される分野にまで広がるに従って、高画質が実現可能な
ドット反転方式の駆動方法が主な駆動方法として台頭し
てきた。しかしながら、ドット反転方式の場合、ソース
駆動回路から約10〜12V程度の高電圧を出力しなけ
ればならないため、出力端に高電圧素子を使用するか、
または一般的なCMOS工程で実施するためには特殊な
回路技法が要求されている。
FT−LCD駆動回路を添付図面に基づいて説明する。
図1は従来のTFT−LCD駆動回路の構成ブロック図
であり、図2は従来の出力バッファ回路の構成図であ
る。従来のTFT−LCD駆動回路は、図1に示すよう
に、入力されるグレーレベルを示す画像信号データを入
力して一定のレベルの信号にレベル変換(VSS〜V DDを
VSS2〜VDD2にレベル変換する)して出力する第1レベ
ルシフト部1と、第1レベルシフト部1から出力される
信号を(+)極性のアナログ画像信号に変換して出力す
る第1デジタル/アナログ変換器2と、第1デジタル/
アナログ変換器2の出力をサンプリングしてホールドす
る第1サンプルアンドホールド部3と、入力されるグレ
ーレベルを示す画像信号データを入力して一定のレベル
の信号にレベル変換(VSS〜VDDをVSS1〜VDD1にレベ
ル変換する)して出力する第2レベルシフト部4と、第
2レベルシフト部4から出力される信号を(−)極性の
アナログ画像信号に変換して出力する第2デジタル/ア
ナログ変換器5と、第2デジタル/アナログ変換器5の
出力をサンプリングしてホールドする第2サンプルアン
ドホールド部6と、外部から入力される極性(+、−)
信号を入力として一定のレベルの信号にレベル変換(V
SS〜VDDをVSS2〜VDD2にレベル変換する)してイネー
ブル「ハイ」信号を出力する第3レベルシフト部7と、
外部から入力される極性(+、−)信号を入力として一
定のレベルの信号にレベル変換(V SS〜VDDをVSS1〜
VDD1にレベル変換する)してイネーブル「ロー」信号
を出力する第4レベルシフト部8と、前記第3及び第4
レベルシフト部7、8のイネーブル信号に基づいて前記
第1サンプルアンドホールド部3及び第2サンプルアン
ドホールド部6の信号のうちのいずれか一つを選択して
出力する出力バッファ部9とを備える。
力バッファ部の構成を図2に示す。すなわち、第3レベ
ルシフト部7から出力されるイネーブル信号により第1
サンプルアンドホールド部3の出力をスイッチングする
第1トランジスタQ1と、第4レベルシフト部8から出
力されるイネーブル信号により第2サンプルアンドホー
ルド部6の出力をスイッチングする第2トランジスタQ
3と、第1、第2トランジスタQ1、Q3から出力され
る信号をそれぞれ所定の利得に増幅して出力する第3、
第4トランジスタQ2、Q4とから構成される。
−LCDのソース駆動回路の動作について説明する。グ
レーレベルを示す4ビットのデジタル映像信号を、第1
レベルシフト部1、第1デジタル/アナログ変換器2、
及び第1サンプルアンドホールド部3を介して所定のレ
ベル(VSS2〜VDD2)に変換させて(+)極性のアナロ
グ信号を生成し、グレーレベルを示す4ビットのデジタ
ル映像信号を第2レベルシフト部4、第2デジタル/ア
ナログ変換器5、及び第2サンプルアンドホールド部6
を介して所定のレベル(VSS1〜VDD1)に変換させて
(−)極性のアナログ信号を生成する。そして、外部か
ら入力される極性(+、−)信号を、第3、第4レベル
シフト部7、8でそれぞれVSS2〜VDD2レベル、VSS1
〜VDD1レベルに変換させて出力バッファ部9のイネー
ブル信号として出力する。出力バッファ部9は、第3、
第4レベルシフト部7、8から出力される信号に基づい
て第1、第2サンプルアンドホールド部3、6から出力
される信号のうち一つを選択してTFT−LCDのデー
タラインへ印加する。
ス駆動回路では、(+)極性映像信号を処理する回路部
と、(−)極性映像信号を処理する回路部をそれぞれ別
々に構成して、各回路部の電圧変化幅を5V以下に小さ
くして低電圧素子で各回路部を構成している。さらに、
出力端回路にシールドトランジスタ(shield transisto
r)を用いて、出力端回路を構成する各トランジスタの
ゲートとドレインとの間又はソースとドレインとの間に
高電圧がかからないようにして出力端を低電圧素子とし
て構成した。
TFT−LCDのソース駆動回路においては以下のよう
な問題点があった。1チャネルの映像信号を処理するに
あたって、(+)極性処理部と(−)極性処理部とが構
成されるため、回路のサイズが大きくなる。出力バッフ
ァ部で(+)極性の信号から(−)極性の信号にスイッ
チングするとき第4トランジスタQ4のソースとドレイ
ンとの間に瞬間的に高電圧が印加され、又(−)極性か
ら(+)極性の信号にスイッチングするとき第3トラン
ジスタQ2のソースとドレインとの間に瞬間的に高電圧
が印加されるため、これらのトランジスタが劣化し、信
頼性が低下する。本発明は上記した問題点を解決するた
めになされたものであり、その目的は、回路構成を単純
化し、且つ一般的なCMOS工程で実現できるTFT−
LCD駆動回路を提供することである。
の本発明のTFT−LCD駆動回路は、2チャネルのデ
ジタル映像信号を一時記憶して外部の極性信号に基づい
て(+)極性信号と(−)極性信号の順序を調節して出
力するミクシング部と、クロック信号の一周期長さのパ
ルスを順次に出力させるシフトレジスタと、前記シフト
レジスタから出力される信号に基づいて前記ミキシング
部から出力されるデジタル映像信号をラッチさせ、それ
ぞれ(+)極性信号処理部及び(−)極性信号処理部で
信号処理して出力するラッチ部と、各チャネル毎に前記
ラッチ部から出力される信号のレベルを所定のレベルに
変換して出力するレベルシフト部と、外部から入力され
る複数の基準電圧を、(+、−)極性信号に基づいて基
準電圧値の高い順序または低い順序に出力するパワース
イッチ部と、前記パワースイッチ部から出力される基準
電圧により、各チャネル毎にレベルシフタ部から出力さ
れるデジタル信号をアナログ信号に変換して出力するデ
ジタル/アナログ変換器と、(−)極性信号を処理する
キャパシタと(+)極性を処理するキャパシタとを備
え、(+)極性の処理時にデジタル/アナログ変換器1
6の出力値に一定値(Vx)を加える記憶部と、特定周
期毎に、記憶部の(+)極性を処理するキャパシタの両
端の電位差が一定値(Vx)を維持するように(+)極
性のキャパシタをリフレッシュさせるリフレッシュロジ
ック部と、記憶部から出力される値をそれぞれ増幅して
出力するバッファ部と、バッファ部の複数のバッファの
うち2個を一対として、その一対の一つの信号を選択し
て出力するスイッチング部と、を備えることを特徴とす
る。
動回路を添付図面に基づいてより詳細に説明する。図3
は本発明実施形態のTFT−LCD駆動回路の構成図、
図4は本実施形態のミキシング部の詳細回路部、図5は
本実施形態のパワースイッチ部の詳細回路図、図6は本
実施形態のパワースイッチ部の出力波形図、図7は本実
施形態のリフレッシュロジック部の概念図、図8は本実
施形態のスイッチング部の詳細回路図、図9は本実施形
態による図6のパワースイッチ部の出力値を示す表、図
10は本実施形態のデジタル/アナログ変換器の出力及
び記憶部の出力の説明図である。本発明のTFT−LC
D駆動回路は、図3に示すように、入力される2チャネ
ルのデジタル映像信号を一時記憶して外部の極性信号に
基づいて(+)極性信号と(−)極性信号の順序を調節
して出力するミキシング部11と、クロック信号の一周
期長さのパルスを順次出力させるシフトレジスタ部12
と、シフトレジスタ部12から出力される信号に基づい
てミキシング部11から出力されるデジタル映像信号を
ラッチして(+)極性信号処理部及び(−)極性信号処
理部でそれぞれ信号処理して出力するラッチ部13と、
TFT−LCDのチャネルに相応する個数のレベルシフ
トから構成され、各チャネル毎にラッチ部13から出力
される信号を所定のレベルに変換(VSS〜VDDをVSS1
〜VDD1のレベルに変換する)して出力するレベルシフ
ト部14と、外部から入力される複数の基準電圧を
(+、−)極性信号に基づいて基準電圧値の高い順序ま
たは低い順序で出力するパワースイッチング部15と、
TFT−LCDのチャネルに相応する個数のD/A変換
器から構成され、パワースイッチ部15から出力される
基準電圧により各チャネル毎にレベルシフト部14から
出力されるデジタル信号をアナログ信号に変換して出力
するデジタル/アナログ変換器16と、TFT−LCD
のチャネルに相応する個数のキャパシタ(C1、C2、
・・・)から構成され、(−)極性信号を処理するキャ
パシタと(+)極性を処理するキャパシタとに分けら
れ、(+)極性の処理時にデジタル/アナログ変換器1
6の出力値に一定値(Vx)を加える記憶部18と、特
定周期毎に、(+)極性を処理するキャパシタの両端の
電位差が一定値(Vx)を維持するように(+)極性の
キャパシタをリフレッシュさせるリフレッシュロジック
部17と、TFT−LCDのチャネルに相応する個数の
バッファから構成され、記憶部18から出力される値を
増幅して出力するバッファ部19と、TFT−LCDの
チャネルに相応する個数のスイッチング素子から構成さ
れ、バッファ部19の複数のバッファ中の隣り合うバッ
ファの出力のうち一つを選択して出力するスイッチング
部20とを備える。
アナログ変換器16、記憶部18、バッファ部19のそ
れぞれの素子中の奇数番目は(−)極性信号を処理する
部分で、偶数番目は(+)極性信号を処理する部分であ
る。
CD駆動回路の各部を更に詳細に説明する。まず、ミキ
シング部11は、図4に示すように、6ビットのデータ
をクロック信号(CLK,CLKB)によってラッチし
て出力する第1ラッチ素子21と、第1ラッチ素子21
の出力信号を第1ラッチ素子21と同じクロック信号に
よってラッチして出力する第2ラッチ素子22と、第1
ラッチ素子21の出力信号を第1ラッチ素子21の2分
周されたクロック信号(CLK2X,CLK2XB)に
よってラッチして出力する第3ラッチ素子23と、第2
ラッチ素子22の出力信号を第3ラッチ素子23と同じ
クロック信号(CLK2X,CLK2XB)によってラ
ッチして出力する第4ラッチ素子24と、極性信号(P
OL)をCON端に入力し、反転された極性信号(PO
L)をCONB端に入力し、第3、第4ラッチ素子2
3、24の出力信号のいずれかの信号を選択してラッチ
部13に出力するマルチプレクサ25と、極性信号(P
OL)を反転してマルチプレクサ25のCONB端に入
力するインバータ26とから構成される。この回路の入
出力タイミングを図11に示す。図中O、Eはそれぞれ
図3のO、Eに相当する。すなわち2チャネル分の信号
である。
に、外部から入力される基準電圧(Vref 5)を外部の
制御信号(CON1)によりスイッチングする第1スイ
ッチS1と、外部から入力される基準電圧(Vref 0)
を外部の制御信号(CON1B)によりスイッチングす
る第2スイッチS2と、外部から入力される基準電圧
(Vref 4)を外部の制御信号(CON1)によりスイ
ッチングする第3スイッチS3と、外部から入力される
基準電圧(Vref 1)を外部の制御信号(CON1B)
によりスイッチングする第4スイッチS4と、外部から
入力される基準電圧(Vref 3)を外部の制御信号(C
ON1)によりスイッチングする第5スイッチS5と、
外部から入力される基準電圧(Vref 2)を外部の制御
信号(CON1B)によりスイッチングする第6スイッ
チS6と、外部から入力される基準電圧(Vref 2)を
外部の制御信号(CON1)によりスイッチングする第
7スイッチS7と、外部から入力される基準電圧(Vre
f 3)を外部の制御信号(CON1B)によりスイッチ
ングする第8スイッチS8と、外部から入力される基準
電圧(Vref 1)を外部の制御信号(CON1)により
スイッチングする第9スイッチS9と、外部から入力さ
れる基準電圧(Vref 4)を外部の制御信号(CON1
B)によりスイッチングする第10スイッチS10と、
外部から入力される基準電圧(Vref 0)を外部の制御
信号(CON1)によりスイッチングする第11スイッ
チS11と、外部から入力される基準電圧(Vref 5)
を外部の制御信号(CON1B)によりスイッチングす
る第12スイッチS12と、第1、第2スイッチS1、
S2から出力される信号を外部の制御信号(CON2)
によりスイッチングする第13スイッチS13と、第
3、第4スイッチS3、S4から出力される信号を外部
の制御信号(CON2)によりスイッチングする第14
スイッチS14と、第5、第6スイッチS5、S6から
出力される信号を外部の制御信号(CON2)によりス
イッチングする第15スイッチS15と、第7、第8ス
イッチS7、S8から出力される信号を外部の制御信号
(CON2)によりスイッチングする第16スイッチS
16と、第9、第10スイッチS9、S10から出力さ
れる信号を外部の制御信号(CON2)によりスイッチ
ングする第17スイッチS17と、第11、第12スイ
ッチS11、S12から出力される信号を外部の制御信
号(CON2)によりスイッチングする第18スイッチ
S18と、第13、第14、第15、第16、第17、
第18スイッチS13、S14、S15、S16、S1
7、S18の出力を出力端とする第1、第2、第3、第
4、第5、第6出力端V05、V04、V03、V0
2、V01、V00の間にそれぞれ接続され、外部の制
御信号(CON2B)によりそれぞれの隣接する出力端
を等電位にスイッチングする第19、第20、第21、
第22、第23スイッチS19、S20、S21、S2
2、S23とから構成される。
シタC1は一方のノードは接地されており、他方のノー
ドはDACの出力及びバッファ部19の入力端に連結さ
れている。そして、偶数番目の(+)極性信号処理部分
のキャパシタC2はDACの出力端とバッファ部19の
入力端との間に連結されている。
れる信号を増幅する役割を果たす。(−)極性信号処理
部には(−)極性を増幅するN−BUFがあり、(+)
極性信号処理部には(+)極性を増幅するP−BUFが
配置されており、各々の動作電圧はVSS1〜VDD1とV
SS2〜VDD2である。このVSS1〜VDD1とVSS2〜VDD2は
それぞれ(−)信号と(+)信号範囲を含んでおり、5
Vの範囲以内である。
ように、外部のローのコントロール信号(CONL、C
ONLB)によりロー信号をスイッチングする第1伝送
ゲート31と、外部のコントロール信号(CONL,C
ONLB)により共通電圧(VCOM)をスイッチング
する第2伝送ゲート32と、外部のハイのコントロール
信号(CONH,CONHB)によりハイ信号をスイッ
チングする第3伝送ゲート33と、外部のハイのコント
ロール信号(CONH,CONHB)により共通電圧
(VCOM)をスイッチングする第4伝送ゲート34
と、共通電圧(VCOM)信号により第1、第2伝送ゲ
ート31、32の出力信号をスイッチングして出力する
NMOSトランジスタ35と、共通電圧(VCOM)信
号により第3、第4伝送ゲート33、34の出力信号を
スイッチングして出力するPMOSトランジスタ36と
から構成される。このスイッチング部20は、要するに
バッファ部19の2個のバッファを一対としてその一対
のいずれかを選択して出力するものである。
−LCD駆動回路の動作について以下に説明する。ミキ
シング部11は、コントローラ(図示せず)から入力さ
れる2チャネル分のデジタル映像信号を記憶したのち、
図11に示すように、極性(POL)信号に基づいて
(+)極性信号はラッチ部13の(+)極性信号処理部
に入力され、(−)極性信号はラッチ部13の(−)極
性信号処理部に入力されるように、ラッチ部13に入力
される順序を調節する。すなわち、1チャネルの映像信
号は第1、第3ラッチ素子21、23を介し、別のチャ
ネルの映像信号は第2、第4ラッチ素子22、24を介
して、極性信号(POL)に基づいてマルチプレクサ2
5によりラッチ部13の(+)極性信号処理部または
(−)極性信号処理部に入力される。そして、シフトレ
ジスタ部12は、クロック信号(CLK)の一周期長さ
のパルスを順次出力させ、次段のラッチ中の一つをイネ
ーブルさせることにより、ミキシング部11の出力をラ
ッチ部13に順次入力させる。
ら出力されるイネーブル信号により、ミキシング部11
から入力される映像信号を1チャネルずつ(+)極性信
号処理部と(−)極性信号処理部で順次処理してそれぞ
れのチャネルでレベルシフト部14へ出力する。その
際、(+)極性信号処理部で処理された信号は偶数番目
のレベルシフトへ出力し、(−)極性信号処理部で処理
された信号は奇数番目のレベルシフトへ出力する。レベ
ルシフト部14は、ラッチ部13から出力されるデジタ
ル映像信号のレベルを各チャネル毎にVSS〜VDDからV
SS1〜VDD1のレベルに変換して出力する。
ような制御信号のタイミングにより、図9のように出力
端からの基準電圧値の大きさの順序が逆順になるように
出力する。つまり、CON1、CON2が「ハイ」の区
間ではVref 5からVref 0の順に出力され、CON2
が「ロー」、CON2Bが「ハイ」の区間ではすべて短
絡され、CON1B、CON2が「ハイ」の区間ではV
ref 0からVref 5の順に出力され、CON2Bが「ハ
イ」の区間では再度すべての信号が短絡されるようにす
る。すなわち、デジタル/アナログ変換器16へ供給す
る基準電圧を(+)極性チャネルと(−)極性チャネル
とで逆順になるように供給する。デジタル/アナログ変
換器16は、パワースイッチ部15から入力される基準
電圧値を用いて、レベルシフト部14から出力されるデ
ジタル信号をアナログ信号に変換して出力する。すなわ
ち、図10に示すように、入力される基準電圧に基づい
て大きさは同じで且つ位相は反対である信号を出力す
る。
シタC1は、一方のノードは接地されており、他方のノ
ードはDACの出力とバッファ部19の入力端に連結さ
れている。これにより、DACの出力をそのままバッフ
ァ部19の入力端へ伝達し、DACの出力端がハイイン
ピダンス状態のときには以前の出力電圧を維持する。偶
数番目の(+)極性信号処理部分のキャパシタC2はD
ACの出力端とバッファ部19の入力端との間に連結さ
れており、リフレッシュロジック部17により常に両端
の電位差が一定値(Vx)に維持される。このVxはD
ACの出力に加えられて(+)極性の映像信号を作るた
めの補償電圧である。よって、キャパシタC2は、DA
Cの出力にVxの電圧を加えてバッファ部19へ伝達す
る電圧加算器の役割を果たし、キャパシタC1と同様に
DACの出力端がハイインピダンス状態のときには以前
の出力値を維持する。すなわち、図10に示すように、
(+)極性の場合にはVxだけ加えられる。
れる信号をそれぞれ(−)極性増幅及び(+)極性増幅
を行う。最後に、スイッチング部20は、(+)極性信
号と(−)極性信号とをラインに応じて変える。つま
り、ドット反転方式は、奇数番目のラインでは+、−、
+、−の順に、偶数番目のラインでは−、+、−、+の
順に表示されるため、ラインに応じてバッファ部19の
バッファを2個一対とし、それらを切り換えてそれぞれ
のチャネルに出力している。
2チャネル信号を入力して、1チャネルの信号は(+)
極性信号処理部に与え、別の1チャネルの信号は(−)
極性信号処理部に与えて、それぞれ該当極性で処理す
る。そして、パワースイッチ部15及びデジタル/アナ
ログ変換器16では該当極性のアナログ信号を出力さ
せ、記憶部18及びリフレッシュロジック部17ではド
ット反転方式の駆動原理に基づいて(+)極性と(−)
極性を生成し、スイッチング部20ではラインに応じて
チャネルの極性順序を変える。
LCD駆動回路においては以下のような効果がある。5
V以下で駆動できるため、一般的なCMOS工程でドッ
ト反転用の駆動回路を実現することができる。1チャネ
ルの信号を処理するにあたって、従来では2つの信号処
理部及びデジタル/アナログ変換素子を必要としたが、
本発明では一つのデジタル/アナログ変換素子のみで実
現できる。このため、チップ面積を大幅に減少させるこ
とができる。出力端がスイッチングする前に一定の期間
にわたってすべてのデータラインを共通電圧(VCO
M)端子に連結して、電荷分配(charge sharing)効果
を得ることができるため、消費電力を減少させることが
できる。
ク図。
構成図。
図。
路図。
ロール信号出力波形図。
念図。
図。
出力値を示す図。
器の出力及び記憶部の出力の説明図。
す図。
Claims (7)
- 【請求項1】 2チャネルのデジタル映像信号を一時記
憶して外部の極性信号に基づいて(+)極性信号と
(−)極性信号の順序を調節して出力するミクシング部
と、 クロック信号の一周期長さのパルスを順次に出力させる
シフトレジスタと、 前記シフトレジスタから出力される信号に基づいて前記
ミキシング部から出力されるデジタル映像信号をラッチ
させ、ミキシング部からの(+)極性信号を(+)極性
信号処理部で及び(−)極性信号を(−)極性信号処理
部でそれぞれ信号処理して出力するラッチ部と、 各チャネル毎に前記ラッチ部から出力された信号のレベ
ルを所定のレベルに変換して出力するレベルシフト部
と、 外部から入力される複数の基準電圧を、(+)、(−)
極性信号に基づいて基準電圧値の高い順序または低い順
序に出力するパワースイッチ部と、 前記パワースイッチ部から出力される基準電圧により、
各チャネル毎にレベルシフタ部から出力されるデジタル
信号をアナログ信号に変換して出力するデジタル/アナ
ログ変換器と、 (−)極性信号を処理するキャパシタと(+)極性を処
理するキャパシタとを備え、(+)極性の処理時にデジ
タル/アナログ変換器16の出力値に一定値(Vx)を
加える記憶部と、 特定周期毎に、記憶部の(+)極性を処理するキャパシ
タの両端の電位差が一定値(Vx)を維持するように
(+)極性のキャパシタをリフレッシュさせるリフレッ
シュロジック部と、 記憶部から各チャネルごとに出力される値をそれぞれの
バッファで増幅して出力するバッファ部と、 バッファ部の複数のバッファのうち2個を一対として、
その一対の一つの信号を選択して出力するスイッチング
部と、を備えることを特徴とするTFT−LCD駆動回
路。 - 【請求項2】 前記レベルシフト部、デジタル/アナロ
グ変換器、記憶部、バッファ部は、それぞれチャネルに
相応する個数の素子から構成され、各部の奇数番目は
(−)極性信号を処理する部分であり、偶数番目は
(+)極性信号を処理する部分であることを特徴とする
請求項1に記載のTFT−LCD駆動回路。 - 【請求項3】 前記ミキシング部は、 6ビットのデータをクロック信号(CLK、CLKB)
によりラッチして出力する第1ラッチ素子と、 前記第1ラッチ素子の出力信号を第1ラッチ素子と同じ
クロック信号によりラッチして出力する第2ラッチ素子
と、 前記第1ラッチ素子の出力信号を第1ラッチ素子のクロ
ックの2分周に相当するクロック信号(CLK2X,C
LKB2X)によりラッチして出力する第3ラッチ素子
と、 前記第2ラッチ素子の出力信号を第3ラッチ素子と同じ
クロック信号(CLK2X、CLKB2X)によりラッ
チして出力する第4ラッチ素子と、 外部の極性信号(POL)に基づいて前記第3、第4ラ
ッチ素子の出力信号のいずれか一方を選択して前記ラッ
チ部に出力するマルチプレクサとから構成されることを
特徴とする請求項1に記載のTFT−LCD駆動回路。 - 【請求項4】 前記パワースイッチ部は、 外部から入力される基準電圧(Vref 5)を外部の制御
信号(CON1)によりスイッチングする第1スイッチ
と、 外部から入力される基準電圧(Vref 0)を外部の制御
信号(CON1B)によりスイッチングする第2スイッ
チと、 外部から入力される基準電圧(Vref 4)を外部の制御
信号(CON1)によりスイッチングする第3スイッチ
と、 外部から入力される基準電圧(Vref 1)を外部の制御
信号(CON1B)によりスイッチングする第4スイッ
チと、 外部から入力される基準電圧(Vref 3)を外部の制御
信号(CON1)によりスイッチングする第5スイッチ
と、 外部から入力される基準電圧(Vref 2)を外部の制御
信号(CON1B)によりスイッチングする第6スイッ
チと、 外部から入力される基準電圧(Vref 2)を外部の制御
信号(CON1)によりスイッチングする第7スイッチ
と、 外部から入力される基準電圧(Vref 3)を外部の制御
信号(CON1B)によりスイッチングする第8スイッ
チと、 外部から入力される基準電圧(Vref 1)を外部の制御
信号(CON1)によりスイッチングする第9スイッチ
と、 外部から入力される基準電圧(Vref 4)を外部の制御
信号(CON1B)によりスイッチングする第10スイ
ッチと、 外部から入力される基準電圧(Vref 0)を外部の制御
信号(CON1)によりスイッチングする第11スイッ
チと、 外部から入力される基準電圧(Vref 5)を外部の制御
信号(CON1B)によりスイッチングする第12スイ
ッチと、 前記第1、第2スイッチS1、S2から出力される信号
を外部の制御信号(CON2)によりスイッチングする
第13スイッチと、 前記第3、第4スイッチから出力される信号を外部の制
御信号(CON2)によりスイッチングする第14スイ
ッチと、 前記第5、第6スイッチから出力される信号を外部の制
御信号(CON2)によりスイッチングする第15スイ
ッチと、 前記第7、第8スイッチから出力される信号を外部の制
御信号(CON2)によりスイッチングする第16スイ
ッチと、 前記第9、第10スイッチから出力される信号を外部の
制御信号(CON2)によりスイッチングする第17ス
イッチと、 前記第11、第12スイッチから出力される信号を外部
の制御信号(CON2)によりスイッチングする第18
スイッチと、 前記第13、第14、第15、第16、第17、第18
スイッチの出力を出力端とする第1、第2、第3、第
4、第5、第6出力端の間にそれぞれ設けられ、外部の
制御信号(CON2B)により前記各出力端の等電位に
スイッチングする第19、第20、第21、第22、第
23スイッチと、から構成されることを特徴とする請求
項1に記載のTFT−LCD駆動回路。 - 【請求項5】 前記記憶部はチャネル数に相応する個数
のキャパシタから構成され、 奇数番目のキャパシタC1は、一方のノードは接地され
ており、他方のノードは前記デジタル/アナログ変換器
の出力と前記バッファの入力端に連結されており、 偶数番目の(+)極性信号処理部分のキャパシタC2
は、前記デジタル/アナログ変換器の出力端と前記バッ
ファの入力端との間に連結されていることを特徴とする
請求項1に記載のTFT−LCD駆動回路。 - 【請求項6】 前記バッファ部はチャネル数に相応する
複数のバッファから構成され、(−)極性信号処理部に
は(−)極性を増幅するバッファ(N−BUF)があ
り、(+)極性信号処理部には(+)極性を増幅するバ
ッファ(P−BUF)が配置されていることを特徴とす
る請求項1に記載のTFT−LCD駆動回路。 - 【請求項7】 前記スイッチング部は、 外部のローのコントロール信号(CONL,CONL
B)によりロー信号をスイッチングする第1伝送ゲート
と、 外部のコントロール信号(CONL,CONLB)によ
り共通電圧(VCOM)をスイッチングする第2伝送ゲ
ートと、 外部のハイのコントロール信号(CONH,CONH
B)によりハイ信号をスイッチングする第3伝送ゲート
と、 外部のハイのコントロール信号(CONH,CONH
B)によりハイ信号をスイッチングする第4伝送ゲート
と、 前記共通電圧(VCOM)信号により前記第1、第2伝
送ゲートの出力信号をスイッチングして出力するNMO
Sトランジスタと、 前記共通電圧(VCOM)信号により前記第3、第4伝
送ゲートの出力信号をスイッチングして出力するPMO
Sトランジスタとから構成されることを特徴とする請求
項1に記載のTFT−LCD駆動回路。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR20637/1998 | 1998-06-03 | ||
KR1019980020637A KR100268904B1 (ko) | 1998-06-03 | 1998-06-03 | Tft-lcd 구동 회로 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2000010075A JP2000010075A (ja) | 2000-01-14 |
JP3138866B2 true JP3138866B2 (ja) | 2001-02-26 |
Family
ID=19538309
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP11153563A Expired - Fee Related JP3138866B2 (ja) | 1998-06-03 | 1999-06-01 | Tft−lcd駆動回路 |
Country Status (3)
Country | Link |
---|---|
US (1) | US6373459B1 (ja) |
JP (1) | JP3138866B2 (ja) |
KR (1) | KR100268904B1 (ja) |
Families Citing this family (54)
Publication number | Priority date | Publication date | Assignee | Title |
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1998
- 1998-06-03 KR KR1019980020637A patent/KR100268904B1/ko not_active IP Right Cessation
-
1999
- 1999-06-01 JP JP11153563A patent/JP3138866B2/ja not_active Expired - Fee Related
- 1999-06-03 US US09/324,776 patent/US6373459B1/en not_active Expired - Lifetime
Also Published As
Publication number | Publication date |
---|---|
US6373459B1 (en) | 2002-04-16 |
KR20000000788A (ko) | 2000-01-15 |
JP2000010075A (ja) | 2000-01-14 |
KR100268904B1 (ko) | 2000-10-16 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
TRDD | Decision of grant or rejection written | ||
R150 | Certificate of patent or registration of utility model |
Ref document number: 3138866 Country of ref document: JP Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
S631 | Written request for registration of reclamation of domicile |
Free format text: JAPANESE INTERMEDIATE CODE: R313631 |
|
S633 | Written request for registration of reclamation of name |
Free format text: JAPANESE INTERMEDIATE CODE: R313633 |
|
R360 | Written notification for declining of transfer of rights |
Free format text: JAPANESE INTERMEDIATE CODE: R360 |
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R371 | Transfer withdrawn |
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S631 | Written request for registration of reclamation of domicile |
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R350 | Written notification of registration of transfer |
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S111 | Request for change of ownership or part of ownership |
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R360 | Written notification for declining of transfer of rights |
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FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20071215 Year of fee payment: 7 |
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FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20081215 Year of fee payment: 8 |
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R250 | Receipt of annual fees |
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FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20091215 Year of fee payment: 9 |
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R250 | Receipt of annual fees |
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FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20101215 Year of fee payment: 10 |
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R250 | Receipt of annual fees |
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FPAY | Renewal fee payment (event date is renewal date of database) |
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FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20121215 Year of fee payment: 12 |
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FPAY | Renewal fee payment (event date is renewal date of database) |
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