JP3054498B2 - 画像表示装置及び入力信号判別回路 - Google Patents
画像表示装置及び入力信号判別回路Info
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- JP3054498B2 JP3054498B2 JP4178223A JP17822392A JP3054498B2 JP 3054498 B2 JP3054498 B2 JP 3054498B2 JP 4178223 A JP4178223 A JP 4178223A JP 17822392 A JP17822392 A JP 17822392A JP 3054498 B2 JP3054498 B2 JP 3054498B2
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Description
【０００１】
【産業上の利用分野】本発明は、異なる方式の映像信号
を自動的に判別し、表示する画像表示装置に関するもの
である。
を自動的に判別し、表示する画像表示装置に関するもの
である。
【０００２】
【従来の技術】液晶ビデオプロジェクタなどにおいて、
コンピュータの映像出力を表示する場合、コンピュータ
の映像出力の画素と液晶ビデオプロジェクタなどの表示
装置の画素を１対１で対応させる必要がある。
コンピュータの映像出力を表示する場合、コンピュータ
の映像出力の画素と液晶ビデオプロジェクタなどの表示
装置の画素を１対１で対応させる必要がある。
【０００３】ところが、コンピュータの映像出力は、コ
ンピュータごとに水平同期周波数や垂直同期周波数、ま
た、同期信号の極性などの出力形式が異なっており、そ
れらを正しく判断しなければ映像出力の画素と表示装置
の画素を対応させるて表示することはできない。
ンピュータごとに水平同期周波数や垂直同期周波数、ま
た、同期信号の極性などの出力形式が異なっており、そ
れらを正しく判断しなければ映像出力の画素と表示装置
の画素を対応させるて表示することはできない。
【０００４】そのためには、水平同期周波数や垂直同期
周波数、同期信号の極性を判別する必要があり、従来で
は、計数回路で、水平同期周波数、垂直同期周波数で検
出していた。これによれば、垂直同期周波数は周波数が
低いため容易に計数することができる。
周波数、同期信号の極性を判別する必要があり、従来で
は、計数回路で、水平同期周波数、垂直同期周波数で検
出していた。これによれば、垂直同期周波数は周波数が
低いため容易に計数することができる。
【０００５】一方、水平同期周波数は、以下のような方
法で判別を行ってきた。
法で判別を行ってきた。
【０００６】図２に従来の方法の１つである水平同期周
波数を判別する回路である。まず、水平同期信号は、周
波数電圧変換回路（１）により直流電圧に変換されたの
ち、アナログ−ディジタル変換回路（２）によりディジ
タル信号に変換される。そして、ＣＰＵ（３）によりデ
ジタル値に応じて、水平周波数を判定する。
波数を判別する回路である。まず、水平同期信号は、周
波数電圧変換回路（１）により直流電圧に変換されたの
ち、アナログ−ディジタル変換回路（２）によりディジ
タル信号に変換される。そして、ＣＰＵ（３）によりデ
ジタル値に応じて、水平周波数を判定する。
【０００７】しかしながら、この回路では、水平周波数
が直接計数されるのではなく、直流電圧に変換され、デ
ィジタル化されているので、高い精度が望めない。
が直接計数されるのではなく、直流電圧に変換され、デ
ィジタル化されているので、高い精度が望めない。
【０００８】そこで、図３に示すように、ＣＰＵ（４）
に水平同期信号を直接入力して、水平同期期間を計数す
るようにしたものが提案されている。
に水平同期信号を直接入力して、水平同期期間を計数す
るようにしたものが提案されている。
【０００９】ここで、その方法を説明する。図４に示す
水平同期信号によってＣＰＵ（４）は割り込みがかけら
れる。割り込みが発生したとき、ＣＰＵ（４）にある計
数回路が、内部クロックによる計数回路の値をゼロにリ
セットするようにしておくことにより、ゼロにリセット
される直前の計数回路の値を知ることができる。それに
よって、水平周波数が計数できる。
水平同期信号によってＣＰＵ（４）は割り込みがかけら
れる。割り込みが発生したとき、ＣＰＵ（４）にある計
数回路が、内部クロックによる計数回路の値をゼロにリ
セットするようにしておくことにより、ゼロにリセット
される直前の計数回路の値を知ることができる。それに
よって、水平周波数が計数できる。
【００１０】例えば、１μＳごとに計数する回路で考え
ると、水平周波数が３１．２５ＫＨｚであれば、リセッ
トされる直前の計数回路の値は３２となっている。
ると、水平周波数が３１．２５ＫＨｚであれば、リセッ
トされる直前の計数回路の値は３２となっている。
【００１１】また、他の方法として、図５のように水平
同期信号毎にＨＩＧＨとＬＯＷにして、ＣＰＵ（４）の
計数回路を内部クロックによって一定時間ごとに、入力
されている信号のＨＩＧＨまたはＬＯＷの期間を調べ
る。
同期信号毎にＨＩＧＨとＬＯＷにして、ＣＰＵ（４）の
計数回路を内部クロックによって一定時間ごとに、入力
されている信号のＨＩＧＨまたはＬＯＷの期間を調べ
る。
【００１２】いま、ＨＩＧＨの回数を数えるとすると、
入力されている信号がＬＯＷであれば、ＨＩＧＨの回数
はゼロにリセットされる。ＨＩＧＨであれば、ＨＩＧＨ
の回数は一つ増加する。このようにすると、ＨＩＧＨの
回数の最大値によって水平周波数が計数される。
入力されている信号がＬＯＷであれば、ＨＩＧＨの回数
はゼロにリセットされる。ＨＩＧＨであれば、ＨＩＧＨ
の回数は一つ増加する。このようにすると、ＨＩＧＨの
回数の最大値によって水平周波数が計数される。
【００１３】例えば、０．５μＳごとに入力されている
信号のＨＩＧＨの数を考えると、水平周波数が３１．２
５ＫＨｚのとき、ＨＩＧＨの回数の最大値は６４とな
る。
信号のＨＩＧＨの数を考えると、水平周波数が３１．２
５ＫＨｚのとき、ＨＩＧＨの回数の最大値は６４とな
る。
【００１４】ところで、この場合、水平周波数の違い
が、極わずかな差しかなければ、計数回路の計数値には
差がでないことになり、判別できなくなる。
が、極わずかな差しかなければ、計数回路の計数値には
差がでないことになり、判別できなくなる。
【００１５】そのため、ＣＰＵのクロック周波数を高く
することによって精度を高くすることができる。しかし
ながら、高いクロック周波数で動作するＣＰＵは高価な
ものであり、この装置を組み込んだセットも高価なもの
となってしまう。
することによって精度を高くすることができる。しかし
ながら、高いクロック周波数で動作するＣＰＵは高価な
ものであり、この装置を組み込んだセットも高価なもの
となってしまう。
【００１６】
【発明が解決しようとする課題】本発明は、上述した欠
点を解決するためのものであり、入力された映像信号が
極わずかな周波数差であっても精度よく映像信号の形式
を判別できる装置を提供することを目的とする。
点を解決するためのものであり、入力された映像信号が
極わずかな周波数差であっても精度よく映像信号の形式
を判別できる装置を提供することを目的とする。
【００１７】
【課題を解決するための手段】本発明は、水平同期周波
数と垂直同期周波数及び水平同期信号と垂直同期信号の
極性が異なる複数の入力映像信号を判別するための判別
回路を備える画像表示装置において、前記判別回路は、
入力される水平同期信号の極性を判定する水平同期信号
極性判定回路と、入力される垂直同期信号の極性を判定
する垂直同期信号極性判定回路と、所定の発振周波数で
発振する発振回路と、該発振回路からの発振出力を一水
平同期期間に渡って計数する第１カウンタ回路と、前記
発振回路からの発振出力を数水平同期期間に渡って計数
する第２カウンタ回路と、入力される水平同期信号の数
を一垂直同期期間に渡って計数する第３カウンタ回路
と、前記水平同期信号極性判定回路と垂直同期信号極性
判定回路の判定出力と前記第１、第２及び第３カウンタ
回路からのカウンタ出力を入力し、これらの全ての出力
に対応する映像信号の方式を判別するＣＰＵとによって
構成されてなることを特徴とする画像表示装置である。
数と垂直同期周波数及び水平同期信号と垂直同期信号の
極性が異なる複数の入力映像信号を判別するための判別
回路を備える画像表示装置において、前記判別回路は、
入力される水平同期信号の極性を判定する水平同期信号
極性判定回路と、入力される垂直同期信号の極性を判定
する垂直同期信号極性判定回路と、所定の発振周波数で
発振する発振回路と、該発振回路からの発振出力を一水
平同期期間に渡って計数する第１カウンタ回路と、前記
発振回路からの発振出力を数水平同期期間に渡って計数
する第２カウンタ回路と、入力される水平同期信号の数
を一垂直同期期間に渡って計数する第３カウンタ回路
と、前記水平同期信号極性判定回路と垂直同期信号極性
判定回路の判定出力と前記第１、第２及び第３カウンタ
回路からのカウンタ出力を入力し、これらの全ての出力
に対応する映像信号の方式を判別するＣＰＵとによって
構成されてなることを特徴とする画像表示装置である。
【００１８】本発明は、水平同期周波数と垂直同期周波
数及び水平同期信号と垂直同期信号の極性が異なる複数
の入力映像信号を判別するための入力信号判別回路にお
いて、前記判別回路は、入力される水平同期信号の極性
を判定する水平同期信号極性判定回路と、入力される垂
直同期信号の極性を判定する垂直同期信号極性判定回路
と、所定の発振周波数で発振する発振回路と、該発振回
路からの発振出力を一水平同期期間に渡って計数する第
１カウンタ回路と、前記発振回路からの発振出力を数水
平同期期間に渡って計数する第２カウンタ回路と、入力
される水平同期信号の数を一垂直同期期間に渡って計数
する第３カウンタ回路と、前記水平同期信号極性判定回
路と垂直同期信号極性判定回路の判定出力と前記第１、
第２及び第３カウンタ回路からのカウンタ出力を入力
し、これらの全ての出力に対応する映像信号の方式を判
別するＣＰＵとによって構成されてなることを特徴とす
る入力信号判別回路である。
数及び水平同期信号と垂直同期信号の極性が異なる複数
の入力映像信号を判別するための入力信号判別回路にお
いて、前記判別回路は、入力される水平同期信号の極性
を判定する水平同期信号極性判定回路と、入力される垂
直同期信号の極性を判定する垂直同期信号極性判定回路
と、所定の発振周波数で発振する発振回路と、該発振回
路からの発振出力を一水平同期期間に渡って計数する第
１カウンタ回路と、前記発振回路からの発振出力を数水
平同期期間に渡って計数する第２カウンタ回路と、入力
される水平同期信号の数を一垂直同期期間に渡って計数
する第３カウンタ回路と、前記水平同期信号極性判定回
路と垂直同期信号極性判定回路の判定出力と前記第１、
第２及び第３カウンタ回路からのカウンタ出力を入力
し、これらの全ての出力に対応する映像信号の方式を判
別するＣＰＵとによって構成されてなることを特徴とす
る入力信号判別回路である。
【００１９】
【作用】本発明は、上述した構成とすることにより、水
平同期信号、垂直同期信号の極性や水平同期周波数、垂
直同期周波数の相違を精度よく判断することができる。
平同期信号、垂直同期信号の極性や水平同期周波数、垂
直同期周波数の相違を精度よく判断することができる。
【００２０】
【実施例】以下、本発明の実施例を図１を用いて説明す
る。図１において、（５）は水平同期信号の極性を切換
る極性切換回路、（６）は水平同期信号を所定分周する
分周回路、（７）は分周された水平同期信号を計数する
計数回路、（８）は発振回路、（９）は水平同期信号の
極性を判別する極性判別回路、（１０）は水平同期信号
を計数する計数回路、（１１）はＣＰＵ、（１２）はＣ
ＰＵ用クロックを発生する発振回路、（１３）は垂直同
期信号の極性を切換る極性切換回路、（１４）は垂直同
期信号を計数する計数回路、（１５）は垂直同期信号の
極性を判別する極性判別回路。
る。図１において、（５）は水平同期信号の極性を切換
る極性切換回路、（６）は水平同期信号を所定分周する
分周回路、（７）は分周された水平同期信号を計数する
計数回路、（８）は発振回路、（９）は水平同期信号の
極性を判別する極性判別回路、（１０）は水平同期信号
を計数する計数回路、（１１）はＣＰＵ、（１２）はＣ
ＰＵ用クロックを発生する発振回路、（１３）は垂直同
期信号の極性を切換る極性切換回路、（１４）は垂直同
期信号を計数する計数回路、（１５）は垂直同期信号の
極性を判別する極性判別回路。
【００２１】次に、動作を説明する。まず、水平同期信
号は、極性判別回路（９）でその極性が判別される。極
性判別回路（９）の出力は、極性切換回路（５）とＣＰ
Ｕ（１１）に供給される。（尚、コンピュータ等の映像
信号では、同期信号の極性も正極性と負極性があり、そ
れにより入力映像信号を判別できる。）この極性判別回
路（９）及び極性切換回路（５）は、例えば、特開昭５
６−１４９８６８号公報（Ｈ０４Ｎ５／０４）に示され
るような回路構成で形成すればよい。
号は、極性判別回路（９）でその極性が判別される。極
性判別回路（９）の出力は、極性切換回路（５）とＣＰ
Ｕ（１１）に供給される。（尚、コンピュータ等の映像
信号では、同期信号の極性も正極性と負極性があり、そ
れにより入力映像信号を判別できる。）この極性判別回
路（９）及び極性切換回路（５）は、例えば、特開昭５
６−１４９８６８号公報（Ｈ０４Ｎ５／０４）に示され
るような回路構成で形成すればよい。
【００２２】そして、極性切換回路（５）では、極性判
別回路（９）の出力により水平同期信号を図４で示され
るような正極性に切換る。
別回路（９）の出力により水平同期信号を図４で示され
るような正極性に切換る。
【００２３】極性切換回路（５）の出力は、分周回路
（６）に供給され、水平同期信号は分周される。この実
施例では、水平周波数が１／２０４８と設定している。
（６）に供給され、水平同期信号は分周される。この実
施例では、水平周波数が１／２０４８と設定している。
【００２４】ＣＰＵ（１１）のクロック発振器（１２）
の発振周波数と同期していない周波数を発振する発振回
路（８）の出力は、計数回路（７）で計数されている。
計数回路（７）は、分周回路（６）の出力でリセットさ
れる。この実施例では２０４８個の水平同期信号が来る
度にリセットされる。リセット直前の値は、ＣＰＵ（１
１）に出力される。
の発振周波数と同期していない周波数を発振する発振回
路（８）の出力は、計数回路（７）で計数されている。
計数回路（７）は、分周回路（６）の出力でリセットさ
れる。この実施例では２０４８個の水平同期信号が来る
度にリセットされる。リセット直前の値は、ＣＰＵ（１
１）に出力される。
【００２５】また、発振回路（８）の出力は、計数回路
（１０）で計数されている。計数回路（１０）は、極性
切換回路（５）の出力でリセットされる。この実施例で
は１個の水平同期信号が来る度にリセットする。リセッ
ト直前の値は、ＣＰＵ（１１）に出力される。
（１０）で計数されている。計数回路（１０）は、極性
切換回路（５）の出力でリセットされる。この実施例で
は１個の水平同期信号が来る度にリセットする。リセッ
ト直前の値は、ＣＰＵ（１１）に出力される。
【００２６】一方、垂直同期信号は、極性判別回路（１
５）でその極性が判別される。極性判別回路（１５）の
出力は、極性切換回路（１３）とＣＰＵ（１１）に供給
される。極性切換回路（１３）では、極性判別回路（１
５）の出力により垂直同期信号を正極性に切換る。
５）でその極性が判別される。極性判別回路（１５）の
出力は、極性切換回路（１３）とＣＰＵ（１１）に供給
される。極性切換回路（１３）では、極性判別回路（１
５）の出力により垂直同期信号を正極性に切換る。
【００２７】そして、極性切換回路（５）の出力は、計
数回路（１４）で計数されている。計数回路（１４）
は、極性切換回路（１３）の出力でリセットする。この
実施例では、１個の垂直同期信号が来る度にリセットさ
れ、リセット直前の値はＣＰＵ（１１）に出力される。
数回路（１４）で計数されている。計数回路（１４）
は、極性切換回路（１３）の出力でリセットする。この
実施例では、１個の垂直同期信号が来る度にリセットさ
れ、リセット直前の値はＣＰＵ（１１）に出力される。
【００２８】尚、ＣＰＵ（１１）には、上記各判別回路
や計数回路から得られた水平同期信号、垂直同期信号の
極性や水平同期周波数、垂直同期周波数のデータが入力
され最終的な判断を下し、どの形式の映像信号であるか
を判別する。
や計数回路から得られた水平同期信号、垂直同期信号の
極性や水平同期周波数、垂直同期周波数のデータが入力
され最終的な判断を下し、どの形式の映像信号であるか
を判別する。
【００２９】次に、具体的な例として次に示すモードＡ
とモードＢの判別について説明する。
とモードＢの判別について説明する。
【００３０】モードＡは、 １垂直期間は４３２水平同期、 水平同期周波数は２５．８６２０６９ＫＨｚ 垂直同期信号は正極性 水平同期信号は正極性 モードＢは、 １垂直期間は４３４水平同期、 水平同期周波数は２５．８８９９６７６４ＫＨｚ 垂直同期信号は正極性 水平同期信号は正極性 であるとすると、水平同期信号の極性判別回路（９）で
は、モードＡもモードＢも正極性と判別され、極性切換
回路（５）では、極性切換は行わない。同様に、垂直同
期信号の極性判別回路（１５）では、モードＡもモード
Ｂも正極性と判別され、極性切換回路（１３）では、極
性切換は行わない。これらの極性判別回路の出力はＣＰ
Ｕ（１１）に供給されているが、モードＡ、モードＢと
も同じ条件であるのでモードの判定はできない。
は、モードＡもモードＢも正極性と判別され、極性切換
回路（５）では、極性切換は行わない。同様に、垂直同
期信号の極性判別回路（１５）では、モードＡもモード
Ｂも正極性と判別され、極性切換回路（１３）では、極
性切換は行わない。これらの極性判別回路の出力はＣＰ
Ｕ（１１）に供給されているが、モードＡ、モードＢと
も同じ条件であるのでモードの判定はできない。
【００３１】計数回路（１４）において、モードＡでは
４３２、モードＢでは４３４と計数されるが、垂直同期
信号と水平同期信号の位相関係によって発生する読み取
り誤差を考慮すると、モードＡ、モードＢとも同じ条件
であるのでモードの判定はできない。
４３２、モードＢでは４３４と計数されるが、垂直同期
信号と水平同期信号の位相関係によって発生する読み取
り誤差を考慮すると、モードＡ、モードＢとも同じ条件
であるのでモードの判定はできない。
【００３２】発振回路（８）が１０ＭＨｚで発振してい
るとすると、計数回路（１０）において、モードＡでは
３８６、モードＢでは３８６と計数される。モードＡ、
モードＢとも同じ条件であるのでモードの判定はできな
い。
るとすると、計数回路（１０）において、モードＡでは
３８６、モードＢでは３８６と計数される。モードＡ、
モードＢとも同じ条件であるのでモードの判定はできな
い。
【００３３】分周回路（６）で１／２０４８になった水
平同期信号は、計数回路（７）において、モードＡでは
７９１８９３、モードＢでは７９１０３９と計数され
る。
平同期信号は、計数回路（７）において、モードＡでは
７９１８９３、モードＢでは７９１０３９と計数され
る。
【００３４】モードＡ、モードＢとの条件が異なるので
モードの判定ができる。
モードの判定ができる。
【００３５】
【発明の効果】本発明によれば、高価なＣＰＵを用いる
ことなく、精度良く、コンピュータ等の映像信号の出力
形式が判別できる。
ことなく、精度良く、コンピュータ等の映像信号の出力
形式が判別できる。
【図１】本発明の実施例を示す図。
【図２】従来技術を示す図。
【図３】従来技術を示す図。
【図４】水平同期信号の波形。
【図５】１水平期間毎に反転させた水平同期信号の波
形。
形。
５ 極性切換回路 ６ 分周回路 ７ 計数回路 ８ 発振回路 ９ 極性判別回路 １０ 計数回路 １１ ＣＰＵ １２ クロック発振回路 １３ 極性切換回路 １４ 計数回路 １５ 極性判別回路
Claims (2)
- 【請求項１】 水平同期周波数と垂直同期周波数及び水
平同期信号と垂直同期信号の極性が異なる複数の入力映
像信号を判別するための判別回路を備える画像表示装置
において、 前記判別回路は、入力される水平同期信号の極性を判定
する水平同期信号極性判定回路と、入力される垂直同期
信号の極性を判定する垂直同期信号極性判定回路と、所
定の発振周波数で発振する発振回路と、該発振回路から
の発振出力を一水平同期期間に渡って計数する第１カウ
ンタ回路と、前記発振回路からの発振出力を数水平同期
期間に渡って計数する第２カウンタ回路と、入力される
水平同期信号の数を一垂直同期期間に渡って計数する第
３カウンタ回路と、前記水平同期信号極性判定回路と垂
直同期信号極性判定回路の判定出力と前記第１、第２及
び第３カウンタ回路からのカウンタ出力を入力し、これ
らの全ての出力に対応する映像信号の方式を判別するＣ
ＰＵとによって構成されてなることを特徴とする画像表
示装置。 - 【請求項２】 水平同期周波数と垂直同期周波数及び水
平同期信号と垂直同期信号の極性が異なる複数の入力映
像信号を判別するための入力信号判別回路において、 前記判別回路は、入力される水平同期信号の極性を判定
する水平同期信号極性判定回路と、入力される垂直同期
信号の極性を判定する垂直同期信号極性判定回路と、所
定の発振周波数で発振する発振回路と、該発振回路から
の発振出力を一水平同期期間に渡って計数する第１カウ
ンタ回路と、前記発振回路からの発振出力を数水平同期
期間に渡って計数する第２カウンタ回路と、入力される
水平同期信号の数を一垂直同期期間に渡って計数する第
３カウンタ回路と、前記水平同期信号極性判定回路と垂
直同期信号極性判定回路の判定出力と前記第１、第２及
び第３カウンタ回路からのカウンタ出力を入力し、これ
らの全ての出力に対応する映像信号の方式を判別するＣ
ＰＵとによって構成されてなることを特徴とする入力信
号判別回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4178223A JP3054498B2 (ja) | 1992-07-06 | 1992-07-06 | 画像表示装置及び入力信号判別回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4178223A JP3054498B2 (ja) | 1992-07-06 | 1992-07-06 | 画像表示装置及び入力信号判別回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0630352A JPH0630352A (ja) | 1994-02-04 |
| JP3054498B2 true JP3054498B2 (ja) | 2000-06-19 |
Family
ID=16044745
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4178223A Expired - Fee Related JP3054498B2 (ja) | 1992-07-06 | 1992-07-06 | 画像表示装置及び入力信号判別回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3054498B2 (ja) |
-
1992
- 1992-07-06 JP JP4178223A patent/JP3054498B2/ja not_active Expired - Fee Related
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| Publication number | Publication date |
|---|---|
| JPH0630352A (ja) | 1994-02-04 |
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