JP2754574B2 - 非同期回線同期化回路 - Google Patents
非同期回線同期化回路Info
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- JP2754574B2 JP2754574B2 JP63132639A JP13263988A JP2754574B2 JP 2754574 B2 JP2754574 B2 JP 2754574B2 JP 63132639 A JP63132639 A JP 63132639A JP 13263988 A JP13263988 A JP 13263988A JP 2754574 B2 JP2754574 B2 JP 2754574B2
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- Japan
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- line
- asynchronous
- read clock
- unit
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Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、非同期回線間のデータを相互に入れ換える
ために必要な同期化回路に関するものである。
ために必要な同期化回路に関するものである。
従来、この種の同期化回路としては、非同期低速回線
を高速回線に多重化するためのスタッフ同期が一般的で
あった。
を高速回線に多重化するためのスタッフ同期が一般的で
あった。
次に、この例を示し、その動作について説明する。第
３図に、従来の同期化回路としてのスタッフ同期回路の
ブロック系統図を示す。同図において、T1は回線Ａの端
子、T2は回線Ｂの端子、１は回線終端部、２は回線多重
化部、３はタイムスロット入換部、４はメモリ部、５は
読出クロック作成部である。また、ａは回線データ、ｂ
は回線クロック、ｃはスタッフされた回線データ、ｄは
読出クロック、ｅは共通部クロック、ｆはスタッフ情
報、ｇは多重化データ、ｈは回線データである。
３図に、従来の同期化回路としてのスタッフ同期回路の
ブロック系統図を示す。同図において、T1は回線Ａの端
子、T2は回線Ｂの端子、１は回線終端部、２は回線多重
化部、３はタイムスロット入換部、４はメモリ部、５は
読出クロック作成部である。また、ａは回線データ、ｂ
は回線クロック、ｃはスタッフされた回線データ、ｄは
読出クロック、ｅは共通部クロック、ｆはスタッフ情
報、ｇは多重化データ、ｈは回線データである。
第３図において、回線信号ｈは回線終端部１にて終端
され、回線より抽出したクロックによりサンプリングさ
れた回線データａとしてメモリ部４に書き込まれる。読
出クロック作成部５では、回線クロックｂより若干高速
の回線多重化部２からの共通部クロックｅと回線クロッ
クｂの位相比較を行ない、位相差により、所定位置にて
共通部クロックｅを１クロック間引き、回線終端部１と
回線多重化部２との間の同期がとれるクロックｄを作成
する。このクロックｄをメモリ部４の読出クロックに使
用すると共に、クロックを間引かない場合には、所定位
置にて、スタッフの情報有りの情報をスタッフ情報ｆに
より回線多重化部に通知する。
され、回線より抽出したクロックによりサンプリングさ
れた回線データａとしてメモリ部４に書き込まれる。読
出クロック作成部５では、回線クロックｂより若干高速
の回線多重化部２からの共通部クロックｅと回線クロッ
クｂの位相比較を行ない、位相差により、所定位置にて
共通部クロックｅを１クロック間引き、回線終端部１と
回線多重化部２との間の同期がとれるクロックｄを作成
する。このクロックｄをメモリ部４の読出クロックに使
用すると共に、クロックを間引かない場合には、所定位
置にて、スタッフの情報有りの情報をスタッフ情報ｆに
より回線多重化部に通知する。
上記動作によるフレーム構成例を第４図に示す。
同図で、６は回線Ａのデータ、７は回線Ｂのデータで
ある。フレームは、回線データビットＤ以外に、スタッ
フ制御ビットＣおよびスタッフデータもしくは“空”と
して利用されるタイミングビットＴより構成され、スタ
ッフ制御ビットＣ＝１の時、タイミングビットＴは無情
報のスタッフビットとして取り扱われる。
ある。フレームは、回線データビットＤ以外に、スタッ
フ制御ビットＣおよびスタッフデータもしくは“空”と
して利用されるタイミングビットＴより構成され、スタ
ッフ制御ビットＣ＝１の時、タイミングビットＴは無情
報のスタッフビットとして取り扱われる。
上述した従来の同期化回路としてのスタッフ同期回路
は回線終端部ごとに位相比較回路が必要であり、回路規
模が大きくなる欠点があった。更に、回線間での信号の
入換えを行なうためには、最も速度が遅い回線の速度に
合わせて運用する必要があった。
は回線終端部ごとに位相比較回路が必要であり、回路規
模が大きくなる欠点があった。更に、回線間での信号の
入換えを行なうためには、最も速度が遅い回線の速度に
合わせて運用する必要があった。
このような課題を解決するために本発明による非同期
回線同期化回路は、各非同期回線からの信号を各回線速
度で各個にサンプリングする複数の回線終端部と、回線
データを記憶する複数のメモリ部と、読出クロックを作
成する読出クロック作成部とを設け、書込みにおいて
は、メモリ部は回線速度にて対応する回線終端部の出力
信号を回線データとして書き込み、読出しにおいては、
読出クロック作成部は各非同期回線に対応する各メモリ
部に対して共通に一定周期毎にアドレスをリセットする
とともに、非同期回線の最低速度より低い周波数の共通
の読出クロックで各メモリ部から必要量の回線データを
読み出すようにしたものである。
回線同期化回路は、各非同期回線からの信号を各回線速
度で各個にサンプリングする複数の回線終端部と、回線
データを記憶する複数のメモリ部と、読出クロックを作
成する読出クロック作成部とを設け、書込みにおいて
は、メモリ部は回線速度にて対応する回線終端部の出力
信号を回線データとして書き込み、読出しにおいては、
読出クロック作成部は各非同期回線に対応する各メモリ
部に対して共通に一定周期毎にアドレスをリセットする
とともに、非同期回線の最低速度より低い周波数の共通
の読出クロックで各メモリ部から必要量の回線データを
読み出すようにしたものである。
本発明による非同期回線同期化回路においては、読出
クロックは各回線に共通となる。
クロックは各回線に共通となる。
次に、本発明による非同期回線同期化回路について図
面を参照して説明する。第１図は、本発明による非同期
回線同期化回路の一実施例を示すブロック系統図であ
る。同図において第３図と同一部分又は相当部分には同
一符号が付してある。
面を参照して説明する。第１図は、本発明による非同期
回線同期化回路の一実施例を示すブロック系統図であ
る。同図において第３図と同一部分又は相当部分には同
一符号が付してある。
第１図において、回線終端部１にて終端された回線信
号は、回線ＡまたはＢの回線信号h1またはh2から抽出し
た回線クロックb1またはb2にてメモリ部４に回線データ
a1またはa2として書き込まれる。メモリ部４の読出クロ
ックｄは各回線共通に読出しクロック作成部５に与えら
れる。読出クロック作成部５は各回線の周波数より若干
低く設定された周波数で動作し、さらに、フレームタイ
ミングパルスｉの一定周期ごとに読出アドレスがリセッ
トされる。
号は、回線ＡまたはＢの回線信号h1またはh2から抽出し
た回線クロックb1またはb2にてメモリ部４に回線データ
a1またはa2として書き込まれる。メモリ部４の読出クロ
ックｄは各回線共通に読出しクロック作成部５に与えら
れる。読出クロック作成部５は各回線の周波数より若干
低く設定された周波数で動作し、さらに、フレームタイ
ミングパルスｉの一定周期ごとに読出アドレスがリセッ
トされる。
上記動作のタイムチャートを第２図に示す。第２図
（ａ）はフレームタイミングパルスｉを示し、（ｂ）は
回線Ａの回線信号h1、（ｃ）は回線Ｂの回線信号h2、
（ｄ）は読出クロックｄ、（ｅ）および（ｆ）は回線Ａ
およびＢの同期化回線データcaおよびcb、（ｇ）は回線
Ａのデータ８と回線Ｂのデータ９の多重化データを示
す。第２図において、回線Ａの回線信号h1が14ビット／
秒、回線Ｂの回線信号h2が11ビット／秒であるときに回
線相互のビット入換えを行なう場合、11ビット／秒以下
の回線容量とみなす必要がある。本実施例では10ビット
／秒とすることとしてある。メモリ読出クロックｄは、
よって10ビット／秒とし、第２図（ｄ）に示されてい
る。更に、メモリ読出しに際して、フレームタイミング
パルスｉにより一定周期でアドレスをリセットする。従
って、読み出された信号はそれぞれ10ビット／秒の同期
化された信号となる。
（ａ）はフレームタイミングパルスｉを示し、（ｂ）は
回線Ａの回線信号h1、（ｃ）は回線Ｂの回線信号h2、
（ｄ）は読出クロックｄ、（ｅ）および（ｆ）は回線Ａ
およびＢの同期化回線データcaおよびcb、（ｇ）は回線
Ａのデータ８と回線Ｂのデータ９の多重化データを示
す。第２図において、回線Ａの回線信号h1が14ビット／
秒、回線Ｂの回線信号h2が11ビット／秒であるときに回
線相互のビット入換えを行なう場合、11ビット／秒以下
の回線容量とみなす必要がある。本実施例では10ビット
／秒とすることとしてある。メモリ読出クロックｄは、
よって10ビット／秒とし、第２図（ｄ）に示されてい
る。更に、メモリ読出しに際して、フレームタイミング
パルスｉにより一定周期でアドレスをリセットする。従
って、読み出された信号はそれぞれ10ビット／秒の同期
化された信号となる。
以上説明したように本発明による非同期回線同期化回
路は、書込みにおいては、メモリ部は回線速度にて回線
終端部出力信号を回線データとして書き込み、読出しに
おいては、読出クロック作成部は非同期回線に対して共
通に一定周期ごとにアドレスをリセットし、非同期回線
の最低速度より低い周波数でメモリ部の内容を読み出す
ようにしたことにより、読出クロックを各回線で共通な
ものとすることができ、非同期回線から必要量の信号ビ
ットのみを抽出し同期化でき、位相比較回路が不要とな
り、回路規模が大きくならない効果がある。また、最も
速度が遅い回路の速度に合わせて運用する必要もない。
路は、書込みにおいては、メモリ部は回線速度にて回線
終端部出力信号を回線データとして書き込み、読出しに
おいては、読出クロック作成部は非同期回線に対して共
通に一定周期ごとにアドレスをリセットし、非同期回線
の最低速度より低い周波数でメモリ部の内容を読み出す
ようにしたことにより、読出クロックを各回線で共通な
ものとすることができ、非同期回線から必要量の信号ビ
ットのみを抽出し同期化でき、位相比較回路が不要とな
り、回路規模が大きくならない効果がある。また、最も
速度が遅い回路の速度に合わせて運用する必要もない。
第１図は本発明による非同期回線同期化回路の一実施例
を示すブロック系統図、第２図は第１図のブロック系統
の動作を説明するためのタイムチャート、第３図は従来
の非同期回線同期化回路を示すブロック系統図、第４図
は第３図のブロック系統の動作を説明するためのタイム
チャートである。 T1,T2……端子、１……回線終端部、２……回線多重化
部、３……タイムスロット入換部、４……メモリ部、５
……読出クロック作成部。
を示すブロック系統図、第２図は第１図のブロック系統
の動作を説明するためのタイムチャート、第３図は従来
の非同期回線同期化回路を示すブロック系統図、第４図
は第３図のブロック系統の動作を説明するためのタイム
チャートである。 T1,T2……端子、１……回線終端部、２……回線多重化
部、３……タイムスロット入換部、４……メモリ部、５
……読出クロック作成部。
Claims (1)
- 【請求項１】各非同期回線からの信号を各回線速度で各
個にサンプリングする複数の回線終端部と、回線データ
を記憶する複数のメモリ部と、読出クロックを作成する
読出クロック作成部とを備え、書込みにおいては、前記
メモリ部は前記回線速度にて対応する前記回線終端部の
出力信号を前記回線データとして書き込み、読出しにお
いては、前記読出しクロック作成部は前記各非同期回線
に対応する各メモリ部に対して共通に一定周期毎にアド
レスをリセットするとともに、前記非同期回線の最低速
度より低い周波数の共通の読出クロックで前記各メモリ
部から必要量の回線データを読み出すことを特徴とする
非同期回線同期化回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63132639A JP2754574B2 (ja) | 1988-06-01 | 1988-06-01 | 非同期回線同期化回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63132639A JP2754574B2 (ja) | 1988-06-01 | 1988-06-01 | 非同期回線同期化回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01303822A JPH01303822A (ja) | 1989-12-07 |
| JP2754574B2 true JP2754574B2 (ja) | 1998-05-20 |
Family
ID=15086032
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63132639A Expired - Lifetime JP2754574B2 (ja) | 1988-06-01 | 1988-06-01 | 非同期回線同期化回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2754574B2 (ja) |
Family Cites Families (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6313437A (ja) * | 1986-07-03 | 1988-01-20 | Nec Corp | 多重化回路 |
| JPS6318833A (ja) * | 1986-07-11 | 1988-01-26 | Nec Corp | 符号化装置 |
-
1988
- 1988-06-01 JP JP63132639A patent/JP2754574B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH01303822A (ja) | 1989-12-07 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20080306 Year of fee payment: 10 |
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| FPAY | Renewal fee payment (event date is renewal date of database) |
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