JP2597072B2 - 複合被膜を沈積する方法 - Google Patents

複合被膜を沈積する方法

Info

Publication number
JP2597072B2
JP2597072B2 JP5100845A JP10084593A JP2597072B2 JP 2597072 B2 JP2597072 B2 JP 2597072B2 JP 5100845 A JP5100845 A JP 5100845A JP 10084593 A JP10084593 A JP 10084593A JP 2597072 B2 JP2597072 B2 JP 2597072B2
Authority
JP
Japan
Prior art keywords
tungsten
silicon
flow rate
substrate
deposition
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Lifetime
Application number
JP5100845A
Other languages
English (en)
Other versions
JPH07118855A (ja
Inventor
エル.ブロス ダニエル
Original Assignee
ジーナス インコーポレイテッド
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by ジーナス インコーポレイテッド filed Critical ジーナス インコーポレイテッド
Publication of JPH07118855A publication Critical patent/JPH07118855A/ja
Application granted granted Critical
Publication of JP2597072B2 publication Critical patent/JP2597072B2/ja
Anticipated expiration legal-status Critical
Expired - Lifetime legal-status Critical Current

Links

Classifications

    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C16/00Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
    • C23C16/02Pretreatment of the material to be coated
    • C23C16/0227Pretreatment of the material to be coated by cleaning or etching
    • C23C16/0245Pretreatment of the material to be coated by cleaning or etching by etching with a plasma
    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C16/00Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
    • C23C16/02Pretreatment of the material to be coated
    • C23C16/0272Deposition of sub-layers, e.g. to promote the adhesion of the main coating
    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C16/00Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
    • C23C16/44Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/28Manufacture of electrodes on semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/268
    • H01L21/283Deposition of conductive or insulating materials for electrodes conducting electric current
    • H01L21/285Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation
    • H01L21/28506Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation of conductive layers
    • H01L21/28512Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation of conductive layers on semiconductor bodies comprising elements of Group IV of the Periodic Table
    • H01L21/28518Deposition of conductive or insulating materials for electrodes conducting electric current from a gas or vapour, e.g. condensation of conductive layers on semiconductor bodies comprising elements of Group IV of the Periodic Table the conductive layers comprising silicides
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/302Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to change their surface-physical characteristics or shape, e.g. etching, polishing, cutting
    • H01L21/306Chemical or electrical treatment, e.g. electrolytic etching
    • H01L21/3065Plasma etching; Reactive-ion etching
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/70Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
    • H01L21/71Manufacture of specific parts of devices defined in group H01L21/70
    • H01L21/768Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
    • H01L21/76838Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
    • H01L21/76877Filling of holes, grooves or trenches, e.g. vias, with conductive material
    • H01L21/76879Filling of holes, grooves or trenches, e.g. vias, with conductive material by selective deposition of conductive material in the vias, e.g. selective C.V.D. on semiconductor material, plating
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/70Manufacture or treatment of devices consisting of a plurality of solid state components formed in or on a common substrate or of parts thereof; Manufacture of integrated circuit devices or of parts thereof
    • H01L21/71Manufacture of specific parts of devices defined in group H01L21/70
    • H01L21/768Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics
    • H01L21/76838Applying interconnections to be used for carrying current between separate components within a device comprising conductors and dielectrics characterised by the formation and the after-treatment of the conductors
    • H01L21/76886Modifying permanently or temporarily the pattern or the conductivity of conductive members, e.g. formation of alloys, reduction of contact resistances
    • H01L21/76889Modifying permanently or temporarily the pattern or the conductivity of conductive members, e.g. formation of alloys, reduction of contact resistances by forming silicides of refractory metals
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/52Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames
    • H01L23/522Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames including external interconnections consisting of a multilayer structure of conductive and insulating layers inseparably formed on the semiconductor body
    • H01L23/532Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames including external interconnections consisting of a multilayer structure of conductive and insulating layers inseparably formed on the semiconductor body characterised by the materials
    • H01L23/53204Conductive materials
    • H01L23/53209Conductive materials based on metals, e.g. alloys, metal silicides
    • H01L23/53257Conductive materials based on metals, e.g. alloys, metal silicides the principal metal being a refractory metal
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/0001Technical content checked by a classifier
    • H01L2924/0002Not covered by any one of groups H01L24/00, H01L24/00 and H01L2224/00
    • YGENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y10TECHNICAL SUBJECTS COVERED BY FORMER USPC
    • Y10STECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y10S438/00Semiconductor device manufacturing: process
    • Y10S438/906Cleaning of wafer as interim step

Landscapes

  • Engineering & Computer Science (AREA)
  • Chemical & Material Sciences (AREA)
  • Physics & Mathematics (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • Power Engineering (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Computer Hardware Design (AREA)
  • General Physics & Mathematics (AREA)
  • Manufacturing & Machinery (AREA)
  • General Chemical & Material Sciences (AREA)
  • Organic Chemistry (AREA)
  • Metallurgy (AREA)
  • Mechanical Engineering (AREA)
  • Materials Engineering (AREA)
  • Chemical Kinetics & Catalysis (AREA)
  • Plasma & Fusion (AREA)
  • Chemical Vapour Deposition (AREA)
  • Electrodes Of Semiconductors (AREA)
  • ing And Chemical Polishing (AREA)

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】この発明は低圧化学蒸気沈積(C
DV)により、半導体ウエーハ上にタングステン及びシ
リコンの錯化合物を沈積することに関する。
【0002】
【発明の背景】集積回路の装置の形状の縮小が進むにつ
れて、改良された微小回路製造技術並びに材料に対する
要望が強くなっている。現在利用し得る処理方法は1乃
至 1.5マイクロメータという小さい寸法を限定すること
ができるが、更に小さい形状が望まれている。然し、乾
式食刻及び製版技術の改良により、高密度のVLSI回
路の寸法は、この探求に対する主要な障害が既に明らか
になる様な点までに至っている。
【0003】
【発明が解決しようとする課題】例えば多結晶シリコン
(ポリSi)を使うこと、即ち、LSI−MOS装置で
現在使われている最も普通のゲート電極及び層間接続材
料を使うことは、重要な問題である。ポリSiは良好な
酸化特性、高い温度に於ける機械的な安定性、すぐれた
ステップ・カバリッジ及び接着力という様な多くの望ま
しい性質を持っているが、抵抗値が比較的大きいという
大きな欠点がある。大抵の用途では、著しくドープした
ポリSiの 5,000Å層の典型的なシート抵抗である20
乃至30オーム/スクエアのシート抵抗は回路の設計に
於ける大きな制約とはならない。然し、VLSIの設計
にとっては、こういう大きさの抵抗値は大きな制約とな
る。これは、大形のVLSI回路は長くて細い線を必要
とし、その結果、RC時間の制約が許容し難がたいもの
になり、こうして形状を非常に縮小した時の高速性能が
制限されるからである。その結果、MOS回路の設計が
更に改良されるかどうかは、更に進歩した相互接続技術
が開発されるかどうかにかかっていると思われる。
【0004】ポリSiの相互接続部に代わるものとし
て、耐火金属及び耐火金属珪化物が魅力のある候補と思
われ、最近研究が進められている。耐火金属、例えばタ
ングステンは、典型的にはポリSiよりもバルク抵抗値
が小さいが、一般的に酸化特性がよくなく、半導体業界
で普通に使われる洗滌剤である過酸化水素/硫酸中で容
易に食刻される。更に、焼鈍後の接着力が不良であり、
2酸化シリコン上では特にそうである。このため、現在
では、限られた範囲でしか受入れられていない。他方、
耐火金属珪化物は、耐火金属自体よりもバルク比抵抗は
一層大きいが、一般的にすぐれた酸化抵抗を持ち、IC
ウエーハ処理と合う様にするその他の性質をも持ってい
る。例えば珪化物はICウエーハ処理温度に於ける安定
性があり、良好な接着力、良好な化学抵抗及び良好な乾
式食刻特性を持っている。
【0005】こういう珪化物を形成するための幾つかの
方式が使われているが、何れもかなりの問題がある。共
同蒸着は限界的なステップ・カバリッジ及び焼鈍中のか
なりの収縮を持つ被膜を作る傾向がある。後者は接着力
の問題を招く。共同スパッタリングした被膜は、ステッ
プ・カバリッジがよくなるが、被膜にかなりの量のアル
ゴンが含まれ、焼鈍中もかなりの収縮がある。圧成した
珪化物ターゲットからスパッタリングした被膜は収縮を
最小限に抑えると思われるが、酸素、炭素及びアルゴン
の汚染により一般的に被膜はバルク比抵抗が大きいとい
う様に性質が劣る。
【0006】或るCVD装置が限られた範囲で成功を収
めたが、報告された化合物は粗い面を持っていて、柱状
の構造、結合された構造又はモジュール形の構造である
か、或いは塵埃粒子の形をしている。(アプライド・フ
イジイックス・レターズ誌1981年9月1日、39(5)
所載のK.アキモト、及びK.ワタナベの論文「プラズ
マ化学蒸気沈積によるWx Si1-x の形成」参照。) タングステン珪化物の特定の場合、この沈積は、標準型
の石英又はバイコール管の反応器内でシラン中で6弗化
タングステンが還元されることによって起こるのが典型
的である。一般的に、基板表面に於ける反応は次の様に
なるものと考えられる。
【0007】SiH4 →Si+4H WF6 +6H→W+6HF W+Si→WSi2 7W+3WSi2 →2W5 Si3 (プロシーディング・オブ・ザ・4−th・インターナ
ショナル・コンファレンス・オン・CVD第74頁乃至
第83頁所載のジーシュエ・ロー他の論文「タングステ
ン−シリコン系のCDVの研究」参照。)
【0008】大抵の高温壁装置では、或る程度の気相反
応も考えられ、これによって重大な有害な影響が起こり
得る。特にウエーハを汚染する惧れのある塵埃粒子が形
成される。
【0009】熱駆動形のプロセスでこういう珪化物を沈
積する際の問題は、1つには6弗化タングステン中のシ
ラン反応性が非常に強いことによるものであり、これに
よって非常に高い表面反応速度になる。更に、形成され
た化合物の化学量論は、タングステン分が多くなる傾向
があり、従ってこの後の処理環境にさらされた時、不安
定になる。反応は非常に急速に且つ低い沈積温度で進
み、このため、結果は、厚さも一様性も、制御が困難で
ある。更に、この反応は基板の所望の面の上だけでな
く、反応室内にあるこの他の利用し得る面でも進行し、
制御が尚更難しくなると共に、その上に沈積しようとす
るウエーハを汚染する惧れのある粒状物を最終的に生ず
る。
【0010】タングステン珪化物を沈積する場合のこう
いう問題の幾分かは、新たに開発された低温壁沈積装置
を使うことによって解決された。この装置の詳細は、19
83年3月29日出願された係属中の米国特許出願通し番
号第 480,030号に記載されている。この装置では、でき
た表面は一般的に品質が高く、シリコン分が多く、典型
的には、化学式WSixで表わすと、xを 2.0と 4.0の
間で変えることができる。こういう被膜は良好なステッ
プ・カバリッジを持ち、即ち、垂直の階段に対して85
%をこえるステップ・カバリッジを持つと共に、ウエー
ハを 1,000℃で10分間焼鈍した時は75マイクロオー
ムcm未満、そして 1,100℃で10分間焼鈍した時は、5
0マイクロオームcm未満のバルク比抵抗が得られる。然
し、焼鈍前のバルク比抵抗はずっと高く、典型的には5
00乃至800マイクロオームcm程度である。この焼鈍
過程はVSLI回路の浅い接合の様な、熱サイクルの影
響を受け易い系では望ましくない。焼鈍が大きなウエー
ハに反りを招く原因にもなり得る。
【0011】従って、珪化物被膜の品質が最近改善され
たと言っても、比抵抗が小さく、すぐれたステップ・カ
バリッジを持ち、半導体基板並びに酸化物に対する接着
がよく、良好な酸化抵抗を持ち、焼鈍を必要としない様
な被膜に対する現在の業界の必要条件は充たされていな
い。
【0012】
【課題を解決するための手段】この発明の好ましい実施
例では、xを2より大きいとして、WSix の第1の層
を持ち、その上に実質的にタングステンで構成され、典
型的には5重量%未満の少量のシリコンを持つタングス
テン錯化合物の第2の層を沈積した複合被膜を提供す
る。両方の層は500乃至550℃の基板温度で低温壁
化学蒸気沈積室内でその場所で沈積される。この沈積は
500℃より低い所で行なわれるが、酸化物に対する被
膜の接着力は500℃より下では限界的である。
【0013】この第1及び第2の層に対する沈積過程を
開始する前に、これらを沈積する基板は2つの工程から
成るプロセスにより、最初にプラズマ食刻される。最初
は、NF3 を反応ガスとし、次に、H2 を反応ガスとす
る。両方の工程は約100乃至200ボルトの自己バイ
アスで行なわれる。この2つの工程から成る食刻によ
り、その表面にシリコン、2酸化シリコン、窒化物又は
その他の材料を持つ基板に対する複合被膜の接着力がよ
くなる様に表面が用意される。
【0014】次に、タングステン珪化物の流量の20乃
至80倍のガス流量のシランを用いて、基板の表面にW
Six を沈積する。WSix を沈積した後、6弗化タン
グステンのガス流量をシランの流量の1乃至3倍にし且
つ水素のガス流量をシランの流量の約10倍にして、タ
ングステン錯化合物を第2の層として沈積する。この結
果できる複合被膜はすぐれたステップ・カバリッジ、低
いバルク比抵抗、小さい接触抵抗、関心のある全ての面
に対するすぐれた接着力を持ち、湿式食刻に対して不透
過性である。
【0015】同様に、別の実施例では、最初の実施例の
第2の層のタングステンに対するのと同じ方法を用い
て、直接的にシリコンの表面に、珪化物の層なしにタン
グステン錯化合物を沈積する。この結果得られるタング
ステン錯化合物の単一層被膜は、最初の実施例の第2の
層と同じ組成及び作用を持つ様に思われる。その独特の
性質に基づいて、これはタングステン及びシリコンの組
合せの新しい組成物を構成するが、これはその製法によ
って説明するのが最も判り易い。
【0016】
【実施例】図1に示す基板101は、今日の半導体装置
を製造する場合に見られる様なシリコンの表面107及
び2酸化シリコン109を持っている。この発明の好ま
しい実施例では、これらの表面の上にタングステン珪化
物の第1の層111が配置されている。この第1の層は
xを2より大きいか又は2に等しいとし、好ましくは2
乃至4の範囲内として、化学式WSix を持つタングス
テン珪化物をCVDによってその場所で沈積する。
【0017】層111の上に、やはりCVDによってそ
の場所で第2の層121が沈積される。第2の層は、実
質的にタングステンで構成されていて、この中にシリコ
ンが好ましくは5重量%含まれているところの錯化合物
であり、この錯化合物のシリコンの好ましい百分率は5
重量%未満であるが、約 0.1%より多いことが好まし
い。
【0018】この好ましい実施例では、層111及び層
121の両方が、図2及び図3に示す様な低温壁低圧C
VD反応器内で沈積される。この反応器は前に引用した
米国特許出願に記載されているものと略同じである。引
用した米国特許出願には記載されていないが、この発明
の場合に設けられるのは、2本のガス配管、即ち、水素
配管261及びNF3 配管であり、その作用は後で説明
する。
【0019】装置は低圧CVD反応装置であって、円筒
形の真空室又はハウジング11を持ち、その中心には沈
積中にウエーハを保持する基板タレット集成体13があ
る。典型的には、ハウジング11は直径が約60cm、高
さが約30cmであり、アルミニウムで作るのが典型的で
ある。このハウジングは装置にウエーハを導入するため
の真空密の鎖錠ドア12を持っており、その床にはタレ
ット集成体13を入れるための円形孔がある。
【0020】典型的には、ハウジング11は、ハウジン
グの内壁に目立った沈積が起こらない程低い温度まで、
冷却コイル14によって水冷する。一般的に、ハウジン
グの温度は、沈積する特定の材料によって変わるが、タ
ングステン珪化物に対し、ハウジング温度を約100℃
にすれば、内壁に対する望ましくない沈積がかなり減少
する。壁の温度を約80℃より低く、或いは、更に好ま
しくは30℃より低く更に下げれば、尚更劇的である。
【0021】前に述べたこういう温度では、ハウジング
壁に対する沈積が殆どなくなるが、これは恐らく、壁面
に於ける反応剤の解離のために利用し得るエネルギが減
少するため、並びに一般的に化学反応は温度が下がった
時は、その速度が遅くなるためであると考えられる。3
0℃では、室壁に対する沈積はごく少なく、それを測定
するのは非常に困難である。大まかな見積りから、壁に
沈積されるタングステン珪化物の厚さとウエーハに沈積
される厚さとの比は精々1対 1,000であり、或いは尚更
低いと思われる。
【0022】排気マニホルド15がハウジング11に取
付けられ、室を真空にひくことができる様にする。排気
マニホルド15は真空/排気装置17に取付けられる
が、この装置は典型的にはシステム10mT未満にまでポ
ンプで引くことができる。排気マニホルド15は直径 1
0.16cm(4吋)の半円形のアルミニウムの排気高圧室で
構成され、これがハウジングの下方に懸吊されており、
4本の直径は5.08cm(2吋)の接続管19がマニホルド
に沿って一様な間隔で設けられている。これらの接続管
がハウジング11の中に約25cm入り込み、ハウジング
壁と良好な熱接触をして、管も比較的低い温度に保たれ
る様にする。
【0023】各々の接続管は頂部にキャップをはめ、1
つは頂部の近く、そしてもう1つは底部の近くに、典型
的には直径が約 1.9cm(3/4吋)の2つの開口16を
持ち、こうしてハウジングの周縁に沿って合計8個の排
気ポートが分布する様にする。この配置により、排気が
非常に均一になり、沈積過程の間の制御がかなりやり易
くなる。真空/排気装置17は典型的には真空絞り弁及
び制御器、高精度のマノメータ、回転ベーン・ポンプ、
及び圧力を下げ且つ真空を維持する間、ベーン・ポンプ
を昇圧するためのルーツ送風機を持っている。真空の圧
力はプログラム自在であり、マイクロプロセッサ29に
よって監視される。
【0024】反応ガスは典型的には3つのバンクに入っ
ている。第1のバンク25がプロセス・ヘリウム及びシ
ランを保有し、第2のバンク26が水素及びNF3 を保
有し、第3のバンク27がヘリウム担体及び6弗化タン
グステンを保有する。バンク25及び27のガスが、ハ
ウジング11の壁に取付けた混合室28の様な混合室
で、混合されて低い圧力で拡散され、反応ガス混合物を
作り、それがウエーハと直接向い合ってハウジングに導
入される。ガスが一様に導入される様に保証するため、
図3に示す様に、室28の様な8個の混合室がハウジン
グに沿って均一に分布している。
【0025】一般的にタレット集成体13はハウジング
11の底の上で、電気的に隔離された回転真空封じ47
にのっている。平面図(図3)で示す様に、タレット集
成体13は典型的には水平断面が8角形であって、8角
形の各面にウエーハを保持するための、ウエーハ・プラ
テン15の様なウエーハ・プラテン又はチャックを持っ
ている。各々のウエーハ・プラテンは厚さ1.27cm(1/
2吋)のモネル・シート材料から梯形に切取るのが典型
的であり、各々のプラテンの頂部は幅が12.7cm(5吋)
であり、底は幅が約 15.24cm(6吋)であり、梯形の高
さは約 15.24cm(6吋)であって、12.7cm(5吋)のウ
エーハを保有する様に設計されている。
【0026】図3及び図4に示す様に、プラテンを全般
的にその縁で溶接すると共に、上側の8角形リング34
及び下側の8角形リング32に溶接する。高さが約5.08
cm(2吋)で頂部の直径が 26.67cm(10.5吋)であるキ
ャップ31、及び深さが7.62cm(3吋)で底の直径が 2
6.67cm(10.5吋)である底部35も夫々上側及び下側の
8角形リングに溶接し、この集成体をチャック基部リン
グ36に取付ける。チャック基部36は、ハウジング1
1の底にある真空封じ47と接触する時、真空に対して
密な装置を構成する。
【0027】処理の間、タレット集成体13は、沈積の
一様性を高めるために、典型的には1RPM程度の一定
速度で、モータ23によってゆっくりと回転させること
ができる。図4の切欠きに示す様に、タレット集成体1
3は、ランプ24の様な3つのランプのバンクから成る
不動の配列によって、内側から加熱される。各々のバン
クが固体整流器によって制御される8個の500ワット
石英ランプを持っている。
【0028】典型的には、タレット集成体の全体は、腐
食抵抗並びに高温に耐えることができる点で、モネルで
構成される。プラテンがその後面からの熱を、ウエーハ
を配置した前面に伝導する。プラテンの外面の温度はプ
ログラム可能であって、マイクロプロセッサ29によっ
て制御される。タレット集成体の内側を見る不動の赤外
線感知装置により、マイクロプロセッサに対して温度情
報の帰還が送られる。タレット集成体13を回転するこ
とにより、この感知装置が集成体の円周全体にわたる温
度を測定することができる。
【0029】タレット集成体の内、プラテン及びウエー
ハ以外の区域に沈積されない様にするため、タレット集
成体13はキャップ31及び底部35に冷却装置を設け
るのが典型的である。冷却は 0.635cm(1/4吋)の給
水管37で行なわれる。この給水管はキャップ及び底部
の両方と良好な熱接触を保ちながら、その円周を実質的
に横切る。
【0030】典型的には、ハウジング壁に対して行なっ
たのと同じ様に、キャップ及び底部の温度を約30℃よ
り低く保ち、これらの部分に目立った沈積が起こらない
様にし、それと共に真空封じ47が低温状態にとどまる
様に保証する。然し、加熱されたプラテンと給水管37
の円周方向の接触部の間の温度勾配のため、キャップ及
び底部の全面をこういう温度に保つことができないこと
は言うまでもない。
【0031】2キロワットのRF発生装置49がタレッ
ト集成体13に取付けられる。これは、基板のプラズマ
食刻のため、並びに時おりの洗滌のために、H2 及びN
3ガスと共に使うことができる。発生器49の周波数
は 13.56MHzが典型的である。
【0032】この装置を用いて品質の高い複合被膜を作
るため、処理工程は特に調整する。典型的には、室を最
初に窒素でパージする。次に、装置にウエーハを装入
し、ハウジングを10乃至20mTの基本圧力まで下げ
る。
【0033】圧力を下げた後に、最初はNF3 を用い
て、約50mTの室圧で約20cc/分のガス流量で、約1
分間、プラズマ食刻を開始する。次に、2度目はH2
食刻ガスとして約100mT室圧並びに約50cc/分のガ
ス流量で約3分間用いて、ウエーハをプラズマ食刻す
る。この何れの食刻でも、電力密度は典型的には約3乃
至5ワット/平方吋である。
【0034】有効な食刻が行なわれる様にするため、こ
の過程の間、100乃至200ボルトの直流自己バイア
スを保つことが好ましい。更に、約100ボルトより低
い直流自己バイアスでは、食刻過程は比較的効果がない
ことが判った。
【0035】この2つの工程から成る食刻過程の目的
は、後で沈積される複合被膜に対する接着力がよくなる
様に保証することである。そのメカニズムは十分に判っ
ていないが、NF3 がウエーハ面を食刻するが、後で沈
積する被膜があらゆる種類の材料に接着する様にするた
めに、ウエーハ面に残留する弗化物錯体を除去するため
に、H2 食刻が必要であることが判った。
【0036】プラズマ食刻の後、ハウジングをポンプ作
用によって吸出し、この時装置はWSix の層111を
沈積する用意ができる。最初に6弗化タングステン配管
271及びシラン配管251の両方でヘリウムから開始
して、ガス配管の間の相互汚染並びに望ましくない反応
を防止し、次にシランを送り始める。
【0037】典型的な流量は、ヘリウムは100/分、
シランは 1,000cc/分である。次に室圧を約200mTに
設定し、所望の沈積時間の間、典型的には層111の厚
さが約600乃至 1,000Åになるまで、6弗化タングス
テンを約14cc/分の流量でオンする。6弗化タングス
テンの流れを開始する時、目立ったオーバーシュートを
避けるため(20%を超えない)、予防措置を講ずるこ
とが重要である。(一般的にシランの流量は沈積時間並
びに珪化物の所望の化学量論に応じて、6弗化タングス
テンの流量の20乃至80倍にすべきである。6弗化タ
ングステンの最適の最低流量は12.7cm(5吋)のウエ
ーハにつき、約 1.7乃至2.0cc/分であることが判っ
た。)
【0038】沈積の終りに、ガスはオンした時とは逆の
順序でオフに転じ、再びポンプ作用で装置の吸出しを行
なう。典型的な沈積速度は、ガスの流量、温度及び室圧
に応じて、約100乃至約10,000Å/分の範囲で変える
ことができる。然し、500乃至550℃の範囲内の温
度で層111を沈積するのが典型的であり、これが層1
12の沈積温度の好ましい範囲に対応する。これは後で
説明する。
【0039】今述べた様に、珪化物を沈積した後、層1
11と略同じ手順を用いて、シリコンを少量含むタング
ステン錯化合物の層121を沈積する。主な違いは流量
と、この過程の反応剤として水素ガスを添加することで
ある。水素は高い温度で6弗化タングステンをタングス
テンに還元するのを助ける。この層では、6弗化タング
ステンの流量はシランの流量の1乃至3倍にすることが
好ましく、水素ガスはシランの流量の約10倍の流量
で、室に導入する。好ましい実施方法として、シランの
流量を100cc/分、6弗化タングステンの流量を15
0cc/分、及び水素の流量を 1,000cc/分にして、ウエ
ーハ温度を約500℃にすると、層121のタングステ
ン錯化合物の成長速度は約 2,000Å/分になる。
【0040】こうして得られたタングステン錯化合物を
分析したところ、層121はシリコンが全般的に5%重
量未満であり、焼鈍せずに、バルク比抵抗が8乃至10
マイクロオームcmと小さく、80°の階段に対してステ
ップ・カバリッジが95%より大きく、小山が形成され
ず、プラズマ方式によって容易に食刻ができ、ポリシリ
コン、単結晶シリコン、窒化物、2酸化シリコン及びそ
の他の面に対する接着力がすぐれていることが判った。
更に、上記のタングステン錯化合物は湿式食刻に対する
抵抗力が特に強く、これに対して例えば純粋なタングス
テンは、半導体業界で洗滌剤として普通使われる過酸化
水素/硫酸中で食刻されてしまう。
【0041】さらに重要なことは、1020/cm3 の表面
にドーピング濃度でドープしたn形のシリコンに沈積し
た時、ドープしたシリコンに対する複合被膜の接触抵抗
が非常に小さく、2×10-8オームcm2 であるが、それ
に較べてアルミニウムは5×10-6オームcm2 である。
アルミニウムは最も良く使われる相互接続材料の1つで
ある。これは、相互接続の抵抗値が接触抵抗によって左
右される様な小さな形状の場合、特に重要である。例え
ば1ミクロン×1ミクロンという寸法の接点では、n形
シリコンの表面に対するアルミニウムの接触抵抗は約5
00オームであるが、この発明の複合層で構成された同
じ寸法の接点は、接触抵抗が約2オームである。
【0042】別の重要な特徴は、複合層を700℃まで
の温度で加熱しても比抵抗に影響がない様に思われ、接
着力も同じ様に影響を受けないことである。800℃よ
り高い温度では、複合被膜をシリコンの上に沈積した場
合、追加のタングステン珪化物が形成されるが、2酸化
シリコン上の複合被膜では、 1,000℃まで被膜に変化は
認められなかった。然し、この複合被膜で低いバルク抵
抗を得るのに焼鈍を必要としないことを強調しておきた
い。これは、ウエーハを約800℃より多角加熱する
と、浅い接合に難点を招く惧れがある小形のVLSIの
形状ではとくに重要である。この時ドープ剤が更にウエ
ーハの中に拡散し、装置を破壊する。
【0043】この発明の別の実施例は、複合被膜を沈積
する代わりに、タングステン錯化合物の単一層の被膜を
シリコン・ウエーハの上に直接的に沈積するものであ
る。この場合、この単一層被膜に対する処理は複合被膜
の層121に対するものと全く同じである。この実施例
では、単一層被膜の物理的な属性は層121と同一であ
る様に思われ、基板の表面を前と同じ様に2回のプラズ
マ食刻によって予め処理しても、単一層が熱サイクルで
2酸化シリコンに接着しない他は、複合被膜の全ての性
質を持っている。タングステン及びシリコンのこの新し
い組成物の正確な構造は完全に判っていないが、これ
は、タングステン及びシリコンの錯化合物について従来
知られていない性質を明らかに持つものである。
【図面の簡単な説明】
【図1】図1はこの発明の複合被膜の断面図。
【図2】図2は図1の複合被膜を沈積するのに使う低圧
CVD装置をこの装置の真空ハウジングを通る断面で示
した図。
【図3】図3は真空ハウジングの頂部を取外したこのハ
ウジングの平面図。
【図4】図4は低圧CVD装置内に基板を保持するため
の基板タングステンを切欠いた図である。
【符号の説明】
11 ハウジング 13 タレット集成体 25 シラン配管 27 6弗化タングステン配管 49 RF発生装置 101 基板 111 第1の層(WSix の層) 121 第2の層(タングステン錯化合物の層)

Claims (2)

    (57)【特許請求の範囲】
  1. 【請求項1】 タングステン及びシリコンの両方を成
    分とする被膜の沈積に対する受容度を高めるように基板
    を処理する方法に於いて、前記タングステン及びシリコ
    ンの沈積前に、 (イ) NF3 を反応ガスとして使った前記基板をプラ
    ズマ食刻し、 (ロ) 前記工程(イ)の後、H2 を反応ガスとして使
    って前記基板をプラズマ食刻する工程から成る方法。
  2. 【請求項2】 被膜が、 シリコン基板を500乃至550℃の範囲内の温度にS
    iH4 ,WF6 およびH2 の反応ガスの雰囲気内で加熱
    し、これらのガスの流量の比は、SiH4 の流量に対す
    るWF6 の流量の比が1乃至3、SiH4 の流量に対す
    るH2 の流量の比が10になるようにして得られ、シリ
    コン基板に低圧化学蒸気沈積によって沈積され、実質的
    にタングステンであって、シリコンが5重量%未満であ
    り、バルク抵抗値が焼鈍なしに8乃至10マイクロオーム
    cmの範囲内であり、傾斜角80°のステップに対するス
    テップカバリッジが95%を越えるタングステンとシリ
    コンの錯化合物である請求項1記載の方法
JP5100845A 1984-03-16 1993-04-27 複合被膜を沈積する方法 Expired - Lifetime JP2597072B2 (ja)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
US06/590,117 US4629635A (en) 1984-03-16 1984-03-16 Process for depositing a low resistivity tungsten silicon composite film on a substrate
US590117 1984-03-16

Publications (2)

Publication Number Publication Date
JPH07118855A JPH07118855A (ja) 1995-05-09
JP2597072B2 true JP2597072B2 (ja) 1997-04-02

Family

ID=24360943

Family Applications (2)

Application Number Title Priority Date Filing Date
JP60003438A Granted JPS60200966A (ja) 1984-03-16 1985-01-14 複合被膜
JP5100845A Expired - Lifetime JP2597072B2 (ja) 1984-03-16 1993-04-27 複合被膜を沈積する方法

Family Applications Before (1)

Application Number Title Priority Date Filing Date
JP60003438A Granted JPS60200966A (ja) 1984-03-16 1985-01-14 複合被膜

Country Status (4)

Country Link
US (1) US4629635A (ja)
EP (1) EP0157052B1 (ja)
JP (2) JPS60200966A (ja)
DE (1) DE3480309D1 (ja)

Families Citing this family (98)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6784033B1 (en) 1984-02-15 2004-08-31 Semiconductor Energy Laboratory Co., Ltd. Method for the manufacture of an insulated gate field effect semiconductor device
US4629635A (en) * 1984-03-16 1986-12-16 Genus, Inc. Process for depositing a low resistivity tungsten silicon composite film on a substrate
JPH0752718B2 (ja) * 1984-11-26 1995-06-05 株式会社半導体エネルギー研究所 薄膜形成方法
US6786997B1 (en) 1984-11-26 2004-09-07 Semiconductor Energy Laboratory Co., Ltd. Plasma processing apparatus
US6113701A (en) 1985-02-14 2000-09-05 Semiconductor Energy Laboratory Co., Ltd. Semiconductor device, manufacturing method, and system
JPS61250172A (ja) * 1985-04-25 1986-11-07 Fujitsu Ltd タングステンシリサイド膜の成長方法
JPS61270870A (ja) * 1985-05-25 1986-12-01 Mitsubishi Electric Corp 半導体装置
JPS61272379A (ja) * 1985-05-27 1986-12-02 Fujitsu Ltd アルミニウムのcvd方法
US4617087A (en) * 1985-09-27 1986-10-14 International Business Machines Corporation Method for differential selective deposition of metal for fabricating metal contacts in integrated semiconductor circuits
US6673722B1 (en) * 1985-10-14 2004-01-06 Semiconductor Energy Laboratory Co., Ltd. Microwave enhanced CVD system under magnetic field
US6230650B1 (en) 1985-10-14 2001-05-15 Semiconductor Energy Laboratory Co., Ltd. Microwave enhanced CVD system under magnetic field
US4709655A (en) * 1985-12-03 1987-12-01 Varian Associates, Inc. Chemical vapor deposition apparatus
US4796562A (en) * 1985-12-03 1989-01-10 Varian Associates, Inc. Rapid thermal cvd apparatus
JPS62216224A (ja) * 1986-03-17 1987-09-22 Fujitsu Ltd タングステンの選択成長方法
US4732801A (en) * 1986-04-30 1988-03-22 International Business Machines Corporation Graded oxide/nitride via structure and method of fabrication therefor
US4766006A (en) * 1986-05-15 1988-08-23 Varian Associates, Inc. Low pressure chemical vapor deposition of metal silicide
US4968644A (en) * 1986-06-16 1990-11-06 At&T Bell Laboratories Method for fabricating devices and devices formed thereby
EP0251764B1 (en) * 1986-06-30 1996-03-27 Nihon Sinku Gijutsu Kabushiki Kaisha Chemical vapour deposition methods and apparatus
US4849260A (en) * 1986-06-30 1989-07-18 Nihon Sinku Gijutsu Kabushiki Kaisha Method for selectively depositing metal on a substrate
JPH01501985A (ja) * 1986-07-31 1989-07-06 アメリカン テレフォン アンド テレグラフ カムパニー 改良メタライゼーションを有する半導体デバイス
US4684542A (en) * 1986-08-11 1987-08-04 International Business Machines Corporation Low pressure chemical vapor deposition of tungsten silicide
JPS6381948A (ja) * 1986-09-26 1988-04-12 Toshiba Corp 多層配線半導体装置
US5755886A (en) * 1986-12-19 1998-05-26 Applied Materials, Inc. Apparatus for preventing deposition gases from contacting a selected region of a substrate during deposition processing
US5000113A (en) * 1986-12-19 1991-03-19 Applied Materials, Inc. Thermal CVD/PECVD reactor and use for thermal chemical vapor deposition of silicon dioxide and in-situ multi-step planarized process
US4884123A (en) * 1987-02-19 1989-11-28 Advanced Micro Devices, Inc. Contact plug and interconnect employing a barrier lining and a backfilled conductor material
US4812419A (en) * 1987-04-30 1989-03-14 Hewlett-Packard Company Via connection with thin resistivity layer
US5223455A (en) * 1987-07-10 1993-06-29 Kabushiki Kaisha Toshiba Method of forming refractory metal film
US4842687A (en) * 1987-07-16 1989-06-27 Texas Instruments Incorporated Method for etching tungsten
US4828649A (en) * 1987-07-16 1989-05-09 Texas Instruments Incorporated Method for etching an aluminum film doped with silicon
US4822450A (en) * 1987-07-16 1989-04-18 Texas Instruments Incorporated Processing apparatus and method
US4855016A (en) * 1987-07-16 1989-08-08 Texas Instruments Incorporated Method for etching aluminum film doped with copper
US4863558A (en) * 1987-07-16 1989-09-05 Texas Instruments Incorporated Method for etching tungsten
US4832779A (en) * 1987-07-16 1989-05-23 Texas Instruments Incorporated Processing apparatus
US4844773A (en) * 1987-07-16 1989-07-04 Texas Instruments Incorporated Process for etching silicon nitride film
US4820377A (en) * 1987-07-16 1989-04-11 Texas Instruments Incorporated Method for cleanup processing chamber and vacuum process module
US4891488A (en) * 1987-07-16 1990-01-02 Texas Instruments Incorporated Processing apparatus and method
US4830705A (en) * 1987-07-16 1989-05-16 Texas Instruments Incorporated Method for etch of GaAs
US4849067A (en) * 1987-07-16 1989-07-18 Texas Instruments Incorporated Method for etching tungsten
US4904621A (en) * 1987-07-16 1990-02-27 Texas Instruments Incorporated Remote plasma generation process using a two-stage showerhead
US4832778A (en) * 1987-07-16 1989-05-23 Texas Instruments Inc. Processing apparatus for wafers
US4818326A (en) * 1987-07-16 1989-04-04 Texas Instruments Incorporated Processing apparatus
US4832777A (en) * 1987-07-16 1989-05-23 Texas Instruments Incorporated Processing apparatus and method
US4872938A (en) * 1987-07-16 1989-10-10 Texas Instruments Incorporated Processing apparatus
US4838990A (en) * 1987-07-16 1989-06-13 Texas Instruments Incorporated Method for plasma etching tungsten
US4857132A (en) * 1987-07-16 1989-08-15 Texas Instruments Incorporated Processing apparatus for wafers
US4867841A (en) * 1987-07-16 1989-09-19 Texas Instruments Incorporated Method for etch of polysilicon film
US4838984A (en) * 1987-07-16 1989-06-13 Texas Instruments Incorporated Method for etching films of mercury-cadmium-telluride and zinc sulfid
US4816098A (en) * 1987-07-16 1989-03-28 Texas Instruments Incorporated Apparatus for transferring workpieces
US4837113A (en) * 1987-07-16 1989-06-06 Texas Instruments Incorporated Method for depositing compound from group II-VI
US4842676A (en) * 1987-07-16 1989-06-27 Texas Instruments Incorporated Process for etch of tungsten
US4830700A (en) * 1987-07-16 1989-05-16 Texas Instruments Incorporated Processing apparatus and method
US4855160A (en) * 1987-07-16 1989-08-08 Texas Instruments Incorporated Method for passivating wafer
US4842686A (en) * 1987-07-17 1989-06-27 Texas Instruments Incorporated Wafer processing apparatus and method
JPH0656841B2 (ja) * 1987-10-15 1994-07-27 日電アネルバ株式会社 タングステンの選択成長方法
FR2622052B1 (fr) * 1987-10-19 1990-02-16 Air Liquide Procede de depot de siliciure de metal refractaire pour la fabrication de circuits integres
JPH01109770A (ja) * 1987-10-22 1989-04-26 Mitsubishi Electric Corp 半導体装置の製造方法
JPH021988A (ja) * 1987-12-03 1990-01-08 Texas Instr Inc <Ti> 電気的にプログラム可能なメモリ・セル
JP2627756B2 (ja) * 1987-12-17 1997-07-09 富士通株式会社 半導体装置の製造方法
NL8800221A (nl) * 1988-01-29 1989-08-16 Philips Nv Werkwijze voor het vervaardigen van een halfgeleiderinrichting.
JP2768685B2 (ja) * 1988-03-28 1998-06-25 株式会社東芝 半導体装置の製造方法及びその装置
US4988533A (en) * 1988-05-27 1991-01-29 Texas Instruments Incorporated Method for deposition of silicon oxide on a wafer
EP0345400A1 (en) * 1988-06-08 1989-12-13 L'air Liquide, Societe Anonyme Pour L'etude Et L'exploitation Des Procedes Georges Claude Selective CVD for maufacturing semiconductor devices
ES2015776A6 (es) * 1988-10-07 1990-09-01 American Telephone & Telegraph Metodo de fabricacion de dispositivos semiconductores.
KR940000906B1 (ko) * 1988-11-21 1994-02-04 가부시키가이샤 도시바 반도체장치의 제조방법
JPH02298270A (ja) * 1989-02-17 1990-12-10 Tokyo Electron Ltd 成膜方法
US4985372A (en) * 1989-02-17 1991-01-15 Tokyo Electron Limited Method of forming conductive layer including removal of native oxide
NL8900469A (nl) * 1989-02-24 1990-09-17 Imec Inter Uni Micro Electr Werkwijze en toestel voor het aanbrengen van epitaxiaal silicium en silicides.
JP2708533B2 (ja) * 1989-03-14 1998-02-04 富士通株式会社 Cvd装置の残留ガス除去方法
JPH02272727A (ja) * 1989-04-14 1990-11-07 Fujitsu Ltd 配線形成方法
US5104694A (en) * 1989-04-21 1992-04-14 Nippon Telephone & Telegraph Corporation Selective chemical vapor deposition of a metallic film on the silicon surface
JP2888253B2 (ja) * 1989-07-20 1999-05-10 富士通株式会社 化学気相成長法およびその実施のための装置
US4993358A (en) * 1989-07-28 1991-02-19 Watkins-Johnson Company Chemical vapor deposition reactor and method of operation
US5075256A (en) * 1989-08-25 1991-12-24 Applied Materials, Inc. Process for removing deposits from backside and end edge of semiconductor wafer while preventing removal of materials from front surface of wafer
US5043299B1 (en) * 1989-12-01 1997-02-25 Applied Materials Inc Process for selective deposition of tungsten on semiconductor wafer
US5180432A (en) * 1990-01-08 1993-01-19 Lsi Logic Corporation Apparatus for conducting a refractory metal deposition process
EP1069610A2 (en) * 1990-01-08 2001-01-17 Lsi Logic Corporation Refractory metal deposition process for low contact resistivity to silicon and corresponding apparatus
ES2127183T3 (es) * 1990-02-20 1999-04-16 Air Liquide Cuerpo ceramico metalizado y metodo para fabricarlo.
US5043300A (en) * 1990-04-16 1991-08-27 Applied Materials, Inc. Single anneal step process for forming titanium silicide on semiconductor wafer
EP0528795A1 (en) * 1990-04-30 1993-03-03 International Business Machines Corporation Apparatus for low temperature cvd of metals
JPH05347272A (ja) * 1991-01-26 1993-12-27 Sharp Corp 半導体装置の製造方法
JPH088258B2 (ja) * 1991-02-19 1996-01-29 日本電信電話株式会社 パターン形成方法
US5242860A (en) * 1991-07-24 1993-09-07 Applied Materials, Inc. Method for the formation of tin barrier layer with preferential (111) crystallographic orientation
JP3163687B2 (ja) * 1991-11-12 2001-05-08 富士通株式会社 化学気相成長装置及び化学気相成長膜形成方法
US5273588A (en) * 1992-06-15 1993-12-28 Materials Research Corporation Semiconductor wafer processing CVD reactor apparatus comprising contoured electrode gas directing means
US5342652A (en) * 1992-06-15 1994-08-30 Materials Research Corporation Method of nucleating tungsten on titanium nitride by CVD without silane
US5534072A (en) * 1992-06-24 1996-07-09 Anelva Corporation Integrated module multi-chamber CVD processing system and its method for processing subtrates
US5643633A (en) * 1992-12-22 1997-07-01 Applied Materials, Inc. Uniform tungsten silicide films produced by chemical vapor depostiton
US5997950A (en) * 1992-12-22 1999-12-07 Applied Materials, Inc. Substrate having uniform tungsten silicide film and method of manufacture
US5647911A (en) * 1993-12-14 1997-07-15 Sony Corporation Gas diffuser plate assembly and RF electrode
JPH09501612A (ja) * 1994-04-08 1997-02-18 マーク エー. レイ, 選択的プラズマ成長
US6699530B2 (en) * 1995-07-06 2004-03-02 Applied Materials, Inc. Method for constructing a film on a semiconductor wafer
US5489552A (en) * 1994-12-30 1996-02-06 At&T Corp. Multiple layer tungsten deposition process
US5948697A (en) * 1996-05-23 1999-09-07 Lsi Logic Corporation Catalytic acceleration and electrical bias control of CMP processing
US6335280B1 (en) 1997-01-13 2002-01-01 Asm America, Inc. Tungsten silicide deposition process
KR100243291B1 (ko) * 1997-04-30 2000-03-02 윤종용 반도체장치의제조공정에서실리사이드층형성방법
KR100269315B1 (ko) * 1997-11-24 2000-11-01 윤종용 램프가열방식의매엽식장비를이용한반도체장치의제조방법
US6451692B1 (en) * 2000-08-18 2002-09-17 Micron Technology, Inc. Preheating of chemical vapor deposition precursors
DE60022067T2 (de) * 2000-12-28 2006-06-01 Ami Semiconductor Belgium Bvba Verfahren zur chemischen Dampfablagerung von Wolfram auf einem Halbleitersubstrat

Family Cites Families (10)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS49131585A (ja) * 1973-04-20 1974-12-17
JPS5211175A (en) * 1975-07-18 1977-01-27 Toshiba Corp Activated gas reacting apparatus
US4180596A (en) * 1977-06-30 1979-12-25 International Business Machines Corporation Method for providing a metal silicide layer on a substrate
US4391846A (en) * 1979-04-05 1983-07-05 The United States Of America As Represented By The United States Department Of Energy Method of preparing high-temperature-stable thin-film resistors
US4247579A (en) * 1979-11-30 1981-01-27 General Electric Company Method for metallizing a semiconductor element
US4310380A (en) * 1980-04-07 1982-01-12 Bell Telephone Laboratories, Incorporated Plasma etching of silicon
US4359490A (en) * 1981-07-13 1982-11-16 Fairchild Camera & Instrument Corp. Method for LPCVD co-deposition of metal and silicon to form metal silicide
US4411734A (en) * 1982-12-09 1983-10-25 Rca Corporation Etching of tantalum silicide/doped polysilicon structures
US4629635A (en) * 1984-03-16 1986-12-16 Genus, Inc. Process for depositing a low resistivity tungsten silicon composite film on a substrate
JPH0576548A (ja) * 1991-09-13 1993-03-30 Ube Ind Ltd 義歯のリベース法

Also Published As

Publication number Publication date
US4629635A (en) 1986-12-16
JPH07118855A (ja) 1995-05-09
JPH0576548B2 (ja) 1993-10-22
DE3480309D1 (en) 1989-11-30
EP0157052A1 (en) 1985-10-09
EP0157052B1 (en) 1989-10-25
JPS60200966A (ja) 1985-10-11

Similar Documents

Publication Publication Date Title
JP2597072B2 (ja) 複合被膜を沈積する方法
US4851295A (en) Low resistivity tungsten silicon composite film
US4565157A (en) Method and apparatus for deposition of tungsten silicides
KR100355914B1 (ko) 저온플라즈마를이용한직접회로제조방법
JP3740508B2 (ja) 窒化チタンのプラズマエンハンスアニール処理
US4563367A (en) Apparatus and method for high rate deposition and etching
US5064683A (en) Method for polish planarizing a semiconductor substrate by using a boron nitride polish stop
US5695819A (en) Method of enhancing step coverage of polysilicon deposits
KR100356264B1 (ko) 암모니아를사용하는질화티타늄의플라즈마강화화학증착
JPH10144628A (ja) 薄膜の改良堆積法
JP2001185500A (ja) Cvdチャンバを現場でエッチングして清浄化するための装置及び方法
GB2195663A (en) Chemical vapour deposition method and apparatus therefor
JPS6333569A (ja) 金属薄膜の製造方法
US20020168840A1 (en) Deposition of tungsten silicide films
JP3578155B2 (ja) 被処理体の酸化方法
US7033939B2 (en) Chemistry for chemical vapor deposition of titanium containing films
EP0388957A2 (en) Process for depositing tantalum oxide film and chemical vapor deposition system used therefore
US4794019A (en) Refractory metal deposition process
US20020162500A1 (en) Deposition of tungsten silicide films
US4920908A (en) Method and apparatus for deposition of tungsten silicides
JPH09249972A (ja) 薄膜形成方法、半導体装置及びその製造方法
JPH0765179B2 (ja) 化学的気相成長方法
JPH0327565A (ja) 容量絶縁膜の形成方法
Tedrow et al. Plasma-enhanced chemical vapor deposition
JPH0414188B2 (ja)

Legal Events

Date Code Title Description
EXPY Cancellation because of completion of term
R250 Receipt of annual fees

Free format text: JAPANESE INTERMEDIATE CODE: R250